意味 | 例文 (4件) |
SLN-1とは 意味・読み方・使い方
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遺伝子名称シソーラスでの「SLN-1」の意味 |
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SLN-1
mouse | 遺伝子名 | SLN-1 |
同義語(エイリアス) | matrix metallopeptidase 3; Stromelysin-1 precursor; stromelysin 1; Transin-1; stromelysin-1; EMS-2; Matrix metalloproteinase-3; Stmy1; SL-1; Str1; SLN1; MMP-3; progelatinase; Mmp3 | |
SWISS-PROTのID | SWISS-PROT:P28862 | |
EntrezGeneのID | EntrezGene:17392 | |
その他のDBのID | MGI:97010 |
yeast | 遺伝子名 | SLN1 |
同義語(エイリアス) | Osmolarity two-component system protein SLN1; YPD2; YIL147C | |
SWISS-PROTのID | SWISS-PROT:P39928 | |
EntrezGeneのID | EntrezGene:854659 | |
その他のDBのID | SGD:S000001409 |
本文中に表示されているデータベースの説明
「SLN-1」の部分一致の例文検索結果
該当件数 : 4件
The data voltage source Vdata applies a positive voltage to data lines DL1 to DLm and the first and second scan voltage sources Vin1 to Vin2 apply a negative voltage and a positive voltage to scan lines SL1 to SLn.例文帳に追加
データ電圧源Vdataは、データラインDL1〜DLmに正極性電圧を印加し、第1および第2スキャン電圧源Vin1〜Vin2は、スキャンラインSL1〜SLnに負極性電圧および正極性電圧を印加する。 - 特許庁
In an active matrix type liquid crystal display device 1, a coupling signal S0 corresponding to the sum total of outputs of all data signal lines SL1 to SLn is detected by a detection bus line 12 crossing data signal lines SL1 to SLn.例文帳に追加
アクティブマトリクス型の液晶表示装置1において、データ信号線SL_1 〜SL_n に交差する検出用バスライン12によって、全データ信号線SL_1 〜SL_n の出力の総和に応じたカップリング信号S0が検出される。 - 特許庁
When the image to be displayed is not the raw image, the source driver 300 applies sampling video signals AVs outputted from the sample-and-hold circuits SH1 to SHn-1 to the video signal lines SL2 to SLn like a conventional method.例文帳に追加
ベタ画像でなければ、ソースドライバ300は、従来通り、サンプルホールド回路から出力されたサンプリング映像信号AVsを映像信号線SL2〜SLnに印加する。 - 特許庁
A selector 4 is controlled to select pixel data which are transmitted from the DMA controller 3 and inputted to a '0' side terminal or pixel data which are fed back from the line memory 5 and inputted to the '1' side terminal in accordance with the level of a line signal SLN inputted from the resolution conversion part 6 and to output it to the line memory 5.例文帳に追加
セレクタ4は、解像度変換部6から入力するライン信号SLNのレベルに応じて、DMAコントローラ3から伝達され「0」側端子に入力する画素データと、ライン・メモリ5から帰還して「1」側端子に入力する画素データとの何れかを選択してライン・メモリ5に出力するよう制御される。 - 特許庁
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