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Chip Banksとは 意味・読み方・使い方
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ウィキペディア英語版での「Chip Banks」の意味 |
Chip Banks
出典:『Wikipedia』 (2011/07/18 01:41 UTC 版)
「Chip Banks」の部分一致の例文検索結果
該当件数 : 12件
The memory module 8 is provided with first and second banks 12, 13 to be respectively addressed of the DSP of the memory chip.例文帳に追加
メモリ・モジュール8は、メモリ・チップのDSPの第1および第2のそれぞれアドレス可能なバンク12,13を有する。 - 特許庁
To provide a semiconductor memory capable of easilily dealing with the extension of banks without increasing chip area and realizing high speed access.例文帳に追加
チップ面積を増大させることなくバンク拡張に容易に対応できかつ高速アクセスを実現することのできる半導体記憶装置を提供する。 - 特許庁
A resin chip 21 on the upper side is aligned onto a joint face 23 between a resin chip 22 on the lower side and itself, and it has a pair of earth wire holding banks 24 at positions on both right and left sides of the shield wire 1 for holding an earth wire 2.例文帳に追加
上側となる樹脂チップ21は、下側となる樹脂チップ22との接合面23の位置に合わせ、且つ、シールド電線1の左右両側となる位置に、アース線2を保持するための一対のアース線保持用土手24を有している。 - 特許庁
To reduce costs by reducing chip sizes of a synchronous DRAM or the like by reducing an amount of hardware of circuits necessary for bank control of the synchronous DRAM or the like having a plurality of banks.例文帳に追加
複数のバンクを備えるシンクロナスDRAM等のバンク制御に必要な回路のハードウェア量を削減して、シンクロナスDRAM等のチップサイズを縮小し、その低コスト化を図る。 - 特許庁
Both banks of the memory chip is placed on at least one high power state and at least one low power state by either of the system memory controller or the DSP.例文帳に追加
メモリ・チップの両方のバンクは、システム・メモリ・コントローラまたはDSPのいずれかによって、少なくとも1つの高電力状態と少なくとも1つの低電力状態とに置くことができる。 - 特許庁
The resin chip 22 on the lower side is aligned onto the joint face 23, and it has a pair of earth wire holding banks 26 at positions on both right and left sides of the shield wire 1 for holding the earth wire 2.例文帳に追加
下側となる樹脂チップ22は、接合面23の位置に合わせ、且つ、シールド電線1の左右両側となる位置に、アース線2を保持するための一対のアース線保持用土手26を有している。 - 特許庁
To shorten the time required for writing a flash memory having a plurality of banks while enhancing the processing capacity of a computer system including it and to reduce the chip size and the cost of a flash memory.例文帳に追加
複数のバンクを備えるフラッシュメモリ等の書き込み所要時間を短縮し、これを含むコンピュータシステム等の処理能力を高めるとともに、フラッシュメモリ等のチップサイズを縮小し、その低コスト化を図る。 - 特許庁
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「Chip Banks」の部分一致の例文検索結果
該当件数 : 12件
The defective address storing circuit 180 to 183 and the comparing circuits 190 to 193 are allocated commonly for two banks respectively, thereby, the chip area can be reduced.例文帳に追加
不良アドレス記憶回路180〜183及び比較回路190〜193は、それぞれ2つバンクに対して共通に割り当てられており、これによりチップ面積を縮小することが可能となる。 - 特許庁
To provide a nonvolatile semiconductor memory in which decoder part area overhead of a nonvolatile semiconductor memory provided with a plurality of banks and a page read function is suppressed and a chip cost can be reduced.例文帳に追加
複数バンクとページ読み出し機能を共に備えた不揮発性半導体メモリのデコーダ部面積オーバーヘッドを抑え、チップコストを低く抑えることができる不揮発性半導体メモリを提供することを目的としている。 - 特許庁
A semiconductor integrated circuit (1) includes a plurality of memory banks (BNK0-BNK7) formed on a semiconductor chip (1A), a plurality of write buffers (WB0-WB3), an external input circuit (I/F1) and a control circuit (MCNT).例文帳に追加
半導体集積回路(1)は、半導体チップ(1A)上に形成された複数のメモリバンク(BNK0〜BNK7)と、複数のライトバッファ(WB0〜WB3)と、外部入力回路(I/F1)と、制御回路(MCNT)とを有する。 - 特許庁
The core chips CC0-CC7 each output a local bank active signal MCIDT, indicative of whether at least one of a plurality of memory banks included therein is in an active state, to the interface chip IF respectively, and the interface chip IF activates a bank active signal PMCIT when at least one of local bank active signals MCIDT indicates an active state.例文帳に追加
コアチップCC0〜CC7は、其々に含まれる複数のメモリバンクの少なくとも1つがアクティブ状態であるか否かを示すローカルバンクアクティブ信号MCIDTをインターフェースチップIFに其々出力し、インターフェースチップIFは、ローカルバンクアクティブ信号MCIDTの少なくとも1つが活性状態を示すときにバンクアクティブ信号PMCITを活性化させる。 - 特許庁
Therefore, in this device, efficiency of a memory chip is improved by dividing plural memory banks into input/output sense amplifier blocks, pairs of wide band input/output lines are crossed and addressing of a bank is made easy by arranging input/output line transmitting transistors and sense amplifier driving transistors alternately, then high speed operation margin can be improved.例文帳に追加
したがって、本発明では入出力センス増幅器ブロックに複数のメモリバンクを分割することによりメモリチップ能率を改善して、入出力ライン伝達トランジスタとセンス増幅器駆動トランジスタの配置領域を交互で配置することにより広域入出力ライン対を交差してバンクのアドレッシングを容易にして、高速動作マージンを改善することができる。 - 特許庁
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