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D&Csとは 意味・読み方・使い方
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「D&Cs」の部分一致の例文検索結果
該当件数 : 22件
d # rc-update add sshd default Note: Emerge pcmciautils if you need support for PCMCIA cards.発音を聞く 例文帳に追加
必要に応じて、pcmcia-csをemergeしデフォルトランレベルに追加します。 - Gentoo Linux
This device is provided with a liquid crystal panel 1, a D/A conversion part 2, a video amplifier 3, a common electrode/Cs line drive circuit 4 and a timing controller 5.例文帳に追加
本発明の液晶表示装置は、液晶パネル1と、D/A変換部2と、ビデオアンプ3と、コモン電極/Cs線駆動回路4と、タイミングコントローラ5とを備える。 - 特許庁
A value in a space period in which a pit is not formed among the obtained signal A+D is extracted as an inner periphery side signal Cs.例文帳に追加
得られた信号A+Dのうちピット形成しないスペース期間における値を内周側信号Csとして抽出する。 - 特許庁
A D flip-flop 50 latches the composite synchronizing signal CS by the pulse P3 to generate a polarity discriminating signal S.例文帳に追加
Dフリップフロップ50はコンポジット同期信号CSを第3タイミングパルスP3でラッチして極性判別信号Sを生成する。 - 特許庁
The channel assignment device 19 decides whether or not this PS is in existence in the vicinity of the CS on the basis of the D wave level.例文帳に追加
チャネル割当装置19は、D波レベルに基づいて、このPSが当該CSの近傍に存在しているか否かを判断する。 - 特許庁
A reception level computer 16 computes a D wave level of a PS making a request to a CS for connection and the computer 16 informs a channel assignment device 19 about it.例文帳に追加
CSに接続を要求しているPSのD波レベルを受信レベル計算機16で計算し、チャネル割当装置19に知らせる。 - 特許庁
Thus, the phase difference of the reception data D and the output signals Vco becomes zero in the operation of the phase comparator 2 regardless of the timing of the control signals CS.例文帳に追加
よって、制御信号CSのタイミングに関わらず位相比較器2の動作時には受信データDと出力信号Vcoとの位相差が零となる。 - 特許庁
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「D&Cs」の部分一致の例文検索結果
該当件数 : 22件
Thereafter, a timing correction circuit 7 generates changeover correction control signals KH and corrects the output of control signals CS for switching to the phase comparison of the reception data D and output signals Vco to a timing at which the reception data D are shifted to an Lo level.例文帳に追加
その後、タイミング補正回路7は、切り換え補正制御信号KHを生成し、受信データDと出力信号Vcoとの位相比較に切り換える制御信号CSの出力が受信データDがLoレベルに遷移したタイミングに補正する。 - 特許庁
A comparator compares a voltage level of reference voltage V_H×V_L that an initial-stage D/A converter 1 generates in accordance with digital data of high-order m-bits, and outputs a comparison signal CS.例文帳に追加
比較器4は、初段D/Aコンバータ1が上位mビットのデジタルデータに応じて生成する基準電圧V_H ・V_L の電圧レベルを比較し、比較信号CSを出力する。 - 特許庁
When the difference d is found in a result of the determination, a display part 70 displays warning of vascular calcification and a calcification score CS as information showing the possibility of vascular calcification.例文帳に追加
判定の結果、差dがある場合には、表示部70は、血管石灰化の可能性がある旨の情報として、血管石灰化警告と石灰化指数CSとを表示する。 - 特許庁
Crystallization starts from a plurality of crystal nuclei A, C, D, E, F introduced in an amorphous silicon film in their respective linear directions to grow a plurality of columnar crystals CS approximately oriented in panes.例文帳に追加
非晶質シリコン膜に導入された複数の結晶核A,C,D,E,Fからそれぞれ一方向に結晶化が開始し、結晶方位が概ね揃った複数の柱状結晶CSが成長する。 - 特許庁
A control circuit for A/D converters comprises a control portion 111 for generating CS signals and clock signals sent to the many A/D converters, first and second serial/parallel conversion portions 112 and 113 for converting serial data signals sent from the many A/D converters into parallel data signals, first and second data storage portion 114 and 115 for storing the parallel data.例文帳に追加
ADコンバータ制御回路は複数のADコンバータに対するCS信号、クロック信号を生成するコントロール部111と複数のADコンバータからのシリアルデータ信号をパラレルに変換するシリアルパラレル1変換部112、シリアルパラレル2変換部113とパラレルデータを格納するデータ1格納部114とデータ2格納部115で構成される。 - 特許庁
Si_aCs_bO_d (1) (in the formula (1), Si, Cs and O represent silicon, cesium and oxygen, respectively, and a, b and d represent each atomic ratio, b is 0.01-5 when a is 100, and d is an oxygen atomic ratio required to satisfy valences of other components.).例文帳に追加
Si_aCs_bO_d (1)(式(1)において、Si、CsおよびOはそれぞれケイ素、セシウムおよび酸素を示す。a、bおよびdは各元素の原子比率を示し、a=100のときb=0.01〜5であり、dはその他の成分の原子価を満足するのに必要な酸素の原子比率である。) - 特許庁
A processing circuit 4 once accepts an AD conversion command and after that, does not process the content of a command other than the AD conversion command even if the command is accepted until a termination command for performing termination instruction of A/D conversion processing and an invalid signal of a chip selection signal CS are accepted as termination instruction signals and an A/D conversion part 5 continuously executes the A/D conversion processing.例文帳に追加
処理回路4は、AD変換コマンドを一旦受付けた後、A/D変換処理を終了指示するための終了コマンドやチップセレクト信号CSの無効信号を終了指示信号として受け付けるまでAD変換コマンド以外のコマンドを受け付けたとしても当該コマンドの内容を処理することなく、A/D変換部5がA/D変換処理を継続実行する。 - 特許庁
When a rise edge of a chip-select signal CS inputted to an EEPROM by a microcomputer is detected by a D flip-flop 10, a data input control section 3 permits input of serial data DI based on the edge detection.例文帳に追加
データ入力制御部3は、マイコンによってEEPROM2に入力されるチップセレクト信号CSの立上がりエッジをDフリップフロップ10により検出すると、そのエッジ検出に基づいてシリアルデータDIの入力を許可する。 - 特許庁
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