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vss-1とは 意味・読み方・使い方
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遺伝子名称シソーラスでの「vss-1」の意味 |
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「vss-1」の部分一致の例文検索結果
該当件数 : 67件
When '1' is read out, the SA node 33 approaches to Vss slowly.例文帳に追加
“1”読み出しのときは、SAノード33は、緩やかにVssに近づく。 - 特許庁
(b) is impressed between VDD-VSS of a microcomputer 1 by the chattering at the soldering time.例文帳に追加
ハンダ付け時のチャタリングで、マイコン1のV_DD〜V_SS間に図(b)の電圧がかかる。 - 特許庁
A Vss potential is supplied to the Vss terminal 5 of the respective 1-chip microcomputers 2 and 3 through a common inner layer conductor pattern 16 and common via hole conductors 18 and 19.例文帳に追加
各1チップマイコン2、3のVss端子5は、共通の内層導体パターン16、共通のビアホール導体18,19を通じてVss電位を供給される。 - 特許庁
A VSS power source line extended from a VSS terminal is branched in the middle, a branched first VSS power source line SL1 is extended clockwise along a display region 10 on an insulation substrate 1 and another branched second VSS power source line SL2 is extended counter-clockwise along the display region 10 on the insulation substrate 1.例文帳に追加
VSS端子から延びたVSS電源線を途中で分岐させ、分岐した第1のVSS電源線SL1は絶縁基板1上を表示領域10に沿って時計回りに延在させ、分岐したもう1本の第2のVSS電源線SL2は、絶縁基板1上を表示領域10に沿って反時計回りに延在させる。 - 特許庁
In place of this, a grounding voltage Vss (non-erasable voltage) is supplied to the wordline WL1 from the decoder circuit 10-1 through the second transistor M2-1.例文帳に追加
その代わり、デコーダ回路10−1から第2のトランジスタM2−1を通してワード線WL1に接地電圧Vss(=非消去電圧)が供給される。 - 特許庁
From the layout of the semiconductor device, an electrostatic discharge protection circuit network comprising pads PAD 1-9, net VDD 1 and 2, VSS 1 and 2, SIG 1, and protection elements 12a-12f are extracted.例文帳に追加
半導体装置のレイアウトからパッドPAD1乃至9、ネットVDD1、2、VSS1、2、SIG1と保護素子12a乃至12fとで構成される静電放電保護回路網を抽出する。 - 特許庁
It is preferable that the amount of the added chlorine dioxide 20 is set to a weight ratio of it to VSS of the digested sludge 12 of 0.2-1%.例文帳に追加
二酸化塩素20の添加量を消化汚泥12のVSSに対し重量比で0.2〜1%とすることが好ましい。 - 特許庁
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「vss-1」の部分一致の例文検索結果
該当件数 : 67件
A capacitor 14-2 is charged from a constant current source 14-1 and the voltage level Vss at point A is increased gradually.例文帳に追加
コンデンサ14−2に定電流源14−1からの電荷を充電させ、点Aの電圧値Vssを除々に上昇させる。 - 特許庁
The current source 18 is provided between the coupling node of the sources of the FET 1 and the FET 2 and a reference potential line VSS.例文帳に追加
電流源18は、FET1およびFET2のソースとの結合ノードと基準電位線VSSとの間に設けられる。 - 特許庁
Figure 3 shows its one example, wherein it shows such structure that a VDD shield wire 2 is arranged on an VSS power wire 10 connected through a plug 9 to the wire 6 arranged within an insulating film 7 on a substrate 8 where a plurality of transistors are arranged, and that a VSS shield wire 1 is arranged on a VSS wire 11.例文帳に追加
図3はその一例で、複数のトランジスタを配置した基板8上の絶縁膜7中に配置した配線6にプラグ9を介して接続したV_SS電源配線10上にV_DDシールド配線2を配置し、V_DD電源配線11上にV_SSシールド配線1を配置した構造を示している。 - 特許庁
The test signal generation circuit is provided with a resistor 3 connecting the test terminal 2 and a predetermined potential (a VSS potential or a VCC 1 potential) together.例文帳に追加
このテスト信号生成回路は、テスト端子2と所定の電位(VSS電位又はVCC1電位)とを接続する抵抗3を有する。 - 特許庁
A minimum interval is made so as to pass only one wiring therebetween, and power supply (VDD, VSS) wirings at a minimum line width are disposed in a vertical axial direction in n layers and in a horizontal axial direction in (n+1) layers to form a lattice-like shield, which is wired with a signal line.例文帳に追加
間に配線が一本通れるだけの最小の間隔を空けて最小線幅の電源(VDD,VSS)配線をn層で縦軸方向、n+1層で横軸方向に配置し格子状のシールドを形成しておき、その間に信号線を配線する。 - 特許庁
A drain of a transistor TR 5 is connected to the gate of the transistor TR 1, a source is connected to the low level Vss, and a gate is connected to the input node C.例文帳に追加
トランジスタTr5は、ドレインがトランジスタTr1のゲートに接続し、ソースが低電位Vssに接続し、ゲートが入力ノードCに接続している。 - 特許庁
One or more power supply pads Vcc and Vss are provided on a main surface of a semiconductor chip 1 for supplying electric power to a semiconductor integrated circuit.例文帳に追加
1以上の電源パッドVcc、Vssは、半導体チップ1の主面上に、半導体集積回路に電力を供給するために設けられている。 - 特許庁
Second VSS wiring 3 is provided at the first wiring layer so as to be adjacent to the first VDD wiring 1, and second VDD wiring 4 is provided at the second wiring layer so as to vertically face the second VSS wiring 3.例文帳に追加
また、第1の配線層には第2のVSS配線3が、第1のVDD配線1と隣り合うように設けられていると共に、第2の配線層には第2のVDD配線4が、第2のVSS配線3と上下に向かい合うように設けられている。 - 特許庁
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