| 意味 | 例文 (12件) |
c112とは 意味・読み方・使い方
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遺伝子名称シソーラスでの「c112」の意味 |
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c112
| human | 遺伝子名 | c112 |
| 同義語(エイリアス) | C1orf13; NPL1; NPL; chromosome 1 open reading frame 13 | |
| SWISS-PROTのID | --- | |
| EntrezGeneのID | EntrezGene:80896 | |
| その他のDBのID | HGNC:16781 |
本文中に表示されているデータベースの説明
「c112」を含む例文一覧
該当件数 : 12件
A script acquisition unit c112 acquires the alternative program from the acquisition destination extracted by the URI determination unit c122.例文帳に追加
スクリプト取得部c112は、URI判定部c122が抽出した取得先から代替プログラムを取得する。 - 特許庁
When the user taps on an upper part of the cell C106, a fourth step displays cells C110 and C112 of the photographing processing name as a list.例文帳に追加
セルC106上をタップされると、第4工程に撮影処理名のセルC110及びC112を一覧表示させる。 - 特許庁
A display control unit c111 executes the alternative program acquired by the script acquisition unit c112, instead of the program to be executed.例文帳に追加
表示制御部c111は、実行予定のプログラムに代えて、スクリプト取得部c112が取得した代替プログラムを実行する。 - 特許庁
A sampling transistor 115 samples an input signal Vsig from a signal line and holds it in a 1st capacity element C112, and a drive transistor 111 drives the load element 117 with a current corresponding to the signal potential held by the 1st capacity element C112.例文帳に追加
サンプリングトランジスタ115は信号線から入力信号Vsigをサンプリングして第1の容量素子C112に保持し、ドライブトランジスタ111は、第1の容量素子C112に保持された信号電位に応じて負荷素子117を電流駆動する。 - 特許庁
A threshold canceling circuit detects the threshold of a drive transistor 111 in advance and makes an additional hold capacitor C112 holds a potential needed to cancel its influence.例文帳に追加
閾電圧キャンセル回路は、ドライブトランジスタ111の閾電圧を検知しあらかじめその影響をキャンセルする為に必要な電位を追加保持容量C112に保持させておく。 - 特許庁
A bootstrap circuit detects characteristic variation of the load element 117 and automatically adjusts the level of the signal potential held by the 1st capacity element C112 so that its influence is canceled.例文帳に追加
ブートストラップ回路は、負荷素子117の特性変動を検知し、その影響を打ち消す様に第1の容量素子C112に保持された信号電位のレベルを自動的に調整する。 - 特許庁
A master key generation part 106 ciphers the plain sentence M110 of a file by the cryptographic key K1, generates a cipher sentence C112, decentralizes the cryptographic key K1 and generates two cryptographic keys a109 and b108.例文帳に追加
マスタ鍵生成部106は、ファイルの平文M110を暗号鍵K1で暗号化して暗号文C112を生成し、暗号鍵K1につき一様な乱数Uで分散化し2つの暗号鍵a109、b108を生成する。 - 特許庁
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「c112」を含む例文一覧
該当件数 : 12件
A sampling transistor 115 writes a signal Vsig inputted from a signal line DTL101 directly to the hold capacitor C111 not through coupling between the additional hold capacity C112 and a capacitor component including the gate capacitance of the drive transistor 111.例文帳に追加
サンプリングトランジスタ115は、信号線DTL101から入力された信号Vsigを、追加保持容量C112及びドライブトランジスタ111のゲート容量を含む容量成分との結合を介することなく、直接保持容量C111に書き込む。 - 特許庁
A mail control part 104 adds a cryptographic key a 112 to the cipher sentence C112, transmits it to a user B as a mail main body, adds the cryptographic key b108 to the mail to which a session key Ke 107, session information (t) and file information F are added and sends the mail later as an auxiliary mail.例文帳に追加
メール制御部104は、暗号文C112に暗号鍵a112を添付しメール本体として利用者Bに送信し、セッション鍵Ke107及びセッション情報t、ファイル情報Fを添付したメールに暗号鍵b108を添付して副メールとして後送する。 - 特許庁
The capacitor C111 is connected between the node ND1 and the second node, the serially connected tuning coil L112 and the capacitor C112 are connected between the node ND1 and the node ND2 in parallel to the tuning coil L111, and an output node of the tuning circuit 1101b by the node ND1 is formed.例文帳に追加
キャパシタC111がノードND1と上記第2のノードとの間に接続され、同調コイルL111と並列に、直列接続された同調コイルL112とキャパシタC112がノードND1とノードND2間に接続され、ノードND1により同調回路1101bの出力ノードが形成されている。 - 特許庁
A tuning circuit 1101b includes a first tuning coil (inductor) L111 and a second tuning coil (inductor) L112 for forming a receiving antenna, a first capacitor C111, a second capacitor C112, and a first node ND1 and a second node ND2 connecting both terminals of a tuning coil L111 respectively.例文帳に追加
同調回路1101bは、受信アンテナを形成する第1の同調コイル(インダクタ)L111、第2の同調コイル(インダクタ)L112、第1のキャパシタC111、第2のキャパシタC112、同調コイルL111の両端子がそれぞれ接続される第1のノードND1、および第2のノードND2とを含む。 - 特許庁
An interpolation capacitor C112 is formed with a compounded capacitor of a capacitor formed between a first wiring layer 123 constituting a gate electrode of a transistor 111 and a polysilicon layer 126 as a semiconductor layer, a capacitor formed between the polysilicon layer and a second wiring layer 128, and a capacitor formed between the second wiring layer 128 and a third wiring layer 130.例文帳に追加
補間容量C112は、トランジスタ111のゲート電極を形成する第1配線層123と半導体層であるポリシリコン層126との間に形成される容量、ポリシリコン層と第2配線層128との間に形成される容量、さらに第2配線層128と第3配線層130との間に形成される容量の合成容量により形成されている。 - 特許庁
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