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JP2518322B2 - Digital subscriber line carrier system - Google Patents
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JP2518322B2 - Digital subscriber line carrier system - Google Patents

Digital subscriber line carrier system

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JP2518322B2 JP62297696A JP29769687A JP2518322B2 JP 2518322 B2 JP2518322 B2 JP 2518322B2 JP 62297696 A JP62297696 A JP 62297696A JP 29769687 A JP29769687 A JP 29769687A JP 2518322 B2 JP2518322 B2 JP 2518322B2
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Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、複数の加入者電話やISDN加入者線等の各種
加入者線信号をPCM一次群信号に多重化する機能を有す
るディジタル加入者線搬送方式に関する。
The present invention relates to a digital subscriber having a function of multiplexing various subscriber line signals such as a plurality of subscriber telephones and ISDN subscriber lines into a PCM primary group signal. It relates to a line transfer system.

[従来の技術] 従来、この種のディジタル加入者線搬送方式は、共通
制御部より多重化する場合の位置決めとなるパルスを各
チャンネルに分配し、それぞれの出力のワイヤードORを
とることにより多重化する方式となっていた。
[Prior Art] Conventionally, a digital subscriber line carrier system of this type is multiplexed by distributing pulses for positioning from a common control unit to each channel and taking a wired OR of each output. It was a method to do.

[発明が解決しようとする問題点] 上述した従来のディジタル加入者線搬送方式は、次の
ような欠点がある。例えば、従来のアナログ電話機の音
声信号をディジタル搬送化する場合、PCM一次群信号上
では64kb/sを使用するため1タイムスロットを占有し、
ISDM電話信号はPCM一次群信号上では192kb/sを使用する
ため3タイムスロットを占有する。そこで、一台のディ
ジタル加入者線搬送装置でアナログ電話加入者及びISDM
電話加入者の両方を収容する場合、1タイムスロットを
占有するチャンネル盤と3タイムスロットを占有するチ
ャンネル盤とが混在することになる。そして、ISDN加入
者線のように3タイムスロットを専有するチャンネル盤
と1タイムスロットを専有するアナログ加入者電話回路
が2セット実装されたチャンネル盤とが同一装置内に混
在する場合には、タイムスロットが重ならないようにす
るため、アナログ加入者電話回路2セット分の4タイム
スロットの中から3タイムスロットを割り当てる必要が
あり、ISDN加入者線にはあらかじめ4タイムスロットを
割り当てねばならず、1タイムスロットが無駄になる。
[Problems to be Solved by the Invention] The conventional digital subscriber line carrier system described above has the following drawbacks. For example, when converting the voice signal of a conventional analog telephone into a digital carrier, one time slot is occupied because 64 kb / s is used on the PCM primary group signal,
The ISDM telephone signal uses 192 kb / s on the PCM primary group signal and therefore occupies 3 time slots. Therefore, one digital subscriber line carrier is used for analog telephone subscribers and ISDM.
When accommodating both telephone subscribers, a channel board occupying one time slot and a channel board occupying three time slots are mixed. When a channel board having three time slots exclusively used for ISDN subscriber lines and a channel board having two sets of analog subscriber telephone circuits having one time slot exclusively installed are mixed in the same device, To prevent the slots from overlapping, it is necessary to allocate 3 time slots from 4 time slots for 2 sets of analog subscriber telephone circuits, and 4 time slots must be allocated to the ISDN subscriber line in advance. Time slots are wasted.

これは、PCM一次群信号上のタイムスロットを埋める
だけの加入者数がいない場合においては、タイムスロッ
トを多少空けた状態で使用しても問題は無いが、一加入
者を収容できないためにディジタル加入者線搬送装置を
もう一台追加する必要がある場合もあり、コストミニマ
ムなシステムを構築するためには、できるだけタイムス
ロットを無駄にしないということが必要である。
This is because if there are not enough subscribers to fill the time slots on the PCM primary group signal, there is no problem in using them with some time slots open, but since one subscriber cannot be accommodated, digital In some cases, it is necessary to add another subscriber line carrier, and in order to construct a cost-minimized system, it is necessary to waste time slots as little as possible.

[問題点を解決するための手段] 本発明のディジタル加入者線搬送方式は、各チャンネ
ル盤に共通に与えられる基準パルス信号とチャンネル盤
が実装される位置によって定められたアドレス信号とを
入力し、自チャンネルが専有すべきタイムスロットを示
す信号を出力するチャンネルパルス発生回路と、受信加
入者線信号を必要に応じディジタル化した後前記タイム
スロットを示す信号位置にnタイムスロット(n=1、
2、…)出力する加入者線インターフェイス回路と、該
nタイムスロット分をそのまま出力するかもしくは高イ
ンピーダンス状態にするかを外部からの制御信号により
決定されるワイヤードOR回路とにより構成される。な
お、前記制御信号は、PCM一次群信号上のタイムスロッ
トと時間的に同期し、該当するタイムスロットを出力す
る場合にはそのタイムスロット分のみ論理値“1"で、出
力せず高インピーダンス状態にする場合及びそのチャン
ネル盤の出力対象外の全てのタイムスロット分は論理値
“0"となるような信号である。
[Means for Solving Problems] In the digital subscriber line carrier system of the present invention, a reference pulse signal commonly given to each channel board and an address signal determined by a position where the channel board is mounted are input. , A channel pulse generation circuit for outputting a signal indicating a time slot to be occupied by its own channel, and n time slots (n = 1, n = 1,
, ...) and a wired OR circuit that determines whether to output the n time slots as they are or to put them in a high impedance state by a control signal from the outside. The control signal is time-synchronized with the time slot on the PCM primary group signal, and when the corresponding time slot is output, only that time slot has a logical value "1" and is not output and is in a high impedance state. When it is set to "0" and all the time slots for which the output of the channel board is not output are logical values "0".

[作用] 本発明の構成によれば、1タイムスロットを専有する
加入者回路が2チャンネル実装されたチャンネル盤と、
1加入者線入力が3タイムスロットを専有するチャンネ
ル盤とが同一装置内に混在する場合においても、3タイ
ムスロットを専有するチャンネル盤出力の次のタイムス
ロットに、1タイムスロットを専有する加入者回路が2
チャンネル実装されたチャンネル盤の1チャンネルを前
記制御信号によりそのまま出力し、残りの1チャンネル
は前記制御信号により高インピーダンス状態にすること
により、タイムスロットを連続的に使うことができる。
[Operation] According to the configuration of the present invention, a channel board on which two channels of subscriber circuits exclusively for one time slot are mounted,
A subscriber who occupies 1 time slot in the next time slot of the channel board output that occupies 3 time slots even when a channel board that occupies 3 time slots for 1 subscriber line input coexists. Circuit is 2
Time slots can be continuously used by directly outputting one channel of the channel board on which the channels are mounted by the control signal and setting the remaining one channel in a high impedance state by the control signal.

[実施例] 次に、本発明について図面を参照して説明する。EXAMPLES Next, the present invention will be described with reference to the drawings.

第1図は本発明の一実施例を示すブロック図である。
第2図は第1図の実施例の動作を説明するタイムチャー
トである。
FIG. 1 is a block diagram showing an embodiment of the present invention.
FIG. 2 is a time chart explaining the operation of the embodiment shown in FIG.

本発明によるチャンネル盤は、各チャンネル盤に共通
に与えられる基準パルス信号とチャンネル盤が実装され
る位置によって定められたアドレス信号とを入力し、自
チャンネルが専有すべきタイムスロットを示す信号を出
力するチャンネルパルス発生回路1と、受信加入者線信
号を必要に応じディジタル化した後、前記タイムスロッ
トを示す信号位置にnタイムスロット出力する加入者線
インターフェイス回路2と、このnタイムスロット分を
そのまま出力するかもしくは高インピーダンス状態にす
るかを外部からの制御信号により決定されるワイヤード
OR回路3とで構成されている。
The channel board according to the present invention inputs a reference pulse signal commonly given to each channel board and an address signal determined by a position where the channel board is mounted, and outputs a signal indicating a time slot to be occupied by its own channel. Channel pulse generator circuit 1, a subscriber line interface circuit 2 that outputs the received subscriber line signal to the signal position indicating the time slot for n time slots after digitizing the received subscriber line signal, and the n time slot portions as they are. Wired that is determined by an external control signal whether to output or set to high impedance state
It is composed of an OR circuit 3.

チャンネルパルス発生回路1は、第2図(a)で示さ
れるような基準パルスと、チャンネル盤実装位置によっ
て決まるアドレス入力とを比較し、自チャンネルが出力
すべきタイムスロット位置を示す信号11を出力する。加
入者線インターフェイス回路2は、タイムスロット位置
を示す信号11の示すタイムスロット位置にnタイムスロ
ット)n=1、2、…)分、必要に応じて加入者線入力
をディジタル化した後出力する。ワイヤードOR回路3は
加入者線インターフェイス回路2の出力を、出力制御信
号によりそのまま出力するか、あるいは高インピーダン
ス状態にする。出力制御信号は、PCM一次群信号上のタ
イムスロットと時間的に同期し、該当するタイムスロッ
トを出力する場合にはそのタイムスロット分のみ論理値
“1"とし、出力せず高インピーダンス状態にする場合に
はそのタイムスロット分は論理値“0"とする。
The channel pulse generation circuit 1 compares the reference pulse as shown in FIG. 2 (a) with the address input determined by the mounting position of the channel board, and outputs the signal 11 indicating the time slot position to be output by the own channel. To do. The subscriber line interface circuit 2 digitizes the subscriber line input at the time slot position indicated by the signal 11 indicating the time slot position for n time slots) n = 1, 2, ... . The wired OR circuit 3 outputs the output of the subscriber line interface circuit 2 as it is according to the output control signal or puts it in a high impedance state. The output control signal is time-synchronized with the time slot on the PCM primary group signal, and when the corresponding time slot is output, only the time slot is set to the logical value "1" and is not output and is in a high impedance state. In that case, the logical value of that time slot is “0”.

n=1であるような上記回路を2セット含むチャンネ
ル盤のみ同一装置内に実装された場合(それぞれAチャ
ンネル、Bチャンネルと呼ぶ)、ワイヤードOR回路3の
出力は第2図(b)のようになる(1、2、3…はチャ
ンネル盤の番号を示す)。
When only a channel board including two sets of the above circuits with n = 1 is mounted in the same device (referred to as A channel and B channel, respectively), the output of the wired OR circuit 3 is as shown in FIG. 2 (b). (1, 2, 3, ... Indicates the numbers on the channel board).

すなわち、アナログ電話信号を搬送化する回路を2回
路収容するチャンネル盤の出力は2タイムスロット(A
チャンネル、Bチャンネルとする)を占有するため、24
タイムスロット(上限値)を持つ1.544Mb/sのPCM一次群
信号は12枚のチャンネル盤で全てのタイムスロットを使
いきることができる。
That is, the output of the channel board that accommodates two circuits for carrying analog telephone signals is two time slots (A
Channel and B channel), so 24
A 1.544 Mb / s PCM primary group signal with a time slot (upper limit value) can use all time slots on 12 channel boards.

しかしながら、ISDN電話信号用のチャンネル盤が1
枚、アナログ電話信号用チャンネル盤が11枚実装される
場合には、ISND電話信号用チャンネル盤が3タイムスロ
ットを占有するため全部で25タイムスロットが必要にな
り、すべての信号を搬送化することはできなくなる。こ
れはISDNチャンネル盤の3タイムスロットの内の3番目
のタイムスロットと、ISDNチャンネル盤の右隣に実装さ
れるアナログ電話用チャンネル盤の2タイムスロットの
内のAチャンネルが衝突するためである(ただし、左か
ら右に向かってチャンネル盤の実装位置に従ってタイム
スロットの割付けを行なうものとする)。
However, there is only one channel board for ISDN telephone signals.
If 11 channels of analog telephone signal channel boards are installed, the ISND telephone signal channel board occupies 3 time slots, so a total of 25 time slots are required, and all signals must be carried. Will not be possible. This is because the third time slot of the three time slots of the ISDN channel board collides with the A channel of the two time slots of the analog telephone channel board mounted on the right side of the ISDN channel board ( However, the time slots shall be assigned from left to right according to the mounting position of the channel board).

従って、Aチャンネルを何らかの方法により未使用と
する必要がある。そこで、n=3であるような1加入者
線入力が3タイムスロットを専有するチャンネル盤と前
記n=1の加入者回路を2セット含むようなチャンネル
盤とが同一装置内に実装された場合には、3タイムスロ
ットを専有するチャンネル盤の右隣りに実装されるチャ
ンネル盤の内AチャンネルのワイヤードOR回路3を出力
制御信号により高インピーダンス状態にする。これによ
りワイヤードOR回路3の多重化出力は第2図(c)で示
すようになり、タイムスロットを無駄にすることなく多
重化することができる。
Therefore, it is necessary to make the A channel unused by some method. Therefore, in the case where a channel board in which one subscriber line input such as n = 3 exclusively uses three time slots and a channel board including two sets of the above-mentioned n = 1 subscriber circuit are mounted in the same device. In the first step, the wired OR circuit 3 of the channel A of the channel board mounted on the right side of the channel board that exclusively occupies 3 time slots is set to the high impedance state by the output control signal. As a result, the multiplexed output of the wired OR circuit 3 becomes as shown in FIG. 2 (c), and the time slot can be multiplexed without wasting it.

[発明の効果] 以上説明したように本発明は、基準パルス信号とチャ
ンネル盤実装位置によって決まるアドレス信号との比較
により自チャンネルの専有すべきタイムスロットを決定
し、その位置に必要に応じディジタル化した加入者線入
力信号を送出し、その送出信号を出力制御信号により制
御されたワイヤードOR回路から出力することにより、同
一チャンネル盤に1タイムスロットを専有する加入者回
路が2セット実装されたチャンネル盤や1加入者線入力
が3タイムスロット以上専有するチャンネル盤が同一装
置に混在する場合においても、1タイムスロットも無駄
にすることなく多重化できる効果がある。
[Effects of the Invention] As described above, the present invention determines the time slot to be occupied by the own channel by comparing the reference pulse signal with the address signal determined by the mounting position of the channel board, and digitizes the position at that position as necessary. A channel in which two sets of subscriber circuits having one time slot are mounted on the same channel board by transmitting the subscriber line input signal and outputting the transmission signal from the wired OR circuit controlled by the output control signal. Even if a board and a channel board that occupies three time slots or more for one subscriber line are mixed in the same device, one time slot can be multiplexed without being wasted.

【図面の簡単な説明】[Brief description of drawings]

第1図は本発明の一実施例を示すブロック図、第2図は
第1図の実施例の動作を説明するためのタイムチャート
である。 1……チャンネルパルス発生回路、2……加入者線イン
ターフェイス回路、3……ワイヤードOR回路。
FIG. 1 is a block diagram showing an embodiment of the present invention, and FIG. 2 is a time chart for explaining the operation of the embodiment of FIG. 1 ... Channel pulse generation circuit, 2 ... Subscriber line interface circuit, 3 ... Wired OR circuit.

Claims (1)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】複数の加入者電話やISDN加入者線信号をPC
M一次群信号に多重化する機能を持つディジタル加入者
線搬送装置において、各チャンネル盤に共通に与えられ
る基準パルス信号とチャンネル盤が実装される位置によ
って定められたアドレス信号とを入力し、自チャンネル
が専有すべきタイムスロットを示す信号を出力するチャ
ンネルパルス発生回路と、受信加入者線信号を必要に応
じディジタル化した後前記タイムスロットを示す信号位
置にnタイムスロット(n=1、2、…)出力する加入
者線インターフェイス回路と、該nタイムスロット分を
そのまま出力するかもしくは高インピーダンス状態にす
るかを外部からの制御信号により決定されるワイヤード
OR回路とにより構成され、前記制御信号は、PCM一次群
信号上のタイムスロットと時間的に同期し、該当するタ
イムスロットを出力する場合にはそのタイムスロット分
のみ論理値“1"で、出力せず高インピーダンス状態にす
る場合及びそのチャンネル盤の出力対象外の全てのタイ
ムスロット分は論理値“0"となるような信号であるディ
ジタル加入者線搬送方式。
1. A plurality of subscriber telephones and ISDN subscriber line signals are transmitted to a PC.
In a digital subscriber line carrier having a function of multiplexing with an M primary group signal, a reference pulse signal commonly given to each channel board and an address signal determined by the position where the channel board is mounted are input, A channel pulse generating circuit for outputting a signal indicating a time slot to be occupied by a channel, and n time slots (n = 1, 2, ...) The subscriber line interface circuit to be output and the wired that is determined by an external control signal whether to output the n time slots as they are or to put them in a high impedance state.
And an OR circuit, the control signal is time-synchronized with a time slot on the PCM primary group signal, and when the corresponding time slot is output, only that time slot is output with a logical value "1". A digital subscriber line carrier system in which the signal is a logical value of "0" for all timeslots that are not subject to output on the channel board and are not put into the high impedance state.
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