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JP3415263B2 - 待機状態において消費電力を節減する電源供給回路 - Google Patents
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JP3415263B2 - 待機状態において消費電力を節減する電源供給回路 - Google Patents

待機状態において消費電力を節減する電源供給回路

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JP3415263B2 JP10578394A JP10578394A JP3415263B2 JP 3415263 B2 JP3415263 B2 JP 3415263B2 JP 10578394 A JP10578394 A JP 10578394A JP 10578394 A JP10578394 A JP 10578394A JP 3415263 B2 JP3415263 B2 JP 3415263B2
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    • Y02B—CLIMATE CHANGE MITIGATION TECHNOLOGIES RELATED TO BUILDINGS, e.g. HOUSING, HOUSE APPLIANCES OR RELATED END-USER APPLICATIONS
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Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、待機（Stand-by）状態
において消費電力を節減する電源供給回路関し、もっと
詳しくはテレビとビデオカセットレコーダ（Video Cass
ette Recorder ；以下、ＶＣＲという）とを一体化させ
た家電製品（以下、ＴＶＣＲという）等において、待機
状態の時に出力電圧を強制的に低下させて消費電力を節
減し、信頼性を高める待機状態において消費電力を節減
する電源供給回路に関するものである。
【０００２】
【従来の技術】図１は、従来の電源供給回路図であり、
電源コード１０１を通じて入力された交流ＡＣ電圧を整
流する電源整流部１０２と、スイッチング動作により前
記電源整流部１０２から出力された直流電圧をスイッチ
ングして、トランスＴ１の１次側に供給するスイッチン
グ部１０３と、トランスＴ１の２次側に誘起された矩形
波を整流して、モニタ用電源とビデオ用電源等とを出力
する２次側整流部１０４と、前記２次整流部１０４の出
力電圧と基準電圧とを比較して、制御信号を出力する基
準電圧検出制御部１０５と、前記基準電圧検出部１０５
の制御により前記２次側整流部１０４の出力電圧のフィ
ードバック量を調節して、前記スイッチング部１０３へ
出力するフィードバック部１０６とからなる。
【０００３】ここで、前記フィードバック部１０６は、
スイッチング部１０３のオン／オフの時間間隔を制御し
て、安定した出力電圧が得られるようにする要素であ
り、フォトカプラからなる。フォトダイオードに電流が
印加されると、光によりフォトトランジスタのベースに
電流が印加されて、コレクタ端からエミッタ端へ電流が
流れ、前記フォトカプラは、オンとなる。この時、フォ
トダイオードとフォトトランジスタとは互いに電気的に
絶縁されている。
【０００４】このように構成された図１で、電源コード
１０１を通じて入力された交流電圧は、電源整流部１０
２により整流及び平滑されて直流電圧としてスイッチン
グ部１０３へ出力される。そして、スイッチング部１０
３は、フィードバック部１０６の制御によりオン／オフ
されて、前記電源整流部１０２の出力電圧をスイッチン
グしてトランスＴ１の１次側へ供給する。前記トランス
Ｔ１の２次側に誘起される矩形波は、２次側整流部１０
４により直流電圧として整流及び平滑されて、モニタ用
の電源とビデオ用の電源とを出力する。
【０００５】また、前記２次側整流部１０４の出力電圧
は、基準電圧検出制御部１０５とフィードバック部１０
６とへ印加される。前記基準電圧検出制御部１０５で
は、常時一定な電圧を維持するために所定の基準電圧と
前記２次側整流部１０４との出力電圧とを比較して、２
次側整流部１０４の出力電圧が基準電圧より高いか低い
場合は、フィードバック部１０６に制御信号を出力して
フィードバック量を調節する。前記フィードバック部１
０６では、前記基準電圧検出制御部１０５の制御により
２次側整流部１０４の出力電圧のフィードバック量を調
節して、スイッチング部１０３のスイッチングのオン／
オフタイムを制御することにより、常時一定の電圧を得
る。
【０００６】このように、図１に示された回路により、
使用者がテレビ放送を視聴するとか予約録画をする場合
に、電源上に大きな問題もなく使用できる。しかし、待
機状態でも２次側の電圧として常時高い電圧がかかって
いるので、入力消費電力がかなり高くなり（約２２
Ｗ）、不必要な電力の浪費を招来していた。
【０００７】一方、米国特許第４，７３７，８５１号
“ON/OFF CONTROL CIRCUITRY FOR TELEVISION ”には、
テレビの待機状態で、偏向電流の生成を防止して消費電
力を節減する技術が紹介されている。即ち、前記米国特
許第４，７３７，８５１号は、正常モードで偏向捲線に
偏向電流を発生させる偏向回路と、正常モードと待機モ
ードとのそれぞれにおける動作中に生成される第１供給
電圧の電圧源と、前記偏向回路に結合されており、正常
モードの動作中に前記偏向回路の動作を制御し、待機モ
ードの動作中には前記偏向電流の生成を防止する制御回
路とから構成され、正常動作では偏向回路の動作を制御
し、待機モードでは偏向電流の生成を防止してモニタを
オフさせることにより、待機状態でモニタの消費電力を
節減させる。
【０００８】しかし、上記米国特許は待機状態でモニタ
の消費電力を節減させるのみであり、ＴＶＣＲ自体の消
費電力を節減させることは考慮していない。
【０００９】
【発明が解決しようとする課題】従って、本発明の目的
は、待機状態である場合に、マイクロプロセッサからの
制御信号により、出力電圧を強制的に低下させるようフ
ィードバック量の制御を基準電圧検出制御部による調整
から所定値に切り替えることにより、入力消費電力を低
下させて不必要な電力の浪費をなくす待機状態において
消費電力を節減する電源供給回路を提供することにあ
る。
【００１０】
【課題を解決するための手段】前記目的を達成するため
に、本発明の待機状態において消費電力を節減する電源
供給回路は、電源コードを通じて入力される交流電圧を
整流する電源整流部と、出力電圧のフィードバックによ
りスイッチングタイムが制御されて前記電源整流部の出
力をトランスの２次側に誘起させるスイッチング部と、
トランスの２次側に誘起された電圧を整流及び平滑して
出力電圧を得る２次側整流部と、前記２次側整流部の出
力電圧を前記スイッチング部へフィードバックさせるフ
ィードバック部と、前記２次側整流部の出力電圧と所定
の基準電圧とを比較して前記フィードバック部のフィー
ドバック量を調節する基準電圧検出制御部とを有する電
源供給回路において、負荷機器の状態に対応して、所定
のポートを通じてハイまたはローの制御信号を出力する
マイクロプロセッサと、前記負荷機器が待機状態では、
前記マイクロプロセッサからの前記制御信号により、前
記フィードバック部のフィードバック量の制御を前記基
準電圧検出制御部による調整から所定値に切り替え、２
次側の出力電圧を強制的に低下させる待機状態電源制御
部とを備えることを特徴とする。
【００１１】ここで、前記負荷機器は、テレビとビデオ
カセットレコーダとを一体化させた家電製品であって、
前記家電製品が待機状態，予約録画及びモニタのオフの
時には、前記マイクロプロセッサからの制御信号により
水平発振用の電圧がモニタへ供給されないように制御す
るモニタ電源制御部を更に備える。また、前記モニタ電
源制御部は、前記マイクロプロセッサからの制御信号に
よりオン／オフされて、前記２次側整流部の第１出力端
の電圧を、前記モニタの水平発振用の電圧端へ供給また
は遮断する第１トランジスタを含む。
【００１２】また、前記待機状態電源制御部は、前記マ
イクロプロセッサからの制御信号によりオン／オフされ
る第２トランジスタと、前記第２トランジスタがターン
オンされれば、レギュレータを通じて前記２次側整流部
の第２出力端の電圧をマイクロプロセッサに提供し、前
記２次側整流部の第３出力端の電圧を強制的にフィード
バックさせて２次側の出力電圧を強制的に低下させる第
３トランジスタと、前記フィードバック部と第２トラン
ジスタとに連結されて、前記第２トランジスタがターン
オンされればオンされて、前記２次側の出力電圧が強制
的に低下されるように前記フィードバック部のフィード
バック量の制御を所定値に切り替えるダイオードとを含
む。また、前記待機状態電源制御部は、前記マイクロプ
ロセッサからの制御信号によりターンオン／オフされる
第４トランジスタと、前記第４トランジスタのターンオ
ン／オフによりターンオン／オフが制御される第５トラ
ンジスタと、前記第５トランジスタのターンオン／オフ
により、２次側整流部の第２出力端の電圧をマイクロプ
ロセッサに提供し、２次側の出力電圧を強制的に低下さ
せるため、前記２次側整流部の第３出力端の電圧を強制
的に前記フィードバック部にフィードバックさせるよう
に切り替える第６トランジスタとを含む。
【００１３】
【実施例】以下、添付した図面を参照して、本発明によ
る待機状態において消費電力を節減する電源供給回路の
望ましい一実施例を詳細に説明する。図２は、本実施例
の待機状態において消費電力を節減する電源供給回路の
ブロック図であり、図３は、前記図２のモニタ電源制御
部１０７と待機状態電源制御部１０８との詳細な回路図
である。尚、図２及び図３において、図１と同一の参照
符号は同一の要素を示す。
【００１４】図２及び図３を見ると、２次側整流部１０
４とマイクロプロセッサ１０９との間に連結されたモニ
タ電源制御部１０７と、待機状態電源制御部１０８及び
マイクロプロセッサ１０９とを除外した構成部分は、図
１と同一であるので、ここでは、モニタ電源制御部１０
７と待機状態電源制御部１０８及びマイクロプロセッサ
１０９を詳細に説明する。
【００１５】前記モニタ電源制御部１０７は、前記マイ
クロプロセッサ１０９の第１ポートにベース端が連結さ
れるトランジスタＱ１で構成される。この時、前記トラ
ンジスタＱ１のコレクター端には、２次側整流部１０４
のＡ端子と水平発振用電圧端Ｂ＋とが共通に連結され、
エミッタ端は接地されている。そして、前記待機状態電
源制御部１０８は、前記マイクロプロセッサ１０９の第
２ポートにベース端が連結されるトランジスタＱ２と、
前記トランジスタＱ２のコレクター端に抵抗Ｒ４を通じ
てベース端が連結されるトランジスタＱ３とから構成さ
れる。この時、前記トランジスタＱ３のエミッタ端は、
抵抗Ｒ２を通じて２次側整流部１０４のＢ端子が連結さ
れ、エミッタ端とベース端との間にバイアス用抵抗Ｒ３
が連結される。更に、前記トランジスタＱ３のコレクタ
ー端には、２次側整流部１０４のＣ端子と５Ｖレギュレ
ーター１１０を通じてマイクロプロセッサ１０９の電源
ポートと共通に連結され、同時に抵抗Ｒ５を通じてフィ
ードバック部１０６のフォトダイオードのアノード端が
連結される。
【００１６】また、基準電源検出制御部１０５には、前
記フィードバック部１０６のフォトダイオードのカソー
ド端と２次側整流部１０４のＡ端子とが連結される。こ
こで、前記２次側整流部１０４のＡ端子は正常動作（図
中“Ｎ”で示す）でハイ電圧ＨＢ＋，待機状態（図中
“Ｓ”で示す）で１８〜３０Ｖを出力し、Ｂ端子は正常
動作で８０Ｖ，待機状態で１２Ｖを出力し、Ｃ端子は９
〜１２Ｖを出力する例をあげた。
【００１７】一方、前記マイクロプロセッサ１０９の動
作テーブルは下記の＜表１＞となり、マイクロプロセッ
サのプログラムは＜表１＞に基づいて作成される。
【００１８】
【表１】
【００１９】このように構成された本実施例で、ＴＶＣ
Ｒの電源コード１０１が電源ソケットに挿入され、ＴＶ
ＣＲセットの電源がオフ状態であると、ＴＶＣＲセット
は待機状態になる。待機状態では、マイクロプロセッサ
１０９の第１ポートと第２ポートとは、同時にハイ状態
になる。この時、前記マイクロプロセッサ１０９の第１
ポートがハイ状態になると、トランジスタＱ１のベース
端に電圧が印加されてトランジスタＱ１が導通されるの
で、水平発振用電圧Ｂ＋がモニタへ供給されない。
【００２０】また、マイクロプロセッサ１０９の第２ポ
ートがハイ状態になると、トランジスタＱ２は導通さ
れ、２次側整流部１０４のＢ端子にかけられた電圧は抵
抗Ｒ２を通じてトランジスタＱ３のエミッタ端に印加さ
れ、抵抗Ｒ３を経てトランジスタＱ３のベース端に印加
される。この時、前記トランジスタＱ２が導通状態なの
で、トランジスタＱ３のベース電流が抵抗Ｒ４を通じて
流れていく様になって、トランジスタＱ３も導通され
る。
【００２１】従って、２次側整流部１０４のＢ端子の１
２Ｖは５Ｖレギュレーター１１０により５Ｖに落とされ
た後に、マイクロプロセッサ１０９に印加されてマイク
ロプロセッサ１０９を継続し動作させる。そして、トラ
ンジスタＱ２の導通でダイオードＤ１がオンされるの
で、２次側整流部１０４のＣ端子にかかっている電圧
は、抵抗Ｒ５→フィードバック部１０６→ダイオードＤ
１を通じて強制的にフィードバックがかけられるので、
２次側の電圧は強制的に低下される。
【００２２】このとき、基準電圧検出制御部１０５の制
御電圧もダイオードＤ１を通じて接地されるので、フィ
ードバック部１０６は、基準電圧検出制御部１０５の制
御を受けない。更に、２次側整流部１０４のＡ端子の電
圧が初期のＨＢ＋から１８Ｖ〜３０Ｖ程度になり、抵抗
Ｒ１両端間の電圧に降下が起こる。一方、ＴＶＣＲを視
聴するとかプログラムを録画するために電源がオンされ
れば、マイクロプロセッサ１０９の第１ポートと第２ポ
ートとがロー状態になる。
【００２３】従って、トランジスタＱ１がオフされるの
で、２次側整流部１０４のＡ端子の電圧は、抵抗Ｒ１を
通じて水平発振用電圧Ｂ＋としてモニタに印加されてモ
ニタがオンされる。また、マイクロプロセッサ１０９の
第２ポートがローであるので、トランジスタＱ２がター
ンオフされ、トランジスタＱ３のベースに抵抗Ｒ３を通
じて印加された２次側整流部１０４のＢ端子の電圧によ
り、トランジスタＱ３もターンオフされる。
【００２４】この時、トランジスタＱ２のターンオフに
よりダイオードＤ１はオフ状態となるので、２次側整流
部１０４のＣ端子の電圧が抵抗Ｒ５及びフィードバック
部１０６を通じて基準電圧検出制御部１０５へ印加さ
れ、基準電圧検出制御部１０５は、２次側整流部１０４
のＡ端子の電圧変動を検出して、フィードバック部１０
６のフィードバック量の調節を始める。
【００２５】一方、＜表１＞で電源のオフは待機状態を
いう。また、モニタのオフ状態は、予約録画の時と同一
な条件でモニタだけオフ状態を維持してセットは正常動
作を保持しなければならない。従って、マイクロプロセ
ッサ１０９の第１ポートはハイ状態であり、第２ポート
はロー状態となる。前記マイクロプロセッサ１０９の第
１ポートがハイ状態であると、前述されたごとく、トラ
ンジスタＱ１の導通で水平発振用電圧Ｂ＋がモニタに供
給されないので、モニタはオフ状態を維持する。そし
て、マイクロプロセッサ１０９の第２ポートがロー状態
であると、トランジスタＱ２とトランジスタＱ３とがタ
ーンオフされるので、前述されたごとく、フィードバッ
ク部のフィードバック量は、基準電圧検出制御部１０５
の制御によってのみ調節される。
【００２６】図４は、前記待機状態電源制御部１０８の
他の実施例を示す回路図である。本回路は、前記マイク
ロプロセッサ１０９の第２ポートにベース端が連結され
るトランジスタＱ４と、前記トランジスタＱ４のコレク
タ端にベース端が連結されるトランジスタＱ５と、前記
トランジスタＱ５のコレクタ端に抵抗Ｒ８を通じてベー
ス端が連結されるトランジスタＱ６とから構成される。
この時、前記トランジスタＱ４のエミッタ端は接地さ
れ、前記トランジスタＱ５のコレクタ端と２次側整流部
１０４のＢ端子との間には抵抗Ｒ６を通じてツェナーダ
イオードＤＺ１が連結される。
【００２７】ここで、前記抵抗Ｒ６はツェナーダイオー
ドの保護用である。そして、前記トランジスタＱ６のエ
ミッタ端は、抵抗Ｒ７を通じて２次側整流部１０４のＢ
端子が連結され、コレクタ端は２次側整流部１０４のＣ
端子が連結される。前記ツェナーダイオードＤＺ１は、
前記図３の抵抗Ｒ３と同様にバイアス用である。また、
前記マイクロプロセッサ１０９の第２ポートは、前記さ
れた図２及び図３とは反対に、待機状態であるとかモニ
タのオフまたは予約録画の時にはロー信号を出力し、そ
の以外にはハイ信号を出力する様にプログラミングされ
る必要がある。
【００２８】
【発明の効果】以上のように、本発明による待機状態に
おいて消費電力を節減する電源供給回路によれば、待機
状態では、マイクロプロセッサからの制御信号によりフ
ィードバック量の制御を基準電圧検出制御部による調整
から所定値に切り替えて、２次側の出力電圧を所定の電
圧で強制的に低下させることにより、例えば消費電力を
１０Ｗ未満に節約することができ、ＴＶＣＲセットの信
頼性を高める効果がある。
【００２９】また、近頃は、ヨーロッパ等の其の他地域
で、待機状態の消費電力を強制的に１０Ｗ未満とする管
理規制を開始したので、本発明は大きな効果を持つ。
【図面の簡単な説明】
【図１】従来の電源供給回路のブロック図である。
【図２】本実施例の待機状態において消費電力を節減す
る電源供給回路のブロック図である。
【図３】本実施例の待機状態において消費電力を節減す
る電源供給回路の詳細な回路図である。
【図４】図２及び図３の待機状態電源制御部の他の実施
例を示す図である。
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) H02M 3/28 G05F 1/56 H04N 5/63

Claims (5)

    (57)【特許請求の範囲】
  1. 【請求項１】 電源コードを通じて入力される交流電圧
    を整流する電源整流部と、出力電圧のフィードバックに
    よりスイッチングタイムが制御されて前記電源整流部の
    出力をトランスの２次側に誘起させるスイッチング部
    と、トランスの２次側に誘起された電圧を整流及び平滑
    して出力電圧を得る２次側整流部と、前記２次側整流部
    の出力電圧を前記スイッチング部へフィードバックさせ
    るフィードバック部と、前記２次側整流部の出力電圧と
    所定の基準電圧とを比較して前記フィードバック部のフ
    ィードバック量を調節する基準電圧検出制御部とを有す
    る電源供給回路において、 負荷機器の状態に対応して、所定のポートを通じてハイ
    またはローの制御信号を出力するマイクロプロセッサ
    と、 前記負荷機器が待機状態では、前記マイクロプロセッサ
    からの前記制御信号により、前記フィードバック部のフ
    ィードバック量の制御を前記基準電圧検出制御部による
    調整から所定値に切り替え、２次側の出力電圧を強制的
    に低下させる待機状態電源制御部とを備えることを特徴
    とする待機状態において消費電力を節減する電源供給回
    路。
  2. 【請求項２】 前記負荷機器は、テレビとビデオカセッ
    トレコーダとを一体化させた家電製品であって、前記家
    電製品が待機状態，予約録画及びモニタのオフの時に
    は、前記マイクロプロセッサからの制御信号により水平
    発振用の電圧がモニタへ供給されないように制御するモ
    ニタ電源制御部を更に備えることを特徴とする請求項１
    記載の待機状態において消費電力を節減する電源供給回
    路。
  3. 【請求項３】 前記モニタ電源制御部は、前記マイクロ
    プロセッサからの制御信号によりオン／オフされて、前
    記２次側整流部の第１出力端の電圧を、前記モニタの水
    平発振用の電圧端へ供給または遮断する第１トランジス
    タを含むことを特徴とする請求項２記載の待機状態にお
    いて消費電力を節減する電源供給回路。
  4. 【請求項４】 前記待機状態電源制御部は、 前記マイクロプロセッサからの制御信号によりオン／オ
    フされる第２トランジスタと、 前記第２トランジスタがターンオンされれば、レギュレ
    ータを通じて前記２次側整流部の第２出力端の電圧をマ
    イクロプロセッサに提供し、前記２次側整流部の第３出
    力端の電圧を強制的にフィードバックさせて２次側の出
    力電圧を強制的に低下させる第３トランジスタと、 前記フィードバック部と第２トランジスタとに連結され
    て、前記第２トランジスタがターンオンされればオンさ
    れて、前記２次側の出力電圧が強制的に低下されるよう
    に前記フィードバック部のフィードバック量の制御を所
    定値に切り替えるダイオードとを含むことを特徴とする
    請求項１記載の待機状態において消費電力を節減する電
    源供給回路。
  5. 【請求項５】 前記待機状態電源制御部は、 前記マイクロプロセッサからの制御信号によりターンオ
    ン／オフされる第４トランジスタと、 前記第４トランジスタのターンオン／オフによりターン
    オン／オフが制御される第５トランジスタと、 前記第５トランジスタのターンオン／オフにより、２次
    側整流部の第２出力端の電圧をマイクロプロセッサに提
    供し、２次側の出力電圧を強制的に低下させるため、前
    記２次側整流部の第３出力端の電圧を強制的に前記フィ
    ードバック部にフィードバックさせるように切り替える
    第６トランジスタとを含むことを特徴とする請求項１記
    載の待機状態において消費電力を節減する電源供給回
    路。
JP10578394A 1993-11-30 1994-05-19 待機状態において消費電力を節減する電源供給回路 Expired - Lifetime JP3415263B2 (ja)

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