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JP3474937B2 - 実装用配線板の製造方法、半導体パッケージの製造方法 - Google Patents
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JP3474937B2 - 実装用配線板の製造方法、半導体パッケージの製造方法 - Google Patents

実装用配線板の製造方法、半導体パッケージの製造方法

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JP3474937B2
JP3474937B2 JP24445994A JP24445994A JP3474937B2 JP 3474937 B2 JP3474937 B2 JP 3474937B2 JP 24445994 A JP24445994 A JP 24445994A JP 24445994 A JP24445994 A JP 24445994A JP 3474937 B2 JP3474937 B2 JP 3474937B2
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Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は実装用配線板の製造方
、半導体パッケージの製造方法に係り、さらに詳しく
は、実装電子部品の入出力端子と接続する配線パターン
の端子部が実装面に導出された実装用配線板の製造方
、半導体パッケージの製造方法に関する。
【0002】
【従来の技術】たとえば半導体素子など、各種の電子部
品を配線板に搭載・実装して成る実装回路装置は、電子
機器類の回路部品として広く実用に供せられている。そ
して、この種の実装回路装置の構成には、回路の高密度
化もしくはコンパクト化などの要求に対応して、いわゆ
る多層型配線板が利用されている。より具体的には、た
とえばコンピュータなどの電子回路では、半導体素子間
に高速な信号伝搬ができるように、配線長を短くする高
密度実装手段が採られている。つまり、半導体素子をベ
アチップのまま実装して実装面積を小さくする一方、配
線幅の小さな配線板を用いて実装密度を上げながら、配
線長を短くして回路の高密度化などに対応している。
【0003】ところで、前記多層型配線板は、一般的
に、次のような手段で製造されている。すなわち、絶縁
性基板の両面に張られた銅箔を、それぞれ配線パターニ
ングした後、その配線パターニング面上に絶縁シート
(たとえばプリプレグ層)を介して銅箔を積層,配置
し、加熱加圧により一体化する。次いで、前記積層体
に、たとえばドリルなどで孔明け加工を施した後、化学
メッキ法で孔の内壁面を金属層化し、さらに電気メッキ
で厚付けして、内層配線パターンと外層配線パターンと
の配線層間の電気的接続を行う。その後、表面銅箔につ
いて、端子部(接続用パッド)を含む配線パターニング
を行い多層型配線板を得ている。なお、より配線パター
ン層の多い多層型配線板の場合は、中間に介挿させる両
面型配線板数を増加する方式で製造されている。
【0004】さらに、前記とは構成の異なる多層型配線
板として、たとえばセラミックスを層間絶縁体層とした
配線基板面に、たとえばポリイミド系樹脂を層間絶縁体
層とする薄膜多層配線層を積層・一体化した構成の配線
板も実装用に供せられている。 また、上記によって製
造された多層型印刷配線板に、半導体素子( LSI)をベ
アチップのまま実装して高密度実装を図る場合は、ベア
チップの入出力端子側に半田でバンプを設け、この半田
バンプを介して多層型印刷配線板面の端子部(パッド)
と接続している。
【0005】
【発明が解決しようとする課題】しかしながら、上記半
田バンプを介したベアチップの実装手段では、実装する
ベアチップの入出力端子のサイズ合わせた微小サイズの
半田バンプが要求されるので、半田バンプの形成が煩雑
化するばかりでなく、半田バンプの形状・サイズおよび
位置・精度などの点から歩留まりにも問題がある。一
方、配線板においては、高密度実装化に対応して、配線
幅の狭小化だけでなく、ベアチップの入出力端子を接続
する端子部(パッド)の微小化もしくは端子部(パッ
ド)間の狭小化が要求される。そして、この多層型配線
板においては、前記配線密度の向上、および実装密度の
向上を考慮すると、配線パターン層間を連結するスルホ
ール径にも自ずから限界があり、直径0.10mm程度にスル
ホール径を設定する場合、たとえばNCドリルマシン加工
を適用し得ないので、別途、新たな加工装置もしくは加
工手段が要求されることになる。いずれにしても、従来
知られている構成の多層型配線板、もしくは従来の製造
手段で形成される多層型配線板の場合は、実装回路装置
の高密度化やコンパクト化のうえで問題がある。
【0006】本発明は、上記事情に対処してなされたも
ので、信頼性の高い高密度配線および高密度実装を可能
とした実装用配線板の製造方法、半導体パッケージの製
造方法の提供を目的とする。
【0007】
【課題を解決するための手段】本発明に係る第1の実装
用配線板の製造方法は、導電性金属箔の主面に感光性レ
ジスト層を配設する工程と、前記感光性レジスト層を選
択的に露光し、現像処理して前記導電性金属箔の前記主
面を選択的に露出させる工程と、前記露出した導電性金
属箔の主面上に導電性金属をめっき成長させ、導電性バ
ンプを形成する工程と、前記感光性レジスト層を剥離・
除去する工程と、前記導電性金属箔の前記導電性バンプ
形成された面に合成樹脂系シートを重ね積層する工程
と、前記積層された導電性金属箔および合成樹脂系シー
積層方向に加圧し、前記導電性バンプ先端部を
接続用端子部として前記合成樹脂シートの厚さ方向に
貫通して突出させる工程と、前記導電性金属箔を選択的
にエッチング除去し、配線パターニングする工程とを具
備して成ることを特徴とする。また、本発明に係る第2
の実装用配線板の製造方法は、導電性金属箔の主面に感
光性レジスト層を配設する工程と、前記感光性レジスト
層を選択的に露光し、現像処理して前記導電性金属箔
前記主面を選択的に露出させる工程と、前記露出した導
電性金属箔の主面上に導電性金属をめっき成長させ、導
電性バンプを形成する工程と、前記感光性レジスト層を
剥離・除去する工程と、前記導電性金属箔の前記導電性
バンプ形成された面に合成樹脂系シートを重ね積層す
る工程と、前記積層された導電性金属箔および合成樹脂
系シート積層方向に加圧し、前記導電性バンプ先端
部を、接続用端子部として前記合成樹脂シートの厚さ
方向に貫通して突出させる工程とを具備して成ることを
特徴とする。さらに、本発明に係る半導体パッケージの
製造方法は、導電性箔の表面に感光層を形成する工程
と、前記感光層を選択的に露光し、現像処理して前記導
電性箔の各領域面を選択的に露出させ、前記感光層に孔
を形成する工程と、前記露出した導電性箔の表面上に第
1の導電性金属をめっき成長させる工程と、前記めっき
成長させた第1の導電性金属上に第2の導電性金属をめ
っき成長させ、導電性バンプを形成する工程と、前記感
光層を除去する工程と、前記形成された導電性バンプ上
に絶縁性合成樹脂シートを重ね、前記導電性バンプの先
端部を前記絶縁性合成樹脂シート上に突き出させる工程
と、前記導電性箔をパターニングし、配線パターンを形
成する工程と、前記突き 出された導電性バンプの先端部
に対接して、接続電極を有するチップを配置する工程
と、前記配線パターン、前記絶縁性合成樹脂シート、お
よび前記チップを、これらの重ねた方向に加圧かつ加熱
し、前記チップの接続電極を前記導電性バンプの先端部
に接続する工程とを具備して成ることを特徴とする。
【0008】さらに、上記製造方法において、積層体の
加圧により合成樹脂系シートを貫挿・露出した接続用端
子部面を低接触抵抗性金属のめっき層で被覆することが
好ましい。
【0009】本発明においては、銅など導電性金属の選
択的なメッキによって、導電性バンプが形成される。そ
して、この選択的なメッキを行うためのマスク材として
は、高精度で微小な、さらには微小ピッチな導電性バン
プの任意な形成を可能とするために感光性樹脂が選ば
れ、この感光性樹脂の配設は感光性樹脂フィルムの張り
合わせ、もしくは感光性樹脂溶液の塗布・乾燥などで行
われる。
【0010】また、前記導電性金属のめっきにより形成
する突起状(たとえば円錐状もしくは柱状体など)の導
電性バンプは、前記感光性樹脂層が成すマスクの厚さ
や、マスクに設けられた孔の径,および分布などによっ
決まるので、形成する貫挿型の端子部(パッド)およ
び配線パターン層間の接続部の構成に応じて適宜設定さ
れる。
【0011】前記突起状の導電性バンプの先端部が貫挿
され、端子部および層間接続部を形成する合成樹脂系シ
ートとしては、たとえば熱可塑性樹脂フイルム(シー
ト)が挙げられ、その厚さは25〜 300μm 程度が好まし
い。ここで、熱可塑性樹脂シートとしては、たとえばポ
リカーボネート樹脂,ポリスルホン樹脂,熱可塑性ポリ
イミド樹脂,4フッ化ポリエチレン樹脂,6フッ化ポリ
プロピレン樹脂,ポリエーテルエーテルケトン樹脂など
のシート類が挙げられる。また、硬化前状態に保持され
る熱硬化性樹脂シートとしては、エポキシ樹脂,ビスマ
レイミドトリアジン樹脂,ポリイミド樹脂,フェノール
樹脂,ポリエステル樹脂,メラミン樹脂,あるいはブタ
ジェンゴム,ブチルゴム,天然ゴム,ネオプレンゴム,
シリコーンゴムなどの生ゴムのシート類が挙げられる。
これら合成樹脂は、単独でもよいが絶縁性無機物や有機
物系の充填物を含有してもよく、さらにガラスクロスや
マット、有機合成繊維布やマット、あるいは紙などの補
強材と組み合わせて成るシートであってもよい。
【0012】また、前記導電性バンプの先端部を合成樹
脂系シート表面に貫挿・露出させ、端子部(パッド)を
形成するに当たっては、次のような手段を採ることが好
ましい。すなわち、突起状の導電性バンプを形設した基
体面へ、合成樹脂系シート主面を対接させて積層配置
し、この積層体の両側に当て板として寸法や変形の少な
い、たとえばステンレス板,真鍮板などの金属板、たと
えばポリイミド樹脂板(シート),ポリテトラフロロエ
チレン樹脂板(シート)などの耐熱性樹脂板を配置して
加圧して、突起状の導電性バンプ先端側を合成樹脂系シ
ートの厚さ方向に貫挿させることにより形成できる。
【0013】
【作用】本発明に係る実装用配線板の製造方法によれ
ば、実装する電子部品の入出力端子と電気的に接続され
る端子部(パッド)は、いわゆるめっき法によって選択
的に成長・形成され、かつ絶縁体層を貫挿した導電性バ
ンプの先端部で形成されている。つまり、端子部(パッ
ド)は、埋め込み導出形で配線板面に露出される構成を
採り、また高精度の寸法,形状(たとえば高さのばらつ
きは± 2μm 程度)に形成されるばかりでなく、 300μ
m 程度以下(たとえば 100μm 程度)のピッチで配設し
得る。そして、前記導電性バンプを、微細な形状および
微小なピッチで設置し得ることに伴って、配線密度およ
び実装密度の向上も併せて図られた配線板が得られるこ
とになる。しかも、配線板面にスルホールが存在しない
ため、少なくともその分配線領域および実装領域の低減
も解消することになり、前記配線密度および実装密度の
向上がさらに助長されることになり、信頼性の高い実装
用配線板を歩留まりよく提供し得る。
【0014】
【実施例】以下、図1 (a)〜 (d)、図2 (a)〜 (c)、図
3 (a), (b)、図4 (a)〜 (c)、図5 (a), (b)および
図6 (a)〜 (c)を参照して本発明の実施例を説明する。
【0015】実施例1 図1 (a)〜 (d)および図2 (a)〜 (c)はこの実施例によ
る実装用配線板の製造方法の態様例を模式的に示したも
のである。
【0016】先ず、印刷配線板の製造に使用されている
厚さ18μm の電解銅箔、および厚さ150μm の感光性樹
脂フイルム(商品名:Photec SR-3000EB-22 日立化成KK
製)を用意した。そして、図1 (a)に断面的に示すごと
く、前記電解銅箔1の両面に、前記感光性樹脂(感光性
レジスト)フイルム2a,2bを、それぞれ張り合わせた
後、マスク3を介して光を感光性レジストフイルム2aに
照射(選択的露光)した。次いで、前記選択的露光した
感光性レジストフイルム2a,2bについて現像処理を施し
て、図1 (b)に断面的に示すように、感光性レジストフ
イルム2aに直径約75μm の孔4を設けた。
【0017】その後、前記電解銅箔1を陰極として、電
気銅めっき液(商品名:KC500 ジャパンエナジーKK製)
中に浸漬し、電気銅めっき処理を行い、図1 (c)に断面
的に示すごとく、前記感光性レジストフイルム2aの孔4
内(電解銅箔1の選択的な露出面)に、高さ 130μm 程
度の銅を成長させた。前記めっき処理終了後、マスクと
して機能させた感光性樹脂フィルム2a,2bを剥離して、
図1 (d)に断面的に示すように、突起状の導電性バンプ
5群が一主面に形成された電解銅箔1を得た。次に、前
記電解銅箔1の突起状導電性バンプ5群形成面に、図2
(a)に断面的に示すごとく、厚さ50μm の合成樹脂シー
ト6、たとえばテフロン樹脂−ガラスクロス系プリプレ
グ、および図示しないアルミ箔,クラフト紙を積層配置
した。この積層体を、 180℃に保持した熱プレス機の熱
板間にセットし、約1.96×106Paで加圧してそのまま15
分間保持し、図2(b) に断面的に示すような、導電性バ
ンプ5先端部が合成樹脂シート6層を貫挿して他の面に
露出した積層板を得た。その後、前記積層板の電解銅箔
1面にエッチングレジストを印刷し、その電解銅箔1の
選択的なエッチングを行って、配線パターニング7して
から、前記エッチングレジストをアルカリ水溶液で剥離
除去して、図2(c) に断面的に示すような、実装用配線
板8を得た。
【0018】前記実装用配線板8においては、図2 (c)
に断面的に示すごとく、一方の主面(表面)には、導電
性バンプ5の先端部が端子部(パッド)9として露出
し、他方の主面(裏面)には、端子部9と接続する配線
パターン7が形設された構成を成している。そして、前
記端子部9所定位置に設定されており、図3 (a)に断面
的、また図3 (b)に平面透視的に示すように、たとえば
LSI(半導体)ベアチップ10の入出力端子 10aと確実に
対接され、金属間の接合(金属同士の結合,金属常温接
合を含む)によって安定した電気的な接続がなされた。
【0019】実施例2 図4 (a)〜 (c)は、この実施例による実装用配線板の製
造方法の態様例を模式的に示したものである。
【0020】先ず、印刷配線板の製造に使用されている
厚さ18μm の電解銅箔、および厚さ150μm の感光性樹
脂フイルム(商品名:Photec SR-3000EB-22 日立化成KK
製)を用意した。そして、前記電解銅箔1の両面に、前
記感光性樹脂(感光性レジスト)フイルム2a,2bを、そ
れぞれ張り合わせた後、マスクを介して光を感光性レジ
ストフイルム2aに照射(選択的露光)した。次いで、前
記選択的露光した感光性レジストフイルム2a,2bについ
て現像処理を施して、感光性レジストフイルム2aに直径
約75μm の孔4を設けた。
【0021】その後、前記電解銅箔1を陰極として、電
気銅めっき液(商品名:KC500 ジャパンエナジーKK製)
中に浸漬し、電気銅めっき処理および金めっき処理を順
次行い、図4 (a)に断面的に示すごとく、前記感光性レ
ジストフイルム2aの孔4内(電解銅箔1の選択的な露出
面)に、高さ 130μm 程度の銅5aを成長させ、さらにそ
の上に高さ15μm 程度の金5bを積層させた。前記めっき
処理終了後、マスクとして機能させた感光性樹脂フィル
ム2a,2bを剥離して、銅5aおよび金5bが積層された形の
突起状導電性バンプ5群が一主面に形成された電解銅箔
1を得た。
【0022】次に、前記電解銅箔1の突起状導電性バン
プ5群形成面に、厚さ50μm の合成樹脂シート3、たと
えばテフロン樹脂−ガラスクロス系プリプレグ、および
アルミ箔やクラフト紙を積層配置した。この積層体を、
180℃に保持した熱プレス機の熱板間にセットし、約1.
96×106 Paで加圧してそのまま15分間保持し、導電性バ
ンプ5先端部が合成樹脂シート6層を貫挿して他の面に
露出した積層板を得た。 その後、前記積層板の電解銅
箔1面にエッチングレジストを印刷し、その電解銅箔1
の選択的なエッチングを行って、配線パターニング7し
てから、前記エッチングレジストをアルカリ水溶液で剥
離除去して、実装用配線板8を得た。
【0023】前記実装用配線板8においては、図4 (b)
に断面的に示すごとく、一方の主面(表面)には、導電
性バンプ5の先端部が端子部(パッド)9として露出
し、他方の主面(裏面)には、端子部9と接続する配線
パターン7が形設された構成を成している。そして、前
記端子部9高精度に所定位置に設定されており、図4
(c)に断面的に示すように、たとえば LSI(半導体)ベ
アチップ10の入出力端子 10aと確実に対接され、金属間
の接合によって安定した電気的な接続がなされた。 実施例3 図5 (a)および (b)は、この実施例による実装用配線板
の製造方法の他の態様例を模式的に示す断面図である。
【0024】先ず、印刷配線板の製造に使用されている
厚さ18μm の電解銅箔、ポリマータイプの銀系ペースト
(商品名:ケミタイトMS-89.東芝ケミカルKK製)、厚さ
100μm のステンレス鋼板の所定位置に 0.1mm径の孔を
明けて成るメタルマスクをそれぞれ用意した。そして、
前記電解銅箔面に、メタルマスクを位置決め配置して、
銀系ペーストを印刷して突起状の導電性バンプを、ほぼ
方形に最小で 0.3mm程度のピッチで被着形成した。前記
印刷した導電性バンプが乾燥後、同一のメタルマスクを
用いて同一位置に再度印刷する方法を4回繰り返し、高
さ60〜 100μmの略円錐状の導電性バンプ形成した。
【0025】次いで、前記電解銅箔の導電性バンプ形成
面側に、厚さ50μm の合成樹脂シート、たとえばテフロ
ン樹脂−ガラスクロス系プリプレグを介して、厚さ18μ
m の電解銅箔を積層配置した。この積層体を、 180℃に
保持した熱プレス機の熱板間にセットし、約1.96×106
Paで加圧してそのまま15分間保持し、図4(b) に断面的
に示すような、導電性バンプの先端部が合成樹脂シート
層を貫挿して対向する電解銅箔面との間が電気的に接続
された積層板を得た。
【0026】次いで、前記積層板の両電解銅箔1面にエ
ッチングレジストを印刷し、その電解銅箔1の選択的な
エッチングを行って、配線パターニングしてから、前記
エッチングレジストをアルカリ水溶液で剥離除去して、
両面型配線板を得た。この両面型配線板の一方の配線パ
ターン面の所定位置に、前記手法にしたがって銀ペース
ト系の導電性バンプの形成、たとえばテフロン樹脂−ガ
ラスクロス系プリプレグを介しての厚さ18μm の電解銅
箔の積層一体化、この電解銅箔の配線パターニングを繰
り返して、図5 (a)に断面的に示すような積層配線板11
を作成した。
【0027】前記作成した積層配線板11の導電性バンプ
5′形成面に、厚さ50μm のたとえばテフロン樹脂−ガ
ラスクロス系プリプレグを介して、前記図4 (b)に図示
した実装用配線板8を積層配置した。この積層体を、 1
80℃に保持した熱プレス機の熱板間にセットし、約1.96
×106 Paで加圧してそのまま15分間保持し、導電性バン
プ5′先端部が合成樹脂シート6層を貫挿して実装用配
線板8の配線パター7に電気的に接続するとともに、実
装用配線板8および積層配線板11が積層一体化して成る
多層型の実装用配線板12を得た。
【0028】前記多層型の実装用配線板12においては、
一方の主面(表面)に導電性バンプ5の先端部が端子部
(パッド)9として露出した構成を成している。そし
て、前記端子部9所定位置に精度よく配設されているの
で、たとえば LSI(半導体)ベアチップの入出力端子に
が確実に対接され、金属間の接合によって安定した電気
的な接続がなされた。
【0029】実施例4 図6 (a)〜 (c)はこの実施例による実装用配線板の製造
方法の態様例を模式的に示したものである。
【0030】先ず、印刷配線板の製造に使用されている
厚さ18μm の電解銅箔、および厚さ150μm の感光性樹
脂フイルム(商品名:Photec SR-3000EB-22 日立化成KK
製)を用意した。そして、前記電解銅箔1の両面に、前
記感光性樹脂(感光性レジスト)フイルム2a,2bを、そ
れぞれ張り合わせた後、マスク3を介して光を感光性レ
ジストフイルム2aに照射(選択的露光)した。なお、こ
の選択的露光処理においては、テスターのブローブ接触
用導体バンプ13を周辺部に設置するための露光も併せて
行った。
【0031】次いで、前記選択的露光した感光性レジス
トフイルム2a,2bについて現像処理を施して、感光性レ
ジストフイルム2aに直径約75μm の孔4,4′を設け
た。
【0032】その後、前記電解銅箔1を陰極として、電
気銅めっき液(商品名:KC500 ジャパンエナジーKK製)
中に浸漬し、電気銅めっき処理および金めっき処理を順
次行い、図6 (a)に断面的に示すごとく、前記感光性レ
ジストフイルム2aの孔4内(電解銅箔1の選択的な露出
面)に、高さ 130μm 程度の銅5aを成長させ、さらにそ
の上に高さ15μm 程度の金5bを積層させ、また孔4′内
(同じく電解銅箔1の選択的な露出面)に高さ 150〜 2
00μm 程度の銅5aを成長させ、さらにその上に、高さ15
μm 程度の金5bを積層させた。前記めっき処理終了後、
マスクとして機能させた感光性樹脂フィルム2a,2bを剥
離して、銅5aおよび金5bが積層された形の突起状導電性
バンプ5,13群が一主面に形成された電解銅箔1を得
た。
【0033】次いで、図6(b) に断面的に示すごとく、
前記電解銅箔1の導電性バンプ5,13形成面側に、基板
本体を成す厚さ50μm のテフロン樹脂−ガラスクロス系
プリプレグ6を積層配置した。この積層体を、 180℃に
保持した熱プレス機の熱板間にセットし、約1.96×106
Paで加圧してそのまま15分間保持し、導電性バンプ5,
13の先端部が合成樹脂シート6層を貫挿して他の面に露
出した積層板を得た。
【0034】さらに、前記積層板の他面に貫挿・露出し
ている導電性バンプ5,13のうち、高さの高い導電性バ
ンプ13をプレス機で押し潰し加工した。次いで、前記積
層板の電解銅箔1面にエッチングレジストを印刷し、そ
の電解銅箔1の選択的なエッチングを行って、配線パタ
ーニングしてから、前記エッチングレジストをアルカリ
水溶液で剥離除去して、図6(c) に断面的に示すよう
な、実装用配線板8′を得た。
【0035】前記構成の実装用配線板では、実装するベ
アチップ10の入出力端子 10aと接続する端子部9に電気
的に接続している端子13′が、周辺部に導出されている
ため、ベアチップ10を搭載・実装した後、前記周辺部に
導出させた端子13′を利用して、搭載・実装したベアチ
ップ10の良,不良のテストを容易に行うことが可能であ
る。つまり、テスターのプローブをベアチップ10の入出
力端子 10aに直接接触させずとも、実装したベアチップ
10の特性調査を容易かつ確実に行うことができ、また、
導電性バンプ5,13が形成する端子部9および端子13′
間を接続する配線パター7の設計によっては、複数個の
テスターのプローブでの特性評価も可能である。 な
お、本発明は上記実施例に限定されるものでなく、発明
の趣旨を逸脱しない範囲でいろいろの変形を採り得る。
たとえば、配線パターン層間の絶縁体としてはテフロン
樹脂−ガラスクロス系の代わりに、ポリイミド樹脂やポ
リサルホン樹脂などを用いてもよい。
【0036】
【発明の効果】上記実施例の説明などからも明らかのよ
うに、本発明に係る実装用配線板の製造方法によれば、
所定位置に精度よく、また微小な端子部(パッド)を備
えた構成を採った実装用配線板を容易に得ることが可能
となる。たとえば、前記端子部の高さのばらつきも± 2
μm 程度以下であり、端子部における接続抵抗も 0.1Ω
以下で、さらに端子部を 100μm 程度のピッチで配設し
得る。そして、前記実装用配線板における端子部の設定
位置や形状の高精度化により、たとえばベアチップの対
応する入出力端子との位置合わせ,接続も確実に行い得
るので、信頼性の高い実装回路装置の提供が可能とな
る。また、前記端子部の表面導出は、導電性バンプの貫
挿で、いわゆる埋め込み形であるため、スルホール穿設
やスルホールめっきなど煩雑な加工作業が不要となるば
かりでなく、前記スルホールによる配線領域および実装
領域の制約も低減されるので、高密度の配線化および実
装化が図られる。
【図面の簡単な説明】
【図1】本発明に係る実装用配線板の製造方法例を模式
的に示すもので、 (a)は銅箔面に設けた感光性樹脂層の
選択的な露光状態を示す断面図、 (b)は現像した状態を
示す断面図、 (c)は露出させた銅箔面にめっき処理し突
起状の導電性バンプを成長させた状態を示す断面図、
(d)は感光性樹脂層銅箔を剥離・除去した状態を示す断
面図。
【図2】本発明に係る実装用配線板の製造方法例を模式
的に示すもので、 (a)は突起状の導電性バンプを設けた
銅箔面に合成樹脂系シートを配置した状態を示す断面
図、 (b)は導電性バンプ先端部が合成樹脂系シートを挿
通した状態を示す断面図、(c)は銅箔を配線パターニン
グした状態を示す断面図。
【図3】本発明に係る実装用配線板に LSIベアチップを
実装した態様例を模式的に示すもので、 (a)は要部断面
図、 (b)は要部平面的な透視図。
【図4】本発明に係る実装用配線板の製造方法の他の実
施態様例を模式的に示すもので、 (a)は露出させた銅箔
面にめっき処理し突起状の導電性バンプを成長させた状
態を示す断面図、 (b)は実装用配線板の断面図、 (c)は
LSIベアチップを実装した状態を示す断面図。
【図5】本発明に係る実装用配線板の別の製造方法例を
模式的に示すもので、 (a)は突起状の導電ペーストで導
電性バンプを設け、この導電性バンプで配線層間を節即
した構成の積層配線板の要部断面図、 (b)は (a)に図示
した積層配線板と図4(b)に図示した実装用配線板とを
積層一体化して成る多層型実装用配線板の要部断面図。
【図6】本発明に係る実装用配線板のさらに別の製造方
法例を模式的に示すもので、(a)は露出させた銅箔面に
めっき処理し突起状の導電性バンプを成長させた状態を
示す断面図、 (b)は突起状の導電性バンプを設けた銅箔
面に合成樹脂系シートを配置した状態を示す断面図、
(c)は銅箔を配線パターニングした状態を示す断面図。
【符号の説明】
1……電解銅箔 2a,2b……感光性樹脂層 3
……マスク 4……マスク孔 5,5′,13…
…導電性バンプ 6……合成樹脂系シート(プリプ
レグ層) 7……配線パターン 8,8′……
実装用配線板 9……端子部 10……ベアチップ 10a……ベア
チップの入出力端子 11……積層配線板 12……多層型積層配線板 1
3′……端子(テスト用) 7……配線パターン
8……ベアチップ
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.7 識別記号 FI H05K 3/40 H05K 3/46 N 3/46 Q 1/18 J // H05K 1/18 H01L 23/12 N (56)参考文献 特開 平4−341772(JP,A) 特開 昭59−175191(JP,A) 特開 平7−72171(JP,A) 特開 昭62−219933(JP,A) 特開 平7−14628(JP,A) 特開 平4−323894(JP,A) 米国特許4991285(US,A) 欧州特許出願公開608726(EP,A 1) (58)調査した分野(Int.Cl.7,DB名) H05K 1/11 H05K 3/40 H05K 3/46

Claims (8)

    (57)【特許請求の範囲】
  1. 【請求項1】 導電性金属箔の主面に感光性レジスト層
    を配設する工程と、 前記感光性レジスト層を選択的に露光し、現像処理して
    前記導電性金属箔の前記主面を選択的に露出させる工程
    と、 前記露出した導電性金属箔の主面上に導電性金属をめっ
    き成長させ、導電性バンプを形成する工程と 前記感 光性レジスト層を剥離・除去する工程と、 前記導電性金属箔の前記導電性バンプ形成された面に
    合成樹脂系シートを重ね積層する工程と、 前記積層された導電性金属箔および合成樹脂系シート
    積層方向に加圧し、前記導電性バンプ先端部を、接続
    用端子部として前記合成樹脂シートの厚さ方向に貫通
    して突出させる工程と、 前記導電性金属箔を選択的にエッチング除去し、配線パ
    ターニングする工程とを具備して成ることを特徴とする
    実装用配線板の製造方法。
  2. 【請求項2】 導電性金属箔の主面に感光性レジスト層
    を配設する工程と、 前記感光性レジスト層を選択的に露光し、現像処理して
    前記導電性金属箔の前記主面を選択的に露出させる工程
    と、 前記露出した導電性金属箔の主面上に導電性金属をめっ
    き成長させ、導電性バンプを形成する工程と 前記感 光性レジスト層を剥離・除去する工程と、 前記導電性金属箔の前記導電性バンプ形成された面に
    合成樹脂系シートを重ね積層する工程と、 前記積層された導電性金属箔および合成樹脂系シート
    積層方向に加圧し、前記導電性バンプ先端部を、接続
    用端子部として前記合成樹脂シートの厚さ方向に貫通
    して突出させる工程とを具備して成ることを特徴とする
    実装用配線板の製造方法。
  3. 【請求項3】 導電性バンプを形成する前記工程は、導
    電性金属の前記めっき成長として低接触抵抗性金属のめ
    っき成長を含むことを特徴とする請求項1または請求項
    2記載の実装用配線板の製造方法。
  4. 【請求項4】 配線パターンを有する配線板の表面に感
    光性レジスト層を配設する工程と、 前記感光性レジスト層を選択的に露光し、現像処理して
    前記配線パターンの表面を選択的に露出させ、前記感光
    性レジスト層に孔を形成する工程と、 前記露出した配線パターン上に導電性金属をめっき成長
    させ、導電性バンプを形成する工程と、 前記感性レジスト層を剥離・除去する工程と、 前記配線板の前記導電性バンプ形成された面に絶縁性
    合成樹脂シートを重ね積層する工程と、 前記積層された配線板および前記絶縁性合成樹脂シート
    積層方向に加圧し、前記導電性バンプ先端部を、接
    続用端子部として前記絶縁性合成樹脂シートの厚さ方向
    に貫通して突出させる工程とを具備して成ることを特徴
    とする実装用配線板の製造方法。
  5. 【請求項5】 導電性箔の表面に感光層を形成する工程
    と、 前記感光層を選択的に露光し、現像処理して前記導電性
    箔の各領域面を選択的に露出させ、前記感光層に孔を形
    成する工程と、 前記露出した導電性箔の表面上に第1の導電性金属を
    っき成長させる工程と、 前記めっき成長させた第1の導電性金属上に第2の導電
    性金属をめっき成長させ、導電性バンプ形成する工程
    記感光層を除去する工程と、 前記形成された導電性バンプ上に絶縁性合成樹脂シート
    を重ね、前記導電性バンプの先端部を前記絶縁性合成樹
    脂シート上に突き出させる工程と、 前記導電性箔をパターニングし、配線パターンを形成す
    る工程と、前記突き出された導電性バンプの先端部に対接して、
    続電極を有するチップを配置する工程と、 前記配線パターン、前記絶縁性合成樹脂シートおよび
    前記チップを、これらの重ねた方向に加圧かつ加熱し、
    前記チップの接続電極を前記導電性バンプの先端に接
    続する工程とを具備して成ることを特徴とする半導体パ
    ッケージの製造方法。
  6. 【請求項6】 導電性金属箔の主面に感光性レジスト層
    を配設する工程と、 前記感光性レジスト層を選択的に露光し、現像処理して
    前記導電性金属箔の前記主面を選択的に露出させ、前記
    感光性レジスト層に孔を形成する工程と、 前記露出した導電性金属箔の主面上に導電性金属をめっ
    き成長させ、導電性バンプを形成する工程と、 前記感性レジスト層を剥離・除去する工程と、 前記導電性金属箔の前記導電性バンプ形成された面に
    第1の絶縁性合成樹脂シートを重ね積層する工程と、 前記積層された導電性金属箔および第1の絶縁性合成樹
    脂シート積層方向に加圧し、前記導電性バンプ先端
    部を、接続用端子部として前記第1の絶縁性合成樹脂シ
    ートの厚さ方向に貫通して突出させる工程と、 前記導電性金属箔を選択的にエッチング除去し、第1の
    配線パターンを形成する工程と、 所定位置に第2の導電性バンプが形成された第2の配線
    パターンを有する配板上に第2の絶縁性合成樹脂シー
    トを介して前記第1の配線パターンさらに前記第1の絶
    縁性合成樹脂シートを重ね積層する工程と、 前記積層された配線板、第2の絶縁性合成樹脂シート、
    第1の配線パターン、および第1の絶縁性合成樹脂シー
    積層方向に加圧し、前記第2の導電性バンプ先端
    部を前記第2の絶縁性合成樹脂シートの厚さ方向に貫
    せて前記第1の配線パターンと接続する工程とを具備
    して成ることを特徴とする実装用配線板の製造方法。
  7. 【請求項7】 前記配線板は多層配線板であることを特
    徴とする請求項記載の実装用配線板の製造方法。
  8. 【請求項8】 前記配板は、 第の導電性金属箔の表面所定位置に第3の導電性バン
    プのための孔を有する金属マスクを配置し、前記金属マ
    スクを介して前記第2の導電性金属箔上に導電性ペース
    印刷しこれを乾燥することを繰り返すことにより、
    前記第3の導電性バンプを形成する工程と、 前記第3の導電性バンプを有する前記第2の導電性金属
    上に樹脂シートと第の導電性金属箔とを順次重ね
    程と、 前記重ねられた第2の導電性金属箔、樹脂シート、およ
    び第3の導電性金属箔を同時に加熱加圧し、前記第3の
    導電性バンプが前記樹脂シートを貫通してその先端部が
    前記第の導電性金属箔に接続した積層シートを形成す
    る工程と、 前記第の導電性金属箔面および前記第の導電性金属
    箔面上にエッチングレジスト層を印刷し、前記第およ
    び前記第の導電性金属箔を選択的にエッチングして配
    線パターンを形成し、前記エッチングレジスト層を除
    する工程とを備えた製造工程により両面配線板を形成す
    ることを複数回有して形されることを特徴とする請求
    記載の実装用配線板の製造方法。
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US (2) US5737833A (ja)
JP (1) JP3474937B2 (ja)

Families Citing this family (46)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3474937B2 (ja) * 1994-10-07 2003-12-08 株式会社東芝 実装用配線板の製造方法、半導体パッケージの製造方法
JP3687041B2 (ja) * 1997-04-16 2005-08-24 大日本印刷株式会社 配線基板、配線基板の製造方法、および半導体パッケージ
JP3935480B2 (ja) * 1998-07-29 2007-06-20 ソニーケミカル&インフォメーションデバイス株式会社 フレキシブル基板製造方法
JP2000106482A (ja) * 1998-07-29 2000-04-11 Sony Chem Corp フレキシブル基板製造方法
JP3420706B2 (ja) * 1998-09-22 2003-06-30 株式会社東芝 半導体装置、半導体装置の製造方法、回路基板、回路基板の製造方法
JP2000164638A (ja) 1998-11-27 2000-06-16 Toshiba Corp 半導体装置
TW396462B (en) * 1998-12-17 2000-07-01 Eriston Technologies Pte Ltd Bumpless flip chip assembly with solder via
JP3701807B2 (ja) * 1999-01-20 2005-10-05 ソニーケミカル株式会社 基板製造方法、及び基板
US6930390B2 (en) 1999-01-20 2005-08-16 Sony Chemicals Corp. Flexible printed wiring boards
US6915566B2 (en) * 1999-03-01 2005-07-12 Texas Instruments Incorporated Method of fabricating flexible circuits for integrated circuit interconnections
US6288905B1 (en) * 1999-04-15 2001-09-11 Amerasia International Technology Inc. Contact module, as for a smart card, and method for making same
JP2001015551A (ja) 1999-06-29 2001-01-19 Toshiba Corp 半導体装置およびその製造方法
JP3183653B2 (ja) * 1999-08-26 2001-07-09 ソニーケミカル株式会社 フレキシブル基板
US6583364B1 (en) * 1999-08-26 2003-06-24 Sony Chemicals Corp. Ultrasonic manufacturing apparatuses, multilayer flexible wiring boards and processes for manufacturing multilayer flexible wiring boards
KR100455748B1 (ko) * 1999-10-08 2004-11-06 다이니폰 인사츠 가부시키가이샤 비접촉식 데이터 캐리어 및 집적회로칩
US6630630B1 (en) * 1999-12-14 2003-10-07 Matsushita Electric Industrial Co., Ltd. Multilayer printed wiring board and its manufacturing method
US6469394B1 (en) 2000-01-31 2002-10-22 Fujitsu Limited Conductive interconnect structures and methods for forming conductive interconnect structures
JP4322402B2 (ja) * 2000-06-22 2009-09-02 大日本印刷株式会社 プリント配線基板及びその製造方法
US6329609B1 (en) 2000-06-29 2001-12-11 International Business Machines Corporation Method and structure to prevent distortion and expansion of organic spacer layer for thin film transfer-join technology
JP4023076B2 (ja) * 2000-07-27 2007-12-19 富士通株式会社 表裏導通基板及びその製造方法
JP2002324957A (ja) * 2001-04-24 2002-11-08 Mitsui Mining & Smelting Co Ltd プリント回路板及びその製造方法
US6701614B2 (en) * 2002-02-15 2004-03-09 Advanced Semiconductor Engineering Inc. Method for making a build-up package of a semiconductor
JP4045143B2 (ja) * 2002-02-18 2008-02-13 テセラ・インターコネクト・マテリアルズ,インコーポレイテッド 配線膜間接続用部材の製造方法及び多層配線基板の製造方法
KR20030095758A (ko) * 2002-06-14 2003-12-24 주식회사 심텍 비어 스터드 형성방법
US7320173B2 (en) * 2003-02-06 2008-01-22 Lg Electronics Inc. Method for interconnecting multi-layer printed circuit board
US7015580B2 (en) * 2003-11-25 2006-03-21 International Business Machines Corporation Roughened bonding pad and bonding wire surfaces for low pressure wire bonding
JP4540365B2 (ja) * 2004-03-02 2010-09-08 イビデン株式会社 プリント配線板
KR100793423B1 (ko) 2004-08-30 2008-01-11 엘지전자 주식회사 인쇄회로기판의 제조방법
JP4813035B2 (ja) * 2004-10-01 2011-11-09 新光電気工業株式会社 貫通電極付基板の製造方法
TWI255466B (en) * 2004-10-08 2006-05-21 Ind Tech Res Inst Polymer-matrix conductive film and method for fabricating the same
JP4597631B2 (ja) * 2004-10-13 2010-12-15 大日本印刷株式会社 部品内蔵配線板、部品内蔵配線板の製造方法
JP3976043B2 (ja) * 2004-10-25 2007-09-12 セイコーエプソン株式会社 半導体装置及びその製造方法
US7259391B2 (en) * 2004-12-22 2007-08-21 General Electric Company Vertical interconnect for organic electronic devices
KR101084777B1 (ko) * 2005-02-03 2011-11-21 파나소닉 주식회사 플립 칩 실장체와 그 실장 방법 및 범프 형성 방법
KR100664500B1 (ko) * 2005-08-09 2007-01-04 삼성전자주식회사 돌기부를 갖는 메탈 랜드를 구비하는 인쇄회로기판 및 그의제조방법
KR100723270B1 (ko) * 2005-12-13 2007-05-30 전자부품연구원 다층 인쇄회로기판 제조방법
US7394028B2 (en) * 2006-02-23 2008-07-01 Agere Systems Inc. Flexible circuit substrate for flip-chip-on-flex applications
KR100709896B1 (ko) * 2006-02-28 2007-04-23 주식회사 두산 다층 배선 기판 및 그 제조방법
JP5091600B2 (ja) * 2006-09-29 2012-12-05 三洋電機株式会社 半導体モジュール、半導体モジュールの製造方法および携帯機器
DE112008000704T5 (de) * 2007-03-22 2010-04-29 Murata Mfg. Co., Ltd., Nagaokakyo-shi Kontaktlochbildungsverfahren, das ein elektrophotographisches Druckverfahren verwendet
JP4788654B2 (ja) * 2007-05-14 2011-10-05 大日本印刷株式会社 配線板の製造方法
JP5152601B2 (ja) * 2010-06-01 2013-02-27 日立化成工業株式会社 薄板状物品を用いた接続基板の製造方法と多層配線板の製造方法
US9407117B2 (en) * 2012-04-12 2016-08-02 Eastman Kodak Company Shaped electrical conductor
CN103456715B (zh) * 2012-06-04 2017-06-09 欣兴电子股份有限公司 中介基材及其制作方法
JPWO2020017582A1 (ja) 2018-07-20 2021-06-24 株式会社村田製作所 モジュール
CN118250933B (zh) * 2023-12-27 2025-05-27 礼鼎半导体科技(深圳)有限公司 具有微间距导电凸块的基板及其制造方法

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4991285A (en) 1989-11-17 1991-02-12 Rockwell International Corporation Method of fabricating multi-layer board

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4788767A (en) * 1987-03-11 1988-12-06 International Business Machines Corporation Method for mounting a flexible film semiconductor chip carrier on a circuitized substrate
US4813128A (en) * 1988-01-13 1989-03-21 Cray Research, Inc. High density disposable printed circuit inter-board connector
JP3142951B2 (ja) * 1992-04-21 2001-03-07 日東電工株式会社 両面基板の製造方法
US5259110A (en) * 1992-04-03 1993-11-09 International Business Machines Corporation Method for forming a multilayer microelectronic wiring module
US5432999A (en) * 1992-08-20 1995-07-18 Capps; David F. Integrated circuit lamination process
CA2109687A1 (en) * 1993-01-26 1995-05-23 Walter Schmidt Method for the through plating of conductor foils
DE69419219T2 (de) * 1993-09-03 2000-01-05 Kabushiki Kaisha Toshiba, Kawasaki Leiterplatte und Verfahren zur Herstellung solcher Leiterplatten
JP3474937B2 (ja) * 1994-10-07 2003-12-08 株式会社東芝 実装用配線板の製造方法、半導体パッケージの製造方法

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4991285A (en) 1989-11-17 1991-02-12 Rockwell International Corporation Method of fabricating multi-layer board

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JPH08111583A (ja) 1996-04-30
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