Deprecated: The each() function is deprecated. This message will be suppressed on further calls in /home/zhenxiangba/zhenxiangba.com/public_html/phproxy-improved-master/index.php on line 456
JP3859978B2 - 基板上の半導体材料膜に横方向に延在する結晶領域を形成する装置 - Google Patents
[go: Go Back, main page]

JP3859978B2 - 基板上の半導体材料膜に横方向に延在する結晶領域を形成する装置 - Google Patents

基板上の半導体材料膜に横方向に延在する結晶領域を形成する装置 Download PDF

Info

Publication number
JP3859978B2
JP3859978B2 JP2001055483A JP2001055483A JP3859978B2 JP 3859978 B2 JP3859978 B2 JP 3859978B2 JP 2001055483 A JP2001055483 A JP 2001055483A JP 2001055483 A JP2001055483 A JP 2001055483A JP 3859978 B2 JP3859978 B2 JP 3859978B2
Authority
JP
Japan
Prior art keywords
semiconductor material
mask
radiation beam
masked
material film
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP2001055483A
Other languages
English (en)
Other versions
JP2001274088A (ja
Inventor
エス イム ジェイムス
Original Assignee
ザ トラスティーズ オブ コロンビア ユニヴァーシティ イン ザ シティ オブ ニューヨーク
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by ザ トラスティーズ オブ コロンビア ユニヴァーシティ イン ザ シティ オブ ニューヨーク filed Critical ザ トラスティーズ オブ コロンビア ユニヴァーシティ イン ザ シティ オブ ニューヨーク
Priority to JP2001055483A priority Critical patent/JP3859978B2/ja
Publication of JP2001274088A publication Critical patent/JP2001274088A/ja
Application granted granted Critical
Publication of JP3859978B2 publication Critical patent/JP3859978B2/ja
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Images

Landscapes

  • Thin Film Transistor (AREA)
  • Recrystallisation Techniques (AREA)

Description

【0001】
技術分野
本発明は、半導体集積化デバイス用の半導体材料の処理方法に関するものである。
【0002】
発明の背景
半導体デバイスは例えば水晶又はガラスの基板上のシリコンの層又は膜に形成することができる。この技術はイメージセンサ及びアクティブマトリックス液晶表示装置(AMLCD)のデバイスの製造に用いられる。後者の場合、適切に透明な基板上の薄膜トランジスタ(TFT)の規則的なアレイにおいて、各トランジスタは画素コントローラとして作用する。市販されているAMLCDデバイスにおいて、薄膜トランジスタは水和したアモルファスシリコン膜に形成される(a−Si:H TFT)。
【0003】
TFTのスイッチング特性を増強するため、アモルファスシリコンの代わりに多結晶シリコンが用いられている。多結晶構造体は、例えば堆積しているアモルファス又は微結晶シリコン膜をエキシマレーザで結晶化(ELC)することにより得られる。
【0004】
しかしながら、ランダムに結晶化している多結晶シリコンを用いる場合、満足されない結果が生じてしまう。小さな粒子のポリシリコンの場合、例えばTFTのアクティブチャネル領域において多数の大きな角度の粒子境界によりデバイス性能が制限されてしまう。大粒子のポリシリコンはこの点に関しては優れているが、あるTFTに別のTFTと比べて顕著な粒子構造の不規則性が存在するとTFTアレイにデバイス特性の不均一性が生じてしまう。
【0005】
発明の概要
デバイス特性及びデバイスの不均一性を改善するため、基板上の半導体膜に横方向に凝固させる技術を適用する。この人為的に制御されるスーパラテラル成長(ACSLG)と称せられる技術は、例えばレーザビームパルスのような適当な放射パルスにより膜の一部を露光し、膜をその全厚さにわたって局部的に溶融することを含む。溶融した半導体材料が凝固すると、膜の予め定めた完全に溶融しなかった部分から結晶構造が成長する。
この技術の第1の好適な実施例において、露光される構造体は基板により支持された第1の半導体膜、第1の半導体膜上の耐熱性膜、及び耐熱性膜上の第2の半導体膜を含む。この実施例において、構造体の前側及び後側の両方をパルスで露光する。
【0006】
好適な第2の実施例において、横方向の凝固は、第1の領域からくびれた第2の領域を経てデバイス領域として意図した第3の領域へ進行する。この実施例では、基板を介して加熱する領域と関連して一方の側からの露光を用いる。
好適な第3の実施例において、ビームを繰り返し照射し、放射パターンを横方向にステップ移動させて溶融及び凝固を繰り返すことにより拡大した単一結晶領域を形成する。
有益なものとして、この技術は高速液晶表示装置の製造に用いることができ、その製造においては画素コントローラ及び/又はドライバ回路は単一結晶として又は規則的な/準規則的な多結晶膜として形成する。別の用途として、イメージセンサ、スタティックランダムアクセスメモリ(SRAM)、シリコンオンインシュレータ(SOI)デバイス、及び3次元集積化回路デバイスが含まれる。
【0007】
好適実施例の説明
以下において実験的に実現された特有の実施例及びその変形例について説明する。明示的又は内在的な数個の変形例は実施例と共通し、さらに請求の範囲内において別の変形例が当業者にとって自明である。例えば、ゲルマニウム、シリコン−ゲルマニウム、ゲルマニウム砒素又はインジウム燐のようなシリコン以外の半導体材料を用いることを含むものである。処理条件下における安定性、不活性及び耐熱性について考慮された例えばシリコン、水晶、ガラス又はプラスチックのような適切な材料の基板を用いることも含むものである。例えば電子ビーム又はイオンビームのようなレーザビーム以外の放射ビームを用いることも含む。
【0008】
第1実施例
図1の投影露光装置は、エキシマレーザ11、ミラー12、ビームスプリッタ13、可変焦点視野レンズ14、パターン化された投影マスク15、2個の素子の結像レンズ16、サンプルステージ17、可変減衰器18、及び収束レンズ19を含んでいる。この投影装置を用いることにより、ステージ17上のサンプル10の前側面及び後側面に同時に放射パルスを供給することができる。
【0009】
この技術の第1実施例の場合、図2に示すように、透明基板20、第1のアモルファスシリコン膜21、SiO2 膜22、及び第2のアモルファスシリコン膜23を含む「二重層」(DL)サンプル構造体を用意した。アモルファスシリコン膜の膜厚は100nmとし、SiO2 膜の膜厚は500nmとした。例えば窒化シリコン又は高温ガラスのような別の耐熱性材料を膜22に用いることができる。
【0010】
第2のすなわち頂部シリコン膜23上にパターン投影を行い第1のすなわち底部シリコン膜21にブロードなビーム照射を行うと、第1のシリコン膜21は含まれる犠牲層として調整され、頂部シリコン膜23における横方向の結晶化速度を最大にすることができる。これらの膜の役割は、パターンを基板を介して第1の膜上に投影する場合、反転させることができる。パターンが投影された膜において、横方向に凝固した粒子が形成され、例えばTFT用に良好に適合した処理膜が形成される。
【0011】
図2に基づく構造体は、アモルファス−シリコン、SiO2 トラックアモルファス−シリコンを水晶基板上に順次低圧化学気相体積することにより用意される。アモルファス又は微結晶堆積する別の適切な堆積方法には、例えばプラズマエンハンスド化学気相堆積(PECVD)、蒸着、又はスパッタリングが含まれる。
【0012】
サンプルは図1の投影露光装置のステージ17上に配置する。マスク15は、10〜100μmの種々の分離距離で50μm幅の簡単な細条のパターンを有する。
【0013】
マスクパターンは3〜6の範囲の種々の縮小倍率でサンプル上に投影する。後ろ側のエネルギー密度は可変減衰器18により制御する。サンプルは308nmの波長の30n秒XeClエキシマレーザを用いて室温で照射され、この波長域において水晶は透明である。このレーザは、LambdaPhysik Compex 301の商品名で市販されている。ガラス基板の場合、例えば348nmのようなより長い波長が必要である。
【0014】
ビーム照射は固定された前側エネルギー密度及び種々の後側エネルギー密度で行う。評価した前側エネルギー密度はサンプル面で約1.0J/cm2 である。後側エネルギー密度は170〜680mJ/cm2 である。
照射に続いて試験を行うため、膜全体をセコ(Secco)エッチ剤を用いて欠陥エッチングを行い、走査型電子顕微鏡(SEM)を用いて試験を行った。最も大きな不均一な粒子は510mJ/cm2 の後側エネルギー密度の場合に得られた。これらの粒子は細条状領域の2個の側から横方向に成長し、細条の中心線上に良好に規定された粒子境界で2本の粒子列を形成している。
生じた個別の結晶体がTFTのアクティブチャネル領域全体を形成するのに十分でない場合でも、この結晶体は例えば図3A又は図3Bに図示するようなTFTのアクティブチャネル領域として作用できる規則的な又は準規則的な多結晶構造体を形成する。ソース電極31、ドレイン電極32ゲート電極33及びアクティブチャネル領域34を示す。図3Aにおいて、アクティブチャネル領域は、上述したようにして生成された両方の粒子列を含む。図3Bのような十分に大きな粒子の場合、アクティブチャネル領域は粒子の単一列として形成することができる。
【0015】
第1の実施例による処理方法において、底部犠牲層21の役割は、ビームにより加熱する場合エネルギーを蓄積する加熱サセプタの役割として理解することができ、最大の効果はこの膜が溶融する場合に得られる。蓄積した熱は凝固中に解放される。これにより、頂部膜23が伝導により熱を喪失する程度が低減される。従って、最大の利点を得るためには、露光される構造体を適切な寸法にすることが重要である。SiO2 膜22が薄過ぎる場合、シリコン膜21及び23の放熱は一緒になってしまい、膜21を形成することによる利点が得られない。他方において、膜22が物理的なプロセスの熱拡散距離に対して厚過ぎる場合、膜21が頂部膜23の変換に対して不十分に作用することになる。底部膜21に関して、その厚さは、この膜が十分な熱量を有するように選択する必要がある。しかし、膜21がより厚い場合、この膜を溶融するのにより多くのエネルギーが必要となる。
【0016】
シリコン層23上にパターンを露光する代わりに、例えば近接マスク、コンタクトマスク又はフォトリソグラフィによりパターン化された堆積したマスク層により所望のパターンを規定することができる。
マスキングの変形例において、マスク層は例えば入射する放射を吸収又は反射することによりマスクの下側の領域での加熱を低減するように作用できる。或いは、適切な厚さの適当なマスク材料を用い場合、相補的な反射防止効果が実現され、付加的なエネルギーをマスク材料の下側の半導体膜に流入させることができる。例えば、SiO2 膜を用いてこの効果をシリコン膜に及ぼすことができる。この変形例は、マスク層が溶融した半導体材料に対する拘束部材として作用し、溶融半導体層が表面張力の作用により塊に凝集したり変形するのを防止する利点がある。
【0017】
第2実施例
図4の露光装置は、エキシマレーザ41、プリズム偏向器42、集束レンズ43、真空チャンバ44及びサンプルを配置するホットステージ45を含む。
本発明の図4の露光装置を用いる第2の実施例において、図5のサンプル構造体は、基板50、熱酸化膜51、第1のパターン化されたアモルファスシリコン膜52、SiO2 膜53、第2のパターン化されたアモルファスシリコン膜54、及びさらに堆積したSiO2 膜55を含む。典型的な厚さは、熱酸化膜51については100nmとし、アモルファスシリコン膜52については100nmとし、SiO2膜53については210nmとし、アモルファスシリコン膜54については120nmとし、SiO2 膜55については170nmとする。
【0018】
このサンプル構造体はシリコンウェハ50上の熱酸化膜51上に低圧化学気相堆積(LPCVD)によりアモルファスシリコン膜52を堆積することにより得られる。シリコン膜52にフォトレジストをコートし、その後ステッパにより露光し、現像し、さらにシリコン膜52をSF6 /O2 プラスマで反応性イオンエッチングを行いパターン形成を行う。シリコン膜52の第1レベルのアイランドの得られたパターンを図6Aに上方から見た図面として示す。このパターンは、デバイスとして使用される四角形の主アイランド領域523、矩形の「テイル」領域521、及びテイル領域521と主アイランド領域523とを結ぶ「ボトルネック」領域522の3個の領域で構成される。これらの寸法は以下のように選択する。テイル領域521については20×10μmとし、ボトムネック領域522については5×3μmとし、主アイランド領域521については10×10μmから50×50μmの範囲の異なる寸法とする。
【0019】
第1レベルのアイランドにはプラズマ−エンハンド気相堆積(PECVD)によりSiO2 膜53を形成し、上側にアモルファスシリコンを堆積する。フォトリソグラフィ処理を用いてアモルファスシリコンについてパターニングを行い、5×5μmの寸法の「第2のレベルのアイランド」54を形成する。第2レベルのアイランド54はテイル領域521の上側に直接位置し露光中のビーム遮光区域として作用する。最後に、この構造体全体にPECVDのSiO2 層を形成する。
【0020】
処理を行うため、サンプルを10-5トールの圧力の真空チャンバ内の耐熱性グラファイトのホットステージ上に配置する。別の適当な加熱装置を利用できる場合、真空処理を省略することができる。基板温度が1000〜1200°になるまで加熱を行い、これには約3分の立ち上がり時間を必要とする。露光する前にサンプルを最終的な基板温度に約2分間保持する。サンプルの温度は、直接取り付けた熱電対により間欠的にモニタすると共にディジタルの赤外線サーモメータにより連続的にモニタする。サンプルは、単一のエキシマレーザパルスを用いてテイル領域内のビーム遮光領域区域以外の全ての第1のレベルのアイランドが完全に溶融するのに十分高いエネルギー密度で露光する。
【0021】
微細構造の分析を行うため、露光したサンプルをセコウ(Secco)エッチングを行った。1150°Cの基板温度で露光したサンプルの場合、セコウエッチングされたサンプルのノマルスキー顕微鏡写真は、20×20、40×40及び50×50μmのアイランドは単一結晶のアイランド(SCI)に完全に変換されているのを示している。エッチングされたサンプルの欠陥パターンは、主アイランド領域が、SLGの研究で認められている平面欠陥に加えて、ゾーンメルティングの再結晶化で観測されるものと同様な小角サブ境界を含むことを示唆している。1100°Cのような低い基板温度の場合、20×20μmの小さいアイランドだけが大角粒界のない単一結晶のアイランドに変換された。1050及び1000°Cの一層低い基板温度の場合、20×20μmのアイランドに大角粒界面が発生している。
【0022】
この第2実施例の凝固過程は図6B〜6Dに基づいて理解することができる。すなわち、露光に際して、第2レベルの四角形の領域54はこの領域に入射するビームエネルギーの大部分を遮光し、テイル領域521のビームが遮光された区域での完全な溶融が阻止される。露光された第1レベルの領域の残りの部分は、図6Bに示すように完全に溶融する。膜が基板を介して冷却されると、ビームが遮光された領域の液相−固相界面は冷却不足になり、シリコン粒子61がビーム遮光領域から外側に向けて急速に成長を開始する。テイル領域内において、多くの粒子61は素早く結びつき、1個又は数個の好ましく位置する粒子だけがボトルネック部522に向けて成長する。ボトルネック部522は、1個の粒子がボトルネック部を経て主アイランド領域523に拡張するような形態を有する。基板温度が十分に高く主アイランド領域523が急激に冷却された液中での凝集が防止されるほど小さい場合、ボトルネック部522を経て成長した1個の粒子の横方向の成長により主アイランド523全体が単一の結晶領域に変換される。
【0023】
従って、主アイランド領域523の単一結晶形態への有用な変換は、基板温度とアイランド領域の大きさとの適切な組合せを必要とする。溶融したシリコンは、横方向凝固により完全に変換するために必要な特性時間よりも長い特定の体積を凝固させるための特性時間にわたって十分に高い温度に維持する必要がある。この特性変換時間は主として変換すべき距離すなわち主アイランドの横方向の寸法に依存するので、、特性変換時間が液体中で凝固がトリガされる前に達成できる平均横方向成長距離に匹敵するようにアイランドの大きさを基板温度に関係付ける必要がある。ゾーンメルティング再結晶と比較して、本発明の技術は例えば100nm又はそれ以下の厚さの極めて薄い膜を再結晶させることができる。
【0024】
ビームを阻止する代わりに、第1の実施例について説明したように、反射防止膜を用いて相補的なマスキングにより種領域を規定することができる。或いは、露光により種領域を規定することができる。
【0025】
第3実施例
図7の投影露光装置は、エキシマレーザ71、ミラー72、可変焦点視野レンズ74、パターンが形成されたマスク75、2素子結像レンズ76、サンプルステージ77、及び可変減衰器78を含む。サンプル70はサンプルステージ77上に配置する。この装置を用いて鮮明なビームを発生させることにより、順次横方向凝集(SLS)プロセスで単一結晶のシリコン領域を段階成長させることができる。或いは、近接マスク又は接触マスクを用いてビーム成形することができる。
【0026】
図8のサンプル構造体は、基板80、熱酸化膜81、及びアモルファスシリコン膜82を有する。
以下の説明において、図9A〜9F、第1の変形例の2個の例を示す図10A〜10F及び第2の変形例を示す図11A〜11Bを参照して第3実施例の技術を説明する。
【0027】
本例において矩形にパターン化されているアモルファスシリコン膜82からスタートし(図9A)、2本の破線により境界されているシリコン膜82の領域91をパルスで露光し、この領域のシリコンを完全に溶融させ(図9B)、次に領域91の溶融シリコンを再凝固させる(図9C)。ここで、領域91は細条状とし、この領域91の露光はマスクされた露光により又は近接マスクを用いて行うことができる。領域91の溶融シリコンの再凝固に際し、2個の粒子列が領域91の破線の境界部から領域91の中央に向けて爆発的に成長する。2本の粒子列の成長は、最終の距離92に至る特有の横方向の成長である。領域91の残りの部分において、微細に粒子化した多結晶領域93が形成される。好ましくは、この細条の幅は、再凝固に際し2本の粒子列が集束することなく互いに近づくように選択する。本発明から除外されるものではないが、幅が広くなっても処理の効率に寄与することはない。幅を狭くすると望ましくない傾向にある。この理由は、以後の工程において長さを短くしなければならず、しかも凝固プロセス中に対向する方向から成長する粒子が一緒になる位置において半導体表面が不規則になる可能性があるためである。シリコン膜上に酸化キャップ層を形成し、凝集を遅くすると共にシリコン膜の表面の歪みを低減して表面を円滑にすることができる。
【0028】
露光される隣接領域はマスク投影又は近接マスクに対してサンプルを結晶成長の方向にシフト(ステッピング)することにより規定される。シフトした(ステップ移動した)領域94は図9Dの2本の破線により境界される。シフトする距離は、露光される次の領域が前回露光した領域と重なって図9Eに示すように一方の結晶の列が部分的に溶融する間に他方の結晶の列が完全に溶融するように設定する。再凝固に際し、部分的に溶融している結晶の列は、する。9Fに示すように、一層長くなる。この態様において、露光される部分を繰り返しシストすることにより、所望の長さの単一結晶粒子を成長せることができる。
露光された領域のパターンが単一細条でなく、図10Aの破線で規定されるように山形形状101である場合、図10B〜10F に示す露光領域を同一の順序でシフトすることにより、シフトされた山形パターンの縁部の頂部から粒子の成長が拡大する。このようにして、単一結晶の領域を幅及び長さを増大しながら成長させることができる。
【0029】
大面積の単一結晶領域は、図11Aに図示され、テイル領域111、細いボトルネック領域112及び主アイランド領域113を有するパターン化されたアモルファスシリコン膜に順次シフト(ステップ状に)した露光領域を形成することにより成長させることができる。図11A〜11Cの領域111、112及び113の断面は、放射遮光アモルファスシリコン領域54及び第2の二酸化シリコン層55が存在しないことを除いて図5に示すものと同様である。マスクされた露光又は近接マスクにより規定された露光領域は図11A〜11Cの破線により境界された領域により図示されており、この図11はテイル領域111からボトルネック領域112を経て単一粒子を成長させて単一結晶のアイランド領域113を形成するための露光領域の順次の横方向シフト(ステッピング)を示す。
【0030】
図9A〜9F、図10A〜10F及び図11A〜11Cの実施例の順次の横方向溶融及び再凝固は、水晶基板上にコートされ膜厚が100〜240nmのの二酸化シリコン上に化学気相堆積(CVD)により堆積したアモルファスシリコン膜について行った。単一結晶細条の形成はは、欠陥エッチングサンプルの光学式走査電子顕微鏡により確認した。
【0031】
選択的なものとして、基板を加熱して溶融に必要なビームエネルギーを低減し又は1ステップ当たりの横方向の成長距離を増大することができる。この利点は、図1に示すステージ上のサンプルを2方向からの露光により実現することができる。
【0032】
別の処理及び用途
本発明により形成された半導体膜を用いることにより、例えばパターン規定、エッチング、不純物注入、絶縁層の堆積、コンタクト形成、及びパターン化された金属層の相互接続のような良好に確立された別の技術により集積化された半導体デバイスを製造することができる。好適な薄膜半導体トランジスタにおいて、少なくともアクティブチャネル領域は、例えば図3A及び3Bに示す単一結晶の規則的な又は少なくともほぼ規則的な微細構造を有する。
特に注目すべきことは、図12に線図的に示す液晶表示装置にこのようなTFTが含まれることである。このデバイスは、少なくとも表示窓部分121が透明な基板120を含む。この表示窓含む121は画素122の規則的なアレイを含み、各画素はTFT画素コントローラを含む。各画素コントローラはドライバ123により個別にアドレスされることができる。好ましくは、画素コントローラ及び/又はドライバ回路は本発明の技術に基づいて形成した半導体材料で形成する。
別の用途して、イメージセンサ、スタテックランダムアクセスメモリ(SRAM)、シリコン−オンインシュレータ(SOI)デバイス、及び三次元集積回路デバイスが含まれる。
【図面の簡単な説明】
【図1】 図1はこの技術の第1実施例として用いることができる投影露光装置の線図でである。
【図2】 図2は第1実施例のためのサンプル構造体の拡大した線図的側面図である。
【図3】 図3A及び3Bは第1実施例の半導体材料に形成することができるTFTデバイスの微細構造体の拡大した線図的上面図である。
【図4】 図4はこの技術の第2の実施例で用いることができる露光装置の線図である。
【図5】 図5は第2実施例のサンプル構造体の拡大した線図的側面図である。
【図6】 図6A〜6Dは順次の処理工程における図5のサンプル構造体の線図的上面図である。
【図7】 図7は第3実施例に用いることができる露光装置の線図である。
【図8】 図8は第3実施例のサンプル構造体の拡大した線図的側面図である。
【図9】 図9A〜9Fは処理の第1の変形例の第1の形式の順次の工程における図8のサンプル構造体の線図的側面図である。
【図10】 図10A〜10Fは処理の第1の変形例の第2の形式の順次の工程における図8のサンプル構造体の線図的側面図である。
【図11】 図11A〜11Cは処理の第2の変形例の順次の工程におけるサンプル構造体の線図的側面図である。
【図12】 図12はTFTが含まれている液晶表示装置の線図的上面図である。

Claims (15)

  1. 基板上の半導体材料膜に横方向に延在する結晶領域を形成する装置であって、
    (a)パルス状の放射ビームを発生するパルス放射ビーム源と、
    (b)それぞれ前記半導体材料膜を露光するための予め定めた強度パターンを有すると共に前記半導体材料膜の露光された部分をその厚さ全体にわたって溶融させるたの十分なエネルギーを有するマスクされた放射ビームパルスを形成するビームマスクと、
    (c)前記半導体材料膜の少なくとも一部分がマスクされた放射ビームパルスにより露光される間に前記基板上に、前記半導体材料膜を保持すると共に、前記基板上の前記半導体材料膜を、前記マスクされた放射ビームパルスに対して横切る方向に移動させるサンプル移動ステージとを具え、
    前記サンプル移動ステージが第1の位置に位置する場合、前記半導体材料膜の第1の部分をマスクされた放射ビームパルスにより露光して、第1の部分の前記半導体材料をその厚さ全体にわたって溶融し、第1の部分の前記半導体材料を凝固させて前記第1の部分の境界に沿って少なくとも1個の半導体結晶を形成し、前記半導体結晶を次の処理に対する直前の部分とし、
    前記サンプル移動ステージが次の位置に移動し、この位置において、前記少なくとも1個の半導体結晶と部分的にオーバラップする前記半導体材料膜の次の部分をマスクされた放射ビームパルスにより露光して前記次の部分の半導体材料をその厚さ全体にわたって溶融し、前記次の部分の溶融した前記半導体材料を凝固させて横方向に成長させることにより前記少なくとも1個の半導体結晶を拡大し、
    前記サンプル移動ステージが別の位置まで繰り返し移動し、その位置において、直前の部分が凝固した後、前記半導体材料膜の別の部分をマスクされたビームパルスにより露光し、各別の部分は直前の部分の少なくとも1個の半導体結晶と部分的にオーバラップし、横方向に成長させることにより前記少なくとも1個の半導体結晶を所望の結晶領域が形成されるまで拡大させる装置。
  2. 請求項1に記載の装置において、前記パルス放射ビーム源をパルス発振するレーザとし、当該装置は、放射ビームパルスがレーザから前記ビームマスクまで伝搬する第1の光路を含む装置。
  3. 請求項2に記載の装置において、前記パルス発振するレーザをパルス発振エキシマレーザとした装置。
  4. 請求項2に記載の装置において、前記第1の光路が、前記レーザからの放射ビームパルスをビームマスクに投影する視野レンズを有する装置。
  5. 請求項2に記載の装置において、前記ビームマスクを投影マスクとした装置。
  6. 請求項2に記載の装置において、前記マスクを近接マスクとした装置。
  7. 請求項2に記載の装置において、前記マスクを接触マスクとした装置。
  8. 請求項2に記載の装置において、前記第1の光路が、レーザからの放射ビームパルスの強度を減衰させる可変減衰器を含む装置。
  9. 請求項2に記載の装置において、前記第1の光路が、少なくとも1個のビームステアリングミラーを含む装置。
  10. 請求項1に記載の装置において、パルス放射ビーム源をレーザとし、前記ビームマスクを投影マスクとし、さらに前記ビームマスクからサンプル移動ステージ上の半導体材料までマスクされた放射ビームパルスが伝搬する第2の光路を有する装置。
  11. 請求項10に記載の装置において、前記第2の光路が、マスクされた放射ビームパルスをサンプル移動ステージ上で露光される前記半導体材料膜の一部分上に集束させる対物レンズを含む装置。
  12. 請求項10に記載の装置において、前記第2の光路が、前記マスクされた放射ビームパルスを減衰させる可変減衰器を含む装置。
  13. 請求項11に記載の装置において、前記第2の光路が、少なくとも1個のビームステアリングミラーを有する装置。
  14. 請求項1に記載の装置において、前記ビームマスクが、各マスクされた放射ビームパルスの強度パターンを規定し、この強度パターンが前記半導体材料膜を露光する少なくとも1個の細条の形状を含む装置。
  15. 請求項1に記載の装置において、前記ビームマスクが、各マスクされた放射ビームパルスの強度パターンを規定し、この強度パターンが前記半導体材料膜を露光する少なくとも1個の山形の形状を含む装置。
JP2001055483A 2001-02-28 2001-02-28 基板上の半導体材料膜に横方向に延在する結晶領域を形成する装置 Expired - Lifetime JP3859978B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2001055483A JP3859978B2 (ja) 2001-02-28 2001-02-28 基板上の半導体材料膜に横方向に延在する結晶領域を形成する装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2001055483A JP3859978B2 (ja) 2001-02-28 2001-02-28 基板上の半導体材料膜に横方向に延在する結晶領域を形成する装置

Related Parent Applications (1)

Application Number Title Priority Date Filing Date
JP54227097A Division JP3204986B2 (ja) 1996-05-28 1996-05-28 基板上の半導体膜領域の結晶化処理及びこの方法により製造されたデバイス

Publications (2)

Publication Number Publication Date
JP2001274088A JP2001274088A (ja) 2001-10-05
JP3859978B2 true JP3859978B2 (ja) 2006-12-20

Family

ID=18915665

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2001055483A Expired - Lifetime JP3859978B2 (ja) 2001-02-28 2001-02-28 基板上の半導体材料膜に横方向に延在する結晶領域を形成する装置

Country Status (1)

Country Link
JP (1) JP3859978B2 (ja)

Families Citing this family (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4584953B2 (ja) * 2001-08-30 2010-11-24 シャープ株式会社 半導体装置の製造方法
JP4651249B2 (ja) * 2001-11-09 2011-03-16 シャープ株式会社 半導体薄膜の製造装置およびその製造方法ならびに表示装置
KR100831227B1 (ko) 2001-12-17 2008-05-21 삼성전자주식회사 다결정 규소를 이용한 박막 트랜지스터의 제조 방법
KR100514179B1 (ko) * 2002-11-19 2005-09-13 삼성에스디아이 주식회사 박막 트랜지스터 및 이를 사용하는 유기 전계 발광 소자
JP4813743B2 (ja) * 2002-07-24 2011-11-09 株式会社 日立ディスプレイズ 画像表示装置の製造方法
TWI221102B (en) * 2002-08-30 2004-09-21 Sumitomo Heavy Industries Laser material processing method and processing device
US7470602B2 (en) 2002-10-29 2008-12-30 Sumitomo Heavy Industries, Ltd. Crystalline film and its manufacture method using laser
JP4481562B2 (ja) * 2002-11-29 2010-06-16 キヤノン株式会社 結晶性薄膜の製造方法
JP4583004B2 (ja) 2003-05-21 2010-11-17 株式会社 日立ディスプレイズ アクティブ・マトリクス基板の製造方法
JP2005129769A (ja) * 2003-10-24 2005-05-19 Hitachi Ltd 半導体薄膜の改質方法、改質した半導体薄膜とその評価方法、およびこの半導体薄膜で形成した薄膜トランジスタ、並びにこの薄膜トランジスタを用いて構成した回路を有する画像表示装置
US7018468B2 (en) * 2003-11-13 2006-03-28 Sharp Laboratories Of America, Inc. Process for long crystal lateral growth in silicon films by UV and IR pulse sequencing
KR101045204B1 (ko) 2004-02-07 2011-06-30 삼성전자주식회사 연속 측방 고상법을 이용하여 단결정 실리콘 박막을형성하는 방법
JP4534585B2 (ja) * 2004-05-11 2010-09-01 日立電線株式会社 薄膜半導体基板及びその製造方法
KR100713894B1 (ko) * 2006-03-17 2007-05-04 비오이 하이디스 테크놀로지 주식회사 결정화 패턴 및 이를 이용한 비정질실리콘의 결정화 방법
US20080030877A1 (en) * 2006-08-07 2008-02-07 Tcz Gmbh Systems and methods for optimizing the crystallization of amorphous silicon

Also Published As

Publication number Publication date
JP2001274088A (ja) 2001-10-05

Similar Documents

Publication Publication Date Title
JP3204986B2 (ja) 基板上の半導体膜領域の結晶化処理及びこの方法により製造されたデバイス
JP4470395B2 (ja) 半導体薄膜の製造方法及び製造装置、並びに薄膜トランジスタ
US6169014B1 (en) Laser crystallization of thin films
JP3859978B2 (ja) 基板上の半導体材料膜に横方向に延在する結晶領域を形成する装置
US8598588B2 (en) Systems and methods for processing a film, and thin films
US20040192013A1 (en) Method for fabricating single crystal silicon film
JP5068171B2 (ja) 結晶方位制御ポリシリコン膜を生成するためのシステム及び方法
JP4637410B2 (ja) 半導体基板の製造方法及び半導体装置
JP2002110544A (ja) レーザアニールによる薄膜結晶成長
US9087696B2 (en) Systems and methods for non-periodic pulse partial melt film processing
JPH08236443A (ja) 半導体結晶の成長方法および半導体製造装置
TWI575571B (zh) 部分熔融膜之非週期性脈衝處理系統及方法
CN101288155A (zh) 高生产率的薄膜结晶过程
US20110233591A1 (en) Phase modulation device, phase modulation device fabrication method, crystallization apparatus, and crystallization method
TWI389316B (zh) 薄膜電晶體、半導體裝置、顯示器、結晶化方法及製造薄膜電晶體方法
JP2002057105A (ja) 半導体薄膜製造方法、半導体薄膜製造装置、およびマトリクス回路駆動装置
US20050211987A1 (en) Semiconductor device, manufacturing method thereof and manufacturing apparatus therefor
JP4769491B2 (ja) 結晶化方法、薄膜トランジスタの製造方法、薄膜トランジスタおよび表示装置
JP2003249448A (ja) 半導体装置の製造方法、半導体装置の製造装置、半導体膜の製造装置、および半導体装置
JP2005228808A (ja) 半導体デバイスの製造方法
JP2005123262A (ja) 半導体デバイスおよびその製造方法
KR100575235B1 (ko) 레이저 광학계 및 이를 이용한 결정화 방법
JP2005150438A (ja) 半導体デバイスの製造方法
CN100468626C (zh) 半导体器件的制造方法
Ganot Laser Crystallization of Silicon Thin Films for Three-Dimensional Integrated Circuits

Legal Events

Date Code Title Description
A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20041221

A601 Written request for extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A601

Effective date: 20050322

A602 Written permission of extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A602

Effective date: 20050325

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20050621

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20060905

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20060920

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100929

Year of fee payment: 4

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110929

Year of fee payment: 5

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110929

Year of fee payment: 5

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120929

Year of fee payment: 6

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130929

Year of fee payment: 7

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

EXPY Cancellation because of completion of term