Deprecated: The each() function is deprecated. This message will be suppressed on further calls in /home/zhenxiangba/zhenxiangba.com/public_html/phproxy-improved-master/index.php on line 456
JP4035755B2 - Icテスタ - Google Patents
[go: Go Back, main page]

JP4035755B2 - Icテスタ - Google Patents

Icテスタ Download PDF

Info

Publication number
JP4035755B2
JP4035755B2 JP2001075298A JP2001075298A JP4035755B2 JP 4035755 B2 JP4035755 B2 JP 4035755B2 JP 2001075298 A JP2001075298 A JP 2001075298A JP 2001075298 A JP2001075298 A JP 2001075298A JP 4035755 B2 JP4035755 B2 JP 4035755B2
Authority
JP
Japan
Prior art keywords
voltage
output
converter
dut
pmu
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2001075298A
Other languages
English (en)
Other versions
JP2002277504A (ja
Inventor
明男 杉村
敏秋 塚田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Yokogawa Electric Corp
Original Assignee
Yokogawa Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Yokogawa Electric Corp filed Critical Yokogawa Electric Corp
Priority to JP2001075298A priority Critical patent/JP4035755B2/ja
Publication of JP2002277504A publication Critical patent/JP2002277504A/ja
Application granted granted Critical
Publication of JP4035755B2 publication Critical patent/JP4035755B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Images

Landscapes

  • Testing Of Individual Semiconductor Devices (AREA)

Description

【0001】
【発明の属する技術分野】
本発明は、被試験対象、例えば、IC、LSI等を試験するICテスタに関し、高電圧を出力できるICテスタに関するものである。
【0002】
【従来の技術】
ICテスタは、直流特性試験と機能特性試験とがある。直流特性試験は、IC、LSI等の被試験対象(以下DUTと略す)に直流電圧または直流電流を与え、DUTの直流電流または直流電圧を測定し、良否の判定を行っている。そして、機能特性試験は、DUTに試験パターンを与え、DUTからの出力と期待値パターンとを比較し、良否の判定を行っている。このような装置を図2に示し説明する。
【0003】
図において、DUT1は例えばIC,LSI等である。ドライバDは、試験パターンを入力し、増幅して、DUT1に出力する。コンパレータCは、DUT1からの出力を入力し、所定の電圧と比較し、比較結果を出力する。パラメトリックメジャーユニット(以下PMUと略す)2は、DUT1に直流電圧または直流電流出力を行い、電流または電圧測定を行う。なお、ここでは、DUT1の1ピンに対しての接続構成を説明したが、DUT1の各ピンにドライバD、コンパレータC、PMU2が設けられることは言うまでもない。また、PMU2は、DUT1の各ピンごとに設けられず、複数のPMU2をリレーにより切り替えてDUT1の各ピンに接続する構成もある。
【0004】
このような装置の動作を以下に説明する。直流特性試験を行う場合、PMU2から直流電圧または直流電流をDUT1に与え、電流または電圧の測定を行う。そして、所定の電圧または電流範囲に入っているかどうかで、DUT1の良否の判定を行う。
【0005】
また、機能特性試験を行う場合、試験パターンを、ドライバDを介して、DUT1に出力する。そして、DUT1が試験パターンに基づいた出力を行う。この出力をコンパレータCは入力し、所定の電圧と比較し、ハイレベルかロウレベルかの比較結果を出力する。この比較結果と期待値パターン(ハイレベル、ロウレベル)とを比較し、DUT1の良否の判定を行う。
【0006】
【発明が解決しようとする課題】
近年、被試験対象であるIC,LSI等は、消費電圧を下げ、高集積化のため、低電圧で、高速動作になっている。このため、ICテスタも低電圧、高速動作に対応している。そのため、PMU2は、例えば、±32V、±30mAの出力、測定が行えるように構成されている。
【0007】
しかし、例えば、蛍光表示制御ICは、制御部等の部分は低電圧、高速動作であるが、蛍光管を表示させる部分に、−40Vの電圧を必要としている。
【0008】
このため、−40Vに係る部分の蛍光表示制御ICを試験するために、PMU2と別に、−40Vの高電圧を出力できる高価なソース部を設けなければならなかった。
【0009】
そこで、本発明の目的は、低電圧を出力するソース部を用いて、高電圧を出力できるICテスタを実現することにある。
【0010】
【課題を解決するための手段】
本発明は、
被試験対象を試験するICテスタにおいて、
少なくとも直流電圧出力を行うソース部と、
直流電圧または交流電圧を出力する電圧発生部と、
この電圧発生部の電圧を入力し、所望の直流電圧に変換し、前記ソース部の出力電圧にオフセット電圧として加え、前記被試験対象に出力するコンバータと
を有することを特徴とするものである。
【0011】
【発明の実施の形態】
以下図面を用いて本発明の実施の形態を説明する。図1は本発明の一実施例を示した構成図である。
【0012】
図において、DUT1は、蛍光表示制御ICで、FETQ、抵抗Rを有する。FETQのドレインは、図示しない汎用電源により、+5Vが供給されている。抵抗Rの一端はFETQのソースに接続する。なお、ここでは、DUT1の要部だけ説明し、詳細な構成は省略する。PMU2はソース部で、少なくとも直流電圧出力を行い、直流電流測定を行う。汎用電源3は電圧発生部で、±32Vの直流電圧を出力する。DC/DCコンバータ4はコンバータで、汎用電源3の直流電圧を入力し、トランスにより、アイソレーションして、所望の直流電圧に変換し、プラス出力端をPMU2の出力端に接続し、PMU2の出力電圧にオフセット電圧として加え、DUT1に出力する。
【0013】
スイッチSW1は、一端をDC/DCコンバータ4のマイナス出力端に接続し、他端をDUT1の抵抗Rの他端に接続する。スイッチSW2は、一端をDC/DCコンバータ4のマイナス出力端に接続する。アッテネータ5は、スイッチSW2の他端に接続し、DC/DCコンバータ4の出力電圧を減衰する。PMU6は、アッテネータ5の出力を入力し、電圧を測定する。テストシステムコントローラ(以下TSCと略す)7は制御部で、PMU2,6、汎用電源3、スイッチSW1,SW2等に接続し、各部の制御を行う。実際には、図2に示すように、ドライバ、コンパレータ等も有しているが、本発明の主要部でないので、省略する。
【0014】
このような装置の動作を以下で説明する。機能特性試験は従来と同様なので説明を省略し、直流特性試験(電圧出力、電流測定)について説明する。
【0015】
TSC7は、スイッチSW1をオフし、スイッチSW2をオンし、PMU2、汎用電源3を制御し、それぞれ−25V、30Vの直流電圧を出力させる。そして、DC/DCコンバータ4は、汎用電源3からの30Vの直流電圧を15Vの直流電圧に変換し、出力する。このとき、DC/DCコンバータ4のプラス出力端にPMU2の出力が接続されているので、マイナス出力端から−40Vの直流電圧が出力される。この−40Vの直流電圧は、スイッチSW2を介して、アッテネータ5で減衰され、PMU6で測定される。この測定結果により、TSC7は、正確に、−40VがDUT1に与えられるように、PMU2の出力電圧を調整する。
【0016】
次に、TSC7は、スイッチSW1,SW2をオフし、PMU2に測定を行わせる。このとき、PMU2が測定した電流をオフセット電流とする。
【0017】
そして、TSC7は、スイッチSW1をオンし、スイッチSW2をオフして、DUT1に、PMU2の出力電圧とDC/DCコンバータ4の出力電圧とにより、−40Vを出力する。このとき、DUT1のFETQはオフ(何も接続されていない状態)で、PMU2は電流測定を行い、この電流からオフセット電流を引いて、FETQのドレイン−ソース間のリーク電流とする。このリーク電流が所定の電流範囲に入っているかどうかにより、TSC7はDUT1の良否の判定を行う。
【0018】
このように、PMU2の出力電圧に、DC/DCコンバータ4の出力電圧をオフセット電圧として加えて、DUT1に出力するので、PMU2の出力電圧以上の電圧を出力することができる。これにより、高電圧を出力できるソース部を設ける必要がなく、非常に安価なDC/DCコンバータ4を用いるだけでよく、安価にICテスタを構成することができる。
【0019】
また、PMU6により、DUT1に与える電圧を測定し、TSC7により、PMU2の出力電圧の調整を行うので、正確な電圧出力を行うことができ、正確な試験を行うことができる。
【0020】
そして、PMU2は、DUT1の接続前にオフセット電流を測定し、DUT1の接続時に測定結果からオフセット電流を引くので、DC/DCコンバータ4の影響がない正確な電流測定を行うことができる。
【0021】
なお、本発明はこれに限定されるものではなく、以下のような構成でもよい。
【0022】
(1)アッテネータ5とPMU6とからなる測定部の構成を示したが、アッテネータ5を設けない測定部により測定する構成でもよい。
【0023】
(2)TSC7は、PMU6の測定結果により、PMU2を調整する構成を示したが、DC/DCコンバータ4や汎用電源3を調整して、DC/DCコンバータのオフセット電圧を調整し、DUT1に与える電圧の調整を行う構成でもよい。
【0024】
(3)電圧発生部として、汎用電源3を用いた例を示したが、PMUにしてもよい。
【0025】
(4)DC/DCコンバータ4の出力電圧を正電圧だけでなく、負電圧も出力させれば、DC/DCコンバータ4のプラス出力端、マイナス出力端の接続方向に制限されない。
【0026】
(5)ソース部が、電圧出力と電流測定を行うPMU2を示したが、少なくとも電圧出力する構成であればよい。
【0027】
(6)電圧発生部(汎用電源30)が直流電圧を出力し、コンバータ(DC/DCコンバータ4)で直流電圧を所望の直流電圧に変換する構成を示したが、電圧発生部が交流電圧を出力し、コンバータ(AC/DCコンバータ)で交流電圧を、トランスによりアイソレーションして、所望の直流電圧に変換する構成でもよい。
【0028】
(7)PMU2が、測定結果からオフセット電流を引く構成を示したが、TSC7で、オフセット電流を引いてもよいし、測定結果の良否の範囲にオフセット電流を加える構成でもよい。
【0029】
【発明の効果】
本発明によれば、以下の効果がある。
請求項1,3によれば、ソース部の出力電圧に、コンバータの出力電圧をオフセット電圧として加えて、被試験対象に出力するので、ソース部の出力電圧以上の電圧を出力することができる。これにより、高電圧を出力できるソース部を設ける必要がなく、非常に安価なコンバータを用いるだけでよく、安価にICテスタを構成することができる。
【0030】
請求項2,3によれば、測定部により、被試験対象に与える電圧を測定し、制御部により、ソース部の出力電圧またはコンバータのオフセット電圧の調整を行うので、正確な電圧出力を行うことができ、正確な試験を行うことができる。
【0031】
請求項4によれば、ソース部は、被試験対象の接続前にオフセット電流を測定するので、被試験対象の測定時にオフセット電流を考慮すれば、コンバータの影響がない正確な電流測定または試験を行うことができる。
【図面の簡単な説明】
【図1】本発明の一実施例を示した構成図である。
【図2】従来のICテスタの概略構成を示した図である。
【符号の説明】
1 DUT
2,6 PMU
3 汎用電源
4 DC/DCコンバータ
5 アッテネータ
7 TSC

Claims (4)

  1. 被試験対象を試験するICテスタにおいて、
    少なくとも直流電圧出力を行うソース部と、
    直流電圧または交流電圧を出力する電圧発生部と、
    この電圧発生部の電圧を入力し、所望の直流電圧に変換し、前記ソース部の出力電圧にオフセット電圧として加え、前記被試験対象に出力するコンバータと
    を有することを特徴とするICテスタ。
  2. コンバータが被試験対象に出力する電圧を測定する測定部と、
    この測定部の測定結果により、ソース部の電圧の調整またはコンバータが加えるオフセット電圧を調整する制御部と
    を設けたことを特徴とする請求項1記載のICテスタ。
  3. ソース部が直流電流測定を行うことを特徴とする請求項1または2記載のICテスタ。
  4. ソース部は、被試験対象に接続する前に、オフセット電流を測定することを特徴とする請求項3記載のICテスタ。
JP2001075298A 2001-03-16 2001-03-16 Icテスタ Expired - Fee Related JP4035755B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2001075298A JP4035755B2 (ja) 2001-03-16 2001-03-16 Icテスタ

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2001075298A JP4035755B2 (ja) 2001-03-16 2001-03-16 Icテスタ

Publications (2)

Publication Number Publication Date
JP2002277504A JP2002277504A (ja) 2002-09-25
JP4035755B2 true JP4035755B2 (ja) 2008-01-23

Family

ID=18932401

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2001075298A Expired - Fee Related JP4035755B2 (ja) 2001-03-16 2001-03-16 Icテスタ

Country Status (1)

Country Link
JP (1) JP4035755B2 (ja)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6804620B1 (en) * 2003-03-21 2004-10-12 Advantest Corporation Calibration method for system performance validation of automatic test equipment
JP4894069B2 (ja) * 2007-02-05 2012-03-07 横河電機株式会社 直流モジュール装置

Also Published As

Publication number Publication date
JP2002277504A (ja) 2002-09-25

Similar Documents

Publication Publication Date Title
US6456097B1 (en) Fault current detection method
JP2001324552A (ja) 電源電流測定ユニット及び半導体テストシステム
US20100109674A1 (en) Device, test apparatus and test method
JP4035755B2 (ja) Icテスタ
RU2670715C1 (ru) Стенд для испытания электродвигателей постоянного и переменного тока
JPH07244125A (ja) Ic試験装置
US20030030446A1 (en) Method for providing compensation current and test device using the same
JP2008298641A (ja) 回路基板検査方法及び装置
EP1635183B1 (en) Device for monitoring quiescent current of an electronic device
JPH0743430A (ja) Icテスタ用校正装置
JP4061533B2 (ja) Icテスタ
JP3436138B2 (ja) 半導体試験装置用バイアス電源回路
JP2003107135A (ja) バーンイン装置
JP3553509B2 (ja) 半導体集積回路及びその検査方法
JP3180435B2 (ja) 液晶駆動ドライバic試験装置
JP3331103B2 (ja) Icテスタの電流測定装置
JPH05190637A (ja) 半導体集積回路の試験方法
JP7803000B1 (ja) 充放電検査装置の校正装置および校正方法
JP5003955B2 (ja) Icテスタ
JP3598643B2 (ja) 半導体集積回路測定装置および半導体集積回路装置
JP4502448B2 (ja) Ic試験装置における電圧発生器の校正方法・電圧発生器の校正装置
JPH06148264A (ja) リーク電流の測定方法
JPH0712887A (ja) 電流試験装置
JPH1090336A (ja) 周波数発生器の自動試験装置
JPH0694797A (ja) Icテストシステム

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20050818

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20070706

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20070717

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20070810

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20071004

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20071017

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20101109

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20101109

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20111109

Year of fee payment: 4

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20111109

Year of fee payment: 4

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20121109

Year of fee payment: 5

LAPS Cancellation because of no payment of annual fees