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JP4747787B2 - Delay time difference measuring method and delay time difference measuring apparatus - Google Patents
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JP4747787B2 - Delay time difference measuring method and delay time difference measuring apparatus - Google Patents

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Description

本発明は遅延時間差測定方法及び遅延時間差測定装置に係り、特に複数の経路で同一のパケット信号を伝送した場合に、その伝送パケット信号の経路間の伝搬遅延時間差を測定する遅延時間差測定方法及び遅延時間差測定装置に関する。   The present invention relates to a delay time difference measuring method and a delay time difference measuring apparatus, and more particularly to a delay time difference measuring method and delay for measuring a propagation delay time difference between paths of the transmitted packet signal when the same packet signal is transmitted through a plurality of paths. The present invention relates to a time difference measuring apparatus.

複数の経路を介して同一の素材のパケット信号が伝送され、それらの中から一つの経路を介して伝送された情報を同期して無瞬断で切替えるような場合、その伝送パケット信号の経路間の伝搬遅延時間差を測定する必要がある。例えば、現用回線から予備回線への同期切替を行うためには、上記の伝搬遅延時間差を測定し、その測定結果に基づいて、現用回線と予備回線を伝送する各パケット信号を遅延する遅延回路の遅延時間を調整することが従来から行われている(例えば、特許文献1、2参照)。   When packet signals of the same material are transmitted via multiple paths, and information transmitted via one path is synchronized and switched without interruption, between the paths of the transmitted packet signals. It is necessary to measure the propagation delay time difference. For example, in order to perform synchronous switching from the working line to the protection line, the above-described propagation delay time difference is measured, and based on the measurement result, a delay circuit that delays each packet signal transmitted between the working line and the protection line Conventionally, the delay time is adjusted (see, for example, Patent Documents 1 and 2).

上記のような場合、従来から例えば、図5に示すような遅延時間差測定装置を用いて伝播遅延時間差を測定している。図5は従来の遅延時間差測定装置の一例のブロック図を示す。同図において、同一の素材をMPEG(Moving Picture Experts Group)方式により圧縮符号化して得られたトランスポートストリーム(TS)信号を伝送するシステムにおいて、第1の伝送路(例えば、現用回線)を伝送する第1のTS信号はPATパケットトラップ回路31及び遅延調整用メモリ34にそれぞれ供給され、また、第2の伝送路(例えば、予備回線)を伝送する第2のTS信号はPATパケットトラップ回路32及び遅延調整用メモリ35にそれぞれ供給される。第1のTS信号と第2のTS信号は、同一の素材(映像、音声等)を圧縮符号化した信号である。   In the above case, conventionally, for example, the propagation delay time difference is measured using a delay time difference measuring apparatus as shown in FIG. FIG. 5 shows a block diagram of an example of a conventional delay time difference measuring apparatus. In the figure, in a system that transmits a transport stream (TS) signal obtained by compressing and coding the same material by the MPEG (Moving Picture Experts Group) method, the first transmission path (for example, working line) is transmitted. The first TS signal to be transmitted is supplied to the PAT packet trap circuit 31 and the delay adjustment memory 34, respectively, and the second TS signal transmitted through the second transmission path (for example, the protection line) is the PAT packet trap circuit 32. And the delay adjustment memory 35 respectively. The first TS signal and the second TS signal are signals obtained by compression-coding the same material (video, audio, etc.).

PATパケットトラップ回路31及び32はそれぞれ入力されたTS信号中からPATパケットを検出し、PATパケット時間差検出回路33へ検出したPATのみ転送する。PATパケット時間差計算回路33では、各入力系統からPATをトラップした時刻の差分を計算し、差分が0になるように、遅延補正用メモリ34、35に対して遅延時間設定を行う。   Each of the PAT packet trap circuits 31 and 32 detects a PAT packet from the input TS signal, and transfers only the detected PAT to the PAT packet time difference detection circuit 33. The PAT packet time difference calculation circuit 33 calculates the difference in time when the PAT is trapped from each input system, and sets the delay time in the delay correction memories 34 and 35 so that the difference becomes zero.

特開平5−219027号公報Japanese Patent Laid-Open No. 5-219027 特開平8−237230号公報JP-A-8-237230

しかしながら、上記の従来の遅延時間差測定装置では、基本的に同一のTSでの遅延測定を前提条件としており、PAT(Program Association Table:番組表)やPMT(Program Map Table:番組対応表)など固定パターンをもったTSパケットを受信する時刻の差で遅延を測定している。このため、複数ある伝送路中のある系のみでTS多重化処理が行われたり、あるいは系統毎に多重化処理が異なる場合、伝送路上にTS多重化装置が入り、パケットのPID(Packet Identification:パケットの識別)やプログラム番号の付け替え処理により、PATの再生成処理が入ると、PATのパケットの内容が書き換えられてしまうため、各系統間で同一のパケットであるという認識ができないという問題がある。   However, the conventional delay time difference measuring apparatus described above is basically premised on delay measurement at the same TS, and fixed such as PAT (Program Association Table) and PMT (Program Map Table). The delay is measured by the difference in the time at which TS packets having a pattern are received. For this reason, when the TS multiplexing process is performed only in a certain system in a plurality of transmission paths, or when the multiplexing process is different for each system, the TS multiplexing apparatus enters on the transmission path, and the packet PID (Packet Identification: If PAT regeneration processing is entered by packet identification) or program number reassignment processing, the contents of the PAT packet will be rewritten, so that there is a problem that the same packet cannot be recognized between the systems. .

また、通常、TS多重化器ではPAT、PMTを独自のタイミングで送出するため、元のPAT、PMTの送出間隔と異なる独自の間隔でPAT、PMTパケットを送出するため、元々のPAT、PMT送出タイミング情報が伝送できないという問題もある。   In addition, since the PAT and PMT are normally sent at a unique timing in the TS multiplexer, the PAT and PMT packets are sent at a unique interval different from the transmission interval of the original PAT and PMT. There is also a problem that timing information cannot be transmitted.

本発明は以上の点に鑑みてなされたもので、伝送経路上でTSパケットの多重化処理が行われた場合でも伝送経路の遅延時間差を測定し得る遅延時間差測定方法及び遅延時間差測定装置を提供することを目的とする。   The present invention has been made in view of the above points, and provides a delay time difference measuring method and a delay time difference measuring apparatus capable of measuring a delay time difference of a transmission path even when TS packet multiplexing processing is performed on the transmission path. The purpose is to do.

上記の目的を達成するため、第1の発明の遅延時間差測定方法は、複数の伝送系によりそれぞれ伝送された同一の情報を含むMPEG方式によるトランスポートストリームを入力として受け、それら複数の伝送系で伝送されたトランスポートストリームの間の相対的な遅延時間差を測定する遅延時間差測定方法において、複数の伝送系のうち第1の伝送系を経て入力された第1のトランスポートストリーム中の測定に使用するパケット識別情報であるPIDを持った第1のパケットのみを通過させる第1のステップと、第1のステップで通過された第1のパケットが圧縮データの先頭データを含むTSパケットであることを示す第1のパケットのヘッダ部の第1のペイロードユニットスタートインジケータビットを検出する第2のステップと、第2のステップで検出された第1のペイロードユニットスタートインジケータビットを有する第1のパケットを記憶手段に記憶する第3のステップと、第2のステップの第1のペイロードユニットスタートインジケータビットの検出時点で、一定周波数のクロックをカウントするカウンタからのパケットの到達時刻を示すカウント値をラッチする第4のステップと、複数の伝送系のうち第2の伝送系を経て入力された、第1のトランスポートストリームと送信元が同一で同一の情報を含む第2のトランスポートストリーム中の測定に使用するパケット識別情報であるPIDを持った第2のパケットのみを通過させる第5のステップと、第5のステップで通過された第2のパケットが圧縮データの先頭データを含むTSパケットであることを示す第2のパケットのヘッダ部の第2のペイロードユニットスタートインジケータビットを検出する第6のステップと、記憶手段に記憶された第1のパケットのペイロード部を比較基準とし、第6のステップにより検出された第2のペイロードユニットスタートインジケータビットを有する第2のパケットのペイロード部を比較対象として比較し、両者が一致したとき一致信号を出力する第7のステップと、一致信号が出力された時の、カウント手段からのカウント値をラッチする第8のステップと、第4のステップと第8のステップでそれぞれラッチされた値の差分値から、第1のトランスポートストリームと第2のトランスポートストリームとの遅延時間差を得る第9のステップとを含むことを特徴とする。 In order to achieve the above object, a delay time difference measuring method according to a first aspect of the present invention receives an MPEG transport stream including the same information transmitted by a plurality of transmission systems as an input, and the plurality of transmission systems In a delay time difference measuring method for measuring a relative delay time difference between transmitted transport streams, the method is used for measurement in a first transport stream input through a first transmission system among a plurality of transmission systems. The first step of passing only the first packet having the PID which is the packet identification information to be transmitted, and the first packet passed in the first step is a TS packet including the head data of the compressed data a second step of detecting the first payload unit start indicator bit in the header portion of the first packet indicating A third step of storing the first packet having a first payload unit start indicator bit detected in the second step in the storage means, the detection time of the first payload unit start indicator bit in the second step The fourth step of latching the count value indicating the arrival time of the packet from the counter that counts the clock with a constant frequency, and the first transformer input via the second transmission system among the plurality of transmission systems. A fifth step of allowing only a second packet having a PID which is packet identification information used for measurement in a second transport stream having the same information as the port stream and the same transmission source; the second packets passed in step is a TS packet including the head data of compressed data A sixth step of detecting a second payload unit start indicator bit in the header portion of the to the second packet, the first comparison reference payload portion of a packet stored in the storage unit, detected by the sixth step A second step of comparing the payload part of the second packet having the second payload unit start indicator bit as a comparison target and outputting a coincidence signal when the two coincide with each other, and when the coincidence signal is outputted The first transport stream and the second transport stream are obtained from the eighth step of latching the count value from the counting means, and the difference values of the values latched in the fourth step and the eighth step, respectively. And a ninth step of obtaining a delay time difference of

また、上記の目的を達成するため、第2の発明は、複数の伝送系によりそれぞれ伝送された同一の情報を含むMPEG方式によるトランスポートストリームを入力として受け、それら複数の伝送系で伝送されたトランスポートストリームの間の相対的な遅延時間差を測定する遅延時間差測定装置において、一定周波数のクロックをカウントしてパケットの到達時刻を示すカウント値を出力するカウント手段と、複数の伝送系のうち第1の伝送系を経て入力された第1のトランスポートストリーム中の測定に使用するパケット識別情報であるPIDを持った第1のパケットのみを通過させる第1のパケットトラップ手段と、第1のパケットトラップ手段により通過された第1のパケットが圧縮データの先頭データを含むTSパケットであることを示す第1のパケットのヘッダ部の第1のペイロードユニットスタートインジケータビットを検出する第1の検出手段と、第1の検出手段で検出された第1のペイロードユニットスタートインジケータビットを有する第1のパケットを記憶する記憶手段と、第1の検出手段による第1のペイロードユニットスタートインジケータビットの検出時点でカウント手段からのカウント値をラッチする第1のラッチ手段と、複数の伝送系のうち第2の伝送系を経て入力された、第1のトランスポートストリームと送信元が同一で同一の情報を含む第2のトランスポートストリーム中の測定に使用するパケット識別情報であるPIDを持った第2のパケットのみを通過させる第2のパケットトラップ手段と、第2のパケットトラップ手段により通過された第2のパケットが圧縮データの先頭データを含むTSパケットであることを示す第2のパケットのヘッダ部の第2のペイロードユニットスタートインジケータビットを検出する第2の検出手段と、記憶手段に記憶された第1のパケットのペイロード部を比較基準とし、第2の検出手段により検出された第2のペイロードユニットスタートインジケータビットを有する第2のパケットのペイロード部を比較対象として比較し、両者が一致したとき一致信号を出力する比較手段と、一致信号が出力された時の、カウント手段からのカウント値をラッチする第2のラッチ手段と、第1のラッチ手段と第2のラッチ手段でそれぞれラッチされた値の差分値から、第1のトランスポートストリームと第2のトランスポートストリームとの遅延時間差を得る演算手段とを有することを特徴とする。 In order to achieve the above object, the second invention receives an MPEG transport stream including the same information transmitted by a plurality of transmission systems as an input, and is transmitted by the plurality of transmission systems. In a delay time difference measuring apparatus for measuring a relative delay time difference between transport streams, counting means for counting a clock having a constant frequency and outputting a count value indicating arrival time of a packet, and a first of a plurality of transmission systems A first packet trap means for passing only a first packet having PID which is packet identification information used for measurement in a first transport stream inputted through one transmission system; and a first packet it first packets passed by the trap means is TS packet containing head data of compressed data First packet having a first detecting means for detecting a first payload unit start indicator bit in the header portion of the first packet, the first payload unit start indicator bit detected by the first detecting means shown storage means for storing a first latch means for latching a count value from the counting means at the detection time point of the first payload unit start indicator bit of the first detecting means, a second of the plurality of transmission systems A second packet having a PID which is packet identification information used for measurement in a second transport stream that is input through the transmission system and includes the same information as the first transport stream and the same transmission source Is passed by the second packet trap means and the second packet trap means. Second detecting means for the second packet detecting a second payload unit start indicator bit in the header portion of the second packet indicating that the TS packet including the head data of the compressed data, stored in the storage means The payload portion of the first packet is used as a reference for comparison, and the payload portion of the second packet having the second payload unit start indicator bit detected by the second detection means is compared as a comparison target. The comparator means for outputting the coincidence signal, the second latch means for latching the count value from the counting means when the coincidence signal is outputted, and the first latch means and the second latch means, respectively. The difference in delay time between the first transport stream and the second transport stream is obtained from the difference value of the obtained values. And calculating means.

本発明によれば、パケットが圧縮データの先頭データを含むTSパケットであることを示すペイロードユニットインジケータビット同士の2つのパケットのペイロード部を比較して両者が一致するときの受信時刻の差から遅延時間差を演算することにより、PAT、PMTの内容に関係なく遅延時間差を演算することができるため、経路の途中でPIDの付け替えや、PAT、PMTパケットの送出間隔の変更や、プログラム番号の付け替えが発生しても、同一のパケットかどうかの検出が可能であり、結果として遅延時間差検出ができる。 According to the present invention, the payload unit indicator bits indicating that the packet is a TS packet including the head data of the compressed data are compared with each other in the payload part of the two packets, and the delay is caused by the difference in reception time when the two match. By calculating the time difference, the delay time difference can be calculated regardless of the contents of the PAT and PMT, so the PID can be changed in the middle of the route, the transmission interval of the PAT and PMT packets can be changed, and the program number can be changed. Even if they occur, it is possible to detect whether or not they are the same packet, and as a result, a delay time difference can be detected.

また、本発明によれば、遅延時間差の測定に、PAT、PMTパケットのような多重化器で再生成されることが無いパケットのヘッダ部のペイロードユニットインジケータビットを使用するので、ペイロード部比較頻度を大きく減らしてパケットが多重化器を通過する時の多重化処理時間のばらつきの範囲内で安定して遅延時間測定できる。
Further, according to the present invention, the measurement of the delay time difference, PAT, because it uses Bae Lee load unit indicator bit of the header portion of the regenerated it is not packet multiplexer such as the PMT packet, a payload unit comparison The delay time can be measured stably within a range of variation in multiplexing processing time when the packet passes through the multiplexer by greatly reducing the frequency .

次に、本発明の実施の形態について図面と共に説明する。図1は本発明になる遅延時間差測定装置の一実施の形態のブロック図を示す。同図において、発振器(OSC)1から発振出力された一定周波数の基準クロックは、タイムカウンタ2に供給され、ここでカウントされ、遅延時間測定に使用するTSパケットの到達時刻を示すカウント値とされる。このカウント値は、第1のラッチ回路3と第2のラッチ回路4に供給される。   Next, embodiments of the present invention will be described with reference to the drawings. FIG. 1 shows a block diagram of an embodiment of a delay time difference measuring apparatus according to the present invention. In the figure, a constant frequency reference clock oscillated from an oscillator (OSC) 1 is supplied to a time counter 2 where it is counted and used as a count value indicating the arrival time of a TS packet used for delay time measurement. The This count value is supplied to the first latch circuit 3 and the second latch circuit 4.

ラッチ回路3は、後述するペイロード一致信号に基づいて、遅延測定を行う2つの伝送系で伝送される2つのTS中のペイロードがそれぞれ一致した時の上記カウント値をラッチして、それを制御回路5へ出力する。一方、ラッチ回路4は、後述するコピー完了信号に基づいて、遅延時間差測定の基準となる伝送系に、遅延時間差測定に使用するPIDを持ったTSパケットをデュアルポートメモリ9にトラップした時の上記カウント値をラッチして、それを制御回路5へ出力する。   The latch circuit 3 latches the count value when the payloads in the two TSs transmitted by the two transmission systems that perform delay measurement match based on a payload match signal described later, Output to 5. On the other hand, the latch circuit 4 performs the above operation when the TS packet having the PID used for the delay time difference measurement is trapped in the dual port memory 9 in the transmission system serving as a reference for the delay time difference measurement based on the copy completion signal described later. The count value is latched and output to the control circuit 5.

パケットトラップ回路6は第1の伝送系を経て入力された第1のTSパケットのうち、測定に使用するPIDを持ったTSパケットのみを通過させて比較回路7に供給する。また、パケットトラップ回路8は第2の伝送系を経て入力された第2のTSパケットのうち、測定に使用するPIDを持ったTSパケットのみを通過させて、コピー完了信号としてラッチ回路4へ出力する一方、デュアルポートメモリ9に記憶させる。   The packet trap circuit 6 passes only the TS packet having the PID used for measurement out of the first TS packet input through the first transmission system, and supplies it to the comparison circuit 7. Further, the packet trap circuit 8 passes only the TS packet having the PID used for measurement out of the second TS packets input through the second transmission system, and outputs it to the latch circuit 4 as a copy completion signal. On the other hand, it is stored in the dual port memory 9.

比較回路7は、デュアルポートメモリ9に記憶されている、遅延時間差測定の基準となる第2の伝送系のTSパケットのペイロード部と、パケットトラップ回路6から出力される、測定の対象となる第1の伝送系のTSパケットのペイロード部とをCPU又はハードウェアロジックで1バイトずつ比較して、両者が一致した時、すなわち、同じTSパケットを検出した時、ペイロード一致信号を発生して、ラッチ回路3と制御回路5へ出力する。   The comparison circuit 7 stores the payload portion of the TS packet of the second transmission system that is stored in the dual port memory 9 and serves as a reference for the delay time difference measurement, and the measurement target output from the packet trap circuit 6. Compares the payload part of TS packet of 1 transmission system with CPU or hardware logic one byte at a time, and when both match, that is, when the same TS packet is detected, generates payload match signal and latches Output to the circuit 3 and the control circuit 5.

制御回路5は、ラッチ回路3及び4でそれぞれラッチされたカウント値の差分を計算することで、第1の伝送系を経て入力された第1のTSパケットと、第2の伝送系を経て入力された第2のTSパケットとの遅延時間差を測定し、その遅延時間差に応じて、遅延制御回路10及び11の遅延時間を制御する。これにより、遅延制御回路10で遅延された第1のTSパケットと、遅延制御回路11で遅延された第2のTSパケットとの遅延時間差がほぼ0とされて、切替回路12に供給される。切替回路12は、制御回路5の制御信号に基づいて、第1の伝送系第1のTSパケット及び第2のTSパケットのうち、それまで出力していたTSパケットから他方のTSパケットへ切替出力する。   The control circuit 5 calculates the difference between the count values latched by the latch circuits 3 and 4, respectively, and inputs the first TS packet input through the first transmission system and the second transmission system. The delay time difference from the second TS packet is measured, and the delay times of the delay control circuits 10 and 11 are controlled according to the delay time difference. As a result, the delay time difference between the first TS packet delayed by the delay control circuit 10 and the second TS packet delayed by the delay control circuit 11 is made substantially zero and supplied to the switching circuit 12. Based on the control signal of the control circuit 5, the switching circuit 12 switches the output from the TS packet that has been output so far to the other TS packet among the first TS packet and the second TS packet in the first transmission system. To do.

このように、本実施の形態では、PAT、PMTパケット以外のある特定のPIDを持ったTSパケットを選択し、そのTSパケットのヘッダ部を除いたペイロード部を比較することにより、遅延時間差を検出しているので、伝送路の途中に多重系が入った場合に発生するPAT、PMTデータ、送出間隔の変更や、TSパケットPIDの付け替えなどが行われても、TS遅延測定を行うことができる。   As described above, in the present embodiment, a delay time difference is detected by selecting a TS packet having a specific PID other than the PAT and PMT packets and comparing the payload part excluding the header part of the TS packet. Therefore, TS delay measurement can be performed even if PAT, PMT data, transmission interval change, TS packet PID change, etc. that occur when a multiplex system enters in the middle of the transmission path. .

図2は本発明になる遅延時間差測定装置の実施例1のブロック図を示す。同図中、図1と同一構成部分には同一符号を付し、その説明を適宜省略する。図2はTSダイバーシティ(4入力ダイバーシティ)装置に適用した例で、例えば、マラソン中継など、街中を走る中継車から送信された一つのTS信号が、異なる複数の基地局からなる4つの伝送経路を経由して受信入力され、それぞれ異なる遅延調整回路18〜21に入力される。   FIG. 2 shows a block diagram of Embodiment 1 of the delay time difference measuring apparatus according to the present invention. In the figure, the same components as those in FIG. 1 are denoted by the same reference numerals, and description thereof will be omitted as appropriate. FIG. 2 is an example applied to a TS diversity (4-input diversity) device. For example, one TS signal transmitted from a relay vehicle running in the city, such as a marathon relay, has four transmission paths composed of a plurality of different base stations. The received signals are received and input to different delay adjustment circuits 18 to 21.

第1のセレクタ13と第2のセレクタ15とは、それぞれ4つのTS信号が入力され、互いに異なる1つのTS信号を選択する。すなわち、セレクタ15は、入力された4つのTS信号のうち遅延時間差測定の基準となる一つのTS信号を選択してパケットトラップ回路16に供給し、セレクタ13は、入力された4つのTS信号のうち、セレクタ15で選択される以外の、測定の対象(基準系に対する相手側)となる一つのTS信号を選択してパケットトラップ回路14に供給する。セレクタ13及び15は、制御回路17からの系統選択信号により上記の選択を行う。   Each of the first selector 13 and the second selector 15 receives four TS signals and selects one TS signal different from each other. That is, the selector 15 selects one TS signal that is a reference for delay time difference measurement from the four input TS signals, and supplies the selected TS signal to the packet trap circuit 16, and the selector 13 selects the four TS signals that are input. Among them, one TS signal that is a measurement target (a counterpart side with respect to the reference system) other than that selected by the selector 15 is selected and supplied to the packet trap circuit 14. The selectors 13 and 15 perform the above selection by a system selection signal from the control circuit 17.

パケットトラップ回路14、16は、測定に使用するPIDを持ったTSパケットのみ通過させる。デュアルポートメモリ9は、パケットトラップ回路16により遅延測定の基準系TSからトラップしたTSパケットを保存する。比較回路7は、デュアルポートメモリ9内に保存された遅延測定の基準系のTSパケットのペイロード部と、セレクタ13により選択された、測定の対象となる系統からパケットトラップ回路14でトラップされたTSパケットのペイロード部とを比較し、同一のパケットかどうかの判断を行う。   The packet trap circuits 14 and 16 pass only TS packets having a PID used for measurement. The dual port memory 9 stores TS packets trapped from the reference system TS for delay measurement by the packet trap circuit 16. The comparison circuit 7 includes a payload portion of a reference TS packet for delay measurement stored in the dual-port memory 9 and a TS trapped by the packet trap circuit 14 from the measurement target system selected by the selector 13. The payload part of the packet is compared, and it is determined whether or not they are the same packet.

制御回路17は、ペイロード一致信号入力時のラッチ回路3からのカウンタ値と、トラップ完了信号入力時のラッチ回路4からのカウンタ値との差分を計算することで、2系統間の遅延時間差を計算し、遅延調整回路18〜21に補正用の遅延時間設定をすることでタイミング調整を行う。遅延調整回路18〜21は、メモリで構成され、入力されるTS信号を制御回路17からの遅延時間設定の制御信号に基づき設定された時間、互いに独立して遅延させて読み出すことで系統間の遅延時間調整をするために用いられる。   The control circuit 17 calculates the difference in delay time between the two systems by calculating the difference between the counter value from the latch circuit 3 when the payload coincidence signal is input and the counter value from the latch circuit 4 when the trap completion signal is input. Then, timing adjustment is performed by setting a delay time for correction in the delay adjustment circuits 18 to 21. The delay adjustment circuits 18 to 21 are configured by a memory, and read the TS signals that are input by delaying them independently from each other for a time set based on a control signal for setting a delay time from the control circuit 17. Used to adjust the delay time.

次に、本実施例の動作を図3のタイミングチャートを使用して説明する。図3において、(A)は送出元のTS信号、(B)は第1の経路で伝送されて受信されたTS信号で、第1の経路の伝送中に他のTSが1つ多重されている。これに対し(H)は第2の経路で伝送されて受信されたTS信号で、こちらは経路途上での多重化処理は行われていない。ここでは、図3(A)に示す元のTS信号のV4のパケットを使用して遅延を測定するものとし、第2の経路で伝送された同図(H)に示すTS信号を測定の基準に、第1の経路で伝送されたTSパケットを測定対象とする。   Next, the operation of this embodiment will be described with reference to the timing chart of FIG. In FIG. 3, (A) is a source TS signal, (B) is a TS signal transmitted and received via the first route, and another TS is multiplexed during transmission of the first route. Yes. On the other hand, (H) is a TS signal transmitted and received through the second route, and this is not multiplexed in the route. Here, the delay is measured using the V4 packet of the original TS signal shown in FIG. 3A, and the TS signal shown in FIG. In addition, a TS packet transmitted through the first route is a measurement target.

なお、図3において、時間軸は右から左へ時間が進行するものとし、同図(E)に示すタイムカウンタ値は時間の経過と共に1ずつアップカウントする。また、第1の経路で伝送されたTS信号の方が第2の経路で伝送されたTS信号よりも遅延している。また、図3(A)、(B)、(H)に示すTSパケット中、Aはオーディオパケット、Vはビデオパケット、V又はAに続く数字はパケット中に入っている、パケットの並びが逆転していないかどうかを確認するための連続性をチェックするための番号(Continuity Counter)の値を示す。TSパケットは、A1、V1、A2、V2、・・・の順で受信入力される。   In FIG. 3, the time axis is assumed to advance from right to left, and the time counter value shown in FIG. 3E is incremented by 1 as time elapses. Further, the TS signal transmitted through the first route is delayed from the TS signal transmitted through the second route. Also, in the TS packets shown in FIGS. 3A, 3B, and 3H, A is an audio packet, V is a video packet, and the numbers following V or A are included in the packet. Indicates the value of the number (Continuity Counter) for checking continuity for confirming whether or not it has been performed. TS packets are received and input in the order of A1, V1, A2, V2,.

図2において、基準系選択を行うセレクタ15は第2の経路を経て受信した、図3(H)に示す第2のTS信号を選択し、パケットトラップ回路16に供給する。制御回路17により第2のTS信号中のV4のパケットで切替を行うものとした場合、パケットトラップ回路16は制御回路17からの切替指定パケットに基づいて、第2のTS信号中のV4パケットを検出すると(トラップすると)、図3(G)に示すように、ハイレベルのトラップ完了信号を生成し、それを制御回路17に供給すると共に、ラッチ回路4に供給して、そのときのタイマカウンタ2からの図3(E)に示すカウント値「8」を、ラッチ回路4にラッチさせる。これにより、ラッチ回路4の出力値は図3(F)に示すように、これ以降「8」となる。また、パケットトラップ回路16は第2のTS信号中のV4パケットをデュアルポートメモリ9に供給して記憶させる。   In FIG. 2, the selector 15 that performs reference system selection selects the second TS signal shown in FIG. 3H received via the second path and supplies it to the packet trap circuit 16. When the control circuit 17 performs switching using the V4 packet in the second TS signal, the packet trap circuit 16 converts the V4 packet in the second TS signal based on the switching designation packet from the control circuit 17. When detected (trapped), as shown in FIG. 3G, a high-level trap completion signal is generated and supplied to the control circuit 17 and also supplied to the latch circuit 4, and the timer counter at that time 2 causes the latch circuit 4 to latch the count value “8” shown in FIG. As a result, the output value of the latch circuit 4 becomes “8” thereafter, as shown in FIG. The packet trap circuit 16 supplies the V4 packet in the second TS signal to the dual port memory 9 for storage.

一方、セレクタ13は第1の経路で伝送されて受信された図3(B)に示す第1のTS信号を選択し、パケットトラップ回路14に供給する。パケットトラップ回路14は、制御回路17からのPID設定により、第1のTS信号中のV4パケットを検出する(トラップする)と、それを比較回路7へ供給する。比較回路7はパケットトラップ回路14からのV4パケットを受信完了した時点で、そのV4パケットのペイロード部とデュアルポートメモリ9に記憶されているV4パケットのペイロード部とを1バイトずつ比較し、両者が一致すると、図3(C)に示す1パケット分の時間ハイレベルのペイロード一致信号を生成し、それを制御回路17へ供給すると共に、ラッチ回路3に供給して、そのときのタイマカウンタ2からの図3(E)に示すカウント値「11」を、ラッチ回路3にラッチさせる。これにより、ラッチ回路3の出力値は図3(D)に示すように、これ以降「11」となる。   On the other hand, the selector 13 selects the first TS signal shown in FIG. 3B transmitted and received through the first route, and supplies the selected signal to the packet trap circuit 14. The packet trap circuit 14 detects (traps) the V4 packet in the first TS signal according to the PID setting from the control circuit 17 and supplies it to the comparison circuit 7. When the comparison circuit 7 completes reception of the V4 packet from the packet trap circuit 14, the comparison circuit 7 compares the payload portion of the V4 packet with the payload portion of the V4 packet stored in the dual port memory 9 one byte at a time. When they match, a time-level payload match signal for one packet shown in FIG. 3C is generated and supplied to the control circuit 17 and supplied to the latch circuit 3 from the timer counter 2 at that time. The count value “11” shown in FIG. 3E is latched by the latch circuit 3. As a result, the output value of the latch circuit 3 thereafter becomes “11” as shown in FIG.

制御回路17は、ペイロード一致信号入力時のラッチ回路3のカウンタ値「11」と、トラップ完了信号入力時のラッチ回路4のカウンタ値「8」との差分を計算し、得られた差分値「3」が、2系統間の遅延時間差と判断し、遅延調整回路18〜21のうち、セレクタ15で選択された第2のTS信号が供給される第2の遅延調整回路の遅延時間を、セレクタ13で選択された第1のTS信号が供給される第1の遅延調整回路の遅延時間に対して、相対的に上記の差分値「3」に相当する時間だけ大に制御する。   The control circuit 17 calculates the difference between the counter value “11” of the latch circuit 3 when the payload match signal is input and the counter value “8” of the latch circuit 4 when the trap completion signal is input, and the obtained difference value “ 3 ”is determined as a delay time difference between the two systems, and the delay time of the second delay adjustment circuit to which the second TS signal selected by the selector 15 is supplied is selected from the delay adjustment circuits 18 to 21. The delay time of the first delay adjustment circuit to which the first TS signal selected at 13 is supplied is controlled to be relatively large by a time corresponding to the difference value “3”.

これにより、第1の遅延調整回路からセレクタ22に供給される第1の遅延TS信号と、第2の遅延調整回路からセレクタ22に供給される第2の遅延TS信号との時間差はほぼ0となり、セレクタ22は制御回路17からの系統選択信号に基づき、第2の遅延TS信号から第1の遅延TS信号へと切替出力する。   As a result, the time difference between the first delay TS signal supplied from the first delay adjustment circuit to the selector 22 and the second delay TS signal supplied from the second delay adjustment circuit to the selector 22 is substantially zero. The selector 22 switches and outputs the second delayed TS signal to the first delayed TS signal based on the system selection signal from the control circuit 17.

このように、本実施例では、PAT、PMTパケット以外のある特定のPIDを持ったTSパケットを選択し、そのTSパケットのヘッダ部を除いたペイロード部を比較回路7で比較することにより、遅延時間差を検出しているので、伝送路の途中に多重系が入った場合に発生するPAT、PMTデータ、送出間隔の変更や、TSパケットPIDの付け替えなどが行われても、TS遅延測定を行うことができる。   As described above, in this embodiment, a delay is achieved by selecting a TS packet having a specific PID other than the PAT and PMT packets, and comparing the payload portion excluding the header portion of the TS packet with the comparison circuit 7. Since the time difference is detected, TS delay measurement is performed even if PAT, PMT data, transmission interval change, TS packet PID change, etc. that occur when a multiplex system enters the middle of the transmission path. be able to.

なお、図2において、4つの入力TS信号TS1〜TS4の各伝送路間の遅延時間差を測定する場合は、セレクタ13、15により、TS1とTS2、TS2とTS3、TS3とTS4、TS4とTS1の4パターンの遅延時間差を測定することになる。   In FIG. 2, when measuring the delay time difference between the transmission lines of the four input TS signals TS1 to TS4, the selectors 13 and 15 use the TS1 and TS2, TS2 and TS3, TS3 and TS4, and TS4 and TS1. The delay time difference of four patterns is measured.

図4は本発明になる遅延時間差測定装置の実施例2のブロック図を示す。同図中、図1と同一構成部分には同一符号を付し、その説明を省略する。本実施例の基本的構成は、図1と同様であるが、同一パケット検出方法について更に工夫している。   FIG. 4 shows a block diagram of Embodiment 2 of the delay time difference measuring apparatus according to the present invention. In the figure, the same components as those in FIG. The basic configuration of this embodiment is the same as that shown in FIG. 1, but the same packet detection method is further devised.

図4において、ペイロードユニットスタートインジケータ検出回路24、25は、パケットトラップ回路6、8から出力されたTSパケットヘッダ中のペイロードユニットスタートインジケータ(payload_unit_start_indicator)ビットを検出する。本実施例は、TSパケットのトラップ条件に、このペイロードユニットスタートインジケータビットを加えている点が実施例1と異なる。なお、図4では図1の遅延制御回路10、11、切替回路12の図示は省略してある。   In FIG. 4, payload unit start indicator detection circuits 24 and 25 detect a payload unit start indicator (payload_unit_start_indicator) bit in the TS packet header output from the packet trap circuits 6 and 8. This embodiment is different from the first embodiment in that this payload unit start indicator bit is added to the trap condition of the TS packet. In FIG. 4, the delay control circuits 10 and 11 and the switching circuit 12 of FIG. 1 are not shown.

特に伝送レートが高い素材の場合、高速にパケット比較を行う必要が生じるが、比較処理が間に合わない場合、とりこぼしが発生し、遅延測定ができなくなるという事態に陥る。そこで、この実施例では、ペイロードユニットスタートインジケータビットが、映像、音声信号のMPEG2などによる圧縮処理の結果生じたデータの塊の先頭パケットで見付けられるフラグであり、発生間隔は20〜30msecに1回であることに着目し、このペイロードユニットスタートインジケータビットを有するTSパケットのペイロード部を比較回路26で比較することで、TSパケットのペイロード部比較頻度を大きく減らすものである。 In particular, in the case of a material having a high transmission rate, it is necessary to perform packet comparison at high speed. However, if the comparison processing is not in time, a situation occurs in which missing data is generated and delay measurement cannot be performed. Therefore, in this embodiment, the payload unit start indicator bit is a flag that is found in the first packet of the data chunk generated as a result of compression processing by MPEG2 or the like of the video and audio signals, and the generation interval is once every 20 to 30 msec. When the comparison circuit 26 compares the payload portion of the TS packet having the payload unit start indicator bit , the payload portion comparison frequency of the TS packet is greatly reduced.

これにより、本実施例では、TSパケットヘッダ部のペイロードユニットスタートインジケータビットをパケットトラップ条件に加えているので、TSパケットのペイロード部比較頻度を大きく減らすことができ、処理系の負担を激減させることができるという効果が得られる。このため、本実施例においては、比較回路26はマイクロコントローラなどを使用し、ソフトウェアで実現してもよい。   As a result, in this embodiment, the payload unit start indicator bit of the TS packet header part is added to the packet trap condition, so the frequency of comparing the payload part of the TS packet can be greatly reduced, and the burden on the processing system can be drastically reduced. The effect of being able to be obtained. Therefore, in this embodiment, the comparison circuit 26 may be realized by software using a microcontroller or the like.

本発明の一実施の形態のブロック図である。It is a block diagram of one embodiment of the present invention. 本発明の実施例1のブロック図である。It is a block diagram of Example 1 of the present invention. 図2の動作説明用タイミングチャートである。3 is a timing chart for explaining the operation of FIG. 2. 本発明の実施例2のブロック図である。It is a block diagram of Example 2 of the present invention. 従来の一例のブロック図である。It is a block diagram of an example of the prior art.

符号の説明Explanation of symbols

1 発振器(OSC)
2 タイムカウンタ
3、4 ラッチ回路
5、17 制御回路
6、8、14、16 パケットトラップ回路
7、26 比較回路
9 デュアルポートメモリ
10、11 遅延制御回路
12 切替回路
13、15 セレクタ
18〜21 遅延調整回路
22 セレクタ
1 Oscillator (OSC)
2 Time counter 3, 4 Latch circuit 5, 17 Control circuit 6, 8, 14, 16 Packet trap circuit 7, 26 Comparison circuit 9 Dual port memory 10, 11 Delay control circuit 12 Switching circuit 13, 15 Selector 18-21 Delay adjustment Circuit 22 selector

Claims (2)

複数の伝送系によりそれぞれ伝送された同一の情報を含むMPEG方式によるトランスポートストリームを入力として受け、それら複数の伝送系で伝送された前記トランスポートストリームの間の相対的な遅延時間差を測定する遅延時間差測定方法において、
前記複数の伝送系のうち第1の伝送系を経て入力された第1のトランスポートストリーム中の測定に使用するパケット識別情報であるPIDを持った第1のパケットのみを通過させる第1のステップと、
前記第1のステップで通過された前記第1のパケットが圧縮データの先頭データを含むTSパケットであることを示す前記第1のパケットのヘッダ部の第1のペイロードユニットスタートインジケータビットを検出する第2のステップと、
前記第2のステップで検出された前記第1のペイロードユニットスタートインジケータビットを有する前記第1のパケットを記憶手段に記憶する第3のステップと、
前記第2のステップの前記第1のペイロードユニットスタートインジケータビットの検出時点で、一定周波数のクロックをカウントするカウンタからのパケットの到達時刻を示すカウント値をラッチする第4のステップと、
前記複数の伝送系のうち第2の伝送系を経て入力された、前記第1のトランスポートストリームと送信元が同一で同一の情報を含む第2のトランスポートストリーム中の測定に使用するパケット識別情報であるPIDを持った第2のパケットのみを通過させる第5のステップと、
前記第5のステップで通過された前記第2のパケットが圧縮データの先頭データを含むTSパケットであることを示す前記第2のパケットのヘッダ部の第2のペイロードユニットスタートインジケータビットを検出する第6のステップと、
前記記憶手段に記憶された前記第1のパケットのペイロード部を比較基準とし、前記第6のステップにより検出された前記第2のペイロードユニットスタートインジケータビットを有する前記第2のパケットのペイロード部を比較対象として比較し、両者が一致したとき一致信号を出力する第7のステップと、
前記一致信号が出力された時の、前記カウント手段からの前記カウント値をラッチする第8のステップと、
前記第4のステップと前記第8のステップでそれぞれラッチされた値の差分値から、前記第1のトランスポートストリームと前記第2のトランスポートストリームとの遅延時間差を得る第9のステップと
を含むことを特徴とする遅延時間差測定方法。
A delay for receiving, as an input, an MPEG transport stream including the same information transmitted by a plurality of transmission systems, and measuring a relative delay time difference between the transport streams transmitted by the plurality of transmission systems In the time difference measurement method,
A first step of passing only a first packet having a PID which is packet identification information used for measurement in a first transport stream input through a first transmission system among the plurality of transmission systems; When,
Detecting a first payload unit start indicator bit in a header portion of the first packet indicating that the first packet passed in the first step is a TS packet including head data of compressed data; Two steps,
A third step of storing in the storage means the first packet having the first payload unit start indicator bit detected in the second step;
A fourth step of latching a count value indicating the arrival time of a packet from a counter that counts a constant frequency clock at the time of detection of the first payload unit start indicator bit of the second step;
Packet identification used for measurement in the second transport stream that is input through the second transmission system among the plurality of transmission systems and includes the same information as the first transport stream and the same transmission source A fifth step of passing only the second packet having the information PID;
Detecting a second payload unit start indicator bit in a header portion of the second packet indicating that the second packet passed in the fifth step is a TS packet including the head data of the compressed data; 6 steps,
Comparing the payload portion of the second packet having the second payload unit start indicator bit detected by the sixth step, using the payload portion of the first packet stored in the storage means as a comparison reference A seventh step of comparing as a target and outputting a coincidence signal when both coincide,
An eighth step of latching the count value from the counting means when the coincidence signal is output;
A ninth step of obtaining a delay time difference between the first transport stream and the second transport stream from a difference value between the values latched in the fourth step and the eighth step, respectively. The delay time difference measuring method characterized by the above-mentioned.
複数の伝送系によりそれぞれ伝送された同一の情報を含むMPEG方式によるトランスポートストリームを入力として受け、それら複数の伝送系で伝送された前記トランスポートストリームの間の相対的な遅延時間差を測定する遅延時間差測定装置において、
一定周波数のクロックをカウントしてパケットの到達時刻を示すカウント値を出力するカウント手段と、
前記複数の伝送系のうち第1の伝送系を経て入力された第1のトランスポートストリーム中の測定に使用するパケット識別情報であるPIDを持った第1のパケットのみを通過させる第1のパケットトラップ手段と、
前記第1のパケットトラップ手段により通過された前記第1のパケットが圧縮データの先頭データを含むTSパケットであることを示す前記第1のパケットのヘッダ部の第1のペイロードユニットスタートインジケータビットを検出する第1の検出手段と、
前記第1の検出手段で検出された前記第1のペイロードユニットスタートインジケータビットを有する前記第1のパケットを記憶する記憶手段と、
前記第1の検出手段による前記第1のペイロードユニットスタートインジケータビットの検出時点で前記カウント手段からの前記カウント値をラッチする第1のラッチ手段と、
前記複数の伝送系のうち第2の伝送系を経て入力された、前記第1のトランスポートストリームと送信元が同一で同一の情報を含む第2のトランスポートストリーム中の測定に使用するパケット識別情報であるPIDを持った第2のパケットのみを通過させる第2のパケットトラップ手段と、
前記第2のパケットトラップ手段により通過された前記第2のパケットが圧縮データの先頭データを含むTSパケットであることを示す前記第2のパケットのヘッダ部の第2のペイロードユニットスタートインジケータビットを検出する第2の検出手段と、
前記記憶手段に記憶された前記第1のパケットのペイロード部を比較基準とし、前記第2の検出手段により検出された前記第2のペイロードユニットスタートインジケータビットを有する前記第2のパケットのペイロード部を比較対象として比較し、両者が一致したとき一致信号を出力する比較手段と、
前記一致信号が出力された時の、前記カウント手段からの前記カウント値をラッチする第2のラッチ手段と、
前記第1のラッチ手段と前記第2のラッチ手段でそれぞれラッチされた値の差分値から、前記第1のトランスポートストリームと前記第2のトランスポートストリームとの遅延時間差を得る演算手段と
を有することを特徴とする遅延時間差測定装置。
A delay for receiving, as an input, an MPEG transport stream including the same information transmitted by a plurality of transmission systems, and measuring a relative delay time difference between the transport streams transmitted by the plurality of transmission systems In the time difference measuring device,
Counting means for counting a clock with a constant frequency and outputting a count value indicating the arrival time of the packet;
A first packet that passes only a first packet having a PID that is packet identification information used for measurement in a first transport stream input through the first transmission system among the plurality of transmission systems. Trap means;
Detecting a first payload unit start indicator bit in a header portion of the first packet indicating that the first packet passed by the first packet trap means is a TS packet including the head data of compressed data First detecting means for
Storage means for storing the first packet having the first payload unit start indicator bit detected by the first detection means ;
First latch means for latching the count value from the counting means at the time of detection of the first payload unit start indicator bit by the first detecting means;
Packet identification used for measurement in the second transport stream that is input through the second transmission system among the plurality of transmission systems and includes the same information as the first transport stream and the same transmission source Second packet trap means for passing only the second packet having the PID which is information;
Detecting a second payload unit start indicator bit in the header portion of the second packet indicating that the second packet passed by the second packet trap means is a TS packet including the head data of the compressed data Second detecting means for
The payload portion of the second packet having the second payload unit start indicator bit detected by the second detection means, using the payload portion of the first packet stored in the storage means as a reference. Comparison means for comparing as a comparison target and outputting a coincidence signal when both coincide,
Second latch means for latching the count value from the count means when the coincidence signal is output;
Calculating means for obtaining a delay time difference between the first transport stream and the second transport stream from a difference value between values latched by the first latch means and the second latch means, respectively. A delay time difference measuring apparatus.
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JP4998580B2 (en) * 2010-04-06 2012-08-15 三菱電機株式会社 Communication diagnostic device and communication diagnostic method

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH05219027A (en) * 1992-01-31 1993-08-27 Nec Corp Synchronous switching system
JP2999087B2 (en) * 1993-03-11 2000-01-17 沖電気工業株式会社 Path switching method
JP2536401B2 (en) * 1993-06-11 1996-09-18 日本電気株式会社 Switching without interruption
JPH08139731A (en) * 1994-11-08 1996-05-31 Fujitsu Ltd Duplex transmission system switching method
JP2000209557A (en) * 1999-01-08 2000-07-28 Nec Corp Switching device and method of transport stream
JP3566585B2 (en) * 1999-07-01 2004-09-15 Kddi株式会社 Track switching device
JP2002232379A (en) * 2001-02-07 2002-08-16 Matsushita Electric Ind Co Ltd MPEG2 transport stream multiplexer
JP2003258774A (en) * 2002-03-01 2003-09-12 Denso Corp Short-range wireless communication system, vehicle hands-free communication system, and communication control method for short-range wireless communication system
DE60223806T2 (en) * 2002-09-16 2008-10-30 Agilent Technologies, Inc. - a Delaware Corporation -, Santa Clara Measurement of network parameters as perceived by non-artificial network traffic

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