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JP4960764B2 - amplifier - Google Patents
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JP4960764B2 - amplifier - Google Patents

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Description

本発明は、増幅器に関し、特に、過負荷に対応した電力増幅器に関する。   The present invention relates to an amplifier, and more particularly, to a power amplifier that supports overload.

電力増幅器には、そのインピーダンスがハイインピーダンスのものと、ローインピーダンスのものとがある。ハイインピーダンスの電力増幅器に誤ってローインピーダンスの負荷、例えばローインピーダンスのスピーカを接続すると、過電流が流れ、スピーカだけでなく電力増幅器も損傷する可能性がある。この点を改善するために、例えば特許文献1に開示されている技術がある。   There are power amplifiers having high impedance and low impedance. If a low-impedance load, for example, a low-impedance speaker, is mistakenly connected to the high-impedance power amplifier, an overcurrent flows, which may damage not only the speaker but also the power amplifier. In order to improve this point, for example, there is a technique disclosed in Patent Document 1.

この技術では、電力増幅器の負荷電流を検出すると共に、電力増幅器の入力電圧を検出し、入力電圧と負荷電流とを比較して、その結果に従って負荷インピーダンスが規定インピーダンスより低いかどうか判断し、低い場合には、この電力増幅器の出力を制限している。   In this technique, the load current of the power amplifier is detected, the input voltage of the power amplifier is detected, the input voltage and the load current are compared, and it is determined whether the load impedance is lower than the specified impedance according to the result. In some cases, the output of this power amplifier is limited.

特開平10−327026号公報Japanese Patent Laid-Open No. 10-327026

この技術では、入力電圧と負荷電流とを比較しているので、負荷インピーダンスを演算する複雑な回路が不要で、保護回路の構成を簡略化することができる。しかし、入力電圧と負荷電流とを比較しているので、入力電圧が出力電圧と一致していればよいが、入力する周波数成分や増幅器自体の電源の性能により、出力電圧が歪むことがあり、正確に過負荷状態を検出できない場合がある。また、上記技術では、負荷電流が入力電圧よりも小さくなると、電力増幅器の出力を特定の状態に制限している。過負荷といっても、軽過負荷の場合もあるし、重過負荷の場合もあるにも拘わらず、一律に出力制御を行っており、過負荷の状態に応じた保護を行えない。   In this technique, since the input voltage is compared with the load current, a complicated circuit for calculating the load impedance is not required, and the configuration of the protection circuit can be simplified. However, since the input voltage is compared with the load current, the input voltage only needs to match the output voltage, but the output voltage may be distorted depending on the input frequency component and the performance of the power supply of the amplifier itself. The overload condition may not be detected accurately. Further, in the above technique, when the load current becomes smaller than the input voltage, the output of the power amplifier is limited to a specific state. Even if it is said to be an overload, it may be light overload or heavy overload, and output control is performed uniformly, and protection according to the overload state cannot be performed.

本発明は、正確に過負荷の状態を検出することができ、かつその過負荷の状態に応じた保護を行える増幅器を提供することを目的とする。   An object of the present invention is to provide an amplifier capable of accurately detecting an overload state and capable of protecting according to the overload state.

本発明の一態様の増幅器は、可聴周波数信号を増幅し、負荷に供給する増幅手段を有している。この増幅手段としては、A級、B級、AB級のアナログ増幅手段を使用することもできるし、一般的にD級のデジタル増幅手段を使用することもできる。この増幅手段としては電力増幅手段を使用することが望ましい。増幅手段から負荷、例えばスピーカに供給される電流を電流検出手段が検出し、その大きさを表す電流検出信号を生成する。増幅手段から負荷に供給される電圧を電圧検出手段が検出し、その大きさを表す電圧検出信号を生成する。電流検出信号と電圧検出信号とが差生成手段に供給され、差生成手段は両者の差を表す差信号を生成する。増幅手段にレベル調整手段が設けられている。レベル調整手段は、差信号にそれと逆極性のバイアス信号を重畳したバイアス重畳差信号を出力するバイアス重畳手段と、前記バイアス重畳差信号をこれと同相の同相信号と逆相の逆相信号とに変換し、前記同相信号を同相出力端子に、前記逆相信号を逆相出力端子に出力する変換手段と、前記同相出力端子に一端が接続され、他端が前記増幅手段中の入力側増幅手段の出力側に接続された第1のダイオードと、前記逆相出力端子に一端が接続され、他端が前記入力側増幅手段の出力側に接続された第2のダイオードとを具備している。前記バイアス信号は、前記入力側増幅出段の出力信号のピーク値の絶対値よりも絶対値が小さく、極性が、前記負荷電流検出信号が前記負荷電圧検出信号よりも大きいときの前記差信号の極性と逆である。前記負荷電流検出信号が前記負荷電圧検出信号よりも大きいときに導通する方向で、第1のダイオードは、前記同相端子と前記入力側増幅手段の出力側に接続され、第2のダイオードは、前記逆相端子と前記入力側増幅手段の出力側に、接続されている。 The amplifier according to one embodiment of the present invention includes an amplifying unit that amplifies an audio frequency signal and supplies the amplified audio signal to a load. As the amplification means, class A, class B and class AB analog amplification means can be used, and generally a class D digital amplification means can also be used. As this amplifying means, it is desirable to use a power amplifying means. The current detection means detects a current supplied from the amplification means to a load, for example, a speaker, and generates a current detection signal representing the magnitude thereof. The voltage detection means detects the voltage supplied from the amplification means to the load, and generates a voltage detection signal representing the magnitude of the voltage detection means. The current detection signal and the voltage detection signal are supplied to the difference generation unit, and the difference generation unit generates a difference signal representing the difference between the two. A level adjusting means is provided in the amplifying means. The level adjusting means outputs a bias superimposed difference signal in which a bias signal having a polarity opposite to that of the difference signal is superimposed on the difference signal, and the bias superimposed difference signal is converted into an in-phase signal and an anti-phase signal of the opposite phase. And converting means for outputting the in-phase signal to the in-phase output terminal, and outputting the reverse-phase signal to the anti-phase output terminal, one end connected to the in-phase output terminal, and the other end to the input side in the amplifying means A first diode connected to the output side of the amplifying means; and a second diode having one end connected to the negative phase output terminal and the other end connected to the output side of the input side amplifying means. Yes. The bias signal has an absolute value smaller than an absolute value of a peak value of an output signal of the input side amplification output stage, and a polarity of the difference signal when the load current detection signal is larger than the load voltage detection signal. It is the opposite of polarity. The first diode is connected to the common-mode terminal and the output side of the input-side amplification means in a direction that conducts when the load current detection signal is larger than the load voltage detection signal, and the second diode is The negative phase terminal is connected to the output side of the input side amplification means.

このように構成すると、電流検出信号が電圧検出信号以下のとき、即ち定格負荷または軽負荷のとき、第1及び第2のダイオードは導通しない。従って、レベル調整は行われない。電流検出信号が電圧検出信号より大きいとき、即ち、過負荷のとき、第1及び第2のダイオードが導通する。第1及び第2のダイオードの導通状態は、同相信号及び逆相信号の大きさに応じたものとなる。その結果、入力側増幅手段の出力信号は、第1及び第2のダイオードの導通状態に応じて変換手段に吸い込まれ、レベル調整が行われる。しかも、差信号の絶対値がバイアス信号の絶対値よりも大きくなっても、第1及び第2のダイオードを導通させることができるので、入力側増幅手段の出力信号をほぼミュート状態まで制限することができる。   If comprised in this way, when a current detection signal is below a voltage detection signal, ie, a rated load or a light load, a 1st and 2nd diode will not conduct. Therefore, level adjustment is not performed. When the current detection signal is larger than the voltage detection signal, that is, when the load is overloaded, the first and second diodes are turned on. The conduction state of the first and second diodes depends on the magnitudes of the in-phase signal and the anti-phase signal. As a result, the output signal of the input side amplification means is sucked into the conversion means according to the conduction state of the first and second diodes, and the level adjustment is performed. In addition, even if the absolute value of the difference signal is larger than the absolute value of the bias signal, the first and second diodes can be made conductive, so that the output signal of the input side amplifying means is almost limited to the mute state. Can do.

変換手段の同相端子と基準電位との間に第3のダイオードを接続し、変換手段の逆相端子と基準電位との間に第4のダイオードを接続することもできる。この場合、第3及び第4のダイオードは、差信号の絶対値が前記バイアス信号の絶対値よりもオン電圧(第3及び第4のダイオードが導通するためにアノード−カソード間に印加する必要のある電圧)だけ大きくなったとき、導通する方向に配置されている。   A third diode may be connected between the in-phase terminal of the conversion means and the reference potential, and a fourth diode may be connected between the reverse-phase terminal of the conversion means and the reference potential. In this case, the third and fourth diodes must be applied between the anode and the cathode so that the absolute value of the difference signal is higher than the absolute value of the bias signal (in order for the third and fourth diodes to conduct). When the voltage is increased by a certain voltage, it is arranged in the direction of conduction.

上述したように、差信号の絶対値がバイアス信号の絶対値よりも大きくなったとき、入力側増幅手段の出力信号をほぼミュート状態まで制限できるが、差信号の絶対値が更に多くなっても、第1及び第2のダイオードを導通させると、変換手段に多大な電流が吸い込まれることになり、変換手段がオーバードライブ状態になる。そこで、第3及び第4のダイオードによって同相信号及び逆相信号の値を制限し、オーバードライブ状態になることを防止している。   As described above, when the absolute value of the difference signal becomes larger than the absolute value of the bias signal, the output signal of the input side amplifying means can be limited to the mute state, but even if the absolute value of the difference signal further increases. When the first and second diodes are turned on, a large amount of current is sucked into the conversion means, and the conversion means enters an overdrive state. Therefore, the values of the in-phase signal and the anti-phase signal are limited by the third and fourth diodes to prevent an overdrive state.

以上のように、本発明によれば、過負荷の状態を正確に把握することができる上に、その過負荷の状態に応じて可聴周波数信号のレベル調整が行われ、増幅器の保護を確実に行うことができる。   As described above, according to the present invention, the overload state can be accurately grasped, and the level of the audible frequency signal is adjusted according to the overload state, thereby ensuring the protection of the amplifier. It can be carried out.

本発明の参考例の増幅器は、例えば電力増幅器であって、パブリックアドレスシステムに使用される。この増幅器は、図1に示すように、レベル調整手段、例えばゲイン可変増幅手段、具体的には電圧制御増幅器2を有している。電圧制御増幅器2には、可聴周波数信号源、例えば音源4からの可聴周波数信号、例えばアナログ音声信号が供給されている。電圧制御増幅器2で増幅された音声信号は、増幅手段、例えばデジタルアンプ部6に供給される。 The amplifier of the reference example of the present invention is, for example, a power amplifier and is used in a public address system. As shown in FIG. 1, this amplifier has a level adjusting means, for example, a variable gain amplifying means, specifically, a voltage control amplifier 2. The voltage control amplifier 2 is supplied with an audible frequency signal source, for example, an audible frequency signal from the sound source 4, for example, an analog audio signal. The audio signal amplified by the voltage control amplifier 2 is supplied to amplification means, for example, a digital amplifier unit 6.

デジタルアンプ部6は、電圧制御増幅器2から供給されたアナログ音声信号を、PWM信号に変換し、このPWM信号をD級増幅し、このD級増幅されたPWM信号をフィルタによってアナログ音声信号に変換して、出力端子6a、6bから図示しない負荷、例えばスピーカに供給する。このデジタルアンプ部6は、出力インピーダンスがハイインピーダンスのもので、出力端子6a、6b間には、一般には複数のスピーカが並列に接続される。これら複数のスピーカは、それぞれは所定のインピーダンスを有し、これら複数のスピーカの合成インピーダンスは、デジタルアンプ部6の出力インピーダンスに一致する。デジタルアンプ部6の出力インピーダンスに一致する複数のスピーカを定格負荷と称する。   The digital amplifier unit 6 converts the analog audio signal supplied from the voltage control amplifier 2 into a PWM signal, amplifies the PWM signal in class D, and converts the PWM signal amplified in class D into an analog audio signal by a filter. Then, the output terminals 6a and 6b are supplied to a load (not shown) such as a speaker. The digital amplifier 6 has a high impedance output impedance, and generally a plurality of speakers are connected in parallel between the output terminals 6a and 6b. Each of the plurality of speakers has a predetermined impedance, and the combined impedance of the plurality of speakers matches the output impedance of the digital amplifier unit 6. A plurality of speakers that match the output impedance of the digital amplifier unit 6 are referred to as rated loads.

使用するスピーカに誤って所定のインピーダンスよりも低いインピーダンスのものを使用することがある。このようなスピーカの間違いの結果、出力端子6a、6bに接続されているスピーカの合成インピーダンス、即ち負荷インピーダンスがデジタル増幅部6の出力インピーダンスより低くなり、デジタル増幅部6が過負荷状態になることがある。   A speaker having an impedance lower than a predetermined impedance may be used by mistake. As a result of such a speaker error, the combined impedance of the speakers connected to the output terminals 6a and 6b, that is, the load impedance becomes lower than the output impedance of the digital amplifier 6, and the digital amplifier 6 becomes overloaded. There is.

デジタル増幅部6が過負荷状態であるか否かを検出するために、出力端子6aに直列に電流検出手段、例えば負荷電流検出器8が接続されている。なお、負荷電流検出器8は出力端子6bに直列に接続することも可能である。負荷電流検出器8は、例えばカレントトランスを使用することができ、負荷に流れる電流を表す電流検出信号、例えば負荷電流検出信号を生成する。この負荷電流検出信号は、例えば負荷電流の大きさを電圧で表したものである。   In order to detect whether or not the digital amplifier 6 is in an overload state, current detection means, for example, a load current detector 8 is connected in series to the output terminal 6a. The load current detector 8 can also be connected in series with the output terminal 6b. The load current detector 8 can use a current transformer, for example, and generates a current detection signal representing a current flowing through the load, for example, a load current detection signal. This load current detection signal is, for example, a voltage indicating the magnitude of the load current.

また、過負荷状態であるか否かを検出するために、出力端子6a、6b間に電圧検出手段、例えば負荷電圧検出器10が接続されている。この負荷電圧検出器10は、負荷に印加される電圧を表す負荷電圧検出信号を生成する。この負荷電圧検出信号も負荷電圧を電圧で表したものである。   Further, in order to detect whether or not it is in an overload state, a voltage detection means, for example, a load voltage detector 10 is connected between the output terminals 6a and 6b. The load voltage detector 10 generates a load voltage detection signal representing a voltage applied to the load. This load voltage detection signal also represents the load voltage as a voltage.

負荷電流検出信号は、整流手段、例えば全波整流回路12によって整流され、負荷電圧検出信号も、整流手段、例えば全波整流回路14によって整流される。但し、負荷電圧検出信号は、負荷が定格負荷の時、全波整流回路12、14の出力信号のレベルが一致するように、増幅手段、例えば増幅器16によってレベル調整が行われている。以下、全波整流回路12の出力信号を整流負荷電流検出信号と称し、全波整流回路14の出力信号を整流負荷電圧検出信号と称する。   The load current detection signal is rectified by a rectifier, for example, a full-wave rectifier circuit 12, and the load voltage detection signal is also rectified by a rectifier, for example, a full-wave rectifier circuit 14. However, the level of the load voltage detection signal is adjusted by an amplifying means, for example, an amplifier 16 so that the output signal levels of the full-wave rectifier circuits 12 and 14 match when the load is a rated load. Hereinafter, the output signal of the full-wave rectifier circuit 12 is referred to as a rectified load current detection signal, and the output signal of the full-wave rectifier circuit 14 is referred to as a rectified load voltage detection signal.

これら整流負荷電流検出信号と整流負荷電圧検出信号は、差信号生成手段、例えば減算回路18に供給される。この減算回路18は、例えば演算増幅器18aと4つの抵抗器18b乃至18eによって構成された差動増幅器で、差信号、例えば整流負荷電圧検出信号から整流負荷電流検出信号を減算した値を表す誤差信号を生成する。この誤差信号は、上述したように増幅器16によってレベル調整が行われているので、負荷が定格負荷あるいは軽負荷の場合、零以上の値となり、負荷が過負荷の場合、負の値となる。   The rectified load current detection signal and the rectified load voltage detection signal are supplied to difference signal generation means, for example, a subtraction circuit 18. The subtraction circuit 18 is a differential amplifier composed of, for example, an operational amplifier 18a and four resistors 18b to 18e, and an error signal representing a difference signal, for example, a value obtained by subtracting a rectified load current detection signal from a rectified load voltage detection signal. Is generated. Since the level of the error signal is adjusted by the amplifier 16 as described above, when the load is a rated load or a light load, the error signal has a value of zero or more, and when the load is an overload, the error signal has a negative value.

この誤差信号は、係数乗算手段、例えば増幅器20に供給される。増幅器20は、演算増幅器20aと、3つの抵抗器20b乃至20dとによって構成された非反転増幅器で、抵抗器20b乃至20dの値を適切に選択することによって、誤差信号を予め定めた利得で増幅した、即ち所定の係数を乗算した乗算誤差信号を出力する。この乗算誤差信号が電圧制御増幅器2に制御信号として供給される。電圧制御増幅器2は、乗算誤差信号が負の値であるときに、その値に応じてゲインを小さくし、乗算誤差信号が零以上の時、ゲインを所定の値に維持する。   This error signal is supplied to coefficient multiplication means, for example, the amplifier 20. The amplifier 20 is a non-inverting amplifier composed of an operational amplifier 20a and three resistors 20b to 20d, and amplifies the error signal with a predetermined gain by appropriately selecting the values of the resistors 20b to 20d. That is, a multiplication error signal multiplied by a predetermined coefficient is output. This multiplication error signal is supplied to the voltage control amplifier 2 as a control signal. When the multiplication error signal has a negative value, the voltage control amplifier 2 reduces the gain according to the negative value, and maintains the gain at a predetermined value when the multiplication error signal is equal to or greater than zero.

このように構成された増幅器では、デジタルアンプ部6の対応できる定格負荷インピーダンスよりも、負荷インピーダンスが大きい場合がある。即ち軽負荷の場合がある。この場合、図2(a)に示すように負荷電流は定格負荷電流よりも小さく、同図(b)に示すように整流負荷電流は、整流負荷電圧よりも小さい。その結果、減算回路18の誤差信号は正の値である。正の誤差信号が増幅器20によって増幅された乗算誤差信号が、電圧制御増幅器2に制御信号として供給されても、電圧制御増幅器2のゲインは、予め設定された値を維持し、デジタルアンプ部6の負荷電流は、現在の値を維持する。また、複数のスピーカの合成インピーダンスが定格負荷の場合、図2(a)に示すように負荷電流は定格電流を維持し、同図(b)に示すように整流負荷電流は、整流負荷電圧に等しい。その結果、減算回路18の誤差信号は零であり、電圧制御増幅器2にも零の乗算誤差信号が供給され、電圧制御増幅器2は、予め定められたゲインを維持し、デジタルアンプ部6の負荷電流は、定格負荷電流を維持する。   In the amplifier configured as described above, the load impedance may be larger than the rated load impedance that the digital amplifier unit 6 can handle. That is, there may be a light load. In this case, the load current is smaller than the rated load current as shown in FIG. 2A, and the rectified load current is smaller than the rectified load voltage as shown in FIG. As a result, the error signal of the subtraction circuit 18 is a positive value. Even if the multiplication error signal obtained by amplifying the positive error signal by the amplifier 20 is supplied to the voltage control amplifier 2 as a control signal, the gain of the voltage control amplifier 2 maintains the preset value, and the digital amplifier unit 6 The load current of the current value is maintained. When the combined impedance of a plurality of speakers is a rated load, the load current maintains the rated current as shown in FIG. 2A, and the rectified load current becomes the rectified load voltage as shown in FIG. equal. As a result, the error signal of the subtraction circuit 18 is zero, and a zero multiplication error signal is also supplied to the voltage control amplifier 2. The voltage control amplifier 2 maintains a predetermined gain, and the load of the digital amplifier unit 6 The current maintains the rated load current.

負荷インピーダンスがデジタルアンプ部6の対応できる定格負荷インピーダンスよりも小さくなると、即ち過負荷になると、負荷電流は定格負荷電流よりも大きくなり、また負荷電圧は定格負荷電圧よりも小さくなる。極端な場合、負荷電圧は零Vに近づく。その結果、減算回路18の誤差信号は、負の値となり、増幅器20からの乗算誤差信号が電圧制御増幅器2に供給され、そのゲインが乗算誤差信号の値に応じて減少され、デジタルアンプ部6に供給される音声信号のレベルが小さくなる。その結果、デジタルアンプ部6の負荷電流の値が小さくなり、デジタルアンプ部6の過電流が流れることを防止する。   When the load impedance becomes smaller than the rated load impedance that the digital amplifier unit 6 can handle, that is, when the load is overloaded, the load current becomes larger than the rated load current, and the load voltage becomes smaller than the rated load voltage. In extreme cases, the load voltage approaches zero volts. As a result, the error signal of the subtracting circuit 18 becomes a negative value, the multiplication error signal from the amplifier 20 is supplied to the voltage control amplifier 2, and the gain is reduced according to the value of the multiplication error signal, and the digital amplifier unit 6. The level of the audio signal supplied to is reduced. As a result, the value of the load current of the digital amplifier unit 6 is reduced, and the overcurrent of the digital amplifier unit 6 is prevented from flowing.

この負荷電流の減少は、乗算誤差信号の大きさに応じて変化する。例えば、負荷インピーダンスがデジタルアンプ部6の対応できる定格負荷インピーダンスよりもわずかに小さい場合には、図2(a)に示すように負荷電流も定格負荷電流よりもわずかに減少するように入力信号の電圧レベルを調整するだけであるが、複数のスピーカの合成インピーダンスがデジタルアンプ部6の出力インピーダンスよりもかなり小さく、負荷電圧が定格電圧よりもかなり低下している場合には、負荷電流は定格電流よりも大きく減少するように、入力信号の電圧レベルを大きく調整し、出力レベル(電圧)がかなり小さくなるように制限する。即ち、フの字特性を示す。また、負荷インピーダンスが変動すると、その負荷インピーダンスの変動に応じて負荷電流の値が制御され、負荷が定格負荷に復帰すると、負荷電流も自動的に定格電流に復帰する。   This decrease in the load current changes according to the magnitude of the multiplication error signal. For example, when the load impedance is slightly smaller than the rated load impedance that can be handled by the digital amplifier unit 6, as shown in FIG. 2 (a), the load current is also slightly decreased from the rated load current. Although only the voltage level is adjusted, when the combined impedance of the plurality of speakers is considerably smaller than the output impedance of the digital amplifier unit 6 and the load voltage is considerably lower than the rated voltage, the load current is the rated current. The voltage level of the input signal is adjusted so as to be greatly reduced, and the output level (voltage) is limited to be considerably small. That is, it shows the character characteristics of the character. When the load impedance varies, the value of the load current is controlled according to the variation of the load impedance. When the load returns to the rated load, the load current automatically returns to the rated current.

なお、増幅器20のゲインを適切に調整することによって、フの字特性の傾斜を調整することができる。   The slope of the U-shaped characteristic can be adjusted by appropriately adjusting the gain of the amplifier 20.

本発明の1実施形態の増幅器は、参考例の電圧増幅器2に代えて、図3に示すように、クリップ回路を使用したものである。参考例の増幅器と同一部分には同一符号を付して、その説明を省略する。 The amplifier according to one embodiment of the present invention uses a clip circuit as shown in FIG. 3 instead of the voltage amplifier 2 of the reference example . The same parts as those of the amplifier of the reference example are denoted by the same reference numerals, and description thereof is omitted.

この増幅器では、電圧増幅器2に代えて、入力側増幅手段、例えば2段の増幅器30a、30bが使用されている。増幅器30aには、音源4からの音声信号が供給され、増幅器30aは、これを増幅して、増幅器30bに供給する。増幅器30bは、増幅器30aの出力信号を更に増幅して、デジタルアンプ部6に供給する。   In this amplifier, instead of the voltage amplifier 2, input side amplification means, for example, two-stage amplifiers 30a and 30b are used. The amplifier 30a is supplied with the audio signal from the sound source 4, and the amplifier 30a amplifies it and supplies it to the amplifier 30b. The amplifier 30 b further amplifies the output signal of the amplifier 30 a and supplies it to the digital amplifier unit 6.

増幅器30aの出力側と増幅器30bの入力側との間に、複数、例えば同じ値の4つの抵抗器32a乃至32dが直列に接続されている。これら抵抗器32a乃至32dの中間である抵抗器32b、32cの接続点に、第1のダイオード、例えばダイオード34のアノードが接続されている。ダイオード34のカソードは、同相増幅手段、例えば非反転増幅器36の出力側に接続されている。非反転増幅器36は、演算増幅器36aと4つの抵抗器36b乃至36eとによって構成されている。このとき、4つの抵抗器32a乃至32dに限る必要はないが、2つ以上の偶数個の同じ抵抗値の抵抗器を用いて、これら抵抗器の中点でダイオード接続するようにする。このようにすることで、最も信号を制限できるようになり、ミュート時などに特に有効である。   A plurality of, for example, four resistors 32a to 32d having the same value are connected in series between the output side of the amplifier 30a and the input side of the amplifier 30b. A first diode, for example, an anode of a diode 34 is connected to a connection point of resistors 32b and 32c, which are intermediate between the resistors 32a to 32d. The cathode of the diode 34 is connected to the output side of the in-phase amplifier, for example, the non-inverting amplifier 36. The non-inverting amplifier 36 includes an operational amplifier 36a and four resistors 36b to 36e. At this time, it is not necessary to limit to the four resistors 32a to 32d, but two or more even-numbered resistors having the same resistance value are used and diode-connected at the midpoint of these resistors. In this way, the signal can be most restricted, and is particularly effective when muted.

抵抗器32b、32cの接続点には、第2のダイオード、例えばダイオード38のカソードが接続されている。ダイオード38のアノードは、逆相増幅手段、例えば反転増幅器40の出力側に接続されている。反転増幅器40は、演算増幅器40aと、5つの抵抗器40b乃至40fとによって構成されている。   A connection point between the resistors 32b and 32c is connected to a second diode, for example, a cathode of a diode 38. The anode of the diode 38 is connected to the output side of the reverse phase amplification means, for example, the inverting amplifier 40. The inverting amplifier 40 includes an operational amplifier 40a and five resistors 40b to 40f.

非反転増幅器36と反転増幅器40とは、ゲインが等しくなるように、例えばほぼ1となるように、抵抗器36b乃至36e、40b乃至40fの値が選択されている。非反転増幅器36と反転増幅器40とが変換手段を構成し、非反転増幅器36の出力側が同相端子に、反転増幅器40の出力側が逆相端子に対応する。これら非反転増幅36と反転増幅器40には、共通の入力信号が供給される。この共通入力信号をそのまま非反転増幅器36が出力し、反転増幅器40が位相反転させて出力する。なお、抵抗器36b、40bは、非反転増幅器36及び反転増幅器40の出力インピーダンスを上昇させるために、非反転増幅器36及び反転増幅器40の帰還ループ内に設けられている。   The values of the resistors 36b to 36e and 40b to 40f are selected so that the non-inverting amplifier 36 and the inverting amplifier 40 have the same gain, for example, approximately 1. The non-inverting amplifier 36 and the inverting amplifier 40 constitute conversion means, and the output side of the non-inverting amplifier 36 corresponds to the in-phase terminal, and the output side of the inverting amplifier 40 corresponds to the anti-phase terminal. A common input signal is supplied to the non-inverting amplifier 36 and the inverting amplifier 40. The common input signal is outputted as it is by the non-inverting amplifier 36, and the inverting amplifier 40 inverts the phase and outputs it. The resistors 36b and 40b are provided in the feedback loop of the non-inverting amplifier 36 and the inverting amplifier 40 in order to increase the output impedance of the non-inverting amplifier 36 and the inverting amplifier 40.

共通の入力信号は、次のようにして供給される。増幅器20の出力側には、ダイオード42のカソードが接続され、アノードには、ツェナーダイオード44のアノードが接続され、このアノードは抵抗器46を介して例えば+15Vの電圧である正の直流電源端子48に接続されている。ツェナーダイオード44のカソードと抵抗器46との接続点が、同相増幅器36と逆相増幅器40の入力側に接続されている。ダイオード42、ツェナーダイオード44及び抵抗器46がバイアス重畳手段、例えばバイアス重畳回路49を構成している。ツェナーダイオード44は、定格が4.7Vであり、ダイオード42の両端間電圧は、0.6Vであるので、合計5.3Vのバイアス電圧が増幅器20からの乗算誤差信号に重畳されて、非反転増幅器36と反転増幅器40とに供給される。   The common input signal is supplied as follows. The cathode of a diode 42 is connected to the output side of the amplifier 20, and the anode of a Zener diode 44 is connected to the anode. The anode is connected to a positive DC power supply terminal 48 having a voltage of, for example, + 15V via a resistor 46. It is connected to the. A connection point between the cathode of the Zener diode 44 and the resistor 46 is connected to the input side of the in-phase amplifier 36 and the anti-phase amplifier 40. The diode 42, the Zener diode 44, and the resistor 46 constitute a bias superimposing means, for example, a bias superimposing circuit 49. Since the Zener diode 44 has a rating of 4.7 V and the voltage across the diode 42 is 0.6 V, a total of 5.3 V bias voltage is superimposed on the multiplication error signal from the amplifier 20 and is non-inverted. The amplifier 36 and the inverting amplifier 40 are supplied.

なお、非反転増幅器36、40の出力側には、第3及び第4のダイオード、例えば保護用ダイオード50、52が接続されている。即ち、ダイオード50は、そのアノードが基準電位、例えば接地電位に接続され、カソードが非反転増幅器36の出力側に接続されている。ダイオード52は、そのアノードが反転増幅器40の出力側に接続され、そのカソードが接地電位に接続されている。   Note that third and fourth diodes, for example, protection diodes 50 and 52 are connected to the output side of the non-inverting amplifiers 36 and 40. That is, the diode 50 has an anode connected to a reference potential, for example, a ground potential, and a cathode connected to the output side of the non-inverting amplifier 36. The diode 52 has an anode connected to the output side of the inverting amplifier 40 and a cathode connected to the ground potential.

また、音源4、増幅器20、30a、30b、非反転増幅器36、反転増幅器40、バイアス重畳回路49は、接地電位を基準電位としている。また、増幅器30aは、その出力信号として接地電位を基準としてピーク値が±5.6Vの交流電圧を出力している。即ち、バイアス電圧の絶対値は、増幅器30aのピーク値の絶対値よりも幾分小さい。   The sound source 4, the amplifiers 20, 30a, 30b, the non-inverting amplifier 36, the inverting amplifier 40, and the bias superimposing circuit 49 have the ground potential as a reference potential. The amplifier 30a outputs an AC voltage having a peak value of ± 5.6 V with respect to the ground potential as its output signal. That is, the absolute value of the bias voltage is somewhat smaller than the absolute value of the peak value of the amplifier 30a.

例えば、負荷インピーダンスが定格負荷であるとすると、第1の実施形態と同様に、増幅器20の乗算誤差信号は0Vである。従って、この0Vにバイアス重畳回路49で+5.3Vのバイアス電圧が重畳されて、非反転増幅器36、反転増幅器40に供給される。非反転増幅器36はダイオード34のカソードに+5.3Vの電圧を供給し、反転増幅器40はダイオード38のアノードに−5.3Vの電圧を供給する。即ち、非反転増幅器36aの出力電圧は、増幅器30aの正のピーク出力電圧よりも約0.3V低く、反転増幅器40aの出力電圧は、増幅器30aの負のピーク出力電圧よりも約0.3V高く設定されている。この約0.3Vの電圧は、ダイオード34、38が導通するためにアノード−カソード間に印加する必要のあるオン電圧よりも幾分低い。   For example, assuming that the load impedance is a rated load, the multiplication error signal of the amplifier 20 is 0 V as in the first embodiment. Therefore, a bias voltage of +5.3 V is superimposed on 0 V by the bias superimposing circuit 49 and supplied to the non-inverting amplifier 36 and the inverting amplifier 40. The non-inverting amplifier 36 supplies a voltage of +5.3 V to the cathode of the diode 34, and the inverting amplifier 40 supplies a voltage of −5.3 V to the anode of the diode 38. That is, the output voltage of the non-inverting amplifier 36a is about 0.3V lower than the positive peak output voltage of the amplifier 30a, and the output voltage of the inverting amplifier 40a is about 0.3V higher than the negative peak output voltage of the amplifier 30a. Is set. This voltage of about 0.3V is somewhat lower than the on-voltage that needs to be applied between the anode and cathode in order for the diodes 34, 38 to conduct.

上述したように増幅器30aの出力電圧のピーク値は、±5.6Vであるので、増幅器30aの出力電圧が+5.6Vのときでも、ダイオード34のアノード−カソード間には+0.3Vの電圧差しかない。増幅器30aの出力電圧が−5.3Vのときでも、ダイオード34のアノード−カソード間には+0.3Vの電圧差しかない。ダイオード34、38が導通するためには、アノード−カソード間に約+0.6Vの電圧差が必要である。従って、定格負荷の場合には、ダイオード34、38は導通せず、増幅器30aの出力信号はダイオード34、38によって制限されることはない。負荷が軽負荷の場合も同様である。この動作は、ハイインピーダンスアンプにおいて重要で、軽負荷時、電源電圧の上昇時においても、アンプ出力の過電圧によるスピーカ故障という状態も防ぐことができる。この動作により、アンプだけでなく、スピーカも保護できる。   As described above, since the peak value of the output voltage of the amplifier 30a is ± 5.6V, even when the output voltage of the amplifier 30a is + 5.6V, a voltage difference of + 0.3V is connected between the anode and the cathode of the diode 34. No. Even when the output voltage of the amplifier 30a is −5.3V, only a voltage of + 0.3V is inserted between the anode and the cathode of the diode 34. In order for the diodes 34 and 38 to conduct, a voltage difference of about +0.6 V is required between the anode and the cathode. Therefore, in the case of a rated load, the diodes 34 and 38 do not conduct, and the output signal of the amplifier 30a is not limited by the diodes 34 and 38. The same applies when the load is light. This operation is important in a high-impedance amplifier, and it is possible to prevent a speaker failure caused by an overvoltage of the amplifier output even at a light load or when the power supply voltage rises. This operation can protect not only the amplifier but also the speaker.

一方、増幅器20からの乗算誤差信号が負であるとき、例えば−5.3Vのとき、非反転増幅器36、40にはバイアス重畳回路49によって+5.3Vが重畳された0Vの電圧が供給され、非反転増幅器36、反転増幅器40の出力電圧は、それぞれ0Vとなる。その結果、ダイオード34、38のアノード−カソード間にはそれぞれ約+0.6V以上の電圧差が生じ、ダイオード34、38が導通し、増幅器30aの出力電圧は、正のときにはダイオード34の導通状態に応じて非反転増幅器36に吸い込まれ、負のときにはダイオード38の導通状態に応じて反転増幅器40に吸い込まれ、出力信号は制限される。   On the other hand, when the multiplication error signal from the amplifier 20 is negative, for example, −5.3V, the non-inverting amplifiers 36 and 40 are supplied with 0V voltage superimposed with + 5.3V by the bias superimposing circuit 49, The output voltages of the non-inverting amplifier 36 and the inverting amplifier 40 are each 0V. As a result, a voltage difference of about +0.6 V or more is generated between the anode and the cathode of each of the diodes 34 and 38, the diodes 34 and 38 are turned on, and when the output voltage of the amplifier 30a is positive, the diode 34 is turned on. Accordingly, it is sucked into the non-inverting amplifier 36, and when it is negative, it is sucked into the inverting amplifier 40 according to the conduction state of the diode 38, and the output signal is limited.

ダイオード34、38の導通状態は、そのアノード−カソード間に印加された電圧の大きさに応じて変化し、この電圧が大きいときほど、非反転増幅器36、反転増幅器40に吸い込まれる入力側増幅器30aの出力信号が多くなる。   The conduction state of the diodes 34 and 38 changes in accordance with the magnitude of the voltage applied between the anode and the cathode, and the input side amplifier 30a sucked into the non-inverting amplifier 36 and the inverting amplifier 40 as the voltage increases. Output signal increases.

例えば増幅器20の出力電圧がバイアス電圧の絶対値よりも絶対値が大きい−6.3Vのとき、非反転増幅器36、反転増幅器40には−1Vの電圧が供給され、非反転増幅器36の出力電圧は−1V、反転増幅器40の出力電圧は+1Vとなる。ここで、ダイオード50、52と抵抗器36b、40bが設けられていないとすると、ダイオード34、38が大きく導通し、非反転増幅器36、反転増幅器40の演算増幅器36a、40aは大きな電流を吸い込む。このとき、増幅器30aの出力電圧は±5.6Vであるので、この出力電圧をほぼ零ボルトのミュート状態にまで制限することができる。但し、演算増幅器36a、40aには大きな電流が流れ、これらはオーバードライブされる。   For example, when the output voltage of the amplifier 20 is −6.3 V, whose absolute value is larger than the absolute value of the bias voltage, a voltage of −1 V is supplied to the non-inverting amplifier 36 and the inverting amplifier 40, and the output voltage of the non-inverting amplifier 36. Is -1V, and the output voltage of the inverting amplifier 40 is + 1V. Here, if the diodes 50 and 52 and the resistors 36b and 40b are not provided, the diodes 34 and 38 are largely conducted, and the operational amplifiers 36a and 40a of the non-inverting amplifier 36 and the inverting amplifier 40 absorb a large current. At this time, since the output voltage of the amplifier 30a is ± 5.6 V, the output voltage can be limited to a mute state of almost zero volts. However, a large current flows through the operational amplifiers 36a and 40a, and these are overdriven.

実際には、保護用ダイオード50、52と抵抗器36b、40bが設けられているので、非反転増幅器36の出力電圧が−0.6V以下になると、ダイオード50が導通し、非反転増幅器36の出力電圧を−0.6Vに制限する。同様に反転増幅器40の出力電圧が+0.6以上になると、ダイオード52が導通し、反転増幅器40の出力電圧を+0.6Vに制限する。これによって、ダイオード34のカソード電圧は−0.6V以下に下がることはなく、ダイオード38のアノード電圧も+0.6V以上に上がることがない。その上、抵抗器36b、40bが非反転増幅器36、反転増幅器40の出力インピーダンスを高めている。その結果、ダイオード34、38の導通状態が制限され、演算増幅器36a、40aのオーバードライブが防止される。   Actually, since the protective diodes 50 and 52 and the resistors 36b and 40b are provided, when the output voltage of the non-inverting amplifier 36 becomes −0.6 V or less, the diode 50 becomes conductive and the non-inverting amplifier 36 Limit the output voltage to -0.6V. Similarly, when the output voltage of the inverting amplifier 40 becomes +0.6 or more, the diode 52 becomes conductive and limits the output voltage of the inverting amplifier 40 to + 0.6V. As a result, the cathode voltage of the diode 34 does not fall below −0.6V, and the anode voltage of the diode 38 does not rise above + 0.6V. In addition, resistors 36b and 40b increase the output impedance of non-inverting amplifier 36 and inverting amplifier 40. As a result, the conduction state of the diodes 34 and 38 is limited, and overdrive of the operational amplifiers 36a and 40a is prevented.

しかも、その制限は、バイアス重畳回路49による重畳分を打ち消して、非反転増幅器36、反転増幅器40の出力電圧の極性が、バイアス電圧が打ち消される前の極性と反対の極性になってごくわずかの値を発生したところで行われている。従って、ほぼミュートに近い状態まで増幅器30aの出力信号を制限することができる上に、演算増幅器36a、40aのオーバードライブを防止することができる。   In addition, the limitation is that the overlap by the bias superimposing circuit 49 is canceled, and the polarities of the output voltages of the non-inverting amplifier 36 and the inverting amplifier 40 are opposite to the polarities before the bias voltage is canceled. It is done where the value is generated. Therefore, the output signal of the amplifier 30a can be limited to a state almost close to mute, and overdrive of the operational amplifiers 36a and 40a can be prevented.

上記の実施形態では、デジタルアンプ部6を使用したが、これに限ったものではなく、アナログアンプ部を使用することもできる。また、上記の実施形態では、定格負荷時に負荷電流検出信号と負荷電圧検出信号の値を等しくするために、負荷電圧検出信号のレベルを増幅器16によって調整したが、負荷電流検出信号のレベルを調整することもできるし、負荷電流検出信号及び負荷電圧検出信号双方のレベルを調整することもできる。また、減算回路18では、清流負荷電流検出信号が清流負荷電圧検出信号よりも大きいときに、誤差信号が負極性になるように構成したが、逆に正極性となるように構成することもできる。但し、その場合、制御電圧増幅器2は、正極性の乗算誤差信号が供給されたとき、ゲインを小さくするように構成する。また、増幅器20を設けて、誤差信号に係数を乗算したが、電圧制御増幅器2の特性等によっては、増幅器20を除去することもできる。 In the above embodiment, the digital amplifier unit 6 is used. However, the present invention is not limited to this, and an analog amplifier unit can also be used. In the above embodiment, the level of the load voltage detection signal is adjusted by the amplifier 16 in order to equalize the values of the load current detection signal and the load voltage detection signal at the rated load, but the level of the load current detection signal is adjusted. It is also possible to adjust the levels of both the load current detection signal and the load voltage detection signal. Further, the subtracting circuit 18 is configured such that the error signal has a negative polarity when the clear load current detection signal is larger than the clear load voltage detection signal, but it can also be configured to be positive. . In this case, however, the control voltage amplifier 2 is configured to reduce the gain when a positive multiplication error signal is supplied. Further, although the amplifier 20 is provided and the error signal is multiplied by the coefficient, the amplifier 20 can be removed depending on the characteristics of the voltage control amplifier 2 and the like.

上記の実施形態では、バイアス電圧を正極性としたが、増幅器20からの乗算誤差信号が正極性の場合、バイアス電圧は負極性とする。その場合、ダイオード34、38、50、52は、図3に示したものと反対に、ダイオード34のカソードとダイオード38のアノード抵抗器32b、32cの接続点に接続し、ダイオード34のアノードを非反転増幅器36の出力側に接続し、ダイオード38のカソードを反転増幅器40の出力側に接続し、ダイオード50のカソードとダイオード52のアノードを接地電位に接続し、ダイオード50のアノードを非反転増幅器36の出力側に、ダイオード52のカソードを反転増幅器40の出力側に接続する。 In the above embodiment, the bias voltage is positive, but when the multiplication error signal from the amplifier 20 is positive, the bias voltage is negative. In that case, the diode 34,38,50,52 is opposite to that shown in FIG. 3, the anode resistor 32b of the cathode of the diode 34 and the diode 38, connected to a node 32c, and the anode of the diode 34 The non-inverting amplifier 36 is connected to the output side, the cathode of the diode 38 is connected to the output side of the inverting amplifier 40, the cathode of the diode 50 and the anode of the diode 52 are connected to the ground potential, and the anode of the diode 50 is connected to the non-inverting amplifier. The cathode of the diode 52 is connected to the output side of the inverting amplifier 40 on the output side of 36.

本発明の参考例の増幅器のブロック図である。It is a block diagram of the amplifier of the reference example of this invention. 図1の増幅器の負荷電圧対負荷電流特性と、清流負荷電圧対清流負荷電圧特性とを示す図である。It is a figure which shows the load voltage versus load current characteristic and clear current load voltage versus clear current load voltage characteristic of the amplifier of FIG. 本発明の1実施形態の増幅器の一部のブロック図である。FIG. 3 is a block diagram of a part of an amplifier according to an embodiment of the present invention.

符号の説明Explanation of symbols

2 電圧制御増幅器(レベル調整手段)
6 デジタルアンプ(増幅手段)
8 負荷電流検出器(電流検出手段)
10 負荷電圧検出器(電圧検出手段)
18 減算回路(差生成手段)
20 増幅器(係数乗算手段)
2 Voltage control amplifier (level adjustment means)
6 Digital amplifier (amplification means)
8 Load current detector (current detection means)
10 Load voltage detector (voltage detection means)
18 Subtraction circuit (difference generation means)
20 Amplifier (coefficient multiplication means)

Claims (2)

可聴周波数信号を増幅し、負荷に供給する増幅手段と、
この増幅手段から前記負荷に供給される電流を検出し、その大きさを表す電流検出信号を生成する電流検出手段と、
前記増幅手段から前記負荷に供給される電圧を検出し、その大きさを表す電圧検出信号を生成する電圧検出手段と、
前記電流検出信号と前記電圧検出信号とが供給され、両者の差を表す差信号を生成する差生成手段と、
前記増幅手段に設けられ、前記電流検出信号が前記電圧検出信号よりも大きいときの差信号の大きさに応じて前記可聴周波数信号のレベルを調整するレベル調整手段とを具備し、
前記レベル調整手段は、
前記差信号にそれと逆極性のバイアス信号を重畳したバイアス重畳差信号を出力するバイアス重畳手段と、
前記バイアス重畳差信号をこれと同相の同相信号と逆相の逆相信号とに変換し、前記同相信号を同相出力端子に、前記逆相信号を逆相出力端子に出力する変換手段と、
前記同相出力端子に一端が接続され、他端が前記増幅手段中の入力側増幅手段の出力側に接続された第1のダイオードと、
前記逆相出力端子に一端が接続され、他端が前記入力側増幅手段の出力側に接続された第2のダイオードとを具備し、
前記バイアス信号は、前記入力側増幅出段の出力信号のピーク値の絶対値よりも絶対値が小さく、極性が、前記負荷電流検出信号が前記負荷電圧検出信号よりも大きいときの前記差信号の極性と逆であり、
前記負荷電流検出信号が前記負荷電圧検出信号よりも大きいときに導通する方向で、第1のダイオードは、前記同相端子と前記入力側増幅手段の出力側に、第2のダイオードは、前記逆相端子と前記入力側増幅手段の出力側に、それぞれ接続されている
ことを特徴とする増幅器。
Amplifying means for amplifying the audio frequency signal and supplying it to the load;
Current detection means for detecting a current supplied from the amplification means to the load and generating a current detection signal representing the magnitude thereof;
Voltage detecting means for detecting a voltage supplied from the amplifying means to the load and generating a voltage detection signal representing the magnitude thereof;
Difference generation means for generating a difference signal representing a difference between the current detection signal and the voltage detection signal;
Provided in the amplifying means, comprising a level adjusting means for adjusting the level of the audio frequency signal according to the magnitude of the difference signal when the current detection signal is larger than the voltage detection signal;
The level adjusting means includes
Bias superimposing means for outputting a bias superimposed difference signal in which a bias signal having a polarity opposite to that of the difference signal is superimposed on the difference signal;
Conversion means for converting the bias superimposed difference signal into an in-phase signal and an out-of-phase anti-phase signal, and outputting the in-phase signal to an in-phase output terminal and the anti-phase signal to an anti-phase output terminal; ,
A first diode having one end connected to the common-mode output terminal and the other end connected to the output side of the input side amplifying means in the amplifying means;
A second diode having one end connected to the reverse phase output terminal and the other end connected to the output side of the input side amplifying means;
The bias signal has an absolute value smaller than an absolute value of a peak value of an output signal of the input side amplification output stage, and a polarity of the difference signal when the load current detection signal is larger than the load voltage detection signal. The opposite of polarity,
The first diode is connected to the in-phase terminal and the output side of the input side amplifying means, and the second diode is connected to the opposite phase in the direction of conduction when the load current detection signal is larger than the load voltage detection signal. An amplifier characterized by being connected to a terminal and an output side of the input side amplifying means, respectively .
請求項記載の増幅器において、前記変換手段の同相端子と基準電位との間に第3のダイオードが接続され、前記変換手段の逆相端子と前記基準電位との間に第4のダイオードが接続され、第3及び第4のダイオードは、前記差信号の絶対値が前記バイアス信号の絶対値よりもオン電圧だけ大きくなったとき、導通する方向に配置されている増幅器。 2. The amplifier according to claim 1 , wherein a third diode is connected between the in-phase terminal of said converting means and a reference potential, and a fourth diode is connected between the opposite-phase terminal of said converting means and said reference potential. The third and fourth diodes are arranged in a direction to conduct when the absolute value of the difference signal becomes larger by an on-voltage than the absolute value of the bias signal.
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