JP5012856B2

JP5012856B2 - 半導体装置の製造方法

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Publication number: JP5012856B2
Application number: JP2009148601A
Authority: JP
Inventors: 理崇野田; 剛山本
Original assignee: Denso Corp
Current assignee: Denso Corp
Priority date: 2009-06-23
Filing date: 2009-06-23
Publication date: 2012-08-29
Anticipated expiration: 2027-06-07
Also published as: JP2009218618A

Description

本発明は、半導体基板にトレンチを形成してなる半導体装置の製造方法に関するものである。

従来、素子間を分離する絶遠分離トレンチ、ＭＯＳ素子やＩＧＢＴ素子などのトレンチ構造のゲート電極、ｎ型の領域とｐ型の領域を交互に配置した並設ｐｎ構造部を備える超接合素子などを含む半導体装置を製造するに当たり、異方性ドライエッチングにより半導体基板にトレンチを形成する方法が採用されている。この方法では、加速させたイオンを半導体基板に衝突させてエッチングするので、半導体基板のトレンチ壁面内部にダメージ層が生じる。このダメージ層が残った状態で後工程（熱処理）を行うと、結晶欠陥の発生や、トレンチ壁面上に形成される絶縁膜の信頼性低下といった問題が生じる。

このダメージ層を除去する方法として、本出願人は先に特許文献１を開示している。特許文献１によれば、異方性ドライエッチングによってトレンチを形成した後、フッ酸と硝酸の混合液による等方性ウェットエッチングによって、ダメージ層を除去するようにしている。しかしながら、高アスペクト比（アスペクト比１０以上）のトレンチを形成する場合、表面張力等によって混合液がトレンチの底部側まで供給されにくく、これによりトレンチ壁面の一部にダメージ層が残ることも考えられる。

また、等方性ドライエッチングを採用することも考えられる。しかしながら、従来の等方性ドライエッチングでは、高アスペクト比（アスペクト比１０以上）のトレンチを形成する場合、エッチャントガスがトレンチ底部まで供給されにくく、トレンチの形状が、開口部付近が選択的にエッチングされて側壁に段差のある（角張った部分のある）漏斗様の形状となりやすい。この場合、段差部において電界集中が起こりやすくなる。また、この段差部やダメージ層が残ったトレンチ底部において、結晶欠陥の発生やトレンチ壁面上に形成される絶縁膜の信頼性低下といった問題が生じる。

高アスペクト比のトレンチ底部をエッチングするために、半導体基板にバイアスを印加し、トレンチ底部までイオンを引き込んでエッチングすることも考えられる。しかしながら、この方法によれば、加速させたイオンの衝突により、半導体基板に新たなダメージ層が生じることとなる。

また、特許文献２には、等方性ドライエッチングによってトレンチ底部をエッチングする方法が示されている。異方性ドライエッチングによって半導体基板にトレンチを形成した後、シリコン窒化膜をトレンチ壁面全面に形成する。そして、異方性エッチングによってトレンチ底部のシリコン窒化膜を除去した後に等方性エッチングすることで、トレンチの底部をラウンド形状としつつ、半導体基板に生じたダメージを除去するようにしている。

特開２００１−３５１８９号公報特開２００３−７６７６号公報

しかしながら、特許文献２に示される製造方法の場合、トレンチの壁面のうち、シリコン窒化膜から露出されたトレンチの底部を等方的にエッチングするため、シリコン窒化膜にて保護された部位と保護されない部位との間でエッチング有無による段差（角張った部分）が発生し、トレンチがメスフラスコ様の形状となる。したがって、段差部において電界集中が起こりやすくなる。また、この段差部や、シリコン窒化膜によって保護されることでダメージ層が残った部位において、結晶欠陥の発生やトレンチ壁面上に形成される絶縁膜の信頼性低下といった問題が生じる。

本発明は上記問題点に鑑み、高アスペクト比のトレンチを形成でき、且つ、トレンチ壁面全面にわたってダメージ層を除去できる半導体装置の製造方法を提供することを目的とする。

上記目的を達成する為に請求項１に記載の発明は、異方性ドライエッチングにより、シリコンを含む半導体基板にアスペクト比が１０以上のトレンチを形成するトレンチ形成工程と、異方性ドライエッチングによって半導体基板のトレンチ壁面内部に生じたダメージ層を、等方性ドライエッチングにより除去する除去工程と、を有する半導体装置の製造方法であって、トレンチ形成工程において、底部側ほどトレンチ幅の小さい順テーパ形状のトレンチを形成し、除去工程において、少なくとも炭素及びフッ素を含む第１ガスと、酸素からなる第２ガスとの少なくとも２種類のガスを用い、半導体基板の温度を２０℃以上９０℃未満の範囲内の温度にして、等方性ドライエッチングを実施することを特徴とする。

本発明においては、等方性ドライエッチングに用いるガスとして、少なくとも炭素及びフッ素を含む第１ガスと酸素からなる第２ガスの少なくとも２種類のガスを採用している。このガスにおいて、炭素は、フッ素など第１ガスの他の元素とともに重合膜（ポリマー）を形成し、トレンチ壁面に堆積することでフッ素ラジカルによる半導体基板のトレンチ壁面のエッチングを妨げるように作用する。なお、この重合膜は、プラズマ放電域に近いトレンチ開口側ほど堆積されやすい。また、酸素は、半導体基板に堆積した重合膜（炭素）を除去するように作用する。すなわち、重合膜の生成と除去は、トレンチの深さ方向において、トレンチ各所にフッ素ラジカルを供給し（トレンチ各所のエッチングレートを制御し）、トレンチ壁面全面にわたってダメージ層を除去するうえで重要である。

これに対し、本発明者は、半導体基板の温度を制御する（以下に示すように２０℃以上２００℃以下の範囲内の所定温度とする）ことで、重合膜の生成と除去を制御して、トレンチ壁面全面にわたってダメージ層を除去することができることを明らかにした。特に本発明のように、半導体基板の温度を２０℃以上９０℃未満の範囲内の温度とすると、トレンチの深さ方向において、半導体基板に対するエッチングレートを、底部側ほど大きくなるように連続的に変化する値とすることができる。したがって、等方性ドライエッチングによってトレンチ壁面に段差が生じることはない。このように、本発明によれば、高アスペクト比のトレンチを形成でき、且つ、トレンチ壁面全面にわたってダメージ層を除去することができる。なお、上述の範囲内においては、温度が低いほど、トレンチの底部側が開口部側に対してエッチングされやすくなるが、２０℃未満とすると、第２ガスとして酸素がある条件であっても、プラズマ放電によって第１ガスを分解（解離）する際に重合膜が酸素による除去に対して過剰に生成され、これによりダメージ層の除去が不十分となる。

特に請求項２に記載のように、トレンチ形成工程において、底部側ほどトレンチ幅の小さい順テーパ形状のトレンチを形成すると、除去工程後のトレンチを、深さ方向でトレンチ幅のほぼ等しい垂直形状とすることもできる。

また、請求項３に記載のように、トレンチ形成工程において、底部側ほどトレンチ幅の小さい順テーパ形状のトレンチを形成する、若しくは、請求項４に記載のように、トレンチ形成工程において、深さ方向でトレンチ幅のほぼ等しい垂直形状のトレンチを形成すると、除去工程後のトレンチを、底部側ほどトレンチ幅の大きい逆テーパ形状とすることもできる。

等方性エッチングにおける重合膜の効果を示す断面図である。等方性エッチングにおける重合膜除去の効果を示す断面図である。各温度における、トレンチの深さ方向における位置とエッチングレートとの関係を示す図である。各温度における、トレンチアスペクト比と、開口部エッチングレートに対する底部エッチングレートの比との関係を示す図である。トレンチの深さ方向において、エッチングレートがほぼ等しい場合のエッチングを示す断面図である。トレンチの深さ方向において、底部側ほどエッチングレートが大きい場合のエッチングを示す断面図である。トレンチの深さ方向において、開口部側ほどエッチングレートが大きい場合のエッチングを示す断面図である。第１実施形態に係る半導体装置の製造工程のうち、マスク形成工程を示す断面図である。第１実施形態に係る半導体装置の製造工程のうち、トレンチ形成工程を示す断面図である。第１実施形態に係る半導体装置の製造工程のうち、除去工程を示す断面図である。変形例のトレンチ形成工程を示す断面図である。変形例の除去工程を示す断面図である。第２実施形態に係る半導体装置の製造工程のうち、トレンチ形成工程を示す断面図である。第２実施形態に係る半導体装置の製造工程のうち、除去工程を示す断面図である。変形例のトレンチ形成工程を示す断面図である。変形例の除去工程を示す断面図である。第３実施形態に係る半導体装置の製造工程のうち、トレンチ形成工程を示す断面図である。第３実施形態に係る半導体装置の製造工程のうち、除去工程を示す断面図である。変形例のトレンチ形成工程を示す断面図である。変形例の除去工程を示す断面図である。その他変形例の除去工程を示す断面図である。

先ず、本発明の実施形態について説明する前に、本発明者が本発明を創作するに至った経緯を説明する。図１は、等方性エッチングにおける重合膜の効果を示す断面図である。図２は、等方性エッチングにおける重合膜除去の効果を示す断面図である。

本発明者は、異方性ドライエッチングにより、シリコンを含む半導体基板にトレンチを形成した後に、半導体基板のトレンチ壁面内部に生じるダメージ層を除去するに当たり、反応ガスとして、少なくとも炭素及びフッ素を含む第１ガス（例えばテトラフルオロメタン）と、酸素からなる第２ガスとの少なくとも２種類のガスを用いた等方性ドライエッチングの検討を詳細に行った。なお、チャンバ内圧力は３０Ｐａ程度とし、第２ガスに対する第１ガスの流量比を１程度とした。

具体的には、図１に示すように、シリコンからなる半導体基板１０の一面に、例えばシリコン酸化膜からなり、トレンチ形成部位に応じた開口部１２ａを有するマスク１２を形成し、マスク１２を介して、異方性ドライエッチング（例えばＲＩＥ）によりトレンチ１４を形成した。そして、トレンチ１４の形成後、トレンチ壁面内部の図示されないダメージ層を除去すべく、等方性ドライエッチングを実施した。

ここで、上述の等方性ドライエッチングにおいては、プラズマ放電によって第１ガスが分解（解離）された際に、炭素とフッ素など第１ガスを構成する他の元素とによる重合膜（ポリマー）が生成される。図１に示すように、生成された重合膜１６は、プラズマ放電域に近い、半導体基板１０の一面上（マスク１２上）及びトレンチ１４の開口部側から堆積するため、トレンチ１４の深さ方向において、開口部側ほど重合膜１６が存在することとなる。この重合膜１６は、プラズマ放電によって励起された活性種であるフッ素ラジカル１８が、半導体基板１０（トレンチ１４の壁面）をエッチングする（フッ素ラジカル１８がシリコンと反応して揮発性生物を生成し、表面から離脱する）のを妨げる。したがって、重合膜１６が存在すると、フッ素ラジカル１８は、図１に示すように、トレンチ１４の底部側まで供給されることとなり、底部において等方的にエッチングが進行する。

また、第２ガスとして用いる酸素は、プラズマ放電によって励起された状態（酸素ラジカル）で、重合膜１６（炭素）と反応し、例えば図２に示すように二酸化炭素２０として表面から離脱するため、重合膜１６が除去されることとなる。したがって、図２に示すように、重合膜１６が存在しないか、存在しても僅かである状態では、活性種であるフッ素ラジカル１８が、プラズマ放電域から近い半導体基板１０の部位であるトレンチ１４の開口部周辺の壁面をエッチングすることとなる。

このように、重合膜１６の生成（堆積）と除去は、トレンチ壁面の各所エッチングレートを決定するうえで非常に重要な要素である。そこで、本発明者は、重合膜１６の生成（堆積）と除去を制御するパラメータとして、半導体基板１０の温度について精査した。その結果を、図３〜図７に示す。図３は、各温度における、トレンチの深さ方向における位置とエッチングレートとの関係を示す図である。図４は、各温度における、トレンチアスペクト比と、開口部エッチングレートに対する底部エッチングレートの比との関係を示す図である。図５は、トレンチの深さ方向において、エッチングレートがほぼ等しい場合の等方性エッチングを示す断面図である。図６は、トレンチの深さ方向において、底部側ほどエッチングレートが大きい場合の等方性エッチングを示す断面図である。図７は、トレンチの深さ方向において、開口部側ほどエッチングレートが大きい場合の等方性エッチングを示す断面図である。なお、図３及び図４においては、トレンチ幅が約０．８μｍのトレンチ１４に対して等方性ドライエッチングを施した場合の結果を示しており、温度７０℃，９０℃，１２０℃については実測値、それ以外の温度についてはシミュレーション値を示している。また、図５〜図７においては、異方性ドライエッチングにより形成された、深さ方向でトレンチ幅のほぼ等しいトレンチ１４を等方性ドライエッチングする例を示しており、等方性ドライエッチング後のトレンチ１４の壁面を破線で示している。

図３に示すように、半導体基板１０の温度が９０℃の時には、トレンチ１４の深さ方向において、開口部（トレンチ深さ０μｍ）、中間部（トレンチ深さ１０μｍ）、底部（トレンチ深さ２０μｍ）の各所におけるエッチングレートがほぼ等しい値となった。これに対し、半導体基板１０の温度が９０℃よりも低い７０℃の場合には、深さ方向においてトレンチ各所でダメージ層を除去可能でありながら、底部側ほどエッチングレートが大きい値となった。また、半導体基板１０の温度が９０℃よりも高い１２０℃の場合には、深さ方向においてトレンチ各所でダメージ層を除去可能でありながら、開口部側ほどエッチングレートが大きい値となった。

また、半導体基板１０の温度による、トレンチ壁面のエッチングレートの制御は、図４に示すように、トレンチ１４のアスペクト比が１０以上において特に効果的であることが明らかとなった。なお、図４に示すように、半導体基板１０の温度を９０℃以上１１０℃以下、好ましくは１００℃とすると、トレンチ１４の各所におけるエッチングレートがほぼ等しい値となることが明らかとなった。また、１１０℃よりも高い温度とすると、開口部側ほどエッチングレートが大きくなることが明らかとなった。これは、重合膜１６によるトレンチ開口部でのエッチング抑止効果が、９０℃以上１１０℃以下のときよりも小さくなることによるものと考えられる。また、９０℃よりも低い温度とすると、底部側ほどエッチングレートが大きくなることが明らかとなった。これは、重合膜１６によるトレンチ開口部でのエッチング抑止効果が、９０℃以上１１０℃以下のときよりも大きくなることによるものと考えられる。

すなわち、図３及び図４の結果より、アスペクト比が１０以上のトレンチ１４に対して等方性ドライエッチングを施すに当たり、トレンチ壁面のエッチングレートを、半導体基板１０の温度によって制御できることを見出した。詳しくは、図５に示すように、トレンチ１４の深さ方向において、エッチングレートがほぼ等しい状態（フッ素ラジカル１８がトレンチ壁面の各所にほぼ均等に供給される状態）、図６に示すように、トレンチ１４の深さ方向において、底部側ほどエッチングレートが大きい状態（フッ素ラジカル１８が底部側に多く供給される状態）、図７に示すように、トレンチ１４の深さ方向において、開口部側ほどエッチングレートが大きい状態（フッ素ラジカル１８が開口部側に多く供給される状態）のいずれかに制御することができることを見出した。本発明は、この知見に基づくものであり、以下、本発明の実施の形態を図に基づいて説明する。

（第１実施形態）
図８〜図１０は、本発明の第１実施形態に係る半導体装置の製造工程を示す断面図であり、図８は、マスク形成工程、図９は、トレンチ形成工程、図１０は除去工程を示している。なお、上述した構成要素と同一の要素には、同一の符号を付与するものとする。

上述したように、本実施形態においても半導体基板１０としてシリコン基板を採用する。異方性ドライエッチングに先立ち、先ず図８に示すように、半導体基板１０の一面上に、トレンチ形成部位に応じた開口部１２ａを有するマスク１２を形成する。このマスク１２としては、異方性ドライエッチングによるトレンチ形成において、マスクとしての機能を果たすものであれば採用することができる。本実施形態においては、上述同様、シリコン酸化膜をパターニングしてマスク１２としている。

次に、マスク１２を介して、異方性ドライエッチングによりトレンチ１４を形成する。異方性ドライエッチングとしては、化学的エッチングよりも物理的エッチングの影響が大きいものであれば採用することができ、本実施形態においてはＲＩＥ（反応性イオンエッチング）を採用している。この異方性ドライエッチングにおいては、加速させたイオンを、マスク１２の開口部１２ａから露出する半導体基板１０に衝突させて物理的エッチング（スパッタエッチング）するため、図９に示すように、半導体基板１０のトレンチ壁面内部にダメージ層２２が形成される。なお、本実施形態においては、トレンチ１４として、アスペクト比が約２０であり、深さ方向においてトレンチ幅のほぼ等しい垂直形状（半導体基板１０の一面に対する）のトレンチを形成する。

トレンチ１４の形成後、ダメージ層２２を除去するために、等方性ドライエッチングを実施する。本実施形態においては、少なくとも炭素及びフッ素を含む第１ガスとしてテトラフルオロメタン（ＣＦ_４）、第２ガスとして酸素（Ｏ_２）を用い、チャンバ内圧力を３０Ｐａ程度、第２ガスに対する第１ガスの流量比を１程度とした。そして、半導体基板１０の温度を、９０℃以上１１０℃以下の範囲内において所定温度（一定）とした。このような条件とすると、上述（図３〜図５参照）したように、深さ方向においてトレンチ各所のエッチングレートがほぼ等しい値（０．９５程度〜１．０５程度）となる。したがって、トレンチ壁面全面がほぼ均一にエッチングされ、図１０に示すように、トレンチ壁面全面にわたってダメージ層２２を除去することができる。すなわち、ダメージ層２２を起因とする結晶欠陥の発生を抑制することができる。

また、高アスペクト比（アスペクト比１０以上）であって、深さ方向においてトレンチ幅のほぼ等しい垂直形状のトレンチ１４を形成することができる。また、トレンチ壁面全面がほぼ均一にエッチングされるので、高アスペクト比であってもトレンチ１４の壁面に段差がなく、トレンチ１４の底部端（側面との境界）の隅部１４ａと、開口部の角部である肩部１４ｂも、等方性エッチングによって図１０に示すように丸められた形状となる。したがって、局所的な電界集中を抑制することができる。

半導体基板１０の温度としては、特に略１００℃とすると、図４に示したように、深さ方向においてトレンチ各所のエッチングレートをより均一とし、本実施形態においてはトレンチ１４の垂直性を高めることができる。

このようなトレンチ１４の形成（ダメージ層２２の除去）は、素子間を分離する絶遠分離トレンチ、ＭＯＳ素子やＩＧＢＴ素子などのトレンチ構造のゲート電極、ｎ型の領域とｐ型の領域を交互に配置した並設ｐｎ構造部を備える超接合素子のトレンチ形成に適用することができる。本実施形態においては、超接合素子のトレンチ（例えばｐ型の領域をエピ成長によって形成する際のトレンチ）に対し、上述した製造方法を適用している。

このように本実施形態に係る半導体装置の製造方法によれば、高アスペクト比（アスペクト比１０以上）のトレンチ１４を形成でき、且つ、トレンチ壁面全面にわたってダメージ層２２を除去することができる。したがって、ダメージ層２２を起因とする結晶欠陥の発生を抑制することができる。また、等方性ドライエッチングによってトレンチ壁面に段差が生じることがないので、局所的な電界集中を抑制することができる。

なお、本実施形態においては、トレンチ形成工程において、深さ方向でトレンチ幅のほぼ等しい垂直形状のトレンチ１４を形成する例を示した。しかしながら、トレンチ形成工程において、底部側ほどトレンチ幅の小さい順テーパ形状のトレンチ１４や、底部側ほどトレンチ幅の大きい逆テーパ形状のトレンチ１４を形成しても良い。例えばＲＩＥにより、図１１に示すように、底部側ほどトレンチ幅の小さい順テーパ形状のトレンチ１４を形成しておき、上述の条件で除去工程を実施すれば、図１２に示すように、除去工程後のトレンチ１４を、底部側ほどトレンチ幅の小さい順テーパ形状のトレンチ１４とすることができる。このように、本実施形態に係る半導体装置の製造方法によれば、トレンチ壁面全面にわたってダメージ層２２を除去でき、除去工程後のトレンチ１４を、除去工程前のトレンチ形状を反映した（模倣した）形状とすることができる。

（第２実施形態）
図１３及び図１４は、本発明の第２実施形態に係る半導体装置の製造工程を示す断面図であり、図１３は、トレンチ形成工程、図１４は除去工程を示している。なお、上述した構成要素と同一の構成要素には、同一の符号を付与するものとする。

第１実施形態においては、半導体基板１０の温度を９０℃以上１１０℃以下の範囲内の温度とすることで、アスペクト比が１０以上のトレンチ１４を、ダメージ層２２が除去され、且つ、深さ方向においてトレンチ幅のほぼ等しい垂直形状とする例を示した。これに対し、本実施形態においては、半導体基板１０の温度を２０℃以上９０℃未満の範囲内の所定温度（一定）としつつ、アスペクト比が１０以上のトレンチ１４を、ダメージ層２２が除去され、且つ、深さ方向においてトレンチ幅のほぼ等しい垂直形状とする点を特徴とする。

半導体基板１０の温度を９０℃よりも低い温度とすると、上述（図３、図４、図６参照）したように、トレンチ１４の深さ方向において、半導体基板１０に対するエッチングレートを、底部側ほど大きくなるように連続的に変化する値とすることができる。例えば、温度を７０℃とすると、図４に示すように、トレンチ開口部におけるエッチングレートに対する底部におけるエッチングレートの比が１．２〜１．２５程度となる。本実施形態においては、これを利用し、図１３に示すように、トレンチ形成工程において、例えばＲＩＥにより、底部側ほどトレンチ幅の小さい順テーパ形状のトレンチ１４を形成しておく。そして上述の条件で除去工程を実施する。なお、除去工程後のトレンチ形状が深さ方向でトレンチ幅のほぼ等しい垂直形状となるように、トレンチ形成工程後のトレンチ１４の形状に応じて、除去工程における半導体基板１０の温度を選択する。これにより、トレンチ壁面全面がエッチングされながらも、トレンチ１４の深さ方向において底部側ほど早くエッチングされ、除去工程後のトレンチ１４を、図１４に示すように、深さ方向でトレンチ幅のほぼ等しい垂直形状とすることができる。

なお、半導体基板１０の温度が低いほど、重合膜１６が生成されやすくなり、トレンチ１４の底部側が開口部側に対してエッチングされやすくなるが、２０℃未満とすると、第２ガスとして酸素がある条件であっても、酸素（酸素ラジカル）による除去に対して重合膜１６の生成量が過剰となり、ダメージ層２２の除去が不十分となる。したがって、半導体基板１０の温度は、２０℃以上９０℃未満の範囲内の温度とすると良い。

このように本実施形態に係る半導体装置の製造方法によれば、アスペクト比が１０以上のトレンチ１４を、ダメージ層２２が除去され、且つ、深さ方向においてトレンチ幅のほぼ等しい垂直形状とすることができる。したがって、ダメージ層２２を起因とする結晶欠陥の発生を抑制することができる。また、この等方性ドライエッチングによってトレンチ壁面に段差が生じることはないので、局所的な電界集中を抑制することができる。

なお、本実施形態においては、除去工程が終了した時点で、トレンチ１４を、深さ方向においてトレンチ幅のほぼ等しい垂直形状とする例を示した。しかしながら、トレンチ形成工程において、底部側ほどトレンチ幅の小さい順テーパ形状のトレンチ１４、又は、深さ方向でトレンチ幅のほぼ等しい垂直形状のトレンチ１４を形成しておくことで、除去工程後のトレンチ１４を、底部側ほどトレンチ幅の大きい逆テーパ形状とすることもできる。例えば図１５に示すように、深さ方向でトレンチ幅のほぼ等しい垂直形状のトレンチ１４を形成した場合、上述の条件で除去工程を実施すれば、図１６に示すように、除去工程後のトレンチ１４を、底部側ほどトレンチ幅の大きい逆テーパ形状のトレンチ１４とすることができる。この場合も、高アスペクト比（アスペクト比１０以上）のトレンチ１４を形成でき、且つ、トレンチ壁面全面にわたってダメージ層２２を除去することができる。また、等方性ドライエッチングによってトレンチ壁面に段差が生じることはない。

さらには、トレンチ形成工程において、底部側ほどトレンチ幅の大きい逆テーパ形状のトレンチ１４を形成しておくことで、逆テーパ形状のトレンチ１４のテーパ角（半導体基板１０の一面に対して垂直からの傾き角度）をより大きくするようにしても良い。

（第３実施形態）
図１７及び図１８は、本発明の第３実施形態に係る半導体装置の製造工程を示す断面図であり、図１７は、トレンチ形成工程、図１８は除去工程を示している。なお、上述した構成要素と同一の構成要素には、同一の符号を付与するものとする。

第１実施形態においては、半導体基板１０の温度を９０℃以上１１０℃以下の範囲内の所定温度（一定）とすることで、アスペクト比が１０以上のトレンチ１４を、ダメージ層２２が除去され、且つ、深さ方向においてトレンチ幅のほぼ等しい垂直形状とする例を示した。これに対し、本実施形態においては、半導体基板１０の温度を１１０℃よりも高く２００℃以下の範囲内の温度としつつ、アスペクト比が１０以上のトレンチ１４を、ダメージ層２２が除去され、且つ、深さ方向においてトレンチ幅のほぼ等しい垂直形状とする点を特徴とする。

半導体基板１０の温度を１１０℃よりも高い温度とすると、上述（図３、図４、図７参照）したように、トレンチ１４の深さ方向において、半導体基板１０に対するエッチングレートを、開口部側ほど大きくなるように連続的に変化する値とすることができる。例えば、温度を１２０℃とすると、図４に示すように、トレンチ開口部におけるエッチングレートに対する底部におけるエッチングレートの比が０．９程度となる。本実施形態においては、これを利用し、図１７に示すように、トレンチ形成工程において、例えばＲＩＥにより、底部側ほどトレンチ幅の大きい逆テーパ形状のトレンチ１４を形成しておく。そして上述の条件で除去工程を実施する。なお、除去工程後のトレンチ形状が深さ方向でトレンチ幅のほぼ等しい垂直形状となるように、トレンチ形成工程後のトレンチ１４の形状に応じて、除去工程における半導体基板１０の温度を選択する。これにより、トレンチ壁面全面がエッチングされながらも、トレンチ１４の深さ方向において開口部側ほど早くエッチングされ、除去工程後のトレンチ１４を、図１８に示すように、深さ方向でトレンチ幅のほぼ等しい垂直形状とすることができる。

なお、半導体基板１０の温度が高いほど、重合膜１６が生成されにくくなり、トレンチ１４の開口部側が底部側に対してエッチングされやすくなるが、２００℃を超える温度とすると、重合膜１６がほとんど生成しなくなるため、トレンチ底部へのフッ素ラジカル１８の供給が困難となる。したがって、半導体基板１０の温度を１１０℃よりも高く２００℃以下の範囲内の温度とすると良い。

なお、本実施形態においては、除去工程が終了した時点で、トレンチ１４を、深さ方向においてトレンチ幅のほぼ等しい垂直形状とする例を示した。しかしながら、トレンチ形成工程において、底部側ほどトレンチ幅の大きい逆テーパ形状のトレンチ１４、又は、深さ方向でトレンチ幅のほぼ等しい垂直形状のトレンチ１４を形成しておくことで、除去工程後のトレンチ１４を、底部側ほどトレンチ幅の小さい順テーパ形状とすることもできる。例えば図１９に示すように、深さ方向でトレンチ幅のほぼ等しい垂直形状のトレンチ１４を形成した場合、上述の条件で除去工程を実施すれば、図２０に示すように、除去工程後のトレンチ１４を、開口部側ほどトレンチ幅の大きい順テーパ形状のトレンチ１４とすることができる。この場合も、高アスペクト比（アスペクト比１０以上）のトレンチ１４を形成でき、且つ、トレンチ壁面全面にわたってダメージ層２２を除去することができる。また、等方性ドライエッチングによってトレンチ壁面に段差が生じることはない。

さらには、トレンチ形成工程において、底部側ほどトレンチ幅の小さい順テーパ形状のトレンチ１４を形成しておくことで、順テーパ形状のトレンチ１４のテーパ角をより大きくするようにしても良い。

以上、本発明の好ましい実施形態について説明したが、本発明は上述した実施形態になんら制限されることなく、本発明の主旨を逸脱しない範囲において、種々変形して実施することが可能である。

本実施形態においては、半導体基板１０としてシリコン基板を採用する例を示した。しかしながら、半導体基板１０としてはシリコンを含む基板であれば良く、例えばＳｉＣ基板を採用することもできる。ただし、ＳｉＣ基板の場合、基板中の炭素を除去するために、第２ガスである酸素をシリコン基板よりも多くしたほうが良い。また、単結晶のバルク基板だけでなく、支持基板上に絶縁層を介して半導体層を配置してなるＳＯＩ構造基板の半導体層を、半導体基板１０として採用することもできる。

本実施形態においては、第１ガスとして、テトラフルオロメタン（ＣＦ_４）を用いる例を示した。しかしながら、第１ガスとしては炭素とフッ素を少なくとも含むガスであれば良く、例えばトリフルオロメタン（ＣＨＦ_３）、ジフルオロメタン（ＣＨ_２Ｆ_２）、（モノ）フルオロメタン（ＣＨ_３Ｆ）を採用することができる。

本実施形態においては、除去工程において、半導体基板１０の温度を所定温度に固定する例を示した。しかしながら、それぞれの温度範囲内において、温度を変化させても良い。また、除去工程において、半導体基板１０の温度を、深さ方向においてエッチングレートのほぼ等しい９０℃以上１１０℃以下の範囲内の温度、深さ方向において底部側ほどエッチングレートの高い２０℃以上９０℃未満の範囲内の温度、及び深さ方向において開口部側ほどエッチングレートの高い１１０℃よりも高く２００℃以下の範囲内の温度のうち、少なくとも２つの温度で切り替えても良い。このように、半導体基板１０の温度を多段に切り替えても、高アスペクト比のトレンチ１４を形成でき、且つ、トレンチ壁面全面にわたってダメージ層２２を除去することができる。また、トレンチ１４を種々の形状とすることができる。例えば、２０℃以上９０℃未満の範囲内の温度と、１１０℃よりも高く２００℃以下の範囲内の温度の切り替えにより、トレンチ１４を、図２１に示すように鼓状の形状とすることもできる。図２１は、その他変形例の除去工程を示す断面図であり、破線を１段目の除去（１１０℃よりも高く２００℃以下の範囲内の温度）での形状、実線を２段目の除去（２０℃以上９０℃未満の範囲内の温度）での形状としている。

本実施形態においては、半導体基板１０の温度によって、重合膜１６の生成及び除去を制御し、ひいては深さ方向でのトレンチ各所のエッチングレートを制御する例を示した。しかしながら、ガス流量比（ガス流量）、チャンバ内圧力によっても、重合膜１６の生成及び除去を制御することは可能であると考えられる。例えば、第１ガスの量が増えると、フッ素ラジカル１８及び重合膜１６が増加し、底部側のエッチングレートが大きくなる。これに対し、第１ガスの量が減少すると、フッ素ラジカル１８及び重合膜１６が減少して、開口部側のエッチングレートが大きくなる。また、チャンバ内圧力が高くなると、分子密度が高まり、平均速度が遅くなるので、ミーンフリーパス（平均自由行程）が短くなり、開口部側のエッチングレートが大きくなる。これに対し、チャンバ内圧力が低くなると、分子密度が小さくなり、平均速度が早くなるので、ミーンフリーパスが長くなり、底部側のエッチングレートが大きくなる。

１０・・・半導体基板
１２・・・マスク
１４・・・トレンチ
１４ａ・・・隅部
１４ｂ・・・肩部
１６・・・重合膜
１８・・・フッ素ラジカル
２０・・・二酸化炭素
２２・・・ダメージ層

Claims

異方性ドライエッチングにより、シリコンを含む半導体基板にアスペクト比が１０以上のトレンチを形成するトレンチ形成工程と、
前記異方性ドライエッチングによって前記半導体基板のトレンチ壁面内部に生じたダメージ層を、等方性ドライエッチングにより除去する除去工程と、を有する半導体装置の製造方法であって、
前記トレンチ形成工程において、底部側ほどトレンチ幅の小さい順テーパ形状の前記トレンチを形成し、
前記除去工程において、少なくとも炭素及びフッ素を含む第１ガスと、酸素からなる第２ガスとの少なくとも２種類のガスを用い、前記半導体基板の温度を２０℃以上９０℃未満の範囲内の温度にして、前記等方性ドライエッチングを実施することを特徴とする半導体装置の製造方法。
前記トレンチ形成工程において、底部側ほどトレンチ幅の小さい順テーパ形状の前記トレンチを形成し、
前記除去工程によって、前記トレンチを、深さ方向でトレンチ幅のほぼ等しい垂直形状とすることを特徴とする請求項１に記載の半導体装置の製造方法。
前記トレンチ形成工程において、底部側ほどトレンチ幅の小さい順テーパ形状の前記トレンチを形成し、
前記除去工程によって、前記トレンチを、底部側ほどトレンチ幅の大きい逆テーパ形状とすることを特徴とする請求項１に記載の半導体装置の製造方法。
前記トレンチ形成工程において、深さ方向でトレンチ幅のほぼ等しい垂直形状の前記トレンチを形成し、
前記除去工程によって、前記トレンチを、底部側ほどトレンチ幅の大きい逆テーパ形状とすることを特徴とする請求項１に記載の半導体装置の製造方法。