JP5081373B2 - 低不純物炭化ケイ素ウェーハの作製方法 - Google Patents
低不純物炭化ケイ素ウェーハの作製方法 Download PDFInfo
- Publication number
- JP5081373B2 JP5081373B2 JP2004532493A JP2004532493A JP5081373B2 JP 5081373 B2 JP5081373 B2 JP 5081373B2 JP 2004532493 A JP2004532493 A JP 2004532493A JP 2004532493 A JP2004532493 A JP 2004532493A JP 5081373 B2 JP5081373 B2 JP 5081373B2
- Authority
- JP
- Japan
- Prior art keywords
- crystal
- wafer
- concentration
- silicon
- silicon carbide
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D12/00—Bipolar devices controlled by the field effect, e.g. insulated-gate bipolar transistors [IGBT]
- H10D12/411—Insulated-gate bipolar transistors [IGBT]
- H10D12/441—Vertical IGBTs
-
- C—CHEMISTRY; METALLURGY
- C30—CRYSTAL GROWTH
- C30B—SINGLE-CRYSTAL GROWTH; UNIDIRECTIONAL SOLIDIFICATION OF EUTECTIC MATERIAL OR UNIDIRECTIONAL DEMIXING OF EUTECTOID MATERIAL; REFINING BY ZONE-MELTING OF MATERIAL; PRODUCTION OF A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; SINGLE CRYSTALS OR HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; AFTER-TREATMENT OF SINGLE CRYSTALS OR A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; APPARATUS THEREFOR
- C30B25/00—Single-crystal growth by chemical reaction of reactive gases, e.g. chemical vapour-deposition growth
-
- C—CHEMISTRY; METALLURGY
- C30—CRYSTAL GROWTH
- C30B—SINGLE-CRYSTAL GROWTH; UNIDIRECTIONAL SOLIDIFICATION OF EUTECTIC MATERIAL OR UNIDIRECTIONAL DEMIXING OF EUTECTOID MATERIAL; REFINING BY ZONE-MELTING OF MATERIAL; PRODUCTION OF A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; SINGLE CRYSTALS OR HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; AFTER-TREATMENT OF SINGLE CRYSTALS OR A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; APPARATUS THEREFOR
- C30B29/00—Single crystals or homogeneous polycrystalline material with defined structure characterised by the material or by their shape
- C30B29/10—Inorganic compounds or compositions
- C30B29/36—Carbides
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D12/00—Bipolar devices controlled by the field effect, e.g. insulated-gate bipolar transistors [IGBT]
- H10D12/01—Manufacture or treatment
- H10D12/031—Manufacture or treatment of IGBTs
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D12/00—Bipolar devices controlled by the field effect, e.g. insulated-gate bipolar transistors [IGBT]
- H10D12/01—Manufacture or treatment
- H10D12/031—Manufacture or treatment of IGBTs
- H10D12/032—Manufacture or treatment of IGBTs of vertical IGBTs
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D62/00—Semiconductor bodies, or regions thereof, of devices having potential barriers
- H10D62/80—Semiconductor bodies, or regions thereof, of devices having potential barriers characterised by the materials
- H10D62/83—Semiconductor bodies, or regions thereof, of devices having potential barriers characterised by the materials being Group IV materials, e.g. B-doped Si or undoped Ge
- H10D62/832—Semiconductor bodies, or regions thereof, of devices having potential barriers characterised by the materials being Group IV materials, e.g. B-doped Si or undoped Ge being Group IV materials comprising two or more elements, e.g. SiGe
- H10D62/8325—Silicon carbide
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
- H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
- H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
- H10P14/24—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials using chemical vapour deposition [CVD]
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
- H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
- H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
- H10P14/29—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by the substrates
- H10P14/2901—Materials
- H10P14/2902—Materials being Group IVA materials
- H10P14/2904—Silicon carbide
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
- H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
- H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
- H10P14/29—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by the substrates
- H10P14/2926—Crystal orientations
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
- H10P14/00—Formation of materials, e.g. in the shape of layers or pillars
- H10P14/20—Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
- H10P14/34—Deposited materials, e.g. layers
- H10P14/3402—Deposited materials, e.g. layers characterised by the chemical composition
- H10P14/3404—Deposited materials, e.g. layers characterised by the chemical composition being Group IVA materials
- H10P14/3408—Silicon carbide
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
- H10P32/00—Diffusion of dopants within, into or out of wafers, substrates or parts of devices
- H10P32/10—Diffusion of dopants within, into or out of semiconductor bodies or layers
- H10P32/17—Diffusion of dopants within, into or out of semiconductor bodies or layers characterised by the semiconductor material
- H10P32/171—Diffusion of dopants within, into or out of semiconductor bodies or layers characterised by the semiconductor material being group IV material
- H10P32/172—Diffusion of dopants within, into or out of semiconductor bodies or layers characterised by the semiconductor material being group IV material being crystalline silicon carbide
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S438/00—Semiconductor device manufacturing: process
- Y10S438/931—Silicon carbide semiconductor
Landscapes
- Chemical & Material Sciences (AREA)
- Engineering & Computer Science (AREA)
- Crystallography & Structural Chemistry (AREA)
- Materials Engineering (AREA)
- Metallurgy (AREA)
- Organic Chemistry (AREA)
- Inorganic Chemistry (AREA)
- Chemical Kinetics & Catalysis (AREA)
- General Chemical & Material Sciences (AREA)
- Crystals, And After-Treatments Of Crystals (AREA)
- Recrystallisation Techniques (AREA)
Description
【0001】
本発明は、ウェーハに注入された自由キャリアをバイポーラパワーデバイスのために利益のある寿命で再結合させるために、不純物、内因性欠陥又は構造欠陥のいずれかに起因する深い準位の十分な濃度を有する低不純物(低ドーピング)n型又はp型炭化ケイ素ウェーハの作製方法に関する。
【背景技術】
【0002】
現在、シリコンパワーデバイスにより実現する最も高い破壊電圧はIGBTとGTOに対して4.5〜6.5kVの範囲であり、サイリスタに対して9〜12kVの範囲である。今日、高めの電圧を扱うためのこれらスイッチング装置の能力は、直列操作(直列演算)の要件のような技術因子、及びシリコン半導体の物理特性により制限される。高めの電圧(>10kV)の電気送信システムは広めのバンドギャップの炭化ケイ素半導体の高めの臨界電場から利益を得ると考えられている。加えて、同等の電圧定格のために、炭化ケイ素装置はそれらのシリコンの片方より低いオン抵抗と低いスイッチングのロスの利点を提供する。
【0003】
SiC基板1に析出した低不純物電圧阻止層3を有する、従来技術に従う例の構造が図1に示されている。現在のところ、このような全ての電圧支持SiC層は、高不純物(高ドーピング)のオフ(オフオリエント)したSiC基板1においてエピタキシャル成長する。このような層3を成長させるための確立した方法は、1600℃付近の温度で実行されるCVD技術である。CVD技術の利点は、SiCバイポーラ装置に必要な、低n型又はp型ドーピング(典型的には1015cm−3の範囲及びより低い)と長いキャリア寿命(数百ナノ秒)の要件を満たすその能力にある。CVDプロセスの主な不利益はその遅い成長速度と、従って100μmより厚い層に対してコスト高になる点にある。例えば、ND〜3×1014cm−3で5〜10μm/hの範囲の成長速度で、20kVの阻止層のための250μm厚のドリフト領域のために、既存のCVDプロセスは25〜50時間の成長時間を必要とする。
【0004】
シリコンの技術では、エピタキシャルパワーデバイス構造の高いコストは、伝導基板で成長した厚い低不純物エピレイヤーの代わりに、低不純物シリコンウェーハをドリフト領域として用いることにより取り組まれてきた。最新式のハイパワーシリコンデバイスのための出発ウェーハは、フロート領域で成長したSi結晶から作られた4〜6インチの中性子変換ウェーハである。例えば、5kVスイッチング装置のドリフト領域は、2×1013cm−3のドーピングを有する約500μm厚のシリコンウェーハを用いる。
【0005】
現在、この技術はシリコンパワーデバイスを10kVレンジまでの電圧操作能力に限定する。25kVのシリコンデバイスは、1012cm−3又はそれ以下のドリフト領域として2mm厚のウェーハを使用すること、及び400μsの担体寿命を必要とする。炭化ケイ素スイッチング装置は、同じ阻止電圧を実現するために、1桁薄いドリフト領域、1〜2桁高いドーピング及び低めの担体寿命を使用する一方、低めのオン抵抗と低めのスイッチングロスの利点をもたらす。
【0006】
しかしながら、低不純物のマイクロ秒レンジの寿命を有するSiCウェーハの不足のために、このアプローチは現在の最新式の炭化ケイ素ウェーハによって使用できる。現在、SiCウェーハは、低めのレンジの抵抗率(n型、約0.015Ωcm及びp型約2.5Ωcm)と、半絶縁性フォーム(ρ>106Ωcm)において基板として用いるために利用できる。低い抵抗率の基板のために、浅いドーパントの濃度(例えば、窒素又はアルミニウム)は典型的には1018cm−3又はそれより高いレンジにある一方、半絶縁性基板は浅い準位(例えば窒素)より高い密度の深い準位(内因性又は外因性)を含む。従って、逆電圧支持能力を有しない低い抵抗率の基板も、自由キャリアの寿命が数ナノ秒よりも短い半絶縁性基板も、パワーデバイスのドリフト領域として用いることができない。
【0007】
十分な伝導率を有する適切なベース材料が利用できないので(n型材料の0.02Ωcmに対して約8Ωcm)、「低い抵抗率」のp型基板に作製された縦型SiC半導体パワーデバイスは、これまでのところ理論にのみ存在する。この不足の理由は、最も一般的な結晶成長プロセスの現在の技術にあると考えられる。アルミニウムの組み込みは、特に高不純物濃度の場合に昇華成長炉で制御することが困難である。さらに、炭化ケイ素における全ての知られたアクセプタのイオン化エネルギーは比較的高い。従って、エピタキシーにより成長したn型ドリフト領域を有するp型基板を用いる基板のような魅力的なIGBTを作製することは可能でない。さらに、適切なベース材料の利用性をも考えると、推定されるIGBT構造の逆方向エミッタの近くで寿命変調によってデバイスパラメータを調節することは限られた可能性しかない(図1)。
【0008】
分かっている限りでは、エピタキシャルのSiC基板において実現したIGBT構造は、満足できない技術的なパラメータにより損なわれる。全ての場合で、ベース材料は非常に低い伝導率を有するp型だった。この場合、酸化物の応力が非常に高く、信頼度が非常に低下することになるので(十分な遮断の対策の使用を除く)、MOSゲートを用いた典型的なIGBT構造の成功の実現は可能ではないようである。
【0009】
【特許文献1】
US patent 5704985
【特許文献2】
US patent 60306612
【特許文献3】
US patent 6039812
【特許文献4】
US patent 6048398
【特許文献5】
SE 0103602-9
【特許文献6】
US patent 5712502
【発明の開示】
【発明が解決しようとする課題】
【0010】
(材料の目的と要約)
本発明の目的は、ウェーハ全体(図2)が高電圧パワーデバイスのドリフト領域として使用することができるような質を有する低不純物n型又はp型結晶からSiCウェーハを作製するための方法を提供することである。この方法は、エピタキシーのために基板として用いられる低い抵抗率のSiCウェーハにおける厚い(>100μm)低不純物層の従来のCVD成長より低いコスト解決法を提供する。本発明は、IGBTのようなSiCスイッチング装置の新しい効率的な設計をも可能にする。
【0011】
(デバイスの目的と要約)
本発明の最も重要な利点は、低い抵抗基板なしに半導体構造を作製することができることである。この基板は、縦型パワーデバイスの場合、不要な付加的な抵抗だけを表す。ウェーハ全体は、非常に高い電圧(15kVよりも大きい)を阻止することができる低不純物nドリフト領域(図2)から成る。
【発明を実施するための最良の形態】
【0012】
(材料の記述)
バイポーラ装置での適切な操作を可能にするために、ドリフト領域は幾つかの要件を満たさなければならない。第一の要件は高電圧を維持するための低ドーピングであり、典型的には1013〜1014cm−3の正味のキャリア濃度と、100〜300μm程度の十分な厚みである。
【0013】
第二の要件は、順方向バイアス下でドリフト領域に注入されるキャリアの十分な寿命であり、それでその結果生じる伝導変調が高い電流密度を可能にする。再結合中心として作用するバンドギャップ内の欠陥準位の存在が、キャリアの寿命に不利な影響を及ぼすことになる。ゆえに、伝導帯と価電子帯の両方とキャリアを交換することができる深い準位のような効率的な再結合中心の濃度は、所望の装置性能によって、同じ位低く保たれなければならない。幾つかの欠陥は、遷移金属及び内因性欠陥のようなSiCにおける深い準位を生じさせることが知られている。積層欠陥のような構造欠陥及び低角度境界は寿命キラーと認定されているので避けなければならない。
【0014】
従来の昇華により、又は物理気相輸送(PVT)から成長した炭化ケイ素結晶から製造されたウェーハは、現在、パワーデバイスのドリフト領域として役立つには十分純粋ではない。PVT成長結晶からスライスされた最も高い純度のウェーハにおいてさえ、窒素濃度は5×1016cm−3程のままである。さらには、発明者の知る限り、層のエピタキシャル成長のための基板としてのみ用いられるこのようなウェーハにおける自由キャリアの寿命を検出することは決して可能ではなかった。
【0015】
本発明の一つの目的は、高めの純度かつ長い自由キャリアの寿命のウェーハが製造され得る低不純物炭化ケイ素結晶を成長させるための方法を提供することである。
【0016】
引例により開示する特許文献1、2及び3に記述されているように、高めの純度のSiC結晶を成長させるための好ましい方法は、いわゆる高温化学気相成長(HTCVD)法である。この気相技術では、従来のCVD法のようにケイ素及び炭素を含有する原材料が浄化ガスによって供給される。例えば、シラン(SiH4)がケイ素前駆体として使用される一方、メタン(CH4)又はエチレン(C2H4)のような炭化水素は炭素前駆体として使用される。SiC結晶又はブールの成長は、所望の時間の長さの間、1900℃を超える温度まで熱せられたSiC種結晶をソースガスの連続流れに晒すことにより実現する。その後、そこから所望の直径及び厚みのウェーハがスライスされ、研磨される。ヘリウム、アルゴン又は水素のようなキャリアガスが前駆体の輸送を援助するのに用いられる。
【0017】
本発明のためのHTCVD技術の幾つかの利点は、超高純度ガスの原材料としての使用、ケイ素に対する炭素のガス混合の比を最適化する能力、及び所望の量のドーピングソースガスを連続して供給する能力である。例えば、SiC結晶は、少量の窒素ガスをソースガス混合気体に導入することにより僅かにn型に作られる。窒素前駆体の流れ速度が、例えば希釈構成を用いてマスフローコントローラによって制御される。その技術は、いわゆるオンアクシスとオフアクシスの種の両方において単一のポリタイプ結晶を成長させることが可能な1900℃より高い成長温度を用いる。ここで、オンアクシスの種結晶は種として定められ、ここではソースガス混合気体に晒された表面が結晶面、例えば(0001)面と10分の数度以内で平行である。オフアクシスの種結晶は、わざと基準結晶面から2分の1度以上に晒された表面を有する。
【0018】
原子のステップの十分な密度をもたらすために8°までオフされた高不純物基板を用いる従来のCVD法と比べて、HTCVD法は、オンアクシスの又は僅かに間違って方向付けられた(1°以下)種結晶を用いて、種に実質的に低めのステップ密度を有するSiC結晶を成長させることが可能である。軸上のウェーハと少し間違って方向付けされたウェーハの両方ともこのような結晶からスライスされ、研磨される。このようなウェーハをハイパワーデバイスの電圧阻止層として用いることは、電場の異方性効果を減少させる利点がある。
【0019】
本発明は4Hポリタイプの成長、又は炭化ケイ素結晶の結晶格子変異体のために示されるが、その方法は、例えば6H、15R又は3Cのような他のポリタイプの低不純物結晶を成長させるのにも用いられることが明らかである。当該方法は、結晶格子のc軸に沿って、又は近くで成長した結晶のために示される。それは、例えば「数1」や「数2」のようなa軸方向又はSiC結晶格子のc軸とa軸の中間の方向のような他の方向に沿って成長した結晶にも当てはまる。
【0020】
【数1】
【0021】
【数2】
【0022】
好ましい方法が本発明の実現性を示すために記述されるが、いわゆる当業者は同じタイプの結果を実現する一方で、本発明を改良することもできる。特に、本発明を改良することにより改善されるキャリア寿命の実験値は、以下に与えられる例に限られないと解されるべきである。
【0023】
第一の実施形態では、本発明は低不純物SiCウェーハを準備するための新規な方法に関する。ウェーハでは、これらのウェーハに作られた装置を操作することにより又は光励起により注入された自由キャリアがある速度で再結合する。第一の実施形態は、結晶自体又はこの結晶からスライスされたウェーハの後成長熱処理に先行する、決められた低n型又はp型ドーピングを用いたSiC結晶の成長に関する。
【0024】
本発明によれば、n型又はp型ドーピングは窒素のようなドーパントガスの導入と一体化したバックグラウンドドーピングの正確な制御により得られる。それで結晶のドーパント原子濃度は5×1015cm−3より低く、好ましくは1013〜1014cm−3の範囲になる。図3に示されるように、本発明によって成長した4H結晶における窒素濃度は、SIMSのような分析測定の検出限界より低い。このような結晶からスライスされ、研磨されたウェーハは1014cm−3の範囲の正味のキャリア濃度を有するn型の伝導性を示す(図4)。
ホウ素濃度は5×10 14 cm −3 より低く、遷移金属不純物の濃度は5×10 14 cm −3 より低い。また、ホウ素濃度は5×10 13 cm −3 より低く、遷移金属不純物の濃度は10 13 cm −3 より低いと好ましい。結晶は、成長後に所望の時間の間、水素又は水素と不活性ガスの混合気体のいずれかを含む雰囲気において、700℃を超える温度でアニールされる。
【0025】
本発明によれば、低不純物結晶は、HTCVD技術のような純粋な気相法によって100μm/hより高い成長率で成長する。しかしながら、例えば開示する特許文献4に記述されているように、本発明は、純粋なガス前駆体の使用とSi及びCを含有する固体又は液体状態の原材料を結びつける方法により結晶を成長させることによっても実現する。特に、キャリア寿命が光学的に測定されるn型SiCウェーハを得るために、アクセプタ(例えばBとAl)を補償する遷移金属(例えばV、Tiなど)などの不純物の濃度を減少させる必要があることが知られている。これは、成長プロセスの間に意図的な不純物を結晶に放つことを防ぐ材料の選択と、成長プロセスの間に用いられるキャリアと前駆体ガスの両方のための浄化技術の使用を必要とする。特に炭素前駆体がメタンとして選択されるのが好ましい。それは、他の炭化水素より高い純度で製造され、さらにゲッタリングデバイスにより元の位置(インサイチュ)で浄化される。本発明の別な結果は、成長パラメータ及び結晶冷却速度が調節され、それで再結合中心として作用する内因性欠陥の密度が低く保たれ、残りの内因性欠陥がアニール化されることである。例えば、特許文献5の教示を用いて、as-grown結晶がケイ素空格子点を含むように成長条件が調節される。特に、ケイ素空格子点の濃度はこのような結晶のアニール処理によって減少することが分かった。もう一つの選択肢として、成長条件は、例えば炭素空格子点がas-grown結晶に存在するように選択される。
【0026】
先に述べた、引用によりこの明細書に開示した従来技術のHTCVD技術に従う炭化ケイ素単結晶を製造する早期に知られた方法の例として、以下のプロセスステップについて言及する:
−ケイ素及び炭素原子を含むガスの流れをエンクロージャーに導入し、
−種結晶の温度が、種結晶が、熱せられたエンクロージャーに導入されたSi及びCを含む種の分圧下で分解する温度より低いままになるように、種炭化ケイ素結晶を含むエンクロージャーを1900℃を超える温度に熱し、
−バルク結晶が成長するように、十分な時間の間、1900℃を超える温度とケイ素ガス及び炭素ガスの流れとを維持し、
−その成長の時間の間、n型又はp型の結晶を作るためにドーパントの流れを結晶に導入し、
−内因性準位の濃度をドーパントとして作用する浅い不純物の濃度以下に減少させるために、十分ゆっくりした速度で成長温度から室温まで結晶を冷却し、
−メタン、エチレン及びプロパンの群の炭化水素から炭素を含有するガスを選択し、及び
−シラン、クロロシラン化合物及びメチルシラン化合物の群からケイ素を含有するガスを選択する、各ステップ。
【0027】
以下の例は、本発明の低不純物及び寿命の要件を満たすと特定された条件を示す。
【0028】
(実施例1)
4HポリタイプのSiC単結晶が、400μm/hの平均成長速度を有するHTCVD炉で成長した。少量の窒素流れが、低n型ドーピングをもたらすために炉に供給されたシラン、エチレン及びキャリアガス流れに加えられた。ウェーハはこの結晶からスライスされ、研磨され、容量−電圧(C−V)、深部準位時間分解分光(DLTS)、二次イオン質量分析(SIMS)及び時間分解フォトルミネッセンス(TRPL)の技術を用いて解析される。CV及びDLTS測定は、少なくとも一つの深い準位による窒素ドナーの補償のためにこれらのウェーハで実施することは可能でないと確認された。SIMS測定は、3×1015cm−3の濃度のTi混入を明らかにした。一方、B、Al及びVのような他の不純物は、少なくとも1桁低い濃度を有していた。研磨された後又は1時間1600℃でアニールされた後、このようなウェーハに実行されたTRPL測定は、実験のセットアップの検出限界(<5ns)より小さい減衰時間を示した。このようなウェーハを本発明の目的にとって適切でない。
【0029】
(実施例2)
成長システムを変形し、遷移金属のような望ましくない不純物が成長雰囲気に放たれるのを防ぐ構成要素を選択することにより、成長結晶へのTi混入が抑えられた。低不純物n型4HSiC結晶が先の例の条件と比較した条件で成長した。この結晶におけるTi濃度は5×1013cm−3に減少した。しかしながら、この結晶のas-polishedウェーハにおけるDLTS測定は、それぞれ4.5×1015cm−3と3×1015cm−3の濃度を有する伝導帯から約0.66eVと1.5eVに位置する深い準位の存在を示した。同じ基板においてTRPLで測定されたキャリア寿命は5nsより小さかった。その後、ウェーハは水素環境において1600℃で1時間アニールされた。アニール後、as-polishedウェーハにおいてDLTSで確認された深い準位の濃度は極めて減少した(図5)。TRPL測定は、約20nsの光寿命を有する自由キャリアの再結合は水素でアニールされたウェーハで観測されることも示した。この結果は、ウェーハに存在し、効率的な再結合チャネルとして作用する内因性欠陥の水素の種によるアニール又はパッシベーションとして解釈できる。ケイ素空格子点及び炭素空格子点のような内因性欠陥、及び寿命キラーとして作用するケイ素アンチサイトは、例えば半絶縁性SiC結晶において確認されている(特許文献5)。
【0030】
(実施例3)
結晶で成長した内因性欠陥の濃度を減少させるために成長条件を変化させることにより、先の実施例の結果は考慮された。この例では、エチレン/シランガスの混合気体のインプットC/Si比は増加した。図6は、このような結晶からスライスされ、研磨されたウェーハが1.5eVでDLTSにより確認された実質的に低めの深い準位の濃度(しかしZ1/2準位と同等な濃度)を有することを示す。水素又はアルゴン環境で1600℃でアニールすると、深い準位の両方の濃度は先の例(図6)のように減少する。しかしながら、水素を含む環境でアニールされた基板のキャリア寿命は3倍になり、約60nsまで増加した(図7)。しかしながら、同じ結晶から切られ、純粋なアルゴン環境でアニールされた別なウェーハのキャリア寿命は、TRPLシステムの検出限界より低いままである。
【0031】
15kV以上の阻止電圧を有するデバイスの電流密度の要求を満たすために、TRPLで光崩壊により測定される寿命の値を数マイクロ秒の値まで増加させるために、本発明の第一実施形態の教示が使用され、改良されることが理解される。光学的に測定される寿命値がバイポーラ装置から抽出された値と異なることも理解される。しかしながら、本発明は、以下に主張する低不純物SiC結晶における寿命値を増加させる第一の方法を教示する。
【0032】
(デバイスの記述)
参考例として、本発明の実施形態のいずれかに従って製造される低不純物ウェーハを用いたハイパワーバイポーラ装置構造を開示する。
【0033】
本発明は、低不純物ウェーハをドリフト領域として用いて高抵抗基板の問題を解決する。ドリフト領域は同時に装置構造のためのメカニカルサポートとして働く。このようなウェーハは、第一実施形態で記述されるオンアクシスプロセスによって成長する。約150μmを超える厚みのために、材料は別な処理ステップに対して十分な機械的安定度を有する。エミッタは、裏面から、マスクした又はマスクしていない裏面へのイオン注入により実現する(図8及び9)。この注入は、特に適用の要求のために調節されるエミッタ効率及び少数キャリアの寿命を得るために最適化される。さらに、逆阻止装置を得るために、単純なプロセスステップを用いて、ウェーハの裏面で平面接合エッジ終端の実現が可能になる(図2)。ここで公開した開示は、非常に高い阻止電圧を阻止することができる単一のスイッチング装置を作製する機会を提供する。これは、シリコンにおいて、複雑な制御回路を必要とするスイッチング装置の直列接続を使用することによってのみ実現する(例SiC:250〜280μm厚のドリフト領域、ND−NA=3×1014cm−3、20kV阻止電圧)。
【0034】
ここで公開した解決法の最も重要な利点は、縦型パワーデバイスの場合に不要な付加的な抵抗を表す基板なしに半導体構造を作製する可能性である。ウェーハ全体は、非常に高い電圧(15kVより大きい)を阻止することができる低不純物n−ドリフト領域から成る。さらに、逆方向エミッタがウェーハ裏面へのイオン注入を介して慎重に設計される。これは、選択的に付加的なフィールドストップ領域を用いて又は用いずに実現する。裏面エミッタにおいて接合終端エクステンション(JTE)を実現することにより、逆阻止装置が可能になる。別な利点は、少数キャリアの寿命を調節するために逆方向pn接合を局所的に照射する可能性である。SiCウェーハ自体は可視光を通すので、前面の制御セルに対するウェーハ裏面における構造の調節は、リソグラフィー用のラージギャップの対物レンズを用いて容易に実行される。従って、調節は前面の位置合わせマークに対して実行される。さらに、HTCVDプロセスはオンアクシス成長を実行する可能性をもたらす。ゆえに、例えば電気破壊フィールドの異方性による否定的な影響は最小化され又は排除される。
【0035】
(例)
限定的な例ではない。図9がアクティブなデバイス層として低不純物n−基板を用いた仮定の新しいIGBT構造の断面を示す。
【0036】
N−ウェーハは装置の所望な阻止電圧に従ってドープ処理されなければならない。層の最小の厚みは薄いウェーハを扱う技術の能力によって与えられる。技術プロセスの状態を考慮すると、この限界は150μmぐらいに見出される。しかしながら、別な発展型はこの厚みをより低い値にシフトさせることができる。pウエルベース領域_5がドリフト領域に注入され、選択的なエピタキシャル成長により拡散又は創出される。この層の深さは用いられる技術に依存して数ナノメートル〜数マイクロメートルになる。ドーピングは1×1016cm−3から1020cm−3より高い値にまでなる。典型的には、それは数1018cm−3〜1019cm−3の範囲にある。pウエルの間の隙間は数μm〜100μmの範囲にある。N−ウェーハの表面及びpウエルの内部にn型ソース領域が位置している。ソース領域と表面のpウエルの端との距離が装置のチャネルの長さを定める。これは1μm〜100μmの間であり、パワーデバイスでは典型的には2〜4μm程の値である。ソース領域は、p領域に対して用いられるより高いドーピングによって(典型的には1019cm−3より大きい)、n型伝導性の領域で形成される。デバイスの周囲では、JTE(特許文献6)が実行される。ソース領域に多少重なり、pウエルの間の間隔に完全に重なったチャネル領域の上に、ゲート酸化膜が位置する。ゲート酸化膜として、全て一般的な二酸化ケイ素、窒化ケイ素又は他の新しい誘電体のような薄いフィルム絶縁体が用いられる。熱で成長した又は析出した約80nm厚の二酸化ケイ素層が、パワーデバイスにとって典型的である。ゲート材料として、金属、金属ケイ化物又はポリシリコンのような高伝導材料が用いられる。このゲートは、広範囲の前面のエミッタコンタクトから電気的に絶縁している。このコンタクト層は普通、厚いアルミニウム又は別な金属によって形成される。pウエル(酸化物、ゲート電極)の上の層は制御領域として作用する。その構造の裏面には、コレクタコンタクト領域がある。このコレクタコンタクトはアクティブ領域(pウエル)と反対側の全領域にわたって位置するか、低不純物ウェーハとのオーミックコンタクトを有する小さい領域によって間隔をあけられる。コレクタ領域(裏面エミッタ)は低不純物ウェーハと反対の伝導性を有し、そのドーピングはウェーハのドーピングを超える。典型的な値は、1017cm−3〜1019cm−3である。この層の深さと形成に対して、pウエルのルールが当てはまる。順方向の注入を維持する一方で阻止の場合に十分な遮断効果を保障するために、幅と間隔は数μm程度の範囲で選択される。逆阻止のために、前面のJTEに対応するJTEが実行される。裏面の層は透明なSiCウェーハのために前面の構造に位置合わせがなされる。これは、シリコンの解決法に比べて重要な利点である。さらに、ウェーハ全体が装置のアクティブ領域として働くという事実のため、裏面構造は表面での直接の選択されたドーピングにより形成される。
【図面の簡単な説明】
【0037】
【図1】実質的なキャリア寿命を有する厚い低不純物ドリフト層が、高不純物p型SiC基板でエピタキシャル成長する従来技術の典型的なIGBTSiC基板の横断面図である。
【図2】N−SiCウェーハが実質的なキャリア寿命を有するドリフト領域を構成する裏面において選択的にインプラントエミッタと接合終端エクステンションを有する新しい高電圧IGBTの横断面図である。
【図3】窒素濃度が測定の検出限界より低いことを示す、低不純物(N−)4HSiCウェーハの窒素濃度のSIMSプロファイルである。
【図4】上部が、n型伝導性を示す意図して作られた低不純物(N−)4HSiC基板におけるショットキーダイオード接触を用いる電流−電圧測定を示し、下部が、容量−電圧によって測定された正味のキャリア濃度が4×1014cm−3の平均値を生じることを示す。
【図5】水素環境でアニールする前及び後の低n型不純物4HSiCウェーハで測定されたDLTSスペクトルである。
【図6】水素環境でアニールした後のZ1/2中心の濃度の減少を示す本発明で記述されるような変更した条件下で成長した低不純物4HSiCウェーハで測定されたDLTSスペクトルである。
【図7】アニール前、アルゴン環境におけるアニール後及び水素環境におけるアニール後の、図6のウェーハで測定された室温での時間分解光ルミネセンスの減衰曲線を示す図である。
【図8】N−SiCウェーハが実質的なキャリア寿命を有するドリフト領域を構成するフィールドストップ層とインプラントされたエミッタを有する新しい高電圧IGBTの横断面図である。
【図9】N−SiCウェーハが実質的なキャリア寿命を有するドリフト領域を構成するインプラントエミッタ、接合終端エクステンション及びアノード短絡回路を有する新しい高電圧IGBTの横断面図である。
Claims (9)
- n型又はp型の伝導性を有する一様な炭化ケイ素単結晶からウェーハを作るための方法にして、
−炭化ケイ素単結晶を成長させ、ここで、結晶は5×1014cm−3より低いホウ素濃度、5×1014cm−3より低い遷移金属不純物の濃度を有し、結晶中の内因性欠陥が最小化され、内因性欠陥はケイ素空格子点又は炭素空格子点を有し、
−所望の時間の間、水素又は水素と不活性ガスの混合気体のいずれかを含む雰囲気において、700℃を超える温度で結晶をアニールし、それで、内因性欠陥及び関連する欠陥の密度が、室温において少なくとも50nsの所望のキャリア寿命を結晶に与えるのに十分低い濃度にまで減少し、
−結晶からウェーハをスライスする、各ステップを有する方法。 - 結晶からウェーハをスライスするステップは結晶をアニールするステップの前に行われ、さらに、結晶をアニールするステップの前に、ウェーハを研磨するステップを有する請求項1に記載の方法。
- さらに、結晶からウェーハをスライスするステップの後に、ウェーハを研磨するステップを有する請求項1に記載の方法。
- 請求項1に記載の炭化ケイ素の単結晶を成長させるための方法において、
−ケイ素及び炭素原子を含むガスの流れをエンクロージャーに導入し、
−種結晶の温度が、種結晶が、熱せられたエンクロージャーに導入されたSi及びCを含む種の分圧下で分解する温度より低いままになるように、種炭化ケイ素結晶を含むエンクロージャーを1900℃を超える温度に熱し、
−バルク結晶が成長するように、十分な時間の間、1900℃を超える温度とケイ素ガス及び炭素ガスの流れとを維持し、及び
−その成長の時間の間、n型又はp型の結晶を作るためにドーパントの流れを結晶に導入する
各ステップをさらに有する方法。 - 内因性準位の濃度をドーパントとして作用する浅い不純物の濃度以下に減少させるために、結晶が成長温度から室温まで冷却されることを特徴とする請求項4に記載の方法。
- 炭素を含むガスが、メタン、エチレン及びプロパンの群から選択された炭化水素であることを特徴とする請求項4に記載の方法。
- ケイ素を含むガスが、シラン、クロロシラン化合物及びメチルシラン化合物の群から選択されることを特徴とする請求項4に記載の方法。
- 結晶は5×10 13 cm −3 より低いホウ素濃度を有することを特徴とする請求項1に記載の方法。
- 結晶は10 13 cm −3 より低い遷移金属不純物の濃度を有することを特徴とする請求項1に記載の方法。
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| SE0202585A SE525574C2 (sv) | 2002-08-30 | 2002-08-30 | Lågdopat kiselkarbidsubstrat och användning därav i högspänningskomponenter |
| SE0202585-6 | 2002-08-30 | ||
| PCT/SE2003/001309 WO2004020706A1 (en) | 2002-08-30 | 2003-08-22 | Lightly doped silicon carbide wafer and use thereof in high power devices |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2011274530A Division JP2012099832A (ja) | 2002-08-30 | 2011-12-15 | 半導体装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2005537657A JP2005537657A (ja) | 2005-12-08 |
| JP5081373B2 true JP5081373B2 (ja) | 2012-11-28 |
Family
ID=20288862
Family Applications (3)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2004532493A Expired - Fee Related JP5081373B2 (ja) | 2002-08-30 | 2003-08-22 | 低不純物炭化ケイ素ウェーハの作製方法 |
| JP2011274530A Pending JP2012099832A (ja) | 2002-08-30 | 2011-12-15 | 半導体装置 |
| JP2015006669A Pending JP2015099932A (ja) | 2002-08-30 | 2015-01-16 | 半導体装置 |
Family Applications After (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2011274530A Pending JP2012099832A (ja) | 2002-08-30 | 2011-12-15 | 半導体装置 |
| JP2015006669A Pending JP2015099932A (ja) | 2002-08-30 | 2015-01-16 | 半導体装置 |
Country Status (5)
| Country | Link |
|---|---|
| US (3) | US7482068B2 (ja) |
| EP (1) | EP1540050A1 (ja) |
| JP (3) | JP5081373B2 (ja) |
| SE (1) | SE525574C2 (ja) |
| WO (1) | WO2004020706A1 (ja) |
Families Citing this family (50)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| SE525574C2 (sv) * | 2002-08-30 | 2005-03-15 | Okmetic Oyj | Lågdopat kiselkarbidsubstrat och användning därav i högspänningskomponenter |
| DE10330571B8 (de) * | 2003-07-07 | 2007-03-08 | Infineon Technologies Ag | Vertikale Leistungshalbleiterbauelemente mit Injektionsdämpfungsmittel im Rand bereich und Herstellungsverfahren dafür |
| US7157785B2 (en) * | 2003-08-29 | 2007-01-02 | Fuji Electric Device Technology Co., Ltd. | Semiconductor device, the method of manufacturing the same, and two-way switching device using the semiconductor devices |
| US6974720B2 (en) * | 2003-10-16 | 2005-12-13 | Cree, Inc. | Methods of forming power semiconductor devices using boule-grown silicon carbide drift layers and power semiconductor devices formed thereby |
| DE102004047313B3 (de) * | 2004-09-29 | 2006-03-30 | Siced Electronics Development Gmbh & Co. Kg | Halbleiteranordnung mit einem Tunnelkontakt und Verfahren zu deren Herstellung |
| US7811943B2 (en) * | 2004-12-22 | 2010-10-12 | Cree, Inc. | Process for producing silicon carbide crystals having increased minority carrier lifetimes |
| US7414268B2 (en) * | 2005-05-18 | 2008-08-19 | Cree, Inc. | High voltage silicon carbide MOS-bipolar devices having bi-directional blocking capabilities |
| US7615801B2 (en) * | 2005-05-18 | 2009-11-10 | Cree, Inc. | High voltage silicon carbide devices having bi-directional blocking capabilities |
| DE102005053487B4 (de) * | 2005-11-09 | 2011-06-09 | Infineon Technologies Ag | Leistungs-IGBT mit erhöhter Robustheit |
| US20090087967A1 (en) * | 2005-11-14 | 2009-04-02 | Todd Michael A | Precursors and processes for low temperature selective epitaxial growth |
| US7728402B2 (en) | 2006-08-01 | 2010-06-01 | Cree, Inc. | Semiconductor devices including schottky diodes with controlled breakdown |
| US8432012B2 (en) | 2006-08-01 | 2013-04-30 | Cree, Inc. | Semiconductor devices including schottky diodes having overlapping doped regions and methods of fabricating same |
| US8710510B2 (en) | 2006-08-17 | 2014-04-29 | Cree, Inc. | High power insulated gate bipolar transistors |
| JP4946264B2 (ja) * | 2006-08-23 | 2012-06-06 | 日立金属株式会社 | 炭化珪素半導体エピタキシャル基板の製造方法 |
| JP5261907B2 (ja) * | 2006-09-19 | 2013-08-14 | 富士電機株式会社 | トレンチゲート型炭化珪素半導体装置 |
| US8835987B2 (en) | 2007-02-27 | 2014-09-16 | Cree, Inc. | Insulated gate bipolar transistors including current suppressing layers |
| US8866150B2 (en) | 2007-05-31 | 2014-10-21 | Cree, Inc. | Silicon carbide power devices including P-type epitaxial layers and direct ohmic contacts |
| US8409351B2 (en) * | 2007-08-08 | 2013-04-02 | Sic Systems, Inc. | Production of bulk silicon carbide with hot-filament chemical vapor deposition |
| DE102007052202B3 (de) * | 2007-10-30 | 2008-11-13 | Infineon Technologies Austria Ag | Halbleiterbauelement und Verfahren zur Herstellung desselben |
| US7759213B2 (en) * | 2008-08-11 | 2010-07-20 | International Business Machines Corporation | Pattern independent Si:C selective epitaxy |
| US8294507B2 (en) | 2009-05-08 | 2012-10-23 | Cree, Inc. | Wide bandgap bipolar turn-off thyristor having non-negative temperature coefficient and related control circuits |
| US8629509B2 (en) | 2009-06-02 | 2014-01-14 | Cree, Inc. | High voltage insulated gate bipolar transistors with minority carrier diverter |
| US8193848B2 (en) | 2009-06-02 | 2012-06-05 | Cree, Inc. | Power switching devices having controllable surge current capabilities |
| US8541787B2 (en) | 2009-07-15 | 2013-09-24 | Cree, Inc. | High breakdown voltage wide band-gap MOS-gated bipolar junction transistors with avalanche capability |
| US8354690B2 (en) | 2009-08-31 | 2013-01-15 | Cree, Inc. | Solid-state pinch off thyristor circuits |
| US8574528B2 (en) | 2009-09-04 | 2013-11-05 | University Of South Carolina | Methods of growing a silicon carbide epitaxial layer on a substrate to increase and control carrier lifetime |
| US9117739B2 (en) | 2010-03-08 | 2015-08-25 | Cree, Inc. | Semiconductor devices with heterojunction barrier regions and methods of fabricating same |
| US8415671B2 (en) | 2010-04-16 | 2013-04-09 | Cree, Inc. | Wide band-gap MOSFETs having a heterojunction under gate trenches thereof and related methods of forming such devices |
| CN102560671B (zh) * | 2010-12-31 | 2015-05-27 | 中国科学院物理研究所 | 半绝缘碳化硅单晶 |
| US9029945B2 (en) | 2011-05-06 | 2015-05-12 | Cree, Inc. | Field effect transistor devices with low source resistance |
| US9142662B2 (en) | 2011-05-06 | 2015-09-22 | Cree, Inc. | Field effect transistor devices with low source resistance |
| JP2013004572A (ja) * | 2011-06-13 | 2013-01-07 | Mitsubishi Electric Corp | 半導体装置の製造方法 |
| US9640617B2 (en) | 2011-09-11 | 2017-05-02 | Cree, Inc. | High performance power module |
| WO2013036370A1 (en) | 2011-09-11 | 2013-03-14 | Cree, Inc. | High current density power module comprising transistors with improved layout |
| US9373617B2 (en) | 2011-09-11 | 2016-06-21 | Cree, Inc. | High current, low switching loss SiC power module |
| JP6017127B2 (ja) * | 2011-09-30 | 2016-10-26 | 株式会社東芝 | 炭化珪素半導体装置 |
| WO2013119548A1 (en) | 2012-02-06 | 2013-08-15 | Cree, Inc. | Sic devices with high blocking voltage terminated by a negative bevel |
| KR101799258B1 (ko) | 2012-10-02 | 2017-11-20 | 미쓰비시덴키 가부시키가이샤 | 반도체장치 및 반도체장치의 제조방법 |
| US11721547B2 (en) * | 2013-03-14 | 2023-08-08 | Infineon Technologies Ag | Method for manufacturing a silicon carbide substrate for an electrical silicon carbide device, a silicon carbide substrate and an electrical silicon carbide device |
| JP6183080B2 (ja) * | 2013-09-09 | 2017-08-23 | 住友電気工業株式会社 | 炭化珪素半導体装置およびその製造方法 |
| JP6271309B2 (ja) * | 2014-03-19 | 2018-01-31 | 株式会社東芝 | 半導体基板の製造方法、半導体基板および半導体装置 |
| CN114823859A (zh) | 2015-12-11 | 2022-07-29 | 罗姆股份有限公司 | 半导体装置 |
| DE112017004153T5 (de) | 2016-08-19 | 2019-05-02 | Rohm Co., Ltd. | Halbleitervorrichtung |
| JP6811118B2 (ja) * | 2017-02-27 | 2021-01-13 | 株式会社豊田中央研究所 | Mosfet |
| JP2017228790A (ja) * | 2017-08-30 | 2017-12-28 | 良孝 菅原 | 半導体装置とその動作方法 |
| US11094806B2 (en) * | 2017-12-29 | 2021-08-17 | Texas Instruments Incorporated | Fabricating transistors with implanting dopants at first and second dosages in the collector region to form the base region |
| JP2020129675A (ja) * | 2020-04-21 | 2020-08-27 | ローム株式会社 | 半導体装置 |
| TWI865578B (zh) * | 2020-06-18 | 2024-12-11 | 盛新材料科技股份有限公司 | 半絕緣單晶碳化矽塊材以及粉末 |
| JP7285890B2 (ja) * | 2021-08-04 | 2023-06-02 | 株式会社レゾナック | SiCエピタキシャルウェハ及びSiCエピタキシャルウェハの製造方法 |
| EP4411030A4 (en) * | 2021-09-30 | 2025-10-08 | Central Glass Co Ltd | SILICON CARBIDE MONOCRYSTALLINE WAFER AND SILICON CARBIDE MONOCRYSTALLINE INGOT |
Family Cites Families (37)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5043773A (en) * | 1990-06-04 | 1991-08-27 | Advanced Technology Materials, Inc. | Wafer base for silicon carbide semiconductor devices, incorporating alloy substrates |
| US5709745A (en) * | 1993-01-25 | 1998-01-20 | Ohio Aerospace Institute | Compound semi-conductors and controlled doping thereof |
| CA2113336C (en) * | 1993-01-25 | 2001-10-23 | David J. Larkin | Compound semi-conductors and controlled doping thereof |
| JP3182262B2 (ja) * | 1993-07-12 | 2001-07-03 | 株式会社東芝 | 半導体装置 |
| DE4325804C3 (de) * | 1993-07-31 | 2001-08-09 | Daimler Chrysler Ag | Verfahren zum Herstellen von hochohmigem Siliziumkarbid |
| JP3352840B2 (ja) * | 1994-03-14 | 2002-12-03 | 株式会社東芝 | 逆並列接続型双方向性半導体スイッチ |
| TW286435B (ja) | 1994-07-27 | 1996-09-21 | Siemens Ag | |
| US5736430A (en) * | 1995-06-07 | 1998-04-07 | Ssi Technologies, Inc. | Transducer having a silicon diaphragm and method for forming same |
| SE9502288D0 (sv) | 1995-06-26 | 1995-06-26 | Abb Research Ltd | A device and a method for epitaxially growing objects by CVD |
| US6030661A (en) | 1995-08-04 | 2000-02-29 | Abb Research Ltd. | Device and a method for epitaxially growing objects by CVD |
| US6573534B1 (en) * | 1995-09-06 | 2003-06-03 | Denso Corporation | Silicon carbide semiconductor device |
| SE9503428D0 (sv) | 1995-10-04 | 1995-10-04 | Abb Research Ltd | A method for epitaxially growing objects and a device for such a growth |
| US6039812A (en) | 1996-10-21 | 2000-03-21 | Abb Research Ltd. | Device for epitaxially growing objects and method for such a growth |
| ATE287127T1 (de) | 1997-02-07 | 2005-01-15 | James Albert Cooper Jr | Struktur zur erhöhung der maximalen spannung von siliziumkarbid-leistungstransistoren |
| US6180958B1 (en) * | 1997-02-07 | 2001-01-30 | James Albert Cooper, Jr. | Structure for increasing the maximum voltage of silicon carbide power transistors |
| JPH10256529A (ja) * | 1997-03-14 | 1998-09-25 | Fuji Electric Co Ltd | 絶縁ゲート型炭化ケイ素サイリスタ |
| JPH11162850A (ja) * | 1997-08-27 | 1999-06-18 | Matsushita Electric Ind Co Ltd | 炭化珪素基板およびその製造方法、並びに炭化珪素基板を用いた半導体素子 |
| JP3968860B2 (ja) * | 1998-03-20 | 2007-08-29 | 株式会社デンソー | 炭化珪素半導体装置の製造方法 |
| US6100169A (en) * | 1998-06-08 | 2000-08-08 | Cree, Inc. | Methods of fabricating silicon carbide power devices by controlled annealing |
| JP2000101066A (ja) * | 1998-09-25 | 2000-04-07 | Toshiba Corp | 電力用半導体素子 |
| JP2000216090A (ja) * | 1999-01-27 | 2000-08-04 | Toshiba Corp | 多結晶半導体素子の製造方法 |
| US6218680B1 (en) * | 1999-05-18 | 2001-04-17 | Cree, Inc. | Semi-insulating silicon carbide without vanadium domination |
| US6329088B1 (en) * | 1999-06-24 | 2001-12-11 | Advanced Technology Materials, Inc. | Silicon carbide epitaxial layers grown on substrates offcut towards <1{overscore (1)}00> |
| DE60033829T2 (de) | 1999-09-07 | 2007-10-11 | Sixon Inc. | SiC-HALBLEITERSCHEIBE, SiC-HALBLEITERBAUELEMENT SOWIE HERSTELLUNGSVERFAHREN FÜR EINE SiC-HALBLEITERSCHEIBE |
| JP4581179B2 (ja) * | 2000-04-26 | 2010-11-17 | 富士電機システムズ株式会社 | 絶縁ゲート型半導体装置 |
| JP3650727B2 (ja) | 2000-08-10 | 2005-05-25 | Hoya株式会社 | 炭化珪素製造方法 |
| JP4887559B2 (ja) * | 2000-11-07 | 2012-02-29 | 富士電機株式会社 | 半導体装置の製造方法 |
| JP3864696B2 (ja) * | 2000-11-10 | 2007-01-10 | 株式会社デンソー | 炭化珪素単結晶の製造方法及び製造装置 |
| JP2002231944A (ja) * | 2001-01-31 | 2002-08-16 | Sanken Electric Co Ltd | 電力用半導体装置 |
| JP3451247B2 (ja) * | 2001-02-07 | 2003-09-29 | 株式会社日立製作所 | 半導体装置およびその製法 |
| AU2002237483A1 (en) | 2001-03-23 | 2002-10-08 | International Business Machines Corporation | Apparatus and method for storing and reading high data capacities |
| EP1306890A2 (en) * | 2001-10-25 | 2003-05-02 | Matsushita Electric Industrial Co., Ltd. | Semiconductor substrate and device comprising SiC and method for fabricating the same |
| SE520968C2 (sv) * | 2001-10-29 | 2003-09-16 | Okmetic Oyj | Högresistiv monokristallin kiselkarbid och metod för dess framställning |
| FR2834123B1 (fr) * | 2001-12-21 | 2005-02-04 | Soitec Silicon On Insulator | Procede de report de couches minces semi-conductrices et procede d'obtention d'une plaquette donneuse pour un tel procede de report |
| US6814801B2 (en) * | 2002-06-24 | 2004-11-09 | Cree, Inc. | Method for producing semi-insulating resistivity in high purity silicon carbide crystals |
| SE525574C2 (sv) * | 2002-08-30 | 2005-03-15 | Okmetic Oyj | Lågdopat kiselkarbidsubstrat och användning därav i högspänningskomponenter |
| US6964917B2 (en) * | 2003-04-08 | 2005-11-15 | Cree, Inc. | Semi-insulating silicon carbide produced by Neutron transmutation doping |
-
2002
- 2002-08-30 SE SE0202585A patent/SE525574C2/sv not_active IP Right Cessation
-
2003
- 2003-08-22 JP JP2004532493A patent/JP5081373B2/ja not_active Expired - Fee Related
- 2003-08-22 US US10/526,059 patent/US7482068B2/en not_active Expired - Lifetime
- 2003-08-22 EP EP03791515A patent/EP1540050A1/en not_active Ceased
- 2003-08-22 WO PCT/SE2003/001309 patent/WO2004020706A1/en not_active Ceased
-
2009
- 2009-01-13 US US12/352,793 patent/US8097524B2/en not_active Expired - Lifetime
-
2011
- 2011-12-15 JP JP2011274530A patent/JP2012099832A/ja active Pending
- 2011-12-29 US US13/340,192 patent/US8803160B2/en not_active Expired - Fee Related
-
2015
- 2015-01-16 JP JP2015006669A patent/JP2015099932A/ja active Pending
Also Published As
| Publication number | Publication date |
|---|---|
| US8803160B2 (en) | 2014-08-12 |
| US8097524B2 (en) | 2012-01-17 |
| WO2004020706A1 (en) | 2004-03-11 |
| JP2012099832A (ja) | 2012-05-24 |
| US7482068B2 (en) | 2009-01-27 |
| US20060137600A1 (en) | 2006-06-29 |
| JP2005537657A (ja) | 2005-12-08 |
| EP1540050A1 (en) | 2005-06-15 |
| SE0202585L (sv) | 2004-03-01 |
| US20120091471A1 (en) | 2012-04-19 |
| US20090114924A1 (en) | 2009-05-07 |
| SE0202585D0 (sv) | 2002-08-30 |
| SE525574C2 (sv) | 2005-03-15 |
| JP2015099932A (ja) | 2015-05-28 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP5081373B2 (ja) | 低不純物炭化ケイ素ウェーハの作製方法 | |
| JP3854508B2 (ja) | SiCウエハ、SiC半導体デバイス、およびSiCウエハの製造方法 | |
| JP4185215B2 (ja) | SiCウエハ、SiC半導体デバイス、および、SiCウエハの製造方法 | |
| US5709745A (en) | Compound semi-conductors and controlled doping thereof | |
| Davis et al. | Thin film deposition and microelectronic and optoelectronic device fabrication and characterization in monocrystalline alpha and beta silicon carbide | |
| Liu et al. | Low temperature chemical vapor deposition growth of β-SiC on (100) Si using methylsilane and device characteristics | |
| US5463978A (en) | Compound semiconductor and controlled doping thereof | |
| JP3650727B2 (ja) | 炭化珪素製造方法 | |
| KR100853991B1 (ko) | 바이폴라형 반도체 장치 및 그의 제조방법 | |
| US8536582B2 (en) | Stable power devices on low-angle off-cut silicon carbide crystals | |
| US4912063A (en) | Growth of beta-sic thin films and semiconductor devices fabricated thereon | |
| US20110006310A1 (en) | Semiconductor device and semiconductor device manufacturing method | |
| CN101084330A (zh) | 低微管100mm碳化硅晶片 | |
| KR20160070743A (ko) | n형 질화알루미늄 단결정 기판 및 수직형 질화물 반도체 디바이스 | |
| Davis | Epitaxial growth and doping of and device development in monocyrstalline β-SiC semiconductor thin films | |
| US9590047B2 (en) | SiC bipolar junction transistor with reduced carrier lifetime in collector and a defect termination layer | |
| JP2007131504A (ja) | SiCエピタキシャルウエーハおよびそれを用いた半導体デバイス | |
| US20040217457A1 (en) | System and method for fabricating diodes | |
| RU2297690C1 (ru) | Способ изготовления полупроводниковой гетероструктуры на основе соединений a3b5 методом жидкофазной эпитаксии | |
| Kong et al. | Growth, doping, device development and characterization of CVD beta-SiC epilayers on Si (100) and alpha-SiC (0001) | |
| JP2000223719A (ja) | 半導体装置 | |
| JP2007027630A (ja) | バイポーラ型半導体装置およびその製造方法 | |
| Bhat | Epitaxial Growth of Silicon Carbide by Chemical Vapor Deposition | |
| Chen | Epitaxial growth of 4H-silicon carbide by CVD for bipolar power device applications | |
| WO2008015765A1 (en) | Bipolar semiconductor device and process for producing the same |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20060705 |
|
| A711 | Notification of change in applicant |
Free format text: JAPANESE INTERMEDIATE CODE: A711 Effective date: 20061226 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A821 Effective date: 20061226 |
|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20091116 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20100831 |
|
| A601 | Written request for extension of time |
Free format text: JAPANESE INTERMEDIATE CODE: A601 Effective date: 20101129 |
|
| A602 | Written permission of extension of time |
Free format text: JAPANESE INTERMEDIATE CODE: A602 Effective date: 20101206 |
|
| A601 | Written request for extension of time |
Free format text: JAPANESE INTERMEDIATE CODE: A601 Effective date: 20101228 |
|
| A602 | Written permission of extension of time |
Free format text: JAPANESE INTERMEDIATE CODE: A602 Effective date: 20110111 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20110128 |
|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20110816 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20111215 |
|
| A911 | Transfer to examiner for re-examination before appeal (zenchi) |
Free format text: JAPANESE INTERMEDIATE CODE: A911 Effective date: 20120216 |
|
| A711 | Notification of change in applicant |
Free format text: JAPANESE INTERMEDIATE CODE: A711 Effective date: 20120222 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A821 Effective date: 20120222 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20120410 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20120706 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20120821 |
|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20120903 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20150907 Year of fee payment: 3 |
|
| R150 | Certificate of patent or registration of utility model |
Ref document number: 5081373 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20120706 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| LAPS | Cancellation because of no payment of annual fees |