JP5928481B2 - 複合基板 - Google Patents
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Description
〔1〕
窒化珪素からなり熱伝導率が5W/m・K以上、かつ体積抵抗率が1×108Ω・cm以上の無機絶縁性焼結体基板と、単結晶シリコン膜と、前記無機絶縁性焼結体基板と前記単結晶シリコン膜の間に単独で介在し、該無機絶縁性焼結体基板の全体を覆っている窒化珪素からなる化学気相成長膜とを備え、該窒化珪素からなる化学気相成長膜は、当該複合基板を用いた半導体デバイス製造プロセスにおいて前記無機絶縁性焼結体基板中に含まれるAl及び/又はFeの溶出又は拡散を防止する薄膜であることを特徴とする複合基板。
〔2〕
前記窒化珪素からなる化学気相成長膜中におけるAlの濃度が1×1017atoms/cm3以下であり、Feの濃度が1×1017atoms/cm3以下であることを特徴とする〔1〕記載の複合基板。
〔3〕
前記複合基板の少なくとも裏面に多結晶又はアモルファスのシリコン層が設けられていることを特徴とする〔1〕又は〔2〕記載の複合基板。
その中でも、デバイス製造プロセス中に使用される薬液耐性が高いこと、また基板コストが安いことより、窒化珪素が最も好ましい。
この場合、基板中の不純物濃度をICP−MS法で評価した場合、Feが1×1017atoms/cm3以下、Alが1×1017atoms/cm3以下の場合は、基板表面に直接単結晶半導体膜を形成することができるが、Feが上記濃度を超え1×1020atoms/cm3以下、Alが上記濃度を超え1×1020atoms/cm3以下の場合は、これらの不純物の溶出を防止するため、基板全体を酸化物、窒化物あるいは酸窒化物の薄膜で覆うことが好ましい。もちろん、Feが1×1017atoms/cm3以下、Alが1×1017atoms/cm3以下の場合も、上記薄膜を形成することは推奨される。上記薄膜を介して、素子を形成する単結晶半導体膜、具体的には単結晶シリコン膜を設けることにより、所望の複合基板を得ることができる。なお、上記薄膜は基板全体を覆って形成することが好ましい。
また、上記基板表面に直接又は上記薄膜を介して形成される単結晶半導体膜としては、単結晶シリコン膜とすることができ、通常0.01〜100μm、特に0.05〜1μmの厚さに形成することが好ましい。この場合、単結晶半導体の形成方法としては、スマートカット法のような水素や希ガスイオンをインプラした基板を貼り合わせたのち、インプラした層から剥離して転写する方法、SiやSOIなどの半導体層を接合したのち、機械的及び/又は化学的手段で薄化する方法などが挙げられる。
本発明の実施形態を図1に示す。焼結体基板として外径200mm、厚さ725μmのSi3N4焼結体11を作製した。この基板の体積抵抗率を4探針法で測定したところ、1×1014Ω・cmであった。また熱伝導率をレーザーフラッシュ法で測定したところ、15W/m・Kであった。なお、この基板と同じ体積抵抗率及び熱伝導率である基板Si3N4焼結体基板を作製した。この基板をHF水溶液に溶解し、ICP−MS法で金属不純物濃度を評価したところ、Feが1×1019atoms/cm3、Alが5×1018atoms/cm3であった。
この基板全面に窒化珪素膜12をLP−CVD法で1μm形成した。形成した窒化珪素膜の体積抵抗率及び熱伝導率を評価したところ、1×1014Ω・cm、13W/m・Kであり、焼結体とほぼ同じ物性であった。また、膜中に含まれる金属不純物濃度は、膜をHF水溶液に溶解し、ICP−MS法で分析することにより行った。その結果、膜中の金属不純物はFeが最も多く、1×1015atoms/cm3であった。次に多い金属不純物はAlであり、その濃度は1×1014atoms/cm3であった。その他の金属不純物は検出限界以下であり、デバイス製造プロセスで問題の無い濃度であった。
その基板の一方の面に厚さ0.3μmの単結晶シリコン薄膜13を貼り合わせることによって、熱伝導率が高く安価な焼結体基板を用いて、金属汚染の懸念が少ない複合基板を作製することができた。
上記で作製した基板の裏面に、LP−CVD法を用いて厚さ1μmのアモルファスシリコン薄膜14を成膜した。アモルファスシリコン表面の金属不純物濃度を、ICP−MS法で測定したが、検出限界以下であり、裏面への金属汚染は見られなかった。
焼結体基板として、実施例1と同様のSi3N4焼結体を準備した。
この基板全面にSiO2膜をLP−CVD法で1μm形成した。形成したSiO2膜の体積抵抗率及び熱伝導率を評価したところ、1×1014Ω・cm、1.5W/m・Kであった。また、膜中に含まれる金属不純物濃度は、実施例1と同様な手順で評価したところ、Fe及びAl共に1×1014atoms/cm3であった。その他の金属不純物は検出限界以下であり、デバイス製造には問題の無い濃度であった。
実施例1と同様に、基板の片面に厚さ0.3μmの単結晶シリコン薄膜を貼り合わせることによって、熱伝導率が高い絶縁性基板を用い、金属汚染の懸念の無い複合基板を作製することができた。
上記で作製した基板の裏面に、LP−CVD法を用いて厚さ1μmのポリシリコン薄膜を成膜した。ポリシリコン表面の金属不純物濃度を、ICP−MS法で測定したが、検出限界以下であり、裏面への金属汚染は見られなかった。
焼結体基板として、外径200mm、厚さ725μmのAlN焼結体を作製した。この基板の体積抵抗率を4端針法で測定したところ、1×1013Ω・cmであった。またレーザーフラッシュ法で測定した熱伝導率は160W/m・Kであった。実施例1と同様に、基板中の金属不純物濃度を評価したところ、Feが5×1019atoms/cm3、Alが1×1019atoms/cm3であった。
この基板全面に、実施例1と同様に、窒化珪素薄膜をLP−CVD法で1μm形成した。形成した膜の体積抵抗率、熱伝導率及び金属不純物濃度は実施例1と同等であった。
実施例1と同様に、基板の片面に厚さ0.3μmの単結晶シリコン薄膜を貼り合わせることによって、熱伝導率が高い絶縁性基板を用い、金属汚染の懸念の無い複合基板を作製することができた。
上記で作製した基板の裏面に、LP−CVD法を用いて厚さ1μmのアモルファスシリコン薄膜を成膜した。アモルファスシリコン表面の金属不純物濃度を、ICP−MS法で測定したが、検出限界以下であり、裏面への金属汚染は見られなかった。
焼結体基板として、外径200mm、厚さ725μmのSIALON(Si3N4・Al2O3)焼結体を作製した。この基板の体積抵抗率を4端針法で測定したところ、1×1014Ω・cmであった。またレーザーフラッシュ法で測定した熱伝導率は45W/m・Kであった。実施例1と同様に、基板中の金属不純物濃度を評価したところ、Feが2×1019atoms/cm3、Alが1×1020atoms/cm3であった。
この基板全面に、実施例1と同様に、窒化珪素薄膜をLP−CVD法で2μm形成した。形成した膜の体積抵抗率、熱伝導率及び金属不純物濃度は実施例1と同等であった。
実施例1と同様に、基板の片面に厚さ0.3μmの単結晶シリコン薄膜を貼り合わせることによって、熱伝導率が高い絶縁性基板を用い、金属汚染の懸念の無い複合基板を作製することができた。
上記で作製した基板の裏面に、LP−CVD法を用いて厚さ1μmのアモルファスシリコン薄膜を成膜した。アモルファスシリコン表面の金属不純物濃度を、ICP−MS法で測定したが、検出限界以下であり、裏面への金属汚染は見られなかった。
実施例1と同じ体積抵抗率及び熱伝導率である基板Si3N4焼結体基板を作製した。この基板をHF水溶液に溶解し、ICP−MS法で金属不純物濃度を評価したところ、Feが1×1019atoms/cm3、Alが5×1018atoms/cm3であり、実施例1の窒化珪素膜中の濃度に比べ著しく高かった。体積抵抗率や熱伝導率は問題ないが、デバイス製造プロセスで用いるには製造ラインの汚染が問題になる濃度レベルであり、そのままの形態では使用できなかった。
参考例2と同じ体積抵抗率及び熱伝導率である基板AlN焼結体基板を作製した。この基板をHF水溶液に溶解し、ICP−MS法で金属不純物濃度を評価したところ、Feが5×1019atoms/cm3、Alが1×1019atoms/cm3であり、参考例2の窒化珪素膜中の濃度に比べ著しく高かった。体積抵抗率や熱伝導率は問題ないが、デバイス製造プロセスで用いるには製造ラインの汚染が問題になる濃度レベルであり、そのままの形態では使用できなかった。
参考例3と同じ体積抵抗率及び熱伝導率である基板SIALON焼結体基板を作製した。この基板をHF水溶液に溶解し、ICP−MS法で金属不純物濃度を評価したところ、Feが2×1019atoms/cm3、Alが1×1020atoms/cm3であり、参考例3の窒化珪素膜中の濃度に比べ著しく高かった。体積抵抗率や熱伝導率は問題ないが、デバイス製造プロセスで用いるには製造ラインの汚染が問題になる濃度レベルであり、そのままの形態では使用できなかった。
表1には、実施例1、比較例1〜3、参考例1〜3で作製した複合基板の吸着力測定値と、同サイズのシリコンウェハについて測定した値を示す。その結果、アモルファスシリコン又はポリシリコンを成膜していない比較例1〜3に示す複合基板は、ほとんど静電チャックされないのに対し、実施例1、参考例1〜3のアモルファスシリコン又はポリシリコンを成膜した複合基板では、シリコンウェハと同程度の吸着力であった。
Claims (3)
- 窒化珪素からなり熱伝導率が5W/m・K以上、かつ体積抵抗率が1×108Ω・cm以上の無機絶縁性焼結体基板と、単結晶シリコン膜と、前記無機絶縁性焼結体基板と前記単結晶シリコン膜の間に単独で介在し、該無機絶縁性焼結体基板の全体を覆っている窒化珪素からなる化学気相成長膜とを備え、該窒化珪素からなる化学気相成長膜は、当該複合基板を用いた半導体デバイス製造プロセスにおいて前記無機絶縁性焼結体基板中に含まれるAl及び/又はFeの溶出又は拡散を防止する薄膜であることを特徴とする複合基板。
- 前記窒化珪素からなる化学気相成長膜中におけるAlの濃度が1×1017atoms/cm3以下であり、Feの濃度が1×1017atoms/cm3以下であることを特徴とする請求項1記載の複合基板。
- 前記複合基板の少なくとも裏面に多結晶又はアモルファスのシリコン層が設けられていることを特徴とする請求項1又は2記載の複合基板。
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Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH072524B2 (ja) | 1986-07-21 | 1995-01-18 | トヨタ自動車株式会社 | 自動倉庫 |
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Families Citing this family (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP3109893B1 (en) * | 2014-02-21 | 2022-09-28 | Shin-Etsu Chemical Co., Ltd. | Composite substrate |
| JP6208646B2 (ja) * | 2014-09-30 | 2017-10-04 | 信越化学工業株式会社 | 貼り合わせ基板とその製造方法、および貼り合わせ用支持基板 |
| JP2017059598A (ja) * | 2015-09-14 | 2017-03-23 | 株式会社東芝 | ウェーハ及び半導体装置 |
| TWI894863B (zh) * | 2016-06-14 | 2025-08-21 | 美商克若密斯股份有限公司 | 用於功率及rf應用的工程基板結構 |
| KR102257664B1 (ko) * | 2016-09-20 | 2021-05-31 | 엔지케이 인슐레이터 엘티디 | 복합 기판, 그 제조법 및 전자 디바이스 |
| KR102558905B1 (ko) | 2017-07-14 | 2023-07-21 | 신에쓰 가가꾸 고교 가부시끼가이샤 | 고열전도성의 디바이스 기판 및 그 제조 방법 |
| CN110943066A (zh) * | 2018-09-21 | 2020-03-31 | 联华电子股份有限公司 | 具有高电阻晶片的半导体结构及高电阻晶片的接合方法 |
| US11594441B2 (en) | 2021-04-09 | 2023-02-28 | Applied Materials, Inc. | Handling for high resistivity substrates |
Family Cites Families (18)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60254722A (ja) | 1984-05-31 | 1985-12-16 | Nec Corp | 半導体装置用基板 |
| DE4017181C2 (de) * | 1990-05-29 | 1998-08-27 | Daimler Benz Aerospace Ag | Elektrisches Bauelement |
| JP3047986B2 (ja) | 1990-07-25 | 2000-06-05 | 株式会社日立製作所 | 半導体装置 |
| JPH07202063A (ja) | 1993-12-28 | 1995-08-04 | Toshiba Corp | セラミックス回路基板 |
| US5877094A (en) | 1994-04-07 | 1999-03-02 | International Business Machines Corporation | Method for fabricating a silicon-on-sapphire wafer |
| IT1268123B1 (it) | 1994-10-13 | 1997-02-20 | Sgs Thomson Microelectronics | Fetta di materiale semiconduttore per la fabbricazione di dispositivi integrati e procedimento per la sua fabbricazione. |
| JP4571728B2 (ja) * | 1999-06-23 | 2010-10-27 | 日本碍子株式会社 | 窒化珪素焼結体及びその製造方法 |
| US6391812B1 (en) | 1999-06-23 | 2002-05-21 | Ngk Insulators, Ltd. | Silicon nitride sintered body and method of producing the same |
| JP4714423B2 (ja) * | 2004-01-06 | 2011-06-29 | Okiセミコンダクタ株式会社 | 半導体ウエハとその製造方法 |
| JP4975974B2 (ja) * | 2005-03-18 | 2012-07-11 | ラピスセミコンダクタ株式会社 | Sosウェハおよびその製造方法 |
| US7446284B2 (en) * | 2005-12-21 | 2008-11-04 | Momentive Performance Materials Inc. | Etch resistant wafer processing apparatus and method for producing the same |
| EP1901345A1 (en) * | 2006-08-30 | 2008-03-19 | Siltronic AG | Multilayered semiconductor wafer and process for manufacturing the same |
| JP4458116B2 (ja) * | 2007-05-30 | 2010-04-28 | 住友電気工業株式会社 | エピタキシャル層成長用iii族窒化物半導体層貼り合わせ基板および半導体デバイス |
| US20100193900A1 (en) | 2007-07-13 | 2010-08-05 | National University Corporation Tohoku University | Soi substrate and semiconductor device using an soi substrate |
| JP2009081223A (ja) * | 2007-09-26 | 2009-04-16 | Tokyo Electron Ltd | 静電チャック部材 |
| JP5532680B2 (ja) | 2009-05-27 | 2014-06-25 | 信越半導体株式会社 | Soiウェーハの製造方法およびsoiウェーハ |
| JP5926887B2 (ja) * | 2010-02-03 | 2016-05-25 | 株式会社半導体エネルギー研究所 | Soi基板の作製方法 |
| US9184228B2 (en) * | 2011-03-07 | 2015-11-10 | Sumitomo Electric Industries, Ltd. | Composite base including sintered base and base surface flattening layer, and composite substrate including that composite base and semiconductor crystalline layer |
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Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH072524B2 (ja) | 1986-07-21 | 1995-01-18 | トヨタ自動車株式会社 | 自動倉庫 |
| US11069560B2 (en) | 2016-11-01 | 2021-07-20 | Shin-Etsu Chemical Co., Ltd. | Method of transferring device layer to transfer substrate and highly thermal conductive substrate |
| US11876014B2 (en) | 2016-11-01 | 2024-01-16 | Shin-Etsu Chemical Co., Ltd. | Method of transferring device layer to transfer substrate and highly thermal conductive substrate |
Also Published As
| Publication number | Publication date |
|---|---|
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