JP6309643B2 - 再分配層上に積層ダイを備える集積デバイス - Google Patents
再分配層上に積層ダイを備える集積デバイス Download PDFInfo
- Publication number
- JP6309643B2 JP6309643B2 JP2016550864A JP2016550864A JP6309643B2 JP 6309643 B2 JP6309643 B2 JP 6309643B2 JP 2016550864 A JP2016550864 A JP 2016550864A JP 2016550864 A JP2016550864 A JP 2016550864A JP 6309643 B2 JP6309643 B2 JP 6309643B2
- Authority
- JP
- Japan
- Prior art keywords
- die
- interconnects
- layer
- wafer level
- redistribution
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
Images
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W20/00—Interconnections in chips, wafers or substrates
- H10W20/20—Interconnections within wafers or substrates, e.g. through-silicon vias [TSV]
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/01—Manufacture or treatment
- H10W70/05—Manufacture or treatment of insulating or insulated package substrates, or of interposers, or of redistribution layers
- H10W70/08—Manufacture or treatment of insulating or insulated package substrates, or of interposers, or of redistribution layers by depositing layers on the chip or wafer, e.g. "chip-first" RDLs
- H10W70/09—Manufacture or treatment of insulating or insulated package substrates, or of interposers, or of redistribution layers by depositing layers on the chip or wafer, e.g. "chip-first" RDLs extending onto an encapsulation that laterally surrounds the chip or wafer, e.g. fan-out wafer level package [FOWLP] RDLs
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/01—Manufacture or treatment
- H10W72/0198—Manufacture or treatment batch processes
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/20—Bump connectors, e.g. solder bumps or copper pillars; Dummy bumps; Thermal bumps
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/851—Dispositions of multiple connectors or interconnections
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W74/00—Encapsulations, e.g. protective coatings
- H10W74/01—Manufacture or treatment
- H10W74/019—Manufacture or treatment using temporary auxiliary substrates
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/01—Manufacture or treatment
- H10W70/05—Manufacture or treatment of insulating or insulated package substrates, or of interposers, or of redistribution layers
- H10W70/095—Manufacture or treatment of insulating or insulated package substrates, or of interposers, or of redistribution layers of vias therein
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/099—Connecting interconnections to insulating or insulated package substrates, interposers or redistribution layers
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
- H10W70/611—Insulating or insulated package substrates; Interposers; Redistribution layers for connecting multiple chips together
- H10W70/614—Insulating or insulated package substrates; Interposers; Redistribution layers for connecting multiple chips together the multiple chips being integrally enclosed
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/071—Connecting or disconnecting
- H10W72/072—Connecting or disconnecting of bump connectors
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/071—Connecting or disconnecting
- H10W72/072—Connecting or disconnecting of bump connectors
- H10W72/07202—Connecting or disconnecting of bump connectors using auxiliary members
- H10W72/07204—Connecting or disconnecting of bump connectors using auxiliary members using temporary auxiliary members, e.g. sacrificial coatings
- H10W72/07207—Temporary substrates, e.g. removable substrates
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/20—Bump connectors, e.g. solder bumps or copper pillars; Dummy bumps; Thermal bumps
- H10W72/241—Dispositions, e.g. layouts
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/20—Bump connectors, e.g. solder bumps or copper pillars; Dummy bumps; Thermal bumps
- H10W72/251—Materials
- H10W72/252—Materials comprising solid metals or solid metalloids, e.g. PbSn, Ag or Cu
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/20—Bump connectors, e.g. solder bumps or copper pillars; Dummy bumps; Thermal bumps
- H10W72/29—Bond pads specially adapted therefor
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/851—Dispositions of multiple connectors or interconnections
- H10W72/874—On different surfaces
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
- H10W72/941—Dispositions of bond pads
- H10W72/9413—Dispositions of bond pads on encapsulations
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
- H10W72/941—Dispositions of bond pads
- H10W72/9415—Dispositions of bond pads relative to the surface, e.g. recessed, protruding
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
- H10W72/941—Dispositions of bond pads
- H10W72/944—Dispositions of multiple bond pads
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W74/00—Encapsulations, e.g. protective coatings
- H10W74/10—Encapsulations, e.g. protective coatings characterised by their shape or disposition
- H10W74/131—Encapsulations, e.g. protective coatings characterised by their shape or disposition the semiconductor body being only partially enclosed
- H10W74/142—Encapsulations, e.g. protective coatings characterised by their shape or disposition the semiconductor body being only partially enclosed the encapsulations exposing the passive side of the semiconductor body
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/10—Configurations of laterally-adjacent chips
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/20—Configurations of stacked chips
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/20—Configurations of stacked chips
- H10W90/297—Configurations of stacked chips characterised by the through-semiconductor vias [TSVs] in the stacked chips
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/721—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bump connectors
- H10W90/722—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bump connectors between stacked chips
Landscapes
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Production Of Multi-Layered Print Wiring Board (AREA)
- Engineering & Computer Science (AREA)
- Manufacturing & Machinery (AREA)
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
Description
本出願は、内容全体が参照により本明細書に組み込まれる、2014年2月14日に米国特許商標庁に出願された、米国非仮特許出願第14/181,371号の優先権および恩典を主張する。
いくつかの新規の特徴が集積デバイス(たとえば、集積パッケージ、ウェハレベル集積パッケージデバイス)に関連し、その集積デバイスは、集積デバイスのための基部として構成される誘電体層と、誘電体層内のいくつかの再分配金属層と、誘電体層の第1の表面に結合される第1のダイと、第1のダイに結合される第2のダイとを含む。いくつかの実施態様では、誘電体層はいくつかの誘電体層を含む。いくつかの実施態様では、第1のダイは、第1の組のインターコネクトを通して再分配金属層に結合される。いくつかの実施態様では、第2のダイは1組のインターコネクトおよび1組のハンダボールを通して第1のダイに結合される。いくつかの実施態様では、第1のダイはいくつかの基板貫通ビア(TSV)を含む。いくつかの実施態様では、第2のダイは第1の組のインターコネクト、TSV、第2の組のインターコネクトおよび1組のハンダボールを通して、再分配金属層に結合される。いくつかの実施態様では、集積デバイスはさらに、第1のダイおよび第2のダイを封入する封入材を含む。いくつかの実施態様では、集積デバイスはさらに、誘電体層の第1の表面に結合される第3のダイを含む。いくつかの実施態様では、第1のダイはプロセッサであり、第2のダイはメモリダイである。
図2は、積層ダイを含む集積デバイス(たとえば、半導体デバイス、集積パッケージ、ウェハレベル集積パッケージデバイス)の側面図の一例を概念的に示す。具体的には、図2は、集積デバイス200(たとえば、集積パッケージ)を示しており、集積デバイス200は、誘電体層202と、第1の組のハンダボール204(たとえば、204a〜204d)と、第1のダイ206と、第2のダイ208と、第3のダイ210と、封入材220とを含む。異なる実施態様は、封入材220のために異なる材料を使用することができる。たとえば、封入材220は、少なくともモールド、エポキシおよび/またはポリマー充填材のうちの1つを含むことができる。ダイ(たとえば、第1のダイ206、第2のダイ208、第3のダイ210)は、メモリダイおよび/またはプロセッサのような、異なるタイプのダイを表す場合がある。ダイはさらに、図3〜図4を参照しながら以下に詳細に説明される。
いくつかの実施態様では、積層ダイを含む集積デバイス(たとえば、集積パッケージ、ウェハレベル集積パッケージデバイス)を配設することは、いくつかのプロセスを含む。図7A〜図7Cは、集積デバイスを配設する(たとえば、製造する、作製する)ための例示的なシーケンスを示す。いくつかの実施態様では、図7A〜図7Cのシーケンスを用いて、図2、および/または図5〜図6の集積デバイスまたは本開示において説明される他の集積デバイスを配設/製造/作製することができる。
図8は、集積デバイス(たとえば、集積パッケージ)を配設する(たとえば、製造する、作製する)ための例示的な方法を示す。いくつかの実施態様では、図8の方法を用いて、図2、および/または図5〜図6の集積デバイスまたは本開示において説明される他の集積デバイス(たとえば、ダイパッケージ)を配設/製造/作製することができる。
いくつかの実施態様では、積層ダイを含む集積デバイス(たとえば、集積パッケージ、ウェハレベル集積パッケージデバイス)を配設することは、いくつかのプロセスを含む。図9A〜図9Cは、集積デバイスを配設する(たとえば、製造する、作製する)ための例示的なシーケンスを示す。いくつかの実施態様では、図9A〜図9Cのシーケンスを用いて、図2、および/または図5〜図6の集積デバイスまたは本開示において説明される他の集積デバイスを配設/製造/作製することができる。
図10は、集積デバイス(たとえば、集積パッケージ)を配設する(たとえば、製造する、作製する)ための例示的な方法を示す。いくつかの実施態様では、図10の方法を用いて、図2、および/または図5〜図6の集積デバイスまたは本開示において説明される他の集積デバイス(たとえば、ダイパッケージ)を配設/製造/作製することができる。
いくつかの実施態様では、再分配層を含む集積デバイスを配設する(たとえば、製造する、作製する)ことはいくつかのプロセスを含む。図11A〜図11Cは、いくつかの再分配層を含む集積デバイスを配設するための例示的なシーケンスを示す。いくつかの実施態様では、図11A〜図11Cのシーケンスを用いて、図2〜図6の集積デバイスおよび/または本開示において説明される他の集積デバイス(たとえば、ダイ、集積デバイス)を配設/製造/作製することができる。
図12は、上記の半導体デバイス、集積回路、ダイ、インターポーザ、またはパッケージのうちのいずれかと一体に構成することができる種々の電子デバイスを示す。たとえば、モバイル電話1202、ラップトップコンピュータ1204、および定置端末1206が、本明細書において説明されたような集積回路(IC)1200を含むことができる。IC1200は、たとえば、本明細書において説明される集積回路、ダイ、またはパッケージのいずれかとすることができる。図12に示されるデバイス1202、1204、1206は例示にすぎない。限定はしないが、モバイルデバイス、ハンドヘルドパーソナル通信システム(PCS)ユニット、携帯情報端末などのポータブルデータユニット、GPS対応デバイス、ナビゲーションデバイス、セットトップボックス、音楽プレーヤ、ビデオプレーヤ、エンターテイメントユニット、メータ読取り機器などの定置データユニット、通信デバイス、スマートフォン、タブレットコンピュータ、またはデータもしくはコンピュータ命令の記憶もしくは取出しを行う任意の他のデバイス、またはそれらの任意の組合せを含む他の電子デバイスが、IC1200を採用することもできる。
102 基板
106 第1のダイ
108 第2のダイ
116 第1の組のハンダボール
118 第2の組のハンダボール
120 第3の組のハンダボール
200 集積デバイス
202 誘電体層
204 第1の組のハンダボール
204a ハンダボール
204b ハンダボール
204c ハンダボール
204d ハンダボール
206 第1のダイ
208 第2のダイ
210 第3のダイ
212 第3の組のインターコネクト
214 1組のハンダボール
216 第1の組のインターコネクト
218 第2の組のインターコネクト
219 基板貫通ビア(TSV)
220 封入材
230 第1の組の再分配インターコネクト
232 第1のアンダーバンプ(UBM)層
240 第2の組の再分配インターコネクト
242 第1のアンダーバンプ(UBM)層
250 第3の組の再分配インターコネクト
252 第3のアンダーバンプ(UBM)層
260 第4の組の再分配インターコネクト
262 第4のアンダーバンプ(UBM)層
300 ダイ
301 基板
302 下位金属層および誘電体層
311 インターコネクト
312 インターコネクト
313 インターコネクト
314 インターコネクト
315 インターコネクト
316 インターコネクト
320 封入材
400 ダイ
401 基板
402 下位金属層および誘電体層
411 インターコネクト
412 インターコネクト
413 インターコネクト
414 インターコネクト
415 インターコネクト
416 インターコネクト
420 封入材
421 第1の基板貫通ビア(TSV)
422 第2のTSV
423 第3のTSV
424 第4のTSV
500 集積デバイス
502 誘電体層
504 第1の組のハンダボール
504a ハンダボール
504b ハンダボール
504c ハンダボール
204d ハンダボール
506 第1のダイ
508 第2のダイ
510 第3のダイ
512 第3の組のインターコネクト
514 1組のハンダボール
516 第1の組のインターコネクト
518 第2の組のインターコネクト
519 1組の基板貫通ビア(TSV)
520 封入材
530 第1の組の再分配インターコネクト
532 第1のアンダーバンプ(UBM)層
540 第2の組の再分配インターコネクト
542 第1のアンダーバンプ(UBM)層
550 第3の組の再分配インターコネクト
552 第3のアンダーバンプ(UBM)層
560 第4の組の再分配インターコネクト
562 第4のアンダーバンプ(UBM)層
600 集積デバイス
602 誘電体層
604 第1の組のハンダボール
604a ハンダボール
604b ハンダボール
604c ハンダボール
604d ハンダボール
606 第1のダイ
608 第2のダイ
610 第3のダイ
611 第4のダイ
612 第3の組のインターコネクト
614 1組のハンダボール
616 第1の組のインターコネクト
618 第2の組のインターコネクト
620 封入材
622 第4の組のインターコネクト
624 1組のハンダボール
629 1組の基板貫通ビア(TSV)
630 第1の組の再分配インターコネクト
632 第1のアンダーバンプ(UBM)層
640 第2の組の再分配インターコネクト
642 第1のアンダーバンプ(UBM)層
650 第3の組の再分配インターコネクト
652 第3のアンダーバンプ(UBM)層
660 第4の組の再分配インターコネクト
662 第4のアンダーバンプ(UBM)層
700 キャリア
701 接着層
706 第1のダイ
708 第3のダイ
710 第2のダイ
712 第2の組のインターコネクト
714 1組のハンダボール
716 第1の組のインターコネクト
718 第3の組のインターコネクト
719 1組の基板貫通ビア(TSV)
720 封入層
730 第1の誘電体層
731 再分配インターコネクト
732 再分配インターコネクト
733 再分配インターコネクト
734 再分配インターコネクト
740 第2の誘電体層
741 再分配インターコネクト
742 再分配インターコネクト
743 再分配インターコネクト
744 再分配インターコネクト
750 第3の誘電体層
751 再分配インターコネクト
752 再分配インターコネクト
753 再分配インターコネクト
754 再分配インターコネクト
760 1組の誘電体層
761 第1のアンダーバンプメタライゼーション(UBM)層
762 第2のUBM層
763 第3のUBM層
764 第4のUBM層
771 第1のハンダボール
772 第2のハンダボール
773 第3のハンダボール
774 第4のハンダボール
900 キャリア
901 接着層
906 第1のダイ
908 第2のダイ
910 第3のダイ
912 第3の組のインターコネクト
914 1組のハンダボール
916 第1の組のインターコネクト
918 第2の組のインターコネクト
919 1組の基板貫通ビア(TSV)
920 封入層
930 第1の誘電体層
931 再分配インターコネクト
932 再分配インターコネクト
933 再分配インターコネクト
934 再分配インターコネクト
940 第2の誘電体層
941 再分配インターコネクト
942 再分配インターコネクト
943 再分配インターコネクト
944 再分配インターコネクト
950 第3の誘電体層
951 再分配インターコネクト
952 再分配インターコネクト
953 再分配インターコネクト
954 再分配インターコネクト
960 1組の誘電体層
961 第1のアンダーバンプメタライゼーション(UBM)層
962 第2のUBM層
963 第3のUBM層
964 第4のUBM層
971 第1のハンダボール
972 第2のハンダボール
973 第3のハンダボール
974 第4のハンダボール
1102 基部部分
1104 パッド
1106 パッシベーション層
1108 第1の絶縁層
1109 空洞
1110 第1の金属再分配層
1111 空洞
1113 空洞
1114 第2の絶縁層
1116 第3の絶縁層
1117 空洞
1120 第2の金属再分配層
1125 パッド
1129 パッド
1130 第1の金属層
1132 第2の金属層
1140 金属層
1142 金属層
1150 金属層
1152 金属層
1170 アンダーバンプメタライゼーション(UBM)層
1180 ハンダボール
1200 IC
1202 モバイル電話
1204 ラップトップコンピュータ
1206 定置端末
Claims (12)
- 集積デバイスであって、
前記集積デバイスのための基部として構成される誘電体層と、
前記誘電体層内にある複数の再分配金属層と、
前記誘電体層の第1の表面に結合される第1のウェハレベルダイであって、前記第1のウェハレベルダイは少なくとも1つの基板貫通ビア(TSV)を備え、前記第1のウェハレベルダイが第1の組のインターコネクトを介して前記複数の再分配金属層に結合され、前記第1の組のインターコネクトが金属ピラーを含む、第1のウェハレベルダイと、
前記第1のウェハレベルダイに結合される第2のウェハレベルダイであって、前記第1の組のインターコネクト、前記第1のウェハレベルダイの前記少なくとも1つの基板貫通ビア、第2の組のインターコネクト、および1組のハンダボールを介して前記複数の再分配金属層にさらに結合される、第2のウェハレベルダイと、
第3の組のインターコネクトを介して誘電体層の前記第1の表面に結合される第3のウェハレベルダイであって、第3の組のインターコネクトが金属ピラーであり、前記第3の組のインターコネクトが、前記第1の組のインターコネクトよりも垂直に長い、第3のウェハレベルダイと、を備え、
前記第3のウェハレベルダイおよび前記第3の組のインターコネクトを合わせた高さが、前記第1のウェハレベルダイおよび前記第2のウェハレベルダイを合わせた高さと同様である、集積デバイス。 - 前記誘電体層はいくつかの誘電体層を含む、請求項1に記載の集積デバイス。
- 前記第2のウェハレベルダイは前記第2の組のインターコネクトおよび前記1組のハンダボールを通して前記第1のウェハレベルダイに垂直に結合される、請求項1に記載の集積デバイス。
- 前記第1のウェハレベルダイおよび前記第2のウェハレベルダイを封入する封入層をさらに備える、請求項1に記載の集積デバイス。
- 前記第1のウェハレベルダイはプロセッサであり、前記第2のウェハレベルダイはメモリダイである、請求項1に記載の集積デバイス。
- 前記集積デバイスは、音楽プレーヤ、ビデオプレーヤ、エンターテイメントユニット、ナビゲーションデバイス、通信デバイス、モバイルデバイス、モバイルフォン、スマートフォン、携帯情報端末、定置端末、タブレットコンピュータ、および/またはラップトップコンピュータのうちの少なくとも1つに組み込まれる、請求項1に記載の集積デバイス。
- 集積デバイスのための基部として構成される誘電体層と、
前記誘電体層内の再分配インターコネクト手段と、
前記誘電体層の第1の表面に結合される第1のウェハレベルダイであって、前記第1のウェハレベルダイは少なくとも1つの基板貫通ビア(TSV)を備え、前記第1のウェハレベルダイが第1の組のインターコネクトを介して前記再分配インターコネクト手段に結合され、前記第1の組のインターコネクトが金属ピラーを含む、第1のウェハレベルダイと、
前記第1のウェハレベルダイに結合される第2のウェハレベルダイであって、前記第1の組のインターコネクト、前記第1のウェハレベルダイの前記少なくとも1つの基板貫通ビア、第2の組のインターコネクト、および1組のハンダボールを介して前記再分配インターコネクト手段にさらに結合される、第2のウェハレベルダイと、
第3の組のインターコネクトを介して誘電体層の前記第1の表面に結合される第3のウェハレベルダイであって、第3の組のインターコネクトが金属ピラーであり、前記第3の組のインターコネクトが、前記第1の組のインターコネクトよりも垂直に長い、第3のウェハレベルダイと、を備え、
前記第3のウェハレベルダイおよび前記第3の組のインターコネクトを合わせた高さが、前記第1のウェハレベルダイおよび前記第2のウェハレベルダイを合わせた高さと同様である、装置。 - 前記誘電体層はいくつかの誘電体層を含む、請求項7に記載の装置。
- 前記第2のウェハレベルダイは前記第2の組のインターコネクトおよび前記1組のハンダボールを通して前記第1のウェハレベルダイに垂直に結合される、請求項7に記載の装置。
- 前記第1のウェハレベルダイおよび前記第2のウェハレベルダイを封入する封入手段をさらに備える、請求項7に記載の装置。
- 音楽プレーヤ、ビデオプレーヤ、エンターテイメントユニット、ナビゲーションデバイス、通信デバイス、モバイルデバイス、モバイルフォン、スマートフォン、携帯情報端末、定置端末、タブレットコンピュータ、および/またはラップトップコンピュータのうちの少なくとも1つに組み込まれる、請求項7に記載の装置。
- 前記第1のウェハレベルダイはプロセッサであり、前記第2のウェハレベルダイはメモリダイである、請求項7に記載の装置。
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US14/181,371 | 2014-02-14 | ||
| US14/181,371 US9583460B2 (en) | 2014-02-14 | 2014-02-14 | Integrated device comprising stacked dies on redistribution layers |
| PCT/US2015/015639 WO2015123426A2 (en) | 2014-02-14 | 2015-02-12 | Integrated device comprising stacked dies on redistribution layers |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2018002530A Division JP2018082205A (ja) | 2014-02-14 | 2018-01-11 | 再分配層上に積層ダイを備える集積デバイス |
Publications (3)
| Publication Number | Publication Date |
|---|---|
| JP2017506001A JP2017506001A (ja) | 2017-02-23 |
| JP2017506001A5 JP2017506001A5 (ja) | 2017-06-08 |
| JP6309643B2 true JP6309643B2 (ja) | 2018-04-11 |
Family
ID=52686444
Family Applications (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2016550864A Active JP6309643B2 (ja) | 2014-02-14 | 2015-02-12 | 再分配層上に積層ダイを備える集積デバイス |
| JP2018002530A Pending JP2018082205A (ja) | 2014-02-14 | 2018-01-11 | 再分配層上に積層ダイを備える集積デバイス |
Family Applications After (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2018002530A Pending JP2018082205A (ja) | 2014-02-14 | 2018-01-11 | 再分配層上に積層ダイを備える集積デバイス |
Country Status (9)
| Country | Link |
|---|---|
| US (1) | US9583460B2 (ja) |
| EP (1) | EP3105789B1 (ja) |
| JP (2) | JP6309643B2 (ja) |
| KR (1) | KR101872510B1 (ja) |
| CN (2) | CN110060974B (ja) |
| BR (1) | BR112016018580B1 (ja) |
| CA (1) | CA2937552C (ja) |
| ES (1) | ES2910956T3 (ja) |
| WO (1) | WO2015123426A2 (ja) |
Families Citing this family (25)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9852998B2 (en) * | 2014-05-30 | 2017-12-26 | Taiwan Semiconductor Manufacturing Company, Ltd. | Ring structures in device die |
| US9842825B2 (en) * | 2014-09-05 | 2017-12-12 | Taiwan Semiconductor Manufacturing Company, Ltd. | Substrateless integrated circuit packages and methods of forming same |
| JP6330788B2 (ja) * | 2015-11-18 | 2018-05-30 | 株式会社村田製作所 | 電子デバイス |
| US10403609B2 (en) * | 2015-12-21 | 2019-09-03 | Intel IP Corporation | System-in-package devices and methods for forming system-in-package devices |
| US10276402B2 (en) * | 2016-03-21 | 2019-04-30 | Taiwan Semiconductor Manufacturing Co., Ltd. | Semiconductor package and manufacturing process thereof |
| US10134708B2 (en) * | 2016-08-05 | 2018-11-20 | Taiwan Semiconductor Manufacturing Company, Ltd. | Package with thinned substrate |
| KR20230047499A (ko) * | 2016-12-29 | 2023-04-07 | 인텔 코포레이션 | 하이퍼칩 |
| US10854568B2 (en) | 2017-04-07 | 2020-12-01 | Taiwan Semiconductor Manufacturing Company, Ltd. | Packages with Si-substrate-free interposer and method forming same |
| DE102017124104B4 (de) | 2017-04-07 | 2025-05-15 | Taiwan Semiconductor Manufacturing Co., Ltd. | Packages mit si-substrat-freiem interposer und verfahren zum bilden derselben |
| DE102017123449B4 (de) | 2017-04-10 | 2023-12-28 | Taiwan Semiconductor Manufacturing Co. Ltd. | Gehäuse mit Si-substratfreiem Zwischenstück und Ausbildungsverfahren |
| US10522449B2 (en) | 2017-04-10 | 2019-12-31 | Taiwan Semiconductor Manufacturing Company, Ltd. | Packages with Si-substrate-free interposer and method forming same |
| CN107226452B (zh) * | 2017-05-24 | 2019-05-31 | 中国科学院上海微系统与信息技术研究所 | 共面键合结构及其制备方法 |
| KR102412613B1 (ko) | 2017-07-24 | 2022-06-23 | 삼성전자주식회사 | 반도체 패키지 및 이의 제조 방법 |
| CN107275323B (zh) * | 2017-07-25 | 2018-05-01 | 睿力集成电路有限公司 | 一种芯片堆栈立体封装结构 |
| US10290571B2 (en) | 2017-09-18 | 2019-05-14 | Taiwan Semiconductor Manufacturing Company, Ltd. | Packages with si-substrate-free interposer and method forming same |
| CN110998836B (zh) * | 2017-09-25 | 2025-02-14 | 英特尔公司 | 使用具有双侧互连层的管芯的单片芯片堆叠 |
| US11398451B2 (en) | 2019-03-01 | 2022-07-26 | Sandisk Technologies Llc | Methods for reusing substrates during manufacture of a bonded assembly including a logic die and a memory die |
| US10790300B2 (en) | 2019-03-01 | 2020-09-29 | Sandisk Technologies Llc | Three-dimensional memory device having an epitaxial vertical semiconductor channel and method for making the same |
| US11239253B2 (en) | 2019-03-01 | 2022-02-01 | Sandisk Technologies Llc | Three-dimensional memory device having an epitaxial vertical semiconductor channel and method for making the same |
| US11424231B2 (en) | 2019-03-01 | 2022-08-23 | Sandisk Technologies Llc | Three-dimensional memory device having an epitaxial vertical semiconductor channel and method for making the same |
| US11410902B2 (en) * | 2019-09-16 | 2022-08-09 | Advanced Semiconductor Engineering, Inc. | Semiconductor device package and method of manufacturing the same |
| US11217560B2 (en) * | 2019-10-28 | 2022-01-04 | Nanya Technology Corporation | Die assembly and method of manufacturing the same |
| US11784151B2 (en) * | 2020-07-22 | 2023-10-10 | Qualcomm Incorporated | Redistribution layer connection |
| WO2022016470A1 (zh) * | 2020-07-23 | 2022-01-27 | 华为技术有限公司 | 一种芯片封装结构、电子设备 |
| KR102947619B1 (ko) | 2021-10-29 | 2026-04-03 | 삼성전자주식회사 | 반도체 장치 및 이의 제조 방법 |
Family Cites Families (35)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3011098U (ja) * | 1994-11-11 | 1995-05-16 | 勝規 森 | 取付具付き水準器 |
| JP2000155027A (ja) * | 1998-11-19 | 2000-06-06 | Komatsu Ltd | 水準器 |
| JP2003344047A (ja) * | 2002-05-27 | 2003-12-03 | Hokuriku Seiko:Kk | 遊技盤面傾斜器 |
| US20070126085A1 (en) | 2005-12-02 | 2007-06-07 | Nec Electronics Corporation | Semiconductor device and method of manufacturing the same |
| KR100753415B1 (ko) | 2006-03-17 | 2007-08-30 | 주식회사 하이닉스반도체 | 스택 패키지 |
| JP2008091639A (ja) * | 2006-10-02 | 2008-04-17 | Nec Electronics Corp | 電子装置およびその製造方法 |
| JP2008091638A (ja) * | 2006-10-02 | 2008-04-17 | Nec Electronics Corp | 電子装置およびその製造方法 |
| US7969009B2 (en) * | 2008-06-30 | 2011-06-28 | Qualcomm Incorporated | Through silicon via bridge interconnect |
| US8446017B2 (en) * | 2009-09-18 | 2013-05-21 | Amkor Technology Korea, Inc. | Stackable wafer level package and fabricating method thereof |
| US9431316B2 (en) * | 2010-05-04 | 2016-08-30 | STATS ChipPAC Pte. Ltd. | Semiconductor device and method of forming channels in back surface of FO-WLCSP for heat dissipation |
| TWI427753B (zh) * | 2010-05-20 | 2014-02-21 | 日月光半導體製造股份有限公司 | 封裝結構以及封裝製程 |
| US9620455B2 (en) | 2010-06-24 | 2017-04-11 | STATS ChipPAC Pte. Ltd. | Semiconductor device and method of forming anisotropic conductive film between semiconductor die and build-up interconnect structure |
| KR101683814B1 (ko) | 2010-07-26 | 2016-12-08 | 삼성전자주식회사 | 관통 전극을 구비하는 반도체 장치 |
| US8754516B2 (en) * | 2010-08-26 | 2014-06-17 | Intel Corporation | Bumpless build-up layer package with pre-stacked microelectronic devices |
| US9224647B2 (en) * | 2010-09-24 | 2015-12-29 | Stats Chippac, Ltd. | Semiconductor device and method of forming TSV interposer with semiconductor die and build-up interconnect structure on opposing surfaces of the interposer |
| US8786066B2 (en) * | 2010-09-24 | 2014-07-22 | Intel Corporation | Die-stacking using through-silicon vias on bumpless build-up layer substrates including embedded-dice, and processes of forming same |
| US8993377B2 (en) * | 2010-09-29 | 2015-03-31 | Stats Chippac, Ltd. | Semiconductor device and method of bonding different size semiconductor die at the wafer level |
| US8421245B2 (en) * | 2010-12-22 | 2013-04-16 | Intel Corporation | Substrate with embedded stacked through-silicon via die |
| US8648470B2 (en) * | 2011-01-21 | 2014-02-11 | Stats Chippac, Ltd. | Semiconductor device and method of forming FO-WLCSP with multiple encapsulants |
| JP5716415B2 (ja) * | 2011-01-26 | 2015-05-13 | 富士通株式会社 | 半導体装置の製造方法 |
| JP2012227443A (ja) * | 2011-04-21 | 2012-11-15 | Sumitomo Bakelite Co Ltd | 半導体装置の製造方法および半導体装置 |
| KR101739945B1 (ko) | 2011-05-02 | 2017-06-09 | 삼성전자주식회사 | 반도체 패키지 및 이를 제조하는 방법 |
| KR20130015885A (ko) | 2011-08-05 | 2013-02-14 | 삼성전자주식회사 | 반도체 패키지 및 그 제조 방법 |
| JP2013038300A (ja) | 2011-08-10 | 2013-02-21 | Fujitsu Ltd | 電子装置及びその製造方法 |
| US8754514B2 (en) * | 2011-08-10 | 2014-06-17 | Taiwan Semiconductor Manufacturing Company, Ltd. | Multi-chip wafer level package |
| JP2013045863A (ja) * | 2011-08-24 | 2013-03-04 | Elpida Memory Inc | 半導体装置およびその製造方法 |
| KR101906408B1 (ko) * | 2011-10-04 | 2018-10-11 | 삼성전자주식회사 | 반도체 패키지 및 그 제조 방법 |
| US10475759B2 (en) * | 2011-10-11 | 2019-11-12 | Taiwan Semiconductor Manufacturing Company, Ltd. | Integrated circuit structure having dies with connectors of different sizes |
| JP6103470B2 (ja) * | 2011-12-14 | 2017-03-29 | 川崎化成工業株式会社 | 縮合多環芳香族骨格を有する連鎖移動剤並びに該縮合多環芳香族骨格を有するポリマーおよびポリマーの製造方法 |
| US8546955B1 (en) | 2012-08-16 | 2013-10-01 | Xilinx, Inc. | Multi-die stack package |
| US9165887B2 (en) * | 2012-09-10 | 2015-10-20 | Taiwan Semiconductor Manufacturing Company, Ltd. | Semiconductor device with discrete blocks |
| US9478474B2 (en) * | 2012-12-28 | 2016-10-25 | Taiwan Semiconductor Manufacturing Company, Ltd. | Methods and apparatus for forming package-on-packages |
| US9524942B2 (en) * | 2013-12-18 | 2016-12-20 | Taiwan Semiconductor Manufacturing Company, Ltd. | Chip-on-substrate packaging on carrier |
| JP6551903B2 (ja) * | 2015-06-29 | 2019-07-31 | 株式会社スリーストン | 傾斜計 |
| JP6799914B2 (ja) * | 2015-12-10 | 2020-12-16 | 大都販売株式会社 | 傾斜計、遊技機傾斜測定方法 |
-
2014
- 2014-02-14 US US14/181,371 patent/US9583460B2/en active Active
-
2015
- 2015-02-12 BR BR112016018580-3A patent/BR112016018580B1/pt active IP Right Grant
- 2015-02-12 ES ES15710617T patent/ES2910956T3/es active Active
- 2015-02-12 CN CN201910374357.9A patent/CN110060974B/zh active Active
- 2015-02-12 CN CN201580008254.0A patent/CN106133897B/zh active Active
- 2015-02-12 JP JP2016550864A patent/JP6309643B2/ja active Active
- 2015-02-12 CA CA2937552A patent/CA2937552C/en active Active
- 2015-02-12 WO PCT/US2015/015639 patent/WO2015123426A2/en not_active Ceased
- 2015-02-12 KR KR1020167024802A patent/KR101872510B1/ko active Active
- 2015-02-12 EP EP15710617.0A patent/EP3105789B1/en active Active
-
2018
- 2018-01-11 JP JP2018002530A patent/JP2018082205A/ja active Pending
Also Published As
| Publication number | Publication date |
|---|---|
| KR20160122769A (ko) | 2016-10-24 |
| CA2937552C (en) | 2019-09-10 |
| ES2910956T3 (es) | 2022-05-17 |
| CA2937552A1 (en) | 2015-08-20 |
| CN106133897B (zh) | 2019-07-23 |
| WO2015123426A2 (en) | 2015-08-20 |
| BR112016018580B1 (pt) | 2022-09-20 |
| BR112016018580A2 (ja) | 2017-08-08 |
| US9583460B2 (en) | 2017-02-28 |
| KR101872510B1 (ko) | 2018-06-28 |
| US20150235988A1 (en) | 2015-08-20 |
| EP3105789A2 (en) | 2016-12-21 |
| CN110060974B (zh) | 2023-02-17 |
| EP3105789B1 (en) | 2022-03-23 |
| WO2015123426A3 (en) | 2015-10-08 |
| JP2017506001A (ja) | 2017-02-23 |
| JP2018082205A (ja) | 2018-05-24 |
| CN110060974A (zh) | 2019-07-26 |
| CN106133897A (zh) | 2016-11-16 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP6309643B2 (ja) | 再分配層上に積層ダイを備える集積デバイス | |
| US9418877B2 (en) | Integrated device comprising high density interconnects in inorganic layers and redistribution layers in organic layers | |
| US9230936B2 (en) | Integrated device comprising high density interconnects and redistribution layers | |
| US10002857B2 (en) | Package on package (PoP) device comprising thermal interface material (TIM) in cavity of an encapsulation layer | |
| US9153560B2 (en) | Package on package (PoP) integrated device comprising a redistribution layer | |
| US9947642B2 (en) | Package-on-Package (PoP) device comprising a gap controller between integrated circuit (IC) packages | |
| CN107078101A (zh) | 在封装层中包括硅桥接的集成器件封装 | |
| US20160343646A1 (en) | High aspect ratio interconnect for wafer level package (wlp) and integrated circuit (ic) package | |
| US20160020193A1 (en) | PACKAGE ON PACKAGE (PoP) INTEGRATED DEVICE COMPRISING A CAPACITOR IN A SUBSTRATE | |
| US9466554B2 (en) | Integrated device comprising via with side barrier layer traversing encapsulation layer | |
| JP6192859B2 (ja) | カプセル封止層の中にビアとしてワイヤを備える集積デバイス |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20160816 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20170421 |
|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20170421 |
|
| A871 | Explanation of circumstances concerning accelerated examination |
Free format text: JAPANESE INTERMEDIATE CODE: A871 Effective date: 20170421 |
|
| A975 | Report on accelerated examination |
Free format text: JAPANESE INTERMEDIATE CODE: A971005 Effective date: 20170428 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20170522 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20170817 |
|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20170911 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20180111 |
|
| A911 | Transfer to examiner for re-examination before appeal (zenchi) |
Free format text: JAPANESE INTERMEDIATE CODE: A911 Effective date: 20180119 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20180219 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20180314 |
|
| R150 | Certificate of patent or registration of utility model |
Ref document number: 6309643 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |