JP6415256B2 - Game machine - Google Patents
Game machine Download PDFInfo
- Publication number
- JP6415256B2 JP6415256B2 JP2014230443A JP2014230443A JP6415256B2 JP 6415256 B2 JP6415256 B2 JP 6415256B2 JP 2014230443 A JP2014230443 A JP 2014230443A JP 2014230443 A JP2014230443 A JP 2014230443A JP 6415256 B2 JP6415256 B2 JP 6415256B2
- Authority
- JP
- Japan
- Prior art keywords
- voice
- data
- control
- signal
- transmission
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
Images
Landscapes
- Pinball Game Machines (AREA)
Description
本発明は、遊技動作に起因する抽選処理によって大当り状態を発生させる遊技機に関し、特に、高度な音声演出などを安定して実行できる遊技機に関する。 The present invention relates to a gaming machine that generates a big hit state by a lottery process caused by a gaming operation, and more particularly to a gaming machine that can stably execute advanced sound effects and the like.
パチンコ機などの弾球遊技機は、遊技盤に設けた図柄始動口と、複数の表示図柄による一連の図柄変動態様を表示する図柄表示部と、開閉板が開閉される大入賞口などを備えて構成されている。そして、図柄始動口に設けられた検出スイッチが遊技球の通過を検出すると入賞状態となり、遊技球が賞球として払出された後、図柄表示部では表示図柄が所定時間変動される。その後、７・７・７などの所定の態様で図柄が停止すると大当り状態となり、大入賞口が繰返し開放されて、遊技者に有利な遊技状態を発生させている。 A ball game machine such as a pachinko machine has a symbol start opening provided on the game board, a symbol display section for displaying a series of symbol variation patterns by a plurality of display symbols, and a big winning opening for opening and closing the opening and closing plate. Configured. When the detection switch provided at the symbol start port detects the passage of the game ball, the winning state is entered, and after the game ball is paid out as a prize ball, the display symbol is changed for a predetermined time in the symbol display section. Thereafter, when the symbol is stopped in a predetermined manner such as 7, 7, 7, etc., a big hit state is established, and the big winning opening is repeatedly opened to generate a gaming state advantageous to the player.
このような遊技状態を発生させるか否かは、図柄始動口に遊技球が入賞したことを条件に実行される大当り抽選で決定されており、上記の図柄変動動作は、この抽選結果を踏まえたものとなっている。例えば、抽選結果が当選状態である場合には、リーチアクションなどと称される演出動作を２０秒前後実行し、その後、特別図柄を整列させている。一方、ハズレ状態の場合にも、同様のリーチアクションが実行されることがあり、この場合には、遊技者は、大当り状態になることを強く念じつつ演出動作の推移を注視することになる。そして、図柄変動動作の終了時に、停止ラインに所定図柄が揃えば、大当り状態であることが遊技者に保証されたことになる。 Whether or not to generate such a game state is determined by a jackpot lottery executed on the condition that a game ball has won at the symbol start opening, and the above symbol variation operation is based on this lottery result. It has become a thing. For example, when the lottery result is in a winning state, an effect operation called reach action or the like is executed for about 20 seconds, and then the special symbols are aligned. On the other hand, a similar reach action may be executed even in the case of a lost state. In this case, the player pays close attention to the big hit state and pays close attention to the transition of the performance operation. When the predetermined symbols are aligned on the stop line at the end of the symbol variation operation, the player is guaranteed to be in the big hit state.
上記した演出動作は、液晶表示装置での画像演出が中心となるが、この画像演出に連動して、各種のランプを点滅させるランプ演出や、遊技者を盛り上げる音声を出力する音声演出や、可動物が移動する可動演出などが実行される。 The above-mentioned performance operation is centered on the image production on the liquid crystal display device. In conjunction with this image production, a lamp production that blinks various lamps, an audio production that outputs a sound that excites the player, Movable effects such as moving animals are executed.
そして、これら画像演出、ランプ演出、及び可動演出においては、必要なデータをシリアル伝送することで、配線数を増やすことなく演出内容の複雑高度化を図ることが知られている（例えば、特許文献１、特許文献２）。 In these image effects, lamp effects, and movable effects, it is known that the required content is serially transmitted to increase the complexity of the effects without increasing the number of wires (for example, Patent Documents). 1, Patent Document 2).
しかし、画像演出やその他ランプ演出や可動演出を如何に高度化しても、音声演出が意味もなく途絶えたり、或いは、スピーカから異音が発生したり、スピーカコイルから発煙するようなことがあると、遊技者を白けさせてしまり、折角の他の演出動作が台無しになってしまう。 However, no matter how sophisticated the image effects, other lamp effects, or movable effects, the sound effects may stop without meaning, or abnormal sounds may be generated from the speakers or smoke may be emitted from the speaker coils. The player will be whitished, and other production operations will be spoiled.
本発明は、上記の問題点に鑑みてなされたものであって、異常な音声演出を回避するなど、音声制御動作を更に高度化した遊技機を提供することを目的とする。 The present invention has been made in view of the above problems, and an object of the present invention is to provide a gaming machine in which voice control operations are further advanced, such as avoiding abnormal voice effects.
上記の目的を達成するため、本発明は、音声制御レジスタに設定された設定値に基づき動作し、所定の記憶手段に記憶されたデータを読み出して音声信号を再生する音声合成手段と、レジスタアドレスで特定される所定の音声制御レジスタに、所定の設定値を設定するべく設定値データと前記レジスタアドレスを、音声合成手段に伝送して音声演出を制御する演出制御手段との間を、前記設定値データや前記レジスタアドレスである伝送データを、所定の単位で伝送する双方向通信可能なパラレル信号線と、伝送データの種別を特定可能な管理データを伝送する管理データ線と、パラレル信号線の動作モードが、送信モードか受信モードかを特定する制御信号線と、を含んで接続した遊技機であって、制御信号線を送信モードに設定した状態で、管理データ線に所定の管理データを出力すると共に、パラレル信号線に前記レジスタアドレスを出力するアドレス手段と、前記アドレス手段を機能させた後、制御信号線を送信モードに設定した状態で、管理データ線の管理データを変化させると共に、パラレル信号線に前記設定値データを出力する設定手段とを、演出制御手段に設けることで、音声合成手段を機能させると共に、前記アドレス手段を機能させた後、制御信号線を受信モードに設定した状態で、管理データ線の管理データを変化させると共に、パラレル信号線からデータを取得する取得手段を、演出制御手段に設けることで、音声合成手段の動作状態を演出制御手段が把握するよう構成されている。 In order to achieve the above object, the present invention operates based on a set value set in a voice control register, reads out data stored in a predetermined storage means, and reproduces a voice signal, and a register address in a predetermined sound control register specified, the register address and the set value data so as to set a predetermined set value, between the presentation control means for controlling the sound effect by transmitting the speech synthesis means, the setting A parallel signal line capable of bidirectional communication for transmitting value data and transmission data as the register address in predetermined units, a management data line for transmitting management data capable of specifying the type of transmission data, and a parallel signal line state operation mode, a game machine connected comprise a control signal line for specifying whether transmission mode or reception mode, which sets the control signal lines to transmit mode The management unit outputs the management data to the management data line and outputs the register address to the parallel signal line. After the address unit is functioned, the control signal line is set to the transmission mode and the management is performed. After changing the management data of the data line and providing the effect control means with setting means for outputting the set value data to the parallel signal line, the voice synthesis means functions and the address means functions In the state where the control signal line is set in the reception mode, the management data of the management data line is changed, and the acquisition control means is provided with the acquisition means for acquiring the data from the parallel signal line, so that the operation state of the voice synthesis means The production control means is configured to grasp the above .
本発明は、取得手段を備えるので、音声合成手段の動作状態の異常を把握することができ、音声演出が意味もなく途絶えたり、或いは、スピーカから異音が発生するようなトラブルを未然防止することができる。 Since the present invention includes an acquisition unit , it is possible to grasp an abnormality in the operation state of the speech synthesis unit, and to prevent troubles in which the voice production is interrupted without meaning or abnormal noise is generated from the speaker. be able to.
上記した本発明の遊技機によれば、異常な音声演出を回避するなど、制御動作を更に高度化した音声制御動作を実現することができる。 According to the above-described gaming machine of the present invention, it is possible to realize a voice control operation in which the control operation is further advanced, such as avoiding an abnormal voice effect.
以下、実施例に基づいて本発明を詳細に説明する。図１は、本実施例のパチンコ機ＧＭを示す斜視図である。このパチンコ機ＧＭは、島構造体に着脱可能に装着される矩形枠状の木製外枠１と、外枠１に固着されたヒンジ２を介して開閉可能に枢着される前枠３とで構成されている。この前枠３には、遊技盤５が、裏側からではなく、表側から着脱自在に装着され、その前側には、ガラス扉６と前面板７とが夫々開閉自在に枢着されている。
Hereinafter, the present invention will be described in detail based on examples. FIG. 1 is a perspective view showing a pachinko machine GM of the present embodiment. This pachinko machine GM includes a rectangular frame-shaped wooden
ガラス扉６の外周には、ＬＥＤランプなどによる電飾ランプが、略Ｃ字状に配置されている。一方、ガラス扉６の上部左右位置と下側には、全３個のスピーカ（不図示）が配置されている。上部に配置された２個のスピーカＳＰＲ，ＳＰＬは、各々、左右チャンネルの音声を出力し、下側のスピーカＳＰＤは重低音を出力するよう構成されている。
On the outer periphery of the
また、ガラス扉６の下方には、遊技者による演出音の音量調整が可能な音量スイッチＶＳＷが配置されている。この音量スイッチＶＳＷは、左右に＋接点と−接点を有する方向キーであって、１０段階（ＭＩＮ〜ＭＡＸ）の音量調整を可能にしている。この音量調整のための操作は、音声演出が実行されていない演出待機中に限り許可されるが、音量スイッチＶＳＷの操作に対応して、確認演出音が出力されると共に、その設定レベルが表示画面に表示されるようになっている。
In addition, a volume switch VSW capable of adjusting the volume of the effect sound by the player is disposed below the
前面板７には、発射用の遊技球を貯留する上皿８が装着され、前枠３の下部には、上皿８から溢れ出し又は抜き取った遊技球を貯留する下皿９と、発射ハンドル１０とが設けられている。発射ハンドル１０は発射モータと連動しており、発射ハンドル１０の回動角度に応じて動作する打撃槌によって遊技球が発射される。
The
上皿８の外周面には、チャンスボタン１１が設けられている。このチャンスボタン１１は、遊技者の左手で操作できる位置に設けられており、遊技者は、発射ハンドル１０から右手を離すことなくチャンスボタン１１を操作できる。このチャンスボタン１１は、通常時には機能していないが、ゲーム状態がボタンチャンス状態となると内蔵ランプが点灯されて操作可能となる。なお、ボタンチャンス状態は、必要に応じて設けられるゲーム状態である。
A
上皿８の右部には、カード式球貸し機に対する球貸し操作用の操作パネル１２が設けられ、カード残額を３桁の数字で表示する度数表示部と、所定金額分の遊技球の球貸しを指示する球貸しスイッチと、ゲーム終了時にカードの返却を指令する返却スイッチとが設けられている。
On the right side of the
図２に示すように、遊技盤５の表面には、金属製の外レールと内レールとからなるガイドレール１３が環状に設けられ、その略中央には、中央開口ＨＯが設けられている。そして、中央開口ＨＯには、大型の液晶カラーディスプレイ（ＬＣＤ）で構成された表示装置ＤＳが配置されている。
As shown in FIG. 2, a
表示装置ＤＳは、大当り状態に係わる特定図柄を変動表示すると共に背景画像や各種のキャラクタなどをアニメーション的に表示する装置である。この表示装置ＤＳは、中央部に特別図柄表示部Ｄａ〜Ｄｃと右上部に普通図柄表示部１９とを有している。そして、特別図柄表示部Ｄａ〜Ｄｃでは、大当り状態の招来を期待させるリーチ演出が実行されることがあり、特別図柄表示部Ｄａ〜Ｄｃ及びその周りでは、適宜な予告演出などが実行される。 The display device DS is a device that variably displays a specific symbol related to the big hit state and displays a background image and various characters in an animated manner. This display device DS has special symbol display portions Da to Dc in the center portion and a normal symbol display portion 19 in the upper right portion. In the special symbol display portions Da to Dc, there is a case where a reach effect that expects a big hit state is invited, and in the special symbol display portions Da to Dc and the surroundings, an appropriate notice effect is executed.
遊技球が落下移動する遊技領域には、図柄始動口１５、大入賞口１６、普通入賞口１７、及び、ゲート１８が配設されている。これらの入賞口１５〜１８は、それぞれ内部に検出スイッチを有しており、遊技球の通過を検出できるようになっている。そして、遊技球が図柄始動口１５を通過すると、遊技球が入賞したとして、特別図柄表示部Ｄａ〜Ｄｃで特別図柄の変動動作を伴う一連の画像演出が開始される。また、この画像演出に対応して、背景音楽や演出音を伴う音声演出や、ランプが点滅するランプ演出が実行される。
In the game area where the game ball falls and moves, a symbol start
図柄始動口１５は、左右一対の開閉爪１５ａを備えた電動式チューリップで開閉されるように構成され、普通図柄表示部１７の変動後の停止図柄が当り図柄を表示した場合には、所定時間だけ、若しくは、所定個数の遊技球を検出するまで、開閉爪１５ａが開放されるようになっている。
The
なお、普通図柄表示部１９は、普通図柄を表示するものであり、ゲート１８を通過した遊技球が検出されると、普通図柄が所定時間だけ変動し、遊技球のゲート１８の通過時点において抽出された抽選用乱数値により決定される停止図柄を表示して停止する。
The normal symbol display unit 19 displays a normal symbol. When a game ball that has passed through the
大入賞口１６は、前後方向に開閉する開閉板１６ａを有して構成されている。大入賞口１６の動作は、特に限定されないが、典型的な大当り状態では、大入賞口１６の開閉板１６ａが開放された後、所定時間が経過し、又は所定数（例えば１０個）の遊技球が入賞すると開閉板１６ａが閉じる。このような動作は、最大で例えば１５回まで継続され、遊技者に有利な状態に制御される。なお、特別図柄表示部Ｄａ〜Ｄｃの変動後の停止図柄が特別図柄のうちの特定図柄であった場合には、特別遊技の終了後のゲームが高確率状態（確変状態）となるという特典が付与される。
The special winning
図３は、上記した各動作を実現するパチンコ機ＧＭの全体回路構成を示すブロック図である。図示の通り、このパチンコ機ＧＭは、ＡＣ２４Ｖを受けて各種の直流電圧や、電源異常信号ＡＢＮ１、ＡＢＮ２やシステムリセット信号（電源リセット信号）ＳＹＳなどを出力する電源基板２０と、遊技制御動作を中心統括的に担う主制御基板２１と、主制御基板２１から受けた制御コマンドＣＭＤに基づいてランプ演出及び音声演出を実行する演出制御基板２２と、演出制御基板２２から受けた制御コマンドＣＭＤ’に基づいて表示装置ＤＳを駆動する画像制御基板２３と、主制御基板２１から受けた制御コマンドＣＭＤ”に基づいて払出モータＭを制御して遊技球を払い出す払出制御基板２４と、遊技者の操作に応答して遊技球を発射させる発射制御基板２５と、を中心に構成されている。
FIG. 3 is a block diagram showing an overall circuit configuration of the pachinko machine GM that realizes the above-described operations. As shown in the figure, this pachinko machine GM mainly receives a 24V AC and outputs various DC voltages, power supply abnormality signals ABN1, ABN2, a system reset signal (power reset signal) SYS, and the like, and a game control operation. Based on the main control board 21 that performs overall control, the
但し、この実施例では、主制御基板２１が出力する制御コマンドＣＭＤは、コマンド中継基板２６と演出インタフェイス基板２７を経由して、演出制御基板２２に伝送される。また、演出制御基板２２が出力する制御コマンドＣＭＤ’は、演出インタフェイス基板２７と画像インタフェイス基板２８を経由して、画像制御基板２３に伝送され、主制御基板２１が出力する制御コマンドＣＭＤ”は、主基板中継基板３２を経由して、払出制御基板２４に伝送される。制御コマンドＣＭＤ，ＣＭＤ’，ＣＭＤ”は、何れも１６ビット長であるが、主制御基板２１や払出制御基板２４が関係する制御コマンドは、８ビット長毎に２回に分けてパラレル送信されている。一方、演出制御基板２２から画像制御基板２３に伝送される制御コマンドＣＭＤ’は、１６ビット長をまとめてパラレル伝送されている。そのため、可動予告演出を含む予告演出を、多様化して多数の制御コマンドを連続的に送受信するような場合でも、迅速にその処理を終えることができ、他の制御動作に支障を与えない。
However, in this embodiment, the control command CMD output from the main control board 21 is transmitted to the
ところで、本実施例では、演出インタフェイス基板２７と演出制御基板２２とは、配線ケーブルを経由することなく、雄型コネクタと雌型コネクタとを直結されて二枚の回路基板が積層されている。同様に、画像インタフェイス基板２８と画像制御基板２３についても、配線ケーブルを経由することなく、雄型コネクタと雌型コネクタとを直結されて二枚の回路基板が積層されている。そのため、各電子回路の回路構成を複雑高度化しても基板全体の収納空間を最小化できると共に、接続ラインを最短化することで耐ノイズ性を高めることができる。
By the way, in the present embodiment, the
これら主制御基板２１、演出制御基板２２、画像制御基板２３、及び払出制御基板２４には、ワンチップマイコンを備えるコンピュータ回路がそれぞれ搭載されている。そこで、これらの制御基板２１〜２４とインタフェイス基板２７〜２８に搭載された回路、及びその回路によって実現される動作を機能的に総称して、本明細書では、主制御部２１、演出制御部２２’、画像制御部２３’、及び払出制御部２４と言うことがある。すなわち、この実施例では、演出制御基板２２と演出インタフェイス基板２７とで演出制御部２２’を構成し、画像制御基板２３と画像インタフェイス基板２８とで画像制御部２３’を構成している。なお、演出制御部２２’、画像制御部２３’、及び払出制御部２４の全部又は一部がサブ制御部である。
The main control board 21, the
また、このパチンコ機ＧＭは、図３の破線で囲む枠側部材ＧＭ１と、遊技盤５の背面に固定された盤側部材ＧＭ２とに大別されている。枠側部材ＧＭ１には、ガラス扉６や前面板７が枢着された前枠３と、その外側の木製外枠１とが含まれており、機種の変更に拘わらず、長期間にわたって遊技ホールに固定的に設置される。一方、盤側部材ＧＭ２は、機種変更に対応して交換され、新たな盤側部材ＧＭ２が、元の盤側部材の代わりに枠側部材ＧＭ１に取り付けられる。なお、枠側部材１を除く全てが、盤側部材ＧＭ２である。
The pachinko machine GM is roughly divided into a frame side member GM1 surrounded by a broken line in FIG. 3 and a board side member GM2 fixed to the back of the
図３の破線枠に示す通り、枠側部材ＧＭ１には、電源基板２０と、払出制御基板２４と、発射制御基板２５と、枠中継基板３５と、ランプ駆動基板３６とが含まれており、これらの回路基板が、前枠３の適所に各々固定されている。
As shown in the broken line frame in FIG. 3, the frame side member GM1 includes a
ランプ駆動基板３６には、複数のＬＥＤが接続されており、これらのＬＥＤ群を駆動する駆動データＳＤＡＴＡは、シリアル信号として、演出制御基板２２→演出インタフェイス基板２７→枠中継基板３４→枠中継基板３５を経由して、ランプ駆動基板３６に搭載された複数のＬＥＤドライバに伝送されている。
A plurality of LEDs are connected to the lamp drive board 36, and the drive data SDATA for driving these LED groups is a serial signal, the
遊技盤５の背面には、主制御基板２１、演出制御基板２２、画像制御基板２３が、表示装置ＤＳやその他の回路基板と共に固定されている。そして、枠側部材ＧＭ１と盤側部材ＧＭ２とは、一箇所に集中配置された接続コネクタＣ１〜Ｃ４によって電気的に接続されている。
On the back surface of the
電源基板２０は、接続コネクタＣ２を通して、主基板中継基板３２に接続され、接続コネクタＣ３を通して、電源中継基板３３に接続されている。電源基板２０には、交流電源の投入と遮断とを監視する電源監視部ＭＮＴが設けられている。電源監視部ＭＮＴは、交流電源が投入されたことを検知すると、所定時間だけシステムリセット信号ＳＹＳをＬレベルに維持した後に、これをＨレベルに遷移させる。
The
また、電源監視部ＭＮＴは、交流電源の遮断を検知すると、電源異常信号ＡＢＮ１，ＡＢＮ２を、直ちにＬレベルに遷移させる。なお、電源異常信号ＡＢＮ１，ＡＢＮ２は、電源投入後に速やかにＨレベルとなる。 Further, when power supply monitoring unit MNT detects the interruption of the AC power supply, power supply abnormality signals ABN1 and ABN2 are immediately shifted to the L level. The power supply abnormality signals ABN1 and ABN2 quickly become H level after the power is turned on.
ところで、本実施例のシステムリセット信号は、交流電源に基づく直流電源によって生成されている。そのため、交流電源の投入（通常は電源スイッチのＯＮ）を検知してＨレベルに増加した後は、直流電源電圧が異常レベルまで低下しない限り、Ｈレベルを維持する。したがって、直流電源電圧が維持された状態で、交流電源が瞬停状態となっても、システムリセット信号ＳＹＳがＣＰＵをリセットすることはない。なお、電源異常信号ＡＢＮ１，ＡＢＮ２は、交流電源の瞬停状態でも出力される。 Incidentally, the system reset signal of this embodiment is generated by a DC power supply based on an AC power supply. For this reason, after detecting the turning-on of the AC power supply (usually turning on the power switch) and increasing it to the H level, the H level is maintained unless the DC power supply voltage drops to an abnormal level. Therefore, even if the AC power supply is in an instantaneous power interruption state while the DC power supply voltage is maintained, the system reset signal SYS does not reset the CPU. The power supply abnormality signals ABN1 and ABN2 are also output even when the AC power supply is instantaneously stopped.
主基板中継基板３２は、電源基板２０から出力される電源異常信号ＡＢＮ１、バックアップ電源ＢＡＫ、及びＤＣ５Ｖ，ＤＣ１２Ｖ，ＤＣ３２Ｖを、そのまま主制御部２１に出力している。一方、電源中継基板３３は、電源基板２０から受けたシステムリセット信号ＳＹＳや、交流及び直流の電源電圧を、そのまま演出インタフェイス基板２７に出力している。演出インタフェイス基板２７は、受けたシステムリセット信号ＳＹＳを、そのまま演出制御部２２’と画像制御部２３’に出力している。
The main board relay board 32 outputs the power abnormality signal ABN1, the backup power supply BAK, and DC5V, DC12V, and DC32V output from the
一方、払出制御基板２４は、中継基板を介することなく、電源基板２０に直結されており、主制御部２１が受けると同様の電源異常信号ＡＢＮ２や、バックアップ電源ＢＡＫを、その他の電源電圧と共に直接的に受けている。
On the other hand, the
電源基板２０が出力するシステムリセット信号ＳＹＳは、電源基板２０に交流電源２４Ｖが投入されたことを示す電源リセット信号であり、この電源リセット信号によって演出制御部２２’と画像制御部２３’のワンチップマイコンは、その他のＩＣ素子と共に電源リセットされるようになっている。
The system reset signal SYS output from the
但し、このシステムリセット信号ＳＹＳは、主制御部２１と払出制御部２４には、供給されておらず、各々の回路基板２１，２４のリセット回路ＲＳＴにおいて電源リセット信号（ＣＰＵリセット信号）が生成されている。そのため、例えば、接続コネクタＣ２がガタついたり、或いは、配線ケーブルにノイズが重畳しても、主制御部２１や払出制御部２４のＣＰＵが異常リセットされるおそれはない。演出制御部２２’と画像制御部２３’は、主制御部２１からの制御コマンドに基づいて、従属的に演出動作を実行することから、回路構成の複雑化を回避するために、電源基板２０から出力されるシステムリセット信号ＳＹＳを利用している。
However, the system reset signal SYS is not supplied to the main control unit 21 and the
ところで、主制御部２１や払出制御部２４に設けられたリセット回路ＲＳＴは、各々ウォッチドッグタイマを内蔵しており、各制御部２１，２４のＣＰＵから、定時的なクリアパルスを受けない限り、各ＣＰＵは強制的にリセットされる。
By the way, the reset circuits RST provided in the main control unit 21 and the
また、この実施例では、ＲＡＭクリア信号ＣＬＲは、主制御部２１で生成されて主制御部２１と払出制御部２４のワンチップマイコンに伝送されている。ここで、ＲＡＭクリア信号ＣＬＲは、各制御部２１，２４のワンチップマイコンの内蔵ＲＡＭの全領域を初期設定するか否かを決定する信号であって、係員が操作する初期化スイッチＳＷのＯＮ／ＯＦＦ状態に対応した値を有している。
In this embodiment, the RAM clear signal CLR is generated by the main control unit 21 and transmitted to the one-chip microcomputer of the main control unit 21 and the
主制御部２１及び払出制御部２４は、電源基板２０から電源異常信号ＡＢＮ１，ＡＢＮ２を受けることによって、停電や営業終了に先立って、必要な終了処理を開始するようになっている。また、バックアップ電源ＢＡＫは、営業終了や停電により交流電源２４Ｖが遮断された後も、主制御部２１と払出制御部２４のワンチップマイコンの内蔵ＲＡＭのデータを保持するＤＣ５Ｖの直流電源である。したがって、主制御部２１と払出制御部２４は、電源遮断前の遊技動作を電源投入後に再開できることになる（電源バックアップ機能）。このパチンコ機では少なくとも数日は、各ワンチップマイコンのＲＡＭの記憶内容が保持されるよう設計されている。
The main control unit 21 and the
図３に示す通り、主制御部２１は、主基板中継基板３２を経由して、払出制御部２４に制御コマンドＣＭＤ”を送信する一方、払出制御部２４からは、遊技球の払出動作を示す賞球計数信号や、払出動作の異常に係わるステイタス信号ＣＯＮや、動作開始信号ＢＧＮを受信している。ステイタス信号ＣＯＮには、例えば、補給切れ信号、払出不足エラー信号、下皿満杯信号が含まれる。動作開始信号ＢＧＮは、電源投入後、払出制御部２４の初期動作が完了したことを主制御部２１に通知する信号である。
As shown in FIG. 3, the main control unit 21 transmits a control command CMD ″ to the
また、主制御部２１は、遊技盤中継基板３１を経由して、遊技盤５の各遊技部品に接続されている。そして、遊技盤上の各入賞口１６〜１８に内蔵された検出スイッチのスイッチ信号を受ける一方、電動式チューリップなどのソレノイド類を駆動している。ソレノイド類や検出スイッチは、主制御部２１から配電された電源電圧ＶＢ（１２Ｖ）で動作するよう構成されている。また、図柄始動口１５への入賞状態などを示す各スイッチ信号は、電源電圧ＶＢ（１２Ｖ）と電源電圧Ｖｃｃ（５Ｖ）とで動作するインタフェイスＩＣで、ＴＴＬレベル又はＣＭＯＳレベルのスイッチ信号に変換された上で、主制御部２１に伝送される。
The main control unit 21 is connected to each game component of the
先に説明した通り、演出制御基板２２と演出インタフェイス基板２７とはコネクタ連結によって一体化されており、演出制御部２２’は、電源中継基板３３を経由して、電源基板２０から各レベルの直流電圧（５Ｖ，１２Ｖ，３２Ｖ）と、システムリセット信号ＳＹＳを受けている（図３及び図４（ａ）参照）。また、演出制御部２２’は、コマンド中継基板２６を経由して、主制御部２１から制御コマンドＣＭＤとストローブ信号ＳＴＢとを受けている。
As described above, the
そして、演出制御部２２’は、演出インタフェイス基板２７を経由して、ランプ駆動基板２９やランプ駆動基板３０に搭載されたＬＥＤドライバに、ランプ駆動データＳＤＡＴＡ（シリアル信号）を供給している。特に限定されるものではないが、ランプ駆動基板２９，３０に搭載されているＬＥＤドライバは、ランプ駆動基板３６に搭載されたＬＥＤドライバと同一構成である。
Then, the
また、本実施例では同じＬＥＤドライバを使用してステッピングモータを駆動しており、破線に示すように、ランプ駆動基板３０を経由して、演出モータ群Ｍ１〜Ｍｎを駆動している。この場合、モータ駆動データは、ランプ駆動データと同様のシリアル信号であり、演出内容を豊富化するべく演出モータ個数を増やしても、配線ケーブルが増加することがなく、機器構成が簡素化される。
In this embodiment, the same LED driver is used to drive the stepping motor, and the production motor groups M1 to Mn are driven via the
図３及び図４（ａ）に示す通り、演出制御部２２’は、画像制御部２３’に対して、制御コマンドＣＭＤ’及びストローブ信号ＳＴＢ’と、電源基板２０から受けたシステムリセット信号ＳＹＳと、２種類の直流電圧（１２Ｖ，５Ｖ）とを出力している。
As shown in FIG. 3 and FIG. 4A, the
そして、画像制御部２３’では、制御コマンドＣＭＤ’に基づいて表示装置ＤＳを駆動して各種の画像演出を実行している。表示装置ＤＳは、ＬＥＤバックライトによって発光しており、画像インタフェイス基板２８から５対のＬＶＤＳ（低電圧差動伝送Low voltage differential signaling）信号と、バックライト電源電圧（１２Ｖ）とを受けて駆動されている（図４（ａ）参照）。
Then, the image controller 23 'drives the display device DS based on the control command CMD' to execute various image effects. The display device DS emits light by an LED backlight, and is driven by receiving five pairs of LVDS (Low voltage differential signaling) signals and a backlight power supply voltage (12 V) from the
続いて、上記した演出制御部２２’と画像制御部２３’の構成を更に詳細に説明する。図４（ａ）に示す通り、演出インタフェイス基板２７は、電源中継基板３３を経由して、電源基板２０から３種類の直流電圧（５Ｖ，１２Ｖ，３２Ｖ）を受けている。ここで、直流電圧５Ｖは、デジタル論理回路の電源電圧として、演出インタフェイス基板２７、ランプ駆動基板２９、ランプ駆動基板３０、画像インタフェイス基板２８、及び画像制御基板２３に配電されて各デジタル回路を動作させている。
Next, the configurations of the effect control unit 22 'and the image control unit 23' will be described in more detail. As shown in FIG. 4A, the
但し、演出制御基板２２には、直流電圧５Ｖが配電されておらず、１２ＶからＤＣ／ＤＣコンバータで降圧された直流電圧３．３Ｖと、３．３ＶからＤＣ／ＤＣコンバータで更に降圧された直流電圧１．８Ｖだけが、演出インタフェイス基板２７から演出制御基板２２に配電されている。
However, the direct
このように、本実施例の演出制御基板２２は、全ての回路が、電源電圧３．３Ｖ又はそれ以下の電源電圧で駆動されているので、電源電圧を５Ｖで動作する場合と比較して大幅に低電力化することができ、仮に、演出制御基板２２の直上に演出インタフェイス基板２７を配置して積層しても放熱上の問題が生じない。
In this way, the
但し、電源基板２０から受けた直流電圧１２Ｖは、そのままデジタルアンプ４６の電源電圧Ｖｄｄとして使用されると共に、ランプ駆動基板３０とランプ駆動基板２９に配電されて各ランプ群の電源電圧となる。また、直流電圧３２Ｖは、演出インタフェイス基板のＤＣ／ＤＣコンバータにおいて直流電圧１３Ｖに降圧されて、必要に応じて、演出モータＭ１〜Ｍｎの駆動電源として使用される。
However, the
図４（ａ）に示すように、演出制御部２２’は、音声演出・ランプ演出・演出可動体による予告演出・データ転送などの処理を実行するワンチップマイコン４０と、ワンチップマイコン４０の制御プログラムなどを記憶する制御メモリ（flash memory）４１と、ワンチップマイコン４０からの指示（音声コマンドＳＮＤ）に基づいて音声信号を再生して出力する音声合成回路４２と、再生すべき音声信号の元データである圧縮音声データやＳＡＣデータを記憶する音声メモリ４３と、クリアパルスが途絶えるとワンチップマイコン４０を強制的にクリアするウォッチドッグタイマＷＤＴと、を備えて構成されている。
As shown in FIG. 4A, the
なお、ワンチップマイコン４０、フラッシュメモリ４１、及び音声メモリ４３は、電源電圧３．３Ｖで動作しており、また、音声合成回路４２は、電源電圧３．３Ｖ及び電源電圧１．８Ｖで動作しており大幅な省電力化が実現されている。ここで、１．８Ｖは、音声合成回路４２のコンピュータ・コア部の電源電圧であり、３．３Ｖは、Ｉ／Ｏ部の電源電圧である。
The one-
図示の通り、音声合成回路４２が出力する音声信号は、４ビット長の一方向シリアル回線（LRCLK,SCLK,SD0,SD1）を通して、デジタルアンプ４６に伝送されている。また、ワンチップマイコン４０と音声合成回路４２とは、２ビット長のシリアル送受信線ＴＸＤ，ＲＸＤと、制御信号線ＲＴＳで接続されている。
As shown in the figure, the audio signal output from the
そして、この実施例では、ワンチップマイコン４０の送信端子ＴＸＤから音声合成回路４２の受信端子ＲＸＤに向けて音声コマンドＳＮＤが伝送される一方、音声合成回路４２の送信端子ＴＸＤからワンチップマイコン４０の受信端子ＲＸＤに向けて、通信エラーなどを示すステイタス情報ＳＴＳが伝送されるよう構成されている。
In this embodiment, the voice command SND is transmitted from the transmission terminal TXD of the one-
本実施例の場合、音声メモリ４３に記憶された圧縮音声データは、１３ビット長のフレーズ番号（０００Ｈ〜１ＦＦＦＨ）で特定されるフレーズ（phrase）圧縮データであり、一連の背景音楽の一曲分（ＢＧＭ）や、ひと纏まりの演出音（予告音）などが、最高８１９２種類（＝２１３）、各々、フレーズ番号に対応して記憶されている。そして、このフレーズ番号は、ワンチップマイコン４０から音声合成回路４２にシリアル伝送される音声コマンドＳＮＤによって特定される。
In the case of the present embodiment, the compressed audio data stored in the
本実施例の場合、音声コマンドＳＮＤは、所定の音声制御レジスタ５１（図５（ｂ））に、フレーズ番号などの設定値を書込むWrite 用途だけでなく、所定の音声制御レジスタ５１からステイタス情報ＳＴＳを読み出すRead用途で使用される。なお、音声制御レジスタ５１は、１バイト長のレジスタアドレスで特定される。 In the case of the present embodiment, the voice command SND is not only used for writing to write a set value such as a phrase number into the predetermined voice control register 51 (FIG. 5B), but also from the predetermined voice control register 51. It is used for Read applications that read STS. The voice control register 51 is specified by a 1-byte register address.
ところで、音声制御レジスタ５１への設定値の設定（Write ）は、必ずしも、音声制御レジスタ毎に個別的に実行する必要はなく、音声メモリ４３に格納されているＳＡＣデータを指定して、サウンドコントロールモジュール５２のシンプルアクセスコントローラ（図５（ｂ））の内部動作を起動させ、一群の音声制御レジスタ５１に対する一連の設定動作を完了させることもできる。
By the way, setting (Write) of the set value to the sound control register 51 is not necessarily executed individually for each sound control register, and the sound control is performed by designating the SAC data stored in the
ここで、ＳＡＣデータとは、音声制御レジスタ５１のレジスタアドレス（１バイト）と、その音声制御レジスタ５１への設定値（複数バイト）とを対応させた最大５１２個（最大１０２４バイト）の集合体を意味する。本実施例では、このようなＳＡＣデータが、必要組だけ、予め音声メモリ４３に記憶されており、一組のＳＡＣデータは、単一のＩＤ情報である１３ビット程度のＳＡＣ番号で特定されるようになっている。
Here, the SAC data is an aggregate of a maximum of 512 pieces (up to 1024 bytes) in which a register address (1 byte) of the voice control register 51 is associated with a set value (a plurality of bytes) in the voice control register 51. Means. In the present embodiment, only a necessary set of such SAC data is stored in the
本実施例の場合、Write 用途の音声コマンドＳＮＤは、ＳＡＣ番号を指定して一組のＳＡＣデータを特定するか、或いは、設定値とレジスタアドレスとを個別的に特定する構成になっている。但し、Write 用途かRead用途かに拘わらず、音声コマンドＳＮＤは、複数（２又は３）バイト長であって、１バイト毎に調歩同期方式でシリアル伝送される。なお、スタートビットと、ストップビットと、パリティビットとを含むので、実際の通信単位は１１ビット長となる（図５（ａ）参照）。 In the case of this embodiment, the voice command SND for writing is configured to specify a set of SAC data by specifying a SAC number, or to specify a set value and a register address individually. However, the voice command SND has a plurality (2 or 3) bytes in length and is serially transmitted in an asynchronous manner for each byte regardless of whether it is a write application or a read application. Since the start bit, stop bit, and parity bit are included, the actual communication unit is 11 bits long (see FIG. 5A).
図４（ａ）に示す通り、ワンチップマイコン４０には、複数のパラレル入出力ポートＰＩＯ（Ｐｉ１，Ｐｉ２，Ｐｏ１，Ｐｏ２）と、クロック同期方式で動作する複数のシリアル入出力ポートＳＩと、調歩同期方式で動作するシリアル入出力ポートＵＡＲＴと、が内蔵されている。
As shown in FIG. 4A, the one-
ここで、シリアル入出力ポートＵＡＲＴは、（１）ＳＡＣ番号を指定して、サウンドコントロールモジュール５２のシンプルアクセスコントローラを起動させ、一群の設定値を、一群の音声制御レジスタ５１（図５（ｂ））に書込ませるシリアル送信動作と、（２）音声合成回路４２に対する動作指示やフレーズ番号を、これに対応する音声制御レジスタ５１（図５（ｂ））に個別的に書込むシリアル送信動作と、（３）所定の音声制御レジスタ５１から、ステイタス情報ＳＴＳを読み出すシリアル受信動作とを実現する部分である。
Here, the serial input / output port UART (1) designates a SAC number, activates the simple access controller of the sound control module 52, and sets a group of set values as a group of audio control registers 51 (FIG. 5B). And (2) a serial transmission operation for individually writing an operation instruction and a phrase number to the
シリアル送受信処理による何れの動作も、音声合成回路４２に対して、送信動作か受信動作かを特定した複数バイト長の音声コマンドＳＮＤを送信することで実行される。例えば、ＳＡＣ番号を送信するシリアル送信動作（１）は、１３ビット長のＳＡＣ番号を含んだ３バイト長の音声コマンドＳＮＤ（送信動作用）を、音声合成回路４２に送信することで実現される。
Any operation by the serial transmission / reception processing is executed by transmitting a voice command SND having a multi-byte length specifying whether the operation is a transmission operation or a reception operation to the
また、個別のシリアル送信動作（２）は、通常、音声制御レジスタ５１を特定する１バイト長のアドレスデータ（レジスタアドレス）と、１バイト長の書込みデータと、を含んだ３バイト長の音声コマンドＳＮＤ（送信動作用）を、音声合成回路４２に送信することで実現される。なお、レジスタアドレスを含まない、書込みデータだけの２バイト長の音声コマンドＳＮＤ（送信動作用）も存在するが、これについては後述する。
In addition, the individual serial transmission operation (2) is usually performed by a 3-byte voice command including 1-byte address data (register address) specifying the voice control register 51 and 1-byte write data. This is realized by transmitting the SND (for transmission operation) to the
一方、シリアル受信動作（３）は、ステイタス情報ＳＴＳを保有する音声制御レジスタ５１を特定するレジスタアドレスを含んだ２バイト長の音声コマンドＳＮＤ（受信動作用）を、音声合成回路４２に送信することで開始される。そして、受信動作用の音声コマンドＳＮＤを受けた音声合成回路４２は、必要なステイタス情報ＳＴＳを音声制御レジスタ５１から読み出して、２バイト長の返送データとして、ワンチップマイコン４０にシリアル送信する。したがって、シリアル入出力ポートＵＡＲＴは、その後、シリアル受信動作によってステイタス情報ＳＴＳを取得することになる。
On the other hand, in the serial reception operation (3), a 2-byte long voice command SND (for reception operation) including a register address specifying the voice control register 51 having the status information STS is transmitted to the
このような動作を実現するため、音声合成回路４２にも、ワンチップマイコン４０のシリアル入出力ポートＵＡＲＴに対応するＵＡＲＴ（Universal Asynchronous Receiver Transmitter ）ポートが内蔵されているが、これらの回路構成や回路動作については、図５に基づいて後述する。
In order to realize such an operation, the
本実施例では、上記した調歩同期方式で動作するシリアル入出力ポートＵＡＲＴとは別に、クロック同期方式で動作するシリアル入出力ポートＳＩが設けられている。ここで、シリアル入出力ポートＳＩは、３チャンネルのシリアル出力ポート（Ｓ０〜Ｓ２）を含んで構成されており、ランプ駆動基板３６、２９、３０に搭載された複数個のＬＥＤドライバに、各々、シリアル駆動データＳＤＡＴＡ０〜ＳＤＡＴＡ２を、クロック信号ＣＫ０〜ＣＫ２に同期して出力している。
In the present embodiment, a serial input / output port SI that operates in a clock synchronous system is provided in addition to the serial input / output port UART that operates in the asynchronous system described above. Here, the serial input / output port SI includes three channels of serial output ports (S0 to S2), and each of the plurality of LED drivers mounted on the
すなわち、シリアル出力ポートＳ０〜シリアル出力ポートＳ２は、クロック同期方式に基づいて、対応するランプ駆動基板３６、２９、３０に、シリアル駆動データＳＤＡＴＡ０〜ＳＤＡＴＡ２を伝送している。なお、シリアル駆動データＳＤＡＴＡ０〜ＳＤＡＴＡ２は、その殆どが、各ＬＥＤの発光輝度をＰＷＭ制御（pulse width modulation）によって輝度調整するため輝度データ（ランプ駆動データ）であるが、演出モータＭ１〜Ｍｎを駆動するモータ駆動データも含まれている。
That is, the serial output port S0 to serial output port S2 transmit serial drive data SDATA0 to SDATA2 to the corresponding
図示の通り、ランプ駆動基板３６、２９、３０は、パラレル入出力ポートＰＩＯのパラレル出力ポートＰｏ２にも接続されており、各ランプ駆動基板３６、２９、３０に搭載されたＬＥＤドライバは、パラレル出力ポートＰｏ２が出力する３ビット長の動作許可信号ＥＮＡＢＬＥ０〜ＥＮＡＢＬＥ２の何れかに基づいて動作を開始している。また、出力ポートＰｏ２からは、デジタルアンプ４６の出力を無音化するためのＭＵＴＥ信号が出力されている。このＭＵＴＥ信号は、例えば、動作が不安定となる可能性のある電源投入時や、デジタルアンプ４６や音声合成回路４２の異常動作が検出された場合などに使用される。
As shown in the figure, the
一方、パラレル入出力ポートＰＩＯの入力ポートＰｉ１には、主制御部２１からの制御コマンドＣＭＤ及びストローブ信号ＳＴＢが入力され、コマンド出力ポートＰｏ１からは、制御コマンドＣＭＤ’及びストローブ信号ＳＴＢ’が出力されるよう構成されている。 On the other hand, the control command CMD and the strobe signal STB from the main control unit 21 are input to the input port Pi1 of the parallel input / output port PIO, and the control command CMD ′ and the strobe signal STB ′ are output from the command output port Po1. It is comprised so that.
具体的には、入力ポートＰｉ１には、主制御基板２１から出力された制御コマンドＣＭＤとストローブ信号（割込み信号）ＳＴＢとが、演出インタフェイス基板２７のバッファ４４において、電源電圧３．３Ｖに対応する論理レベルに変換されて８ビット単位で供給される。割込み信号ＳＴＢは、ワンチップマイコンの割込み端子に供給され、受信割込み処理によって、演出制御部２２’は、制御コマンドＣＭＤを取得するよう構成されている。
Specifically, a control command CMD and a strobe signal (interrupt signal) STB output from the main control board 21 correspond to the power supply voltage 3.3 V in the buffer 44 of the
また、パラレルポートＰｉ２には、デジタルアンプ４６が、自らの内部動作に関して異常を検知したことを示す異常通知信号ＥＲＲと、係員が操作する設定スイッチＳＥＴからのスイッチ信号とが、演出インタフェイス基板２７を経由して供給されている。
The parallel port Pi2 also includes an abnormality notification signal ERR indicating that the
本実施例の場合、デジタルアンプ４６が検出可能な異常は、主として、デジタルアンプ４６の内部回路の動作に関するものであって、（１）過電流異常、（２）高温異常、（３）音声信号が変化しないＤＣ検出異常と、が含まれている。過電流異常やＤＣ検出異常が検出されると、デジタルアンプ４６は、所定時間τだけ、スピーカへの一対の出力端子ＯＵＴ＋ＯＵＴ−を共にグランドレベル（ＨｉＺグランド状態）に降下させて音声出力を遮断するものの、その後は、元の動作状態に自動復帰する。したがって、異常原因が解消されていない限り、デジタルアンプ４６は、同じ動作を繰り返すことになり、抜本的は異常解消手段を持つものではない。
In this embodiment, the abnormality detectable by the
この点は、高温異常検出についても同じであり、高温異常時に、デジタルアンプ４６は、音声出力を抑制又は遮断することで温度低下を図るだけである。そのため、温度が低下して音声出力を通常レベルに戻した後に、再度、高温異常になると、デジタルアンプ４６が同じ動作を繰り返すことになり、異常な音声レベルの音声演出が繰り返される。
This point is the same for the detection of high temperature abnormality, and at the time of high temperature abnormality, the
そこで、本実施例では、異常通知信号ＥＲＲを、ワンチップマイコン４０が定期的にチェックして、異常検出時には、デジタルアンプ４６の異常解消のための措置を採るようにしている。なお、具体的な手法は、図８に基づいて後述する。
Therefore, in this embodiment, the one-
ところで、演出制御部２２’が主制御部２１から取得する制御コマンドＣＭＤには、（１）異常報知その他の報知用制御コマンドなどの他に、（２）図柄始動口への入賞に起因する各種演出動作の概要特定する制御コマンド（変動パターンコマンド）や、図柄種別を指定する制御コマンド（図柄指定コマンド）が含まれている。ここで、変動パターンコマンドで特定される演出動作の概要には、演出開始から演出終了までの演出総時間と、大当たり抽選における当否結果とが含まれている。
By the way, the control command CMD that the
また、図柄指定コマンドには、大当たり抽選の結果に応じて、大当たりの場合には、大当たり種別に関する情報（１５Ｒ確変、２Ｒ確変、１５Ｒ通常、２Ｒ通常など）を特定する情報が含まれ、ハズレの場合には、ハズレを特定する情報が含まれている。変動パターンコマンドで特定される演出動作の概要には、演出開始から演出終了までの演出総時間と、大当り抽選における当否結果とが含まれている。なお、これらに加えて、リーチ演出や予告演出の有無などを含めて変動パターンコマンドで特定しても良いが、この場合でも、演出内容の具体的な内容は特定されていない。 In addition, the symbol designating command includes information for identifying information on the jackpot type (15R probability variation, 2R probability variation, 15R normal, 2R normal, etc.) in the case of a jackpot according to the result of the jackpot lottery. In some cases, information for identifying a loss is included. The outline of the production operation specified by the variation pattern command includes the production total time from the production start to the production end, and the result of success or failure in the big hit lottery. In addition to these, the change pattern command including the presence or absence of the reach effect or the notice effect may be specified, but even in this case, the specific content of the effect content is not specified.
そのため、演出制御部２２’では、変動パターンコマンドを取得すると、これに続いて演出抽選を行い、取得した変動パターンコマンドで特定される演出概要を更に具体化している。例えば、リーチ演出や予告演出について、その具体的な内容が決定される。そして、決定された具体的な遊技内容にしたがい、ＬＥＤ群などの点滅によるランプ演出や、スピーカによる音声演出の準備動作を行うと共に、画像制御部２３’に対して、ランプやスピーカによる演出動作に同期した画像演出に関する制御コマンドＣＭＤ’を出力する。
Therefore, when the change pattern command is acquired, the
このような演出動作に同期した画像演出を実現するため、演出制御部２２’は、コマンド出力ポートＰｏ１を通して、画像制御部２３’に対するストローブ信号（割込み信号）ＳＴＢ’と共に、１６ビット長の制御コマンドＣＭＤ’を演出インタフェイス基板２７に向けて出力している。なお、演出制御部２２’は、図柄指定コマンドや、表示装置ＤＳに関連する報知用制御コマンドや、その他の制御コマンドを受信した場合は、その制御コマンドを、１６ビット長に纏めた状態で、割込み信号ＳＴＢ’と共に演出インタフェイス基板２７に向けて出力している。
In order to realize such an image effect synchronized with the effect operation, the
上記した演出制御基板２２の構成に対応して、演出インタフェイス基板２７には出力バッファ４５が設けられており、１６ビット長の制御コマンドＣＭＤ’と１ビット長の割込み信号ＳＴＢ’を画像インタフェイス基板２８に出力している。そして、これらのデータＣＭＤ’，ＳＴＢ’は、画像インタフェイス基板２８を経由して、画像制御基板２３に伝送される。
Corresponding to the configuration of the
また、演出インタフェイス基板２７には、音声合成回路４２から出力される音声信号を受けるデジタルアンプ４６が配置されている。先に説明した通り、音声合成回路４２は、３．３Ｖと１．８Ｖの電源電圧で動作しており、また、デジタルアンプ４６は、電源電圧Ｖｄｄ（＝１２Ｖ）でＤ級増幅動作しており、消費電力を抑制しつつ大音量の音声演出を可能にしている。
The
なお、デジタルアンプ４６が、ワンチップマイコン４０からＭＵＴＥ信号を受けることがあること、及び、異常検出時には、デジタルアンプ４６が、ワンチップマイコン４０に異常通知信号ＥＲＲを出力することも先に説明した通りである。
As described above, the
また、図４（ａ）に示す通り、演出インタフェイス基板２７には、ワンチップマイコン４０のパラレル出力ポートＰｏ２や、シリアル出力ポートＳＩ（Ｓ０〜Ｓ２）から出力される各種の信号を伝送する出力バッファ回路４７，４８，４９が設けられている。ここで、出力バッファ４７は、第０チャンネルのＬＥＤ群に関連しており、ワンチップマイコン４０が出力するランプ駆動データＳＤＡＴＡ０、クロック信号ＣＫ０、及び、動作許可信号ＥＮＡＢＬＥ０を、枠中継基板３４に出力している。そして、出力された３ビットの信号は、枠中継基板３４、及び、枠中継基板３５を経由して、ランプ駆動基板３６のＬＥＤドライバに伝送される。
Further, as shown in FIG. 4A, the
同様に、出力バッファ４８は、ワンチップマイコン４０が出力するランプ駆動データＳＤＡＴＡ１、クロック信号ＣＫ１、及び、動作許可信号ＥＮＡＢＬＥ１をランプ駆動基板２９のＬＥＤドライバに伝送しており、出力バッファ４９は、ランプ駆動データＳＤＡＴＡ２、クロック信号ＣＫ２、及び、動作許可信号ＥＮＡＢＬＥ２をランプ駆動基板３０のＬＥＤドライバに伝送している。なお、ランプ駆動基板２９のＬＥＤドライバは、第１チャンネルのＬＥＤ群を駆動し、ランプ駆動基板３０のＬＥＤドライバは、第２チャンネルのＬＥＤ群と、演出モータＭ１〜Ｍｎとを駆動している。
Similarly, the output buffer 48 transmits the lamp drive data SDATA1, the clock signal CK1, and the operation enable signal ENABLE1 output from the one-
図５（ｂ）は、音声合成回路４２の概略内部構成と、ワンチップマイコン４０（ホストＣＰＵ）と、音声メモリ４３と、デジタルアンプ４６との接続関係を図示したものである。また、図５（ａ）は、ワンチップマイコン４０と音声合成回路４２と間のシリアルデータ送受信時のデータフォーマットを示し、図５（ｃ）は、音声合成回路４２からデジタルアンプ４６に出力される音声データのデータフォーマットを示している。
FIG. 5B illustrates a schematic internal configuration of the
図５（ｂ）に示す通り、音声合成回路４２は、シリアル通信回線を通してホストＣＰＵ４０からアクセス可能な多数の音声制御レジスタ５１と、音声再生動作を統括的に制御するサウンドコントロールモジュール５２と、音声メモリ４３から読み出されたフレーズ圧縮データをデコード（decode）すると共に、複数のフレーズ再生チャンネルＣＨ０〜ＣＨ１５のデコードデータを適宜な音量比率で混合させるメインジェネレータ５３と、デジタルフィルタ処理によって所望の周波数特性を実現するイコライザ機能や入出力ゲイン特性を変化させるコンプレッサ機能を実現するエフェクト部５４と、最終音量を規定するトータルボリュームＴＶと、シリアル伝送用の４種類の信号ＳＣＬＫ，ＬＲＣＬＫ，ＳＤ０，ＳＤ１を生成するデジタルＩＦ部５５と、を備えて構成されている。
As shown in FIG. 5B, the
サウンドコントロールモジュール５２には、シンプルアクセルコントローラが含まれている。先に説明した通り、シンプルアクセルコントローラは、ワンチップマイコン４０からＳＡＣ番号を特定した音声コマンドＳＮＤを受けた場合に、ＳＡＣ番号に対応する一群のＳＡＣデータを音声メモリ４３から読み出し、ＳＡＣデータに含まれる一連の設定値を、ＳＡＣデータが指定する一群の音声制御レジスタ５１に設定する。
The sound control module 52 includes a simple accelerator controller. As described above, when receiving the voice command SND specifying the SAC number from the one-
また、サウンドコントロールモジュール５２には、音声メモリ４３の一群のフレーズ圧縮データを、自動的に読み出して再生する自動演奏機能を発揮するシーケンサも含まれている。なお、自動演奏すべき一群のフレーズ圧縮データは、予め音声メモリに格納されているシーケンスコードで特定される。
The sound control module 52 also includes a sequencer that exhibits an automatic performance function for automatically reading and reproducing a group of phrase compressed data of the
また、音声合成回路４２の音声制御レジスタ５１は、音声合成回路４２を意図した通りに機能させるために、ホストＣＰＵ４０が書込みデータをWrite 処理する書込みレジスタと、音声合成回路４２の動作状態を把握するために、ホストＣＰＵ４０がステイタス情報ＳＴＳをRead処理する読出しレジスタと、に区分されている。なお、書込みレジスタや読出しレジスタは、１バイト長又は複数バイト長である。
Further, the voice control register 51 of the
書込みレジスタへの書込みデータには、（１）再生すべきＢＧＭ音や演出音を特定するフレーズ番号、（２）その再生音のボリューム（Ｖ１，Ｖ２）指示、（３）再生回数を規定するループ指示、（４）再生開始や一時停止などの動作指示、（５）再生開始時や再生終了時などの音量遷移態様の指示、（６）左右スピーカＳＰＬ，ＳＰＲの音量バランスであるパンポットの指示、（７）最終的なボリューム（ＴＶ）指示などが含まれている。 The write data to the write register includes (1) a phrase number for specifying a BGM sound or effect sound to be reproduced, (2) a volume (V1, V2) instruction of the reproduced sound, and (3) a loop defining the number of times of reproduction. Instruction, (4) operation instruction such as playback start or pause, (5) instruction of volume transition mode such as playback start or playback end, and (6) pan pot which is the volume balance of left and right speakers SP L and SP R (7) Final volume (TV) instruction and the like.
本実施例の場合、一まとまり一群の音声指示は、ＳＡＣデータとして音声メモリ４３に格納されており、ワンチップマイコン４０は、ＳＡＣデータを特定するＳＡＣ番号を含んだ音声コマンドＳＮＤをシリアル送信することで、サウンドコントロールモジュール５２のシンプルアクセスコントローラを起動させ、一群の音声指示を、対応する音声制御レジスタに設定させる構成を採っている。
In the case of the present embodiment, a group of voice instructions is stored in the
ところで、音声指示には、音声合成回路４２の内部回路を、初期状態に設定するためのリセット指示（８）も含まれている。このリセット指示は、初期化コマンド（音声コマンドの一種）として、電源投入時に送信されるだけでなく、異常な音声演出を解消ないし未然防止するために送信されることがある。
Incidentally, the voice instruction includes a reset instruction (8) for setting the internal circuit of the
そして、（１）〜（８）の音声指示は、送信動作用の音声コマンドＳＮＤとして、ワンチップマイコン４０から音声合成回路４２にシリアル送信される。ここで、送信動作用の音声コマンドＳＮＤは、１バイト長の書込みデータと、これを書込むべき音声制御レジスタ５１を特定するレジスタアドレス（１バイト長）とを含んだ３バイト長か、レジスタアドレスを含まない２バイト長か、或いは、１３ビット長のＳＡＣ番号を含んだ３バイト長である。
The voice instructions (1) to (8) are serially transmitted from the one-
レジスタアドレスを含まない送信動作用の音声コマンドＳＮＤの書込みデータ（２バイト長）は、最後に特定された音声制御レジスタ５１に書込まれる。このような動作は、複数バイト長の書込みレジスタに対する一連のWrite 処理に使用される。例えば、フレーズ番号は、１３ビット長であるので、２つの音声コマンドＳＮＤに分解して送信され、１個目の音声コマンドＳＮＤ（３バイト長）で、音声制御レジスタ５１（フレーズ番号を書込むべき音声制御レジスタ）と、フレーズ番号の一部とを特定し、２個目の音声コマンドＳＮＤ（２バイト長）で、フレーズ番号の残りを特定する。 Write data (2-byte length) of the voice command SND for transmission operation not including the register address is written into the voice control register 51 specified last. Such an operation is used for a series of write processing for a write register having a length of a plurality of bytes. For example, since the phrase number has a 13-bit length, it is disassembled into two voice commands SND and transmitted, and the voice control register 51 (phrase number should be written with the first voice command SND (3 bytes length). The voice control register) and a part of the phrase number are specified, and the rest of the phrase number is specified by the second voice command SND (2 bytes length).
なお、（１）フレーズ番号の指定、（２）ボリューム（Ｖ１／Ｖ２）指示、（３）ループ指示、（４）動作指示、（５）音声遷移態様の指示、及び（６）パンポット指示は、全て、デコーダ６０のフレーズ再生チャンネルＣＨ０〜ＣＨ１５を指定して行われるよう構成されている。そのため、フレーズ再生チャンネルＣＨ０〜ＣＨ１５に対応して、最高１６種類のフレーズ圧縮データが、各々、上記の指示（１）〜（６）に基づいて独立して再生され、チャンネルミックス部６１でミキシングされて出力されることになる。
Note that (1) phrase number designation, (2) volume (V1 / V2) instruction, (3) loop instruction, (4) operation instruction, (5) voice transition mode instruction, and (6) panpot instruction All are configured to be performed by designating the phrase reproduction channels CH0 to CH15 of the
続いて、ワンチップマイコン４０のシリアル送受信処理を説明するため、図５（ｂ）に基づいて、ワンチップマイコン４０のシリアル入出力ポートＵＡＲＴの回路構成を説明する。
Subsequently, in order to describe the serial transmission / reception processing of the one-
図示の通り、シリアル入出力ポートＵＡＲＴは、送信／受信レジスタＲＥＧと、通信制御レジスタＦＧとを有し、各々、ＣＰＵがアクセス可能に構成されている。また、送信／受信レジスタＲＥＧには、送信用のシフトレジスタＳＲｔと、受信用のシフトレジスタＳＲｒとが内部接続されている。 As shown in the figure, the serial input / output port UART has a transmission / reception register REG and a communication control register FG, and each is configured to be accessible by the CPU. The transmission / reception register REG is internally connected with a transmission shift register SRt and a reception shift register SRr.
通信制御レジスタＦＧは、複数バイト長であって各種の機能を有するが、第一に、シリアル入出力ポートＵＡＲＴを、送信モードで使用するか、受信モードで使用するかを指定する用途で使用される。また、通信制御レジスタＦＧは、シリアル送信完了時や、シリアル受信完了時には、その旨の完了フラグがセットされ、通信異常時にはエラーフラグがセットされるよう構成されている。そして、これら送信完了フラグ、受信完了フラグ、及び、エラーフラグは、ＣＰＵから読出し可能に構成されている。 The communication control register FG is a plurality of bytes long and has various functions. First, it is used for specifying whether the serial input / output port UART is used in the transmission mode or the reception mode. The The communication control register FG is configured such that when serial transmission is completed or serial reception is completed, a completion flag to that effect is set, and an error flag is set when communication is abnormal. The transmission completion flag, the reception completion flag, and the error flag are configured to be readable from the CPU.
送信／受信レジスタＲＥＧは、シリアル入出力ポートＵＡＲＴを、送信モードで使用するか、受信モードで使用するかに応じて、送信レジスタＲＥＧか又は受信レジスタＲＥＧとして機能する。そして、送信モード時に、ＣＰＵが送信レジスタＲＥＧに１バイトデータを書込むと、これが自動的にシフトレジスタＳＲｔに転送され、シフトレジスタＳＲｔからデータ出力端子ＴＸＤを経由してシリアルデータが出力される。このシリアルデータは、予め指定された転送速度（ボーレート）で出力され、シリアル送信が完了すると、通信制御レジスタＦＧの送信完了フラグがセットされる。 The transmission / reception register REG functions as the transmission register REG or the reception register REG depending on whether the serial input / output port UART is used in the transmission mode or the reception mode. In the transmission mode, when the CPU writes 1-byte data in the transmission register REG, it is automatically transferred to the shift register SRt, and serial data is output from the shift register SRt via the data output terminal TXD. This serial data is output at a transfer rate (baud rate) designated in advance, and when serial transmission is completed, a transmission completion flag in the communication control register FG is set.
但し、このシリアル入出力ポートＵＡＲＴは、調歩同期方式で機能するので、シリアル送信データは、実際には、スタートビットやストップビットやパリティビットを付加した１１ビット長となる（図５（ａ）参照）。なお、非通信状態では、データ入力端子ＲＸＤ及びデータ出力端子ＴＸＤは定常的にＨレベルであり、スタートビット＝Ｌレベル、ストップビット＝Ｈレベルとなる。 However, since this serial input / output port UART functions in an asynchronous manner, the serial transmission data is actually 11 bits long with a start bit, a stop bit, and a parity bit added (see FIG. 5A). ). In the non-communication state, the data input terminal RXD and the data output terminal TXD are constantly at the H level, and the start bit = L level and the stop bit = H level.
先に説明した通り、送信動作用の音声コマンドＳＮＤは、２バイトまたは３バイト長であるので、上記した一単位のシリアル送信処理が２回又は３回繰り返されることで、音声コマンドＳＮＤ一個分のシリアル送信が終了する。一方、受信動作用の音声コマンドＳＮＤは、２バイト長であるので、一単位のシリアル送信処理を２回繰り返して、前半の処理、つまり、取得したいステイタス情報ＳＴＳを保有する音声制御レジスタ５１を特定する処理が終了する。そのため、ＣＰＵは、前半のシリアル送信処理が終われば、シリアル入出力ポートＵＡＲＴを送信モードから受信モードに変更して、音声合成回路４２から、ステイタス情報ＳＴＳをシリアル受信する必要がある。
As described above, since the voice command SND for transmission operation is 2 bytes or 3 bytes long, the above-described one unit serial transmission process is repeated twice or three times, so that one voice command SND is obtained. Serial transmission ends. On the other hand, since the voice command SND for reception operation is 2 bytes long, the serial transmission process of one unit is repeated twice to identify the first half process, that is, the voice control register 51 holding the status information STS to be acquired. The process to complete is completed. Therefore, the CPU needs to change the serial input / output port UART from the transmission mode to the reception mode and serially receive the status information STS from the
本実施例において、ワンチップマイコン４０が実行するシリアル受信処理は、上記したシリアル送信処理に続く、後半の処理を意味する。このような場合であって、シリアル入出力ポートＵＡＲＴが受信モードで機能している場合には、データ入力端子ＲＸＤがＬレベルに遷移するのが監視され、スタートビットが認識された後は、予め指定された転送速度にしたがって、受信データが、１ビット毎にシフトレジスタＳＲｒに取得される。そして、ストップビットが検出されると、取得した１バイトデータが、シフトレジスタＳＲｒから受信レジスタＲＥＧに転送され、通信制御レジスタＦＧの受信完了フラグがセットされる。
In this embodiment, the serial reception process executed by the one-
但し、通信エラーが検出された場合には、通信制御レジスタＦＧのエラーフラグがセットされる。したがって、ＣＰＵは、通信制御レジスタＦＧのエラーフラグから、受信データの正当性を確認することができる。なお、検出される通信エラーには、パリティエラー、フレーミングエラー、及び、オーバーランエラーが含まれている。パリティエラーとは、パリティビットが他の８ビットデータと整合していないことを意味し、フレーミングエラーとは、ストップビットが正当に取得できなかったことを意味する。また、オーバーランエラーは、受信レジスタＲＥＧに格納された受信データの処理前に次の受信データが上書きされたことを意味する。 However, when a communication error is detected, an error flag of the communication control register FG is set. Therefore, the CPU can confirm the validity of the received data from the error flag of the communication control register FG. The detected communication error includes a parity error, a framing error, and an overrun error. The parity error means that the parity bit is not consistent with the other 8-bit data, and the framing error means that the stop bit cannot be acquired properly. An overrun error means that the next received data is overwritten before the received data stored in the receiving register REG is processed.
以上、ワンチップマイコン４０のシリアル入出力ポートＵＡＲＴについて説明したので、音声合成回路４２のＵＡＲＴポートについて説明する。音声合成回路４２のＵＡＲＴポートは、送信用のＦＩＦＯバッファと、受信用のＦＩＦＯバッファと、ハードウェアフロー制御部（不図示）とを有して構成されている。なお、送信用と受信用のＦＩＦＯバッファは、各々、１６バイト程度の記憶容量を有している。
Since the serial input / output port UART of the one-
そして、シリアル送受信処理は、サウンドコントロールモジュール５２において制御され、不図示のハードウェアフロー制御部が機能して実行される。また、サウンドコントロールモジュール５２は、所定時間間隔で、受信用のＦＩＦＯバッファをチェックして、そこに格納されている新規の音声コマンドＳＮＤを解析して、これが、ワンチップマイコン４０にとっての送信動作用の音声コマンドＳＮＤである場合には、ワンチップマイコン４０による書込みデータと、音声制御レジスタ５１のレジスタアドレスとを把握し、受信した書込みデータを所定の音声制御レジスタ５１に転送する。
The serial transmission / reception process is controlled by the sound control module 52 and executed by a hardware flow control unit (not shown). The sound control module 52 checks the reception FIFO buffer at a predetermined time interval, analyzes the new voice command SND stored therein, and this is used for the transmission operation for the one-
また、受信用のＦＩＦＯバッファに、ＳＡＣ番号を含んだ新規の音声コマンドＳＮＤが検出されると、サウンドコントロールモジュール５２は、シンプルアクセスコントローラを起動させて、音声メモリ４３からＳＡＣ番号に対応するＳＡＣデータを読み出し、一群の設定値を一群の音声制御レジスタに設定する。
When a new voice command SND including the SAC number is detected in the receiving FIFO buffer, the sound control module 52 activates the simple access controller and reads the SAC data corresponding to the SAC number from the
一方、新規の音声コマンドＳＮＤが、ワンチップマイコン４０にとっての受信動作用の音声コマンドＳＮＤである場合には、音声制御レジスタ５１のレジスタアドレスを把握し、レジスタアドレスで特定される音声制御レジスタ５１から、ステイタス情報ＳＴＳを読み出して、これをワンチップマイコン４０に対してシリアル送信する。
On the other hand, if the new voice command SND is a voice command SND for reception operation for the one-
音声合成回路４２（ＵＡＲＴポート）によるシリアル送信処理は、ＣＴＳ（Clear To Send ）端子と、ＲＴＳ（Request To Send ）端子の信号レベルに基づくハードウェアフロー制御によって自動的に実現される。フロー制御では、先ず、ＣＴＳ端子が判定され、これがＬレベルであれば、ワンチップマイコン４０側が受信準備を完了していると判定される。なお、この実施例では、ワンチップマイコン４０が受信動作用の音声コマンドＳＮＤを送信した後、ワンチップマイコン４０が、そのシリアル入出力ポートＵＡＲＴを受信モードに変更するので、ＣＴＳ端子をＬレベルに固定している。
The serial transmission processing by the speech synthesis circuit 42 (UART port) is automatically realized by hardware flow control based on the signal levels of the CTS (Clear To Send) terminal and the RTS (Request To Send) terminal. In the flow control, first, the CTS terminal is determined, and if it is at the L level, it is determined that the one-
したがって、音声合成回路４２では、直ちに、ステイタス情報ＳＴＳのシリアル送信処理を開始することになる。なお、不図示のハードウェアフロー制御部は、シリアル送信処理の開始時に、ＲＴＳ端子を禁止レベル（Ｈ）に変化させる。ＲＴＳ端子は、ワンチップマイコン４０が、音声コマンドＳＮＤの送信を開始するか否かを判定するために使用され、ＲＴＳ端子＝Ｌとなるまで、ワンチップマイコン４０は、原則として、シリアル送信処理を開始しないようになっている。
Therefore, the
このように、音声合成回路４２のＵＡＲＴポートが、ハードウェアフロー制御に基づいて機能しているのに対して、ワンチップマイコン４０のシリアル入出力ポートＵＡＲＴは、ＣＰＵによるソフトウェアフロー制御に基づいて機能している。
Thus, the UART port of the
以上、音声合成回路４２がシリアルデータを送信する場合について説明したので、次に、音声合成回路４２によるシリアルデータ受信処理について確認的に説明する。なお、音声合成回路４２によるシリアルデータの受信処理は、ワンチップマイコン４０にとっては音声コマンドＳＮＤの送信処理に他ならない。
The case where the
先に説明した通り、ワンチップマイコン４０による音声コマンドＳＮＤの送信処理は、音声合成回路４２のＲＴＳ端子がＬであることを条件に開始される。但し、音声合成回路４２は、ステイタス情報ＳＴＳの返送処理中（シリアル送信処理中）を除いて、ＲＴＳ端子を許可レベル（Ｌ）に維持して、スタートビット（図５（ａ）参照）の送信を待機している。
As described above, the transmission process of the voice command SND by the one-
したがって、ワンチップマイコン４０は、音声合成回路４２のＲＴＳ端子の電圧レベルを判定することなくシリアル送信処理を開始しても良い。すなわち、本実施例では、図５（ｂ）に破線で示す通り、音声合成回路４２のＲＴＳ端子と入力ポートＰｉ２との接続を省略しても良い。
Therefore, the one-
何れにしても、音声合成回路４２の受信端子ＲＸＤが、定常レベル（Ｈ）からＬレベルに遷移すると、音声合成回路４２では、所定の転送速度でシリアルデータの取得を開始する。なお、ワンチップマイコン４０と、音声合成回路４２とで、予め、転送速度（ボーレート）を一致させているのは勿論である。
In any case, when the reception terminal RXD of the
そして、音声合成回路４２（ＵＡＲＴポート）が、１バイト長のデータを受信する毎に、これを受信用ＦＩＦＯバッファに格納する。例えば、３バイト長の音声コマンドＳＮＤを受けた場合には、受信用ＦＩＦＯバッファの３バイト領域を使用して、これを格納することになる。また、この動作に続いて、２バイト長の音声コマンドＳＮＤを受けた場合には、受信用ＦＩＦＯバッファについて、合計５バイト領域が消費されることになる。 Every time the voice synthesis circuit 42 (UART port) receives 1-byte data, it stores it in the reception FIFO buffer. For example, when a voice command SND having a length of 3 bytes is received, the voice command SND is stored by using the 3-byte area of the reception FIFO buffer. Further, when a 2-byte voice command SND is received following this operation, a total of 5 bytes area is consumed for the reception FIFO buffer.
このように、次々と、受信用ＦＩＦＯバッファに受信データが格納される可能性があるが、記憶容量が１６バイトであり、且つ、サウンドコントロールモジュール５２が、適宜な時間間隔で、受信用ＦＩＦＯバッファをアクセスして、音声コマンドＳＮＤを解析して、それに対応する処理を実行するので、受信用ＦＩＦＯバッファがオーバーフローすることはない。 As described above, reception data may be stored in the reception FIFO buffer one after another. However, the storage capacity is 16 bytes, and the sound control module 52 can receive the reception FIFO buffer at appropriate time intervals. , The voice command SND is analyzed, and the corresponding processing is executed, so that the receiving FIFO buffer does not overflow.
先に説明した通り、受信用ＦＩＦＯバッファに、送信動作用（音声合成回路４２にとっては受信用）の音声コマンドＳＮＤが存在する場合には、ワンチップマイコン４０からの書込みデータと、音声制御レジスタ５１のレジスタアドレスとを把握し、受信した書込みデータを所定の音声制御レジスタ５１に転送するか、シンプルアクセスコントローラを起動させて、一群の設定処理を実行させる。
As described above, when the voice command SND for transmission operation (for reception by the voice synthesis circuit 42) exists in the reception FIFO buffer, the write data from the one-
また、受信用ＦＩＦＯバッファに、受信動作用（音声合成回路４２にとっては送信用）の音声コマンドＳＮＤが存在する場合には、レジスタアドレスで特定される所定の音声制御レジスタ５１からステイタス情報ＳＴＳを取得し、これを送信用のＦＩＦＯバッファに格納する。格納されたステイタス情報ＳＴＳは、ハードウェアフロー制御にしたがって、ワンチップマイコン４０にシリアル送信される点は、先に説明した通りである。
Further, when the voice command SND for reception operation (for transmission for the voice synthesis circuit 42) exists in the reception FIFO buffer, the status information STS is acquired from the predetermined voice control register 51 specified by the register address. This is stored in the FIFO buffer for transmission. The stored status information STS is serially transmitted to the one-
ところで、以上の動作は、通信エラーが発生しなかった場合の動作である。しかし、音声合成回路４２（ＵＡＲＴポート）において、オーバーランエラー、パリティエラー、フレーミングエラー、ＦＩＦＯ満杯エラーなどの通信エラーが生じた場合には、その音声コマンドＳＮＤが受信用ＦＩＦＯバッファに格納されることはなく、発生した通信エラー状態が、ステイタス情報ＳＴＳの一部として所定の音声制御レジスタ５１に記憶される。 By the way, the above operation is an operation when no communication error occurs. However, if a communication error such as an overrun error, a parity error, a framing error, or a FIFO full error occurs in the voice synthesis circuit 42 (UART port), the voice command SND is stored in the reception FIFO buffer. Instead, the communication error state that has occurred is stored in the predetermined audio control register 51 as part of the status information STS.
すなわち、本実施例では、通信エラーに関する音声コマンドＳＮＤが、音声合成回路４２で実効化されることはない。そこで、本実施例では、音声コマンドＳＮＤを送信する毎に、ステイタス情報ＳＴＳを取得して、通信エラーが発生していないことを確認し、万一、通信エラーが生じている場合には、必要な処理を採るようにしている。
That is, in this embodiment, the voice command SND related to the communication error is not validated by the
なお、パリティエラーやフレーミングエラーの意味は、ワンチップマイコン４０のシリアル入出力ポートＵＡＲＴに関して説明した通りである。また、オーバーランエラーは、受信用ＦＩＦＯバッファに格納された音声コマンドＳＮＤの処理前に、次の音声コマンドＳＮＤが上書きされたことを意味し、ＦＩＦＯ満杯エラーとは、ＦＩＦＯバッファを使い切った状態で受信データを受けたこと意味する。但し、１６バイト長のＦＩＦＯバッファにおいて、ＦＩＦＯ満杯エラーやオーバーランエラーが生じる可能性は事実上皆無である。
The meanings of the parity error and the framing error are as described for the serial input / output port UART of the one-
続いて、音声合成回路４２とデジタルアンプ４６との関係を説明する。先に説明した通り、本実施例では、デジタルアンプ４６の出力によって、遊技機上部の左右スピーカＳＰＬ，ＳＰＲと、遊技機下部のスピーカＳＰＤと、を駆動している。そのため、音声合成回路４２は、３チャンネルの音声信号を生成する必要があり、これをパラレル伝送すると、音声合成回路４２とデジタルアンプ４６との配線が複雑化する。
Next, the relationship between the
そこで、本実施例では、音質の劣化を防止すると共に、配線の複雑化を回避するため、音声合成回路４２とデジタルアンプ４６との間は、４本の信号線で接続されている。具体的には、図５（ｂ）や図５（ｃ）及び図６に示す通り、転送クロック信号ＳＣＬＫと、チャンネル制御信号ＬＲＣＬＫと、２ビット長のシリアル信号ＳＤ０，ＳＤ１との合計４ビットの信号線に抑制されている。なお、何れの信号も、その振幅レベルは３．３Ｖである。
Therefore, in this embodiment, the
また、転送クロック信号ＳＣＬＫを、Ｆｓ＊６４＝２．８ＭＨｚ〜３．２ＭＨｚ程度、チャンネル制御信号ＬＲＯを、Ｆｓ＝４４〜５０ＫＨｚ程度に設定している。そして、２０〜３０ビット程度の振幅分解能（２２０〜２３０）を有する１サンプリングデータを、１／Ｆｓ／２の間に高速にシリアルデータを伝送している。 Further, the transfer clock signal SCLK is set to Fs * 64 = 2.8 MHz to 3.2 MHz, and the channel control signal LRO is set to Fs = 44 to 50 KHz. One sampling data having an amplitude resolution (220 to 230) of about 20 to 30 bits is transmitted at a high speed between 1 / Fs / 2.
ここで、シリアル信号ＳＤ１は、チャンネル制御信号ＬＲＣＬＫがＬレベルの場合には、左側スピーカＳＰＬ用の音声信号Ｌ１を意味し、チャンネル制御信号ＬＲＣＬＫがＨレベルの場合には、右側スピーカＳＰＲ用の音声信号Ｒ１を意味する。同様に、シリアル信号ＳＤ０は、下部スピーカの左右チャンネルの音声信号Ｌ０，Ｒ０を意味するが、本実施例では、下部スピーカＳＰＤが１個であるので、左右チャンネルの信号Ｒ０，Ｌ０は同一であり、同一のスピーカＳＰＤに共通して供給される（図６参照）。 Here, the serial signal SD1, when the channel control signal LRCLK is at the L level means a sound signal L1 for the left speaker SP L, when the channel control signal LRCLK is at the H level, for the right speaker SP R Audio signal R1. Similarly, the serial signal SD0 is meant an audio signal L0, R0 of the left and right channels of the lower speaker, in this embodiment, since the lower speaker SP D is one, the signal R0, L0 of the left and right channels are the same There, it is commonly supplied to the same speaker SP D (see FIG. 6).
このようなシリアル信号ＳＤ０，ＳＤ１は、シリアルクロック信号ＳＣＬＫの立上りエッジに同期して、デジタルアンプ４６に取得される。そして、デジタルアンプ４６内部で、所定ビット長毎にパラレル変換され、ＤＡ変換後にＤ級増幅されて各スピーカＳＰＤ，ＳＰＬ，ＳＰＲに供給される。
Such serial signals SD0 and SD1 are acquired by the
図６は、上記の動作を実現するデジタルアンプ４６の内部構成図を示しており、４チャンネル（Ｌ０，Ｌ１，Ｒ０，Ｒ１）各々について、ＤＡ変換部ＤＡＣと、ＰＷＭ変換部ＰＷＭと、ドライバ部Driverとが内蔵されている。先に説明した通り、左右チャンネルの信号Ｒ０，Ｌ０は同一であり、下部スピーカＳＰＤに共通して供給されている。
FIG. 6 shows an internal configuration diagram of the
図７は、ドライバ部Driverを図示したものであり、４チャンネルともＢＴＬ（Bridge Tied Load）接続となっている。すなわち、全てのドライバ部Driverは、ＣＭＯＳ（Complementary MOS ）構造を有する２個のスイッチング素子ＳＷ１，ＳＷ２を上下に配置し、下方のスイッチング素子ＳＷ２に、上方のスイッチング素子ＳＷ１の入力ＰＷＭ信号Ｖｉ＋を論理反転したＰＷＭ信号Ｖｉ−を供給する構成を採っている。したがって、ＢＴＬ接続は、ＳＥＰＰ（Single Ended Push Pull）接続の場合と比較して、出力電圧が理論値２倍になり（Ｖｉ＋−Ｖｉ−参照）、スピーカから大出力を得ることができる。 FIG. 7 illustrates a driver unit driver, and BTL (Bridge Tied Load) connection is used for all four channels. That is, all the driver units Driver have two switching elements SW1 and SW2 having a CMOS (Complementary MOS) structure arranged vertically, and the input PWM signal Vi + of the upper switching element SW1 is applied to the lower switching element SW2. It adopts a configuration for supplying the - logically inverting the PWM signal Vi. Thus, BTL connection, as compared with the case of the SEPP (Single Ended Push Pull) connection, the output voltage is doubled theoretical value (Vi + -Vi - see), it is possible to obtain a large output from the speaker.
また、この実施例では、ＣＭＯＳ構造を構成する一対のトランジスタＱ１，Ｑ２の接続点は、コイルＬとバリスタＶＲとを通してグランド（コモンライン）に接続されている。そして、コイルＬとバリスタＶＲの接続点（ＯＵＴ＋及びＯＵＴ−）が、スピーカに接続されている。 In this embodiment, the connection point of the pair of transistors Q1 and Q2 constituting the CMOS structure is connected to the ground (common line) through the coil L and the varistor VR. The connection point of the coil L and the varistor VR (OUT + and OUT -) is connected to the speaker.
図７（ａ）と図７（ｂ）は、相補的に動作するトランジスタＱ１，Ｑ２の動作内容を図示しており、入力ＰＷＭ信号Ｖｉ＋がＨレベルの場合（図７（ａ））と、入力ＰＷＭ信号Ｖｉ＋がＬレベルの場合を示している。図７（ａ）及び図７（ｂ）に示すタイミングでは、入力ＰＷＭ信号Ｖｉ＋のデュティ比（τ）が５０％以下であるので、出力端子（ＯＵＴ＋，ＯＵＴ−）には、図示の向きに増加する音声信号電圧（ＯＵＴ＋＞ＯＵＴ−）が発生して、音声信号線ＷＲには、図示の向きの音声電流が、その電流レベルを増加させつつ流れている。 FIGS. 7A and 7B illustrate the operation contents of the transistors Q1 and Q2 that operate in a complementary manner. When the input PWM signal Vi + is at the H level (FIG. 7A), The case where the input PWM signal Vi + is at the L level is shown. At the timings shown in FIGS. 7A and 7B, the duty ratio (τ) of the input PWM signal Vi + is 50% or less, so that the output terminals (OUT + , OUT − ) have the illustrated orientation. An audio signal voltage (OUT + > OUT − ) that increases at a time is generated, and an audio current in the direction shown in the figure flows through the audio signal line WR while increasing its current level.
ところで、バリスタＶＲは、規定以上のサージ電圧を受けると電気抵抗が急減する素子であり、一般的には、非直線性抵抗特性を持つ酸化亜鉛などの半導体セラミックスで構成されている。しかし、本実施例では、一対のツェナーダイオードを対面させることで、サージ電圧に対する迅速な降伏特性を実現している。すなわち、この実施例では、降伏電圧が２０〜２５Ｖ程度の２個のツェナーダイオードを対面させることで、２０〜２５Ｖを超えるサージ電圧に対する素早い降伏特性（ブレイクダウン特性）を実現して、スイッチング素子ＳＷ１〜ＳＷ２などの破損を防止している。 By the way, the varistor VR is an element whose electric resistance sharply decreases when a surge voltage exceeding a specified value is received, and is generally composed of semiconductor ceramics such as zinc oxide having non-linear resistance characteristics. However, in this embodiment, a rapid breakdown characteristic against a surge voltage is realized by facing a pair of Zener diodes. That is, in this embodiment, two Zener diodes having a breakdown voltage of about 20 to 25 V are faced to realize a quick breakdown characteristic (breakdown characteristic) for a surge voltage exceeding 20 to 25 V, and the switching element SW1 ~ SW2 etc. are prevented from being damaged.
また、実施例のバリスタＶＲは、５００〜１０００ｐＦ程度の静電容量を有して構成されており、非降伏時には、コイルＬと共にスイッチング周波数に対するローパスフィルタを実現している。なお、実施例のスイッチング周波数は、２５０ＫＨｚ〜１．５ＭＨｚであり、数μＳ程度の実行周期でトランジスタＱ１，Ｑ２をＯＮ／ＯＦＦ動作させているが、音声周波数を超える不要信号は、バリスタＶＲとコイルＬとのＬＣ回路によって吸収される。 The varistor VR of the embodiment is configured to have a capacitance of about 500 to 1000 pF, and realizes a low-pass filter with respect to the switching frequency together with the coil L at the time of non-breakdown. The switching frequency of the embodiment is 250 KHz to 1.5 MHz, and the transistors Q1 and Q2 are turned on / off with an execution cycle of about several μs. Absorbed by LC circuit with L.
以下、この点について、図７に基づいて説明する。まず、入力ＰＷＭ信号Ｖｉ＋がＨレベルの期間では、図７（ａ）の動作状態となり、上側のバリスタＶＲの充電電荷が、スイッチング素子ＳＷ１を通して放電される一方、下側のバリスタＶＲは、スイッチング素子ＳＷ２を通して充電されている。したがって、出力端子ＯＵＴ＋の電位は、減少傾向となり、出力端子ＯＵＴ−の電位は、増加傾向となる。 Hereinafter, this point will be described with reference to FIG. First, when the input PWM signal Vi + is at the H level, the operation state shown in FIG. 7A is established, and the charge of the upper varistor VR is discharged through the switching element SW1, while the lower varistor VR is switched. It is charged through the element SW2. Accordingly, the output terminal OUT + of the potential becomes a downward trend, the output terminal OUT - of the potential tends to increase.
但し、図７（ａ）に示す入力ＰＷＭ信号Ｖｉ＋がＨレベル時の動作は、数μＳ後（１／Ｆｓ×デュティ比）には、図７（ｂ）の動作状態に切り替わる。そして、入力ＰＷＭ信号Ｖｉ＋がＬレベルとなると、図７（ｂ）に示す通り、上側のバリスタＶＲが、スイッチング素子ＳＷ１を通して充電される一方、下側のバリスタＶＲの電荷は、スイッチング素子ＳＷ２を通して放電される。そのため、出力端子ＯＵＴ＋の電位は、増加傾向となり、出力端子ＯＵＴ−の電位は、減少傾向となる。 However, the operation when the input PWM signal Vi + shown in FIG. 7A is at the H level is switched to the operation state shown in FIG. 7B after several μS (1 / Fs × duty ratio). When the input PWM signal Vi + becomes L level, as shown in FIG. 7B, the upper varistor VR is charged through the switching element SW1, while the charge of the lower varistor VR is passed through the switching element SW2. Discharged. Therefore, the output terminal OUT + of the potential on the increase, the output terminal OUT - of the potential becomes decreasing.
図７（ａ）の動作は、デュティ比（τ＜１）で規定される所定の実行時間（＝τ／Ｆｓ）の後に、図７（ｂ）の動作に切り替わるところ、図示のタイミングでは、デュティ比が５０％未満であるので、出力端子ＯＵＴ＋の電位が、出力端子ＯＵＴ−の電位より高い状態（ＯＵＴ＋＞ＯＵＴ−）が維持される。なお、説明の都合上、図示例では、ＰＷＭ信号のデュティ比が素早く低下しているが、音声信号の周波数（２０Ｈｚ〜２０ｋＨｚ）は、スイッチング周波数より格段に低いので、実際には、デュティ比が変化しない期間が１０サイクル以上継続される。 The operation in FIG. 7A switches to the operation in FIG. 7B after a predetermined execution time (= τ / Fs) defined by the duty ratio (τ <1). At the timing shown in FIG. since the ratio is less than 50%, the output terminal OUT + of the potential, the output terminal OUT - higher than the potential of (OUT +> OUT -) is maintained. For convenience of explanation, in the illustrated example, the duty ratio of the PWM signal is rapidly reduced. However, since the frequency (20 Hz to 20 kHz) of the audio signal is much lower than the switching frequency, the duty ratio is actually lower. The period of no change continues for 10 cycles or more.
何れにしても、デュティ比が５０％未満であれば、出力端子ＯＵＴ＋の電位が、出力端子ＯＵＴ−の電位より高くなり（ＯＵＴ＋＞ＯＵＴ−）、逆に、デュティ比（τ）が５０％を超えると、出力端子ＯＵＴ＋の電位が、出力端子ＯＵＴ−の電位より低くなる（ＯＵＴ＋＜ＯＵＴ−）。そして、これらの動作の結果、スピーカが音声周波数で交流的に駆動されることになる。すなわち、音声信号線ＷＲの電位は、電源電圧Ｖｄｄの１／２程度（６Ｖ）の中間電位を中心に増減変動し、音声信号線ＷＲには、図７（ａ）及び図７（ｂ）の向き、又は、その逆向きの電流が流れることになる。 Anyway, if the duty ratio is less than 50%, the output terminal OUT + of the potential, the output terminal OUT - of higher than the potential (OUT +> OUT -), conversely, the duty ratio (tau) is 50 beyond percent, the output terminal OUT + of the potential, the output terminal OUT - becomes lower than the potential (OUT + <OUT -). As a result of these operations, the speaker is driven in an alternating manner at the audio frequency. That is, the potential of the audio signal line WR fluctuates around an intermediate potential of about ½ (6 V) of the power supply voltage Vdd, and the audio signal line WR has the potential shown in FIGS. 7A and 7B. A current in the direction or in the opposite direction flows.
以上の動作から明らかなように、正常時には、一対の音声信号線ＷＲは、常にグランド電位（コモンラインの電位）から浮いた状態であって差動信号ラインとして機能する。しかし、ＰＷＭ波のデュティ比が固定値に維持されるような異常時には、出力端子ＯＵＴ＋と、出力端子ＯＵＴ−との電位差が変化せず、あるＤＣレベルを維持することになる。 As is clear from the above operation, at normal times, the pair of audio signal lines WR are always floating from the ground potential (common line potential) and function as differential signal lines. However, when the duty ratio of the PWM wave is maintained at a fixed value, the potential difference between the output terminal OUT + and the output terminal OUT − does not change, and a certain DC level is maintained.
この点を具体的に説明するため、例えば、音声合成回路４２から異常なシリアル信号ＳＤ０，ＳＤ１を受けた場合や、デジタルアンプ４６の内部回路が誤動作して、デュティ比（τ）が１００％に維持された場合を想定する。
In order to specifically explain this point, for example, when abnormal serial signals SD0 and SD1 are received from the
このような異常時には、図７（ａ）の動作状態が永続的に維持されるので、上側のバリスタＶＲの充電電荷が完全に放電される一方、下側のバリスタＶＲは、電源電圧Ｖｄｄレベルまで充電されてしまう。そのため、出力端子ＯＵＴ＋と、出力端子ＯＵＴ−との電位差は、電源電圧レベルを維持することになり、スピーカコイルのコイル電流が過大化して発煙や焼損の恐れがある。また、トランジスタＱ１，Ｑ２などの電子素子に、過大な直流電流が流れ続けることで、電子素子の発熱や焼損が懸念される。 When such an abnormality occurs, the operating state of FIG. 7A is maintained permanently, so that the charge of the upper varistor VR is completely discharged, while the lower varistor VR reaches the level of the power supply voltage Vdd. It will be charged. Therefore, the output terminal OUT +, the output terminal OUT - the potential difference between the results in maintaining the power supply voltage level, the coil current of the speaker coil is a possibility of excessive increase to smoke or burning. Further, since excessive direct current continues to flow through the electronic elements such as the transistors Q1 and Q2, there is a concern that the electronic elements may generate heat or burn out.
そこで、本実施例のデジタルアンプ４６は、過電流や高温状態を検知可能に構成されると共に、デュティ比（τ）が異常レベル（典型的には１００％又は０％）で維持されたことも検知可能に構成されている。これらの点は、過電流異常、高温異常、及び、ＤＣ検出異常として、先に説明した通りである。
Therefore, the
そして、これら何れかの異常を検知すると、デジタルアンプ４６は、異常通知信号ＥＲＲをアクティブレベルに変化させると共に、出力端子ＯＵＴ＋と、出力端子ＯＵＴ−を共にＨｉＺグランド状態に設定している。ここで、ＨｉＺグランド状態とは、出力端子ＯＵＴ＋，ＯＵＴ−を電流が流れないグランドレベルにすることを意味し、その結果、スピーカコイルへの過電流や内部素子の過電流が一応は停止される（フェールセーフ動作）。
Then, upon detecting any of these abnormalities,
但し、先にも説明した通り、ＨｉＺグランド状態は、永続的に継続される訳ではなく、高温異常が解消されると元の動作状態に戻る。また、一定時間後には、過電流異常やＤＣ検出異常が解消されたか否かに拘わらず、強制的に元の動作状態に戻される。 However, as described above, the HiZ ground state is not continuously maintained, and returns to the original operation state when the high temperature abnormality is resolved. In addition, after a certain time, the original operation state is forcibly returned regardless of whether the overcurrent abnormality or the DC detection abnormality is resolved.
そのため、異常原因が解消されていない場合には、デジタルアンプ４６は、同じフェールセーフ動作を繰り返すことになる。そこで、本実施例では、図５に示すように、ワンチップマイコン４０が異常通知信号ＥＲＲを監視する構成を採り、異常時には、デジタルアンプ４６にＭＵＴＥ信号を供給すると共に、音声合成回路４２に、音声コマンドＳＮＤとして、初期化コマンドを送信して、音声合成回路４２の動作を初期状態に戻した上で、音声制御動作を再開している。
For this reason, when the cause of the abnormality has not been eliminated, the
そのため、音声合成回路４２の誤動作を原因として、デジタルアンプ４６が異常動作している場合には、その異常原因を解消することができ、その後の正常動作が確保されることになる。すなわち、デジタルアンプ４６がフェールセーフ動作を繰り返すことによる無音状態の継続が解消される。また、仮に、ＨｉＺグランド状態への移行動作が正常に機能しない場合でも、スピーカからの異音発生や、スピーカコイルからの発煙などの異常動作が未然防止される。
For this reason, when the
続いて、音声演出動作や異常対応動作に関して、演出制御部２２’の動作を説明する。図８は、演出制御部２２’の動作内容を説明するフローチャートであり、ワンチップマイコン４０のＣＰＵ（ホストＣＰＵ）によって実行される。演出制御部２２’の動作は、ＣＰＵリセット後に無限ループ状に実行されるメインループ処理（図８（ａ））と、１ｍＳ毎に起動されるタイマ割込み処理（図８（ｂ））と、主制御部が送信する制御コマンドを受信する受信割込み処理（不図示）と、を含んで実現される。
Subsequently, the operation of the effect control unit 22 'will be described with respect to the sound effect operation and the abnormality response operation. FIG. 8 is a flowchart for explaining the operation content of the
なお、実際には、図示のメインループ処理（図８（ａ））に先行して、音声合成回路４２やワンチップマイコン４０の各部を初期化する初期処理が実行される。例えば、音声合成回路４２は、電源投入時に初期化コマンドを受けることで、その内部回路を全て初期化している。
Actually, an initial process for initializing each part of the
以上を踏まえて、図８（ｂ）に示すタイマ割込み処理から説明する。タイマ割込み処理では、最初に、設定スイッチＳＥＴ、音量スイッチＶＳＷを含む各種のスイッチ信号を取得し、各スイッチ信号のレベルを記憶する（ＳＴ３０）。 Based on the above, the timer interrupt process shown in FIG. In the timer interrupt process, first, various switch signals including the setting switch SET and the volume switch VSW are acquired, and the level of each switch signal is stored (ST30).
次に、演出モータ（ステッピングモータ）が回転駆動中である場合には、演出モータを歩進させるべく、適宜なタイミングで駆動パルスを１ステップ更新し（ＳＴ３１）、更新された駆動パルスを演出モータに出力する（ＳＴ３２）。また、ランプ演出などに関して、ＬＥＤランプを駆動する（ＳＴ３３）。なお、ＬＥＤランプを駆動するためのランプ駆動データＳＤＡＴＡは、メインループ処理のステップＳＴ１８の処理で、１６ｍＳ毎に更新されている。 Next, when the effect motor (stepping motor) is being rotationally driven, the drive pulse is updated by one step at an appropriate timing to advance the effect motor (ST31), and the updated drive pulse is transmitted to the effect motor. (ST32). Further, the LED lamp is driven for the lamp effect and the like (ST33). The lamp drive data SDATA for driving the LED lamp is updated every 16 mS in the process of step ST18 of the main loop process.
次に、パラレル送信バッファ（図８（ｅ）参照）に、制御コマンドＣＭＤ’が格納されている場合には、これを下流側の画像制御部２３’に送信する。また、シリアル送信バッファ（図８（ｄ）参照）に、音声コマンドＳＮＤが格納されている場合には、これを音声合成回路４２にシリアル送信する（ＳＴ３３）。なお、制御コマンドＣＭＤ’や音声コマンドＳＮＤは、メインループ処理におけるステップＳＴ１２，ＳＴ１６，ＳＴ１７などの処理で、パラレル送信バッファやシリアル送信バッファに格納される。 Next, when the control command CMD 'is stored in the parallel transmission buffer (see FIG. 8E), it is transmitted to the downstream image control unit 23'. If the voice command SND is stored in the serial transmission buffer (see FIG. 8D), it is serially transmitted to the voice synthesis circuit 42 (ST33). Note that the control command CMD 'and the voice command SND are stored in the parallel transmission buffer and the serial transmission buffer in the processes such as steps ST12, ST16, and ST17 in the main loop process.
図８（ｂ）は、音声コマンドＳＮＤのシリアル送信処理を説明するフローチャートであり、ここでは、ワンチップマイコン４０のシリアル入出力ポートＵＡＲＴが活用される。コマンド送信処理は、シリアル送信バッファ（図８（ｄ））に、音声コマンドＳＮＤが格納されていることを条件に開始され、通信制御レジスタＦＧに適宜な設定値を設定することに基づいて、シリアル入出力ポートＵＡＲＴを送信モードに設定する（ＳＴ４０）。
FIG. 8B is a flowchart for explaining the serial transmission processing of the voice command SND. Here, the serial input / output port UART of the one-
なお、ステップＳＴ４０の処理に先行して、入力ポートＰｉ２から、音声合成回路４２のＲＴＳ端子の信号を取得して、これがアクティブレベル（Ｌ）であることを確認しても良いが、ここでは、説明の便宜上、この確認処理を省略している。それは、本実施例では、音声合成回路４２のＵＡＲＴポートは、特別な場合を除いて常に受信待機状態であって、ＲＴＳ端子は、Ｌレベルを維持しているためである。
Prior to the processing of step ST40, the signal of the RTS terminal of the
何れにしても、ステップＳＴ４０の処理が終われば、シリアル送信バッファに格納されている２バイト又は３バイト長の音声コマンドＳＮＤについて、これを１バイト毎に送信レジスタＲＥＧ（図５（ｂ））に書込む（ＳＴ４１）。先に説明した通り、送信レジスタＲＥＧに書込まれた１バイトデータは、シリアル入出力ポートＵＡＲＴの出力端子ＴＸＤから１ビット毎にシリアル送信され、送信処理が終われば、通信制御レジスタＦＧの送信完了フラグがセットされる。 In any case, when the process of step ST40 is completed, the 2-byte or 3-byte voice command SND stored in the serial transmission buffer is stored in the transmission register REG (FIG. 5B) for each byte. Write (ST41). As described above, 1-byte data written in the transmission register REG is serially transmitted bit by bit from the output terminal TXD of the serial input / output port UART. When the transmission processing is completed, transmission of the communication control register FG is completed. A flag is set.
そこで、ＣＰＵは、１バイトデータの書込み後、送信完了フラグをチェックして、これがセット状態になれば、次の１バイトデータを送信レジスタＲＥＧに書込むことになる（ＳＴ４１，ＳＴ４２）。このようにして、一単位の音声コマンドＳＮＤのシリアル送信処理が終われば、通信エラーを判定するべく、ステイタス情報ＳＴＳを取得するための音声コマンドＳＮＤを、１バイト毎に送信レジスタＲＥＧに書込む（ＳＴ４３）。 Therefore, after writing the 1-byte data, the CPU checks the transmission completion flag, and if it is set, writes the next 1-byte data to the transmission register REG (ST41, ST42). In this way, when the serial transmission processing of one unit of voice command SND is completed, the voice command SND for obtaining the status information STS is written to the transmission register REG for each byte in order to determine a communication error ( ST43).
そして、１バイトデータの書込み後、送信完了フラグをチェックして、これがセット状態になれば、次の１バイトデータを送信レジスタＲＥＧに書込む（ＳＴ４３，ＳＴ４４）。このようにして、ステイタス情報ＳＴＳを取得するための音声コマンドＳＮＤの最終書込みが終われば、その後のシリアル受信処理に備えて、シリアル入出力ポートＵＡＲＴを受信モードに設定する（ＳＴ４５）。なお、音声コマンドＳＮＤの送信完了を待つことなく、書込み処理後、直ちに、シリアル入出力ポートＵＡＲＴを受信モードに設定するのが好ましい。 Then, after the 1-byte data is written, the transmission completion flag is checked, and if it is set, the next 1-byte data is written to the transmission register REG (ST43, ST44). Thus, when the final writing of the voice command SND for obtaining the status information STS is completed, the serial input / output port UART is set to the reception mode in preparation for the subsequent serial reception processing (ST45). Note that it is preferable to set the serial input / output port UART to the reception mode immediately after the writing process without waiting for the completion of the transmission of the voice command SND.
シリアル入出力ポートＵＡＲＴが受信モードに設定されたことで、その後、音声合成回路４２がシリアル送信するステイタス情報ＳＴＳ（２バイト構成）は、シリアル入出力ポートＵＡＲＴが自動的に取得し、１バイト取得毎に、通信制御レジスタＦＧの受信完了フラグをセットするので、ＣＰＵは、２バイト構成のステイタス情報ＳＴＳを順番に取得することができる（ＳＴ４６）。
After the serial input / output port UART is set to the reception mode, the serial input / output port UART automatically acquires the status information STS (2-byte configuration) that the
そして、取得したステイタス情報ＳＴＳのエラービットに基づいて、通信エラーの発生の有無、及びエラー種別を判定する（ＳＴ４７）。実施例の通信エラーには、オーバーランエラー、パリティエラー、フレーミングエラー、ＦＩＦＯ満杯エラーが含まれる。但し、先に説明した通り、ＦＩＦＯ満杯エラーやオーバーランエラーが生じる可能性は事実上皆無であり、その他のパリティエラーや、フレーミングエラーについても、これらが発生する可能性は低い。 Based on the error bits of the acquired status information STS, the presence / absence of a communication error and the error type are determined (ST47). The communication error in the embodiment includes an overrun error, a parity error, a framing error, and a FIFO full error. However, as described above, there is virtually no possibility of FIFO full error or overrun error, and other parity errors and framing errors are unlikely to occur.
但し、稀に、パリティエラーや、フレーミングエラーが生じることがあり、この場合には、先にステップＳＴ４１の処理で、シリアル送信した音声コマンドＳＮＤは、音声合成回路４２において実効化されることがない。そこで、ステイタス情報ＳＴＳから、パリティエラーや、フレーミングエラーの発生が認められる場合には、ステップＳＴ４７からＳＴ４０の処理に移行して、先の音声コマンドＳＮＤを再送信する。
However, in rare cases, a parity error or a framing error may occur. In this case, the voice command SND that has been serially transmitted in the process of step ST41 is not validated in the
なお、音声コマンドＳＮＤは、複数バイト長である一方、通信エラーは１バイト毎に発生する可能性があるが、ステイタス情報ＳＴＳとして一旦記憶されたエラー情報は、消滅処理を採らない限り消滅することはない。したがって、複数バイト長の音声コマンドＳＮＤの何れかの１バイトで生じた通信エラーを読み落とすおそれはない。 The voice command SND has a length of a plurality of bytes, but a communication error may occur for each byte. However, the error information once stored as the status information STS is erased unless an elimination process is performed. There is no. Therefore, there is no possibility of reading out a communication error caused by any one byte of the voice command SND having a plurality of bytes.
もっとも、パリティエラーや、フレーミングエラーの発生を認識したＣＰＵは、音声合成回路４２の音声制御レジスタ５１をアクセスし、ステイタス情報ＳＴＳのエラーフラグを初期状態に戻す必要があり、そのためのエラー消滅処理が実行される（ＳＴ４８）。エラー消滅処理は、具体的には、音声制御レジスタ５１の所定データを書込むことで実現される。
Of course, the CPU that has recognized the occurrence of a parity error or framing error needs to access the voice control register 51 of the
一方、通信エラーが認められない場合には、シリアル送信バッファ（図８（ｄ））の音声コマンドＳＮＤを消滅させると共に、ＭＵＴＥ信号を正常レベルに設定する（ＳＴ４９）。ＭＵＴＥ信号を正常レベルに設定するのは、ステップＳＴ２６の処理において、異常レベルのＭＵＴＥ信号を出力するためである。 On the other hand, if no communication error is recognized, the voice command SND in the serial transmission buffer (FIG. 8 (d)) is erased and the MUTE signal is set to a normal level (ST49). The reason why the MUTE signal is set to the normal level is to output an abnormal level MUTE signal in the process of step ST26.
以上の通り、本実施例では、一回のタイマ割込みにおいて、一個の音声コマンド（送信動作用）を送信する構成をとっており、シリアル送信の処理時間が、他の処理に悪影響を与えることがない。しかも、本実施例では、通常の音声演出を全てＳＡＣ番号で特定しているので、ＳＡＣ番号を含んだ音声コマンドを一個送信するだけで、複数の設定値が複数の音声制御レジスタに設定されることになり、タイマ割込み毎に、次々と音声コマンドをシリアル送信するような必要もない。 As described above, in this embodiment, a single voice command (for transmission operation) is transmitted in one timer interrupt, and the processing time of serial transmission may adversely affect other processing. Absent. In addition, in this embodiment, since all the normal audio effects are specified by the SAC number, a plurality of set values are set in the plurality of audio control registers only by transmitting one audio command including the SAC number. In other words, it is not necessary to serially transmit voice commands one after another at each timer interrupt.
以上のようにして、音声コマンドのシリアル送信処理（ＳＴ３４）が終われば、適宜なクリアタイミングに達したことを条件に、ウォッチドッグタイマＷＤＴをクリアする（ＳＴ３５）。そして、割込みカウンタをインクリメントして割込み処理を終える（ＳＴ３６）。 As described above, when the voice command serial transmission process (ST34) is completed, the watchdog timer WDT is cleared on the condition that an appropriate clear timing has been reached (ST35). Then, the interrupt counter is incremented and the interrupt process is finished (ST36).
割込みカウンタは、メインループ処理（図７（ａ））を１６ｍＳ毎に繰り返し実行するためのカウンタである。そのため、メインループ処理では、最初に割込みカウンタの値を判定し（ＳＴ１０）、これが１６に達したタイミングで、ステップＳＴ１１〜ＳＴ２６の処理を実行することで、１６ｍＳ間隔の繰り返し処理を実現している。 The interrupt counter is a counter for repeatedly executing the main loop process (FIG. 7A) every 16 ms. Therefore, in the main loop process, the value of the interrupt counter is first determined (ST10), and the process of steps ST11 to ST26 is executed at the timing when the value reaches 16 to realize the repetition process at intervals of 16 mS. .
すなわち、割込みカウンタが１６に達すると（ＳＴ１０）、これをゼロクリアした上で（ＳＴ１１）、主制御部２１から受信した制御コマンドについて、コマンド解析処理を実行する（ＳＴ１２）。そして、必要な制御コマンドＣＭＤ’をパラレル送信バッファに格納する。なお、この実施例では、コマンド解析処理（ＳＴ１２）において変動パターンコマンドの受信を認識した場合に、演出抽選が実行される。そして、新たな生成された制御コマンドＣＭＤ’は、パラレル送信バッファに格納される。これらの制御コマンドＣＭＤ’は、ステップＳＴ３４の処理で、画像制御部に２３’に送信される。 That is, when the interrupt counter reaches 16 (ST10), after clearing it to zero (ST11), command analysis processing is executed for the control command received from the main control unit 21 (ST12). Then, the necessary control command CMD 'is stored in the parallel transmission buffer. In this embodiment, the effect lottery is executed when the reception of the variation pattern command is recognized in the command analysis process (ST12). The newly generated control command CMD 'is stored in the parallel transmission buffer. These control commands CMD 'are transmitted to the image control unit 23' in the process of step ST34.
次に、エラー処理を実行する（ＳＴ１３）。エラー処理とは、違法行為の発生が懸念される重大な異常事態や、その他の特別事態が発生しているか否かを判定し、必要な報知動作を実行する処理である。具体的な内容は、特に限定されないが、例えば、主制御部２１から送信される制御コマンド（エラーコマンド）や、音声合成回路４２とのシリアル送受信における通信エラーの累積個数や、デジタルアンプ４６から受ける異常通知信号ＥＲＲの累積受信回数などに基づいて、重大な異常事態の発生か否かが判定される（ＳＴ１３）。そして、重大な異常事態が発生していると判定される場合には、異常事態に応じた適宜な報知動作が実行される。
Next, error processing is executed (ST13). The error process is a process of determining whether a serious abnormal situation in which an illegal act is a concern or other special situation has occurred and performing a necessary notification operation. Specific contents are not particularly limited. For example, the control command (error command) transmitted from the main control unit 21, the cumulative number of communication errors in serial transmission / reception with the
次に、係員が操作した設定スイッチＳＥＴに対応する入力検知処理が実行され（ＳＴ１４）、また、遊技動作が停止されているかが判定される（ＳＴ１５）。そして、遊技者が遊技をしていないと判定される場合には、適宜なデモ演出を、開始又は進行させる。 Next, an input detection process corresponding to the setting switch SET operated by the attendant is executed (ST14), and it is determined whether or not the game operation is stopped (ST15). If it is determined that the player is not playing a game, an appropriate demonstration effect is started or advanced.
一方、遊技動作中であれば、音声演出を開始させるか、或いは、実行中の音声演出を進行させるべくシナリオ更新処理を実行し（ＳＴ１６）、そのシナリオにしたがって音声合成回路を駆動する音再生処理を実行する（ＳＴ１７）。 On the other hand, if the game operation is in progress, the sound production is started or the scenario update process is executed to advance the sound production being executed (ST16), and the sound reproduction process for driving the voice synthesis circuit according to the scenario. Is executed (ST17).
この音再生処理（ＳＴ１７）には、音声コマンドＳＮＤをシリアル送信バッファ（図８（ｄ））に格納する処理が含まれており、シリアル送信バッファ格納された音声コマンドＳＮＤは、図８（ｃ）に示す処理を経て、音声合成回路４２に対してシリアル送信される。本実施例では、音声コマンドＳＮＤが通信エラーなく音声合成回路４２にシリアル送信される構成を有していることは、図８（ｃ）に関して説明した通りである。
This sound reproduction process (ST17) includes a process of storing the voice command SND in the serial transmission buffer (FIG. 8D). The voice command SND stored in the serial transmission buffer is shown in FIG. Through the processing shown in FIG. 2, the data is serially transmitted to the
次に、ランプ演出を開始させるか、或いは、実行中のランプ演出を進行させるべくＬＥＤデータの更新処理を実行する（ＳＴ１８）。なお、ＬＥＤランプの駆動動作は、１ｍＳタイマ割込みにおいて実行される（ＳＴ３３）。 Next, a lamp effect is started, or LED data update processing is executed to advance the lamp effect being executed (ST18). The LED lamp driving operation is executed in a 1 mS timer interrupt (ST33).
次に、ＲＡＭの所定領域について総和演算（例えば８ビット加算演算）を実行して、その演算結果を保存する（ＳＴ１９〜ＳＴ２０）。なお、この保存値は、ＣＰＵがリセットされた後に実行される不図示の初期処理において、同じ総和演算の演算結果と比較され、比較値が一致する場合いは、ＲＡＭ領域をクリア処理することなくホットスタート処理が実行される。 Next, a sum operation (for example, 8-bit addition operation) is executed for a predetermined area of the RAM, and the operation result is stored (ST19 to ST20). This stored value is compared with the same sum calculation result in an initial process (not shown) executed after the CPU is reset, and if the comparison values match, the RAM area is not cleared. Hot start processing is executed.
その結果、例え、ウォッチドッグタイマＷＤＴが機能してＣＰＵが異常リセットされた場合でも、ＲＡＭの所定領域の内容が維持されている限り、遊技機の演出を初期状態に戻すことなく、再開することが可能となる。 As a result, even if the watchdog timer WDT functions and the CPU is abnormally reset, as long as the contents of the predetermined area of the RAM are maintained, the effect of the gaming machine is resumed without returning to the initial state. Is possible.
次に、演出抽選用の乱数値を更新した上で（ＳＴ２１）、デジタルアンプ４６の異常を判定するタイミングに達しているか否かを判定する（ＳＴ２２）。デジタルアンプ４６の異常は、例えば、数秒程度の時間間隔で判定され、動作判定タイミングに達していない場合には、ステップＳＴ１０の処理に戻る（ＳＴ２２）。
Next, after updating the random number for effect lottery (ST21), it is determined whether or not the timing for determining the abnormality of the
一方、動作判定タイミングに達している場合には、入力ポートＰｉ２から異常通知信号ＥＲＲを取得して、異常レベルか否かを判定する。そして、異常通知信号ＥＲＲが異常レベルであれば、音声合成回路４２を初期設定するための初期化コマンドを送信するべく、シリアル送信バッファに初期化コマンドを設定する（ＳＴ２６）。また、デジタルアンプ４６に、アクティブレベルのＭＵＴＥ信号を送信する（ＳＴ２７）。 On the other hand, when the operation determination timing has been reached, the abnormality notification signal ERR is acquired from the input port Pi2, and it is determined whether or not the abnormality level is reached. If the abnormality notification signal ERR is at an abnormal level, an initialization command is set in the serial transmission buffer so as to transmit an initialization command for initializing the speech synthesis circuit 42 (ST26). Also, an active level MUTE signal is transmitted to the digital amplifier 46 (ST27).
シリアル送信バッファに設定された初期化コマンドは、図８（ｃ）に示すシリアル送信処理を経て、音声合成回路４２において実効化されるので、音声合成回路４２が初期化されることで、デジタルアンプ４６の異常が解消される可能性がある。そのため、本実施例では、シリアル送信処理の後に、ＭＵＴＥ信号のレベルを非アクティブレベルに戻している（ＳＴ５１）。
Since the initialization command set in the serial transmission buffer is made effective in the
ところで、異常通知信号ＥＲＲが異常レベルである場合、画一的に、初期化コマンドを送信するのではなく、異常通知信号ＥＲＲの受信頻度などに基づいて、初期化コマンドを送信するか否かを決定するのも好適である。もっとも、異常通知信号ＥＲＲが異常レベルである以上、デジタルアンプ４６については、アクティブレベルのＭＵＴＥ信号を送信することで、無音化を図るのが好適である。
By the way, when the abnormality notification signal ERR is at an abnormal level, whether or not the initialization command is transmitted based on the reception frequency of the abnormality notification signal ERR, instead of transmitting the initialization command uniformly. It is also suitable to determine. However, as long as the abnormality notification signal ERR is at an abnormal level, it is preferable that the
以上、実施例について詳細に説明したが具体的な記載内容は、必ずしも本発明を限定するものではない。例えば、もっぱら弾給遊技機を例にして各種の実施例を説明したが、本発明の適用は、弾球遊技機に限定されず、スロットマシンにも適用できるのは勿論である。 As mentioned above, although the Example was described in detail, the concrete description content does not necessarily limit this invention. For example, various embodiments have been described by taking a bullet feeding game machine as an example. However, the application of the present invention is not limited to a bullet ball game machine, and can of course be applied to a slot machine.
また、上記の実施例では、音声合成回路４２ではハードウェアフロー制御を採る一方、ワンチップマイコン４０では、ソフトウェアフロー制御を採るか、或いは、フロー制御を省略したが、図４（ｂ）に示す通り、双方ともハードウェアフロー制御を採るのも好適である。
In the above embodiment, the
また、上記の実施例では、音声コマンドＳＮＤをシリアル送信しているが、必ずしも限定されず、通信異常に対処できる構成であれば、音声コマンドＳＮＤをパラレル送信しても良い。 In the above embodiment, the voice command SND is serially transmitted. However, the voice command SND is not necessarily limited, and the voice command SND may be transmitted in parallel as long as the communication abnormality can be dealt with.
図４（ｃ）は、この回路構成を例示したものであり、ワンチップマイコン４０と音声合成回路４２は、１バイトデータを送受信可能なパラレル信号線（データバス）ＣＤ０〜ＣＤ７と、動作管理データを送信可能な２ビット長の動作管理データ線（アドレスバス）Ａ０〜Ａ１と、読み書き（read/write）動作を制御可能な２ビット長の制御信号線ＷＲ，ＲＤと、音声合成回路４２を選択するチップセレクト信号線ＣＳとで接続されている。
FIG. 4C exemplifies this circuit configuration. The one-
図示の通り、この実施例では、パラレル信号線ＣＤ０〜ＣＤ７は、ワンチップマイコン４０のデータバスで実現され、また、動作管理データ線Ａ０〜Ａ１は、ワンチップマイコン４０のアドレスバスで実現されており、各々、ＣＰＵコアに接続されている。そして、ＣＰＵが、プログラム処理によって、例えば、ＩＯＲＥＡＤ動作やＩＯＷＲＩＴＥ動作を実行すると、制御信号ＷＲ，ＲＤやチップセレクト信号ＣＳが適宜に変化して、パラレル信号線ＣＤ０〜ＣＤ７で特定される音声制御レジスタ５１との読み書き（Ｒ／Ｗ）動作が実現される。
As shown in the figure, in this embodiment, the parallel signal lines CD0 to CD7 are realized by the data bus of the one-
具体的には、図４（ｃ）に示す通りであり、音声制御レジスタ５１のレジスタアドレスと、音声制御レジスタ５１への書込みデータは、各々、パラレル信号線ＣＤ０〜ＣＤ７を通してパラレル伝送される。そして、パラレル伝送された１バイトが、レジスタアドレスであるか、それとも、書込みデータ（ライトデータ）であるかは、動作管理データＡ０〜Ａ１によって特定される。 Specifically, as shown in FIG. 4C, the register address of the audio control register 51 and the write data to the audio control register 51 are transmitted in parallel through the parallel signal lines CD0 to CD7, respectively. Whether the 1 byte transmitted in parallel is a register address or write data (write data) is specified by the operation management data A0 to A1.
したがって、図４（ｃ）に示す通り、動作管理データ（アドレスデータＡ０〜Ａ１）を、［００］→［０１］と推移させる一方で、データバスの１バイトデータを、［音声制御レジスタ５１のレジスタアドレス］→［音声制御レジスタ５１への書込みデータ］と推移させることで、所定の音声コマンドＳＮＤが送信される。なお、ＳＡＣ番号（１３ビット）を送信する場合のように、書込みデータが複数バイト長の場合には、［０１］の動作管理データＡ０〜Ａ１を、［００］→［０１］→［０１］→［０１］と繰り返しつつ、複数バイトの書込みデータを送信する。 Therefore, as shown in FIG. 4C, the operation management data (address data A0 to A1) is changed from [00] to [01], while 1-byte data on the data bus is changed to [voice control register 51]. A predetermined voice command SND is transmitted by transiting from “register address” → [write data to voice control register 51]. When the write data is a plurality of bytes long as in the case of transmitting the SAC number (13 bits), the operation management data A0 to A1 of [01] are changed from [00] → [01] → [01]. → Send the data of multiple bytes while repeating [01].
このようにして送信された音声コマンドは、通信異常がない限り、その後、実効化される。但し、複数バイト長のデータが互いに整合しないなど、通信異常が認められる場合には、その音声コマンドＳＮＤが実効化させることはない。そして、音声制御レジスタ５１のエラーフラグがセットされるが、このエラーフラグ（ステイタス情報ＳＴＳ）は、アドレスバスの動作管理データＡ０〜Ａ１を、［０１］から［１０］に推移させることで、ワンチップマイコン４０がREAD動作によって受信することができる。
The voice command transmitted in this way is subsequently validated as long as there is no communication abnormality. However, if a communication error is recognized, such as data having a plurality of bytes inconsistent with each other, the voice command SND is not activated. Then, an error flag of the voice control register 51 is set. This error flag (status information STS) is set by moving the address bus operation management data A0 to A1 from [01] to [10]. The
このように、この実施例では、動作管理データＡ０〜Ａ１を、［００］→［０１］→・・・［０１］→［１０］と推移させる最終サイクルにおいて、複数ビット長のエラー情報（異常時はＦＦＨ）を取得することができる。そして、正当にパラレル送信できなかった音声コマンドＳＮＤを再送することで、音声演出を適切に進行させることができる。したがって、図４（ｃ）の構成によっても、音声演出が突然、途絶えるような不自然さを確実に解消されることができる。 As described above, in this embodiment, error information (abnormality of a plurality of bits) is obtained in the final cycle in which the operation management data A0 to A1 are changed from [00] → [01] →. FFH) can be obtained. Then, by retransmitting the voice command SND that could not be properly transmitted in parallel, the voice effect can be appropriately advanced. Therefore, even with the configuration of FIG. 4C, it is possible to reliably eliminate the unnaturalness that the sound effect suddenly stops.
ところで、ここまでの説明は、演出制御部２２’は、エラー情報を含んだステイタス情報ＳＴＳを、音声合成回路４２からシリアル受信又はパラレル受信しているが、何ら、この構成に限定されるものではない。
By the way, in the description so far, the
すなわち、音声合成回路４２が通信エラーを認識すると、演出制御部２２’に割込み信号を出力する構成を採るのも好適であり、この場合には、演出制御部２２’の割込み処理プログラムにおいて、通信エラーが生じた音声コマンドを再送すればよい。このような構成は、シリアル伝送方式を採る場合に特に好適であり、殆どの場合に無駄な処理となる、図８のステップＳＴ４５〜ＳＴ４７の処理を省略することができる。
That is, it is preferable to adopt a configuration in which an interrupt signal is output to the
ＧＭ 遊技機
４３ 記憶手段
４２ 音声合成手段
４６ 音声増幅手段
５１ 音声制御レジスタ
２２’ 演出制御部
Claims (5)
レジスタアドレスで特定される所定の音声制御レジスタに、所定の設定値を設定するべく設定値データと前記レジスタアドレスを、音声合成手段に伝送して音声演出を制御する演出制御手段との間を、
前記設定値データや前記レジスタアドレスである伝送データを、所定の単位で伝送する双方向通信可能なパラレル信号線と、伝送データの種別を特定可能な管理データを伝送する管理データ線と、パラレル信号線の動作モードが、送信モードか受信モードかを特定する制御信号線と、を含んで接続した遊技機であって、
制御信号線を送信モードに設定した状態で、管理データ線に所定の管理データを出力すると共に、パラレル信号線に前記レジスタアドレスを出力するアドレス手段と、
前記アドレス手段を機能させた後、制御信号線を送信モードに設定した状態で、管理データ線の管理データを変化させると共に、パラレル信号線に前記設定値データを出力する設定手段とを、演出制御手段に設けることで、音声合成手段を機能させると共に、
前記アドレス手段を機能させた後、制御信号線を受信モードに設定した状態で、管理データ線の管理データを変化させると共に、パラレル信号線からデータを取得する取得手段を、演出制御手段に設けることで、音声合成手段の動作状態を演出制御手段が把握するよう構成されていることを特徴とする遊技機。 A voice synthesizing unit that operates based on a set value set in the voice control register, reads data stored in a predetermined storage unit, and reproduces a voice signal;
In order to set a predetermined set value in a predetermined voice control register specified by the register address, between the setting value data and the register address, the effect control means for controlling the sound effect by transmitting to the voice synthesis means ,
A parallel signal line capable of bidirectional communication for transmitting the set value data and transmission data as the register address in predetermined units, a management data line for transmitting management data capable of specifying the type of transmission data, and a parallel signal A game machine connected to include a control signal line that specifies whether the operation mode of the line is a transmission mode or a reception mode ;
Address means for outputting predetermined management data to the management data line and outputting the register address to the parallel signal line in a state where the control signal line is set to the transmission mode;
After setting the address means to function, change the management data of the management data line in a state in which the control signal line is set to the transmission mode, and set the means for outputting the set value data to the parallel signal line. By providing in the means, the voice synthesizing means functions,
After the addressing unit functions, the production control unit is provided with an acquisition unit for changing the management data of the management data line and acquiring data from the parallel signal line in a state where the control signal line is set to the reception mode. A game machine characterized in that the production control means grasps the operating state of the voice synthesis means .
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2014230443A JP6415256B2 (en) | 2014-11-13 | 2014-11-13 | Game machine |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2014230443A JP6415256B2 (en) | 2014-11-13 | 2014-11-13 | Game machine |
Publications (3)
| Publication Number | Publication Date |
|---|---|
| JP2016093271A JP2016093271A (en) | 2016-05-26 |
| JP2016093271A5 JP2016093271A5 (en) | 2017-12-21 |
| JP6415256B2 true JP6415256B2 (en) | 2018-10-31 |
Family
ID=56069820
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2014230443A Active JP6415256B2 (en) | 2014-11-13 | 2014-11-13 | Game machine |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP6415256B2 (en) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP6472426B2 (en) * | 2016-11-14 | 2019-02-20 | 株式会社藤商事 | Game machine |
| JP6415525B2 (en) * | 2016-12-21 | 2018-10-31 | 株式会社藤商事 | Game machine |
| JP6415524B2 (en) * | 2016-12-21 | 2018-10-31 | 株式会社藤商事 | Game machine |
| JP2021129715A (en) * | 2020-02-19 | 2021-09-09 | 株式会社サンセイアールアンドディ | Game machine |
| JP7836200B2 (en) * | 2022-03-16 | 2026-03-26 | 株式会社平和 | Gaming machine |
Family Cites Families (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3725772B2 (en) * | 2000-10-17 | 2005-12-14 | 株式会社平和 | Control device for gaming machine |
| JP4318018B2 (en) * | 2002-03-29 | 2009-08-19 | 株式会社大一商会 | Pachinko machine |
| JP4432029B2 (en) * | 2003-10-24 | 2010-03-17 | 株式会社大一商会 | Game machine |
| JP4584169B2 (en) * | 2006-03-20 | 2010-11-17 | 株式会社藤商事 | Game machine |
| JP5256418B2 (en) * | 2010-11-25 | 2013-08-07 | 株式会社大都技研 | Amusement stand |
-
2014
- 2014-11-13 JP JP2014230443A patent/JP6415256B2/en active Active
Also Published As
| Publication number | Publication date |
|---|---|
| JP2016093271A (en) | 2016-05-26 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP6128860B2 (en) | Game machine | |
| JP5818827B2 (en) | Game machine | |
| JP5735555B2 (en) | Game machine | |
| JP4714753B2 (en) | Game machine | |
| JP6328587B2 (en) | Game machine | |
| JP6415256B2 (en) | Game machine | |
| JP6125575B2 (en) | Game machine | |
| JP2019208974A (en) | Game machine | |
| JP6189387B2 (en) | Game machine | |
| JP6387060B2 (en) | Game machine | |
| JP6012686B2 (en) | Game machine | |
| JP2019208977A (en) | Game machine | |
| JP5735556B2 (en) | Game machine | |
| JP6010174B2 (en) | Game machine | |
| JP6320493B2 (en) | Game machine | |
| JP5735557B2 (en) | Game machine | |
| JP6047647B2 (en) | Game machine | |
| JP5909570B1 (en) | Game machine | |
| JP2013150740A (en) | Game machine | |
| JP6424247B2 (en) | Game machine | |
| JP6180599B2 (en) | Game machine | |
| JP5996705B2 (en) | Game machine | |
| JP6125245B2 (en) | Game machine | |
| JP6125558B2 (en) | Game machine | |
| JP6262297B2 (en) | Game machine |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20171110 |
|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20171110 |
|
| TRDD | Decision of grant or rejection written | ||
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20180831 |
|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20180905 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20181002 |
|
| R150 | Certificate of patent or registration of utility model |
Ref document number: 6415256 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |