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JP6469899B2 - Multilayer capacitor - Google Patents
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Description

本発明は、小型化及び高性能化に対応可能な積層コンデンサ及びその製造方法に関する。   The present invention relates to a multilayer capacitor that can be reduced in size and performance, and a method for manufacturing the same.

近年、電子機器の小型化及び高性能化に伴い、電子機器に用いられる積層コンデンサに対する小型化及び大容量化への要求がますます強くなってきている。この要求に応えるため、積層コンデンサの多層化及び薄層化が進んできている。   In recent years, with the miniaturization and high performance of electronic devices, there is an increasing demand for miniaturization and large capacity of multilayer capacitors used in electronic devices. In order to meet this demand, multilayer capacitors are becoming increasingly multilayered and thinned.

積層コンデンサの多層化及び薄層化が進むと、積層コンデンサの各誘電体層間における容量のばらつきが発生しやすくなる。これにより、積層コンデンサの容量が設計値からずれ、積層コンデンサの製造ばらつきが発生する。したがって、積層コンデンサの各誘電体層間における容量のばらつきを抑制可能な技術が求められる。   As multilayer capacitors are multilayered and thinned, variations in capacitance between dielectric layers of the multilayer capacitor are likely to occur. As a result, the capacitance of the multilayer capacitor deviates from the design value, resulting in manufacturing variations of the multilayer capacitor. Therefore, there is a demand for a technique that can suppress variation in capacitance between the dielectric layers of the multilayer capacitor.

特許文献1には、積層コンデンサの各誘電体層ごとに容量を変化させることが可能な技術が開示されている。この技術では、積層コンデンサのすべての誘電体層における容量が均一になるように、積層コンデンサの各層ごとに内部電極及び誘電体層の厚さを変化させる。   Patent Document 1 discloses a technique that can change the capacitance for each dielectric layer of a multilayer capacitor. In this technique, the thickness of the internal electrode and the dielectric layer is changed for each layer of the multilayer capacitor so that the capacitance in all the dielectric layers of the multilayer capacitor is uniform.

特開2007−173725号公報JP 2007-173725 A

積層コンデンサには、上記の小型化及び大容量化に加え、低コスト化が強く要求されている。   In addition to the above-described miniaturization and large capacity, multilayer capacitors are strongly required to reduce costs.

一般的な積層コンデンサの製造方法には、大面積のセラミックシートが用いられる。大面積のセラミックシートが用いられる製造方法では、複数の積層コンデンサについて、一括して内部電極の印刷を行い、一括して積層を行うことが可能となる。これにより、積層コンデンサを低コストで製造することができるようになる。   A large-area ceramic sheet is used in a general method for manufacturing a multilayer capacitor. In a manufacturing method in which a large-area ceramic sheet is used, it is possible to collectively print the internal electrodes of a plurality of multilayer capacitors and to laminate them in a lump. Thereby, the multilayer capacitor can be manufactured at low cost.

その点、特許文献1に記載の技術では、積層コンデンサの各誘電体層ごとに厚さの異なるセラミックシートを準備する必要がある。更に、積層コンデンサにおける内部電極の厚さを各誘電体層ごとに変化させるため、各セラミックシートごとに異なる条件で内部電極の印刷を行う必要がある。このように、特許文献1に係る技術では、製造プロセスが複雑化し、積層コンデンサの製造コストが増大する。   In that respect, in the technique described in Patent Document 1, it is necessary to prepare ceramic sheets having different thicknesses for each dielectric layer of the multilayer capacitor. Furthermore, since the thickness of the internal electrode in the multilayer capacitor is changed for each dielectric layer, it is necessary to print the internal electrode under different conditions for each ceramic sheet. As described above, in the technique according to Patent Document 1, the manufacturing process becomes complicated, and the manufacturing cost of the multilayer capacitor increases.

以上のような事情に鑑み、本発明の目的は、各誘電体層間の容量のばらつきを抑制可能な積層コンデンサ及びその製造方法を提供することにある。   In view of the circumstances as described above, an object of the present invention is to provide a multilayer capacitor capable of suppressing variation in capacitance between dielectric layers and a method for manufacturing the same.

上記目的を達成するため、本発明の一形態に係る積層コンデンサは、素体と、第1外部電極と、第2外部電極とを具備する。
上記素体は、第1内部電極と、誘電体層と、第2内部電極とが積層された積層体と、上記積層体と接続する第1及び第2保護層とを有する。
上記第1外部電極は、上記素体の第1端面を覆い、上記第1内部電極に接続する。
上記第2外部電極は、上記素体の第2端面を覆い、上記第2内部電極に接続する。
In order to achieve the above object, a multilayer capacitor according to an aspect of the present invention includes an element body, a first external electrode, and a second external electrode.
The element body includes a laminated body in which a first internal electrode, a dielectric layer, and a second internal electrode are laminated, and first and second protective layers connected to the laminated body.
The first external electrode covers the first end surface of the element body and is connected to the first internal electrode.
The second external electrode covers the second end surface of the element body and is connected to the second internal electrode.

この構成では、マンガンの含有量が多く、マグネシウムの含有量が少ない保護層によって酸素の拡散が制御可能となるため、第1及び第2内部電極間の各誘電体層間における容量のばらつきが抑制される。これにより、積層コンデンサの容量を、狙いの設計の容量にすることができる。   In this configuration, since the diffusion of oxygen can be controlled by the protective layer having a high manganese content and a low magnesium content, variation in capacitance between the dielectric layers between the first and second internal electrodes is suppressed. The Thereby, the capacity | capacitance of a multilayer capacitor can be made into the capacity | capacitance of the target design.

上記積層体の上記保護層に隣接する部分が、マンガンの含有量が上記積層体の中央部にある誘電層のセラミックスよりも多く上記第1及び第2保護層のセラミックスよりも少なく、マグネシウムの含有量が上記積層体の中央部にある誘電層のセラミックスよりも少なく上記第1及び第2保護層のセラミックスよりも多いセラミックスにより構成されていてもよい。   The portion adjacent to the protective layer of the laminate has a manganese content greater than that of the dielectric layer ceramic in the central portion of the laminate and less than the ceramics of the first and second protective layers, and contains magnesium. You may be comprised with the ceramic whose quantity is less than the ceramic of the dielectric layer in the center part of the said laminated body, and more than the ceramics of the said 1st and 2nd protective layer.

この構成では、積層体の保護層に隣接する部分が、積層体の中央部にあるセラミックスと、保護層を構成するセラミックスとの中間組成であるセラミックスにより構成されている。これにより、積層体と保護層との間のデラミネーションが生じにくくなる。   In this configuration, the portion of the laminate that is adjacent to the protective layer is made of ceramic that is an intermediate composition between the ceramic in the center of the laminate and the ceramic that forms the protective layer. Thereby, delamination between the laminate and the protective layer is less likely to occur.

上記第1及び第2保護層では、上記積層体に隣接するセラミックス粒子よりも、上記素体の表面にあるセラミックス粒子の方が、平均粒径が大きくてもよい。
この構成では、積層コンデンサの外面となる保護層の表面の強度が向上する。これにより、積層コンデンサの耐衝撃性が向上する。
In the first and second protective layers, the ceramic particles on the surface of the element body may have a larger average particle size than the ceramic particles adjacent to the laminate.
In this configuration, the strength of the surface of the protective layer that is the outer surface of the multilayer capacitor is improved. Thereby, the impact resistance of the multilayer capacitor is improved.

本発明の一形態に係る積層コンデンサの製造方法では、第1セラミックスにより構成され、第1内部電極が形成される第1セラミックシートが準備される。
上記第1セラミックスにより構成され、第2内部電極が形成される第2セラミックシートが準備される。
マンガンの含有量が上記第1セラミックスよりも多く、マグネシウムの含有量が上記第1セラミックスよりも少ない第2セラミックスにより構成される第3セラミックシートが準備される。
上記第1及び第2セラミックシートとが交互に配置され、上記第1及び第2セラミックシートを挟んで上記第3セラミックシートが配置されるように、上記第1、第2及び第3セラミックシートを積層して積層体が作製される。
In the method for manufacturing a multilayer capacitor according to one aspect of the present invention, a first ceramic sheet made of a first ceramic and having a first internal electrode is prepared.
A second ceramic sheet made of the first ceramic and having a second internal electrode is prepared.
A third ceramic sheet composed of a second ceramic having a manganese content higher than that of the first ceramic and a magnesium content lower than that of the first ceramic is prepared.
The first, second and third ceramic sheets are arranged so that the first and second ceramic sheets are alternately arranged, and the third ceramic sheet is arranged with the first and second ceramic sheets interposed therebetween. A laminate is produced by laminating.

各誘電体層間の容量のばらつきを抑制可能な積層コンデンサ及びその製造方法を提供することができる。   A multilayer capacitor capable of suppressing variation in capacitance between dielectric layers and a method for manufacturing the same can be provided.

本発明の第1の実施形態に係る積層コンデンサの斜視図である。1 is a perspective view of a multilayer capacitor according to a first embodiment of the present invention. 上記積層コンデンサの素体の斜視図である。It is a perspective view of the element body of the multilayer capacitor. 上記素体の図2のA−A'線に沿った断面図である。It is sectional drawing along the AA 'line of FIG. 2 of the said element | base_body. 上記素体の図2のB−B'線に沿った断面図である。It is sectional drawing along the BB 'line | wire of FIG. 2 of the said element | base_body. 上記積層コンデンサの製造方法を示すフローチャートである。It is a flowchart which shows the manufacturing method of the said multilayer capacitor. 上記積層コンデンサの製造過程におけるセラミックシートの積層を示す斜視図である。It is a perspective view which shows lamination | stacking of the ceramic sheet | seat in the manufacture process of the said multilayer capacitor. 上記積層コンデンサの製造過程における未焼成の素体を示す斜視図である。It is a perspective view which shows the unbaking element | base_body in the manufacturing process of the said multilayer capacitor. 上記積層コンデンサの製造過程における未焼成の積層コンデンサを示す斜視図である。It is a perspective view which shows the unbaked multilayer capacitor in the manufacturing process of the said multilayer capacitor. 本発明の第2の実施形態に係る積層コンデンサの断面図である。It is sectional drawing of the multilayer capacitor which concerns on the 2nd Embodiment of this invention. 上記積層コンデンサの断面図である。It is sectional drawing of the said multilayer capacitor. 上記積層コンデンサの積層体のZ軸方向上面を示す平面図である。It is a top view which shows the Z-axis direction upper surface of the laminated body of the said multilayer capacitor. 上記積層コンデンサの積層体のZ軸方向下面を示す平面図である。It is a top view which shows the Z-axis direction lower surface of the laminated body of the said multilayer capacitor. 本発明の第3の実施形態に係る積層コンデンサの断面図である。It is sectional drawing of the multilayer capacitor which concerns on the 3rd Embodiment of this invention. 上記積層コンデンサの製造過程におけるセラミックシートの積層を示す斜視図である。It is a perspective view which shows lamination | stacking of the ceramic sheet | seat in the manufacture process of the said multilayer capacitor.

以下、図面を参照しながら、本発明の実施形態を説明する。
図面には、適宜相互に直交するX軸、Y軸、及びZ軸が示されている。X軸、Y軸、及びZ軸は全図において共通である。
Hereinafter, embodiments of the present invention will be described with reference to the drawings.
In the drawing, an X axis, a Y axis, and a Z axis that are orthogonal to each other are shown as appropriate. The X axis, Y axis, and Z axis are common in all drawings.

<第1の実施形態>
[積層コンデンサ10の構成]
図1は本発明の第1の実施形態に係る積層コンデンサ10の斜視図である。積層コンデンサ10は、素体11と、第1外部電極14と、第2外部電極15とを具備する。外部電極14,15は、素体11のX軸方向両端部にそれぞれ設けられている。
<First Embodiment>
[Configuration of Multilayer Capacitor 10]
FIG. 1 is a perspective view of the multilayer capacitor 10 according to the first embodiment of the present invention. The multilayer capacitor 10 includes an element body 11, a first external electrode 14, and a second external electrode 15. The external electrodes 14 and 15 are provided at both ends of the element body 11 in the X-axis direction.

図2は、素体11の斜視図である。図3は素体11の図2のA−A'線に沿った断面図であり、図4は素体11の図2のB−B'線に沿った断面図である。素体11は、積層体16と、第1保護層17と、第2保護層18とを有する。   FIG. 2 is a perspective view of the element body 11. 3 is a cross-sectional view of the element body 11 taken along the line AA ′ of FIG. 2, and FIG. 4 is a cross-sectional view of the element body 11 taken along the line BB ′ of FIG. The element body 11 includes a stacked body 16, a first protective layer 17, and a second protective layer 18.

積層体16は、X軸、Y軸及びZ軸に沿った辺を有する直方体状である。第1保護層17は積層体16のZ軸方向上面(第1主面)に設けられ、第2保護層18は積層体16のZ軸方向下面(第2主面)に設けられている。保護層17,18は、いずれもXY平面に沿って延びる平板状であり、積層体16のZ軸方向上下面の全面を覆っている。   The stacked body 16 has a rectangular parallelepiped shape having sides along the X axis, the Y axis, and the Z axis. The first protective layer 17 is provided on the upper surface (first main surface) in the Z-axis direction of the multilayer body 16, and the second protective layer 18 is provided on the lower surface (second main surface) in the Z-axis direction of the multilayer body 16. Each of the protective layers 17 and 18 has a flat plate shape extending along the XY plane, and covers the entire upper and lower surfaces of the stacked body 16 in the Z-axis direction.

積層体16は、X軸に垂直な第1端面T1及び第2端面T2を有する。また、積層体16は、複数の第1内部電極12と、複数の第2内部電極13とを有する。内部電極12,13は、いずれもXY平面に沿って延びるシート状であり、Z軸に沿って交互に積層されている。第1内部電極12は第1端面T1に露出し、第2内部電極13は第2端面T2に露出している。   The stacked body 16 has a first end face T1 and a second end face T2 perpendicular to the X axis. The stacked body 16 includes a plurality of first internal electrodes 12 and a plurality of second internal electrodes 13. Each of the internal electrodes 12 and 13 has a sheet shape extending along the XY plane, and is alternately stacked along the Z axis. The first internal electrode 12 is exposed at the first end face T1, and the second internal electrode 13 is exposed at the second end face T2.

図1に示すように、積層体16の第1端面T1は第1外部電極14によって覆われ、積層体16の第2端面T2は第2外部電極15によって覆われている。これにより、第1端面T1に露出している第1内部電極12が第1外部電極14に接続され、第2端面T2に露出している第2内部電極13が第2外部電極15に接続されている。   As shown in FIG. 1, the first end face T <b> 1 of the multilayer body 16 is covered with the first external electrode 14, and the second end face T <b> 2 of the multilayer body 16 is covered with the second external electrode 15. As a result, the first internal electrode 12 exposed at the first end face T1 is connected to the first external electrode 14, and the second internal electrode 13 exposed at the second end face T2 is connected to the second external electrode 15. ing.

上記のような構成により、積層コンデンサ10では、第1外部電極14と第2外部電極15との間に電圧が印加されると、第1内部電極12と第2内部電極13との間の複数の誘電体層に電圧が加わる。   With the configuration as described above, in the multilayer capacitor 10, when a voltage is applied between the first external electrode 14 and the second external electrode 15, a plurality of portions between the first internal electrode 12 and the second internal electrode 13 are provided. A voltage is applied to the dielectric layer.

積層体16は、第1セラミックスによって構成されている。第1セラミックスとしては、内部電極12,13間の各誘電体層の容量を大きくするため、高誘電率の材料が採用される。第1セラミックスとしては、例えば、チタン酸バリウム(BaTiO)に代表される、バリウム(Ba)及びチタン(Ti)を含むペロブスカイト構造の材料が採用可能である。 The laminate 16 is made of a first ceramic. As the first ceramic, a material having a high dielectric constant is employed in order to increase the capacitance of each dielectric layer between the internal electrodes 12 and 13. As the first ceramic, for example, a material having a perovskite structure including barium (Ba) and titanium (Ti) represented by barium titanate (BaTiO 3 ) can be used.

積層体16を構成する第1セラミックスには、マンガン(Mn)及びマグネシウム(Mg)が含まれる。第1セラミックスでは、マンガンの作用によって耐還元性が向上し、マグネシウムの作用によって誘電率のフラットな温度特性が得られる。   The first ceramics constituting the laminate 16 includes manganese (Mn) and magnesium (Mg). In the first ceramic, reduction resistance is improved by the action of manganese, and temperature characteristics having a flat dielectric constant are obtained by the action of magnesium.

例えば、第1セラミックスのマンガン含有量は、チタン酸バリウム100molに対して、0.1〜1.0molとすることができる。また、第1セラミックスのマグネシウム含有量は、チタン酸バリウム100molに対して、0.1〜1.0molとすることができる。   For example, the manganese content of the first ceramic can be 0.1 to 1.0 mol with respect to 100 mol of barium titanate. Moreover, the magnesium content of the first ceramic can be 0.1 to 1.0 mol with respect to 100 mol of barium titanate.

本実施形態に係る積層コンデンサ10の製造方法では、素体11が還元雰囲気下で焼成される。還元雰囲気下での焼成では、酸素の拡散が制御されていないと、積層体16の各誘電体層間で容量のばらつきが大きくなり、積層コンデンサ10の容量が、狙いとする設計の容量からずれてしまう場合がある。   In the method for manufacturing the multilayer capacitor 10 according to this embodiment, the element body 11 is fired in a reducing atmosphere. In firing in a reducing atmosphere, if the diffusion of oxygen is not controlled, the variation in capacitance between the dielectric layers of the multilayer body 16 increases, and the capacitance of the multilayer capacitor 10 deviates from the target design capacitance. May end up.

本実施形態に係る積層コンデンサ10では、積層体16のZ軸方向上下面からの酸素の侵入を防止することにより、各誘電体層間における容量のばらつきを抑制するために、保護層17,18が設けられている。   In the multilayer capacitor 10 according to the present embodiment, the protective layers 17 and 18 are provided in order to suppress variation in capacitance between the dielectric layers by preventing oxygen from entering from the upper and lower surfaces in the Z-axis direction of the multilayer body 16. Is provided.

保護層17,18は、第2セラミックスによって構成されている。保護層17,18を構成する第2セラミックスは、積層体16を構成する第1セラミックスと、マンガンの含有量、及びマグネシウムの含有量のみが異なる。第2セラミックスでは、マンガンの含有量が第1セラミックスより多く、マグネシウムの含有量が第2セラミックスより少ない。   The protective layers 17 and 18 are made of a second ceramic. The second ceramics constituting the protective layers 17 and 18 differ from the first ceramics constituting the laminate 16 only in the content of manganese and the content of magnesium. In the second ceramic, the manganese content is higher than that of the first ceramic, and the magnesium content is lower than that of the second ceramic.

例えば、第2セラミックスのマンガン含有量は、チタン酸バリウム100molに対して、0.5〜2.0molとすることができる。また、第2セラミックスのマグネシウム含有量は、チタン酸バリウム100molに対して、0〜0.5molとすることができる。   For example, the manganese content of the second ceramic can be set to 0.5 to 2.0 mol with respect to 100 mol of barium titanate. The magnesium content of the second ceramic can be 0 to 0.5 mol with respect to 100 mol of barium titanate.

マンガンの含有量が多く、マグネシウムの含有量が少ない第2セラミックスでは、第1セラミックスよりも酸素の拡散を制御可能である。   In the second ceramics having a high manganese content and a low magnesium content, the diffusion of oxygen can be controlled as compared with the first ceramics.

比較例として、本実施形態に係る積層コンデンサ10の保護層17,18が、積層体16と同様の第1セラミックスによって構成される積層コンデンサを作製した。この積層コンデンサについて、各誘電体層の容量を測定した。そして、各誘電体層の容量の最大値CMAX、最小値CMIN、及び平均値CAVEを用い、ばらつき率D(=100×(CMAX−CMIN)/CAVE)[%]を算出した。その結果、比較例に係る積層コンデンサのばらつき率Dは7[%]であった。 As a comparative example, a multilayer capacitor in which the protective layers 17 and 18 of the multilayer capacitor 10 according to the present embodiment are made of the same first ceramic as the multilayer body 16 was produced. For this multilayer capacitor, the capacitance of each dielectric layer was measured. Then, using the maximum value C MAX , the minimum value C MIN , and the average value C AVE of each dielectric layer, a variation rate D (= 100 × (C MAX −C MIN ) / C AVE ) [%] is calculated. did. As a result, the variation rate D of the multilayer capacitor according to the comparative example was 7 [%].

本実施形態に係る積層コンデンサ10について、上記の比較例と同様の測定を行い、ばらつき率Dを算出した。その結果、本実施形態に係る積層コンデンサ10のばらつき率Dは3[%]であった。   For the multilayer capacitor 10 according to the present embodiment, the same measurement as in the above comparative example was performed, and the variation rate D was calculated. As a result, the variation rate D of the multilayer capacitor 10 according to the present embodiment was 3 [%].

以上のように、本実施形態に係る積層コンデンサ10では、保護層17,18によって、焼成時における酸素の拡散を制御できる。したがって、積層コンデンサ10の容量は、狙いとする設計の容量からずれにくい。   As described above, in the multilayer capacitor 10 according to this embodiment, diffusion of oxygen during firing can be controlled by the protective layers 17 and 18. Therefore, the capacitance of the multilayer capacitor 10 is unlikely to deviate from the target designed capacitance.

[積層コンデンサ10の製造方法]
図5は、本実施形態に係る積層コンデンサ10の製造方法を示すフローチャートである。図6〜8は積層コンデンサ10の製造過程を示す図である。以下、積層コンデンサ10の製造方法について、図5に沿って、図6〜8を適宜参照しながら説明する。
[Method of Manufacturing Multilayer Capacitor 10]
FIG. 5 is a flowchart showing a method for manufacturing the multilayer capacitor 10 according to the present embodiment. 6 to 8 are diagrams showing a manufacturing process of the multilayer capacitor 10. Hereinafter, a method for manufacturing the multilayer capacitor 10 will be described along FIG. 5 with reference to FIGS.

(ステップS1:セラミックシート準備)
図6は、図5のステップS1〜S3を説明するための図である。
(Step S1: Preparation of ceramic sheet)
FIG. 6 is a diagram for explaining steps S1 to S3 in FIG.

まず、積層体16を形成するためのセラミックシート110Uと、保護層17,18を形成するためのセラミックシート111Uとを準備する。セラミックシート110U,111Uは、未焼成の誘電体グリーンシートとして構成される。セラミックシート110Uは第1セラミックスによって構成され、セラミックシート111Uは第2セラミックスによって構成される。   First, a ceramic sheet 110U for forming the laminate 16 and a ceramic sheet 111U for forming the protective layers 17 and 18 are prepared. The ceramic sheets 110U and 111U are configured as unfired dielectric green sheets. The ceramic sheet 110U is made of a first ceramic, and the ceramic sheet 111U is made of a second ceramic.

セラミックシート110U,111Uは、例えば、ロールコーターを用いてシート状に成形することができる。セラミックシート110U,111Uは各積層コンデンサ10ごとに切り分けられておらず、以降のステップS2,S3は、複数の積層コンデンサ10について一括して行うことが可能である。   The ceramic sheets 110U and 111U can be formed into a sheet shape using, for example, a roll coater. The ceramic sheets 110U and 111U are not cut for each multilayer capacitor 10, and the subsequent steps S2 and S3 can be performed collectively for the plurality of multilayer capacitors 10.

(ステップS2:内部電極印刷)
セラミックシート110Uに、第1内部電極12となる未焼成の第1内部電極12Uを形成してセラミックシート112Uが得られる。また、セラミックシート110Uに、第2内部電極13となる未焼成の第2内部電極13Uを形成してセラミックシート112Uが得られる。内部電極12U,13Uの形成には、例えば、スクリーン印刷法を用いることができる。
(Step S2: Internal electrode printing)
The ceramic sheet 112U is obtained by forming the unfired first internal electrode 12U to be the first internal electrode 12 on the ceramic sheet 110U. Further, the ceramic sheet 112U is obtained by forming the unfired second internal electrode 13U to be the second internal electrode 13 on the ceramic sheet 110U. For example, a screen printing method can be used to form the internal electrodes 12U and 13U.

(ステップS3:積層)
図6に示すようにセラミックシート111U,112U,113Uを積層する。セラミックシート112U,113Uは、Z軸方向に交互に配置される。内部電極12,13が形成されていないセラミックシート111Uは、Z軸方向の最上部及び最下部に配置される。Z軸方向最上部及び最下部におけるセラミックシート111Uの枚数は、保護層17,18の厚さに応じて適宜決定可能である。
(Step S3: lamination)
As shown in FIG. 6, ceramic sheets 111U, 112U, and 113U are laminated. The ceramic sheets 112U and 113U are alternately arranged in the Z-axis direction. The ceramic sheets 111U on which the internal electrodes 12 and 13 are not formed are arranged at the uppermost part and the lowermost part in the Z-axis direction. The number of ceramic sheets 111U at the uppermost part and the lowermost part in the Z-axis direction can be appropriately determined according to the thickness of the protective layers 17 and 18.

図6では、説明の便宜上、セラミックシート111U,112U,113Uが各積層コンデンサ10をごとに切り分けられた状態を示している。しかし、作業効率及びハンドリング性などの観点から、セラミックシート111U,112U,113Uは、積層された後に、各積層コンデンサ10をごとに切り分けられることが好ましい。   For convenience of explanation, FIG. 6 shows a state in which the ceramic sheets 111U, 112U, and 113U are cut into the respective multilayer capacitors 10. However, from the viewpoints of work efficiency and handling properties, it is preferable that the ceramic sheets 111U, 112U, and 113U be separated into the respective multilayer capacitors 10 after being laminated.

積層されたセラミックシート111U,112U,113Uに対してプレス処理を施すことにより、複数のセラミックシート111U,112U,113Uが一体化し、複数の未焼成の素体11Uが配列された積層シートが得られる。プレス処理の方法としては、例えば、静水圧プレス法を用いることができる。積層シートは、各素体11となる未焼成の各素体11Uごとに切り分けられる。   By pressing the laminated ceramic sheets 111U, 112U, and 113U, a plurality of ceramic sheets 111U, 112U, and 113U are integrated to obtain a laminated sheet in which a plurality of unfired element bodies 11U are arranged. . As a pressing method, for example, an isostatic pressing method can be used. The laminated sheet is cut for each unfired element body 11U to be each element body 11.

なお、セラミックシート112U,113Uのうち最もZ軸方向下方にあるセラミックシート112U,113U(図6ではセラミックシート113U)は、セラミックシート110Uではなく、セラミックシート111Uによって形成されている。しかし、この構成は必須ではなく、セラミックシート112U,113Uがいずれもセラミックシート110Uによって形成されていてもよい。   Of the ceramic sheets 112U and 113U, the ceramic sheets 112U and 113U (the ceramic sheet 113U in FIG. 6) located at the lowest position in the Z-axis direction are formed by the ceramic sheet 111U, not the ceramic sheet 110U. However, this configuration is not essential, and the ceramic sheets 112U and 113U may be formed of the ceramic sheet 110U.

図7は、本ステップS3で得られる未焼成の素体11Uの斜視図である。素体11Uでは、セラミックシート112U,113Uが積層体16Uとなり、セラミックシート111Uが保護層17U,18Uとなっている。積層体16Uの第1端面T1Uには第1内部電極12Uが露出し、積層体16Uの第2端面T2Uには第2内部電極13Uが露出している。   FIG. 7 is a perspective view of the unfired element body 11U obtained in step S3. In the element body 11U, the ceramic sheets 112U and 113U are the laminated bodies 16U, and the ceramic sheet 111U is the protective layers 17U and 18U. The first internal electrode 12U is exposed at the first end face T1U of the multilayer body 16U, and the second internal electrode 13U is exposed at the second end face T2U of the multilayer body 16U.

(ステップS4:外部電極形成)
図8に示すように、積層体16Uの第1端面T1Uを覆うように未焼成の外部電極14Uを設け、積層体16Uの第2端面T2Uを覆うように未焼成の外部電極15Uを設ける。これにより、未焼成の積層コンデンサ10Uが得られる。積層コンデンサ10Uでは、外部電極14Uが第1端面T1Uに露出する第1内部電極12Uに接続し、外部電極15Uが第2端面T2Uに露出する第2内部電極13Uに接続している。
(Step S4: External electrode formation)
As shown in FIG. 8, an unfired external electrode 14U is provided so as to cover the first end face T1U of the multilayer body 16U, and an unfired external electrode 15U is provided so as to cover the second end face T2U of the multilayer body 16U. Thereby, the unfired multilayer capacitor 10U is obtained. In the multilayer capacitor 10U, the external electrode 14U is connected to the first internal electrode 12U exposed at the first end face T1U, and the external electrode 15U is connected to the second internal electrode 13U exposed at the second end face T2U.

(ステップS5:焼成)
図8に示す未焼成の積層コンデンサ10Uを、還元雰囲気下で焼成することにより、図1に示す積層コンデンサ10が得られる。本ステップS5では、積層体16UのZ軸方向上下面に設けられた保護層17U,18Uによって、積層体16UのZ軸方向上下面からの酸素の拡散を制御できるようになる。
(Step S5: Firing)
The unfired multilayer capacitor 10U shown in FIG. 8 is fired in a reducing atmosphere to obtain the multilayer capacitor 10 shown in FIG. In this step S5, the diffusion of oxygen from the upper and lower surfaces in the Z-axis direction of the multilayer body 16U can be controlled by the protective layers 17U and 18U provided on the upper and lower surfaces in the Z-axis direction of the multilayer body 16U.

このように、本実施形態に係る積層コンデンサ10の製造方法では、各誘電体層間の容量のばらつきが少ない積層コンデンサ10が得られる。このため、本実施形態に係る製造方法によって製造される積層コンデンサ10の容量は、狙いの設計の容量からずれにくい。   As described above, in the method for manufacturing the multilayer capacitor 10 according to this embodiment, the multilayer capacitor 10 with less variation in capacitance between the dielectric layers can be obtained. For this reason, the capacity of the multilayer capacitor 10 manufactured by the manufacturing method according to the present embodiment is unlikely to deviate from the target designed capacity.

<第2の実施形態>
本発明の第2の実施形態に係る積層コンデンサについて説明する。本実施形態では、第1の実施形態と共通の構成について、その説明を適宜省略する。また、本実施形態の構成のうち、第1の実施形態に対応する構成には、第1の実施形態と同様の符号を用いる。
<Second Embodiment>
A multilayer capacitor according to a second embodiment of the present invention will be described. In the present embodiment, the description of the configuration common to the first embodiment will be omitted as appropriate. Moreover, the code | symbol similar to 1st Embodiment is used for the structure corresponding to 1st Embodiment among the structures of this embodiment.

[積層コンデンサの構成]
図9,10は、本実施形態に係る積層コンデンサの素体21の断面図である。図9は素体21のZX平面に平行な断面を示し、図10は素体21のYZ平面に平行な断面を示している。
[Configuration of multilayer capacitor]
9 and 10 are cross-sectional views of the multilayer capacitor element body 21 according to the present embodiment. 9 shows a cross section parallel to the ZX plane of the element body 21, and FIG. 10 shows a cross section parallel to the YZ plane of the element body 21.

本実施形態に係る積層コンデンサでは、積層コンデンサの焼成時における積層体26と保護層17,18との間の剥離(デラミネーション)を防止するため、中間部27,28が設けられる。   In the multilayer capacitor according to the present embodiment, intermediate portions 27 and 28 are provided in order to prevent peeling (delamination) between the multilayer body 26 and the protective layers 17 and 18 during firing of the multilayer capacitor.

第1中間部27は積層体26のZ軸方向上面に設けられ、第2中間部28は積層体26のZ軸方向下面に設けられている。したがって、第1中間部27は第1保護層17に隣接し、第2中間部28は第2保護層18に隣接する。   The first intermediate portion 27 is provided on the upper surface in the Z-axis direction of the stacked body 26, and the second intermediate portion 28 is provided on the lower surface in the Z-axis direction of the stacked body 26. Accordingly, the first intermediate portion 27 is adjacent to the first protective layer 17, and the second intermediate portion 28 is adjacent to the second protective layer 18.

図11は積層体16のZ軸方向上面を示す平面図であり、図12は積層体16のZ軸方向下面を示す平面図である。第1中間部27は、積層体26のZ軸方向上面の、第1内部電極12が露出していない領域に設けられている。第2中間部28は、積層体26のZ軸方向下面の、第2内部電極13が露出していない領域に設けられている。   FIG. 11 is a plan view showing the upper surface of the laminate 16 in the Z-axis direction, and FIG. 12 is a plan view showing the lower surface of the laminate 16 in the Z-axis direction. The first intermediate portion 27 is provided in a region on the upper surface in the Z-axis direction of the stacked body 26 where the first internal electrode 12 is not exposed. The second intermediate portion 28 is provided in an area where the second internal electrode 13 is not exposed on the lower surface in the Z-axis direction of the multilayer body 26.

また、中間部27,28は、積層体26の1層分のZ軸方向の厚さを有する。つまり、第1中間部27は、積層体26のZ軸方向上面から、上から2層目の第2内部電極13までの領域に配置されている。また、第2中間部28は、積層体26のZ軸方向下面から、下から2層目の第1内部電極12までの領域に配置されている。   Further, the intermediate portions 27 and 28 have a thickness in the Z-axis direction corresponding to one layer of the stacked body 26. That is, the first intermediate portion 27 is disposed in a region from the upper surface in the Z-axis direction of the multilayer body 26 to the second internal electrode 13 in the second layer from the top. The second intermediate portion 28 is disposed in a region from the bottom surface in the Z-axis direction of the multilayer body 26 to the first internal electrode 12 in the second layer from the bottom.

このように、本実施形態に係る積層コンデンサでは、積層体26を構成する第1セラミックスと、保護層17,18を構成する第2セラミックスとが、直接接しておらず、中間部27,28を介して接続されている。   As described above, in the multilayer capacitor according to the present embodiment, the first ceramics constituting the multilayer body 26 and the second ceramics constituting the protective layers 17 and 18 are not in direct contact with each other, and the intermediate portions 27 and 28 are provided. Connected through.

本実施形態では、中間部27,28は、第3セラミックスによって構成されている。中間部27,28を構成する第3セラミックスは、積層体16を構成する第1セラミックス、及び保護層17,18を構成する第2セラミックスと、マンガン及びマグネシウムの含有量のみが異なる。より詳細には、第3セラミックスのマンガンの含有量は、第1セラミックスより多く、第2セラミックスより少ない。また、第3セラミックスのマグネシウムの含有量は、第1セラミックスより少なく、第2セラミックスより多い。   In the present embodiment, the intermediate portions 27 and 28 are made of third ceramics. The third ceramics constituting the intermediate portions 27 and 28 differ from the first ceramics constituting the laminated body 16 and the second ceramics constituting the protective layers 17 and 18 only in the contents of manganese and magnesium. More specifically, the manganese content of the third ceramic is greater than that of the first ceramic and less than that of the second ceramic. The magnesium content of the third ceramic is less than that of the first ceramic and higher than that of the second ceramic.

つまり、中間部27,28を構成する第3セラミックスは、積層体16を構成する第1セラミックスと、保護層17,18を構成する第2セラミックスとの中間組成を有する。したがって、第3セラミックスは、第1セラミックスと第2セラミックスとの中間の性質を有する。例えば、積層コンデンサの焼成時における第3セラミックスの収縮率は、第1セラミックスの収縮率と、第2セラミックスの収縮率との中間となる。   That is, the third ceramics constituting the intermediate portions 27 and 28 have an intermediate composition between the first ceramics constituting the laminated body 16 and the second ceramics constituting the protective layers 17 and 18. Accordingly, the third ceramic has an intermediate property between the first ceramic and the second ceramic. For example, the shrinkage rate of the third ceramic during firing of the multilayer capacitor is intermediate between the shrinkage rate of the first ceramic and the shrinkage rate of the second ceramic.

したがって、積層コンデンサの焼成時における第1中間部27の収縮率は、第1セラミックスによって構成される積層体26の収縮率にも、第2セラミックスによって構成される第1保護層17の収縮率にも近い。このため、第1中間部27は、積層コンデンサの焼成時に積層体26及び保護層17から剥離しにくく、積層体26と保護層17とを良好に接続する。   Therefore, the shrinkage rate of the first intermediate portion 27 at the time of firing the multilayer capacitor is equal to the shrinkage rate of the multilayer body 26 made of the first ceramics and the shrinkage rate of the first protective layer 17 made of the second ceramics. Is also close. For this reason, the 1st intermediate part 27 cannot peel easily from the laminated body 26 and the protective layer 17 at the time of baking of a multilayer capacitor, and connects the laminated body 26 and the protective layer 17 favorably.

また、積層コンデンサの焼成時における第2中間部28の収縮率は、第1セラミックスによって構成される積層体26の収縮率にも、第2セラミックスによって構成される第2保護層18の収縮率にも近い。このため、第2中間部28は、積層コンデンサの焼成時に積層体26及び保護層18から剥離しにくく、積層体26と保護層17とを良好に接続する。   Further, the shrinkage rate of the second intermediate portion 28 at the time of firing the multilayer capacitor is equal to the shrinkage rate of the multilayer body 26 made of the first ceramics and the shrinkage rate of the second protective layer 18 made of the second ceramics. Is also close. For this reason, the 2nd intermediate part 28 cannot peel easily from the laminated body 26 and the protective layer 18 at the time of baking of a multilayer capacitor, and connects the laminated body 26 and the protective layer 17 favorably.

したがって、本実施形態に係る積層コンデンサでは、中間部27,28の作用により、積層体26と保護層17,18との間のデラミネーションが生じにくい。   Therefore, in the multilayer capacitor according to the present embodiment, delamination between the multilayer body 26 and the protective layers 17 and 18 hardly occurs due to the action of the intermediate portions 27 and 28.

なお、中間部27,28は、積層体16の内部電極12,13間に配置されていないため、積層コンデンサの容量に影響を与えない。つまり、本実施形態に係る積層コンデンサでは、容量を変化させることなく、積層体16と保護層17,18と間のデラミネーションを防止することができる。   Since the intermediate portions 27 and 28 are not disposed between the internal electrodes 12 and 13 of the multilayer body 16, they do not affect the capacitance of the multilayer capacitor. That is, in the multilayer capacitor according to this embodiment, delamination between the multilayer body 16 and the protective layers 17 and 18 can be prevented without changing the capacitance.

また、中間部27,28を構成する第3セラミックスのマンガン及びマグネシウムの含有量は均一でなくてもよい。例えば、中間部27,28を構成する第3セラミックスは、保護層17,18に近いほどマンガンの含有量が多くなっていてもよい。また、中間部27,28を構成する第3セラミックスは、保護層17,18に近いほどマグネシウムの含有量が少なくなっていてもよい。   Further, the contents of manganese and magnesium in the third ceramics constituting the intermediate portions 27 and 28 may not be uniform. For example, the third ceramics constituting the intermediate portions 27 and 28 may have a higher manganese content as they are closer to the protective layers 17 and 18. Further, the third ceramics constituting the intermediate portions 27 and 28 may have a lower magnesium content as they are closer to the protective layers 17 and 18.

更に、積層体16のY軸方向の両端部にある、Z軸方向の全範囲にわたって内部電極12,13が設けられていないサイドマージン部19(図10参照)では、中間部27,28がZ軸方向のより深い位置まで拡張されていてもよい。   Further, in the side margin portion 19 (see FIG. 10) where the internal electrodes 12 and 13 are not provided over the entire range in the Z-axis direction at both ends in the Y-axis direction of the multilayer body 16, the intermediate portions 27 and 28 are Z It may be extended to a deeper position in the axial direction.

[積層コンデンサの製造方法]
本実施形態に係る積層コンデンサの中間部27,28は、マンガン及びマグネシウムの組成を調整したセラミックシートを積層することで形成することができる。
[Manufacturing method of multilayer capacitor]
The intermediate portions 27 and 28 of the multilayer capacitor in accordance with the present embodiment can be formed by laminating ceramic sheets with adjusted manganese and magnesium compositions.

つまり、第1の実施形態に係る積層工程(図6参照)において、中間部27,28に対応する部分に、未焼成の中間部27U,28Uを設け、未焼成の中間部27U,28Uを有する積層体16U(図7参照)を作製してもよい。これにより、焼成後に、本実施形態に係る中間部27,28を有する積層コンデンサが得られる。   That is, in the laminating step according to the first embodiment (see FIG. 6), unfired intermediate portions 27U and 28U are provided in portions corresponding to the intermediate portions 27 and 28, and unfired intermediate portions 27U and 28U are provided. You may produce the laminated body 16U (refer FIG. 7). Thereby, the multilayer capacitor | condenser which has the intermediate parts 27 and 28 which concern on this embodiment after baking is obtained.

<第3の実施形態>
本発明の第3の実施形態に係る積層コンデンサについて説明する。本実施形態では、第1の実施形態と共通の構成について、その説明を適宜省略する。また、本実施形態の構成のうち、第1の実施形態に対応する構成には、第1の実施形態と同様の符号を用いる。
<Third Embodiment>
A multilayer capacitor according to a third embodiment of the present invention will be described. In the present embodiment, the description of the configuration common to the first embodiment will be omitted as appropriate. Moreover, the code | symbol similar to 1st Embodiment is used for the structure corresponding to 1st Embodiment among the structures of this embodiment.

[積層コンデンサの構成]
図13は、本実施形態に係る積層コンデンサの素体31の断面図である。図13は素体31のZX平面に平行な断面を示している。
[Configuration of multilayer capacitor]
FIG. 13 is a cross-sectional view of the multilayer capacitor element body 31 according to the present embodiment. FIG. 13 shows a cross section of the element body 31 parallel to the ZX plane.

本実施形態に係る素体31は、第1の実施形態に係る素体11とは異なり、3層構造の保護層37,38を有する。第1保護層37は、積層体16のZ軸方向上面に第1層37a、第2層37b、第3層37cの順番に積層されて構成されている。また、第2保護層38は、積層体16のZ軸方向下面に第1層38a、第2層38b、第3層38cの順番に積層されて構成されている。   Unlike the element body 11 according to the first embodiment, the element body 31 according to the present embodiment includes protective layers 37 and 38 having a three-layer structure. The first protective layer 37 is configured by laminating the first layer 37a, the second layer 37b, and the third layer 37c in this order on the upper surface of the multilayer body 16 in the Z-axis direction. The second protective layer 38 is configured by laminating the first layer 38a, the second layer 38b, and the third layer 38c in this order on the lower surface in the Z-axis direction of the multilayer body 16.

第1層37a,38a、第2層37b,38b、及び第3層37c,38cは、いずれも第1の実施形態に係る保護層17,18と同様の第2セラミックスによって構成されているが、第2セラミックスを構成する誘電体結晶の平均粒径が相互に異なる。具体的には、第1層37a,38aの誘電体結晶の平均粒径が最も小さく、第3層37c,38cの誘電体結晶の平均粒径が最も大きい。   The first layers 37a and 38a, the second layers 37b and 38b, and the third layers 37c and 38c are all made of the same second ceramic as the protective layers 17 and 18 according to the first embodiment. The average grain sizes of the dielectric crystals constituting the second ceramic are different from each other. Specifically, the average grain size of the dielectric crystals of the first layers 37a and 38a is the smallest, and the average grain size of the dielectric crystals of the third layers 37c and 38c is the largest.

本実施形態では、第1層37a,38a、第2層37b,38b、及び第3層37c,38cの誘電体結晶の平均粒径は0.1〜0.5μmである。これに対し、第1層37a,38aの誘電体結晶の平均粒径は0.1〜0.5μmであり、第3層37c,38cの誘電体結晶の平均粒径は0.2〜1.0μmである。   In this embodiment, the average grain size of the dielectric crystals of the first layers 37a and 38a, the second layers 37b and 38b, and the third layers 37c and 38c is 0.1 to 0.5 μm. On the other hand, the average grain size of the dielectric crystals of the first layers 37a and 38a is 0.1 to 0.5 μm, and the average grain size of the dielectric crystals of the third layers 37c and 38c is 0.2 to 1. 0 μm.

積層体16に隣接する第1層37a,38aの誘電体結晶の平均粒径が小さいと、積層コンデンサの焼成時における第1層37a,38aの流動性が高くなる。これにより、焼成後の積層コンデンサにおいて、積層体16と第1層37a,38aとの高い密着性が得られる。したがって、本実施形態に係る積層コンデンサでは、積層体16と保護層37,38との間のデラミネーションを防止することができる。   When the average grain size of the dielectric crystals of the first layers 37a and 38a adjacent to the multilayer body 16 is small, the fluidity of the first layers 37a and 38a during firing of the multilayer capacitor is increased. Thereby, in the multilayer capacitor after firing, high adhesion between the multilayer body 16 and the first layers 37a and 38a is obtained. Therefore, in the multilayer capacitor according to this embodiment, delamination between the multilayer body 16 and the protective layers 37 and 38 can be prevented.

また、誘電体結晶の平均粒径が大きい第3層37c,38cは高い強度を有する。本実施形態に係る積層コンデンサでは、積層コンデンサの外面を構成する第3層37c,38cの強度が高いため、高い耐衝撃性が得られる。   Further, the third layers 37c and 38c having a large average grain size of the dielectric crystal have high strength. In the multilayer capacitor in accordance with this embodiment, the third layers 37c and 38c constituting the outer surface of the multilayer capacitor have high strength, so that high impact resistance can be obtained.

[積層コンデンサの製造方法]
図14に示すように、本実施形態に係る積層コンデンサの保護層37,38は、未焼成の保護層37U,38Uから形成される。保護層37U,38Uは、平均粒径の異なる第2セラミックスの粉末によって作製された第1層シート37aU,38aU、第2層シート37bU,38bU、及び第3層シート37cU,38cUにより構成される。第1層シート37aU,38aUの粉末の平均粒径が最も小さく、第3層シート37cU,38cUの粉末の平均粒径が最も大きい。
[Manufacturing method of multilayer capacitor]
As shown in FIG. 14, the protective layers 37 and 38 of the multilayer capacitor in accordance with this embodiment are formed from unfired protective layers 37U and 38U. The protective layers 37U and 38U are configured by first layer sheets 37aU and 38aU, second layer sheets 37bU and 38bU, and third layer sheets 37cU and 38cU that are made of powders of second ceramics having different average particle diameters. The average particle size of the powders of the first layer sheets 37aU and 38aU is the smallest, and the average particle size of the powders of the third layer sheets 37cU and 38cU is the largest.

以上により作製される未焼成の素体を焼成することにより、本実施形態に係る素体31を有する積層コンデンサが得られる。   By firing the unfired element body produced as described above, a multilayer capacitor having the element body 31 according to the present embodiment is obtained.

なお、本実施形態に係る積層コンデンサの保護層37,38は、図10に示すような3層構造であることは必須ではない。積層コンデンサでは、保護層37,38における積層体16に接する第1面で誘電体結晶の平均粒径が小さく、保護層37,38における第1面とは反対の第2面で誘電体結晶の平均粒径が大きければ、上記の効果が得られる。   In addition, it is not essential that the protective layers 37 and 38 of the multilayer capacitor according to the present embodiment have a three-layer structure as shown in FIG. In the multilayer capacitor, the average grain size of the dielectric crystal is small on the first surface in contact with the multilayer body 16 in the protective layers 37 and 38, and the dielectric crystal on the second surface opposite to the first surface in the protective layers 37 and 38. If the average particle size is large, the above effect can be obtained.

したがって、本実施形態に係る積層コンデンサの保護層37,38は、積層体16に隣接する第1面よりも、第1面とは反対の第2面の方が、第2セラミックスを構成する誘電体結晶の平均粒径が大きくなるように構成されていればよい。   Therefore, the protective layers 37 and 38 of the multilayer capacitor in accordance with the present embodiment are such that the second surface opposite to the first surface is the dielectric constituting the second ceramic, rather than the first surface adjacent to the multilayer body 16. What is necessary is just to be comprised so that the average particle diameter of a body crystal may become large.

以上、本発明の実施形態について説明したが、本発明は上述の実施形態にのみ限定されるものではなく、本発明の要旨を逸脱しない範囲内において種々変更を加え得ることは勿論である。   The embodiment of the present invention has been described above, but the present invention is not limited to the above-described embodiment, and it is needless to say that various modifications can be made without departing from the gist of the present invention.

10…積層コンデンサ
11…素体
12…第1内部電極
13…第2内部電極
14…第1外部電極
15…第2外部電極
16…積層体
17…第1保護層
18…第2保護層
DESCRIPTION OF SYMBOLS 10 ... Multilayer capacitor 11 ... Element 12 ... 1st internal electrode 13 ... 2nd internal electrode 14 ... 1st external electrode 15 ... 2nd external electrode 16 ... Laminate 17 ... 1st protective layer 18 ... 2nd protective layer

Claims (3)

第1内部電極と、チタン酸バリウム(BaTiO)100molに対して0.1mol以上1.0mol以下のマグネシウムおよび0.1mol以上1.0mol以下のマンガンを含有する誘電体層と、第2内部電極とが積層された積層体と、前記積層体と接続し、チタン酸バリウム(BaTiO )100molに対して0mol以上0.5mol以下のマグネシウムおよび0.5mol以上2.0mol以下のマンガンを含有する第1及び第2保護層とを有する素体と、
前記素体の第1端面を覆い、前記第1内部電極に接続する第1外部電極と、
前記素体の第2端面を覆い、前記第2内部電極に接続する第2外部電極と
を具備し、
前記第1及び第2保護層のセラミックスは、マンガンの含有量が前記誘電体層のセラミックスよりも多く、マグネシウムの含有量が前記誘電体層のセラミックスよりも少ない
積層コンデンサ。
A first internal electrode, a dielectric layer containing 0.1 to 1.0 mol of magnesium and 0.1 to 1.0 mol of manganese with respect to 100 mol of barium titanate (BaTiO 3 ), and a second internal electrode And a layered body that is connected to the layered body and contains 0 mol to 0.5 mol magnesium and 0.5 mol to 2.0 mol manganese with respect to 100 mol of barium titanate (BaTiO 3 ) . An element body having first and second protective layers;
A first external electrode covering the first end face of the element body and connected to the first internal electrode;
A second external electrode covering the second end face of the element body and connected to the second internal electrode;
The ceramic of the first and second protective layers has a manganese content higher than that of the dielectric layer ceramic, and a magnesium content lower than that of the dielectric layer ceramic.
請求項1に記載の積層コンデンサであって、
前記積層体の前記保護層に隣接する部分が、マンガンの含有量が前記積層体の中央部にある誘電層のセラミックスよりも多く前記第1及び第2保護層のセラミックスよりも少なく、マグネシウムの含有量が前記積層体の中央部にある誘電層のセラミックスよりも少なく前記第1及び第2保護層のセラミックスよりも多いセラミックスにより構成される
積層コンデンサ。
The multilayer capacitor according to claim 1,
The portion adjacent to the protective layer of the laminate has a manganese content greater than that of the dielectric layer ceramic in the central portion of the laminate and less than the ceramics of the first and second protective layers, and contains magnesium. A multilayer capacitor comprising an amount of ceramic less than that of a dielectric layer in the center of the multilayer body and greater than that of the first and second protective layers.
請求項1又は2に記載の積層コンデンサであって、
前記第1及び第2保護層では、前記積層体に隣接するセラミックス粒子よりも、前記素体の表面にあるセラミックス粒子の方が、平均粒径が大きい
積層コンデンサ。
The multilayer capacitor according to claim 1 or 2,
In the first and second protective layers, the ceramic particles on the surface of the element body have a larger average particle size than the ceramic particles adjacent to the multilayer body.
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