JP7348971B2 - 畳み込みニューラルネットワークハードウエア構成 - Google Patents
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Description
として定義することができ、第2の層に対して重みの数を
として定義することができるように層の間で変えることができる。
一般的に、ソフトウエアツールがCNNの訓練フェーズ中に使用されて訓練データセットに基づいて層あたり1セットの重みを生成する。一部の構成では、一部の層内の重み値の一部は、他の手段、例えば、ウェーブレットベースによって発生させることができると考えられる。
任意的な低精度重み調整430段階を量子化/変換値に関して実行することができる。重み調整を実行するために、浮動小数点数は、決定された固定小数点数フォーマットに従って量子化すべきである。
は浮動仮数であり、
は、対応する8ビット固定小数点仮数である。
上述の固定小数点付番フォーマットは、整数及び指数固定小数点計算の整数ベースの実施に使用することができる。
上述の演算の全てが整数計算である。オーバーフローの場合に、数は、Xmax又はXminにクランピングされる。乗算の場合に、結果の指数は、ビットをシフトする代わりに調節することができ、数を異なる指数で乗算する時に有用になる。
低精度固定小数点フォーマットで畳み込み層を実施する段階は、いくつかの理由でCNNで畳み込み層を実施する改善された方法を提供することができる。例えば、数ビットをCNNのハードウエア実装を演算するのに使用されるメモリ帯域幅を低減する外部メモリとCNNのハードウエア実装との間で転送しなければならない。上述の整数計算論理部は、畳み込み操作を実施するのに必要なハードウエア論理部のサイズ及び複雑さを低減する畳み込み計算(上述の畳み込みエンジンなど)内に実施することができる。更に、重みデータ及び入力データを格納するのに必要なビットの数が、対応する浮動小数点数表現よりも又は上述のQフォーマット固定小数点数表現よりも少ないので、CNNのハードウエア実装に必要なバッファはより小さい。図2に対応するCNNの上述のハードウエア実装を参照すると、係数及びデータバッファ、並びに累積バッファを小さくすることができる。
CNNのハードウエア実装に使用する構成データを生成して数フォーマットを定義する方法が上記に示されている。上述のように、CNNを定義する重みを低精度ターゲットに適応させることができる重み調整430の任意段階を図4の方法の一部として実施することができる。段階430は、段階440で得られた量子化値を受信する段階及びCNNの更に別の訓練を実行することによって重み値を修正する段階を伴う。重み値の調整は、本発明の開示の固定小数点数表現を使用して実施されるCNNの分類誤差を低減することができる。本明細書に説明する例では、各々が複数の重み値を有する複数の層によって定義される事前訓練されたネットワークは、図4の段階410で上述のように従来の浮動小数点ソフトウエアツールを使用して準備されていたと仮定する。更に、固定小数点数フォーマットの重み及び入力データ指数が段階420で決定され、重み及びデータの事前定義されたビット長が設定されていたと仮定する。
410 浮動点訓練
420 数フォーマットの決定
430 低精度重み調整
440 量子化
Claims (18)
- 畳み込みニューラルネットワーク(CNN)を実装するためのハードウエアであって、
畳み込み演算ハードウエア要素(730)を備える畳み込みブロック(700)を備え、前記畳み込み演算ハードウエア要素(730)は、
CNNの層に対し第1の重みベクトル(720b)と第1のデータベクトル(720a)の間の第1の内積を実行し、ここで前記第1の重みベクトル(720b)は複数の整数ビット(n)と指数(B)によって定義される固定小数点フォーマットにおける複数の重み値を有し、前記第1のデータベクトル(720a)は複数の整数ビット(m)と指数(A)によって定義される固定小数点フォーマットにおける複数のデータ値を有し、
前記第1のデータベクトル(720a)のデータ値に対する指数(A)を示す第1のデータ指標を受け取り、
前記第1の重みベクトル(720b)の重み値に対する指数(B)を示す第1の重み指標を受け取り、
前記第1のデータベクトル(720a)のデータ値に対する指数(A)と前記第1の重みベクトル(720b)の重み値に対する指数(B)とを加算することによって、前記第1の内積の指数を計算する、
よう構成されている、ハードウエア。 - 畳み込み演算ハードウエア要素(730)は、さらに、
CNNの他の層に対し第2の重みベクトルと第2のデータベクトルの間の第2の内積を実行し、ここで前記第2の重みベクトルは複数の整数ビットと指数によって定義される固定小数点フォーマットにおける複数の重み値を有し、前記第2のデータベクトルは複数の整数ビットと指数によって定義される固定小数点フォーマットにおける複数のデータ値を有し、
前記第2のデータベクトルのデータ値に対する指数を示す第2のデータ指標を受け取り、
前記第2の重みベクトルの重み値に対する指数を示す第2の重み指標を受け取り、
前記第2のデータベクトルのデータ値に対する指数と前記第2の重みベクトルの重み値に対する指数とを加算することによって、前記第2の内積の指数を計算する、
よう構成され、
前記第2のデータベクトルのデータ値に対する指数と前記第1のデータベクトルのデータ値に対する指数は異なっている、請求項1に記載のハードウエア。 - 畳み込み演算ハードウエア要素(730)は、さらに、
CNNの他の層に対し第2の重みベクトルと第2のデータベクトルの間の第2の内積を実行し、ここで前記第2の重みベクトルは複数の整数ビットと指数によって定義される固定小数点フォーマットにおける複数の重み値を有し、前記第2のデータベクトルは複数の整数ビットと指数によって定義される固定小数点フォーマットにおける複数のデータ値を有し、
前記第2のデータベクトルのデータ値に対する指数を示す第2のデータ指標を受け取り、
前記第2の重みベクトルの重み値に対する指数を示す第2の重み指標を受け取り、
前記第2のデータベクトルのデータ値に対する指数と前記第2の重みベクトルの重み値に対する指数とを加算することによって、前記第2の内積の指数を計算する、
よう構成され、
前記第2の重みベクトルの重み値に対する指数と、前記第1の重みベクトルの重み値に対する指数は異なっている、請求項1又は2に記載のハードウエア。 - 前記第1のデータベクトルのデータ値に対する整数ビットの数と、前記第2のデータベクトルのデータ値に対する整数ビットの数は同じである、請求項2又は3に記載のハードウエア。
- 前記第1の重みベクトルの重み値に対する整数ビットの数と、前記第2の重みベクトルの重み値に対する整数ビットの数は同じである、請求項2乃至4のいずれかに記載のハードウエア。
- 前記第1の重みベクトルの重み値に対する指数と、前記第1のデータベクトルのデータ値に対する指数は異なっている、請求項1乃至5のいずれかに記載のハードウエア。
- 前記第1の重みベクトルの重み値に対する整数ビットの数と、前記第1のデータベクトルのデータ値に対する整数ビットの数は異なっている、請求項1乃至6のいずれかに記載のハードウエア。
- 前記畳み込みブロック(700)はさらに、前記内積の結果を収容できるサイズの累積器(740)を備える、請求項1乃至7のいずれかに記載のハードウエア。
- 前記畳み込みブロック(700)はさらに、入力データに対する指数及び前記第1のデータベクトルの前記データ値に対する指数に基づいて前記入力データから前記第1のデータベクトルを生成するよう構成された刈り取りユニット(710)を備える、請求項1乃至8のいずれかに記載のハードウエア。
- さらに、前記第1の重みベクトル、及び、前記第1の重みベクトルの前記重み値に対する指数を識別する前記第1の重み指標を含む指令情報を受け取るよう構成されたメモリインタフェース(210)を備える、請求項1乃至9のいずれかに記載のハードウエア。
- さらに、前記第1の内積を実行する前記畳み込み演算ハードウエア要素(730)の前に、前記第1の重みベクトルを格納するよう構成された係数バッファ(230)を備える、請求項1乃至10のいずれかに記載のハードウエア。
- 請求項10に従属する請求項11に記載のハードウエアであって、さらに、
前記メモリインタフェース(210)から前記第1の重みベクトルを受け取るよう構成された係数バッファコントローラ(225)と、
前記指令情報を復号し、かつ、前記係数バッファコントローラ(225)に対して、前記係数バッファコントローラ(225)が前記第1の重みベクトルを前記係数バッファ(230)に格納する方式を制御する制御情報を発令するよう構成された指令復号器(220)と、
を備える請求項11に記載のハードウエア。 - さらに、入力データ又は前記第1のデータベクトルと、前記第1のデータベクトルのデータ値に対する指数及び/又は前記入力データの指数を識別する前記第1のデータ指標を含む指令情報とを受け取るよう構成されたメモリインタフェース(210)を備える、請求項1乃至12のいずれかに記載のハードウエア。
- さらに、前記第1の内積を実行する前記畳み込み演算ハードウエア要素(730)の前に、前記第1のデータベクトル又は入力データを格納するよう構成された1又は2以上の入力バッファ(235a~235n)を備える、請求項1乃至13のいずれかに記載のハードウエア。
- 請求項13に従属する請求項14に記載のハードウエアであって、さらに、
前記メモリインタフェース(210)から前記第1のデータベクトル又は前記入力データを受け取るよう構成された入力バッファコントローラ(215)と、
前記指令情報を復号し、かつ、前記入力バッファコントローラ(215)に対して、前記入力バッファコントローラ(215)が前記入力データ又は前記第1のデータベクトルを前記1又は2以上の入力バッファ(235a~235n)に格納する方式を制御する制御情報を発令するよう構成された指令復号器(220)と、
を備える請求項14に記載のハードウエア。 - 前記畳み込み演算ハードウエア要素(730)は、乗算論理部の複数の要素及び加算論理部の複数の要素を備える、請求項1乃至15のいずれかに記載のハードウエア。
- 集積回路に具現化されている、請求項1乃至16のいずれかに記載のハードウエア。
- 請求項1乃至17のいずれかに記載のハードウエアを備えるコンピュータシステム。
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