JP7572926B2 - 撮像素子、及び撮像装置 - Google Patents
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Description
図面を参照して本発明の第1の実施形態について説明する。
きるので、主要被写体500及び特徴領域510を精度よく検出することができる。
(1)カメラ100は、複数の単位グループ231(撮像領域)を有し、単位グループ231に入射した光像に応じた画像信号を生成する撮像チップ213を有する。またカメラ100は、撮像チップ213から出力された画像信号に基づいて当該画像信号の示す画像の特徴領域510を検出する特徴領域検出部112と、複数の単位グループ231のうち特徴領域510に対応する光像が入射した単位グループ231を特徴領域用フレームレートで撮像を行うように制御し、複数の単位グループ231のうち特徴領域510に対応する光像が入射した単位グループ231以外の単位グループ231を特徴領域用フレームレートとは異なるフレームレートで撮像を行うように制御する制御部101と、を含む信号処理チップ211を有する。これにより、撮像素子200の全体の撮像領域から画像信号を読み出しても、撮像素子200の特定の撮像領域(特徴領域510に対応する光像が入射した単位グループ231)から画素信号を高速に読み出すことができ、特徴領域510の認識精度を向上することができる。また、特徴領域510以外の他の領域についてはフレームレートを低くして画像信号を取得しているので、全画素からの高速読み出しに比べて、撮像素子200の駆動や画像処理の負荷を減らし、消費電力や発熱を抑えることができる。
次に、本発明の第2の実施形態について説明する。第2の実施形態のカメラ100及び撮像素子200の構成は、第1の実施形態と同様であるため、説明を省略する。
(1)カメラ100は、主要被写体領域のデフォーカス量が大きいほど、主要被写体領域に対応する光像が入射した撮像領域(単位グループ231)を撮像する際の画素の間引き率または加算数を大きくするようにした。このように、撮像画像の画素数を増やしても主要被写体の状態を精度よく認識できない状況では、撮像画像の画素数を減らすことで消費電力や演算負荷を抑制することができる。
上述した実施形態において、画像処理部103は、複数の主要被写体(顔)を検出した場合には、その複数の主要被写体の中から優先する被写体(優先被写体)を1つ選択するようにしてもよい。
上述した第1の実施形態において、特徴領域に対応する特徴領域単位グループ群については、主要被写体及び周辺領域よりも高いフレームレートで撮像を行うので、その分電荷の蓄積時間が短くなり、画像信号の出力が小さくなる場合がある。そこで、画像処理部103は、特徴領域単位グループ群については、被写体単位グループ群及び周辺単位グループ群よりも、単位グループ231に含まれる画素から読み出す画素信号のゲインを大きく設定するようにしてもよい。
上述した第1の実施形態において、画像処理部103は、特徴領域単位グループ群に特徴領域用フレームレートを設定する際、撮像面における主要被写体の占める割合に応じて設定する値を変化させるようにしてもよい。撮像面における主要被写体の占める割合が大きいほど特徴領域用フレームレートの設定値を低くし、撮像面における主要被写体の占める割合が小さいほど特徴領域用フレームレートの設定値を高くする。撮像面における主要被写体の占める割合が大きい場合には、撮像画像上で主要被写体に関する情報量が多く、特徴領域の変化も検出しやすいので、特徴領域用フレームレートを下げることで消費電力を低減できる。一方、撮像面における主要被写体の占める割合が小さい場合には、撮像画像上で主要被写体に関する情報量が少なく、特徴領域の変化も検出しにくいので、特徴領域用フレームレートを上げることで、主要被写体の状態の認識精度を高くできる。
主要被写体として複数の人物の顔を検出した際、顔の数が所定値よりも多い場合には、撮像画像において一つ一つの顔に関する情報量が少なく、顔の状態を認識しにくいことが予測される。そこで、画像処理部103は、このような場合には、特徴領域についての画素の間引き率または加算数を小さい値に設定して、顔の状態の認識精度を高くするようにしてもよい。
特徴領域、主要被写体領域及び周辺領域について、上述した第1の実施形態ではフレームレートを設定し、上述した第2の実施形態では、画素の間引き率または加算数を設定する例について説明した。しかしながら、設定する撮像条件は、上述した実施形態で説明した例に限定しなくてもよい。例えば、特徴領域、主要被写体領域及び周辺領域について、画素の間引き率と加算数の両方を設定するようにしてもよい。この場合は、画素が間引かれた後、残った画素の画素信号を加算することで、さらに画素数を少なくする。また、フレームレートと画素の間引き率または加算数との両方を設定するようにしてもよい。
上述した実施形態では、静止画の自動撮影を行う自動撮影モードに本発明を適用する例について説明したが、通常の撮影モード(すなわちユーザのレリーズボタン押下により静止画を記録するモード)に本発明を適用するようにしてもよい。この場合、カメラ100は、例えば、ユーザがレリーズボタンを半押しした場合に上述した図6の処理を開始し、上述した実施形態と同様にステップS101~S108の処理を行う。そして、カメラ100は、ユーザによりレリーズボタンが全押しされると、静止画を記録する。
上述した実施形態では、人物の顔を主要被写体として検出する例について説明したが、この他の被写体を主要被写体として検出するようにしてもよい。例えば、動物を主要被写体として検出するようにしてもよい。この場合、例えば、動物の目、口、鼻、耳、尾などを特徴領域として上述した実施形態と同様の制御を行う。これにより、動物の状態等の認識精度や認識速度を向上させることができる。
上述した実施形態では、複数の画素から構成される単位グループ231ごとに撮像条件を設定可能な撮像素子200を用いる例について説明したが、1つの画素ごとに個別に撮像条件を設定可能な撮像素子を用いるようにしてもよい。この場合、上述したステップS103,S203では、特徴領域、主要被写体領域及び周辺領域のそれぞれに対応する画素群を設定し、各画素群に対してフレームレートや画素の間引き率または加算数を設定すればよい。
本発明による撮像装置は、デジタルカメラだけに限定されない。例えば、携帯電話機、スマートフォン、タブレット端末なども本発明による撮像装置に含まれる。
上述した実施の形態では、各画素に対応してフローティングディフュージョンが設けられた撮像素子を用いる例を説明した。しかしながら、少なくとも2つの画素でフローティングディフュージョンを共有する撮像素子を用いるようにしてもよい。
Claims (19)
- 光を電荷に変換する第1光電変換部と、
光を電荷に変換する光電変換部であって第1方向において前記第1光電変換部の隣に配置される第2光電変換部と、
光を電荷に変換する光電変換部であって前記第1方向と交差する第2方向において前記第1光電変換部の隣に配置される第3光電変換部と、
光を電荷に変換する光電変換部であって前記第1方向において前記第1光電変換部と並んで配置される第4光電変換部と、
光を電荷に変換する光電変換部であって前記第1方向において前記第4光電変換部の隣に配置される第5光電変換部と、
光を電荷に変換する光電変換部であって前記第2方向において前記第4光電変換部の隣に配置される第6光電変換部と、
光を電荷に変換する光電変換部であって前記第2方向において前記第1光電変換部と並んで配置される第7光電変換部と、
光を電荷に変換する光電変換部であって前記第1方向において前記第7光電変換部の隣に配置される第8光電変換部と、
光を電荷に変換する光電変換部であって前記第2方向において前記第7光電変換部の隣に配置される第9光電変換部と、
前記第1光電変換部で変換された電荷を転送する第1転送部と、
前記第2光電変換部で変換された電荷を転送する第2転送部と、
前記第3光電変換部で変換された電荷を転送する第3転送部と、
前記第4光電変換部で変換された電荷を転送する第4転送部と、
前記第5光電変換部で変換された電荷を転送する第5転送部と、
前記第6光電変換部で変換された電荷を転送する第6転送部と、
前記第7光電変換部で変換された電荷を転送する第7転送部と、
前記第8光電変換部で変換された電荷を転送する第8転送部と、
前記第9光電変換部で変換された電荷を転送する第9転送部と
を有する第1半導体基板と、
前記第1半導体基板とともに積層される半導体基板であって、
前記第1光電変換部で変換された電荷に基づく第1画素信号と、前記第2光電変換部で変換された電荷に基づく第2画素信号と、前記第3光電変換部で変換された電荷に基づく第3画素信号とをデジタル信号に変換する第1変換部と、
前記第4光電変換部で変換された電荷に基づく第4画素信号と、前記第5光電変換部で変換された電荷に基づく第5画素信号と、前記第6光電変換部で変換された電荷に基づく第6画素信号とをデジタル信号に変換する第2変換部と、
前記第7光電変換部で変換された電荷に基づく第7画素信号と、前記第8光電変換部で変換された電荷に基づく第8画素信号と、前記第9光電変換部で変換された電荷に基づく第9画素信号とをデジタル信号に変換する第3変換部と、
前記第1光電変換部、前記第2光電変換部および前記第3光電変換部で変換された電荷を蓄積する第1蓄積時間と、前記第4光電変換部、前記第5光電変換部および前記第6光電変換部で変換された電荷を蓄積する第2蓄積時間と、前記第7光電変換部、前記第8光電変換部および前記第9光電変換部で変換された電荷を蓄積する第3蓄積時間とのうち、少なくとも2つの蓄積時間が互いに異なる蓄積時間になるように、前記第1転送部、前記第2転送部、前記第3転送部、前記第4転送部、前記第5転送部、前記第6転送部、前記第7転送部、前記第8転送部および前記第9転送部を制御する駆動部とを有する第2半導体基板と
を備え、
前記第1転送部は、前記第1転送部を制御するための第1転送制御信号が出力される第1転送制御線に接続され、
前記第2転送部は、前記第2転送部を制御するための第2転送制御信号が出力される第2転送制御線に接続され、
前記第3転送部は、前記第3転送部を制御するための第3転送制御信号が出力される第3転送制御線に接続され、
前記第4転送部は、前記第4転送部を制御するための第4転送制御信号が出力される第4転送制御線に接続され、
前記第5転送部は、前記第5転送部を制御するための第5転送制御信号が出力される第5転送制御線に接続され、
前記第6転送部は、前記第6転送部を制御するための第6転送制御信号が出力される第6転送制御線に接続され、
前記第7転送部は、前記第7転送部を制御するための第7転送制御信号が出力される第7転送制御線に接続され、
前記第8転送部は、前記第8転送部を制御するための第8転送制御信号が出力される第8転送制御線に接続され、
前記第9転送部は、前記第9転送部を制御するための第9転送制御信号が出力される第9転送制御線に接続される、
撮像素子。 - 請求項1に記載の撮像素子において、
前記駆動部は、
前記第1蓄積時間、前記第2蓄積時間および前記第3蓄積時間のうち、少なくとも2つの蓄積時間が互いに異なる蓄積時間になるように、
前記第1転送制御信号を前記第1転送制御線に出力するタイミングと、
前記第2転送制御信号を前記第2転送制御線に出力するタイミングと、
前記第3転送制御信号を前記第3転送制御線に出力するタイミングと、
前記第4転送制御信号を前記第4転送制御線に出力するタイミングと、
前記第5転送制御信号を前記第5転送制御線に出力するタイミングと、
前記第6転送制御信号を前記第6転送制御線に出力するタイミングと、
前記第7転送制御信号を前記第7転送制御線に出力するタイミングと、
前記第8転送制御信号を前記第8転送制御線に出力するタイミングと、
前記第9転送制御信号を前記第9転送制御線に出力するタイミングと
を制御する、
撮像素子。 - 請求項1または請求項2のいずれかに記載の撮像素子において、
前記第1光電変換部で変換された電荷が転送される第1フローティングディフュージョンと、
前記第4光電変換部で変換された電荷が転送される第2フローティングディフュージョンと、
前記第7光電変換部で変換された電荷が転送される第3フローティングディフュージョンと、
前記第1フローティングディフュージョンの電位をリセットする第1リセット部と
前記第2フローティングディフュージョンの電位をリセットする第2リセット部と
前記第3フローティングディフュージョンの電位をリセットする第3リセット部と
を備える、
撮像素子。 - 請求項3に記載の撮像素子において、
前記駆動部は、前記第1蓄積時間、前記第2蓄積時間および前記第3蓄積時間のうち、少なくとも2つの蓄積時間が互いに異なる蓄積時間になるように、前記第1リセット部、前記第2リセット部および前記第3リセット部を制御する、
撮像素子。 - 請求項4に記載の撮像素子において、
前記第1リセット部は、前記第1リセット部を制御するための第1リセット制御信号が出力される第1リセット制御線に接続され、
前記第2リセット部は、前記第2リセット部を制御するための第2リセット制御信号が出力される第2リセット制御線に接続され、
前記第3リセット部は、前記第3リセット部を制御するための第3リセット制御信号が出力される第3リセット制御線に接続され、
前記駆動部は、前記第1蓄積時間、前記第2蓄積時間および前記第3蓄積時間のうち、少なくとも2つの蓄積時間が互いに異なる蓄積時間になるように、
前記第1リセット制御信号を前記第1リセット制御線に出力するタイミングと、
前記第2リセット制御信号を前記第2リセット制御線に出力するタイミングと、
前記第3リセット制御信号を前記第3リセット制御線に出力するタイミングとを制御する、
撮像素子。 - 請求項1または請求項2のいずれか一項に記載の撮像素子において、
前記第1光電変換部で変換された電荷を排出する第1リセット部と、
前記第2光電変換部で変換された電荷を排出する第2リセット部と、
前記第3光電変換部で変換された電荷を排出する第3リセット部と、
前記第4光電変換部で変換された電荷を排出する第4リセット部と、
前記第5光電変換部で変換された電荷を排出する第5リセット部と、
前記第6光電変換部で変換された電荷を排出する第6リセット部と、
前記第7光電変換部で変換された電荷を排出する第7リセット部と、
前記第8光電変換部で変換された電荷を排出する第8リセット部と、
前記第9光電変換部で変換された電荷を排出する第9リセット部と
を備え、
前記駆動部は、前記第1蓄積時間、前記第2蓄積時間および前記第3蓄積時間のうち、少なくとも2つの蓄積時間が互いに異なる蓄積時間になるように、前記第1リセット部、前記第2リセット部、前記第3リセット部、前記第4リセット部、前記第5リセット部、前記第6リセット部、前記第7リセット部、前記第8リセット部および前記第9リセット部を制御する、
撮像素子。 - 請求項6に記載の撮像素子において、
前記第1リセット部は、前記第1リセット部を制御するための第1リセット制御信号が出力される第1リセット制御線に接続され、
前記第2リセット部は、前記第2リセット部を制御するための第2リセット制御信号が出力される第2リセット制御線に接続され、
前記第3リセット部は、前記第3リセット部を制御するための第3リセット制御信号が出力される第3リセット制御線に接続され、
前記第4リセット部は、前記第4リセット部を制御するための第4リセット制御信号が出力される第4リセット制御線に接続され、
前記第5リセット部は、前記第5リセット部を制御するための第5リセット制御信号が出力される第5リセット制御線に接続され、
前記第6リセット部は、前記第6リセット部を制御するための第6リセット制御信号が出力される第6リセット制御線に接続され、
前記第7リセット部は、前記第7リセット部を制御するための第7リセット制御信号が出力される第7リセット制御線に接続され、
前記第8リセット部は、前記第8リセット部を制御するための第8リセット制御信号が出力される第8リセット制御線に接続され、
前記第9リセット部は、前記第9リセット部を制御するための第9リセット制御信号が出力される第9リセット制御線に接続され、
前記駆動部は、
前記第1蓄積時間、前記第2蓄積時間および前記第3蓄積時間のうち、少なくとも2つの蓄積時間が互いに異なる蓄積時間になるように、
前記第1リセット制御信号を前記第1リセット制御線に出力するタイミングと、
前記第2リセット制御信号を前記第2リセット制御線に出力するタイミングと、
前記第3リセット制御信号を前記第3リセット制御線に出力するタイミングと、
前記第4リセット制御信号を前記第4リセット制御線に出力するタイミングと、
前記第5リセット制御信号を前記第5リセット制御線に出力するタイミングと、
前記第6リセット制御信号を前記第6リセット制御線に出力するタイミングと、
前記第7リセット制御信号を前記第7リセット制御線に出力するタイミングと、
前記第8リセット制御信号を前記第8リセット制御線に出力するタイミングと、
前記第9リセット制御信号を前記第9リセット制御線に出力するタイミングと
を制御する、
撮像素子。 - 請求項1から請求項7のいずれか一項に記載の撮像素子において、
前記第1半導体基板とともに積層される半導体基板であって、
前記第1変換部でデジタル信号に変換された前記第1画素信号を格納する第1格納部と、
前記第1変換部でデジタル信号に変換された前記第2画素信号を格納する第2格納部と、
前記第1変換部でデジタル信号に変換された前記第3画素信号を格納する第3格納部と、
前記第2変換部でデジタル信号に変換された前記第4画素信号を格納する第4格納部と、
前記第2変換部でデジタル信号に変換された前記第5画素信号を格納する第5格納部と、
前記第2変換部でデジタル信号に変換された前記第6画素信号を格納する第6格納部と、
前記第3変換部でデジタル信号に変換された前記第7画素信号を格納する第7格納部と、
前記第3変換部でデジタル信号に変換された前記第8画素信号を格納する第8格納部と、
前記第3変換部でデジタル信号に変換された前記第9画素信号を格納する第9格納部とを有する第3半導体基板を備える撮像素子。 - 請求項1から請求項8のいずれか一項に記載の撮像素子において、
前記第1画素信号、前記第2画素信号および前記第3画素信号が出力される第1出力線と、
前記第4画素信号、前記第5画素信号および前記第6画素信号が出力される第2出力線と、
前記第7画素信号、前記第8画素信号および前記第9画素信号が出力される第3出力線と
を備え、
前記第1変換部は、前記第1出力線に出力された前記第1画素信号、前記第2画素信号および前記第3画素信号をデジタル信号に変換し、
前記第2変換部は、前記第2出力線に出力された前記第4画素信号、前記第5画素信号および前記第6画素信号をデジタル信号に変換し、
前記第3変換部は、前記第3出力線に出力された前記第7画素信号、前記第8画素信号および前記第9画素信号をデジタル信号に変換する、
撮像素子。 - 請求項9に記載の撮像素子において、
前記第2半導体基板は、
前記第1出力線に電流を供給する第1電流源と、
前記第2出力線に電流を供給する第2電流源と、
前記第3出力線に電流を供給する第3電流源と
を有する撮像素子。 - 請求項1から請求項10のいずれか一項に記載の撮像素子において、
前記駆動部は、前記第1画素信号、前記第2画素信号および前記第3画素信号を読み出すための第1フレームレートと、前記第4画素信号、前記第5画素信号および前記第6画素信号を読み出すための第2フレームレートと、前記第7画素信号、前記第8画素信号および前記第9画素信号を読み出すための第3フレームレートとのうち、少なくとも2つのフレームレートが互いに異なるフレームレートになるように制御する、
撮像素子。 - 請求項1から請求項11のいずれか一項に記載の撮像素子において、
前記駆動部は、前記第1画素信号、前記第2画素信号および前記第3画素信号を増幅するための第1ゲインと、前記第4画素信号、前記第5画素信号および前記第6画素信号を増幅するための第2ゲインと、前記第7画素信号、前記第8画素信号および前記第9画素信号を増幅する第3ゲインとのうち、少なくとも2つのゲインが互いに異なるゲインになるように制御する、
撮像素子。 - 請求項1から請求項12のいずれか一項に記載の撮像素子において、
前記第1半導体基板は、
光を電荷に変換する光電変換部であって、前記第1方向において前記第1光電変換部と並んで配置される第10光電変換部と、
光を電荷に変換する光電変換部であって前記第1方向において前記第10光電変換部の隣に配置される第11光電変換部と、
光を電荷に変換する光電変換部であって前記第2方向において前記第10光電変換部の隣に配置される第12光電変換部と、
前記第10光電変換部で変換された電荷を転送する第10転送部と、
前記第11光電変換部で変換された電荷を転送する第11転送部と、
前記第12光電変換部で変換された電荷を転送する第12転送部と
を有し、
前記第2半導体基板は、前記第10光電変換部で変換された電荷に基づく第10画素信号と、前記第11光電変換部で変換された電荷に基づく第11画素信号と、前記第12光電変換部で変換された電荷に基づく第12画素信号とをデジタル信号に変換する第4変換部を有し、
前記駆動部は、前記第1蓄積時間と、前記第2蓄積時間と、前記第3蓄積時間と、前記第10光電変換部、前記第11光電変換部および前記第12光電変換部で変換された電荷を蓄積する第4蓄積時間とのうち、少なくとも2つの蓄積時間が異なる蓄積時間になるように、前記第1転送部、前記第2転送部、前記第3転送部、前記第4転送部、前記第5転送部、前記第6転送部、前記第7転送部、前記第8転送部、前記第9転送部、前記第10転送部、前記第11転送部および前記第12転送部を制御し、
前記第10転送部は、前記第10転送部を制御するための第10転送制御信号が出力される第10転送制御線に接続され、
前記第11転送部は、前記第11転送部を制御するための第11転送制御信号が出力される第11転送制御線に接続され、
前記第12転送部は、前記第12転送部を制御するための第12転送制御信号が出力される第12転送制御線に接続される、
撮像素子。 - 請求項13に記載の撮像素子において、
前記第1半導体基板は、
光を電荷に変換する光電変換部であって、前記第2方向において前記第1光電変換部と並んで配置される第13光電変換部と、
光を電荷に変換する光電変換部であって前記第1方向において前記第13光電変換部の隣に配置される第14光電変換部と、
光を電荷に変換する光電変換部であって前記第2方向において前記第13光電変換部の隣に配置される第15光電変換部と、
前記第13光電変換部で変換された電荷を転送する第13転送部と、
前記第14光電変換部で変換された電荷を転送する第14転送部と、
前記第15光電変換部で変換された電荷を転送する第15転送部と
を有し、
前記第2半導体基板は、前記第13光電変換部で変換された電荷に基づく第13画素信号と、前記第14光電変換部で変換された電荷に基づく第14画素信号と、前記第15光電変換部で変換された電荷に基づく第15画素信号とをデジタル信号に変換する第5変換部を有し、
前記駆動部は、前記第1蓄積時間と、前記第2蓄積時間と、前記第3蓄積時間と、前記第4蓄積時間と、前記第13光電変換部、前記第14光電変換部および前記第15光電変換部で変換された電荷を蓄積する第5蓄積時間とのうち、少なくとも2つの蓄積時間が異なる蓄積時間になるように、前記第1転送部、前記第2転送部、前記第3転送部、前記第4転送部、前記第5転送部、前記第6転送部、前記第7転送部、前記第8転送部、前記第9転送部、前記第10転送部、前記第11転送部、前記第12転送部、前記第13転送部、前記第14転送部および前記第15転送部を制御し、
前記第13転送部は、前記第13転送部を制御するための第13転送制御信号が出力される第13転送制御線に接続され、
前記第14転送部は、前記第14転送部を制御するための第14転送制御信号が出力される第14転送制御線に接続され、
前記第15転送部は、前記第15転送部を制御するための第15転送制御信号が出力される第15転送制御線に接続される、
撮像素子。 - 請求項1から請求項12のいずれか一項に記載の撮像素子において、
前記第1半導体基板は、
光を電荷に変換する光電変換部であって、前記第2方向において前記第1光電変換部と並んで配置される第10光電変換部と、
光を電荷に変換する光電変換部であって前記第1方向において前記第10光電変換部の隣に配置される第11光電変換部と、
光を電荷に変換する光電変換部であって前記第2方向において前記第10光電変換部の隣に配置される第12光電変換部と、
前記第10光電変換部で変換された電荷を転送する第10転送部と、
前記第11光電変換部で変換された電荷を転送する第11転送部と、
前記第12光電変換部で変換された電荷を転送する第12転送部と
を有し、
前記第2半導体基板は、前記第10光電変換部で変換された電荷に基づく第10画素信号と、前記第11光電変換部で変換された電荷に基づく第11画素信号と、前記第12光電変換部で変換された電荷に基づく第12画素信号とをデジタル信号に変換する第4変換部を有し、
前記駆動部は、前記第1蓄積時間と、前記第2蓄積時間と、前記第3蓄積時間と、前記第10光電変換部、前記第11光電変換部および前記第12光電変換部で変換された電荷を蓄積する第4蓄積時間とのうち、少なくとも2つの蓄積時間が異なる蓄積時間になるように、前記第1転送部、前記第2転送部、前記第3転送部、前記第4転送部、前記第5転送部、前記第6転送部、前記第7転送部、前記第8転送部、前記第9転送部、前記第10転送部、前記第11転送部および前記第12転送部を制御し、
前記第10転送部は、前記第10転送部を制御するための第10転送制御信号が出力される第10転送制御線に接続され、
前記第11転送部は、前記第11転送部を制御するための第11転送制御信号が出力される第11転送制御線に接続され、
前記第12転送部は、前記第12転送部を制御するための第12転送制御信号が出力される第12転送制御線に接続される、
撮像素子。 - 請求項1から請求項15のいずれか一項に記載の撮像素子を備える撮像装置。
- 請求項16に記載の撮像装置において、
前記撮像素子で撮像された被写体から特定被写体を検出する検出部を備え、
前記駆動部は、前記検出部の検出結果に基づいて、前記第1蓄積時間、前記第2蓄積時間および前記第3蓄積時間のうち、少なくとも2つの蓄積時間が互いに異なる蓄積時間になるように、前記第1転送部、前記第2転送部、前記第3転送部、前記第4転送部、前記第5転送部、前記第6転送部、前記第7転送部、前記第8転送部および前記第9転送部を制御する、
撮像装置。 - 請求項17に記載の撮像装置において、
前記検出部は、前記撮像素子で撮像された被写体から人物と推定される被写体を前記特定被写体として検出する撮像装置。 - 請求項17または請求項18に記載の撮像装置において、
前記検出部は、前記撮像素子で撮像された被写体から人物の目又は人物の口と推定される被写体を前記特定被写体として検出する撮像装置。
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