JPS5812719B2 - 回路素子の良否判定装置 - Google Patents
回路素子の良否判定装置Info
- Publication number
- JPS5812719B2 JPS5812719B2 JP52119009A JP11900977A JPS5812719B2 JP S5812719 B2 JPS5812719 B2 JP S5812719B2 JP 52119009 A JP52119009 A JP 52119009A JP 11900977 A JP11900977 A JP 11900977A JP S5812719 B2 JPS5812719 B2 JP S5812719B2
- Authority
- JP
- Japan
- Prior art keywords
- thyristor
- gate
- exclusive
- voltage
- indicator
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Testing Of Individual Semiconductor Devices (AREA)
- Circuit Arrangement For Electric Light Sources In General (AREA)
- Protection Of Static Devices (AREA)
Description
【発明の詳細な説明】
本発明は現在色々な形で使われている電光表示板の表示
灯につき、その全表示灯の断芯等を検知する回路素子の
良否判定装置に係り、特に表示灯の断芯検知と文字表示
中の電光表示板においても断芯の検知を自動的に行なう
ことができると共に表示灯に直列接続されたサイリスタ
の良否を自動的に判定することができる回路素子の良否
判定装置に関するものである。
灯につき、その全表示灯の断芯等を検知する回路素子の
良否判定装置に係り、特に表示灯の断芯検知と文字表示
中の電光表示板においても断芯の検知を自動的に行なう
ことができると共に表示灯に直列接続されたサイリスタ
の良否を自動的に判定することができる回路素子の良否
判定装置に関するものである。
従来のこの種の表示灯における断芯検知装置としては種
々提案されているが、一般に回路構成が複雑になり、ま
た、収納するスペースの増大や価格の上昇が大きくなっ
て、経済的でないという欠点があり、採用することがで
きなかった。
々提案されているが、一般に回路構成が複雑になり、ま
た、収納するスペースの増大や価格の上昇が大きくなっ
て、経済的でないという欠点があり、採用することがで
きなかった。
しかして、各種電光表示板における表示灯の断芯による
表示文字の欠落防止として従来とられてきた方法は、定
期的に保守員が巡回し、目視によって判定し、交換する
という方法が採られている。
表示文字の欠落防止として従来とられてきた方法は、定
期的に保守員が巡回し、目視によって判定し、交換する
という方法が採られている。
しかし、近年、モータリゼーションの発達に伴ない、自
動車の果す役割は大きくなっている。
動車の果す役割は大きくなっている。
一方、それらに対して電光表示板による適切なる道路状
況の報知は不可欠である。
況の報知は不可欠である。
このような状況下において電光表示板の表示灯チェック
が従来装置で行なわれることは、点検巡回間で断芯した
表示灯は不点灯のまま放置されることになり、表示灯点
灯綴りによって文字を形成している現行の電光表示板に
おいては、表示文字を誤読する恐れが増大し、必要とさ
れるドライバーへの適切なる指示が欠如する。
が従来装置で行なわれることは、点検巡回間で断芯した
表示灯は不点灯のまま放置されることになり、表示灯点
灯綴りによって文字を形成している現行の電光表示板に
おいては、表示文字を誤読する恐れが増大し、必要とさ
れるドライバーへの適切なる指示が欠如する。
このような状態をなくすため、表示灯の断芯があった場
合、即刻指令側に通告することが最良である。
合、即刻指令側に通告することが最良である。
本発明は以上の点に鑑み、このような問題を解決すると
共に、かかる欠点を除去すべ《なされた回路素子の良否
判定装置を提供するもので、表示灯とザイリスタを直列
に接続し、サイリスタの点弧によって表示灯が点灯する
無接点表示灯点灯装置において、サイリスタのゲートに
印加する点弧用信号電圧とこのサイリスタのアノードに
現出する電圧を人力信号として動作する排他的論理和回
路を設け、その排他的論埋和回路の入力信号の変化の状
態によって生ずる出力信号の有無によって、表示灯の断
芯・サイリスタの導通破壊・サイリスタの非導通破壊を
自動的に検出するようにしたものである。
共に、かかる欠点を除去すべ《なされた回路素子の良否
判定装置を提供するもので、表示灯とザイリスタを直列
に接続し、サイリスタの点弧によって表示灯が点灯する
無接点表示灯点灯装置において、サイリスタのゲートに
印加する点弧用信号電圧とこのサイリスタのアノードに
現出する電圧を人力信号として動作する排他的論理和回
路を設け、その排他的論埋和回路の入力信号の変化の状
態によって生ずる出力信号の有無によって、表示灯の断
芯・サイリスタの導通破壊・サイリスタの非導通破壊を
自動的に検出するようにしたものである。
以下、図面に基づき本発明の実施例を詳細に説明する。
図は本発明による回路素子の良否判定装置の一実施例を
示す構成図である。
示す構成図である。
図において、ＬＰは脈流のランプ電圧ＰＣが印加される
表示灯、ＳＣＲは表示灯ＬＰに直列接続されたサイリス
タ、ＥＸ−ＯＲはサイリスタＳＣＲのゲートＧに印加す
る点弧用信号電圧とサイリスタＳＣＲのアノードＡに現
出する電圧を入力信号として動作する排他論理和素子、
Ｍは点灯制御信号Ｓを入力とし、リセット信号Ｒによっ
てリセットされるメモリである３そして、表示灯ＬＰと
カソードＫを接地したサイリスタＳＣＲのアノードＡと
の接続点はダイオードＤと抵抗Ｒ１を直列に介して排他
論理和素子ＥＸ−ＯＲの一方のゲート入力端に接続され
、サイリスタＳＣＲのゲートＧにはメモ１Ｍの出力端に
接続されると共に、排他論理和素子ＥＸ−ＯＲの他方の
ゲート入力端に接続されている。
表示灯、ＳＣＲは表示灯ＬＰに直列接続されたサイリス
タ、ＥＸ−ＯＲはサイリスタＳＣＲのゲートＧに印加す
る点弧用信号電圧とサイリスタＳＣＲのアノードＡに現
出する電圧を入力信号として動作する排他論理和素子、
Ｍは点灯制御信号Ｓを入力とし、リセット信号Ｒによっ
てリセットされるメモリである３そして、表示灯ＬＰと
カソードＫを接地したサイリスタＳＣＲのアノードＡと
の接続点はダイオードＤと抵抗Ｒ１を直列に介して排他
論理和素子ＥＸ−ＯＲの一方のゲート入力端に接続され
、サイリスタＳＣＲのゲートＧにはメモ１Ｍの出力端に
接続されると共に、排他論理和素子ＥＸ−ＯＲの他方の
ゲート入力端に接続されている。
また、前記抵抗Ｒ１と排他論理和素子ＥＸ−ＯＲの一方
のゲート入力端との接続点は抵抗Ｒ２およびコンデンサ
Ｃを並列に介して接地され、サイリスタＳＣＲのゲート
Ｇは抵抗Ｒ３を介して接地されている。
のゲート入力端との接続点は抵抗Ｒ２およびコンデンサ
Ｃを並列に介して接地され、サイリスタＳＣＲのゲート
Ｇは抵抗Ｒ３を介して接地されている。
つぎにこの図に示す実施例の動作を説明する。
まず、一般的な無接点表示灯点灯方式としては、表示灯
ＬＰとサイリスタＳＣＲを直列に接続し、その両端に脈
流のランプ電圧を印加し、サイリスタＳＣＲのゲートＧ
にプラス（＋）の電圧が印加されたときサイリスタＳＣ
Ｒが導通して表示灯ＬＰが点灯する方式が採られている
。
ＬＰとサイリスタＳＣＲを直列に接続し、その両端に脈
流のランプ電圧を印加し、サイリスタＳＣＲのゲートＧ
にプラス（＋）の電圧が印加されたときサイリスタＳＣ
Ｒが導通して表示灯ＬＰが点灯する方式が採られている
。
ここで、以上の回路方式により、サイリスタＳＣＲのア
ノードＡに現われる電圧を見ると、サイリスタＳＣＲが
非導通のときは脈流のランプ電圧がそのまま現出するが
、導通のときはＯｖとなる。
ノードＡに現われる電圧を見ると、サイリスタＳＣＲが
非導通のときは脈流のランプ電圧がそのまま現出するが
、導通のときはＯｖとなる。
このように、サイリスタＳＣＲのゲートＧに印加する電
圧と、アノードＡに現出する電圧の有無を検出し、相互
の関連によって表示灯ＬＰの断芯やサイリスタＳＣＨの
良否を判定することができる。
圧と、アノードＡに現出する電圧の有無を検出し、相互
の関連によって表示灯ＬＰの断芯やサイリスタＳＣＨの
良否を判定することができる。
さて、図において、メモリＭの出力電圧が零の場合には
、サイリスタＳＣＲのゲートＧに電圧が印加せず、サイ
リスタＳＣＲは非導通となり、表示灯ＬＰは点灯しない
。
、サイリスタＳＣＲのゲートＧに電圧が印加せず、サイ
リスタＳＣＲは非導通となり、表示灯ＬＰは点灯しない
。
このときのサイリスタＳＣＲのアノードＡの電圧信号は
“１”である。
“１”である。
そして、このアノードＡの信号はダイオードＤと抵抗Ｒ
１を通して排他論理和素子ＥＸ−ＯＲのゲートの一端に
送出される。
１を通して排他論理和素子ＥＸ−ＯＲのゲートの一端に
送出される。
一方、排他論理和素子ＥＸ−ＯＲの他の入力ゲートには
メモリＭの出力線が接続され、この状態における排他論
理和素子ＥＸ−ＯＲの両入力ゲートの信号は“１”と“
０”であり、このときの排他論埋相素子ＥＸ−ＯＲの出
力信号ＯＵＴは“１″となる。
メモリＭの出力線が接続され、この状態における排他論
理和素子ＥＸ−ＯＲの両入力ゲートの信号は“１”と“
０”であり、このときの排他論埋相素子ＥＸ−ＯＲの出
力信号ＯＵＴは“１″となる。
また、メモリＭの出力信号が“１”の場合、サイリスタ
ＳＣＨのゲートＧに電圧が印加し、サイリスタＳＣＲは
導通となり、表示灯ＬＰは点灯する。
ＳＣＨのゲートＧに電圧が印加し、サイリスタＳＣＲは
導通となり、表示灯ＬＰは点灯する。
このときのサイリスタＳＣＲはアノードＡの電圧信号は
零となる。
零となる。
この状態でメモＪＭの出力信号“１”であるから排他論
理和素子ＥＸ−ＯＲの両入力のゲート信号は“０”と“
１”となり、その出力信号ＯＵＴは“１”となる。
理和素子ＥＸ−ＯＲの両入力のゲート信号は“０”と“
１”となり、その出力信号ＯＵＴは“１”となる。
前述の状態は表示灯ＬＰおよびサイリスタＳＣＲが正常
な動作をしているときの制御動作について説明したが、
つぎに不良状態の場合を説明する。
な動作をしているときの制御動作について説明したが、
つぎに不良状態の場合を説明する。
まず、表示灯ＬＰに断芯が起きた場合について説明する
と、サイリスタＳＣＲのゲート信号零のときは、サイリ
スタＳＣＲのアノードＡ信号は“１”とならず“０”と
なり、排他論埋和素子ＥＸ−ＯＲの両入力ゲート信号は
“０”と“０”になってこの排他論理和素子ＥＸ−ＯＲ
の出力信号ＯＵＴは“０”となる。
と、サイリスタＳＣＲのゲート信号零のときは、サイリ
スタＳＣＲのアノードＡ信号は“１”とならず“０”と
なり、排他論埋和素子ＥＸ−ＯＲの両入力ゲート信号は
“０”と“０”になってこの排他論理和素子ＥＸ−ＯＲ
の出力信号ＯＵＴは“０”となる。
また、サイリスタＳＣＲがゲート信号“１”にもかかわ
らず点弧せず非導通になった場合には、サイリスタＳＣ
ＲのアノードＡ信号は“１”を持続し、排他論埋和素子
ＥＸ−ＯＲの両ゲート入力信号は゛１”と“１”となっ
てこの排他論理和素子ＥＸ−ＯＲの出力信号ＯＵＴは“
０”となる。
らず点弧せず非導通になった場合には、サイリスタＳＣ
ＲのアノードＡ信号は“１”を持続し、排他論埋和素子
ＥＸ−ＯＲの両ゲート入力信号は゛１”と“１”となっ
てこの排他論理和素子ＥＸ−ＯＲの出力信号ＯＵＴは“
０”となる。
このような状態変化をまとめると次表に示すようになる
。
。
上表より明らかなように、表示灯ＬＰまたはサイリスタ
ＳＣＲが正常なときは、排他論埋和素子ＥＸ−ＯＲの出
力信号ＯＵＴはサイリスタＳＣＨのゲー｝Ｇに印加され
る信号が“０”または“１′の状態にかかわらず“１”
であるが、不良状態が発生している場合には排他論埋和
素子ＥＸ−ＯＲの出力信号ＯＵＴが“０”となる。
ＳＣＲが正常なときは、排他論埋和素子ＥＸ−ＯＲの出
力信号ＯＵＴはサイリスタＳＣＨのゲー｝Ｇに印加され
る信号が“０”または“１′の状態にかかわらず“１”
であるが、不良状態が発生している場合には排他論埋和
素子ＥＸ−ＯＲの出力信号ＯＵＴが“０”となる。
このように、排他論理和素子ＥＸ−ＯＲの出力信号の有
無によって、表示灯ＬＰの断芯とサイリスタＳＣＲの導
通破壊およびサイリスタＳＣＲの非導通破壊を自動的に
検出することができる。
無によって、表示灯ＬＰの断芯とサイリスタＳＣＲの導
通破壊およびサイリスタＳＣＲの非導通破壊を自動的に
検出することができる。
なお、この排他論埋和素子ＥＸ−ＯＲの出力信号は図示
しない他の系の出力信号と共にオアゲートを介して指令
側に通告される。
しない他の系の出力信号と共にオアゲートを介して指令
側に通告される。
以上本発明を表示灯およびサイリスタからなる回路素子
の良否を判定するため、排他論埋和素子を用いた場合を
例にとって説明したが、本発明はこれに限定されるもの
ではなく、アンドゲート・オアゲートの組合せによる排
他論理和回路によっても検定を行なうことができる。
の良否を判定するため、排他論埋和素子を用いた場合を
例にとって説明したが、本発明はこれに限定されるもの
ではなく、アンドゲート・オアゲートの組合せによる排
他論理和回路によっても検定を行なうことができる。
以上の説明から明らかなように、本発明によれば、複雑
な手段を用いることなく、サイリスタのゲートに印加す
る点弧用信号電圧とそのサイリスタのアノードに現出す
る電圧とを入力とする排他的論埋和回路を設けるという
簡単な回路構成によって表示灯の断芯検知と文字表示中
の電光表示板においても断芯の検知を自動的に行なうこ
とができると共に、サイリスクの良否判定を自動的に行
なうことができるので、実用上の効果は極めて犬である
。
な手段を用いることなく、サイリスタのゲートに印加す
る点弧用信号電圧とそのサイリスタのアノードに現出す
る電圧とを入力とする排他的論埋和回路を設けるという
簡単な回路構成によって表示灯の断芯検知と文字表示中
の電光表示板においても断芯の検知を自動的に行なうこ
とができると共に、サイリスクの良否判定を自動的に行
なうことができるので、実用上の効果は極めて犬である
。
また、従来のように周回による人為的な点検操作に頼よ
る必要がなくなるため、それにもとづ《あらゆる不便さ
を解決することができるという点においても極めて有効
であり、電光表示板における多種回路素子の良否判定装
置としては独自のものである。
る必要がなくなるため、それにもとづ《あらゆる不便さ
を解決することができるという点においても極めて有効
であり、電光表示板における多種回路素子の良否判定装
置としては独自のものである。
図は本発明による回路素子の良否判定装置の一実施例を
示す構成図である。 ＬＰ・・・・・・表示灯、ＳＣＲ・・・・・・サイリス
タ、ＥＸ−ＯＲ・・・・・・排他論埋和素子、Ｍ・・・
・・・メモリ。
示す構成図である。 ＬＰ・・・・・・表示灯、ＳＣＲ・・・・・・サイリス
タ、ＥＸ−ＯＲ・・・・・・排他論埋和素子、Ｍ・・・
・・・メモリ。
Claims (1)
- １ 表示灯とサイリスタを直列に接続し、このサイリス
タの点弧によって表示灯が点灯する無接点表示灯点灯方
式において、前記サイリスクのゲートに印加する点弧用
信号電圧と該サイリスタのアノードに現出する電圧とを
入力する排他的論埋和回路を備え、この排他的論埋和回
路の入力信号の変化の状態に基いて生ずる出力信号の有
無によって、前記表示灯の断芯・サイリスタの導通破壊
を自動的に検出するようにしたことを特徴とする回路素
子の良否判定装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52119009A JPS5812719B2 (ja) | 1977-10-05 | 1977-10-05 | 回路素子の良否判定装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52119009A JPS5812719B2 (ja) | 1977-10-05 | 1977-10-05 | 回路素子の良否判定装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5452998A JPS5452998A (en) | 1979-04-25 |
| JPS5812719B2 true JPS5812719B2 (ja) | 1983-03-09 |
Family
ID=14750723
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP52119009A Expired JPS5812719B2 (ja) | 1977-10-05 | 1977-10-05 | 回路素子の良否判定装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5812719B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61139319U (ja) * | 1984-12-17 | 1986-08-29 |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5691623A (en) * | 1979-12-24 | 1981-07-24 | Toyota Motor Co Ltd | Power transistor malfunction detector |
| JPS59220018A (ja) * | 1983-05-25 | 1984-12-11 | 富士電機株式会社 | サイリスタスイツチの故障検出回路 |
-
1977
- 1977-10-05 JP JP52119009A patent/JPS5812719B2/ja not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61139319U (ja) * | 1984-12-17 | 1986-08-29 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5452998A (en) | 1979-04-25 |
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