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JPS5818605B2 - Maximum value weighing device - Google Patents
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JPS5818605B2 - Maximum value weighing device - Google Patents

Maximum value weighing device

Info

Publication number
JPS5818605B2
JPS5818605B2 JP51111528A JP11152876A JPS5818605B2 JP S5818605 B2 JPS5818605 B2 JP S5818605B2 JP 51111528 A JP51111528 A JP 51111528A JP 11152876 A JP11152876 A JP 11152876A JP S5818605 B2 JPS5818605 B2 JP S5818605B2
Authority
JP
Japan
Prior art keywords
counter
contents
maximum value
latch circuit
circuit
Prior art date
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Expired
Application number
JP51111528A
Other languages
Japanese (ja)
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JPS5337053A (en
Inventor
今一生
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Toshiba Corp
Original Assignee
Tokyo Shibaura Electric Co Ltd
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Filing date
Publication date
Application filed by Tokyo Shibaura Electric Co Ltd filed Critical Tokyo Shibaura Electric Co Ltd
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Publication of JPS5337053A publication Critical patent/JPS5337053A/en
Publication of JPS5818605B2 publication Critical patent/JPS5818605B2/en
Expired legal-status Critical Current

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Description

【発明の詳細な説明】 本発明は入力パルスの最大計数値を表示する最大値計量
装置に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a maximum value measuring device that displays the maximum count value of input pulses.

従来、電気、ガス等の消費量を計量しこれを単位消費量
毎にパルスに変換し例えば遠隔地でそのパルスを積算計
数して表示する装置があるが、その装置の1つとして常
にその積算計数値の最大値を計数表示する最大値計量装
置がある。
Conventionally, there is a device that measures the consumption of electricity, gas, etc., converts it into pulses for each unit of consumption, and, for example, counts and displays the pulses in a remote location. There is a maximum value measuring device that counts and displays the maximum value of the counted value.

ところで、かかる計量装置は最大値加算カウンタと減算
カウンタとを有し、一定時限毎に最大値加算カウンタの
内容を減算カウンタにセットとして両者の計数内容を等
しくした後、入力パルスを減算カウンタに供給して減算
動作を行なわせ、減算カウンタの内容が零になったとき
その零信号で減算カウンタへの入力パルスの供給を阻止
し入力パルスを最大値加算カウンタに供給するようにし
、常に入力パルスの計数最大値を最大値加算カウンタで
保持し、かつそのカウンタの計量内容を表示器に表示す
るようにしている。
By the way, such a measuring device has a maximum value addition counter and a subtraction counter, and after setting the contents of the maximum value addition counter to a subtraction counter at regular intervals to equalize the counted contents of both, input pulses are supplied to the subtraction counter. When the content of the subtraction counter becomes zero, the zero signal is used to block the supply of input pulses to the subtraction counter and supply the input pulse to the maximum value addition counter, so that the input pulse is always The maximum counted value is held by a maximum value addition counter, and the measured contents of the counter are displayed on a display.

しかしながら、上述した装置は積算計数値の最大値を表
示するために、最大値加算カウンタの他に減算カウンタ
をも必要とする反面、その計数表示は最大値しか表示で
きない不都合がある。
However, in order to display the maximum value of the integrated count value, the above-mentioned device requires a subtraction counter in addition to the maximum value addition counter, but has the disadvantage that the count display can only display the maximum value.

本発明は上記のような不都合を改善するためになされた
もので、入力パルスを計数したカウンタの内容をある時
限毎にラッチした後クリアし、そのラッチ内容と次のカ
ウンタの計数値とを比較し・て最大値を表示するととも
に、クリア以後のカウンタの計数内容をも表示するよう
にして、少ないカウンタで最大値はもとより、時限毎の
積算計数値をも表示できるようにした最大値計量装置を
提供するものである。
The present invention has been made in order to improve the above-mentioned disadvantages, and it clears the contents of a counter that counts input pulses at certain time intervals after latching them, and compares the latched contents with the next count value of the counter. A maximum value measuring device that not only displays the maximum value but also displays the count contents of the counter after clearing, making it possible to display not only the maximum value but also the cumulative count value for each time period with a small number of counters. It provides:

以下、図面を参照して本発明の一実施例を説明する。Hereinafter, one embodiment of the present invention will be described with reference to the drawings.

図において11は入力パルスの印加される端子で、これ
には入力パルスを積算計数するカウンタ12が接続され
ている。
In the figure, 11 is a terminal to which input pulses are applied, and a counter 12 for integrating and counting input pulses is connected to this terminal.

13は一定時限毎に時限パルスが印加される端子で、こ
れにはフリツ;プ・フロップ回路14が接続されている
Reference numeral 13 denotes a terminal to which a timed pulse is applied at regular intervals, and a flip-flop circuit 14 is connected to this terminal.

なお、この時限パルスはフリップ・フロップ回路14を
リセットし、後続のラッチ回路15がカウンタ12の内
容を記憶しないようにするものである。
Note that this timed pulse resets the flip-flop circuit 14 and prevents the subsequent latch circuit 15 from storing the contents of the counter 12.

15はフリップ・フロップ回路14からの出力信1号で
カウンタ12の内容をラッチもしくは読み込みをするラ
ッチ回路であって、このラッチ回路15の内容は最大値
を表示する最大値表示装置16で表示される。
Reference numeral 15 denotes a latch circuit that latches or reads the contents of the counter 12 using the output signal 1 from the flip-flop circuit 14, and the contents of this latch circuit 15 are displayed on a maximum value display device 16 that displays the maximum value. Ru.

17は時限毎のカウンタ12の内容を表示する時限毎積
算計数値表示装置である。
Reference numeral 17 denotes an integrated count display device for each time period that displays the contents of the counter 12 for each time period.

18はカウンタ12の内容とラッチ回路15の内容とを
比較し、カウンタ12の内容がラッチ回路15の内容よ
りも大きくなったとき一致信号を出力する一致回路で、
この一致信号でフリップ・フロップ回路14はセットさ
れラッチ回路15に読込み指令を与える。
18 is a coincidence circuit that compares the contents of the counter 12 and the contents of the latch circuit 15 and outputs a coincidence signal when the contents of the counter 12 become larger than the contents of the latch circuit 15;
The flip-flop circuit 14 is set by this coincidence signal, and a read command is given to the latch circuit 15.

これによって、ラッチ回路15はカウンタ12の内容を
読込む。
As a result, the latch circuit 15 reads the contents of the counter 12.

19はクリア信号の印加される端子である。19 is a terminal to which a clear signal is applied.

次に、図に示す最大値計量装置の作用を説明する。Next, the operation of the maximum value measuring device shown in the figure will be explained.

端子11に順次印加される入力パルスはカウンタ12に
よって積算計数される。
The input pulses sequentially applied to the terminal 11 are integrated and counted by the counter 12 .

この状態において時限パルスが端子13に印加されると
、フリップ・フロップ回路14はリセットされ、これに
よってラッチ回路16はカウンタ12の内容をラッチす
る。
When a timed pulse is applied to terminal 13 in this state, flip-flop circuit 14 is reset, thereby causing latch circuit 16 to latch the contents of counter 12.

さらに、時限パルスの入力後、カウンタ12の内容がラ
ッチ回路15へ完全にラッチされるに十分な時間経過し
た後に発生されるクリアパルスによってカウンタ12の
内容は零とされる。
Further, the contents of the counter 12 are made zero by a clear pulse generated after a sufficient time has elapsed for the contents of the counter 12 to be completely latched into the latch circuit 15 after inputting the timed pulse.

このとき、ラッチ回路15の内容は零にならない。At this time, the contents of the latch circuit 15 do not become zero.

以後、カウンタ12は時限パルスが到来するまで入力パ
ルスを積算計数するとともに、これらの回路12.15
の内容を表示装置17.16に表示する。
Thereafter, the counter 12 integrates and counts the input pulses until a timed pulse arrives, and these circuits 12.15
The contents of are displayed on the display device 17.16.

■、いま、次の時限内までのカウンタ12の積算計数値
がラッチ回路15の内容より小さい場合について説明す
る。
(2) Now, the case where the cumulative count value of the counter 12 up to the next time period is smaller than the content of the latch circuit 15 will be explained.

この場合、カウンタ12の内容がラッチ回路15の内容
よりも小さいので、一致回路18からは一致信号が出力
されない。
In this case, since the contents of the counter 12 are smaller than the contents of the latch circuit 15, the coincidence circuit 18 does not output a coincidence signal.

このため、フリップ・フロップ回路14の出力状態は変
化せず、ラッチ回路15はラッチしたままの状態を保持
している。
Therefore, the output state of the flip-flop circuit 14 does not change, and the latch circuit 15 maintains the latched state.

この状態にあってカウンタ12は端子11に入力パルス
が到来するごとにそのパルスを積算計数するとともに、
その積算計数値を時限毎積算計数値表示装置17に表示
する。
In this state, the counter 12 counts the input pulses each time they arrive at the terminal 11, and
The cumulative count value is displayed on the time period cumulative count display device 17.

一方、最大値表示装置16はラッチ回路15の内容つま
り最大値を表示する。
On the other hand, the maximum value display device 16 displays the contents of the latch circuit 15, that is, the maximum value.

そして、ある時間が経過して端子13に時限パルスが入
力されるが、カウンタ12の内容がラッチ回路15の内
容よりも小さい限り、フリップ・フロップ回路14の出
力端は出力信号無しつまり!1011の状態になってい
るので、同回路14からは信号が出力されない。
Then, after a certain period of time has elapsed, a timed pulse is input to the terminal 13, but as long as the content of the counter 12 is smaller than the content of the latch circuit 15, the output terminal of the flip-flop circuit 14 has no output signal! Since the state is 1011, no signal is output from the circuit 14.

従って、ラッチ回路15はラッチ状態を続ける。Therefore, the latch circuit 15 continues in the latched state.

一方、カウンタ12は時限パルスの入力後所定時間経過
後に入力されるクリア信号でクリアされ、これに伴なっ
て表示装置17もゼロクリアされる。
On the other hand, the counter 12 is cleared by a clear signal input after a predetermined period of time has elapsed after the input of the time pulse, and the display device 17 is also cleared to zero accordingly.

◎、さらに、次の時限内までのカウンタ12の積算計数
値がラッチ回路15の内容より大きくなる場合について
説明する。
◎.Furthermore, a case will be described in which the cumulative count value of the counter 12 up to the next time period becomes larger than the content of the latch circuit 15.

カウンタ12が入力パルスを積算しその積算計数値がラ
ッチ回路15の内容と一致したとき、一致回路18から
一致信号が出てフリップ・フロップ回路14はセットさ
れる。
When the counter 12 integrates the input pulses and the integrated count value matches the contents of the latch circuit 15, a match signal is output from the match circuit 18 and the flip-flop circuit 14 is set.

そして、フリップ・フロップ回路14の出力信号によっ
てラッチ回路15はラッチ動作を停止し、カウンタ12
の内容を読込む。
Then, the latch circuit 15 stops the latch operation by the output signal of the flip-flop circuit 14, and the counter 12
Read the contents of.

さらに、入力パルスが次々と到来すると、カウンタ12
はそのまま積算計数し、その積算内容の変化に応じてラ
ッチ回路15も変化する。
Furthermore, when input pulses arrive one after another, the counter 12
is integrated and counted as is, and the latch circuit 15 also changes according to changes in the integrated content.

このため表示装置16.17はラッチ回路15、カウン
タ12の値に応じて変化する。
Therefore, the display devices 16 and 17 change according to the values of the latch circuit 15 and the counter 12.

このとき、ラッチ回路15はカウンタ12の内容と1対
1の関係で対応しているので、それぞれの表示装置16
.17は同一の内容を表示することになる。
At this time, since the latch circuit 15 corresponds to the contents of the counter 12 in a one-to-one relationship, each display device 16
.. 17 will display the same content.

このような状態において時限パルスが到来すると、上述
したようにフリップ・フロップ回路14はリセットされ
、ラッチ回路15はラッチ動作を行なう。
When a timed pulse arrives in such a state, the flip-flop circuit 14 is reset as described above, and the latch circuit 15 performs a latch operation.

従って、ラッチ回路15の内容はそれぞれの時限内の最
大値をランチしたことになり、表示装置16はその最大
値を表示する。
Therefore, the contents of the latch circuit 15 have launched the maximum value within each time period, and the display device 16 displays the maximum value.

しかる後、クリアパルスによってカウンタ12の内容は
ゼロクリアされ、表示装置17はゼロを表示することに
なる。
Thereafter, the contents of the counter 12 are cleared to zero by the clear pulse, and the display device 17 displays zero.

そして、以後順次到来する入力パルスをカウンタ12は
再び積算計数し続ける。
Thereafter, the counter 12 continues to integrate and count the input pulses that arrive one after another.

このような動作を例えば最大需要電力量計に適用する場
合、表示装置16の表示は電力量計の黒付(最大値指示
)に相当し、表示装置17の表示は電力量計の赤外(時
限毎復帰)に相当させることができる。
For example, when such an operation is applied to a maximum demand electricity meter, the display on the display device 16 corresponds to the black mark (maximum value indication) on the electricity meter, and the display on the display device 17 corresponds to the infrared (indication of the maximum value) on the electricity meter. (return every time period).

なお、最大値表示のみ行なう場合は表示装置17は不要
であるが、最大値と時限内の積算値を比較するときに有
効である。
Note that the display device 17 is not necessary when only the maximum value is displayed, but it is effective when comparing the maximum value and the integrated value within a time limit.

以上詳記したように本発明によれば、入力パルスの積算
計数値をカウンタでとらえ、これを一定時限毎にラッチ
回路でラッチするとともに、これらのカウンタ、ラッチ
回路の内容を表示装置で表示する構成としたので、簡単
な構成で所定時限内の最大値をディジタル表示すること
ができる。
As detailed above, according to the present invention, the integrated count value of input pulses is captured by a counter, this is latched by a latch circuit at fixed time intervals, and the contents of these counters and latch circuits are displayed on a display device. With this configuration, the maximum value within a predetermined time period can be digitally displayed with a simple configuration.

また、最大値と時限毎のパルス積算計数値との両者′を
同時表示することも可能になったことにより、ラッチ回
路の内容を記録装置に簡単に打印記録でき、さらに時限
毎の最大値をプリントアウトしである一定時限内の負荷
状況を把握することもできる管種々の効果を有する。
In addition, it is now possible to display both the maximum value and the pulse integrated count value for each time period at the same time, so the contents of the latch circuit can be easily recorded on a recording device, and the maximum value for each time period can also be displayed. It also has various effects, such as being able to check the load status within a certain period of time by printing it out.

【図面の簡単な説明】[Brief explanation of drawings]

図は本発明に係る最大値計量装置の一実施例を説明する
ブロック図である。 12・・・・・・カウンタ、14・・・・・・フリップ
・フロップ回路、15・・・・・・ラッチ回路、15.
17・・・・・・表示装置、18・・・・・・一致回路
The figure is a block diagram illustrating an embodiment of the maximum value measuring device according to the present invention. 12...Counter, 14...Flip-flop circuit, 15...Latch circuit, 15.
17... Display device, 18... Matching circuit.

Claims (1)

【特許請求の範囲】[Claims] 1 人力パルスを積算計数するカウンタと、このカウン
タの内容を時限パルス毎にラッチするラッチ回回路と、
これらのカウンタおよびラッチ回路の内容を比較し、該
カウンタの内容がラッチ回路の内容よりも大きくなった
とき一致信号を出力して前記ラッチ回路にカウンタの内
容を読込ませる一致回路と、前記ラッチ回路の出力から
最大値を表示する最大値表示装置と、前記−数回路に供
給するカウンタの出力を利用して時限毎積算計数値を表
示する時限毎積算計数値表示装置と、前記時限パルスの
入力後に入力されるクリア信号で前記カウンタをクリア
する手段とを具備したことを特徴とする最大値計量装置
1. A counter that cumulatively counts human power pulses, a latch circuit that latches the contents of this counter for each timed pulse,
a matching circuit that compares the contents of the counter and the latch circuit and outputs a match signal when the contents of the counter becomes larger than the contents of the latch circuit to cause the latch circuit to read the contents of the counter; and the latch circuit. a maximum value display device that displays the maximum value from the output of the counter, a time period cumulative count display device that displays the time period cumulative count value using the output of the counter supplied to the - number circuit, and an input of the time pulse. A maximum value measuring device comprising means for clearing the counter with a clear signal input later.
JP51111528A 1976-09-17 1976-09-17 Maximum value weighing device Expired JPS5818605B2 (en)

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JPS5337053A JPS5337053A (en) 1978-04-05
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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JPS5337053A (en) 1978-04-05

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