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JPS5821854B2 - SEPP Shutsuryoku Cairo - Google Patents
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JPS5821854B2 - SEPP Shutsuryoku Cairo - Google Patents

SEPP Shutsuryoku Cairo

Info

Publication number
JPS5821854B2
JPS5821854B2 JP9342775A JP9342775A JPS5821854B2 JP S5821854 B2 JPS5821854 B2 JP S5821854B2 JP 9342775 A JP9342775 A JP 9342775A JP 9342775 A JP9342775 A JP 9342775A JP S5821854 B2 JPS5821854 B2 JP S5821854B2
Authority
JP
Japan
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transistor
collector
current
emitter
signal
Prior art date
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Expired
Application number
JP9342775A
Other languages
Japanese (ja)
Other versions
JPS5216954A (en
Inventor
横山明夫
難波江光男
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP9342775A priority Critical patent/JPS5821854B2/en
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Publication of JPS5821854B2 publication Critical patent/JPS5821854B2/en
Expired legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03FAMPLIFIERS
    • H03F3/00Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
    • H03F3/30Single-ended push-pull [SEPP] amplifiers; Phase-splitters therefor
    • H03F3/3083Single-ended push-pull [SEPP] amplifiers; Phase-splitters therefor the power transistors being of the same type
    • H03F3/3086Single-ended push-pull [SEPP] amplifiers; Phase-splitters therefor the power transistors being of the same type two power transistors being controlled by the input signal

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Amplifiers (AREA)

Description

【発明の詳細な説明】 本発明は安定した無信号時電流を流し、クロスオーバ歪
ならびに不要な電力消費を低減することのできるB級の
5EPP出力回路に関するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a class B 5EPP output circuit that can flow a stable current when no signal is present and can reduce crossover distortion and unnecessary power consumption.

B級5EPP出力回路は、これが個別部品を用いて形成
されたもの、あるいは半導体集積回路内に作り込才れた
もののいずれであっても、出力信号にクロスオーバ歪が
生じる不都合を排除するべく、適当な無信号時電流を流
す配慮が払われている。
Class B 5EPP output circuits, whether formed using individual components or integrated into a semiconductor integrated circuit, are designed to eliminate the inconvenience of crossover distortion in the output signal. Consideration has been taken to flow an appropriate current when no signal is present.

しかしながら、無信号時電流は回路を構成しているトラ
ンジスタ、抵抗等の特性の影響を大きく受け、わずかな
特性変化によって無信号時電流の値が変わり、この電流
値が小さくなったときにはクロスオーバ歪が生じ、逆に
大きくなりすぎたときには余分な電力を消費する不都合
をきたす。
However, the no-signal current is greatly affected by the characteristics of the transistors, resistors, etc. that make up the circuit, and the value of the no-signal current changes due to a slight change in characteristics, and when this current value becomes small, crossover distortion occurs. occurs, and conversely, when it becomes too large, it causes the inconvenience of consuming excess power.

しだがって回路を構成する部品には高い精度が要求され
ており、回路全体として高価なものとなる難点を有して
いた。
Therefore, high precision is required for the parts that make up the circuit, and the circuit as a whole has the disadvantage of being expensive.

本発明は上記の不都合を排除するだめになされたもので
、5EPP出力回路を構成する出力トランジスタのエミ
ッタならびにベースとそれぞれエミッタならびにベース
が共通接続されたトランジスタを付加した回路構成を採
ることによって、トランジスタの特性等に影響されるこ
とのない安定した無信号時電流を流すことのできる5E
PP出力回路を提供することを目的とする。
The present invention has been made to eliminate the above-mentioned disadvantages, and by adopting a circuit configuration in which a transistor is added whose emitter and base are commonly connected to the emitter and base of the output transistor constituting the 5EPP output circuit, the transistor 5E, which can flow stable current during no signal without being affected by the characteristics of
The purpose is to provide a PP output circuit.

第1図は本発明にかかる5EPP出力回路の一実施例を
示すもので、図示する如く第1のトランジスタである出
力トランジスタ1に向い合せて第2のトランジスタであ
るトランジスタ2を配置するとともに同トランジスタ2
と出力トランジスタ1のエミッタならびにベースをそれ
ぞれ共通接続した構成が採られている。
FIG. 1 shows an embodiment of the 5EPP output circuit according to the present invention. As shown in the figure, a transistor 2, which is a second transistor, is arranged facing an output transistor 1, which is a first transistor, and 2
A configuration is adopted in which the emitter and base of the output transistor 1 and the output transistor 1 are connected in common.

共通接続されたトランジスタ1と同2のエミッタは、エ
ミッタが接地された第3のトランジスタであるトランジ
スタ7のコレクタに接続されており、トランジスタ7の
ベースはエミッタがトランジスタ2のコレクタに接続さ
れた第4のトランジスタであるトランジスタ4のコレク
タに接続されている。
The commonly connected emitters of transistors 1 and 2 are connected to the collector of a third transistor, transistor 7, whose emitter is grounded, and the base of transistor 7 is connected to the collector of transistor 7, whose emitter is connected to the collector of transistor 2. It is connected to the collector of transistor 4, which is transistor No. 4.

トランジスタ7のコレクタは充放電素子としてのコンデ
ンサ8を介して負荷であるスピーカ9に接続されている
The collector of the transistor 7 is connected to a speaker 9 as a load via a capacitor 8 as a charging/discharging element.

電源端子6はトランジスタ1のコレクタに、トランジス
タ2のコレクタに抵抗5を介して、まだトランジスタ4
のベースに抵抗10を介してそれぞれ接続されており、
信号源端子3はトランジスタ1,2.4のベースニソれ
ぞれ接続されている。
Power supply terminal 6 is connected to the collector of transistor 1, to the collector of transistor 2 via resistor 5, and to the collector of transistor 4.
are connected to the base of each via a resistor 10,
The signal source terminal 3 is connected to the bases of the transistors 1, 2.4, respectively.

以上の構成よりなる本発明の5EPP出力回路によれば
、以下に述べる動作で安定した無信号特電流がトランジ
スタ1に流れ、前記の不都合を避けることができる。
According to the 5EPP output circuit of the present invention having the above configuration, a stable non-signal special current flows through the transistor 1 through the operation described below, and the above-mentioned disadvantages can be avoided.

すなわち、信号源端子3には交流信号がなく正常な直流
電位で保持されている状態では、この直流電位に準じて
トランジスタ4のエミッタ電位が決まる。
That is, when there is no AC signal at the signal source terminal 3 and the signal source terminal 3 is held at a normal DC potential, the emitter potential of the transistor 4 is determined according to this DC potential.

この時、抵抗5に流れる電流は電源端子6の電位とトラ
ンジスタ4のエミッタ電位との差を抵抗5の値で除した
値のものとなる。
At this time, the current flowing through the resistor 5 has a value obtained by dividing the difference between the potential of the power supply terminal 6 and the emitter potential of the transistor 4 by the value of the resistor 5.

ここで、トランジスタ7に電流増幅率の十分高いものを
選んでおくと、トランジスタ7のベースに流れる電流は
同トランジスタ7のコレクタに流れる電流に比して十分
小さくなるので、トランジスタ4のコレクタとトランジ
スタ7のベースとの間に流れる電流は回路全体として無
視できるものとなる。
Here, if a transistor with a sufficiently high current amplification factor is selected for transistor 7, the current flowing to the base of transistor 7 will be sufficiently small compared to the current flowing to the collector of transistor 7, so that the collector of transistor 4 and the transistor The current flowing between the base of the circuit and the base of the circuit becomes negligible.

従って、トランジスタ7の電流増幅率が十分高ければト
ランジスタ2のコレクタに流れる電流は抵抗5の値によ
り決定されることになる。
Therefore, if the current amplification factor of transistor 7 is sufficiently high, the current flowing to the collector of transistor 2 will be determined by the value of resistor 5.

ところで、トランジスタ1のベースとトランジスタ2の
ベースは共通接続されており、トランジスタ1とトラン
ジスタ2の特性がほぼ等しければ両トランジスタの各コ
レクタに流れる電流は等しいものとなる。
By the way, the base of transistor 1 and the base of transistor 2 are commonly connected, and if the characteristics of transistor 1 and transistor 2 are substantially equal, the currents flowing through the respective collectors of both transistors will be equal.

従って出力トランジスタ1のコレクタに流れる電流も抵
抗5の値にのみによって決められることになり、無信号
時の電流を極めて安定なものにすることができる。
Therefore, the current flowing to the collector of the output transistor 1 is also determined only by the value of the resistor 5, and the current can be made extremely stable when there is no signal.

ちなみに、トランジスタ4のコレクタ電流は、トランジ
スタ7のコレクタ電流を流すに必要とされるトランジス
タ7のわずかなベース電流となっている。
Incidentally, the collector current of the transistor 4 is a small base current of the transistor 7, which is required to cause the collector current of the transistor 7 to flow.

次に本発明にがかる5EPP 増幅回路の動作を説明す
る。
Next, the operation of the 5EPP amplifier circuit according to the present invention will be explained.

無信号時にはコンデンサ8は、信号源端子3に保持され
ている直流電位よりトランジスタ1あるいはトランジス
タ2のベース・エミッタ順方向電圧だけ低い電位まで充
電されている。
When there is no signal, the capacitor 8 is charged to a potential lower than the DC potential held at the signal source terminal 3 by the base-emitter forward voltage of the transistor 1 or transistor 2.

第2図に信号源端子3に交流信号が加わった場合のトラ
ンジスタ1あるいはトランジスタ2のエミッタの信号の
状態を表わしである。
FIG. 2 shows the state of the signal at the emitter of transistor 1 or transistor 2 when an alternating current signal is applied to signal source terminal 3.

同図においてE。In the same figure, E.

は無信号時のトランジスタ1のエミッタ電位である。is the emitter potential of transistor 1 when there is no signal.

今、信号源端子3に無信号時における直流電位よりも高
くなる信号が加わった場合、すなわち第2図のAの期間
では、トランジスタ2のコレクタ電流が増加し、この電
流は抵抗5を流れるためトランジスタ2のコレクタ電位
す々わちトランジスタ4のエミッタ電位が下がりトラン
ジスタ2は飽和領域で動作する。
Now, when a signal that becomes higher than the DC potential when there is no signal is applied to the signal source terminal 3, that is, during the period A in FIG. 2, the collector current of the transistor 2 increases, and this current flows through the resistor 5. The collector potential of the transistor 2, that is, the emitter potential of the transistor 4 decreases, and the transistor 2 operates in a saturation region.

一方、トランジスタ2及びトランジスタ4のベースは共
通接続されており、このためトランジスタ2のコレクタ
電流が増して飽和領域で動作するようになると、トラン
ジスタ4のベース・エミッタ間には逆方向の電圧が加わ
ることになる。
On the other hand, the bases of transistor 2 and transistor 4 are commonly connected, so when the collector current of transistor 2 increases and it operates in the saturation region, a voltage in the opposite direction is applied between the base and emitter of transistor 4. It turns out.

このためにトランジスタ4は遮断領域に入りトランジス
タ4のコレクタ電流は零となる。
Therefore, the transistor 4 enters the cutoff region and the collector current of the transistor 4 becomes zero.

トランジスタ4のコレクタ電流はトランジスタ7のベー
ス電流でもあるだめに、トランジスタ4が遮断状態でト
ランジスタ4のコレクタ電流が零となるとトランジスタ
7も遮断状態となり、トランジスタ7のコレクタ電流は
流れなくなる。
Since the collector current of transistor 4 is also the base current of transistor 7, when transistor 4 is cut off and the collector current of transistor 4 becomes zero, transistor 7 is also cut off and the collector current of transistor 7 stops flowing.

従って、第2図のAの期間では、トランジスタ7のコレ
クタには電流は流れず、飽和したトランジスタ2のコレ
クタの電流は抵抗5により制限されるため、トランジス
タ1のみが負荷に対して有効に作動し、トランジスタ1
のエミッタから、コンデンサ8を介して負荷9に信号電
流を供給することになり、トランジスタ1はエミッタホ
ロアとして動作する。
Therefore, during period A in FIG. 2, no current flows through the collector of transistor 7, and the saturated collector current of transistor 2 is limited by resistor 5, so only transistor 1 operates effectively against the load. and transistor 1
A signal current is supplied from the emitter of the transistor 1 to the load 9 via the capacitor 8, and the transistor 1 operates as an emitter follower.

次に、信号源端子3に無信号時における直流電位よりも
低くなる信号が加わった場合、すなわち第2図のBの期
間では、トランジスタ1及びトランジスタ2はトランジ
スタ7のコレクタ電位を決定するためにのみ動作する。
Next, when a signal that is lower than the DC potential when there is no signal is applied to the signal source terminal 3, that is, during the period B in FIG. only works.

トランジスタ40ベース電位は無信号時の直流電位より
低下するためトランジスタ4は活性領域で作動し、同ト
ランジスタ4のコレクタには電流が流れ、トランジスタ
7を1駆動してトランジスタ7にコレクタ電流ヲ流す。
Since the base potential of the transistor 40 is lower than the DC potential when there is no signal, the transistor 4 operates in the active region, and a current flows through the collector of the transistor 4, driving the transistor 7 to 1 and causing a collector current to flow through the transistor 7.

ゆえに、トランジスタ7のコレクタ電位はコンデンサ8
に充電されている電位E。
Therefore, the collector potential of transistor 7 is
The electric potential E charged at.

より低くなるため、コンデンサ8からトランジスタ7の
方向に電流が流れ負荷9に信号電流を供給することにな
る。
As the voltage becomes lower, current flows from the capacitor 8 to the transistor 7 and supplies a signal current to the load 9.

すなわち、以上のようにして本発明の5EPP出力回路
では、第2図のAの期間ではトランジスタ1により負荷
9に信号電流が供給され、一方同図のBの期間にはトラ
ンジスタ7により負荷9に信号電流が供給され、したが
って回路動作とじては5EPP出力回路の動作そのもの
となる。
That is, in the 5EPP output circuit of the present invention as described above, a signal current is supplied to the load 9 by the transistor 1 during the period A in FIG. A signal current is supplied, and therefore the circuit operation is the same as that of the 5EPP output circuit.

以上説明してきたように、コレクタが電源端子に接続さ
れる第1のトランジスタのエミッタと、コレクタが抵抗
を介して前記電源端子に接続される第2のトランジスタ
のエミッタとを共通接続し、前記共通接続されたエミッ
タに充放電素子を介して負荷を接続し、前記共通接続さ
れたエミッタにコレクタが接続される第3のトランジス
タのベースに前記第2のトランジスタのコレクタにエミ
ッタが接続される第4のトランジスタのコレクタを接続
し、前記第1、第2、第4のトランジスタの各々のベー
スを共通接続して信号源端子に接続したことを特徴とす
る本発明の5EPP出力回路は、無信号時における静止
電流の設定が第2のトランジスタと電源端子との間に接
続されている抵抗の値の選定によってなされ、その設定
が容易でしかも静止電流の安定化を図ることができるの
で、クロスオーバー歪や余分な電力の消費に関する不都
合が排除されることになり、また、回路構成そのものが
非常に簡単であり部品点数も少なくすることができる。
As explained above, the emitter of the first transistor whose collector is connected to the power supply terminal and the emitter of the second transistor whose collector is connected to the power supply terminal via a resistor are commonly connected, and the emitter of the first transistor whose collector is connected to the power supply terminal is commonly connected. A load is connected to the connected emitters via a charging/discharging element, and a fourth transistor has an emitter connected to the base of a third transistor whose collector is connected to the commonly connected emitter and a collector of the second transistor. The 5EPP output circuit of the present invention is characterized in that the collectors of the transistors are connected, and the bases of the first, second, and fourth transistors are commonly connected and connected to a signal source terminal. The setting of the quiescent current is done by selecting the value of the resistor connected between the second transistor and the power supply terminal, and the setting is easy and the quiescent current can be stabilized, so crossover distortion can be reduced. In addition, the circuit configuration itself is very simple and the number of parts can be reduced.

さらに本発明の5EPP出力回路は出力トランジスタと
、ベースならびにエミッタが出力トランジスタのベース
ならびにエミッタと共通接続されるトランジスタとで形
成される回路部を主体とする構成となっており、半導体
集積化をする場合には回路要素の特性が揃い、より一層
の効果を期待できるもので、非常に大なる効果を奏する
ものである。
Furthermore, the 5EPP output circuit of the present invention has a configuration mainly consisting of a circuit section formed by an output transistor and a transistor whose base and emitter are commonly connected to the base and emitter of the output transistor, and is capable of semiconductor integration. In some cases, the characteristics of the circuit elements are uniform, and even greater effects can be expected, resulting in very large effects.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の5EPP出力回路の一実施例を示す図
、第2図は信号印加時における出力トランジスタのエミ
ッタにおける電位の波形を示す図である。 1.2,4,7・・・・・・トランジスタ、3・・・・
・・信号源端子、5,10・・・・・・抵抗、6・・・
・・・電源端子、8・・・・・・コンデンサ、9・・・
・・・負荷。
FIG. 1 is a diagram showing an embodiment of the 5EPP output circuit of the present invention, and FIG. 2 is a diagram showing the waveform of the potential at the emitter of the output transistor when a signal is applied. 1.2,4,7...transistor, 3...
...Signal source terminal, 5,10...Resistor, 6...
...Power terminal, 8...Capacitor, 9...
···load.

Claims (1)

【特許請求の範囲】[Claims] 1 コレクタが電源端子に接続される第1のトランジス
タのエミッタと、コレクタが抵抗を介して前記電源端子
に接続される前記第1のトランジスタと同極性の第2の
トランジスタのエミッタとを共通接続し、前記共通接続
されたエミッタに充放素子を介して負荷を接続し、前記
共通接続されたエミッタにコレクタが接続される前記第
1のトランジスタと同極性の第3のトランジスタのベー
スに前記第2のトランジスタのコレクタにエミッタが接
続される前記第1のトランジスタと逆極性の第4のトラ
ンジスタのコレクタを接続し、前記第1、第2、第4の
トランジスタの各々のベースを共通接続して信号源端子
に接続したことを特徴とする5EPP出力回路。
1. An emitter of a first transistor whose collector is connected to the power supply terminal and an emitter of a second transistor of the same polarity as the first transistor whose collector is connected to the power supply terminal via a resistor are commonly connected. , a load is connected to the commonly connected emitters via a charging/discharging element, and the second transistor is connected to the base of a third transistor having the same polarity as the first transistor whose collector is connected to the commonly connected emitters. The emitter of a fourth transistor is connected to the collector of the first transistor, and the collector of a fourth transistor of opposite polarity is connected to the collector of the first transistor, and the bases of each of the first, second, and fourth transistors are commonly connected to generate a signal. A 5EPP output circuit characterized by being connected to a power source terminal.
JP9342775A 1975-07-30 1975-07-30 SEPP Shutsuryoku Cairo Expired JPS5821854B2 (en)

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