JPS5822218B2 - EEG analyzer - Google Patents
EEG analyzerInfo
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- JPS5822218B2 JPS5822218B2 JP54122833A JP12283379A JPS5822218B2 JP S5822218 B2 JPS5822218 B2 JP S5822218B2 JP 54122833 A JP54122833 A JP 54122833A JP 12283379 A JP12283379 A JP 12283379A JP S5822218 B2 JPS5822218 B2 JP S5822218B2
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- Measurement And Recording Of Electrical Phenomena And Electrical Characteristics Of The Living Body (AREA)
Description
【発明の詳細な説明】
本発明は、脳波検出時において、体動発生のときは、そ
の期間だけ入力情報をキャンセルして正確なデータを得
るようにした脳波分析装置に関するものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an electroencephalogram analyzer that cancels input information for only that period when a body movement occurs during electroencephalogram detection to obtain accurate data.
脳波は、脳皮質表面や頭皮上の所定の部位に電極を取付
けて検出される自発性、律動性の電気現象で、一般にI
Hzから30Hzの周波数範囲の波である。EEG is a spontaneous, rhythmic electrical phenomenon that is detected by attaching electrodes to predetermined locations on the surface of the brain cortex or scalp, and is generally detected by I.
The waves range in frequency from Hz to 30Hz.
そしてこの脳波は、δ1波(1〜2Hz)、β2波(2
〜4Hz)、θ波(4〜8H2)、α波(8〜12.5
Hz)、β1波(12,5〜20Hz)およびβ2波(
20〜30Hz)に分類される。These brain waves consist of δ1 waves (1-2Hz) and β2 waves (2Hz).
~4Hz), theta wave (4~8H2), alpha wave (8~12.5
Hz), β1 wave (12,5-20Hz) and β2 wave (
20-30Hz).
このような各成分毎の出現時間や振巾を調べ、さらに、
出現時間と振巾との積からパワーを計算したりして、そ
のデータが医学の研究や臨床面で重要な役割を果してい
る。We investigated the appearance time and amplitude of each component, and further,
Power is calculated from the product of appearance time and amplitude, and this data plays an important role in medical research and clinical practice.
例えば、振巾が50μ■以上のδ1波が単位標本化時間
(30秒または60秒)の区間でどの程度出現したかを
検出し、この出現時間が単位標本化時間内の50%以上
の割合いとなったときは睡眠状態であると判断したり、
振巾が20μ■以上のα波が単位標本化時間の区間でど
の程度出現したかを検出し、この出現時間が単位標本化
時間の50%以上の割合いとなったときは覚醒状態であ
ると判断したりする。For example, it is possible to detect how many δ1 waves with an amplitude of 50μ or more appear in a unit sampling time (30 seconds or 60 seconds), and the proportion of this appearance time is 50% or more within the unit sampling time. When it becomes sleepy, it is determined that it is in a sleeping state,
The degree to which alpha waves with an amplitude of 20μ or more appear in a unit sampling time is detected, and when this appearance time is 50% or more of the unit sampling time, it is considered to be an awake state. to judge.
ところが、特に睡眠状態で脳波を検出する場合、寝返り
などの体動により脳波が乱され正確なデータが得られな
い。However, when detecting brain waves during sleep, the brain waves are disturbed by body movements such as turning over in bed, making it difficult to obtain accurate data.
つまり体動発生時には、振巾の大きな、周期の長く不自
然な出力波形となるが、自動的にデータを分析せしめる
ときには、脳波の成分として検出してしまうおそれがあ
る。In other words, when a body movement occurs, an unnatural output waveform with a large amplitude and a long period is produced, but when the data is automatically analyzed, there is a risk that it will be detected as a component of brain waves.
本発明は、このような点に鑑みなされたもので、体動発
生時には、単位標本化時間から体動発生時間だけ減じて
有効標本化時間を設定し、かつ生体情報も体動発生時は
キャンセルすることにより、正確なデータを得るように
したものである。The present invention was made in view of the above points, and when a body movement occurs, the effective sampling time is set by subtracting the body movement occurrence time from the unit sampling time, and the biological information is also canceled when the body movement occurs. By doing so, accurate data can be obtained.
以下、本発明の一実施例を図面について説明する。An embodiment of the present invention will be described below with reference to the drawings.
1は、基準となるクロックパルス(例えば1m5)を発
生するクロックパルス発生器、2は、ゲート回路で、通
常(体動のないとき)はインバータ3の出力で開いてク
ロックパルスをつぎのカウンタ4へ送り込む。1 is a clock pulse generator that generates a reference clock pulse (for example, 1m5); 2 is a gate circuit; normally (when there is no body movement), it is opened by the output of inverter 3 and the clock pulse is sent to the next counter 4; send to.
5は、寝返りなどの体動検出器で、この体動検出器5は
、具体的には身体に取付けられた加速度計、体動発生時
に脳波に発生する高周波成分を検出する回路あるいは肩
に取付けられた筋電図検出器などで構成される。5 is a body movement detector such as turning over in bed, and this body movement detector 5 is specifically an accelerometer attached to the body, a circuit for detecting high frequency components generated in brain waves when body movement occurs, or a body movement detector 5 attached to the shoulder. It consists of an electromyogram detector and other equipment.
そして、この体動検出器5から信号があられれるとイン
バータ3からの出力がなくなりゲート回路2が閉じられ
る。When a signal is received from this body motion detector 5, the output from the inverter 3 disappears and the gate circuit 2 is closed.
前記カウンタ4のリセット端子には、単位標本化時間毎
に出力するリセット信号回路6が接続されている。A reset signal circuit 6 that outputs an output every unit sampling time is connected to the reset terminal of the counter 4.
7は、レジスタで、直前の単位標本化時間中の有効標本
化時間が出力される。A register 7 outputs the effective sampling time during the immediately preceding unit sampling time.
8はディジタル・アナログ変換回路(以下D−A回路と
いう)である。8 is a digital-to-analog conversion circuit (hereinafter referred to as DA circuit).
つぎに、9は、脳波の原波形検出回路、10は、アナロ
グスイッチからなるキャンセル回路で、前記体動検出器
5により体動発生時は入力信号がキャンセルされる。Next, 9 is an original waveform detection circuit for brain waves, and 10 is a cancellation circuit consisting of an analog switch, and the input signal is canceled by the body movement detector 5 when a body movement occurs.
11゜〜116は、それぞれ脳波の原波形から各成分δ
1波(1〜2 Hz )、δ2波(2〜4Hz)、θ波
(4〜8 Hz )、α波(8〜12.5Hz)、β1
波(12,5〜20Hz)、およびβ2波(20〜30
Hz)を検出するための検出回路である。11° to 116 are each component δ from the original waveform of the brain wave.
1 wave (1 to 2 Hz), δ2 wave (2 to 4 Hz), θ wave (4 to 8 Hz), α wave (8 to 12.5 Hz), β1 wave
waves (12,5-20 Hz), and β2 waves (20-30
This is a detection circuit for detecting Hz).
これらの検出回路11゜〜116は、具体的には、フィ
ルタ回路の組合せによることもできるが、本出願人が既
に提案した特願昭54−59739号の周波数分析装置
を用いるとより効果的である。Specifically, these detection circuits 11° to 116 can be formed by a combination of filter circuits, but it is more effective to use the frequency analyzer of Japanese Patent Application No. 59739/1987, which was already proposed by the present applicant. be.
その基本原理は、分析すべき脳波の相隣るピーク間の時
間を順次計測し、それぞれのピーク時から周波数成分波
に相当する特定の時間ウィンドを設け、そのウィンド内
につぎのピークがきたとき、その帯域の信号と決定し、
つぎのウィンドをスタートせしめると同時に、決定され
た信号の振巾とピーク間の時間を計測するようにしたも
のである。The basic principle is to sequentially measure the time between adjacent peaks of the brain waves to be analyzed, set a specific time window corresponding to the frequency component wave from each peak time, and calculate when the next peak occurs within that window. , determine the signal in that band,
At the same time as starting the next window, the amplitude of the determined signal and the time between the peaks are measured.
そしてその回路構成は、分析すべき波形からプラスのピ
ーク位置とマイナスのピーク位置を検出するピーク位置
検出回路と、このピーク位置検出回路に接続されプラス
のピーク位置とマイナスのピーク位置に対応したプラス
のパルス列とマイナスのパルス列を得る2つのパルス整
形回路と、これらのパルス整形回路に接続され各ピーク
位置を基準とし分析すべき成分波形の周期の上限と下限
に一致したゲートタイムを設定するプラスのパルス列用
ウィンド設定回路およびマイナスのパルス列用ウィンド
設定回路と、これらのウィンド設定回路の出力と前記パ
ルス列との一致出力を得るプラスのパルス列用一致回路
およびマイナスのパルス列用一致回路と、分析すべき波
形のプラスのピーク値とマイナスのピーク値とをそれぞ
れ保持し、これらの保持したあるプラスのピーク値から
つぎのマイナスのピーク値までの差とあるマイナスのピ
ーク値からつぎのプラスのピーク値までの差とを順次求
めこれらの平均値を求める差動回路と、この差動回路お
よび前記2つの一致回路に接続され、これらの一致回路
の一致出力を基準として差動回路の出力に比例したディ
ジタル値を求めるA−D変換回路と、このA−D変換回
路に接続され前記ディジタル値を振巾として記憶する振
巾レジスタとを具備してなるものである。The circuit configuration consists of a peak position detection circuit that detects the positive peak position and negative peak position from the waveform to be analyzed, and a positive peak position that is connected to this peak position detection circuit and corresponds to the positive peak position and negative peak position. Two pulse shaping circuits are connected to these pulse shaping circuits to obtain a pulse train of A pulse train window setting circuit, a negative pulse train window setting circuit, a positive pulse train matching circuit and a negative pulse train matching circuit for obtaining a matching output between the outputs of these window setting circuits and the pulse train, and a waveform to be analyzed. Hold the positive peak value and negative peak value of , respectively, and calculate the difference from one held positive peak value to the next negative peak value and the difference from one negative peak value to the next positive peak value. a differential circuit that sequentially calculates the differences between the two and averages them, and a digital value that is connected to this differential circuit and the two matching circuits and is proportional to the output of the differential circuit with the matching outputs of these matching circuits as a reference. The device is equipped with an A/D converter circuit for determining the amplitude, and an amplitude register connected to the A/D converter circuit and storing the digital value as an amplitude.
つぎに、121〜126はゲート回路で、前記脳波検出
回路111〜116の出力により開かれている時間だけ
クロックパルス信号が通過する。Next, reference numerals 121 to 126 are gate circuits through which a clock pulse signal passes only during the time they are opened by the outputs of the electroencephalogram detection circuits 111 to 116.
13、〜136は、これらのクロックパルス信号のカウ
ンタで、前記リセット信号回路6が結合され、単位標本
化時間毎にリセットされる。13 to 136 are counters for these clock pulse signals, which are connected to the reset signal circuit 6 and reset every unit sampling time.
14.〜146はレジスタ、151〜156はディジタ
ル・アナログ変換回路(以下D−A回路という)である
。14. 146 are registers, and 151 to 156 are digital/analog conversion circuits (hereinafter referred to as DA circuits).
16は、切換回路で、前記D−A回路151〜156か
らの出力を順次出力する。Reference numeral 16 denotes a switching circuit that sequentially outputs the outputs from the DA circuits 151 to 156.
17は、演算回路で、具体的には、単位標本化時間設定
側のD−A回路8の出力に対する脳波の各成分の時間検
出側のD−A回路151〜156のそれぞれの割合い□
□□を演算する。Reference numeral 17 denotes an arithmetic circuit, specifically, the ratio of each of the DA circuits 151 to 156 on the time detection side of each component of the brain wave to the output of the DA circuit 8 on the unit sampling time setting side.
Calculate □□.
この演算回路17は、アナログ値で表示するときは、前
記レジスタ7 、14゜〜146の出力に基づいて演算
するようにしてもよい。This arithmetic circuit 17 may perform arithmetic operations based on the outputs of the registers 7 and 14° to 146 when displaying analog values.
この演算回路1Tは、具体的には、第2図のように構成
される。This arithmetic circuit 1T is specifically configured as shown in FIG.
すなわち、単位標本化時間設定側のD−A回路8の出力
端に、例えばA点(100%)、B点(50%)、C点
(20%)のように分割する抵抗18,19,20を接
続して所定のパーセンテージを段階的に設定する回路を
形成し、これらの点BとCは比較器2L22に接続し、
かつ前記切換回路16の出力端をこれらの比較回路21
,22に接続する。That is, at the output end of the D-A circuit 8 on the unit sampling time setting side, there are resistors 18, 19, which are divided into points A (100%), B (50%), and C (20%), for example. 20 are connected to form a circuit for setting a predetermined percentage in stages, these points B and C are connected to a comparator 2L22,
And the output terminal of the switching circuit 16 is connected to these comparison circuits 21.
, 22.
そしてこれらの比較回路21.22は、インバータ23
゜24.25、ナンド回路26を介して表示器27の端
子28,29,30に接続する。These comparison circuits 21 and 22 are connected to the inverter 23
24.25, connected to terminals 28, 29, and 30 of the display 27 via the NAND circuit 26.
そして、50%以上のとき端子28に、20〜50%の
とき端子29に、20%以下のとき端子30に出力があ
られれるようになっている。Then, an output is provided to a terminal 28 when the ratio is 50% or more, to a terminal 29 when the ratio is 20 to 50%, and to a terminal 30 when the ratio is 20% or less.
つぎに本発明の詳細な説明する。Next, the present invention will be explained in detail.
1mSのクロックパルス信号がゲート回路2を介してカ
ウンタ4に送られ、単位標本化時間毎にそのパルス数が
計数される。A 1 mS clock pulse signal is sent to the counter 4 via the gate circuit 2, and the number of pulses is counted every unit sampling time.
体動が発生すると、体動検出器5からの出力がインバー
タ3を介して送られ、ゲート回路2をその間だけ閉じる
。When a body movement occurs, the output from the body movement detector 5 is sent through the inverter 3, and the gate circuit 2 is closed only during that time.
カラ。ンタ4には、正確に単位標本化時間毎にリセット
信号が送られるので、カウンタ4には体動時のパルスが
除外される。Kara. Since a reset signal is sent to the counter 4 accurately every unit sampling time, pulses generated when the body moves are excluded from the counter 4.
そのため、レジスタ7には単位標本化時間から体動時間
を差引いた有効標本化時間に相当するパルス数だけが記
憶され、この出。Therefore, only the number of pulses corresponding to the effective sampling time obtained by subtracting the body movement time from the unit sampling time is stored in the register 7.
力がD−A変換されて演算回路17へ送られる。The force is DA converted and sent to the arithmetic circuit 17.
一方、脳波の原波形が検出回路9で検出され、その信号
は、キャンセル回路10に送られる。On the other hand, the original waveform of the brain wave is detected by the detection circuit 9, and the signal is sent to the cancellation circuit 10.
ここでは、体動の発生時にキャンセルされ、体動の発生
しないときだけの脳波が次段へ送られる。Here, when a body movement occurs, it is canceled and the brain waves only when no body movement occurs are sent to the next stage.
検。出回路11、〜116では、δ1.δ2.θ、α、
β1およびδ2に対応する成分の信号だけが出力され、
それぞれの対応するゲート回路12□〜126を開く。Inspection. In the output circuits 11 to 116, δ1. δ2. θ, α,
Only signals of components corresponding to β1 and δ2 are output,
Each corresponding gate circuit 12□-126 is opened.
すると、1msのクロック信号がゲート回路121〜1
26の開いているときに通過し、カラン・り13□〜1
36でそれぞれ計数される。Then, a 1ms clock signal is sent to the gate circuits 121-1.
Pass when 26 is open and click 13□~1
36 each.
これらのパルス数は、有効標本化時間分だけレジスタ1
4□〜146に記憶され、それぞれD−A回路15□〜
156でディジタル値からアナログ値に変換され、切換
回路16を介して演算回路17へ送られる。The number of these pulses is stored in register 1 for the effective sampling time.
4 □ ~ 146, respectively D-A circuit 15 □ ~
At step 156, the digital value is converted into an analog value and sent to the arithmetic circuit 17 via the switching circuit 16.
演算回路17の比較器21.22では、有効標本化時間
に対する各成分の時間の割合が順次比較される。The comparators 21 and 22 of the arithmetic circuit 17 sequentially compare the ratio of the time of each component to the effective sampling time.
そして、50〜100%のときは表示器27の端子28
に、20〜50%のときは端子29に、20%以下のと
きは端子30に信号が送られて該当するランプ等で表示
する。When the value is 50% to 100%, the terminal 28 of the display 27
When it is 20 to 50%, a signal is sent to the terminal 29, and when it is less than 20%, a signal is sent to the terminal 30, and the signal is displayed on the corresponding lamp or the like.
なお、演算回路17では、レジスタ7.14゜〜146
の出力を直接利用して、割合いをアナログ値によりメー
タで振らせたり、D−A回路8゜151〜156の出力
から具体的数字で表示したりすることもできる。Note that in the arithmetic circuit 17, registers 7.14° to 146
It is also possible to use the output directly to change the ratio using an analog value on a meter, or to display a specific number from the output of the D-A circuit 8°151-156.
さらに、睡眠防止などの特殊の目的に使用したときには
、睡眠時に発生する波形が所定以上あられれたとき警報
を発するようにすることもできる。Furthermore, when used for a special purpose such as sleep prevention, an alarm can be issued when the waveform generated during sleep exceeds a predetermined value.
前記実施例では、有効標本化時間を設定するクロック信
号と脳波の各成分毎の時間を検出するクロック信号とを
同一クロックパルス発生器1から入力せしめた。In the embodiment described above, the clock signal for setting the effective sampling time and the clock signal for detecting the time of each component of the brain wave are inputted from the same clock pulse generator 1.
しかし、有効標本化時間の単位は30秒とか60秒であ
るから充分低い周波数のクロック信号を用い、また、脳
波の各成分毎の時間は、高い周波数のり田ツク信号を用
いるようにしてもよい。However, since the unit of effective sampling time is 30 seconds or 60 seconds, a clock signal with a sufficiently low frequency may be used, and the time for each component of the brain wave may be determined by using a high frequency Noritak signal. .
本発明は、上述のように構成したので、脳波の各成分の
割合いが正しく検出でき、脳波分析装置として極めて有
益である。Since the present invention is configured as described above, the ratio of each component of an electroencephalogram can be detected correctly, and it is extremely useful as an electroencephalogram analyzer.
また、正確な数値まで要しないときには、段階的割合い
の設定回路と検出出力とを比較器で比較表示できるなど
すぐれた効果を発揮するものである。In addition, when exact numerical values are not required, the stepwise ratio setting circuit and the detection output can be compared and displayed using a comparator, which provides an excellent effect.
第1図は本発明による脳波分析装置の一実施例を示すブ
ロック図、第2図は、第1図における演算回路の詳細な
ブロック図である。
1・・・・・・クロックパルス発生器、2,121〜1
26・・・・・・ゲート回路、3,23,24,25・
・・・・・インバータ、4,13.〜136・・・・・
・カウンタ、5・・・・・・体動検出器、6・・・・・
・リセット信号回路、7゜14、〜146・・・・・・
レジスタ、8,15□〜156・・・・・・D−A回路
、9・・・・・・脳波検出回路、10・・・・・・キャ
ンセル回路、111〜116・・・・・・脳波の各成分
の検出回路、16・・・・・・切換回路、17・・・・
・・演算回路、18.19,20・・・・・・抵抗、2
L22・・・・・・比較器、26・・・・・・ナンド回
路、27・・・・・・表示器、28゜29.30・・・
・・・端子。FIG. 1 is a block diagram showing an embodiment of an electroencephalogram analysis device according to the present invention, and FIG. 2 is a detailed block diagram of the arithmetic circuit in FIG. 1. 1...Clock pulse generator, 2,121~1
26...Gate circuit, 3, 23, 24, 25...
...Inverter, 4,13. ~136...
・Counter, 5...Body movement detector, 6...
・Reset signal circuit, 7°14, ~146...
Register, 8, 15□~156...D-A circuit, 9...Brain wave detection circuit, 10...Cancel circuit, 111-116...Brain wave detection circuit for each component, 16... switching circuit, 17...
...Arithmetic circuit, 18.19,20...Resistance, 2
L22... Comparator, 26... NAND circuit, 27... Display, 28°29.30...
...Terminal.
Claims (1)
検出する体動検出器と、この体動検出器の体動のないと
きの出力により開放され単位標本化時間設定用クロック
信号を通過せしめるゲート回路と、このゲート回路を通
過したり田ンク信号数をリセット信号回路による単位標
本化時間毎に計数して有効標本化時間を設定するカウン
タと、前記被検者に装着され被検者の脳波の原波形を検
出する脳波検出回路と、前記体動検出器により開閉制御
され前記脳波検出回路の脳波情報の通過を体動のある時
間だけキャンセルするキャンセル回路と、このキャンセ
ル回路を通過した脳波の原波形から周波数によって分類
された各成分毎の脳波を検出する検出回路と、この検出
回路により開閉制御され各成分毎の脳波の検出時間中に
脳波検出時間設定用クロック信号を通過せしめるゲート
回路と、このゲート回路を通過した各成分毎のクロック
信号数をリセット信号回路による単位標本化時間毎に計
数して各成分波時間を検出するカウンタと、前記単位標
本化時間設定用カウンタで設定された有効標本化時間に
対する前記各成分波時間検出用カウンタの各成分波検出
時間の割合いを演算する演算回路とを具備してなること
を特徴とする脳波分析装置。 2 脳波の原波形から周波数によって分類された各成分
毎の脳波を検出する回路は、脳波中のδ1波、β2波、
θ波、α波、β1波、β2波をそれぞれ検出する回路か
らなり、これらの検出回路にそれぞれ個々にゲート回路
を結合してなる特許請求の範囲第1項記載の脳波分析装
置。 3 演算回路は、有効標本化時間を100%として所定
のパーセンテージを段階的に設定する回路と、これらの
段階的設定回路の出力と、脳波の各成分毎の検出時間に
対応するクロック信号数に応じた出力とを比較する比較
器とからなる特許請求の範囲第1項記載の脳波分析装置
。[Scope of Claims] 1. A body motion detector that is attached to a subject and detects body movements such as turning over of the subject, and a unit sample that is opened by the output of this body motion detector when there is no body movement. a gate circuit for passing a clock signal for setting the switching time; a counter for setting the effective sampling time by counting the number of clock signals passing through the gate circuit or for each unit sampling time by the reset signal circuit; an electroencephalogram detection circuit that is worn by the examiner and detects the original waveform of the subject's brain waves; and a cancellation circuit that is controlled to open and close by the body movement detector and cancels passage of the electroencephalogram information from the electroencephalogram detection circuit only during a period of body movement. , a detection circuit that detects brain waves for each component classified by frequency from the original waveform of the brain waves that have passed through this cancellation circuit, and a detection circuit that is opened and closed by this detection circuit to determine the brain wave detection time during the detection time of the brain waves for each component. a gate circuit that allows a setting clock signal to pass; a counter that detects the wave time of each component by counting the number of clock signals for each component that has passed through the gate circuit for each unit sampling time by a reset signal circuit; An electroencephalogram analysis characterized by comprising: an arithmetic circuit that calculates the ratio of each component wave detection time of the component wave time detection counter to the effective sampling time set by the sampling time setting counter. Device. 2 The circuit that detects each component of the brain waves classified by frequency from the original brain wave waveform detects the δ1 wave, β2 wave,
2. The electroencephalogram analyzer according to claim 1, comprising circuits for detecting θ waves, α waves, β1 waves, and β2 waves, respectively, and gate circuits are individually coupled to these detection circuits. 3 The arithmetic circuit includes a circuit that sets a predetermined percentage in stages with the effective sampling time as 100%, the outputs of these stepwise setting circuits, and the number of clock signals corresponding to the detection time of each component of the brain wave. 2. The electroencephalogram analysis device according to claim 1, further comprising a comparator for comparing corresponding outputs.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP54122833A JPS5822218B2 (en) | 1979-09-25 | 1979-09-25 | EEG analyzer |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP54122833A JPS5822218B2 (en) | 1979-09-25 | 1979-09-25 | EEG analyzer |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5645636A JPS5645636A (en) | 1981-04-25 |
| JPS5822218B2 true JPS5822218B2 (en) | 1983-05-07 |
Family
ID=14845759
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP54122833A Expired JPS5822218B2 (en) | 1979-09-25 | 1979-09-25 | EEG analyzer |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5822218B2 (en) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01146633A (en) * | 1987-12-02 | 1989-06-08 | Hitachi Seiki Co Ltd | Workpiece mounting jig |
| US20200246900A1 (en) * | 2019-02-05 | 2020-08-06 | Huys Industries Limited | Welding applicator and method of application |
-
1979
- 1979-09-25 JP JP54122833A patent/JPS5822218B2/en not_active Expired
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01146633A (en) * | 1987-12-02 | 1989-06-08 | Hitachi Seiki Co Ltd | Workpiece mounting jig |
| US20200246900A1 (en) * | 2019-02-05 | 2020-08-06 | Huys Industries Limited | Welding applicator and method of application |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5645636A (en) | 1981-04-25 |
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