JPS5826689B2 - Chu-na-souchi - Google Patents
Chu-na-souchiInfo
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- JPS5826689B2 JPS5826689B2 JP50098885A JP9888575A JPS5826689B2 JP S5826689 B2 JPS5826689 B2 JP S5826689B2 JP 50098885 A JP50098885 A JP 50098885A JP 9888575 A JP9888575 A JP 9888575A JP S5826689 B2 JPS5826689 B2 JP S5826689B2
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Description
【発明の詳細な説明】
本発明は高周波受信機のチューナ装置に関するものであ
り、同調確度を増し、多チヤネル受信を可能にすること
を目的とする。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a tuner device for a high frequency receiver, and aims to increase tuning accuracy and enable multi-channel reception.
従来のチューナの同調方式としては大別して連続可変リ
アクタンス素子で同調する方式と、一定の値を持つリア
クタンス素子を順次切換えて同調する方式との二種類が
ある。Conventional tuner tuning methods can be roughly divided into two types: a method in which tuning is performed using a continuously variable reactance element, and a method in which tuning is performed by sequentially switching reactance elements having a constant value.
前者はりアクタンス素子の変化特性のばらつきが大きな
欠点であってたとえばバリコンを使用した場合はロータ
部の間隔を微調して補正し、可変容量ダイオードを使用
する場合は選別によって特性を揃える必要があり同調周
波数の確度が低いという欠点がある。The major drawback of the former is the variation in the change characteristics of the actance element. For example, if a variable capacitor is used, it must be corrected by finely adjusting the spacing of the rotor section, and if a variable capacitance diode is used, the characteristics must be matched by selection and tuning. The disadvantage is that the frequency accuracy is low.
後者は、一定の値を持つリアクタンス素子が受信チャネ
ル数だけ必要であるため配線あるいは組立てが複雑にな
り多チヤネル受信には適さないという欠点がある。The latter has the disadvantage that it requires as many reactance elements with a fixed value as the number of reception channels, which complicates wiring and assembly, making it unsuitable for multi-channel reception.
第1図はコイルを電子的に切換えて同調周波数を変化さ
せた同調回路の従来例である。FIG. 1 shows a conventional example of a tuning circuit in which the tuning frequency is changed by electronically switching a coil.
DB t D2 t D3 t D4 p D5はスイ
ッチングダイオード、C2t C3y C4t C5t
C6はバイパスコンデンサ、R1,R2,R3,R4
,R5は電流制限及び高周波信号阻止用抵抗、C1は直
流阻止用コンデンサ、C7は共振用コンデンサ、Elは
スイッチング用電源、SWlは共振周波数切換スイッチ
である。DB t D2 t D3 t D4 p D5 is a switching diode, C2t C3y C4t C5t
C6 is a bypass capacitor, R1, R2, R3, R4
, R5 are current limiting and high frequency signal blocking resistors, C1 is a direct current blocking capacitor, C7 is a resonant capacitor, El is a switching power supply, and SWl is a resonant frequency changeover switch.
端子1と2の間で並列共振回路が形成されるが、切換ス
イッチSW1の切換位置に応じてダイオードD1〜D5
のいずれかが導通し、たとえば第1図の状態ではコイル
L6はショートされてコイルL1〜L5が直列接続され
たインダクタンスと、C7の容量とで共振周波数が決ま
る。A parallel resonant circuit is formed between terminals 1 and 2, and diodes D1 to D5 are connected depending on the switching position of changeover switch SW1.
For example, in the state shown in FIG. 1, the coil L6 is short-circuited, and the resonant frequency is determined by the inductance of the series-connected coils L1 to L5 and the capacitance of C7.
第1図では6通りの共振周波数を選択できるが、この切
換周波数はテレビジョン放送受信の場合は12通り必要
で、ケーブルテレビジョンチャネルの増加を考慮すると
全部で28通り必要である。In FIG. 1, 6 types of resonant frequencies can be selected, but 12 types of switching frequencies are required in the case of television broadcast reception, and 28 types in total are required when considering the increase in cable television channels.
従って第1図と同様な回路構成を行なうと、スイッチン
グダイオードは27ケ、コイルは28ケ必要である。Therefore, if the circuit configuration is similar to that shown in FIG. 1, 27 switching diodes and 28 coils are required.
またチャネル切換スイッチから共振回路への配線は28
本必要となり、調整組立てが困難になる。Also, the wiring from the channel selection switch to the resonant circuit is 28
This makes adjustment and assembly difficult.
特にコイル素子部分は大きな容積を占めるので小型化が
困難である。In particular, the coil element portion occupies a large volume, making it difficult to downsize it.
本発明は以上説明した従来例の欠点を解消すべく第1図
のコイルの代りにコンデンサを用いて共板胴波数を切換
えるもので、コンデンサは集積回路への組込みが容易で
小型化が可能となる。In order to eliminate the drawbacks of the conventional example described above, the present invention uses a capacitor instead of the coil shown in Fig. 1 to switch the common plate body wave number.The capacitor can be easily incorporated into an integrated circuit and can be miniaturized. Become.
以下本発明の実施例について説明する。Examples of the present invention will be described below.
第2図はコンデンサ切換え式とした場合の基本的な構成
例である。FIG. 2 shows a basic configuration example of a capacitor switching type.
第2図に示すように共振用コンデンサ3,4゜5.6,
7,8とスイッチングダイオード10゜11.12,1
3,14,15との複数個の直列回路がそれぞれ並列接
続され、この並列回路にさらに共振用コイル9が並列接
続されて端子30゜31間に並列共振回路が形成されて
いる。As shown in Fig. 2, the resonance capacitor 3,4゜5.6,
7, 8 and switching diode 10゜11.12,1
A plurality of series circuits 3, 14, and 15 are connected in parallel, and a resonant coil 9 is further connected in parallel to the parallel circuits to form a parallel resonant circuit between the terminals 30 and 31.
コンデンサ3,4,5,6,7,8とスイッチングダイ
オード10,11.12,13,14,15とのそれぞ
れの接続点は電流制限および高周波信号阻止用の抵抗1
6,17,18,19,20,21およびバイパスコン
デンサ22,23,24゜25.26,27を介して切
替スイッチ28の各固定接点に接続されている。Each connection point between the capacitors 3, 4, 5, 6, 7, 8 and the switching diodes 10, 11, 12, 13, 14, 15 is connected to a resistor 1 for current limiting and high frequency signal blocking.
6, 17, 18, 19, 20, 21 and bypass capacitors 22, 23, 24, 25, 26, 27 to each fixed contact of the changeover switch 28.
この切替スイッチ2Bの可動接点は直流電源29の一端
に接続されている。A movable contact of this changeover switch 2B is connected to one end of a DC power supply 29.
この直流電源の他端はダイオード10〜15の一端に接
続されている。The other end of this DC power supply is connected to one end of diodes 10-15.
第2図に示される位置に切替スイッチ28があるときス
イッチングダイオード10のみが導通し、コイル9とコ
ンデンサ3で共振回路が形成される。When the changeover switch 28 is in the position shown in FIG. 2, only the switching diode 10 is conductive, and the coil 9 and capacitor 3 form a resonant circuit.
このような構成では第1図の場合と異なり、コイルは1
個で良いのでコンデンサを多く必要としても、集積回路
技術によりハイブリッド型またはモノリシック型集積コ
ンデンサとして小型にまとめることが可能になる。In this configuration, unlike the case shown in Fig. 1, the coil is 1
Even if a large number of capacitors are required, integrated circuit technology makes it possible to combine them into compact hybrid or monolithic integrated capacitors.
コンデンサ3〜8、ダイオード10〜15および抵抗1
6〜20のブロックは第3図のように集積回路化するこ
とができる。Capacitors 3-8, diodes 10-15 and resistors 1
Blocks 6 to 20 can be integrated into an integrated circuit as shown in FIG.
この集積回路は第4図に示すコンデンサ1個と抵抗1個
とダイオード(トランジスタのベースコレクタを短絡し
てダイオード使用したもの)1個による回路として示し
てあり、これらを複数個同一基板上に作ればよい、第3
図に示すようにシリコンP型基板32上にN型シリコン
のエピタキシャル薄膜33゜34.35を一様に成長さ
せ、その上に部分的にアクセプタ(たとえばほう素)を
拡散して分離拡散を作る通常のモノリシックトランジス
タ作成のプロセスと同様のものである。This integrated circuit is shown in Figure 4 as a circuit consisting of one capacitor, one resistor, and one diode (a diode is used by shorting the base collector of a transistor), and multiple of these can be made on the same substrate. Goodbye, third
As shown in the figure, an N-type silicon epitaxial thin film 33° 34.35 is uniformly grown on a silicon P-type substrate 32, and an acceptor (for example, boron) is partially diffused thereon to create separation diffusion. The process is similar to the process of creating a normal monolithic transistor.
36はベース拡散による抵抗を示し、第4図の抵抗に相
当する。Reference numeral 36 indicates a resistance due to base diffusion, which corresponds to the resistance in FIG.
34.37.38によって第4図に示すトランジスタが
構成され、ベースコレクタが誘電体39によって短絡さ
れている。34, 37, and 38 constitute the transistor shown in FIG.
40は5i02による誘電体層であり、不純物濃度の高
いN+領域41および薄膜35とで第4図に示すコンデ
ンサが形成されている。40 is a dielectric layer made of 5i02, and the N+ region 41 with a high impurity concentration and the thin film 35 form the capacitor shown in FIG.
a、b、cは第3図、第4図に付した端子である。Terminals a, b, and c are shown in FIGS. 3 and 4.
第2図の場合にはコンデンサ3〜8の各々の値が受信チ
ャネルに対応している場合であり、切替スイッチ28で
コンデンサ3〜8のうちの1つが選択されて使用される
ものである。In the case of FIG. 2, each value of capacitors 3 to 8 corresponds to a receiving channel, and one of capacitors 3 to 8 is selected and used by changeover switch 28.
ところが、このような手段では受信チャネルが多い場合
、コンデンサの数も多くなる。However, with such means, if there are many reception channels, the number of capacitors will also increase.
そこで、本発明では第5図に示すように3個のコンデン
サ42.43゜44と3個のスイッチングダイオード4
5,46゜47および3個の抵抗4B、49.50でコ
ンデンサブロックを構成し、エンコーダ51の8つの入
力端子に入る指定信号によってダイオード45゜46.
47の導通の組合せを8通りにして容量値を8通りに切
替える。Therefore, in the present invention, three capacitors 42.43°44 and three switching diodes 4 are used as shown in FIG.
5, 46° 47 and three resistors 4B, 49.50 constitute a capacitor block, and the specified signals input to the eight input terminals of the encoder 51 cause the diodes 45° 46.
The 47 conduction combinations are made into 8 ways, and the capacitance value is switched into 8 ways.
このようにN通りの容量値を得るにはN個のコンデンサ
ではなく、”hN個のコンデンサスイッチングダイオー
ドを用いれば良い。In this way, in order to obtain N different capacitance values, it is sufficient to use hN capacitor switching diodes instead of N capacitors.
すなわち、N=128の場合倹2128=7で7個のコ
ンデンサで128通りの容量を得ることができる。That is, in the case of N=128, 128 capacitances can be obtained with 7 capacitors since 2128=7.
ただし、必要な容量値は必ずしも二進化容量で効率的に
近似されるとは限らないので、たとえばテレビ受信のよ
うにVIF帯の高・低バンドなど受信帯域が離れている
場合は帯域毎に二進化容量で近似する方が良い場合もあ
る。However, the required capacity value cannot necessarily be efficiently approximated by binary capacity, so if the receiving bands are far apart, such as the high and low bands of the VIF band, as in TV reception, the In some cases, it is better to approximate by evolutionary capacity.
二進化容量の最小容量単位は必要とされる各容量値の最
大公約数で決まる。The minimum capacity unit of the binary capacity is determined by the greatest common divisor of each required capacity value.
この場合、小容量値が必要とされる場合があるが、実現
できる最小容量値は単独のコンデンサで1pF程度であ
るから、下位桁については最大公約数の整数倍の値の容
量を直列接続するか自動周波数制御回路によってカバー
することが実用的である。In this case, a small capacitance value may be required, but the minimum capacitance value that can be achieved is about 1 pF with a single capacitor, so for the lower digits, capacitors with a value that is an integer multiple of the greatest common divisor are connected in series. or it is practical to cover it by an automatic frequency control circuit.
第6図に示すものは第5図に示す3個のコンデンサ42
,43,44、ダイオード45,46゜47、抵抗48
,49,50を内蔵したコンデンサブロックを用いたチ
ューナ装置であり、以下この実施例について説明する。What is shown in FIG. 6 is the three capacitors 42 shown in FIG.
, 43, 44, diode 45, 46° 47, resistor 48
, 49, 50, and this embodiment will be described below.
第6図において、52a、52bはアンテナ入力端子で
あり、直列接続された入力同調コイル53.54の接続
点に端子52aが接続されている。In FIG. 6, 52a and 52b are antenna input terminals, and the terminal 52a is connected to the connection point of input tuning coils 53 and 54 connected in series.
この入力同調コイル53,54と並列にコンデンサブロ
ック55が接続されている。A capacitor block 55 is connected in parallel with the input tuning coils 53 and 54.
56はこのコンデンサブロックが接続された高周波増幅
回路である。56 is a high frequency amplifier circuit to which this capacitor block is connected.
57は段間同調コイルであり、55と同様のコンデンサ
ブロック58.59が接続されている。57 is an interstage tuning coil, to which capacitor blocks 58 and 59 similar to 55 are connected.
60はコンデンサブロック59が接続された混合回路お
よび中間周波増幅回路、61は局部発振回路、62はこ
の発振回路61の発振同調コイル、63はコンデンサブ
ロックである。60 is a mixing circuit and intermediate frequency amplification circuit to which a capacitor block 59 is connected, 61 is a local oscillation circuit, 62 is an oscillation tuning coil of this oscillation circuit 61, and 63 is a capacitor block.
64.65は中間周波出力同調コイル、66a、66b
は出力端子である。64.65 are intermediate frequency output tuning coils, 66a, 66b
is the output terminal.
各コンデンサブロック55,58,59,63の各3本
の入力端子はそれぞれ対応する端子を共通に接続し、3
本の端子として外部に導びいている。Each of the three input terminals of each capacitor block 55, 58, 59, 63 has its corresponding terminal connected in common.
It is led to the outside as a book terminal.
コンデンサブロック55.5B、59.63は1個の集
積回路素子67として作られ、各コンデンサブロック5
5.5B、59.63を結ぶ線も集積回路中に設けられ
るので多くのリード線が外部に露出することはない。Capacitor blocks 55.5B, 59.63 are made as one integrated circuit element 67, and each capacitor block 5
Since the wire connecting 5.5B and 59.63 is also provided in the integrated circuit, many lead wires are not exposed to the outside.
上記コンデンサブロック55.58.59.63を制御
するために第5図の51に相当する1個のエンコーダ6
8が集積回路素子67とは独立して設けられており、こ
のエンコーダ68の3つの出力端子が集積回路素子67
に設けられた3つの入力端子に接続され、エンコーダ6
8の8つの入力端子は切替スイッチ69の各固定接点に
接続されている。One encoder 6 corresponding to 51 in FIG. 5 to control the capacitor blocks 55, 58, 59, 63.
8 is provided independently from the integrated circuit element 67, and the three output terminals of this encoder 68 are connected to the integrated circuit element 67.
is connected to the three input terminals provided on the encoder 6.
The eight input terminals of 8 are connected to each fixed contact of the changeover switch 69.
この切替スイッチ69の可動端子は直流電源70に接続
されている。A movable terminal of this changeover switch 69 is connected to a DC power supply 70.
エンコーダ68は8進・2進変換を行ない8チヤンネル
の切換えに対し3ビツトの出力が得られるようになって
いる。The encoder 68 performs octal/binary conversion so that a 3-bit output can be obtained for switching between 8 channels.
切替スイッチ69を切替えて希望するチャンネルに設定
すると、エンコーダ68から2進信号が発生し、各コン
デンサブロック55.5B、59゜63のスイッチング
ダイオードのオンオフを制御して必要数のコンデンサを
使用し、希望するチャンネルを選局することができる。When the selector switch 69 is switched to set the desired channel, a binary signal is generated from the encoder 68, which controls the on/off of the switching diodes of each capacitor block 55.5B and 59°63 to use the required number of capacitors. You can select the desired channel.
上記実施例ではコンデンサブロック内のコンデンサを並
列接続したが、直列接続にして、不要なコンデンサをダ
イオードで短絡してもよく、またコンデンサの直並列回
路とダイオードとを組合せて可変容量範囲を拡大するこ
ともできる。In the above embodiment, the capacitors in the capacitor block are connected in parallel, but they may be connected in series and unnecessary capacitors may be shorted with diodes. Alternatively, the range of variable capacitance may be expanded by combining a series-parallel circuit of capacitors with a diode. You can also do that.
以上のように本発明は複数のコンデンサとこれらのコン
デンサの1つまたは任意の複数個を組合せて使用できる
ように上記コンデンサに接続された複数のダイオードを
含む複数の入力端よりなるコンデンサブロックを複数個
並列接続するとともに、これらの接続点を集積回路の入
力端子とするコンデンサブロック複数組1個の集積回路
素子を設け、上記集積回路素子の入力端子を制御し、上
記複数のコンデンサブロックを同時に制御するエンコー
ダを上記集積回路素子とは独立して設けたチューナ装置
であり、同調素子の1つであるコンデンサを多数設けて
これを切替えるようにし、しかもコンデンサを複数個組
合せて使用できるようにしたのでコンデンサの数は少な
くてすみ、集積回路化できるので装置はきわめて小型化
することができる。As described above, the present invention includes a plurality of capacitor blocks each having a plurality of input terminals including a plurality of capacitors and a plurality of diodes connected to the capacitors so that one or any plurality of these capacitors can be used in combination. A plurality of capacitor blocks are connected in parallel, and one integrated circuit element is provided in a plurality of sets of capacitor blocks whose connection points are used as input terminals of the integrated circuit, and the input terminals of the integrated circuit elements are controlled, and the plurality of capacitor blocks are simultaneously controlled. This is a tuner device in which an encoder is provided independently from the integrated circuit element, and a large number of capacitors, which are one of the tuning elements, are provided so that they can be switched, and moreover, a plurality of capacitors can be used in combination. Since the number of capacitors is small and can be integrated into an integrated circuit, the device can be made extremely compact.
そして、外部に独立して設けたエンコーダで制御できる
ようにしたので集積回路の入力端子も少なくてすむもの
である。Furthermore, since it is possible to control with an encoder independently provided outside, the number of input terminals of the integrated circuit can be reduced.
さらに可変容量ダイオードを用いていないので選局の精
度も良いものである。Furthermore, since no variable capacitance diode is used, the accuracy of channel selection is also good.
第1図は従来のチューナの回路図、第2図は本発明に先
き立ち考えられたチューナ装置の基本回路の回路図、第
3図は同チューナ装置に使用される集積回路素子の要部
の断面図、第4図は第3図の素子の回路図、第5図は本
発明の一実施例におけるチューナ装置の基本回路の回路
図、第6図は同チューナ装置の回路図である。
42.43,44・・・・・・コンデンサ、45,46
゜47・・・・・・ダイオード、4B、49,50・・
・・・・抵抗、51.68・・・・・・エンコーダ、5
5,58,59゜63・・・・・・コンデンサブロック
、69・・・・・・切替スイッチ、67・・・・・・集
積回路素子。Fig. 1 is a circuit diagram of a conventional tuner, Fig. 2 is a circuit diagram of a basic circuit of a tuner device devised prior to the present invention, and Fig. 3 is a main part of an integrated circuit element used in the tuner device. 4 is a circuit diagram of the element shown in FIG. 3, FIG. 5 is a circuit diagram of a basic circuit of a tuner device according to an embodiment of the present invention, and FIG. 6 is a circuit diagram of the same tuner device. 42.43,44... Capacitor, 45,46
゜47...Diode, 4B, 49,50...
...Resistance, 51.68 ...Encoder, 5
5, 58, 59° 63... Capacitor block, 69... Changeover switch, 67... Integrated circuit element.
Claims (1)
は任意の複数個を組合せて使用できるように上記コンデ
ンサに接続された複数のダイオードを含む複数の入力端
よりなるコンデンサブロックを複数個並列接続するとと
もに、これらの接続点を集積回路の入力端子とするコン
デンサブロック複数組1個の集積回路素子を設け、上記
集積回路素子の入力端子を制御し、上記複数のコンデン
サブロックを同時に制御するエンコーダを上記集積回路
素子とは独立して設けたことを特徴とするチューナ装置
。1. A plurality of capacitor blocks each having a plurality of input terminals including a plurality of capacitors and a plurality of diodes connected to the capacitors are connected in parallel so that one or any plurality of these capacitors can be used in combination, A plurality of sets of capacitor blocks with one integrated circuit element having these connection points as input terminals of the integrated circuit are provided, and an encoder that controls the input terminal of the integrated circuit element and controls the plurality of capacitor blocks simultaneously is connected to the integrated circuit. A tuner device characterized in that it is provided independently of an element.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP50098885A JPS5826689B2 (en) | 1975-08-13 | 1975-08-13 | Chu-na-souchi |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP50098885A JPS5826689B2 (en) | 1975-08-13 | 1975-08-13 | Chu-na-souchi |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5222401A JPS5222401A (en) | 1977-02-19 |
| JPS5826689B2 true JPS5826689B2 (en) | 1983-06-04 |
Family
ID=14231588
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP50098885A Expired JPS5826689B2 (en) | 1975-08-13 | 1975-08-13 | Chu-na-souchi |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5826689B2 (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01128455U (en) * | 1988-01-26 | 1989-09-01 |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5491085A (en) * | 1977-12-28 | 1979-07-19 | Nec Corp | Semiconductor device |
| JPS58196714A (en) * | 1982-05-13 | 1983-11-16 | Oki Electric Ind Co Ltd | Tuning circuit |
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1975
- 1975-08-13 JP JP50098885A patent/JPS5826689B2/en not_active Expired
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Also Published As
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|---|---|
| JPS5222401A (en) | 1977-02-19 |
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