JPS5911266B2 - インバ−タ装置 - Google Patents
インバ−タ装置Info
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- JPS5911266B2 JPS5911266B2 JP52081457A JP8145777A JPS5911266B2 JP S5911266 B2 JPS5911266 B2 JP S5911266B2 JP 52081457 A JP52081457 A JP 52081457A JP 8145777 A JP8145777 A JP 8145777A JP S5911266 B2 JPS5911266 B2 JP S5911266B2
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- Japan
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- current
- control
- commutation
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Description
【発明の詳細な説明】
３５この発明はインバータ装置、特にトランジスタを用
いた並列インバータに関する。
いた並列インバータに関する。
従来、たとえば擬似正弦波出力インバータとしては、直
流電源により駆動される交流負荷を４個のオンオフ可能
なスイツチ素子にて制御する、いわゆるブリツヂ接続イ
ンバータが一般的である。
流電源により駆動される交流負荷を４個のオンオフ可能
なスイツチ素子にて制御する、いわゆるブリツヂ接続イ
ンバータが一般的である。
２個のスイツチ素子によつて制御する並列形インバータ
も公知であるが、この従米の並列形インバータは半サイ
タル中に一方のスイツチ素子をオンオフする場合、その
素子のオフ期間中の負荷電流を転流する期間には出力用
トランス、または負荷に逆篭圧を発生し、その結果正弦
波インバータとしてフイルタを用いて波形整形する場合
などではブリツヂ接続方式に比べてフイルタが大きくな
り、またスイツチ素子に流れる実効電流が増加するとい
う欠点があつた。
も公知であるが、この従米の並列形インバータは半サイ
タル中に一方のスイツチ素子をオンオフする場合、その
素子のオフ期間中の負荷電流を転流する期間には出力用
トランス、または負荷に逆篭圧を発生し、その結果正弦
波インバータとしてフイルタを用いて波形整形する場合
などではブリツヂ接続方式に比べてフイルタが大きくな
り、またスイツチ素子に流れる実効電流が増加するとい
う欠点があつた。
この発明は、このような点に鑑みてなされたものであつ
て、実際にオンオフ制御するスイツチ素子の使用を少く
すると共にフイルタの容量を極力小さくし、さらに電力
消費を軽減したインバータ装置を提供するものである。
て、実際にオンオフ制御するスイツチ素子の使用を少く
すると共にフイルタの容量を極力小さくし、さらに電力
消費を軽減したインバータ装置を提供するものである。
以下、この発明の一実施例を第１図ないし第３図に基づ
いて詳しく説明する。
いて詳しく説明する。
第１図はこの発明の一実施例を示すものである。
第１図において、ＴＲは出力トランスであつて、出力巻
線ＴＮＯ、励振用一次巻線ＴＮｌｌ，ＴＮｌ２および転
流電流通流用二次巻線ＴＮ２ｌ，ＴＮ２２を備えている
。ＣＴは変流器であつて、一次巻線Ｎｌｌ，Ｎｌ２と二
次巻線Ｎ２ｌ，Ｎ２２を有し、一次巻線Ｎｌｌ，Ｎｌ２
は制御整流素子例えばサイリスタＣＲｌ，ＣＲ２にそれ
ぞれ接続され、二次巻線Ｎ２ｌ，Ｎ２２は共にスイツチ
素子例えばトランジスタＱにベース電流を供給しうるよ
うに構成される。Ｄ１〜Ｄ４は整流素子例えばダイオー
ド、ＣＲ３，ＣＲ４はオンオフ用の制御整流素子例えば
サイリスタ、Ｒ１〜Ｒ４は抵抗器であつて、これらの回
路素子は負荷電流を検知のために設けられている。ＶＭ
は直流電源、ＧＣＵはゲート制御装置、Ｚはインバータ
の負荷、ＦＬｌ，ＦＬ２はリアクトル、Ｃはコンデンサ
であつて、これらＦＬｌ，ＦＬ２およびＣでフイルタを
構成する。次に、この発明に係るインバータ装置の動作
を、第２図の信号波形と共に説明する。いま、第２図に
示す時刻Ｔ。以前に負荷およびフイルタに電流が減衰し
て流れ、時刻Ｔ。ではぼ零になつていたとする。時刻Ｔ
。においてゲート制御装置ＧＣＵからサイリスタＣＲｌ
にゲート信号を与えるとともにトランジスタＱにトリガ
パルスを与えたとすると、ＱｓＣＲｌはオンし、ＶＭ−
ＴＮｌｌ（ＴＲ）ＣＲｌ−Ｎｌｌ（ＣＴ）−Ｑ−ＶＭな
る経路の負荷１駆動電流が流ηる。このとき、変流器Ｃ
Ｔの一次巻線Ｎｌｌに流れる電流は変流器ＣＴの二次巻
線Ｎ２ｌに誘導電流を発生し、この電流はＮ２ｌ一Ｑベ
ース−Ｑエミツタ一Ｒ１−Ｄ３−Ｎ２ｌなる経路をとり
、トランジスタＱのベース電流となる。このベース電流
は変流器ＣＴの一次巻線Ｎｌｌを流れる電流の増加、減
少に比例して増大または減少するものであつて、つまり
トランジスタＱにとつてはコレクタ電流の多少に応じて
ベース電流が増減し、抵抗器で単にベース電流を定電流
的に与えるものに比べて、電力消費が節減される。出力
トランスＴＲの一次巻線ＴＮｌｌには直流電源ＶＭから
サイリスタＣＲｌ．トランジスタＱなどの電圧降下を差
引いた電圧が印加され、その出力巻線ＴＮＯには第２図
ａに示すような電圧Ｖ。が発生し、もつてフイルタおよ
び負荷に第２図ｂに示すような電流１。を供給しはじめ
る。この電流１。が適当な値まで増加した時刻ｔ１にト
ランジスタＱをしや断するにはサイリスタＣＲ４にゲー
ト信号を与えて点弧させる。上記電流１。が適当な値で
あるかどうかは抵抗器Ｒ１の電圧降下により知ることが
できる。つまり、トランジスタＱのコレクタ電流すなわ
ち負荷駆動電流に比例する電流が変流器ＣＴの二次側を
流れ、この電流が抵抗器Ｒ１で第２図ｄに示すような電
圧ＶＲｌを生ずる。トランジスタＱのオン中に変流器Ｃ
Ｔの二次巻線Ｎ２ｌに発生していた第２図ｃに示すよう
な電圧ＶＮ２ｌは、別の二次巻線Ｎ２２にも第１図に示
すような極性の電圧ＶＮ２２を発生しており、ゲート制
御装置ＧＣＵによるサイリスタＣＲ４の点弧によつて二
次巻線Ｎ２２の正極側か接地される結果、トランジスタ
Ｑのベース電位は低電位となり、もつてトランジスタＱ
がしや断される。この作用を、さらに確実に行うには、
第１図に点線で示すコンデノサＣＸ２（ＣＸｌも同様の
目的である）をそう入しておくと、このコンデンサＣＸ
２には第１図に示すような極性の電圧が誘導し、この電
圧がサイリスタＣＲ４のオンによつて、トランジスタＱ
のベースに逆電圧を与えることとなり、トランジスタＱ
はしや断される。ｌ・ランジスタＱがしや断されると誘
導性負荷の，駆動電流は、出力トランスＴＲの一次巻線
ＴＮｌｌを流れていたものが、一次巻線ＴＮｌ２および
二次巻線ＴＮ２２の側へダイオードＤ２を介して転流す
る転流電流となる。つまりこの転流電流は出力側の電流
１。がその負荷側のインダクタンス分のため出力巻線Ｔ
ＮＯを流れつづけることにより誘起されるものであるが
一次側ではＭ−Ｒ４−Ｄ２−ＴＮ２２−ＴＮｌ２−ＶＭ
なる経路をとる。この結果直流電源ＶＭの出力電圧にほ
ぼ等しい電圧がＴＮ２２＋ＴＮｌ２巻線に印加され、従
前の直流電源ＶＭの電圧が一次巻線ＴＮｌｌ（一次巻線
ＴＮｌ２と巻数は等しい）にのみほゾ印加されていた場
合よりも多い巻数の巻線に印加されるので、出力巻線Ｔ
ＮＯに現われる逆電圧は小さくなる。したがつて、ダイ
オードＤ２のカソードがサイリスタＣＲ２のアノードに
直接接続される場合は逆電圧が大きいが、この実施例で
はＴＮ２２巻線を介して転流するので逆電圧は小さくな
るものであり、ＴＮ２２巻線巻数が多いほど逆電圧は低
くなり、かつダイオードＤ２に流れる電流も少くなる。
さて、サイリスタＣＲｌを流れていた負荷，駆動電流は
、この電流がダイオードＤ２側へ転流した結果、電流が
サイリスタＣＲｌには流れなくなるので、このときサイ
リスタＣＲｌにはゲート信号を与えていないが、サイリ
スタＣＲｌにゲート信号が与えられている、いないに力
）かわらず、サイ１ｊスタＣＲｌは自然ターンオフする
。したがつて、強制ターンオフ手段を要しないので、サ
イリスタＣＲｌ，ＣＲ２に代るスイツチとしてあえて制
御要素を必要とするトランジスタやＣＴＯサイリスタな
どは不要であつてサイリスタならぱ装置として最も簡単
であるといえる。なお、転流中の電流は抵抗器Ｒ４にて
検知でき、第２図ｅに示すような電圧ＶＲ４を発生する
。さて、転流電流が適当な値まで減少した時刻Ｔ２に負
荷電流を増加させるには、ゲート制碑装置ＧＣＵからサ
イリスタＣＲｌとトランンスタＱにトリガ信号を与える
と前述と同様にしてサイリスタＣＲｌ、トランジスタＱ
に負荷駆動電流か流れて、トランジスタＱは変流器ＣＴ
の二次巻線によつて，駆動される。時刻Ｔ３にトランジ
スタＱ１サイリスタＣＲｌをオフするには、またサイリ
スタＣＲ４にゲート信号を与えると良い。かくして以後
、トランジスタＱＯ）万ンオフを行うことにより負荷電
流電圧の増減を制御でき、負荷Ｚにはフイルタを介して
第２図ａに一点鎖線で示すようなほぼ所望の正弦波状電
圧を与えることができる。サイリスタＣＲｌおよびトラ
ンジスタＱの点弧するモードを正の半サイクルとすると
、負の半サイクルにあつてはサイリスタＣＲ２とトラン
ジスタＱを点弧および消弧する。この結果、負荷駆動電
流は出力トランスＴＲの一次巻線ＴＮｌ２を流れ、転流
電流はタイオートＤ１と巻線ＴＮ２ｌ，ＴＮｌｌを流れ
るが、これは正の半サイクルの祝明におけるＣＲｌとＣ
Ｒ２、ＣＲ３とＣＲ４、Ｄ１とＤ２などを置きかえて考
えれば艮いので詳細な説明は省く。変流器ＣＴについて
はサイリスタＣＲｌのオン時巻線Ｎｌｌ，Ｎｌ２間で動
作していたものか、サイリスタＣＲ２のオン時には巻線
Ｎｌ２，Ｎ２２間にて動作する。出力トランスＴＲｌ変
流器ＣＴともにサイリスタＣＲｌの万ンモードとサイリ
スタＣＲ２のオンモードとで極性を反転して励振され交
流励振される結果飽和することはない。したがつて、正
負各サイクル毎にＣＲｌとＱｓＣＲ２とＱをオノオフし
て５駆動することにより出力に交流出力を供給すること
が出来る。ゲート制御装置ＧＣＵにおいて負荷電流を検
知するには前記Ｒ１とＶＲ４の電圧の和をもつて正の半
サイクルの電流を検知し、また抵抗器Ｒ２とＲ３にそれ
ぞれ発生する電圧ＶＲ２とＶＲ３の和をもつて負の半サ
イクルの電流を検出することにより達成される。抵抗器
Ｒ１〜Ｒ４の値はタイオートＤｌ，Ｄ２を流れる転流電
流を通す出力トランスＴＲの二次巻線ＴＮ２２，ＴＮ２
ｌの巻数に応じて適宜定めることかでき、もつて負荷駆
動時と転流時の上記抵抗器における電圧降下をほソー致
させることは容易である。このように、第１図の実施例
では実際上のオノオフ制御はトランジスタ１本のみで出
力トランスを交番励振して交流負荷を駆動することがで
きる。
線ＴＮＯ、励振用一次巻線ＴＮｌｌ，ＴＮｌ２および転
流電流通流用二次巻線ＴＮ２ｌ，ＴＮ２２を備えている
。ＣＴは変流器であつて、一次巻線Ｎｌｌ，Ｎｌ２と二
次巻線Ｎ２ｌ，Ｎ２２を有し、一次巻線Ｎｌｌ，Ｎｌ２
は制御整流素子例えばサイリスタＣＲｌ，ＣＲ２にそれ
ぞれ接続され、二次巻線Ｎ２ｌ，Ｎ２２は共にスイツチ
素子例えばトランジスタＱにベース電流を供給しうるよ
うに構成される。Ｄ１〜Ｄ４は整流素子例えばダイオー
ド、ＣＲ３，ＣＲ４はオンオフ用の制御整流素子例えば
サイリスタ、Ｒ１〜Ｒ４は抵抗器であつて、これらの回
路素子は負荷電流を検知のために設けられている。ＶＭ
は直流電源、ＧＣＵはゲート制御装置、Ｚはインバータ
の負荷、ＦＬｌ，ＦＬ２はリアクトル、Ｃはコンデンサ
であつて、これらＦＬｌ，ＦＬ２およびＣでフイルタを
構成する。次に、この発明に係るインバータ装置の動作
を、第２図の信号波形と共に説明する。いま、第２図に
示す時刻Ｔ。以前に負荷およびフイルタに電流が減衰し
て流れ、時刻Ｔ。ではぼ零になつていたとする。時刻Ｔ
。においてゲート制御装置ＧＣＵからサイリスタＣＲｌ
にゲート信号を与えるとともにトランジスタＱにトリガ
パルスを与えたとすると、ＱｓＣＲｌはオンし、ＶＭ−
ＴＮｌｌ（ＴＲ）ＣＲｌ−Ｎｌｌ（ＣＴ）−Ｑ−ＶＭな
る経路の負荷１駆動電流が流ηる。このとき、変流器Ｃ
Ｔの一次巻線Ｎｌｌに流れる電流は変流器ＣＴの二次巻
線Ｎ２ｌに誘導電流を発生し、この電流はＮ２ｌ一Ｑベ
ース−Ｑエミツタ一Ｒ１−Ｄ３−Ｎ２ｌなる経路をとり
、トランジスタＱのベース電流となる。このベース電流
は変流器ＣＴの一次巻線Ｎｌｌを流れる電流の増加、減
少に比例して増大または減少するものであつて、つまり
トランジスタＱにとつてはコレクタ電流の多少に応じて
ベース電流が増減し、抵抗器で単にベース電流を定電流
的に与えるものに比べて、電力消費が節減される。出力
トランスＴＲの一次巻線ＴＮｌｌには直流電源ＶＭから
サイリスタＣＲｌ．トランジスタＱなどの電圧降下を差
引いた電圧が印加され、その出力巻線ＴＮＯには第２図
ａに示すような電圧Ｖ。が発生し、もつてフイルタおよ
び負荷に第２図ｂに示すような電流１。を供給しはじめ
る。この電流１。が適当な値まで増加した時刻ｔ１にト
ランジスタＱをしや断するにはサイリスタＣＲ４にゲー
ト信号を与えて点弧させる。上記電流１。が適当な値で
あるかどうかは抵抗器Ｒ１の電圧降下により知ることが
できる。つまり、トランジスタＱのコレクタ電流すなわ
ち負荷駆動電流に比例する電流が変流器ＣＴの二次側を
流れ、この電流が抵抗器Ｒ１で第２図ｄに示すような電
圧ＶＲｌを生ずる。トランジスタＱのオン中に変流器Ｃ
Ｔの二次巻線Ｎ２ｌに発生していた第２図ｃに示すよう
な電圧ＶＮ２ｌは、別の二次巻線Ｎ２２にも第１図に示
すような極性の電圧ＶＮ２２を発生しており、ゲート制
御装置ＧＣＵによるサイリスタＣＲ４の点弧によつて二
次巻線Ｎ２２の正極側か接地される結果、トランジスタ
Ｑのベース電位は低電位となり、もつてトランジスタＱ
がしや断される。この作用を、さらに確実に行うには、
第１図に点線で示すコンデノサＣＸ２（ＣＸｌも同様の
目的である）をそう入しておくと、このコンデンサＣＸ
２には第１図に示すような極性の電圧が誘導し、この電
圧がサイリスタＣＲ４のオンによつて、トランジスタＱ
のベースに逆電圧を与えることとなり、トランジスタＱ
はしや断される。ｌ・ランジスタＱがしや断されると誘
導性負荷の，駆動電流は、出力トランスＴＲの一次巻線
ＴＮｌｌを流れていたものが、一次巻線ＴＮｌ２および
二次巻線ＴＮ２２の側へダイオードＤ２を介して転流す
る転流電流となる。つまりこの転流電流は出力側の電流
１。がその負荷側のインダクタンス分のため出力巻線Ｔ
ＮＯを流れつづけることにより誘起されるものであるが
一次側ではＭ−Ｒ４−Ｄ２−ＴＮ２２−ＴＮｌ２−ＶＭ
なる経路をとる。この結果直流電源ＶＭの出力電圧にほ
ぼ等しい電圧がＴＮ２２＋ＴＮｌ２巻線に印加され、従
前の直流電源ＶＭの電圧が一次巻線ＴＮｌｌ（一次巻線
ＴＮｌ２と巻数は等しい）にのみほゾ印加されていた場
合よりも多い巻数の巻線に印加されるので、出力巻線Ｔ
ＮＯに現われる逆電圧は小さくなる。したがつて、ダイ
オードＤ２のカソードがサイリスタＣＲ２のアノードに
直接接続される場合は逆電圧が大きいが、この実施例で
はＴＮ２２巻線を介して転流するので逆電圧は小さくな
るものであり、ＴＮ２２巻線巻数が多いほど逆電圧は低
くなり、かつダイオードＤ２に流れる電流も少くなる。
さて、サイリスタＣＲｌを流れていた負荷，駆動電流は
、この電流がダイオードＤ２側へ転流した結果、電流が
サイリスタＣＲｌには流れなくなるので、このときサイ
リスタＣＲｌにはゲート信号を与えていないが、サイリ
スタＣＲｌにゲート信号が与えられている、いないに力
）かわらず、サイ１ｊスタＣＲｌは自然ターンオフする
。したがつて、強制ターンオフ手段を要しないので、サ
イリスタＣＲｌ，ＣＲ２に代るスイツチとしてあえて制
御要素を必要とするトランジスタやＣＴＯサイリスタな
どは不要であつてサイリスタならぱ装置として最も簡単
であるといえる。なお、転流中の電流は抵抗器Ｒ４にて
検知でき、第２図ｅに示すような電圧ＶＲ４を発生する
。さて、転流電流が適当な値まで減少した時刻Ｔ２に負
荷電流を増加させるには、ゲート制碑装置ＧＣＵからサ
イリスタＣＲｌとトランンスタＱにトリガ信号を与える
と前述と同様にしてサイリスタＣＲｌ、トランジスタＱ
に負荷駆動電流か流れて、トランジスタＱは変流器ＣＴ
の二次巻線によつて，駆動される。時刻Ｔ３にトランジ
スタＱ１サイリスタＣＲｌをオフするには、またサイリ
スタＣＲ４にゲート信号を与えると良い。かくして以後
、トランジスタＱＯ）万ンオフを行うことにより負荷電
流電圧の増減を制御でき、負荷Ｚにはフイルタを介して
第２図ａに一点鎖線で示すようなほぼ所望の正弦波状電
圧を与えることができる。サイリスタＣＲｌおよびトラ
ンジスタＱの点弧するモードを正の半サイクルとすると
、負の半サイクルにあつてはサイリスタＣＲ２とトラン
ジスタＱを点弧および消弧する。この結果、負荷駆動電
流は出力トランスＴＲの一次巻線ＴＮｌ２を流れ、転流
電流はタイオートＤ１と巻線ＴＮ２ｌ，ＴＮｌｌを流れ
るが、これは正の半サイクルの祝明におけるＣＲｌとＣ
Ｒ２、ＣＲ３とＣＲ４、Ｄ１とＤ２などを置きかえて考
えれば艮いので詳細な説明は省く。変流器ＣＴについて
はサイリスタＣＲｌのオン時巻線Ｎｌｌ，Ｎｌ２間で動
作していたものか、サイリスタＣＲ２のオン時には巻線
Ｎｌ２，Ｎ２２間にて動作する。出力トランスＴＲｌ変
流器ＣＴともにサイリスタＣＲｌの万ンモードとサイリ
スタＣＲ２のオンモードとで極性を反転して励振され交
流励振される結果飽和することはない。したがつて、正
負各サイクル毎にＣＲｌとＱｓＣＲ２とＱをオノオフし
て５駆動することにより出力に交流出力を供給すること
が出来る。ゲート制御装置ＧＣＵにおいて負荷電流を検
知するには前記Ｒ１とＶＲ４の電圧の和をもつて正の半
サイクルの電流を検知し、また抵抗器Ｒ２とＲ３にそれ
ぞれ発生する電圧ＶＲ２とＶＲ３の和をもつて負の半サ
イクルの電流を検出することにより達成される。抵抗器
Ｒ１〜Ｒ４の値はタイオートＤｌ，Ｄ２を流れる転流電
流を通す出力トランスＴＲの二次巻線ＴＮ２２，ＴＮ２
ｌの巻数に応じて適宜定めることかでき、もつて負荷駆
動時と転流時の上記抵抗器における電圧降下をほソー致
させることは容易である。このように、第１図の実施例
では実際上のオノオフ制御はトランジスタ１本のみで出
力トランスを交番励振して交流負荷を駆動することがで
きる。
また、そのトランジスタ５駆動においては２つのサイリ
スタを流れる電流を個々の間で逆極性関係に一次巻廁に
通じ、もつて飽和しない変流器を用いているので、その
コレクタ電流の大小に応じてベース電流か自動的に増減
し効率がよい。さらに、出力トランスに転流用巻線を追
加してダイオードを介して転流時の電流を通すようにし
たので、転流時に発生する逆起電圧を出力側で小さくす
ることができ、もつて同じ出力電流リツブルをとるよう
に考慮したとき、転流用巻線を出力トランスに設けない
場合に比べて、出力フイルタの容量を小さくすることが
できる。第３図はこの発明の他の実施例を示すものであ
つて、第１図の回路と相違する点は変流器ＣＴの一次巻
線Ｎｌｌ，Ｎｌ２をサイリスタＣＲｌ，ＣＲ２のアノー
ド側にそれぞれ配して、二次巻線を１個のＮ２Ｏのみと
し、トランジスタＱのベース電流として二次巻線Ｎ２Ｏ
の出力を、ダイオードＤ３〜Ｄ６で全波整流して供給す
るように構成したことである。
スタを流れる電流を個々の間で逆極性関係に一次巻廁に
通じ、もつて飽和しない変流器を用いているので、その
コレクタ電流の大小に応じてベース電流か自動的に増減
し効率がよい。さらに、出力トランスに転流用巻線を追
加してダイオードを介して転流時の電流を通すようにし
たので、転流時に発生する逆起電圧を出力側で小さくす
ることができ、もつて同じ出力電流リツブルをとるよう
に考慮したとき、転流用巻線を出力トランスに設けない
場合に比べて、出力フイルタの容量を小さくすることが
できる。第３図はこの発明の他の実施例を示すものであ
つて、第１図の回路と相違する点は変流器ＣＴの一次巻
線Ｎｌｌ，Ｎｌ２をサイリスタＣＲｌ，ＣＲ２のアノー
ド側にそれぞれ配して、二次巻線を１個のＮ２Ｏのみと
し、トランジスタＱのベース電流として二次巻線Ｎ２Ｏ
の出力を、ダイオードＤ３〜Ｄ６で全波整流して供給す
るように構成したことである。
この実施例では、トランジスタＱのベース電流は抵抗器
Ｒｓにて検知するが、負荷の転流電流を通すダイオード
Ｄｌ，Ｄ２からの電流も抵抗器Ｒｓを通るように構成し
たので、第１図における４個の抵抗器Ｒ１〜Ｒ４を１個
の抵抗器Ｒｓにすることができる。こ＼で、変流器ＣＴ
と出力トランスＴＲの巻線巻数比は、左辺をＴＲｌ右辺
をＣＴについて示すとき、次式を満足することが必要で
ある。トランジスタＱをオンオフするにはゲート制御装
置ＧＣＵより二次巻線Ｎ２Ｏに比較的高電圧のパルスを
与えると、サイリスタ（双方向性）ＣＲ３がオンして、
二次巻線Ｎ２Ｏを流れる電流（Ｑのベース電流）をサイ
リスタＣＲ３が短絡するので、トランジスタＱがベース
電流をしや断されてオフし、もつてサイリスタＣＲｌ（
ＣＲ２）がオフされる。
Ｒｓにて検知するが、負荷の転流電流を通すダイオード
Ｄｌ，Ｄ２からの電流も抵抗器Ｒｓを通るように構成し
たので、第１図における４個の抵抗器Ｒ１〜Ｒ４を１個
の抵抗器Ｒｓにすることができる。こ＼で、変流器ＣＴ
と出力トランスＴＲの巻線巻数比は、左辺をＴＲｌ右辺
をＣＴについて示すとき、次式を満足することが必要で
ある。トランジスタＱをオンオフするにはゲート制御装
置ＧＣＵより二次巻線Ｎ２Ｏに比較的高電圧のパルスを
与えると、サイリスタ（双方向性）ＣＲ３がオンして、
二次巻線Ｎ２Ｏを流れる電流（Ｑのベース電流）をサイ
リスタＣＲ３が短絡するので、トランジスタＱがベース
電流をしや断されてオフし、もつてサイリスタＣＲｌ（
ＣＲ２）がオフされる。
この第３図の実施例は基本的には第１図の実施例に比べ
てその動作と効果は同様であるが、回路はやや簡単とな
る。以上の説明から明らかなようにこの発明に係るイン
バータ装置によれば、励振巻線および転流巻線を有する
出力トランスと、この出力トランスと結合関係に配せら
れる変流器を設け、この変流器により一つのスイツチ素
子を駆動するように構成することによつて電力消費を軽
減できると共に、上記転流巻線の配設により負荷電流の
転流モードにおける出力側に現われる逆電圧を減少する
ことができ、もつてフイルタの容量を小さくすることが
可能となる。
てその動作と効果は同様であるが、回路はやや簡単とな
る。以上の説明から明らかなようにこの発明に係るイン
バータ装置によれば、励振巻線および転流巻線を有する
出力トランスと、この出力トランスと結合関係に配せら
れる変流器を設け、この変流器により一つのスイツチ素
子を駆動するように構成することによつて電力消費を軽
減できると共に、上記転流巻線の配設により負荷電流の
転流モードにおける出力側に現われる逆電圧を減少する
ことができ、もつてフイルタの容量を小さくすることが
可能となる。
第１図はこの発明の一実施例を示す回路構成図、第２図
は第１図の回路の動作を説明するための信号波形図、第
３図はこの発明の他の実施例を示す回路構成図である。 図中、Ｑはトランジスタ、ＣＲｌ〜ＣＲ４はサイリスタ
、Ｄ１〜Ｄ６はダイオード、ＣＴは変流器、ＴＲは出力
トランス、ＧＣＵはゲート制御装置、Ｚは負荷である。
は第１図の回路の動作を説明するための信号波形図、第
３図はこの発明の他の実施例を示す回路構成図である。 図中、Ｑはトランジスタ、ＣＲｌ〜ＣＲ４はサイリスタ
、Ｄ１〜Ｄ６はダイオード、ＣＴは変流器、ＴＲは出力
トランス、ＧＣＵはゲート制御装置、Ｚは負荷である。
Claims (1)
- 【特許請求の範囲】 １ 出力トランスの第１励振巻線および第１制御整流素
子を含む第１直列回路と、この第１直列回路と並列関係
に接続され、上記第１励振巻線とは逆極性関係にある上
記出力トランスの第２励振巻線および第２制御整流素子
を含む第２直列回路と、これらの第１および第２の直列
回路を直流電源に交互に接続するスイッチ素子と、上記
第１励振巻線と結合関係に設けられる上記出力トランス
の第１転流巻線および第１整流素子を含み、転流時上記
第１励振巻線を介して上記直流電源に接続される第１転
流回路と、上記第２励振巻線と結合関係に設けられる上
記出力トランスの第２転流巻線および第２整流素子を含
み、転流時上記第２励振巻線を介して上記直流電源に接
続される第２転流回路と、負荷駆動時正負各サイクル毎
に上記第１および第２の制御整流素子のゲートを交互に
オンに、又上記スイッチ素子をオンに制御して交流出力
を供給し以後上記スイッチ素子のオンオフで負荷電流電
圧の増減を制御でき、又転流時には強制ターンオフ手段
を要しない自然にターンオフするための制御手段とを備
えるもので、この制御手段は上記第１および第２の直列
回路にそれぞれ挿入される第１および第２の一次巻線、
これらの一次巻線にそれぞれ対応して設けられ、各一端
がスイッチ素子の制御電極に接続され、各他端がそれぞ
れ第３および第４の整流素子を介して上記スイッチ素子
の主電極に接続される第１および第２の二次巻線を有す
る変流器と、上記第３および第４の整流素子にそれぞれ
逆並列関係に接続される第３および第４の制御整流素子
と、上記第１ないし第４の制御整流素子を点弧制御する
ゲート制御装置とを備え、又上記ゲート制御装置は上記
第１および第２の整流素子にそれぞれ接続された抵抗に
より負荷電流を検出し、上記第３および第４の整流素子
にそれぞれ接続された抵抗によりスイッチ素子の制御電
流を検出するようにしたことを特徴とするインバータ装
置。 ２ 制御手段は第１および第２の直列回路にそれぞれ挿
入される第１および第２の一次巻線、これらの一次巻線
に対応して設けられた第３の二次巻線を有する変流器と
、この変流器の出力を整流してスイッチ素子の制御電極
に供給する整流回路と、上記第３の二次巻線に並列接続
される双方向性制御整流素子と、この双方向性制御整流
素子と第１および第２の制御整流素子を点弧制御するゲ
ート制御装置とを備えている特許請求の範囲第１項記載
のインバータ装置。 ３ ゲート制御装置は整流回路に設けられた単一の抵抗
により負荷電流およびスイッチ素子の制御電流を検出す
る特許請求の範囲第２項記載のインバータ装置。 ４ 第１および第２の転流巻線の巻数は第１および第２
の励振巻線の巻数より多くなるように設定される特許請
求の範囲第１項ないし第３項のいずれかに記載のインバ
ータ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52081457A JPS5911266B2 (ja) | 1977-07-06 | 1977-07-06 | インバ−タ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52081457A JPS5911266B2 (ja) | 1977-07-06 | 1977-07-06 | インバ−タ装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5415132A JPS5415132A (en) | 1979-02-03 |
| JPS5911266B2 true JPS5911266B2 (ja) | 1984-03-14 |
Family
ID=13746922
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP52081457A Expired JPS5911266B2 (ja) | 1977-07-06 | 1977-07-06 | インバ−タ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5911266B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS551503B2 (ja) * | 1975-08-30 | 1980-01-14 |
-
1977
- 1977-07-06 JP JP52081457A patent/JPS5911266B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5415132A (en) | 1979-02-03 |
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