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JPS5945230B2 - Emitter short-circuit thyristor - Google Patents
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JPS5945230B2 - Emitter short-circuit thyristor - Google Patents

Emitter short-circuit thyristor

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Publication number
JPS5945230B2
JPS5945230B2 JP53017203A JP1720378A JPS5945230B2 JP S5945230 B2 JPS5945230 B2 JP S5945230B2 JP 53017203 A JP53017203 A JP 53017203A JP 1720378 A JP1720378 A JP 1720378A JP S5945230 B2 JPS5945230 B2 JP S5945230B2
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JP
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short
emitter
cathode
circuited
region
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富久 山田
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Mitsubishi Electric Corp
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Publication date
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    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D62/00Semiconductor bodies, or regions thereof, of devices having potential barriers
    • H10D62/10Shapes, relative sizes or dispositions of the regions of the semiconductor bodies; Shapes of the semiconductor bodies
    • H10D62/13Semiconductor regions connected to electrodes carrying current to be rectified, amplified or switched, e.g. source or drain regions
    • H10D62/141Anode or cathode regions of thyristors; Collector or emitter regions of gated bipolar-mode devices, e.g. of IGBTs
    • H10D62/148Cathode regions of thyristors

Landscapes

  • Thyristors (AREA)

Description

【発明の詳細な説明】 この発明は、陰極エミッタ領域とこれに隣接する陰極ベ
ース領域を陰電極によつて部分的に短絡してなるエミッ
タ短絡形サイリスタの改良に係り、特にそのターンオフ
タイムの短縮構造に関するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an improvement in an emitter-shorted thyristor in which a cathode emitter region and an adjacent cathode base region are partially short-circuited by a cathode, and in particular to shortening the turn-off time thereof. It's about structure.

高速スイッチングを要求されるサイリスタに於ては、従
来より設計的、構造的な面で多くの改善がなされてきた
が、これらの努力は主としてターンオフ特性と、これと
相予盾する他の特性(ゲートトリガ電流、オン電圧等)
との相関関係を改善するために払われてきた。
For thyristors that require high-speed switching, many improvements have been made in terms of design and structure, but these efforts have mainly focused on improving turn-off characteristics and other characteristics that are compatible with these ( gate trigger current, on-voltage, etc.)
has been paid to improve the correlation.

一般にターンオフタイムを短かくするためには、重金属
の拡散や放射線の照射により再結合中心を導入したり、
ショートエミッタを設けることにより、ターンオフ時の
過剰キャリヤの消滅を促すことが行なわれるが、これら
の事柄は同時にゲートトリガ電流やオン電圧を増すとい
う結果をもたらす。他の特性の劣化を最小限にしてター
ンオフタイムを短かくするため、従来より拡散仕様やシ
ョートエミッタの構造等に於て種々の改善が成されたが
、あまり満足すべき結果が得られなかつた。以下従来の
構造のエミッタ短絡形サイリスタについて説明を行なう
Generally, in order to shorten the turn-off time, recombination centers are introduced by diffusion of heavy metals or radiation irradiation,
Providing a short emitter promotes the disappearance of excess carriers at turn-off, but these factors also result in an increase in gate trigger current and on-voltage. In order to minimize the deterioration of other characteristics and shorten the turn-off time, various improvements have been made in the diffusion specifications and short emitter structure, but very satisfactory results have not been obtained. . A short emitter thyristor having a conventional structure will be explained below.

第1図は従来のエミッタ短絡形サイリスタを示す断面図
、第2図はその上面図である。このようなサイリスタは
、N形半導体基板1にP形ベース領域2、P形エミッタ
領域3、N形エミッター領域4を形成し、然る後該半導
体基板1に金等の重金属を拡散せしめ、これにカソード
電極5、ゲート電極6、アノード電極8を形成して得ら
れる。この時、P形ベース領域2のカソード電極5に短
絡された部分子(以下これをショートエミッタと称す)
が形成されている。従来の素子に於ては、このショート
エミッタTがカソード領域内で疎らに形成されていた。
カソード領域内の1点から最も近いショートエミッタT
へ至る距離の最大値は、約300Itm以上であつた。
このため優れたターンオフ特性が得られなかつた。ショ
ートエミッタTをより稠密に形成すれば、ターンオフ特
性は改善されるが、ゲートトリガ−電流が増し、又、実
効陰極面積が減少することにより、オン電圧が増すとい
う問題があつた。この発明はこのような点に鑑みてなさ
れたもので、他の特性を損うことなくターンオフ特性を
向上させることができるエミツタ短絡形サイリスタを提
供することを目的とする。以下、この発明について説明
する。
FIG. 1 is a sectional view showing a conventional short-circuited emitter thyristor, and FIG. 2 is a top view thereof. Such a thyristor is manufactured by forming a P-type base region 2, a P-type emitter region 3, and an N-type emitter region 4 on an N-type semiconductor substrate 1, and then diffusing a heavy metal such as gold into the semiconductor substrate 1. A cathode electrode 5, a gate electrode 6, and an anode electrode 8 are formed on the substrate. At this time, a partial molecule short-circuited to the cathode electrode 5 of the P-type base region 2 (hereinafter referred to as a short emitter)
is formed. In conventional devices, these short emitters T are sparsely formed within the cathode region.
Short emitter T closest to a point in the cathode region
The maximum value of the distance reached was about 300 Itm or more.
For this reason, excellent turn-off characteristics could not be obtained. If the short emitters T are formed more densely, the turn-off characteristics are improved, but there is a problem that the gate trigger current increases and the effective cathode area decreases, resulting in an increase in the on-state voltage. The present invention has been made in view of the above points, and an object of the present invention is to provide a short-circuited emitter thyristor that can improve turn-off characteristics without impairing other characteristics. This invention will be explained below.

第3図はこの発明の一実施例を示す断面図、第4図はそ
の上面図である。図において、第1図および第2図と同
一符号は夫々同一または相当部分を示しており、第1図
および第2図と異なるところは、円形のシヨートエミツ
タ7を、カソード電極5内に均一かつ稠密に配置される
ように、互いに直交する等間隔の平行直線群の交点に位
置するように形成した点である。
FIG. 3 is a sectional view showing an embodiment of the present invention, and FIG. 4 is a top view thereof. In the figure, the same reference numerals as in FIGS. 1 and 2 indicate the same or corresponding parts, and the difference from FIGS. It is a point formed to be located at the intersection of a group of equally spaced parallel straight lines that are orthogonal to each other so that the

この時、N形領域4、P形領域2、P形領域3、の拡散
深さをそれぞれD,,d2,d3、P形領域2及び3間
のN形領域の厚みをD4、半導体基板1の厚みをt1隣
接するシヨートエミツタ7の中心間の距離をDSEl各
シヨートエミツタ7の直径をrとすると、以上の各パラ
メーターは次のような関係により決定される。tは素子
に要求される阻止電圧により決定される場合があるが、
阻止電圧が低い(500〜800)場合、むしろ製造工
程に於けるウエハ割れによる歩留低下を防ぐために必要
なウエ・・厚みより決定されることが多い。
At this time, the diffusion depths of the N-type region 4, P-type region 2, and P-type region 3 are respectively D, d2, d3, the thickness of the N-type region between the P-type regions 2 and 3 is D4, and the semiconductor substrate 1 Assuming that the thickness is t1, the distance between the centers of adjacent shot emitters 7 is DSEl, and the diameter of each shot emitter 7 is r, each of the above parameters is determined by the following relationships. t may be determined by the blocking voltage required for the element, but
When the blocking voltage is low (500 to 800), it is often determined based on the wafer thickness required to prevent a decrease in yield due to wafer cracking during the manufacturing process.

たとえば50mmφのウエハを用いる場合、tが200
μm以下になるとウエハ割れによる歩留低下が問題とな
る。特にガラスパツシベーシヨン形の場合、ウエハにメ
サ溝を形成するため、507n11φのウエハを用いる
場合は約220μm以上の厚みが必要となる。D4が厚
くなるとオン電圧が高くなり、特にパルス大電流を遮断
する場合、オン状態の電力損失が増大して素子の温度上
昇のためターンオフタイムが長くなる。従つてD4は要
求される阻止電圧を満足する限り小さくする必要がある
。又、P形ベース領域2及びP形エミツタ一領域3は製
造工程簡略のため同時に形成されることが多く、この場
合D4を小さくするためにD2を大きくする必要がある
。又、D2−d1が大きくなると、シヨートエミツタ7
からゲート電極6に至るP形ベース領域2の合成抵抗R
SEが小さくなると同時にN形エミツタ一領域4からの
注入効率が低下し、ゲートトリガ電流が大きくなる。
For example, when using a 50 mmφ wafer, t is 200
When the thickness is less than μm, a decrease in yield due to wafer cracking becomes a problem. In particular, in the case of a glass stiction type, a mesa groove is formed in the wafer, so if a 507n11φ wafer is used, a thickness of about 220 μm or more is required. As D4 becomes thicker, the on-voltage increases, and especially when cutting off a pulsed large current, the power loss in the on-state increases and the temperature of the element increases, resulting in a longer turn-off time. Therefore, D4 needs to be as small as possible to satisfy the required blocking voltage. Further, the P-type base region 2 and the P-type emitter region 3 are often formed at the same time to simplify the manufacturing process, and in this case, it is necessary to increase D2 in order to decrease D4. Also, when D2-d1 increases, the short emitter 7
The combined resistance R of the P-type base region 2 from to the gate electrode 6
As SE becomes smaller, the efficiency of injection from the N-type emitter region 4 decreases, and the gate trigger current increases.

又、rを大きくしたりDSEを小さくするとターンオフ
特性は改善されるがゲートトリカー電流が大きくなる。
Furthermore, increasing r or decreasing DSE improves the turn-off characteristics, but increases the gate trigger current.

直列式自動調光ストロボの制御用サイリスタを例にあげ
て本発明による前述の各パラメーターの具体的な値を示
す。
The specific values of each of the above-mentioned parameters according to the present invention will be shown by taking a thyristor for controlling a series automatic light control flash as an example.

該サイリスタに於ては、第5図に示す如き電流ピーク値
100〜300Aのパルス電流を、任意の通電時間Tw
に於て数μSec以下の時間で遮断することが要求され
る。
In the thyristor, a pulse current with a current peak value of 100 to 300 A as shown in FIG.
In this case, it is required to shut off the power in a time of several microseconds or less.

この場合、ターンオフタイムはTwに依存し、通常Tw
が600〜1000μSecの範囲にターンオフタイム
が最大となる点がある。このターンオフタイムの最大値
を、以下パルスターンオフタイムTqと呼ぶ。以下のT
qは第5図のパルス電流についての値である。第6図に
DSEをパラメータとして、パルスターンオフTqとゲ
ートトリカー電流1。Tの相関関係の実験結果を示す。
この時、t=220μm、D2=D3=65μM,.d
l=37μM,.d4=90μM,.r=40ttmで
ある。第6図に於て、A及びBはそれぞれ要求されるT
,及びI。
In this case, the turn-off time depends on Tw and is usually Tw
There is a point where the turn-off time is maximum in the range of 600 to 1000 μSec. The maximum value of this turn-off time is hereinafter referred to as pulse turn-off time Tq. T below
q is the value for the pulse current in FIG. Figure 6 shows pulse turn-off Tq and gate trigger current 1 using DSE as a parameter. The experimental results of the correlation of T are shown.
At this time, t=220 μm, D2=D3=65 μM, . d
l=37μM,. d4=90μM,. r=40ttm. In Figure 6, A and B are each required T
, and I.

Tの最大値を示し、C,D,E,F,GはそれぞれDs
E−600、4001280、200、150μmの特
性を示す線である。このグラフより明らかなように、I
GTが増加するに伴ないT9は減少し、ある値に達する
とIGTの増大に対しt はほぼ一定となる。この時の
TqOqの値をTqminとし、TqmmとDSEの関
係を第7図に示す。
Indicates the maximum value of T, and C, D, E, F, and G are each Ds
This is a line showing the characteristics of E-600, 4001280, 200, and 150 μm. As is clear from this graph, I
As GT increases, T9 decreases, and once a certain value is reached, t becomes approximately constant as IGT increases. The value of TqOq at this time is defined as Tqmin, and the relationship between Tqmm and DSE is shown in FIG.

DSEが400μm以上の場合Tq龍はDSEに殆んど
依存せず、シヨートエミツタの効果が現われていない。
DSEが300ttm以下になるとシヨートエミツタの
効果が顕著になり、TqTnmは小さくなる。第6図の
直線A,Bより明らかなように、D8Eを400μm以
上にするとT,とIGTを共に満足する値に制御するこ
とは困難であるが、DSEを300μm以下にするとこ
れが容易になり、DSEを150μm以下にするとこの
効果がさらに顕著である。第8図にD2−d1をパラメ
ータとしてTqと10Tの相開開係の実験結果を示す。
When the DSE is 400 μm or more, the Tq dragon hardly depends on the DSE, and the short emitter effect does not appear.
When DSE becomes 300 ttm or less, the short emitter effect becomes significant and TqTnm becomes small. As is clear from straight lines A and B in Fig. 6, if D8E is set to 400 μm or more, it is difficult to control T and IGT to values that satisfy both, but if DSE is set to 300 μm or less, this becomes easy. This effect becomes even more remarkable when the DSE is set to 150 μm or less. FIG. 8 shows the experimental results of the phase opening/opening relationship between Tq and 10T using D2-d1 as a parameter.

この場合t一220μM,.d2=D3=65μM,.
d4=90μM.r=40μmである。又H,I,Jは
それぞれD2−d1−27μMl3OμMl35μmの
グラフである。このグラフの示す如く、D2−d1が大
きくなるに従い一定のT,の値に対するIGTが大きく
なり、D2−d1が30μm以上の場合、IGTとT,
を共に満足する値に制御することが困難になる。従つて
D2−d1は30!Tm以下にする必要がある。なお、
D4は110μm以下にすれば、オン電圧増加のための
通電時の温度上昇によるパルスターンオフ特性の著しい
劣化を防ぐことができる。
In this case, t-220 μM, . d2=D3=65 μM, .
d4=90μM. r=40 μm. Moreover, H, I, and J are graphs of D2-d1-27μMl3OμMl35μm, respectively. As shown in this graph, as D2-d1 increases, IGT for a constant T value increases, and when D2-d1 is 30 μm or more, IGT and T,
It becomes difficult to control both of them to a value that satisfies them. Therefore, D2-d1 is 30! It is necessary to keep it below Tm. In addition,
By setting D4 to 110 μm or less, it is possible to prevent significant deterioration of the pulse turn-off characteristics due to a temperature rise during energization to increase the on-state voltage.

また、rは50μm以下にすれば、IGTの増大及び実
効陰極面積の減少によるパルスターンオフ特性の劣化を
防ぐことができる。以上のように、DSEを300It
m(150μm以下ではさらに効果は顕著である)、t
を200μ以上とし、D4が110μm以下になるよう
にD2及びD3を決定し、D2−d1が30μm以下に
なるようにd1を決定し、rを50μm以下にすれば、
従来の構造の場合比べて他の特性を劣化させることなく
より優れたターンオフ特性を有する素子を高い歩留で得
ることができる。
Further, by setting r to 50 μm or less, deterioration of pulse turn-off characteristics due to increase in IGT and decrease in effective cathode area can be prevented. As mentioned above, DSE is 300It
m (the effect is even more pronounced below 150 μm), t
If D2 and D3 are determined so that D4 is 200 μm or more, D4 is 110 μm or less, d1 is determined so that D2-d1 is 30 μm or less, and r is 50 μm or less,
Compared to the conventional structure, devices having better turn-off characteristics can be obtained at a higher yield without deteriorating other characteristics.

もちろん、DSEを3001tm以下にするだけの効果
によつてもターンオフ特性を改善できることは明らかで
ある。以上の例に於て、シヨートエミツタ7は互いに直
交する等間隔の平行直線群の交点上に位置するように配
置した形のものをとり上げたが、必ずしもこの形である
必要はなく、第9図のように、互いに600の角度をも
つて交わる等間隔の平行直線群の交点に配置した形も可
能である。
Of course, it is clear that the turn-off characteristics can be improved simply by reducing the DSE to 3001 tm or less. In the above example, the short emitter 7 is arranged so as to be located on the intersection of a group of equally spaced parallel straight lines that are orthogonal to each other, but it does not necessarily have to be in this shape, and as shown in FIG. It is also possible to arrange them at the intersections of equally spaced parallel straight lines that intersect with each other at an angle of 600°.

すなわち、以上の例に於けるDsE−300μmの場合
のシヨートエミツタの効果と同様のものは、300μm
×300μm−9×104μイの面積に1つの割合で、
かつ全カンード領域にわたつて均一に分布したシヨート
エミツタによつて得られることは明らかである。同様に
してDsE−150μmの効果は、2.25×104μ
dの面積に1つの割合で均一に分布したシヨートエミツ
タの効果と同様である。なおシヨートエミツタの形は必
ずしも円形である必要はなく、たとえば40μmφのシ
ヨートエミツタの効果はπ×20μM,X2OμML−
1.3×103μイの面積を有する任意の形のシヨート
エミツタによつて得られる。
In other words, the effect of the short emitter in the case of DsE-300 μm in the above example is similar to the effect of the short emitter in the case of DsE-300 μm.
× 300 μm - 9 × 104 μm area at a rate of 1,
It is clear that this can be achieved with shot emitters uniformly distributed over the entire cand area. Similarly, the effect of DsE-150μm is 2.25×104μ
This is similar to the effect of short emitters uniformly distributed in the area of d. Note that the shape of the short emitter does not necessarily have to be circular; for example, the effect of a short emitter with a diameter of 40 μm is π×20 μM,
It can be obtained with a short emitter of arbitrary shape having an area of 1.3×10 3 μm.

又第10図の如く、カソード領域の周辺部がシヨートエ
ミツタになつている形のものについても本発明が適用で
きることは明らかである。
It is clear that the present invention can also be applied to a structure in which the periphery of the cathode region is a short emitter, as shown in FIG.

以上は直列式自動調光ストロボ用サイリスタを例にあげ
たが、一般に高速スイツチングを要求されるサイリスタ
に対して本発明を適用することができる。
Although the thyristor for a series automatic light control strobe has been described above as an example, the present invention can be applied to thyristors that generally require high-speed switching.

又、拡散深さ、ウエハ厚み等以上の説明に用いた数値は
1例であり、これ以外の場合も本発明の適用は可能であ
り、たとえばD2Sd3の場合も本発明は有効である。
又、本発明はセンターゲート構造のサイリスタだけでな
く、コーナーゲート構造のサイリスタにも適用できる。
Further, the numerical values used in the above explanation, such as the diffusion depth and wafer thickness, are just one example, and the present invention can be applied to other cases as well. For example, the present invention is also effective in the case of D2Sd3.
Furthermore, the present invention can be applied not only to thyristors with a center gate structure but also to thyristors with a corner gate structure.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来のエミツタ短絡形サイリスタを示す断面図
、第2図はその上面図、第3図はこの発明の一実施例を
示す断面図、第4図はその上面図、第5図はパルス電流
波形を示す図、第6図および第8図はGTとTqの相関
関係を示す図、第7図はDSEとT,mmの関係を示す
図、第9図および第10図はそれぞれこの発明の他の実
施例を示す上面図である。 図において、1はN形半導体基板、2はP形ベース領域
、3はP形エミツタ領域、4はN形エミツタ領域、5は
カソード電極、6はゲート電極、7はシヨートエミツタ
、8はアノード電極である。
Fig. 1 is a sectional view showing a conventional short-emitter thyristor, Fig. 2 is a top view thereof, Fig. 3 is a sectional view showing an embodiment of the present invention, Fig. 4 is a top view thereof, and Fig. 5 is a sectional view showing a conventional short-circuited emitter thyristor. Figures 6 and 8 are diagrams showing the pulse current waveform, Figures 6 and 8 are diagrams showing the correlation between GT and Tq, Figure 7 is a diagram showing the relationship between DSE and T, mm, and Figures 9 and 10 are diagrams showing the correlation between GT and Tq. FIG. 7 is a top view showing another embodiment of the invention. In the figure, 1 is an N-type semiconductor substrate, 2 is a P-type base region, 3 is a P-type emitter region, 4 is an N-type emitter region, 5 is a cathode electrode, 6 is a gate electrode, 7 is a short emitter, and 8 is an anode electrode. be.

Claims (1)

【特許請求の範囲】 1 陰極エミッタ領域、陰極ベース領域、陽極ベース領
域および陽極エミッタ領域を順次接合してなる半導体基
体を備え、上記陰極エミッタ領域と陰極ベース領域を陰
電極によつて部分的に短絡したサイリスタにおいて、上
記短絡部分が9×10^4μm^2に1個以上の密度で
上記陰電極内に均一に分布して複数個設けられ、また上
記半導体基体の厚さが200μm以上、陽極ベース領域
の厚さが110μm以下、陰極ベース領域の厚さが30
μm以下に成形されていることを特徴とするエミッタ短
絡形サイリスタ。 2 短絡部分は2.25×10^4μm^2に1個の密
度で設けられていることを特徴とする特許請求の範囲第
1項記載のエミッタ短絡形サイリスタ。 3 1つの短絡部分は1.3×10^3μm^2以下の
面積であることを特徴とする特許請求の範囲第1項記載
のエミッタ短絡形サイリスタ。
[Scope of Claims] 1. A semiconductor substrate having a cathode emitter region, a cathode base region, an anode base region, and an anode emitter region bonded in sequence, wherein the cathode emitter region and the cathode base region are partially connected by a cathode. In the short-circuited thyristor, a plurality of the short-circuited portions are uniformly distributed within the cathode at a density of one or more in 9×10^4 μm^2, and the thickness of the semiconductor substrate is 200 μm or more, and the anode The thickness of the base region is 110μm or less, and the thickness of the cathode base region is 30μm or less.
A short-circuited emitter thyristor characterized by being formed to a size of micrometer or less. 2. The emitter short-circuited thyristor according to claim 1, wherein the short-circuited portions are provided at a density of one piece per 2.25×10^4 μm^2. 3. The emitter short-circuited thyristor according to claim 1, wherein one short-circuited portion has an area of 1.3×10^3 μm^2 or less.
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