JPS5952132B2 - Paper feed control circuit - Google Patents
Paper feed control circuitInfo
- Publication number
- JPS5952132B2 JPS5952132B2 JP1069877A JP1069877A JPS5952132B2 JP S5952132 B2 JPS5952132 B2 JP S5952132B2 JP 1069877 A JP1069877 A JP 1069877A JP 1069877 A JP1069877 A JP 1069877A JP S5952132 B2 JPS5952132 B2 JP S5952132B2
- Authority
- JP
- Japan
- Prior art keywords
- detector
- paper feed
- counter
- feed control
- control circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Controlling Sheets Or Webs (AREA)
- Conveying Record Carriers (AREA)
Description
【発明の詳細な説明】
〔発明の利用分野〕
この発明は電子計算機の入力装置のうちで光学文字読取
装置(以下OCRと略)の紙送り制御部に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Application of the Invention] The present invention relates to a paper feed control section of an optical character reader (hereinafter abbreviated as OCR) among input devices for an electronic computer.
OCRの紙送り制御部は大きく分類して読取部で帳票を
一時停止させて読取る方式と走行状態で読取る方式に分
けることができ、通常前者がページ・リーダ・タイプで
、後者がドキュメント・リーダ・タイプに対応している
。The paper feed control unit of OCR can be broadly classified into two types: a system that reads the form by temporarily stopping the document in the reading unit, and a system that reads the form while it is running.The former is usually a page reader type, and the latter is a document reader type. It corresponds to the type.
この両タイプのOCRの紙送り制御を共通化するには、
異常検出、特に帳票が走行路上でジャムを起こしその帳
票及びその後に続く帳票が走行できなくなるのを検出す
るジャム検出の方法が問題となる。通常のドキュメント
・リーダ・タイプのジャム検出方法に、ある帳票の先端
が検出器を通過してから次の帳票の先端が検出器を通過
するまでに要する時間をチェックし、所定の時間を経て
も通過しない場合にジャムとして検出する方法がある。
しかしこの方法では、帳票が一時停止するページ・りー
ダ・タイプにそのまま通用することができない。〔発明
の目的〕本発明の目的は、帳票が走行状態で読取られる
ドキュメント・リーダ・タイプと、一時停止して読取ら
れるページ・リーダ・タイプの両者においてジャム検出
が可能な紙送り制御回路を提供することにある。In order to standardize the paper feed control for both types of OCR,
Problems arise in detecting abnormalities, particularly in the jam detection method for detecting when a form jams on the travel path, making it impossible for that form and subsequent forms to travel. In the normal document reader type jam detection method, the time required from the leading edge of one form to pass the detector to the leading edge of the next form to pass the detector is checked, and even if a predetermined period of time has elapsed, There is a method for detecting a jam if the paper does not pass through.
However, this method cannot be directly applied to page reader types where forms are temporarily stopped. [Object of the Invention] An object of the present invention is to provide a paper feed control circuit that can detect jams in both document reader types in which a form is read while it is running, and page reader types in which a form is read in a paused state. It's about doing.
本発明では走行路上の検出器を、ある帳票が通過してか
ら次の帳票が到達する迄の時間をチェックするのに、ペ
ージ・リーダ・タイプにも適用できるように、帳票の読
取り中、即ち、帳票の一時I停止している間、上記の時
間チェックを省くことを特徴とする。In the present invention, the detector on the road is used to check the time from when a certain form passes until the next form arrives, so that it can be applied to a page reader type. , is characterized in that the above-mentioned time check is omitted while the form is temporarily stopped.
本発明の一実施例を第1図に示す。 An embodiment of the present invention is shown in FIG.
第1図はジャム検出回路のブロック図である。走行信号
11は走行路上を帳票を走行させるための制御信号であ
り、図示しないマイクロプロセッサ等の制御部から出力
される。例えば論理レベル’゛1”のときモータを駆動
して帳票を搬送し、 ゛“0’’のときモータを停止す
る。この走行信号11は論理積回路j7に入力される。
論理積回路7のもう一方の入力はクロックパルス12で
あり、図示しない制御部から出力される。従つて走行信
号11が’゛1”のとき論理積回路7からはクロックパ
ルス12が出力される。論理積回路7の出力はカウンタ
4のカウントアップ信号1となる。検出器出力13は走
行路上の帳票の有無を表わす信号であり、帳票が検出さ
れたとa1’’検出されないとa0’’である。検出器
は例えば発光素子と受光素子とから構成される。検出器
出力13が゜“1゛のときワンシヨツト回路2が動作し
、その出力3で゛カウンタ4をクリアする。従つてカウ
ンタ4の出力は、ある帳票が検出器に達してから次の帳
票が到達する迄の時間である。しかもページ・リーダ・
タイプで読取る際も、読取りのため帳票を一時停止して
いる間は走行信号11が“0゛であるためカウンタ4の
カウント値は更新されない。一方、ジヤム検出用の時間
として上記タロツク周期で割つた時間指定値14をレジ
スタ5に予めセツトしておき、これと上記カウンタ4の
出力を比較器6で比較し、後者が前者を越えたときジヤ
ム検出信号を出力する。上記内容は、更に簡略された形
で第2図に示す如く達成できる。FIG. 1 is a block diagram of a jam detection circuit. The running signal 11 is a control signal for running the form on the running road, and is output from a control unit such as a microprocessor (not shown). For example, when the logic level is ``1'', the motor is driven to convey the form, and when the logic level is ``0'', the motor is stopped. This running signal 11 is input to an AND circuit j7.
The other input to the AND circuit 7 is the clock pulse 12, which is output from a control section (not shown). Therefore, when the running signal 11 is '1', the clock pulse 12 is output from the AND circuit 7. The output of the AND circuit 7 becomes the count up signal 1 of the counter 4. This is a signal indicating the presence or absence of a form, and the signal is a1 when a form is detected, and a0 when no form is detected.The detector is composed of, for example, a light emitting element and a light receiving element.When the detector output 13 is ゜"1" When the one-shot circuit 2 operates, its output 3 clears the counter 4. Therefore, the output of the counter 4 is the time from when a certain form reaches the detector until when the next form arrives. Moreover, the page reader
When reading by type, the count value of the counter 4 is not updated because the running signal 11 is "0" while the form is temporarily stopped for reading.On the other hand, the count value of the counter 4 is not updated as the time for jam detection. The specified time value 14 is set in the register 5 in advance, and this is compared with the output of the counter 4 by the comparator 6, and when the latter exceeds the former, a jam detection signal is output.The above content can be further simplified. This can be achieved as shown in FIG.
カウンタ25のカウント・ダウン信号21は、タロツク
パルス12と帳票の走行状態を示す走行信号11の論理
積を論理積回路22でとつたものであり、走行信号11
が“1゛のときカウントダウン信号21としてタロツク
パル512を出力する。帳票が走行路上のある検出器に
達すると検出器出力13によりワンシヨツト回路23が
動作し、カウンタロード信号24を発生する。このカウ
ンタロード24によりカウンタ25には予め設定されて
いるジヤム検出のための時間指定値14がロードされセ
ツトされる。カウンタ25は帳票が検出器に達してから
クロツクパルス12を入力する毎にカウントダウンして
いき、次の帳票が同検出器に達する迄にカウント値が零
に達したときジヤム検出信号を出力する。〔発明の効果
〕
本発明により、ドキユメント・リーダ・タイプとページ
・リーダ・タイプに共通なジヤム検出機能を有する紙送
り制御回路が安価に実現できる。The count down signal 21 of the counter 25 is obtained by calculating the AND of the tally pulse 12 and the running signal 11 indicating the running state of the form in an AND circuit 22.
When the countdown signal 21 is "1", the tally pulse 512 is outputted as the countdown signal 21. When the bill reaches a detector on the road, the one shot circuit 23 is activated by the detector output 13, and a counter load signal 24 is generated. 24, a preset time designation value 14 for jam detection is loaded and set in the counter 25.The counter 25 counts down every time the clock pulse 12 is input after the form reaches the detector. A jam detection signal is output when the count value reaches zero before the next form reaches the same detector. [Effects of the Invention] The present invention makes it possible to detect jams common to document reader types and page reader types. A paper feed control circuit with a detection function can be realized at low cost.
又、同一機でドキユメント・リーダとして、又ページリ
ーダとしての機能をもたせるような場合、何ら変更なく
容易に切替えができる。Furthermore, if the same device is to have the functions of a document reader and a page reader, the switching can be done easily without any changes.
第1図はこの発明の一実施例を示すプロツタ図、第2図
は他の実施例を示すプロツク図である。
2・・・・・・ワンシヨツト回路、4・・・・・・カウ
ンタ、5・・・・・ルジスタ、6・・・・・・比較器、
23・・・・・・ワンシヨツト回路、25・・・・・・
カウンタ。FIG. 1 is a plotter diagram showing one embodiment of the invention, and FIG. 2 is a plotter diagram showing another embodiment. 2...One shot circuit, 4...Counter, 5...Registor, 6...Comparator,
23... One shot circuit, 25...
counter.
Claims (1)
路と、走行路上の帳票の有無を検出する検出器と、該検
出器が帳票の先端を検出したとき予め設定された時間値
がセットされ、前記クロックパルスを入力する毎に減算
を行なうカウンタと、次の帳票が前記検出器で検出され
る前に前記カウンタの値が零に達したときジャムを検出
することを特徴とする紙送り制御回路。1. A circuit that outputs a clock pulse when a form is in a running state, a detector that detects the presence or absence of a form on the road, and a preset time value set when the detector detects the leading edge of the form, and A paper feed control circuit comprising: a counter that performs subtraction every time a clock pulse is input; and a paper jam is detected when the value of the counter reaches zero before the next document is detected by the detector.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1069877A JPS5952132B2 (en) | 1977-02-04 | 1977-02-04 | Paper feed control circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1069877A JPS5952132B2 (en) | 1977-02-04 | 1977-02-04 | Paper feed control circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5398672A JPS5398672A (en) | 1978-08-29 |
| JPS5952132B2 true JPS5952132B2 (en) | 1984-12-18 |
Family
ID=11757499
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1069877A Expired JPS5952132B2 (en) | 1977-02-04 | 1977-02-04 | Paper feed control circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5952132B2 (en) |
-
1977
- 1977-02-04 JP JP1069877A patent/JPS5952132B2/en not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5398672A (en) | 1978-08-29 |
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