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JPS6035753B2 - Tape position detection device - Google Patents
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JPS6035753B2 - Tape position detection device - Google Patents

Tape position detection device

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Publication number
JPS6035753B2
JPS6035753B2 JP14635878A JP14635878A JPS6035753B2 JP S6035753 B2 JPS6035753 B2 JP S6035753B2 JP 14635878 A JP14635878 A JP 14635878A JP 14635878 A JP14635878 A JP 14635878A JP S6035753 B2 JPS6035753 B2 JP S6035753B2
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JP
Japan
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tape
shift register
period
signals
rotation period
Prior art date
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JP14635878A
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賢 吉田
慶一 山内
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Pioneer Corp
Original Assignee
Pioneer Electronic Corp
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Publication date
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  • Length Measuring Devices With Unspecified Measuring Means (AREA)
  • Indexing, Searching, Synchronizing, And The Amount Of Synchronization Travel Of Record Carriers (AREA)

Description

【発明の詳細な説明】 本発明はテープレーダにおけるテープの現在位置を自動
的に検出するテープ位置検出装置に関するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a tape position detection device that automatically detects the current position of a tape in a tape radar.

テープレコーダのテープ位置表示としてはテープカウン
タがあるが、これは機械的に特作するものであるから正
確なテープ位置を求めることは不可能である。またテー
プカウンタではテープ走行量及びテープ残量を共に表示
することは困難であるが、かかる表示の要求は多い。本
発明の目的は正確なテープ現在位置を知ることが可能で
かつ、テープ走行量及びテープ残量を同時に知ることが
可能なテープ位置検出装置を提供することである。
A tape counter is used to display the tape position of a tape recorder, but since this is a special mechanical device, it is impossible to determine the exact tape position. Further, although it is difficult for a tape counter to display both the amount of tape running and the remaining amount of tape, there are many requests for such display. SUMMARY OF THE INVENTION An object of the present invention is to provide a tape position detection device that can accurately determine the current tape position and simultaneously determine the amount of tape travel and the remaining amount of tape.

いまサプライリール及びテークアツプリールの任意の時
刻における回転周期をそれぞれTs及びTtとし、両リ
ールにおけるテープ巻き径が共に等しい時刻からのテー
プ走行時間を△tとすると、次式が成立する。
Now, let Ts and Tt be the rotation periods of the supply reel and the take-up reel at arbitrary times, respectively, and let Δt be the tape running time from the time when both reels have the same tape winding diameter, then the following equation holds true.

rS2−Tぜ=k・△t ・・・・
・・{1}ここにkはテープ速度、テープ厚さ及びテー
プ長により定まる定数である。
rS2-Tze=k・△t...
...{1} Here, k is a constant determined by the tape speed, tape thickness, and tape length.

{1}式は各周期の2乗の差の形で表わされているが、
これを各周期の差で示すと次式のように変形される。T
s−Tt=k′(ノtn−△t−ノtn−△t).・・
.・・‘21ここにk′及びtnは定数を示す。
The formula {1} is expressed in the form of the difference of the squares of each period, but
If this is expressed as a difference between each period, it is transformed as shown in the following equation. T
s-Tt=k'(notn-Δt-nottn-Δt).・・・
.. ...'21 where k' and tn represent constants.

‘2}式において、△t′/m=×,Ts−Tt=yと
おくと糊式が得られる。y=k(ノ1−×−ノ1十×)
……{31この【3}式において、k=k′ノtn
を簡単のために100/ノ2としてグラフを描くと第1
図に示す如くなる。
In the equation '2}, by setting Δt'/m=x and Ts-Tt=y, a glue equation can be obtained. y=k (No1-x-No10x)
...{31 In this formula [3}, k=k'nottn
For simplicity, if we draw a graph as 100/no2, the first
The result will be as shown in the figure.

同図から明白な如く、xが−0.7<×<0.7の範囲
では、xとyの値はリニアな比例関係となっており両者
は1対1に対応できることが分る。すなわち、両リール
の回転周期の差y(Ts−Tt)を求めれば、△t(両
リールのテープ巻き径が共に等しい時刻からのテープ走
行時間)を直ちに得ることが可能となるものである。従
って、本発明のテープ位置検出装置は、両リールの各回
転周期にそれぞれ応じた第1及び第2の回転周期信号を
発生する手段と、この第1及び第2の回転周期信号を用
いて両リールの回転周期の差に対応した差信号を発生す
る手段と、この差信号を所定タイミングで1時記憶する
記憶手段とを含み、この記憶手段の記憶内容をテープ位
置情報とすることを特徴とするものである。
As is clear from the figure, in the range of -0.7<x<0.7, the values of x and y have a linear proportional relationship, and it can be seen that they can correspond one to one. That is, by finding the difference y (Ts-Tt) between the rotation periods of both reels, it is possible to immediately obtain Δt (the tape running time from the time when the tape winding diameters of both reels are equal). Therefore, the tape position detection device of the present invention includes means for generating first and second rotation period signals corresponding to each rotation period of both reels, and means for generating first and second rotation period signals corresponding to each rotation period of both reels. It is characterized by comprising means for generating a difference signal corresponding to the difference in the rotation period of the reels, and a storage means for temporarily storing this difference signal at a predetermined timing, and the storage contents of the storage means are used as tape position information. It is something to do.

好ましい実施態様としては、第1及び第2の回転周期信
号は両リールの回転周期にそれぞれ対応したパルス中を
有するパルス信号であり、差信号を発生する手段として
所定情報が予め書込まれた可逆シフトレジスタを用い、
第1及び第2の回転周期信号が共に発生している期間は
シフトレジスタのシフト動作を停止せしめ、第1の回転
周期信号のみが発生している期間はシフトレジスタの内
容を1方向シフトせしめ、更に第2の回転周期信号のみ
が発生している期間は他方向へシフトせしめるように制
御することを特徴とする。
In a preferred embodiment, the first and second rotation period signals are pulse signals having pulses corresponding to the rotation periods of both reels, and the means for generating the difference signal is a reversible signal in which predetermined information is written in advance. Using a shift register,
The shift operation of the shift register is stopped during a period when both the first and second rotation period signals are generated, and the contents of the shift register are shifted in one direction during a period when only the first rotation period signal is generated; Furthermore, it is characterized in that control is performed to shift in the other direction during a period in which only the second rotation period signal is generated.

ここでシフトレジスタのプリセットすべき所定情報を2
値情報とし、当該レジスタの中間段(真中のビット段)
には例えば“1”情報を、他のビット段にはすべて“0
”情報をプリセットロードしておき、このレジスタのプ
リセット情報を、第1及び第2パルスのパルス中の差(
すなわち両IJールの回転周期の差)に応じて右ないし
は左シフトすることにより、“1”情報のシフトレジス
タ内におけるビット段の位置が正確にテープ現在位置を
示すことになる。
Here, the predetermined information to be preset for the shift register is set to 2.
As value information, the middle stage (middle bit stage) of the relevant register
For example, “1” information is stored in “1” information, and “0” information is stored in all other bit stages.
"Preset information is loaded, and the preset information in this register is calculated as the difference between the first and second pulses (
In other words, by shifting to the right or left according to the difference in rotation period of both IJ wheels, the position of the bit stage in the shift register of "1" information accurately indicates the current tape position.

従って、“1”情報の存在するビット段を基準にして左
側のビット数がテープ走行量を、また右側のビット数が
テープ銭量をそれぞれ示すとになりこれを所定の表示装
置により表示せしめることによって、同時にテープ走行
量及び残量が表示可能となる。
Therefore, based on the bit stage where "1" information exists, the number of bits on the left side indicates the amount of tape travel, and the number of bits on the right side indicates the amount of tape, and these are displayed on a predetermined display device. This allows the amount of tape travel and remaining amount to be displayed at the same time.

以下、本発明について図面を用いて説明する。Hereinafter, the present invention will be explained using the drawings.

第2図aは本発明の実施例を示す概略ブロック図である
。図において、テークアツプリール及びサプライリール
(図示しない)の回転周期をそれぞれ検出するためにフ
オトカプラla,lbが設けられている。各フオトカプ
ラla,lbの発光及び受光素子間にはリール台の回転
に伴って回転する回転板をそれぞれ設け、この回転板の
各々には所定スリットを等間隔に形成しておくことによ
り、各フオトカプラla,lbの出力にはリール台の回
転速度に応じてパルス信号が発生される。これらのパル
ス信号は各波形整形回路2a,2bにより整形増中され
て次段の1/n分周器3a,3bに入力される。各分周
器3a,3bの出力A及びBはそれぞれァンド(論理積
)ゲート4a,4bの1入力となり、アンドゲート4a
,4bの各出力C及びDは可逆シフトレジスタ5のシフ
ト制御入力S,及びS2にそれぞれ印加されると共に、
更にJ−K型フリップフロップ(FF)6a及び6bの
各クロツク入力ckへも印加されている。
FIG. 2a is a schematic block diagram showing an embodiment of the invention. In the figure, photocouplers la and lb are provided to detect the rotation periods of a take-up reel and a supply reel (not shown), respectively. A rotary plate that rotates with the rotation of the reel stand is provided between the light emitting and light receiving elements of each photocoupler la, lb, and predetermined slits are formed at equal intervals in each of the rotary plates. Pulse signals are generated at the la and lb outputs in accordance with the rotational speed of the reel stand. These pulse signals are shaped and multiplied by each waveform shaping circuit 2a, 2b and input to the next stage 1/n frequency divider 3a, 3b. The outputs A and B of each frequency divider 3a and 3b become one input of AND gates 4a and 4b, respectively, and the AND gate 4a
, 4b are respectively applied to shift control inputs S and S2 of a reversible shift register 5, and
Furthermore, it is applied to each clock input ck of JK type flip-flops (FF) 6a and 6b.

このJ−K型FF6a,6bのJ,K入力には共に高レ
ベル(十B電圧)が常に印加され、各出力Qがそれぞれ
アンドゲート4a,4bの各他入力となっている。
A high level (10B voltage) is always applied to both the J and K inputs of the JK type FFs 6a and 6b, and each output Q serves as the other input of the AND gates 4a and 4b, respectively.

これらアンドゲート4a,4bの各出力C及びDは更に
パルス中検出用のオア(論理和)ゲート7に印加され、
このオアゲート出力Eは単安定マルチ8のトリガ入力と
なり、また単安定マルチ8の出力日ま次段の単安定マル
チ9のトリガ入力となる。この単安定マルチ9の出力G
は1/n分周器3a,3b及びFF6a,6bの各クリ
ア入力CLとなっている。更に、シフトレジスタの並列
ディジタル信号を記憶するラッチ回路10が設けられ、
このラッチ回路10の書込指令タイミングが単安定マル
チ8の出力Fとなっている。
The outputs C and D of these AND gates 4a and 4b are further applied to an OR gate 7 for detecting during pulses,
This OR gate output E becomes the trigger input of the monostable multi 8, and the output of the monostable multi 8 also becomes the trigger input of the monostable multi 9 in the next stage. The output G of this monostable multi-9
serves as each clear input CL of the 1/n frequency dividers 3a, 3b and FFs 6a, 6b. Furthermore, a latch circuit 10 for storing parallel digital signals of the shift register is provided,
The write command timing of this latch circuit 10 is the output F of the monostable multi-channel 8.

そしてラッチ回路10の出力を用いて所望の表示器11
を表示駆動する構成とする。いまここで、第2図bに示
すように、可逆シフトレジスタ5の動作モードは、その
制御入力S,及びS2の各レベルの組合せにより左右シ
フト、シフト動作停止更にはプリセット指令が行われる
ように構成されているものとし、“L”は低レベルを、
“H”は高レベルの制御信号を示す。
Then, the output of the latch circuit 10 is used to select a desired display 11.
The configuration is such that the display is driven. Now, as shown in FIG. 2b, the operation mode of the reversible shift register 5 is such that left/right shift, shift operation stop, and preset command are performed depending on the combination of the respective levels of the control inputs S and S2. "L" means low level,
"H" indicates a high level control signal.

そしてシフトレジスタ5のシフト動作速度はシフトパル
ス発生器12よりのシフトパルスによりなされる。第3
図は第2図aに示す回路の1動作態様における各部動作
波形を示すもので、第2aと同等部分は同一符号により
示されている。
The shift operation speed of the shift register 5 is determined by a shift pulse from a shift pulse generator 12. Third
The figure shows operating waveforms of each part in one operation mode of the circuit shown in FIG. 2a, and parts equivalent to those in FIG. 2a are indicated by the same reference numerals.

第3図では、テークアップリールの回転周期Ttがサプ
ライリールの周期口sよりも短く、かつ任意の時刻らを
基準にしてフオトカプラlaの出力信号が早く発生した
場合(すなわち、テークアツプリール例のパルスが早く
発生した場合)を示すもので、各リールの1回転毎にn
個のパルスが各フオトカプラla,lbの出力から発生
されるものとする。従って、1/n分周器3aの出力A
は時刻けこ続くテークアップリール側のパルス発生タイ
ミングt,にて高レベルとなり、1周期Ttの半分の期
間t,〜ら高レベルを維持し、後の半分の期間で低レベ
ルとなる。同様に分周器3bの出力Bは時刻t,より遅
れて時亥比2にて高レベルとなり、1周期Tsの半分の
期間L〜t4高レベルを維持し、後低レベルとなる。期
間ら〜t,においてはFF6a,6b共にリセツト状態
にあって、各出力Qは共に高レベルにあり、またアンド
ゲートの他入力A,Bは共に低レベルであるから、各ゲ
ート出力C及びDは低レベルとなっている。
In FIG. 3, the rotation period Tt of the take-up reel is shorter than the cycle opening s of the supply reel, and the output signal of the photocoupler la is generated earlier than an arbitrary time (i.e., in the example of the take-up reel). (when the pulse occurs quickly), and for each rotation of each reel, n
It is assumed that pulses are generated from the output of each photocoupler la, lb. Therefore, the output A of the 1/n frequency divider 3a
becomes a high level at the pulse generation timing t on the take-up reel side that continues for a long time, maintains a high level from t to a half period of one cycle Tt, and becomes a low level during the latter half period. Similarly, the output B of the frequency divider 3b becomes a high level at a time ratio of 2 after time t, maintains a high level for a period of half of one cycle Ts from L to t4, and then becomes a low level. During periods t to t, both FFs 6a and 6b are in the reset state, each output Q is both at high level, and other inputs A and B of the AND gate are both at low level, so each gate output C and D is at a low level. is at a low level.

この低レベル出力がシフトレジスタ5の制御入力S,及
びS2にそれぞれ印加されており、このときシフトレジ
スタ5には並列ディジタル信号INがプリセットロード
ミれうる。このときの信号を、レジスタの真中のビット
のみを“1”に他を“0”とするような情報としておく
ものとする。時刻t,〜t3の間はアンドゲート4aの
2入力は共に高レベルであるから、出力Cも高レベルと
なり、時亥比2〜t4の間も同様にアンドゲート4bの
出力Dは高レベルとなっている。
This low level output is applied to the control inputs S and S2 of the shift register 5, respectively, and at this time, the shift register 5 can be preset loaded with a parallel digital signal IN. The signal at this time is assumed to be information such that only the middle bit of the register is set to "1" and the others are set to "0". Since the two inputs of the AND gate 4a are both at a high level between times t and t3, the output C is also at a high level, and the output D of the AND gate 4b is also at a high level during a time period from 2 to t4. It has become.

時刻肌3においてアンドゲート4aの出力Cは低レベル
へ遷移すると同時にFF6aの状態が反転し、その出力
Qは低レベルに変化し、次のクリャ入力CLが高レベル
になるまでこの状態は維持される。従って、分周器3a
の出力Aが以後高レベルとなっても、アンドゲート4a
の出力Cは高レベルとならない。よって期間L〜t4の
間すなわちリールの回転の遅い方の回転周期Tsの大略
半分の期間Ts/2にそれぞれ、アンドゲート4a,4
bの出力C及びDには両リールの回転周期に対応したパ
ルス中(Tt/2,Ts/2)を有するパルス1ケずつ
が発生されることになる。これら各出力パルスC,Dに
よりシフトレジスタ5のシフト動作が制御されるから、
第3図印こ示すように期間ら〜t2では右シフト、期間
ら〜t3ではシフト停止、期間郡3〜【4では左シフト
がなされる。
At time scale 3, the output C of the AND gate 4a transitions to a low level, and at the same time the state of the FF 6a is reversed, its output Q changes to a low level, and this state is maintained until the next clear input CL goes to a high level. Ru. Therefore, frequency divider 3a
Even if the output A of the AND gate 4a becomes high level from then on,
The output C of does not become high level. Therefore, during the period L to t4, that is, during the period Ts/2, which is approximately half the rotation period Ts of the slower reel rotation, the AND gates 4a and 4 are activated, respectively.
One pulse each having pulses (Tt/2, Ts/2) corresponding to the rotation period of both reels is generated at the outputs C and D of b. Since the shift operation of the shift register 5 is controlled by these output pulses C and D,
As shown by the mark in FIG. 3, a shift is made to the right in periods t2 to t2, a shift is stopped in periods t3 to t3, and a left shift is made in periods 3 to 4.

この左シフトと右シフトの期間の差力汀s−Ttを示し
ていることは明白であるから、シフトレジスタ5のシフ
ト前のプリセツトロードされた情報(中間位置に“1”
情報がロードされている状態が周期の差Ts−Ttに対
して、本列ではより左シフトされた位置従って、テープ
の中間位置よりもテープ開始位置に近い方にシフトされ
ていることになる。このシフトされた情報をラッチ回路
10へ記憶する。
It is clear that this shows the difference in force between the left shift and right shift periods s-Tt.
The state in which information is loaded is shifted to the left in this column with respect to the period difference Ts-Tt, and therefore is shifted closer to the tape start position than to the middle position of the tape. This shifted information is stored in the latch circuit 10.

そのためにパルス中検出用のオアゲート7を用い、パル
ス中の長いパルスDの終期(立上り)で次段の単安定マ
ルチをトリガして、その出力Fの立上り(t5)のタイ
ミングでラッチ回路10の書込指令をなす。この書込指
令信号Fの立上りにより単安定マルチ9がトリガされ、
その出力Gの立上り(t6)のタイミングにより、再び
テープ位置検出を行うべく、分周器3a,3b,FF6
a,6bをクリヤするものである。ここで、テープ厚さ
やテープ長が異なる場合にはシフトレジスタのシフト動
作速度を定めるシフトパルスの発振周波数を変化させる
ことにより、適正な表示が可能である。
For this purpose, an OR gate 7 for detecting during a pulse is used, and the next stage monostable multi is triggered at the end (rising edge) of the long pulse D during the pulse, and the latch circuit 10 is activated at the timing of the rising edge (t5) of the output F. Make a write command. The monostable multi 9 is triggered by the rise of this write command signal F,
At the timing of the rising edge (t6) of the output G, frequency dividers 3a, 3b and FF6 are used to detect the tape position again.
This clears a and 6b. Here, if the tape thickness or tape length is different, proper display can be achieved by changing the oscillation frequency of the shift pulse that determines the shift operation speed of the shift register.

また同機にテークアツプリールの回転周期Ttよりもサ
プライリールの回転周期Tsが短い場合もシフトレジス
タ5のシフト動作が制御され、右シフト動作期間が長く
なって、テープ中間位置よりもテープ終端に近い方にテ
ープが来たことを示すことになる。
In addition, when the rotation period Ts of the supply reel is shorter than the rotation period Tt of the take-up reel in the same machine, the shift operation of the shift register 5 is controlled, and the right shift operation period becomes longer and the position is closer to the end of the tape than the middle position of the tape. This will indicate that the tape has come towards you.

第4図は、ラツチ回路10の出力を表示するための表示
器の1例を示すもので、シフトレジスタ5のビット数に
対応した数のセグメント素子(発光ダイオード等)11
0を配列して、シフトレジスタ5の内容に応じて各素子
を点灯せしめることにより、テープ位置表示が可能とな
り、テープ走行量及びテープ残量が一度に目視可能であ
ることがわかる。
FIG. 4 shows an example of a display for displaying the output of the latch circuit 10, in which the number of segment elements (light emitting diodes, etc.) 11 corresponds to the number of bits of the shift register 5.
It can be seen that by arranging 0's and lighting each element according to the contents of the shift register 5, the tape position can be displayed, and the amount of tape travel and the remaining amount of tape can be visually checked at the same time.

尚、上記実施例における、各リールの回転周期に対応し
たパルス中を有するパルス発生手段や、パルス中の長い
方のパルスの終期を検出する手段、更には表示器等はこ
れら構成に限定されるものではなく種々の改変が可能で
ある。
In addition, in the above embodiment, the pulse generating means having a pulse corresponding to the rotation period of each reel, the means for detecting the end of the longer pulse among the pulses, the display device, etc. are limited to these configurations. Various modifications are possible.

第5図は本発明の他の実施例を示す図であり、第2図に
示した回路及びその動作をマイクロプロセッサ、例えば
マイクロコンピュータ100を用いて行う場合の概略ブ
ロック図を示す。
FIG. 5 is a diagram showing another embodiment of the present invention, and is a schematic block diagram in which the circuit shown in FIG. 2 and its operation are performed using a microprocessor, for example, the microcomputer 100.

両図において同等部分は同一符号により示されており、
両リールの回転により生ずるパルスは共に1/0ボート
101を介してCPU102へ入力され処理される。C
PUI02内においては所定のプログラムによりこれら
パルス信号に基づき両リールの回転周期に応じたそれぞ
れの信号が得られ、これ等信号に対応して1/0ボート
103より、シフトレジスタ5の左右シフト指令信号,
停止指令信号及びプリセット指令信号等が発生される。
そして予め書込まれた情報(州)がこれら指令信号に応
じて左右シフトされて、両リールの回転周期の差△Tを
示す情報がシフトレジスタ内にホールドされる。このホ
ールドされた内容を所定タイミングにて再びCPUへ論
込み記憶し、1/0ボート104を介して表示手器11
により表示すればテープ位置表示が可能となることは明
白である。
Equivalent parts in both figures are indicated by the same symbols.
Pulses generated by the rotation of both reels are both input to the CPU 102 via the 1/0 port 101 and processed. C
In the PUI 02, signals corresponding to the rotation periods of both reels are obtained based on these pulse signals by a predetermined program, and in response to these signals, a left/right shift command signal for the shift register 5 is sent from the 1/0 boat 103. ,
A stop command signal, a preset command signal, etc. are generated.
The information (state) written in advance is shifted left and right in response to these command signals, and information indicating the difference ΔT between the rotation periods of both reels is held in the shift register. This held content is stored in the CPU again at a predetermined timing, and is sent to the display device 11 via the 1/0 boat 104.
It is obvious that the tape position can be displayed by displaying the following.

このシフトレジスタ5及びシフトパルス発生器12をも
CPU内に合させて構成することも可能である。
It is also possible to configure this shift register 5 and shift pulse generator 12 so that they fit inside the CPU.

以上述べた如く、本発明のテープ位置検出装置によれば
テープ位置の正確な検出が簡単な構成により可能でかつ
、テープ走行量及び残量が同時に検出でき、更には、シ
フトレジスタへのプリセットロードをいつ行つても正確
なテープ位置表示がなされるという利点がある。
As described above, according to the tape position detection device of the present invention, it is possible to accurately detect the tape position with a simple configuration, the amount of tape traveling and the remaining amount can be detected at the same time, and furthermore, the tape position detection device of the present invention can detect the tape position accurately with a simple configuration, can simultaneously detect the amount of tape traveling and the remaining amount, and can also perform preset loading to the shift register. This has the advantage that the tape position can be displayed accurately no matter when.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の原理を説明するグラフ、第2図aは本
発明の一実施例を示す図、第2図bはシフトレジスタの
動作モードを説明する図、第3図は第2図aの各部動作
波形図、第4図は表示器の1例を示す図、第5図は本発
明の他の実施例を示すブロック図である。 主要部分の符号の説明、1・・・・・・フオトカプラ、
3…・・・分周器、4・・・・・・アンドゲート、5・
・・・・・シフトレジスタ、10…・・・ラッチ回路、
12・・・・・・シフトパルス発生器、100・・・・
・・マイクロコンピュータ。 第4図 券/図 第3図 図 N 球 繁5図
FIG. 1 is a graph explaining the principle of the present invention, FIG. 2 a is a diagram showing an embodiment of the present invention, FIG. 2 b is a diagram explaining the operation mode of the shift register, and FIG. FIG. 4 is a diagram showing an example of a display device, and FIG. 5 is a block diagram showing another embodiment of the present invention. Explanation of the symbols of the main parts, 1...Photocoupler,
3... Frequency divider, 4... AND gate, 5.
...Shift register, 10...Latch circuit,
12...Shift pulse generator, 100...
...Microcomputer. Figure 4 Ticket/Figure Figure 3 Figure N Baseball number 5 Figure

Claims (1)

【特許請求の範囲】 1 テークアツプリール及びサプライリールの各回転周
期にそれぞれ応じた第1及び第2の回転周期信号を発生
する手段と、前記第1及び第2の回転周期信号を用いて
前記テークアツプリール及びサプライリールの回転周期
の差に対応した差信号を発生する手段と、前記差信号を
所定のタイミングで記憶する記憶手段と、前記記憶手段
の記憶内容をテープ位置情報として表示する表示手段を
含むテープ位置検出装置であつて、前記第1及び第2の
回転周期信号は前記テークアツプリール及びサプライリ
ールの各回転周期にそれぞれ対応したパルス巾を有する
信号であり、前記差信号を発生する手段は所定情報が予
め書込まれた可逆シフトレジスタを有し、前記第1及び
第2の回転周期信号が共に発生している期間は前記シフ
トレジスタのシフト動作を停止せしめ、前記第1の回転
周期信号のみが発生しいる期間は前記シフトレジスタの
内容を1方向へシフトせしめ、更に前記第2の回転周期
信号のみが発生している期間は前記シフトレジスタの内
容を他方向へシフトせしめるように構成されていること
を特徴とするテープ位置検出装置。 2 前記所定情報は2値情報よりなり、前記シフトレジ
スタの中間段に前記2値情報の1つを書込み、残余の段
には前記2値情報信号の他の1つを書込むことを特徴と
する特許請求の範囲第1項記載のテープ位置検出装置。
[Scope of Claims] 1. Means for generating first and second rotation period signals corresponding to the respective rotation periods of the take-up reel and the supply reel, and means for generating the first and second rotation period signals using the first and second rotation period signals, respectively. means for generating a difference signal corresponding to the difference in rotation period between the take-up reel and the supply reel; a storage means for storing the difference signal at a predetermined timing; and a display for displaying the stored contents of the storage means as tape position information. the first and second rotation period signals are signals having pulse widths corresponding to respective rotation periods of the take-up reel and the supply reel, and generate the difference signal. The means for doing so has a reversible shift register in which predetermined information is written in advance, and stops the shifting operation of the shift register during a period in which both the first and second rotation period signals are generated, and During a period when only the rotation period signal is generated, the contents of the shift register are shifted in one direction, and during a period when only the second rotation period signal is generated, the contents of the shift register are shifted in the other direction. A tape position detection device comprising: 2. The predetermined information is composed of binary information, and one of the binary information signals is written in an intermediate stage of the shift register, and the other one of the binary information signals is written in the remaining stages. A tape position detection device according to claim 1.
JP14635878A 1978-11-27 1978-11-27 Tape position detection device Expired JPS6035753B2 (en)

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