JPS6045477B2 - How to control a vending machine - Google Patents
How to control a vending machineInfo
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- JPS6045477B2 JPS6045477B2 JP52068479A JP6847977A JPS6045477B2 JP S6045477 B2 JPS6045477 B2 JP S6045477B2 JP 52068479 A JP52068479 A JP 52068479A JP 6847977 A JP6847977 A JP 6847977A JP S6045477 B2 JPS6045477 B2 JP S6045477B2
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- JP
- Japan
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- product
- sold
- column
- sales
- processing unit
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Management, Administration, Business Operations System, And Electronic Commerce (AREA)
- Control Of Vending Devices And Auxiliary Devices For Vending Devices (AREA)
Description
【発明の詳細な説明】
本発明は、中央処理装置によつて自動販売機の各種端末
部品を集中制御する自動販売機の制御方式に関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a control system for a vending machine in which various terminal parts of the vending machine are centrally controlled by a central processing unit.
従来、マイクロCPU等の中央処理装置によつて自動販
売機の構成部品である各種スイッチや表示器を集中制御
する自動販売機では、中央処理装置とこれら各端末部品
とを一対一で結線するのが一般的である。Conventionally, in vending machines where the various switches and displays that are the components of the vending machine are centrally controlled by a central processing unit such as a micro CPU, the central processing unit and each of these terminal parts are connected one-to-one. is common.
したがつて中央処理装置には多数の入出力端子が必要で
あり、配線数も多くなつて組立時における配線処理は非
常に面倒である。そして中央処理装置は各端末部品と信
号の授受を行うのに複雑な制御を必要とする。上記点よ
り本発明は、中央処理装置と各端末部品との間の配線を
効果的に削減するとともに、処理が容易な自動販売機の
制御方法を提供するものである。Therefore, the central processing unit requires a large number of input/output terminals, and the number of wires increases, making wiring processing very troublesome during assembly. The central processing unit requires complex control to send and receive signals to and from each terminal component. In view of the above points, the present invention provides a method of controlling a vending machine that effectively reduces the wiring between the central processing unit and each terminal component and that is easy to process.
かかる目的を達成するために本発明は、商品販売コラム
毎に1本の伝送線を具備して対応する販売価格設定手段
・商品売切検知手段・商品選択スイッチ・商品売切表示
手段及び販売可能表示手段を接続するとともに、中央処
理装置に制御により特定の前記伝送線をアクティブにす
るバスセット手段を設け、第1ステップて前記中央処理
装置は該バスセットの制御により前記伝送線を順次1本
づつアクティブにして商品販売コラム毎に販売価格デー
タ・商品売切情報・商品選択スイッチの操作を検出する
とともに、投入金額に応じて当該商)品販売コラムの商
品販売の可否を判定し、商品選択スイッチが操作されて
いないと第2ステップで、前記中央処理装置は前記バス
セット手段の制御により前記商品売切表示手段及び前記
販売可能表示手段にそれぞれ前記商品売切情報及び商品
販5売の可能性を表示するようにしたものである。In order to achieve such an object, the present invention provides a sales price setting means, a product sold-out detection means, a product selection switch, a product sold-out display means, and a product sellable unit that includes one transmission line for each product sales column. In addition to connecting the display means, bus set means is provided for activating specific transmission lines under control of the central processing unit, and in a first step, the central processing unit sequentially sets the transmission lines one by one under control of the bus set. The product is activated one by one to detect sales price data, product sold-out information, and product selection switch operations for each product sales column, and also determines whether or not the product in that product sales column can be sold according to the input amount, and selects the product. If the switch is not operated, in a second step, the central processing unit controls the bus set means to display the product sold-out information and the product sales possibility on the product sold-out display means and the sellable display means, respectively. It is designed to indicate gender.
このような構成により中央処理装置はバスセット手段を
制御することで、商品販売コラム毎に種々の情報を導入
するとともに、商品の売切表示及び商品販売の可能性表
示を行う。以下図面により本発明の一実施例を詳述する
。With such a configuration, the central processing unit controls the bus set means to introduce various pieces of information for each product sales column, and also to display the sold-out product and the possibility of product sales. An embodiment of the present invention will be described in detail below with reference to the drawings.
第1図は5コラムの自動販売機に本発明を適用したもの
である。したがつてバスライン5は5本の伝送経路より
成り、各伝送経路51,52,53,54,55には対
応のコラムの商品売切検知スイッチ2、選択スイッチ3
、販売可能表示ランプ7、売切表示ランプ6、価格設定
部4が接続されている。バスライン5の各伝送経路51
,52,53,54,55は、5段の遅延フリップフロ
ップ回路より成るシフトレジスタ8の各段に接続されて
その出力状態に応じて導通、不導通が制御される。例え
ば本実施例に於いてはシフトレジスタ8の成る段の出力
状態がROョにあると対応の伝送経路が導通するように
回路設計されている。勿論Rl.Jとなつたときに導通
するような回路設計も可能であり、とにかく導通せしめ
る伝送経路に対応する段が他の段と異なる出力状態とな
るようにシフトレジスタ8を制御すれば良いことが明白
となろう。また5個の切換スイッチ41よりなる価格設
定部4は夫々対応コラムの商品価格を設定するものて各
切換スイッチは1・2・4●8・16の重みをもち各々
を0N(出力ROョ)若しくはOFF(出力r1ョ)す
ることで商品価格を2進コードで設定できるように構成
される。そして各切換スイッチ41より5bitの伝送
ライン16でパラレルに示される商品価格情報はシフト
レジスタ89に入つてシリアル情報に変換されてCPU
lに入力するよう設計されている。またROMlOには
第2図に示すフローチャートに沿つたプログラムが記憶
されておりCPUlはプログラムを読取つて実行してい
く。第2図のフローチャートによつて動作を説明してい
く。FIG. 1 shows the present invention applied to a five-column vending machine. Therefore, the bus line 5 consists of five transmission paths, and each transmission path 51, 52, 53, 54, 55 has a sold-out detection switch 2 and a selection switch 3 in the corresponding column.
, a sellable indicator lamp 7, a sold-out indicator lamp 6, and a price setting section 4 are connected. Each transmission path 51 of the bus line 5
, 52, 53, 54, and 55 are connected to each stage of the shift register 8 consisting of five stages of delay flip-flop circuits, and are controlled to be conductive or non-conductive in accordance with their output states. For example, in this embodiment, the circuit is designed so that when the output state of the stage of the shift register 8 is RO, the corresponding transmission path becomes conductive. Of course Rl. It is also possible to design a circuit that conducts when the transmission path becomes conductive, and it is clear that the shift register 8 should be controlled so that the stage corresponding to the transmission path to be rendered conductive has a different output state from the other stages. Become. In addition, the price setting unit 4 consisting of five changeover switches 41 sets the product price of the corresponding column, and each changeover switch has a weight of 1, 2, 4, 8, and 16, and each has a weight of 0N (output RO). Alternatively, by turning it OFF (output r1), the product price can be set in binary code. Then, the product price information shown in parallel on the 5-bit transmission line 16 from each changeover switch 41 enters the shift register 89, is converted into serial information, and is sent to the CPU.
It is designed to be input to Further, the ROM10 stores a program according to the flowchart shown in FIG. 2, and the CPU1 reads and executes the program. The operation will be explained using the flowchart shown in FIG.
先ず電源投入にて初期状態1NITを経てバスセットモ
ードに達するとバスラインのうちCPUlが走査すべき
コラムとCPUl間の伝送経路のみが導通するように処
理される。伝送経路51のみが導通するにはシフトレジ
スタ8の各段の出力Ql,Q2,Q,,Q,,Q5が夫
々ROJrljrlJrlJrlョ・となれば良くCP
Ulはシフトレジスタ8がこの状態となるように処理を
行なう。First, when the power is turned on and the bus set mode is reached after going through the initial state 1NIT, only the transmission path between the column to be scanned by CPU1 among the bus lines and CPU1 is made conductive. In order for only the transmission path 51 to be conductive, the outputs Ql, Q2, Q, , Q, , Q5 of each stage of the shift register 8 should each be ROJrljrlJrlJrlyo・CP.
Ul performs processing so that the shift register 8 is in this state.
シフトレジスタ8の構成及び動作タイミングチャートを
第3図および第4図に示す。即ちCPUlは遅延フリッ
プフロップ回路11にI/Oボート121端を介してシ
フトパルスCPlを出力すると共にI/Oボート12h
端を介して1段目の遅延フリップフロップ回路11に5
bitのデータRlJrlョ RlJrlJrlョRO
Jを順次出力する。そのために1bit目のシフトパル
スの立上がりでデータ入力の内容がQ1出力に現われ、
2bit目のシフトパルスの立上がりで1bit目のQ
1出力の内容がQ2出力に現われると共にQ1出力には
2bit目のデータ入力の内容が現われ以下同様の動作
によつて5bit目のシフトパルスによつて各段の出力
はROJrlJrlJrlJrlJとなるわけである。The configuration and operation timing chart of the shift register 8 are shown in FIGS. 3 and 4. That is, the CPUl outputs the shift pulse CPl to the delay flip-flop circuit 11 via the I/O boat 121 end, and also outputs the shift pulse CPl to the I/O boat 12h.
5 to the first stage delay flip-flop circuit 11 through the end.
bit data RlJrlyo RlJrlJrloRO
Output J sequentially. Therefore, the contents of the data input appear on the Q1 output at the rising edge of the 1st bit shift pulse,
The Q of the 1st bit changes at the rising edge of the 2nd bit shift pulse.
The content of the 1st output appears on the Q2 output, and the content of the 2nd bit data input appears on the Q1 output, and in the same manner, the output of each stage becomes ROJrlJrlJrlJrlJ by the 5th bit shift pulse.
尚タイミングチャートにおいてはQ1からqまでの出力
波形で点線で示した部分はこの動作に入る前にシフトレ
ジスタ8が保持していた内容でr1ョ或いはROJであ
るが5bit目のシフトパルスCPlの立上りで全て消
滅する。In the timing chart, the output waveform from Q1 to q, indicated by the dotted line, is the content held in the shift register 8 before entering this operation, and is r1 or ROJ, but it is the rising edge of the 5th bit shift pulse CP1. It all disappears.
こうしてバスセットモードで伝送経路51が導通可能と
なるとこれに対応したコラムの走査をCPUlは開始す
る。When the transmission path 51 becomes conductive in the bus set mode, the CPU1 starts scanning the corresponding column.
先ず売切れ判定モードに於いてはCPUlはI/Oボー
ト12d端を開いて信号が入力し得る状態にしている。
商品売切検知スイッチ2はコラム内の商品が無くなると
0Nするものであり売切れであれば伝送経路51及び売
切スイッチ2を介してシフトレジスタのQ1出力ROJ
がCPUlに入力しこのコラムの商品切れを検出するこ
とができる。従つて商品切れであればROJをそして商
品切れで無ければRlJを内部に備えたスクラッチバッ
ドレジスタに記憶する。販売価格入力モードに於いてC
PUlはI/0ボート12e◆f端より夫々シフトパル
スCP2及びPL信号を出力して価格設定部7の価格情
報を読取る。第6図及び第7図はシフトレジスタ9の構
成及び動作タイミングチャートを示す。例えば・伝送経
路51に対応する価格設定部4の設定価格が100円で
あるとシフトレジスタ8のQ1出力RlJにより5bi
t伝送ライン16を介して価格情報ROJrlJlOJ
rlJrOJが5段の遅延フリップフロップ回路13で
構成されたjシフトレジスタ9の1から5までの入力端
子にPL信号の到来で入力する。First, in the sold-out determination mode, the CPU 1 opens the I/O port 12d so that a signal can be input.
The product sold-out detection switch 2 turns 0N when the product in the column runs out, and if the product is sold out, the Q1 output ROJ of the shift register is sent via the transmission path 51 and the sold-out switch 2.
is input to CPU1, and it is possible to detect out-of-stock items in this column. Therefore, if the product is out of stock, ROJ is stored in the internal scratch bad register, and if the product is not out of stock, RlJ is stored in the internally provided scratch bad register. C in sales price input mode
PU1 outputs shift pulse CP2 and PL signals from the I/0 ports 12e◆f ends, respectively, and reads price information from the price setting section 7. 6 and 7 show the structure and operation timing chart of the shift register 9. FIG. For example, if the price set by the price setting unit 4 corresponding to the transmission path 51 is 100 yen, the Q1 output RlJ of the shift register 8 will result in 5bi
Price information ROJrlJlOJ via t transmission line 16
When the PL signal arrives, rlJrOJ is input to input terminals 1 to 5 of the j shift register 9, which is composed of a five-stage delay flip-flop circuit 13.
そして以下繰出される5bitのシフトパルスCP2に
よつてシフトレジスタ9はシフトアップし最後段の遅延
フリップフロップ回路13より価格情報ROョ RlJ
ROJrlJrOJをシリアルにI/0ボート12g端
を介してCPUlに出力するのである。Then, the shift register 9 is shifted up by the 5-bit shift pulse CP2 sent out, and the price information RO/RlJ is sent from the delay flip-flop circuit 13 at the last stage.
ROJrlJrOJ is serially output to the CPU1 via the I/0 port 12g end.
第7図のタイミングチャートは5段の遅延フリップフロ
ップ回路13の各段の出力状況をA,B,C,D,Eの
波形で示し、特にEは5bitのシフトパルスCP2の
入力に伴なつてCPUlにシリアルに出力される価格情
報である。販売可判定モードはCPUlに入力された価
格情報及び前記スクラッチバッドレジスタに記憶した売
切判定の結果に基づいてこのコラムの商品が販売できる
かの判定を行なうものである。The timing chart in FIG. 7 shows the output status of each stage of the 5-stage delay flip-flop circuit 13 using waveforms A, B, C, D, and E. In particular, E shows the output status of each stage of the 5-stage delay flip-flop circuit 13. This is price information that is serially output to the CPU1. In the sellability determination mode, it is determined whether the product in this column can be sold based on the price information input to the CPU1 and the result of the sold-out determination stored in the scratchpad register.
先に述べたように本発明は自動販売機の販売待機状態で
の制御方式であり、投入金額が有ればこの額と上述の入
力してくる価格情報とをCPUlは比較演算して販売可
の判定を行なう。また投入金額が無い場合もOと価格情
報を比較演算するが当然販売可能とな判定されない。こ
の販売可の判定結果もCPUlは販売可能な場合はRO
、不可能な場合はRLとして前記スクラッチバッドレジ
スタに記憶する。セレクシヨンモードは伝送経路51に
対するコラムの選択スイッチ3が動作されたかを検出す
るものである。As mentioned earlier, the present invention is a control method for a vending machine in the sales standby state, and if there is an input amount, the CPU compares and calculates this amount with the above-mentioned input price information and sells it. Make a judgment. Further, even if there is no input amount, O and the price information are compared and calculated, but naturally it is not determined that the product can be sold. If the CPU1 is sellable, the result of this judgment is RO
, if this is not possible, store it in the scratch bad register as RL. The selection mode detects whether the column selection switch 3 for the transmission path 51 is operated.
選択スイッチ3は図示されていないが販売可状態で動作
された場合ON状態が商品の送出が確認されるまで維持
されるように構成されている。したがつて0Nの場合C
PUlにはI/0ボート12c端を介してROJが入力
して販売動作の開始を検出することができる。故にRO
ョの入力によつてCPUlは販売ルーチンに飛出して販
売制御を行なう。選択スイッチ3が動作されていないと
最上位コラム判定モードに達する。Although the selection switch 3 is not shown, it is configured so that when it is operated in the sales ready state, the ON state is maintained until delivery of the product is confirmed. Therefore, in the case of 0N, C
ROJ is input to PU1 via the I/0 boat 12c end, and the start of a sales operation can be detected. Therefore R.O.
In response to the input, CPU1 jumps to the sales routine and performs sales control. If the selection switch 3 is not operated, the highest column determination mode is reached.
このモードではいままで走査したコラムが最後のコラム
であるかを判定して他に走査すべきコラムであればバス
セット+1モードに移行する。以上述べてきた走査は、
シフトパルスCPlが5bit出力されてシフトレジス
タの状態がROJrlJrlJrlJrlJとなつたと
きに行なわれるものであり、次のコラムの走査を行なう
には伝送経路52が導通するようにシフトレジスタ8の
出力のみがRO,JとなるようにCPUlはバスセット
する。In this mode, it is determined whether the column scanned so far is the last column, and if there is another column to be scanned, the mode shifts to bus set +1 mode. The scanning described above is
This is performed when 5 bits of shift pulse CPl are output and the state of the shift register becomes ROJrlJrlJrlJrlJ. To scan the next column, only the output of the shift register 8 is set to RO so that the transmission path 52 becomes conductive. , J, the CPU1 sets the bus.
したがつてこのモードに於いてCPUlはデータRlJ
<56bit目のシフトパルスCPlをシフトレジスタ
(8)に出力するとその出力状態がRlJrOJrlJ
rlョr1ョとなつて再び伝送経路5にに対応するコラ
ムの売切れ判定、販売価格入力、販売可判定、セレクシ
ヨンという一連の前述の走査が実行されてここでもこの
コラムの選択スイッチ3の動作が無ければ再びバスセッ
トちモードに到達する。Therefore, in this mode, CPUl has data RlJ.
<When the 56th bit shift pulse CPl is output to the shift register (8), its output state is RlJrOJrlJ
Then, the above-mentioned series of scans including the sold-out determination, sales price input, sale availability determination, and selection of the column corresponding to the transmission path 5 are executed again, and the operation of the selection switch 3 of this column is also performed here. If not, the bus set mode is reached again.
そしてCPUlはデータ0しと7bit目のシフトパル
スCPlをシフトレジスタ8に出力し伝送経路53を導
通させて対応コラムの走査が再6開始される。このよう
にした各コラムの走査が実行されるなかで何れの選択ス
イッチ3も動作されずに最上位コラム判定モードに5た
び到達するとCPUlは9bitのシフトパルスを出力
したことから全てのコラムの走査が完了したことを検出
してコラム走査のステップより表示のステップに移る。
いまコラム走査のステップで売切れが伝送経路52,5
4に対応するコラムであることが検出されてこのことを
前記スクラッチバッドレジスタによつてRlJrOJr
lJrOJrlJと記憶されているものとして説明して
いく。Then, when the data is 0, the CPU1 outputs the shift pulse CP1 of the 7th bit to the shift register 8, the transmission path 53 is made conductive, and scanning of the corresponding column is restarted. While the scanning of each column is executed in this way, when the topmost column determination mode is reached five times without operating any of the selection switches 3, the CPU outputs a 9-bit shift pulse, and therefore all columns are scanned. When the column scanning step is detected to have been completed, the column scanning step proceeds to the display step.
Now, in the column scanning step, the transmission path 52, 5 is sold out.
It is detected that the column corresponds to RlJrOJr.
The following explanation assumes that it is stored as lJrOJrlJ.
先ずバスセットモードでCPUlはおよびスクラッチバ
ッドレジスタの記憶に基づくデータRlJrOJrlJ
rO.UrlJ(55bitのシフトパルスCPlをシ
フトレジスタ8に出力する。このタイミングチャートは
第5図に示すが動作は第4図と同様であり5bit目の
シフトパルスCPlによつてデータが全てシフトレジス
タ8に書込まれて出力状態がRlJrOJrlJrOJ
rlJとなりバスセットされる。即ち伝送経路52,5
4が導通可能となつたわけである。First, in the bus set mode, CPUl and data RlJrOJrlJ based on the memory of the scratch bad register.
rO. UrlJ (outputs a 55-bit shift pulse CPl to the shift register 8. This timing chart is shown in FIG. 5, but the operation is the same as that in FIG. Written and output state is RlJrOJrlJrOJ
rlJ and the bus is set. That is, the transmission paths 52, 5
4 became conductive.
然る往QPUlは売切れ表示ONモードでI/0ボート
12b端よりトランジスタ14のベースにRlJを出力
すると伝送経路52,54が導通可能であるところから
表示ランプし,L4が点灯して売切れを表示することが
できる。However, when the output QPUl outputs RlJ from the I/0 boat 12b end to the base of the transistor 14 in the sold-out display ON mode, an indicator lamp lights up from where the transmission paths 52 and 54 are conductive, and L4 lights up to indicate that it is sold out. can do.
そして所定時間の点灯後売切れ表示OFFモードではI
/0ボート12b端よりのRlJ出力を停止して消灯す
るのである。次に販売可能状態を表示するための動作と
なる。And in the sold-out display OFF mode after lighting for a predetermined time, I
The RlJ output from the /0 port 12b end is stopped and the light is turned off. The next step is to display the sales availability status.
この動作も売切れ表示と同杆CPUlは前記スクラッチ
バッドレジスタに記憶した販売可判定データをシフトレ
ジスタ8に5bitのシフトパルスと共に導入してバス
セットし販売可能コラムに対応する伝送経路を導通可能
とする。このとき投入金額が無い場合若しくは有つても
何れの販売価格に達していない場合は販売可判定データ
は゛1..RlJrl..rlJrlJで導通不能であ
る。This operation is also the same as the sold-out display.The CPU 1 inputs the sellable determination data stored in the scratch bad register to the shift register 8 along with a 5-bit shift pulse to set the bus and enable conduction of the transmission path corresponding to the sellable column. . At this time, if there is no input amount, or if there is, but the selling price has not been reached, the sellability determination data is set to 1. .. RlJrl. .. Conduction is not possible at rlJrlJ.
然る篠?PUlは■/Oボート12a端よりトランジス
タ15のベースにRlJを出力し+V2が販売可能表示
ランプL″1,L″2,L″3,L″4,L″5に印加
される。販売可表示を所定時間行なつた後投入金額表示
ルーチンに到達してCPUlは投入金額表示動作を実行
する。Shino? PUl outputs RlJ from the terminal of the /O boat 12a to the base of the transistor 15, and +V2 is applied to the sellable display lamps L''1, L''2, L''3, L''4, L''5.Saleable. After displaying for a predetermined period of time, the input amount display routine is reached and the CPU1 executes the input amount display operation.
然る後フローチャートにおいてCPUlの処理はコラム
走査のステップに復帰して貨幣が投入されていない場合
若しくは投入されていなくても未だ選択スイッチ3が動
作されていない場合はここまでの動作が繰返して行なわ
れる。また当然貨幣が投入若しくは追加投入されたりし
て販売可の状態が変化すると、CPUlは次の販売可判
定モードで金額に応じて販売可能な商品を決定し、表示
のステップではそれに合つた販売可表示を行なう。本発
明は、商品販売コラム毎に伝送線を設けてこの伝送線に
は当該コラムの端末部品を共通接続するために、中央処
理装置と端末部品間の配線の削減を大巾に図れる。Thereafter, in the flowchart, the processing of the CPU1 returns to the column scanning step, and if no coins have been inserted, or if the selection switch 3 has not been operated even if coins have not been inserted, the operations up to this point are repeated. It will be done. Naturally, when money is inserted or additional money is inserted and the sellable status changes, the CPU1 determines the sellable products according to the amount in the next sellable determination mode, and in the display step, the sellable products that match the sellable products are determined. Perform display. In the present invention, a transmission line is provided for each product sales column, and the terminal parts of the column are commonly connected to this transmission line, so that the wiring between the central processing unit and the terminal parts can be greatly reduced.
そしてバスセット手段により商品販売コラム毎の伝送線
を順次アクティブにして、コラム毎に情報の読取りや商
品売切れ表示及び商品の販売可能表示を行うために、制
御が簡単であるばかりか誤動作が少くなる。The bus set means sequentially activates the transmission line for each product sales column to read information and display products sold out and available for sale for each column, which not only simplifies control but also reduces malfunctions. .
第1図は本発明制御方式を適用した自動販売機を示し、
第2図は動作フローチャート、第3図、第4図、第5図
はシフトレジスタ8の論理回路と動作タイミングチャー
ト、第6図及び第7図はシフトレジスタ9の論理回路と
動作タイミングチャートを示す。
主な図番の説明1・・・中央処理装置、2・・・商品売
切検知手段、3・・・販売指令発生手段、4・・・販売
価格設定手段、5・・・バスライン、6・・・商品売切
表示手段、7・・・販売可能表示手段。FIG. 1 shows a vending machine to which the control method of the present invention is applied,
FIG. 2 shows an operation flowchart, FIGS. 3, 4, and 5 show the logic circuit and operation timing chart of the shift register 8, and FIGS. 6 and 7 show the logic circuit and operation timing chart of the shift register 9. . Explanation of main drawing numbers 1...Central processing unit, 2...Product sold out detection means, 3...Sales command generation means, 4...Sales price setting means, 5...Bus line, 6 ...Merchandise sold out display means, 7...Sale available display means.
Claims (1)
知手段・商品選択スイッチ・商品売切表示手段及び販売
可能表示手段の各端末部品を備えた自動販売機において
、商品販売コラム毎に1本の伝送線を具備して対応する
前記端末部品を接続するとともに、中央処理装置に制御
により特定の前記伝送線をアクティブにするバスセット
手段を設け、第1ステップで前記中央処理装置は該バス
セット手段の制御により前記伝送線を順次1本づつアク
ティブにして商品販売コラム毎に販売価格データ・商品
売切情報・商品選択スイッチの操作を検出するとともに
、投入金額に応じて当該商品販売コラムの商品販売の可
否を判定し、商品選択スイッチが操作されていないと第
2ステップで、前記中央処理装置は前記バスセットの制
御により前記商品売切表示手段及び前記販売可能表示手
段にそれぞれ前記商品売切情報及び商品販売の可能性を
表示するようにした自動販売機の制御方式。1. In a vending machine that is equipped with terminal parts such as a sales price setting means, a product sold-out detection means, a product selection switch, a product sold-out display means, and a sellable display means for each product sales column, one for each product sales column. transmission lines to connect the corresponding terminal parts, and a bus set means for activating a specific transmission line under control of the central processing unit, and in a first step, the central processing unit activates the specified bus set. By controlling the means, the transmission lines are sequentially activated one by one to detect sales price data, product sold-out information, and product selection switch operations for each product sales column, and to detect products in the product sales column according to the input amount. It is determined whether or not the product can be sold, and if the product selection switch is not operated, in a second step, the central processing unit, under the control of the bus set, indicates the product sold out display means and the saleable display means, respectively. A control method for a vending machine that displays information and product sales possibilities.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52068479A JPS6045477B2 (en) | 1977-06-09 | 1977-06-09 | How to control a vending machine |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52068479A JPS6045477B2 (en) | 1977-06-09 | 1977-06-09 | How to control a vending machine |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS543597A JPS543597A (en) | 1979-01-11 |
| JPS6045477B2 true JPS6045477B2 (en) | 1985-10-09 |
Family
ID=13374853
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP52068479A Expired JPS6045477B2 (en) | 1977-06-09 | 1977-06-09 | How to control a vending machine |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6045477B2 (en) |
-
1977
- 1977-06-09 JP JP52068479A patent/JPS6045477B2/en not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS543597A (en) | 1979-01-11 |
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