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JPS6054756B2 - induction heating cooker - Google Patents
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JPS6054756B2 - induction heating cooker - Google Patents

induction heating cooker

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Publication number
JPS6054756B2
JPS6054756B2 JP13375480A JP13375480A JPS6054756B2 JP S6054756 B2 JPS6054756 B2 JP S6054756B2 JP 13375480 A JP13375480 A JP 13375480A JP 13375480 A JP13375480 A JP 13375480A JP S6054756 B2 JPS6054756 B2 JP S6054756B2
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power
output
signal
induction heating
voltage
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JP13375480A
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実 深沢
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Sanyo Electric Co Ltd
Original Assignee
Sanyo Electric Co Ltd
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Publication date
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Description

【発明の詳細な説明】 本発明は、誘導加熱調理器に関し、特に誘導加熱コイル
に加わる電圧及び電流を検出して、負荷にて消費される
電力を算出し、予め設定された入力レベルと比較しなが
ら常に設定電力が供給されるよう電力制御を行なうこと
を目的とする。
Detailed Description of the Invention The present invention relates to an induction heating cooker, and in particular detects the voltage and current applied to the induction heating coil, calculates the power consumed by the load, and compares it with a preset input level. The purpose is to perform power control so that the set power is always supplied.

従来、この種電磁調理器における電力制御方法として、
誘導加熱コイルに流れる負荷電流を検出し、この負荷電
流のピークを増減させることによつて行なう方法が知ら
れているが、かかる方法では、電流が正確に負荷に供給
される電力を反映するものではないため、電力の制御に
正確を期することは困難であつた。すなわち、鉄を含む
金属材料よりなる調理鍋を加熱する場合、鉄の含有量或
は温度変化によつて磁気特性、固有オーミック抵抗が異
なるため調理鍋への入力電力は変化する。この入力電力
を検出して、予め設定した電力に一致させる際、負荷電
流のみ検出したのでは、正しく入力電力を反映しないた
め、完全な電力制御はできなかつたのである。
Conventionally, as a power control method for this type of induction cooker,
It is known to do this by detecting the load current flowing through an induction heating coil and increasing or decreasing the peak of this load current; however, such methods do not ensure that the current accurately reflects the power delivered to the load. Therefore, it was difficult to ensure accurate power control. That is, when heating a cooking pot made of a metal material containing iron, the input power to the cooking pot changes because the magnetic properties and inherent ohmic resistance vary depending on the iron content or temperature changes. When detecting this input power and making it match the preset power, if only the load current was detected, the input power would not be reflected correctly, making complete power control impossible.

本発明は、このような負荷への入力電力を正しく検出し
、所定の電力レベルに一致するよう操作することにより
、実際に調理鍋に供給される電力を正確に制御できたも
のである。
The present invention makes it possible to accurately control the power actually supplied to the cooking pot by correctly detecting the input power to such a load and operating it to match a predetermined power level.

以下本発明実施例を図を参照しながら詳述する。Embodiments of the present invention will be described in detail below with reference to the drawings.

第1図において、1は誘導加熱調理器を示し、上面にセ
ラミック板等耐熱性絶縁基板よりなるトッププレート2
が設けられ、この上に負荷となる調理鍋(図示せず)が
載置される。調理鍋は鉄或はステンレス等鉄を含む金属
にて形成される。3は、交流電源が供給されるプラグ、
4は電源スイッチ、5は入力電力調節用スライド摘み、
6は発光ダイオード等よりなる入力電力表示部で、W(
ワット)数を4桁数字にて表示する。
In Fig. 1, reference numeral 1 indicates an induction heating cooker, and the top plate 2 is made of a heat-resistant insulating substrate such as a ceramic plate on the upper surface.
A cooking pot (not shown) serving as a load is placed on top of the cooking pot. The cooking pot is made of metal containing iron, such as iron or stainless steel. 3 is a plug to which AC power is supplied;
4 is a power switch, 5 is a slide knob for adjusting input power,
6 is an input power display section consisting of a light emitting diode etc., W(
(watts) is displayed as a 4-digit number.

この表示部6にて検出電力と設定電力が一致したとき、
その値がディジタル表示される。第2図A、B、Cは、
本発明実施回路を示し、’7は、商用交流電源、4は電
源スイッチ、8はダイオードをブリッジ接続してなる整
流回路、9はチョークコイル、10は平滑コンデンサ、
11は誘導加熱コイルで、平板状に巻回され、トッププ
レート2裏面に近接して配置されている。
When the detected power and the set power match on this display unit 6,
The value is displayed digitally. Figure 2 A, B, and C are
7 shows a commercial AC power supply, 4 a power switch, 8 a rectifier circuit formed by bridge-connecting diodes, 9 a choke coil, 10 a smoothing capacitor,
Reference numeral 11 denotes an induction heating coil, which is wound into a flat plate shape and placed close to the back surface of the top plate 2.

12は門誘導加熱コイル11と直列接続されたスイッチ
ング素子で、本実施例では、半導体スイッチング素子G
CS(ゲート、コントロールド・スイッチ)(商品名)
を使用している。
12 is a switching element connected in series with the gate induction heating coil 11, and in this embodiment, a semiconductor switching element G
CS (Gate, Controlled Switch) (Product name)
are using.

13は、GCS12のアノード、力ソート間に逆並列に
接続されたフライホイールダイオード、14は共振コン
デンサであり、これら誘導加熱コイル11、GCSl2
、フライホィールダイオード13および共振コンデンサ
14にてインバータ15が構成される。
13 is a flywheel diode connected in antiparallel between the anode and power sort of GCS12, 14 is a resonant capacitor, and these induction heating coil 11, GCSl2
, a flywheel diode 13, and a resonant capacitor 14 constitute an inverter 15.

20は誘導加熱コイル11に近接配置される調理鍋、R
l,R2は平滑コンデンサ14に並列接続された分割抵
抗で、分割点より電圧V1が取り出される。
20 is a cooking pot arranged close to the induction heating coil 11;
1 and R2 are dividing resistors connected in parallel to the smoothing capacitor 14, and the voltage V1 is taken out from the dividing point.

R,,R4は共振コンデンサ14に並列接続された分割
抵抗で、分割点より電圧V2が取り出される。21は誘
導加熱コイル11に流れる電流を検出するカレント・ト
ランスである。
R, , R4 are dividing resistors connected in parallel to the resonant capacitor 14, and voltage V2 is taken out from the dividing point. 21 is a current transformer that detects the current flowing through the induction heating coil 11.

第3図は、上記インバータ各部の電流および電圧波形を
示し、加熱運転中にあつては、共振コンデンサ1牡ダイ
オード13、GCSl2の両端の電圧■εは、江水共振
回路の動作により共振コンデンサ14と平滑コンデンサ
10により電荷の授受が行なわれる。
FIG. 3 shows the current and voltage waveforms of each part of the inverter. During heating operation, the voltage ε across the resonance capacitor 1 Ω diode 13 and the GCSl 2 increases due to the operation of the Emizu resonance circuit. Charge is transferred and received by the smoothing capacitor 10.

そして電圧V6〈0となつた時点で、GCSl2のゲー
ト信号VGを切換え、これをオンとすると誘導加熱コイ
ル11に流れる電流1Lが増加し始めるが、この電流値
は、カレント・トランス21にて検出されて電圧変換さ
れ基準電圧V。に対応する電流1。に達したとき、ゲー
ト信号VOを負に切換え、GCSl2をオフとする。こ
れにより、回路動作は再び■λ共振となり、以後同様の
動作が繰返され発振が継続する。かかる調理器において
トッププレート2上に調理鍋20が置かれた場合、鍋の
固有オーミック抵抗および誘導加熱コイル11の巻線抵
抗は、誘導加熱コイル11と抵抗の直列回路と等価であ
り、かつ誘導加熱コイル11の巻線抵抗は非常に小さ一
いから、誘導加熱コイル11の両端の電圧■,および電
流hを検知することにより負荷への入力電力を検知する
ことかてきる。すなわち瞬時人力電力p(t)はで表わ
されるから、発振一周期(T)間の電力Pは1式をT期
間積分して ―)′―−1′ で求められる。
When the voltage V6 becomes <0, the gate signal VG of the GCSl2 is switched on and the current 1L flowing through the induction heating coil 11 starts to increase, but this current value is detected by the current transformer 21. The voltage is converted to the reference voltage V. Current 1 corresponding to . When it reaches, the gate signal VO is switched to negative and GCS12 is turned off. As a result, the circuit operation becomes ■λ resonance again, and the same operation is repeated thereafter and oscillation continues. When the cooking pot 20 is placed on the top plate 2 in such a cooker, the inherent ohmic resistance of the pot and the winding resistance of the induction heating coil 11 are equivalent to a series circuit of the induction heating coil 11 and the resistor, and Since the winding resistance of the heating coil 11 is very small, the input power to the load can be detected by detecting the voltage (2) and current h across the induction heating coil 11. That is, since the instantaneous human power p(t) is expressed as, the power P during one oscillation period (T) can be obtained by integrating equation 1 over a period of T as follows: -)'--1'.

2式を書きかえると、 ここで、Rは、負荷の固有オーミック抵抗である。Rewriting equation 2, we get Here, R is the inherent ohmic resistance of the load.

3式より電流1L(t)を制御することにより入力電力
制御が可能なことがわかる。
It can be seen from equation 3 that the input power can be controlled by controlling the current 1L(t).

それ故人力電力が小さい場合は、Iし(t)を増大させ
ればよいがこのIし(t)は基準電圧V。により制御さ
れるから、かかる場合、電圧V。のレベルを増大させれ
ばよいことになる。他方逆に入力電力を減少させたい場
合、電圧V。を低下させればよい。続いて、第2B,C
図に基いて、入力電力制御回路を詳述する。
Therefore, when the human power is small, it is sufficient to increase I(t), but this I(t) is the reference voltage V. In such a case, the voltage V. It would be better to increase the level of . On the other hand, if you want to decrease the input power, use the voltage V. All you have to do is lower it. Next, 2nd B and C
The input power control circuit will be described in detail based on the diagram.

22は、演算増幅器で、8入力端子に電圧信号■1が、
また8入力端子に電圧信号V2がそれぞれ抵抗R5を介
して入力する。
22 is an operational amplifier, and the voltage signal 1 is input to the 8 input terminals.
Further, a voltage signal V2 is inputted to each of the eight input terminals via a resistor R5.

この演算増幅器22の出力は、抵抗R5,R6にて設定
される増幅率にて増幅される。この信号V4は、抵抗R
7を介して次段の対数変換器23に入力され出力V5を
得る。
The output of this operational amplifier 22 is amplified by an amplification factor set by resistors R5 and R6. This signal V4 is connected to the resistor R
7 to the logarithmic converter 23 at the next stage to obtain an output V5.

ここで、Kは、ボルツマン定数、qは電子の電荷量、α
は電流増幅率1E3はトランジスタ24のベース・エミ
ッタ間の逆方向電流である。
Here, K is Boltzmann's constant, q is the amount of charge of the electron, and α
The current amplification factor 1E3 is the reverse current between the base and emitter of the transistor 24.

25は、カレント・トランス21により検出された電流
が分割抵抗R8,R9を介して電圧信号V3に変換され
、入力される対数変換器で出力V6を得る。
25, the current detected by the current transformer 21 is converted into a voltage signal V3 via dividing resistors R8 and R9, and is inputted to a logarithmic converter to obtain an output V6.

上記信号V5および信号V6は、それぞれ抵抗RlO,
RlOを介して、ともに演算増幅器26のe入力端子に
加えられる。この演算増幅器26は、加算器として利用
されるもので、出力V,を得る。この加算信号■7は、
次段の逆対数変換器27に入力され、出力V8を得る。
上記4式ないし8式より、 この出力信号■8は、積分器28に入力されT期間積分
される。
The above signal V5 and signal V6 are connected to resistors RlO and RlO, respectively.
Both are applied to the e input terminal of operational amplifier 26 via RIO. This operational amplifier 26 is used as an adder and obtains an output V. This addition signal ■7 is
The signal is input to the antilogarithmic converter 27 at the next stage, and an output V8 is obtained.
From equations 4 to 8 above, this output signal ①8 is input to the integrator 28 and integrated over a period of T.

この積分器28は、コンデンサC1および放電用のアナ
ログスイッチ30を含1.▼爪1!l身イ^^1S,赫
心n鉤吊讐Si′一日崗冑日−1かかる積分器28出力
として信号V,を得る。この信号V9は、次段の演算増
幅器29を介して増幅され、スライド摘み5の操作によ
り設定された電圧信号Vpと比較可能な電圧信号に変換
される。かくして演算増幅器29出力として信号VlO
を得る。式9,@,5より ここで、A=ト・占・:I5=・計(但し上記信号Vl
Oは、第2C図に示す演算増幅器30の4入力端子に加
えられる。
This integrator 28 includes a capacitor C1 and an analog switch 30 for discharging.1. ▼Claw 1! A signal V is obtained as the output of the integrator 28. This signal V9 is amplified via the next-stage operational amplifier 29 and converted into a voltage signal that can be compared with the voltage signal Vp set by the operation of the slide knob 5. Thus, as the output of the operational amplifier 29, the signal VlO
get. From formula 9, @, 5, here, A = t.
O is applied to the four input terminals of operational amplifier 30 shown in FIG. 2C.

演算増幅器30のe入力端子には、入力電力設定用スラ
イド摘み5の操作により電圧値が変化する可変抵抗Rl
8の出力V,が加えられる。31は、信号■,を1入力
端子に、また信号VlOをo入力端子に入力する演算増
幅器、32,33は、インバータ、34は演算増幅器3
0,31の各出力がそれぞれインバータ32,33を経
て入力されるアンドゲートで、その出力にてアナログス
イッチ35が開閉制御される。
The e input terminal of the operational amplifier 30 has a variable resistor Rl whose voltage value changes according to the operation of the input power setting slide knob 5.
8 outputs V, are added. 31 is an operational amplifier that inputs the signal ■, to the 1 input terminal and the signal VlO to the o input terminal, 32 and 33 are inverters, and 34 is the operational amplifier 3.
This is an AND gate in which the respective outputs of 0 and 31 are input via inverters 32 and 33, respectively, and the analog switch 35 is controlled to open and close by the output.

このアナログスイッチ35は、信号VlOを比較器36
へ入力する線路間に設けられたもので、上記アンドゲー
ト34出力がHレベル信号のときスイッチ35が開成し
、信号V,Oが比較器36の4入力端子に加わることに
なる。比較器36の8入力端子にはラダー回路37から
の階段状電圧信号が加わる。ラダー回路37は、クロッ
ク発振器38からのクロックパルスCKを入力する2進
カウンタ39と、このカウンタ39の出力にて抵抗Rl
6,Rl8・・・を選択して順次低レベル電位より高電
位レベル信号を出力する。40はクロック発振器38か
らのクロックパルスCKを受けてこれを計数するw進カ
ウンタで、上記2進カウンタ39とともに、タイマー4
1の立上り信号にて計数を開始し、立下り信号にてリセ
ットされる。
This analog switch 35 connects the signal VlO to a comparator 36.
When the output of the AND gate 34 is an H level signal, the switch 35 is opened and the signals V and O are applied to the four input terminals of the comparator 36. A stepped voltage signal from a ladder circuit 37 is applied to eight input terminals of the comparator 36. The ladder circuit 37 includes a binary counter 39 which inputs the clock pulse CK from the clock oscillator 38, and a resistor Rl at the output of this counter 39.
6, Rl8, . . . and sequentially output higher potential level signals from the lower potential level. 40 is a W-adic counter that receives and counts clock pulses CK from the clock oscillator 38, and together with the binary counter 39, the timer 4
Counting starts with a rising signal of 1 and is reset with a falling signal.

このタイマー41の信号出力期間は、少なくともラダー
回路39出力のレベル数に対応したクロックパルス数が
出力する期間以上に設定される。42は、10進カウン
タ40の内容を記憶するラッチ回路で、比較器36の出
力にて動作する。
The signal output period of this timer 41 is set to be at least longer than the period during which the number of clock pulses corresponding to the number of levels of the output of the ladder circuit 39 is output. 42 is a latch circuit that stores the contents of the decimal counter 40, and is operated by the output of the comparator 36.

43はラッチ回路42の内容をコード変換するデコーダ
、6は、このデコーダ43の内容を表示する前記表示部
である。
43 is a decoder that converts the contents of the latch circuit 42 into a code, and 6 is the display section that displays the contents of this decoder 43.

かくすれば、タイマー41出力にて2進カウンタ39お
よびw進カウンタ40が計数開始しラダー回路37より
出力された電位が信号■10以上に達すると、比較器3
6の出力は、HレベルからLレベルに反転し、このとき
のw進カウンタ40の内容は、ラッチ回路42に保持さ
れる。このラッチ回路42の記憶内容は、デコーダ43
を介して表示部6に表示され、電力表示がなされる。そ
の後タイマー41出力信号の立下りにより2進、w進カ
ウンタ39,40はリセットされ最初の状態に戻る。4
4は、電源信号Vsを抵抗Rl,,R2O,R2lにて
分割して得た信号を4入力端子に、また演算増幅器30
の出力をθ入力端子に入力する演算増幅器、45は、上
記演算増幅器44の出力Vllを4入力端子にまたカレ
ント・トランス21からの検出信号VcTをθ入力端子
に入力する比較器で、その出力は、RSフリップフロッ
プ46のリセット端子に入力される。
In this way, when the binary counter 39 and the w-adic counter 40 start counting at the output of the timer 41 and the potential output from the ladder circuit 37 reaches the signal 10 or higher, the comparator 3
6 is inverted from the H level to the L level, and the contents of the W-adic counter 40 at this time are held in the latch circuit 42. The storage contents of this latch circuit 42 are stored in a decoder 43.
The power is displayed on the display unit 6 via the power display. Thereafter, the binary and w-base counters 39 and 40 are reset by the fall of the output signal of the timer 41 and return to the initial state. 4
4, a signal obtained by dividing the power signal Vs by resistors Rl, , R2O, R2l is input to the 4 input terminal, and an operational amplifier 30
The operational amplifier 45 inputs the output of the operational amplifier 44 to the θ input terminal, and is a comparator that inputs the output Vll of the operational amplifier 44 to the 4-input terminal and the detection signal VcT from the current transformer 21 to the θ input terminal. is input to the reset terminal of the RS flip-flop 46.

RSフリップフロップ46のセット出力は、加速用抵抗
R2。およびコンデンサC2を介してゲート駆動回路4
7に加えられ、セット出力のLレベル反転で、駆動回路
47内のトランジスタ48を導通させ、ゲート信号■と
して電圧−Vccを出力し、GCSl2をオフとする。
49は信号V2が入力される端子て、■2が負の値にな
つたときトランジスタ50のベース電位が低下しこれを
オフとする。
The set output of the RS flip-flop 46 is the acceleration resistor R2. and gate drive circuit 4 via capacitor C2.
7, and when the set output is inverted to the L level, the transistor 48 in the drive circuit 47 is made conductive, the voltage -Vcc is outputted as the gate signal (2), and the GCS12 is turned off.
49 is a terminal to which the signal V2 is input; when 2 becomes a negative value, the base potential of the transistor 50 decreases, turning it off.

したがつてトランジスタ50のコレクタ電位は、上昇し
、かかる立上り信号は、CR微分回路51を経てパルス
化され、さらに、インバータ52を介して反転されてR
Sフリップフロップ46のセット入力端子へ入力される
。すなわち、信号■2の負転換により、フリップフロッ
プ46は、セットされ、そのセット出力はHレベルとな
つてゲート駆動回路47内のトランジスタ53を導通さ
せ、信号VOとして電圧+■Ccを得、これによりGC
Sl2は、オンとなる。53は、フリップフロップ46
のリセット出力により動作するトランジスタ、R23,
C3は時定数回路を構成する抵抗およびコンデンサ、5
4は比較器で、フリップフロップ46セット後時定数回
路にて決定される一定時間後にLレベル信号を出力し、
フリップフロップ46をリセットするもので、GCSl
2の最大電流通電時間、すなわち、インバータの最小発
振周波数を設定するはたらきをなす。
Therefore, the collector potential of the transistor 50 rises, and this rising signal is pulsed through the CR differentiating circuit 51 and further inverted through the inverter 52 to become the R
It is input to the set input terminal of the S flip-flop 46. That is, the flip-flop 46 is set by the negative conversion of the signal 2, and its set output becomes H level, making the transistor 53 in the gate drive circuit 47 conductive, and the voltage +Cc is obtained as the signal VO. by GC
Sl2 is turned on. 53 is a flip-flop 46
A transistor operated by the reset output of R23,
C3 is a resistor and a capacitor that constitute a time constant circuit, 5
4 is a comparator which outputs an L level signal after a certain period of time determined by a time constant circuit after setting the flip-flop 46;
This is to reset the flip-flop 46, and the GCSl
It serves to set the maximum current conduction time of No. 2, that is, the minimum oscillation frequency of the inverter.

この最小発振周波数は、可聰音ノイズの発生を防止する
ため約20KHzに設定される。次に検出された電力信
号■,。と、設定された電力レベル■Pがとりうる3つ
のケースについてその動作を説明する。(1)Vl。=
Vpの場合、これは、検出された電力と、設定した電力
とが等しい場合である。このときは演算増幅器30,3
1の出力はともにLレベル、したがつてインバータ32
,33の出力はともにHレベルとなる。それ故アンドゲ
ート34の出力もまたHレベルとなり、アナログスイッ
チ35は閉成される。これにより、信号VlOは、比較
器36に入力しラダー回路37からの出力信号と一致が
とれたとき、このときのラダー回路37出力に対応する
ディジタル信号がラッチ回路42に保持され、その内容
は、表示部6に例えは旧00Wの如くディジタル表示さ
れる。このとき、演算増幅器44のθ入力端子に入力す
る信号は変化しないから、発振周波数もまた変化せす、
一定周波数の発振が継続する。(2)VlO>Vpの場
合検出電力レベルが、設定電力レベルより大きくなつた
場合、演算増幅器30,31の出力はとなるから、アン
ドゲート34の出力は、Lレベルとなりアナログスイッ
チ35はオフとなり表示部6には表示がなされない。
This minimum oscillation frequency is set at approximately 20 KHz to prevent the occurrence of loud noise. Next, the detected power signal ■,. The operation will be explained for three cases in which the set power level ■P can take. (1) Vl. =
For Vp, this is the case when the detected power and the set power are equal. At this time, operational amplifiers 30, 3
Both outputs of 1 are at L level, so the inverter 32
, 33 are both at H level. Therefore, the output of AND gate 34 also becomes H level, and analog switch 35 is closed. As a result, when the signal VlO is input to the comparator 36 and matches the output signal from the ladder circuit 37, the digital signal corresponding to the output of the ladder circuit 37 at this time is held in the latch circuit 42, and its contents are , is digitally displayed on the display unit 6, for example, as in the old 00W. At this time, since the signal input to the θ input terminal of the operational amplifier 44 does not change, the oscillation frequency also changes.
Oscillation at a constant frequency continues. (2) When VlO>Vp When the detected power level becomes larger than the set power level, the outputs of the operational amplifiers 30 and 31 become, so the output of the AND gate 34 becomes L level and the analog switch 35 turns off. No display is made on the display section 6.

一方演算増幅器44の出力Vllはとなる。On the other hand, the output Vll of the operational amplifier 44 is as follows.

VO〉■pであるから、カレント・トランス21より出
力された電圧信号VCTど比較される基準電圧V。は低
下する。したがつて比較器45の出力がLレベルに反転
する時期は早くなり、フリップフロップ46のリセット
およびGCSl2のターン・オフも早くなる。それ故発
振周波数は上昇し、入力電力は低下する。このようにし
て、入力電力が低下し、設定電力レベルと一致した時点
で、表示部6にそのときの電力が表示され、その後、一
定周波数で発振が持続されることとなる。(3)VlO
<Vpの場合 検出電力レベルが設定電力レベルより小さい場合、上記
(2)の例と逆となり、演算増幅器30の出力がLレベ
ル、演算増幅器31の出力がHレベルとなる。
Since VO>■p, the voltage signal VCT output from the current transformer 21 is the reference voltage V with which it is compared. decreases. Therefore, the timing at which the output of the comparator 45 is inverted to L level is earlier, and the reset of the flip-flop 46 and the turn-off of the GCS12 are also earlier. The oscillation frequency therefore increases and the input power decreases. In this way, when the input power decreases and matches the set power level, the current power is displayed on the display section 6, and oscillation continues at a constant frequency thereafter. (3) VlO
<Vp When the detected power level is smaller than the set power level, the case is opposite to the example (2) above, and the output of the operational amplifier 30 becomes L level and the output of the operational amplifier 31 becomes H level.

この場合もアンドゲート34は開かず、したがつて表示
はなされない。この場合、演算増幅器44の出力Vll
は、となり、比較器45の基準電圧V。
In this case as well, the AND gate 34 is not opened and therefore no display is made. In this case, the output Vll of the operational amplifier 44
is the reference voltage V of the comparator 45.

は上昇する。したがつて比較器45出力がLレベルに反
転する時期は、遅れ、これに伴つてGCSl2オフ時期
も遅れる。それ故、発振周波数は低下し、入力電力は上
昇していく。このようにして、上昇した入力電力が、設
定電力レベルに達すると、発振周波数は一定となり、そ
の後一定の電力供給が行なわれる。勿論上記両電力レベ
ルー致と同時に表示部にそのときの電力が表示される。
なお、電力供給は無制限に増大させることはできず、前
述の如く周波数約20KHzまでに制限される。
will rise. Therefore, the time when the output of the comparator 45 is inverted to the L level is delayed, and accordingly, the time when the GCS12 is turned off is also delayed. Therefore, the oscillation frequency decreases and the input power increases. In this way, when the increased input power reaches the set power level, the oscillation frequency becomes constant, and thereafter constant power supply is performed. Of course, the power at that time is displayed on the display section at the same time as the two power levels match.
Note that the power supply cannot be increased indefinitely, and is limited to a frequency of about 20 KHz as described above.

以上説明したように本発明誘導加熱調理器は、誘導加熱
コイル両端の電圧およびこれに流れる電流を検出して、
実際に負荷に供給される電力を算出するものてあるから
、従来負荷電流のみ検知し、そのピーク値制御によつて
電力制御を行なつていた調理器に比し、よソー層正確な
電力制御を行なうことができる。
As explained above, the induction heating cooker of the present invention detects the voltage across the induction heating coil and the current flowing therethrough.
Since there is a device that calculates the power actually supplied to the load, it allows for much more accurate power control compared to conventional cookers that only detect the load current and control the power by controlling its peak value. can be done.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は、本発明実施例斜視図、第2A図、第2B図及
ひ第2C図は、同実施例回路図、第3図は、動作信号波
形図である。 1・・・誘導加熱調理器、2・・・トッププレート、4
・・・電源スイッチ、5・・・スライド摘み、6・・・
入力電力表示部、12・・・GCSll5・・・インバ
ータ。
FIG. 1 is a perspective view of an embodiment of the present invention, FIGS. 2A, 2B, and 2C are circuit diagrams of the embodiment, and FIG. 3 is an operating signal waveform diagram. 1...Induction heating cooker, 2...Top plate, 4
...Power switch, 5...Slide knob, 6...
Input power display section, 12...GCSll5...Inverter.

Claims (1)

【特許請求の範囲】[Claims] 1 誘導加熱コイルに加わる電圧を検出する電圧検出手
段、上記誘導加熱コイルに流れる電流を検出する電流検
出手段、上記電圧検出手段及び電流検出手段の出力信号
を乗算する乗算手段、この乗算手段から出力された信号
を一定期間積分し、電力に対応した電圧信号を出力する
積分手段、この積分手段出力と、所予の基準電圧レベル
を比較する比較手段、この比較手段の出力を受けて上記
誘導加熱コイルに流れる電流通電期間を調節する電流制
御手段、を具備してなる誘導加熱調理器。
1. Voltage detection means for detecting the voltage applied to the induction heating coil, current detection means for detecting the current flowing through the induction heating coil, multiplication means for multiplying the output signals of the voltage detection means and the current detection means, and an output from the multiplication means. an integrating means for integrating the signal for a certain period of time and outputting a voltage signal corresponding to the electric power; a comparing means for comparing the output of the integrating means with a predetermined reference voltage level; An induction heating cooker comprising current control means for adjusting the period of current flowing through the coil.
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