JPS6111533B2 - - Google Patents
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- JPS6111533B2 JPS6111533B2 JP52081765A JP8176577A JPS6111533B2 JP S6111533 B2 JPS6111533 B2 JP S6111533B2 JP 52081765 A JP52081765 A JP 52081765A JP 8176577 A JP8176577 A JP 8176577A JP S6111533 B2 JPS6111533 B2 JP S6111533B2
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Description
【発明の詳細な説明】
本発明は、制御入力信号を模擬するパルス幅変
調された出力電圧を発生する静止形インバータを
使用した高調波電流補償装置に関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a harmonic current compensator using a static inverter to generate a pulse width modulated output voltage that simulates a control input signal.
本発明の目的は突入電流を生ぜしめることなし
に系統への投入が可能な高調波電流補償装置を提
供することにある。 SUMMARY OF THE INVENTION An object of the present invention is to provide a harmonic current compensator that can be applied to a power grid without generating an inrush current.
第1図は本発明による高調波電流補償装置の原
理構成を示す。電源系統1に高調波電流を発生す
る負荷2が接続されている。3は公知のパルス幅
変調形インバータであり、ここではインバータ主
回路部31、変調信号発生器32、コンパレータ
33パルスアンプ34によつて原理的な構成にて
示されている。このパルス幅変調形インバータ3
はリアクトル4を介して電源系統接続される。イ
ンバータ3は制御入力信号eioを模擬する出力電
圧VAFを発生し、リアクトル4を介して系統1へ
補償電流IAFを供給する。今負荷電流をIZ、系
統電流をIS、系統電圧をVS、そしてリアクトル
4のインダクタンスLSとすると、
IZ=IS+IAF ……(1)
VAF=VS+LSdIAF/dt ……(2)
なる関係がある。 FIG. 1 shows the principle structure of a harmonic current compensator according to the present invention. A load 2 that generates harmonic current is connected to a power supply system 1 . Reference numeral 3 designates a known pulse width modulation type inverter, which is shown here in its basic configuration by an inverter main circuit section 31, a modulation signal generator 32, a comparator 33, and a pulse amplifier 34. This pulse width modulation type inverter 3
is connected to the power supply system via the reactor 4. The inverter 3 generates an output voltage V AF that simulates the control input signal e io and supplies a compensation current I AF to the system 1 via the reactor 4 . Now, assuming that the load current is I Z , the system current is I S , the system voltage is V S , and the inductance of reactor 4 is L S , I Z = I S + I AF ... (1) V AF = V S + L S dI AF /dt...(2) There is a relationship.
インバータ3に与えられる制御入力信号eioは
系統電圧VSに相応した第1の入力信号e1と、補
償すべき高調波電流に従つて与えられる第2の入
力信号e2との和によつて与えられる。即ち、
eio=e1+e2 ……(3)
である。また、系統電圧VSが
VS=|VS|sinθ ……(4)
と表わせる場合に、第1の制御入力信号e1は、
e1=λ0sinθ ……(5)
として与えられる。但し、θは系統角周波数を
ω、時間をtとするときθ=ωtであり、λ0は
出力電圧比であり、出力電圧|VS|に対応する
値である。e2=0で、従つてeio=e1のとき、イ
ンバータ3の出力電圧VAFの基本波は式(4)で表わ
されている系統電圧VSに一致するようになつて
いる。それ故、第2の制御入力信号e2を零に保つ
てインバータ3を運転すれば、インバータ3は系
統電圧と等しい出力電圧を発生するのでこの状態
で電源系統1にインバータを投入すればほとんど
突入電流は生じない。 The control input signal e io given to the inverter 3 is the sum of the first input signal e 1 corresponding to the system voltage V S and the second input signal e 2 given according to the harmonic current to be compensated. It will be given to you. That is, e io =e 1 +e 2 (3). Furthermore, when the system voltage V S can be expressed as V S = |V S | sinθ ...(4), the first control input signal e 1 is given as e 1 = λ 0 sinθ ...(5) . However, when θ is the system angular frequency and time is t, θ=ωt, and λ 0 is the output voltage ratio, which is a value corresponding to the output voltage |V S |. When e 2 =0 and therefore e io =e 1 , the fundamental wave of the output voltage V AF of the inverter 3 matches the system voltage V S expressed by equation (4). Therefore, if the second control input signal e 2 is kept at zero and the inverter 3 is operated, the inverter 3 will generate an output voltage equal to the system voltage, so if the inverter is turned on to the power system 1 in this state, it will almost cause an inrush voltage. No current is generated.
第2の制御入力信号e2は、負荷電流IZに含ま
れる補償すべき高調波成分に応じて演算されたイ
ンバータ出力電流目標値I* AFとそれの実際値I
AFとの偏差を導かれる電流調節器5によつて与え
ることができる。 The second control input signal e 2 is the inverter output current target value I * AF calculated according to the harmonic component to be compensated included in the load current I Z and its actual value I
A deviation from AF can be provided by a guided current regulator 5.
第2図には電流目標値I* AFを求めるための演
算回路が示されている。6は系統電圧VSを検出
してその系統電圧の位相を表わす基準信号sinθ
およびcosθを発生する回路である。7は負荷電
流実際値IZを検出する電流検出器である。8は
負荷電流実際値IZに含まれる基本波有効成分の
大きさA1と基本波無効成分の大きさB1とを算出
する基本波成分演算器である。この場合に、基本
波有効成分の大きさ(振幅)である係数A1と基
本波無効成分の大きさ(振幅)である係数B1
は、フーリエ解析に基く次の公式にしたがつて、
すなわち
A1=1/π∫2〓0IZ・sinθdθ
B1=1/π∫2〓0IZ・cosθdθ
にしたがつて算出される。掛算器9の出力は負荷
電流IZに含まれる基本波有効成分A1sinθであ
り、掛算器10の出力は負荷電流IZに含まれる
基本波無効成分B1cosθである。加算器11の出
力は電流調節器5(第1図)に与えられる電流目
標値I* AFであり、これは次式によつて与えられ
る。 FIG. 2 shows an arithmetic circuit for determining the current target value I * AF . 6 is a reference signal sinθ that detects the system voltage V S and represents the phase of the system voltage.
This is a circuit that generates and cosθ. 7 is a current detector for detecting the actual load current value IZ . Reference numeral 8 denotes a fundamental wave component calculator that calculates the magnitude A 1 of the fundamental wave effective component and the magnitude B 1 of the fundamental wave reactive component included in the actual load current value I Z . In this case, coefficient A 1 is the magnitude (amplitude) of the fundamental wave effective component, and coefficient B 1 is the magnitude (amplitude) of the fundamental wave reactive component.
is based on the following formula based on Fourier analysis:
That is, it is calculated according to A 1 =1/π∫ 2 〓 0 I Z ·sinθdθ B 1 =1/π∫ 2 〓 0 I Z ·cosθdθ. The output of the multiplier 9 is the fundamental wave effective component A 1 sin θ included in the load current I Z , and the output of the multiplier 10 is the fundamental wave active component B 1 cos θ included in the load current I Z. The output of adder 11 is the current target value I * AF applied to current regulator 5 (FIG. 1), which is given by the following equation.
I* AF=IZ−(A1sinθ+B1cosθ) ……(6)
電流調節器5は電流実際値IAFがこの目標値I
* AFに一致するような出力電圧e2を発生する。従
つて、
IAF=IZ−(A1sinθ+B1cosθ) ……(7)
となるような制御が行われる。つまり、式(1)、(7)
より
IS=A1sinθ+B1cosθ ……(8)
なる関係が得られることから分るように、電源系
統1には高調波電流が流れなくなる。 I * AF = I Z - (A 1 sin θ + B 1 cos θ) ...(6) The current regulator 5 sets the actual current value I AF to this target value I
* Generate an output voltage e 2 that matches AF . Therefore, control is performed such that I AF =I Z -(A 1 sin θ+B 1 cos θ) (7). In other words, Equations (1) and (7)
As can be seen from the following relationship: I S =A 1 sin θ + B 1 cos θ (8), no harmonic current flows through the power supply system 1.
第2図の実施例では高調波電流のみを補償の対
象としているが、第3図の実施例では同時に基本
波無効電流分も補償対象としている。第3図によ
れば、回路60により系統電圧VSから基準信号
sinθが導き出され、これをもとに基本波有効成
分演算器80は、電流検出器70によつて検出さ
れた負荷電流実際値IZに含まれている基本波有
効成分の大きさA1を算出する。この算出値A1が
掛算器90によつて基準信号sinωt掛算され
る。混合点110において負荷電流実際値IZと
掛算器90の出力値A1sinωtとの差が形成さ
れ、この差が電流目標値I* AFとなる即ち、
I* AF=IZ−A1sinωt ……(9)
である。電流調節器5の働きによつてIAF=I*
AFとなるような制御が行われ、結局系統電流IS
は、
IS=A1sinωt
にて表わせるように、基本波有効電流分のみとな
り、負荷が発生する高調波電流および基本波無効
電流の補償が行われる。 In the embodiment shown in FIG. 2, only the harmonic current is compensated, but in the embodiment shown in FIG. 3, the fundamental reactive current is also compensated at the same time. According to FIG. 3, the circuit 60 extracts the reference signal from the system voltage V S
sinθ is derived, and based on this, the fundamental wave effective component calculator 80 calculates the magnitude A 1 of the fundamental wave effective component included in the load current actual value I Z detected by the current detector 70. calculate. This calculated value A 1 is multiplied by the reference signal sinωt by a multiplier 90 . At the mixing point 110, a difference is formed between the actual load current value I Z and the output value A 1 sinωt of the multiplier 90, and this difference becomes the current target value I * AF , that is, I * AF = I Z −A 1 sinωt ...(9). Due to the action of the current regulator 5, I AF = I *
Control is performed so that the AF occurs, and as a result, the system current I S
As expressed by I S =A 1 sinωt, only the fundamental wave active current is present, and compensation for harmonic current and fundamental wave reactive current generated by the load is performed.
なお、第1図においてリアクトル4の代りにコ
ンデンサを使用してもよい。 Note that a capacitor may be used instead of the reactor 4 in FIG.
以上のように、本発明によれば、静止形インバ
ータのための制御入力信号eioが電源系統の電圧
VSに相応した第1の信号e1と、補償すべき高調
波電流に応じた第2の信号e2との和として与えら
れるので、第2の信号e2を零に保持するだけで、
静止形インバータの出力電圧基本波は電源系統の
電圧と一致する。したがつて、第2の信号e2を零
保持して静止形インバータを起動した後に補償装
置を電源へ投入するならば、静止形インバータの
出力電圧と電源系統電圧とが平衡状態にあること
から、誘導性もしくは容量性のインピーダンスを
介して突入電流が流れることはない。投入完了後
に第2の信号e2の零保持を解除することにより高
調波電流補償動作を開始させることができる。 As described above, according to the present invention, the control input signal e io for the static inverter is divided into the first signal e 1 corresponding to the voltage V S of the power supply system and the first signal e 1 corresponding to the harmonic current to be compensated. Since it is given as the sum of the second signal e2 , just by keeping the second signal e2 at zero,
The output voltage fundamental wave of the static inverter matches the voltage of the power supply system. Therefore, if the compensator is turned on after starting the static inverter by keeping the second signal e2 at zero, the output voltage of the static inverter and the power system voltage are in equilibrium, so , no inrush current flows through inductive or capacitive impedance. The harmonic current compensation operation can be started by releasing the zero holding of the second signal e 2 after the completion of the input.
第1図は本発明装置の概略構成を示すブロツク
図、第2図および第3図は本発明装置における補
償電流の目標値のための演算回路の互いに異なる
実施例を示すブロツク図である。
1……電源系統、2……負荷、3……パルス幅
変調形インバータ、4……リアクトル、5……電
流調節器。
FIG. 1 is a block diagram showing a schematic configuration of the device of the present invention, and FIGS. 2 and 3 are block diagrams showing different embodiments of an arithmetic circuit for determining the target value of the compensation current in the device of the present invention. 1... Power supply system, 2... Load, 3... Pulse width modulation inverter, 4... Reactor, 5... Current regulator.
Claims (1)
償するために、制御入力信号を模擬するパルス幅
変調された出力電圧を発生する静止形インバータ
を誘導性もしくは容量性インピーダンスを介して
電源系統に接続し、前記制御入力信号は、電源系
統の電圧に相応した値を持たされる第1の信号
と、静止形インバータの投入過程では零に保た
れ、投入過程完了後には補償すべき高調波電流に
相応した値を持たされる第2の信号との和として
与えるようにしたことを特徴とする高調波電流補
償装置。1. A static inverter that generates a pulse-width modulated output voltage that simulates the control input signal is connected to the power system via an inductive or capacitive impedance to compensate for the harmonic currents that the load causes in the power system. The control input signal is a first signal having a value corresponding to the voltage of the power supply system, and a first signal that is kept at zero during the turning-on process of the static inverter, and a harmonic current that is to be compensated after the turning-on process is completed. A harmonic current compensator characterized in that the harmonic current compensation device is configured to provide the harmonic current as a sum with a second signal having a corresponding value.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8176577A JPS5416648A (en) | 1977-07-08 | 1977-07-08 | Harmonic current compensator |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8176577A JPS5416648A (en) | 1977-07-08 | 1977-07-08 | Harmonic current compensator |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5416648A JPS5416648A (en) | 1979-02-07 |
| JPS6111533B2 true JPS6111533B2 (en) | 1986-04-03 |
Family
ID=13755542
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8176577A Granted JPS5416648A (en) | 1977-07-08 | 1977-07-08 | Harmonic current compensator |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5416648A (en) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5932325A (en) * | 1982-08-13 | 1984-02-21 | 株式会社明電舎 | Power regulator in power receiving facility |
| JPS6031410U (en) * | 1983-08-09 | 1985-03-04 | 鐘淵化学工業株式会社 | Wall structure in houses |
| JPS60167633A (en) * | 1984-02-08 | 1985-08-31 | 東洋電機製造株式会社 | Harmonic power suppressing device |
-
1977
- 1977-07-08 JP JP8176577A patent/JPS5416648A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5416648A (en) | 1979-02-07 |
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