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JPS6133310B2 - - Google Patents
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JPS6133310B2 - - Google Patents

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Publication number
JPS6133310B2
JPS6133310B2 JP11025276A JP11025276A JPS6133310B2 JP S6133310 B2 JPS6133310 B2 JP S6133310B2 JP 11025276 A JP11025276 A JP 11025276A JP 11025276 A JP11025276 A JP 11025276A JP S6133310 B2 JPS6133310 B2 JP S6133310B2
Authority
JP
Japan
Prior art keywords
horizontal
vertical
circuit
output
television receiver
Prior art date
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Expired
Application number
JP11025276A
Other languages
Japanese (ja)
Other versions
JPS5335323A (en
Inventor
Masayoshi Hirashima
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
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Publication of JPS5335323A publication Critical patent/JPS5335323A/en
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Description

【発明の詳細な説明】 本発明は、テレビジヨン受像機の調整を正確、
かつ容易にするようにテレビジヨン受像機にパタ
ーン発生回路を内蔵した装置を提供するものであ
る。
DETAILED DESCRIPTION OF THE INVENTION The present invention provides accurate and accurate adjustment of television receivers.
In addition, the present invention provides an apparatus in which a pattern generation circuit is incorporated in a television receiver to facilitate the invention.

カラーテレビジヨン受像機においてはホワイト
バランスやコンバーゼンスを正確に調整しておく
ことが正しい画像再生のために必要であり、従来
にはかかる調整の便宜のためにパターン発生装置
を独立した装置として備え、調整時にはこのパタ
ーン発生装置をテレビジヨン受像機に外部接続す
るようにしていた。ところが、このような従来の
装置では調整の都度パターン発生装置を持ち運ん
でテレビジヨン受像機に接続しなければならない
という不便があり、しかも、このようなパターン
発生装置は独自に同期発生回路を備えているもの
であつてその同期周期がテレビジヨン放送のそれ
と異なつていることが多く、そのためにテレビジ
ヨン受像機の調整時に正確な同期においての調整
ができないために調整状態が不完全になるという
欠点があつた。
In color television receivers, accurate adjustment of white balance and convergence is necessary for correct image reproduction, and conventionally, a pattern generator is provided as an independent device to facilitate such adjustment. During adjustment, this pattern generator was externally connected to the television receiver. However, such conventional devices have the inconvenience of having to carry the pattern generator and connect it to the television receiver each time adjustments are made, and furthermore, these pattern generators do not have their own synchronization generation circuit. The synchronization period is often different from that of television broadcasting, and this has the disadvantage that accurate synchronization cannot be achieved when adjusting the television receiver, resulting in incomplete adjustment. It was hot.

そこで本発明はかかる従来の欠点を全て解消し
た装置を提供することを目的とするものである。
Therefore, it is an object of the present invention to provide a device that eliminates all of the conventional drawbacks.

以下、本発明の一実施例について添付図面とと
もに説明する。
An embodiment of the present invention will be described below with reference to the accompanying drawings.

まず、第1図はその基本的な構成を示し、ここ
で、1はアンテナ、2はテレビジヨン受像回路、
3はパターン発生回路、4は陰極線管である。テ
レビジヨン受像回路2にはチユーナ5、VIF増幅
回路6、映像検波回路7、映像増幅回路8、同期
分離回路9、垂直偏向回路10、水平偏向回路1
1等を備えており、それらは通常のテレビジヨン
受像機におけるそれらと同様のものである。これ
らのテレビジヨン受像回路2からは垂直パルスを
端子12に、水平パルスを端子13に、それぞれ
出力する。
First, Figure 1 shows its basic configuration, where 1 is an antenna, 2 is a television receiver circuit,
3 is a pattern generation circuit, and 4 is a cathode ray tube. The television receiver circuit 2 includes a tuner 5, a VIF amplifier circuit 6, a video detection circuit 7, a video amplifier circuit 8, a synchronization separation circuit 9, a vertical deflection circuit 10, and a horizontal deflection circuit 1.
1, which are similar to those in ordinary television receivers. These television receiver circuits 2 output vertical pulses to a terminal 12 and horizontal pulses to a terminal 13, respectively.

一方、パターン発生回路3には、垂直パルスを
受ける端子14と水平パルスを受ける端子15を
備え、端子15に受けた水平パルスによつてゲー
テツドオシレータ16を制御して水平走査期間内
に水平パルスの周波数(15.75KHz)よりも充分
に高い周波数でこれを発振させる。その発振出力
はカウンタ等で構成した水平分周器17に加え、
ここで発振出力を分周して一定間隔でかつ1水平
期間中に1回以上、望ましくは数回〜10数回、分
周出力を発生する。この分周出力は陰極線管4上
に発生するドツトパターンの個々の大きさと水平
方向の位置を定めるものである。具体的には、水
平ブランキング期間を除いた1水平走査期間がほ
ぼ50μsecであるので、たとえば第4図に示すよ
うに水平方向に15個のドツトパターンを発生する
場合であれば1水平走査期間の15分の1の期間す
なわち約3.3μsec毎に分周出力を発生するように
すればよく、かつ、この分周出力を発生するため
の水平分周器17の分周を16分の1とすればゲー
テツドオシレータ16の発振周波数を約4.8MHz
にしておけばよい。また、個々のドツトパターン
の水平幅は水平分周器17から取り出す出力のパ
ルス幅によつて決定され、上述の場合であればゲ
ーテツドオシレータ16の発振出力の2ビツト分
程度が適当である。
On the other hand, the pattern generation circuit 3 includes a terminal 14 for receiving vertical pulses and a terminal 15 for receiving horizontal pulses, and controls a gated oscillator 16 by the horizontal pulses received at the terminal 15 to generate horizontal pulses within the horizontal scanning period. make it oscillate at a frequency that is sufficiently higher than the frequency of (15.75KHz). The oscillation output is sent to a horizontal frequency divider 17 consisting of a counter, etc.
Here, the oscillation output is frequency-divided and the frequency-divided output is generated at regular intervals and at least once during one horizontal period, preferably several to ten times. This frequency-divided output determines the individual size and horizontal position of the dot pattern generated on the cathode ray tube 4. Specifically, since one horizontal scanning period excluding the horizontal blanking period is approximately 50 μsec, for example, when generating 15 dot patterns in the horizontal direction as shown in Fig. 4, one horizontal scanning period is required. It is sufficient to generate a frequency-divided output every 1/15 of the period, that is, approximately every 3.3 μsec, and the frequency division of the horizontal frequency divider 17 to generate this frequency-divided output is 1/16. This will reduce the oscillation frequency of gated oscillator 16 to approximately 4.8MHz.
Just leave it as . Further, the horizontal width of each dot pattern is determined by the pulse width of the output from the horizontal frequency divider 17, and in the above case, approximately 2 bits of the oscillation output of the gated oscillator 16 is appropriate.

さらに、パターン発生回路3においては端子1
5に加えられる水平パルスをカウンタ等で構成し
た垂直分周器18に加え、ここで水平パルスを分
周して一定間隔で、かつ1垂直走査期間中に以
上、望ましくは数回〜10数回、分周出力を発生す
る。この分周出力は陰極線管4上に発生するドツ
トパターンの個々の大きさと垂直方向の位置を定
めるものである。具体的には、垂直ブランキング
期間を除いた1垂直走査期間がほぼ15.6msecで
あるので、たとえば第4図に示すように垂直方向
に15個のドツトパターンを発生する場合であれば
1垂直走査期間の15分の1の期間、すなわち約
1msec毎に分周出力を発生するようにすればよ
く、このような分周出力を発生するためには垂直
分周器18の分周比を15分の1としておけばよ
い。また、個々のドツトパターンの垂直幅は垂直
分周器18から取り出す分周出力のパルス幅によ
つて決定され、上述の場合であれば水平走査線2
本分程度が適当である。
Furthermore, in the pattern generation circuit 3, the terminal 1
5 is added to a vertical frequency divider 18 composed of a counter or the like, which divides the horizontal pulse and divides the frequency of the horizontal pulse at regular intervals and at least several times during one vertical scanning period, preferably several times to more than 10 times. , generates a divided output. This divided output determines the individual size and vertical position of the dot pattern generated on the cathode ray tube 4. Specifically, since one vertical scanning period excluding the vertical blanking period is approximately 15.6 msec, for example, if 15 dot patterns are to be generated in the vertical direction as shown in Fig. 4, one vertical scanning period is approximately 15.6 msec. The period of one-fifteenth of the period, i.e. approx.
It is sufficient to generate a frequency-divided output every 1 msec, and in order to generate such a frequency-divided output, the frequency division ratio of the vertical frequency divider 18 may be set to 1/15. Further, the vertical width of each dot pattern is determined by the pulse width of the frequency-divided output taken out from the vertical frequency divider 18, and in the above case, the horizontal scanning line 2
Duty level is appropriate.

そして、水平分周器17の分周出力と垂直分周
器18の分周出力とをANDゲート19に加えて
それらの論理積を作成すれば第4図のようなドツ
トパターンを表示するに適したパターン信号を作
成することができ、これをバツフア増幅器20と
端子21,22を介してテレビジヨン受像回路2
中の映像増幅回路8に加えることにより、陰極線
管4に第4図のようなドツトパターンを表示する
ことができ、これを用いてホワイトバランスやコ
ンバーゼンスの正確な調整をきわめて容易に行な
うことができる。この場合、パターン発生回路3
はテレビジヨン受像回路2や陰極線管4とともに
同一のテレビジヨン受像機のキヤビネツト内に組
み込んでおくことにより調整のときにはスイツチ
を切換えるだけの簡単な操作でパターンを表示で
き、別体のパターン発生器を外部接続するような
不便をなくすることができるので、作業能率を大
幅に向上することができる。さらに、特にこの装
置の利点として、パターン発生のための制御用同
期信号を全てテレビジヨン受像回路2から取り出
しているので、テレビジヨン放送信号の同期信号
と完全に同期した正しい同期状態のパターン信号
を発生することができるという点があり、このよ
うなパターン信号を用いることにより、完全に正
しい調整を行なうことができる効果を奏すること
ができるものである。
Then, by adding the frequency division output of the horizontal frequency divider 17 and the frequency division output of the vertical frequency divider 18 to the AND gate 19 to create a logical product, it is suitable to display a dot pattern as shown in FIG. A pattern signal can be created, which is sent to the television receiver circuit 2 via the buffer amplifier 20 and terminals 21 and 22.
By adding it to the video amplification circuit 8 inside, it is possible to display a dot pattern as shown in Fig. 4 on the cathode ray tube 4, and using this, accurate adjustment of white balance and convergence can be performed extremely easily. . In this case, the pattern generation circuit 3
By incorporating the television receiver circuit 2 and cathode ray tube 4 into the same television receiver cabinet, the pattern can be displayed with the simple operation of flipping a switch during adjustment, and a separate pattern generator can be used. Since the inconvenience of external connections can be eliminated, work efficiency can be greatly improved. Furthermore, a particular advantage of this device is that all the control synchronization signals for pattern generation are taken out from the television receiver circuit 2, so that the pattern signal is in the correct synchronization state and is completely synchronized with the synchronization signal of the television broadcast signal. By using such a pattern signal, it is possible to make a completely correct adjustment.

次に、このような装置のさらに具体的な構成を
第2,3図に示す。第2図はパターン発生回路3
の具体的回路図、第3図は映像増幅回路8との結
合部分の具体的回路図であり、それぞれの図中に
おいて第1図中と対応する部分には同一符号を付
す。
Next, a more specific configuration of such an apparatus is shown in FIGS. 2 and 3. Figure 2 shows the pattern generation circuit 3.
FIG. 3 is a specific circuit diagram of a portion connected to the video amplification circuit 8, and in each figure, parts corresponding to those in FIG. 1 are given the same reference numerals.

第2図において、23はテレビジヨン受像回路
2から水平パルスをピツクアツプするためのコイ
ルで、これを水平偏向回路11のフライバツクト
ランスの近傍に取付けてフライバツクパルスを取
り出す。また、24は水平パルスを波形整形する
ための波形整形回路で、ここで25は水平パルス
と共振させるためのコンデンサ、26,27,2
8は増幅用トランジスタであり、トランジスタ2
7は振幅制限作用をする。
In FIG. 2, numeral 23 denotes a coil for picking up horizontal pulses from the television receiver circuit 2, and this coil is installed near the flyback transformer of the horizontal deflection circuit 11 to extract the flyback pulses. 24 is a waveform shaping circuit for shaping the horizontal pulse; 25 is a capacitor for resonance with the horizontal pulse; 26, 27, 2
8 is an amplification transistor, transistor 2
7 has an amplitude limiting effect.

また、29は垂直偏向回路10から垂直パルス
をピツクアツプするためのコイルで、これを垂直
偏向回路10の垂直出力トランス等の近傍に取り
付けて垂直パルスを取り出す。この場合、垂直パ
ルスは正極性、負極性の2通りのいずれかで取り
出されるので、スイツチ30で極性を切換えて正
極性で取り出す。この垂直パルスも波形整形回路
24と同様の波形整形回路31で波形整形する。
Further, 29 is a coil for picking up vertical pulses from the vertical deflection circuit 10, and this coil is attached near a vertical output transformer or the like of the vertical deflection circuit 10 to extract the vertical pulses. In this case, since the vertical pulse is taken out with either positive polarity or negative polarity, the polarity is switched by the switch 30 and taken out with positive polarity. This vertical pulse is also waveform-shaped by a waveform-shaping circuit 31 similar to the waveform-shaping circuit 24.

ゲーテツドオシレータ16は公知の非安定マル
チバイブレータで構成し、また、水平分周器17
は4ピツトの2進カウンタ32とANDゲート3
3で構成する。さらに垂直分周器18は予め2分
の1に分周するフリツプフロツプ34と、4ビツ
トの2進カウンタ35とANDゲート36とで構
成する。
The gated oscillator 16 is composed of a known unstable multivibrator, and a horizontal frequency divider 17
is a 4-pit binary counter 32 and an AND gate 3
Consists of 3. Furthermore, the vertical frequency divider 18 is composed of a flip-flop 34 which divides the frequency by half in advance, a 4-bit binary counter 35, and an AND gate 36.

ここで、ゲーテツドオシレータ16の発振周波
数もしくは水平分周器17の分周比率および出力
ビツト数を変えることによりパターンの水平方向
の位置および大きさを変えることができ、垂直分
周器18における分周比率もしくは出力ビツト数
を変えることによりパターンの垂直方向の位置お
よび大きさを変えることができる。
Here, the horizontal position and size of the pattern can be changed by changing the oscillation frequency of the gated oscillator 16 or the frequency division ratio and output bit number of the horizontal frequency divider 17. By changing the circumferential ratio or the number of output bits, the vertical position and size of the pattern can be changed.

さらに、第3図において、上記のようにしてパ
ターン発生回路3で発したパターン信号は映像増
幅回路2中の映像増幅用のトランジスタ37,3
8,39のうち38のベースに供給する。この場
合、通常のテレビジヨン受像機では破線で示した
ようにトランジスタ37のエミツタとトランジス
タ38のベースとが直結されていてここにテスト
ポイント端子TPが設けられているので、これを
端子22として用いてここにパターン信号を供給
するようバツフア増幅回路20の出力側の端子2
1を接続すれば、最も簡単に実現できる。
Furthermore, in FIG. 3, the pattern signal generated by the pattern generation circuit 3 as described above is transmitted to the video amplification transistors 37 and 3 in the video amplification circuit 2.
Supply to 38 bases out of 8,39. In this case, in a normal television receiver, the emitter of the transistor 37 and the base of the transistor 38 are directly connected as shown by the broken line, and the test point terminal TP is provided here, so this is used as the terminal 22. Terminal 2 on the output side of the buffer amplifier circuit 20 so as to supply a pattern signal here.
This can be accomplished most easily by connecting 1.

また、ここに切換スイツチ40を設けておけば
さらに良い。
Further, it would be even better if a changeover switch 40 is provided here.

なお、41はサービススイツチで、横線のみを
表示するときに垂直偏向回路10の発振用トラン
ジスタ42への電源を遮断し、かつ、陰極線管4
に映像信号を加えないようにするものである。
In addition, 41 is a service switch that cuts off the power to the oscillation transistor 42 of the vertical deflection circuit 10 when displaying only horizontal lines, and also cuts off the power to the oscillation transistor 42 of the vertical deflection circuit 10.
This prevents the addition of video signals to the

なお、このようなパターン発生回路3の部分を
集積回路素子化して、テレビジヨン受像機のキヤ
ビネツト中にテレビジヨン受像回路2と着脱自在
に取付けるようにしておいてもよいものである。
Incidentally, such a portion of the pattern generating circuit 3 may be made into an integrated circuit element and may be detachably attached to the television receiver circuit 2 in the cabinet of the television receiver.

なお、本発明を実施するための具体回路構成は
上記の実施例のものに限定されるものではなく、
同様の作用効果を奏するものであれば広く用いる
ことができる。
Note that the specific circuit configuration for carrying out the present invention is not limited to that of the above embodiment,
A wide variety of materials can be used as long as they provide similar effects.

以上詳述したように本発明のテレビジヨン受像
機用パターン発生装置は、テレビジヨン受像回路
から取り出された水平パルスによつて制御されて
この水平パルスの周波数より高い周波数で発振す
るゲーテツドオシレータと、このゲーテツドオシ
レータの発振出力を分周して一定間隔で、かつ、
1水平走査期間中に1個以上出力を発生する水平
分周器と、テレビジヨン受像回路から取り出され
た水平パルス円分周して一定間隔でかつ1垂直走
査期間中に1回以上出力を発生する垂直分周器と
を備え、水平分周器の出力と垂直分周器の出力と
の論理積信号をテレビジヨン受像機の陰極線管に
供給してパターンを映出することを特徴とするも
のであるので、きわめて容易に、しかも正確にテ
レビジヨン受像機の調整を行なうことができるも
のである。
As detailed above, the pattern generator for a television receiver according to the present invention includes a gated oscillator that is controlled by a horizontal pulse extracted from a television receiver circuit and oscillates at a frequency higher than the frequency of the horizontal pulse. , divide the oscillation output of this gated oscillator at regular intervals, and
A horizontal frequency divider that generates one or more outputs during one horizontal scanning period, and a horizontal frequency divider that circularly divides the horizontal pulse taken from the television receiver circuit and generates outputs at regular intervals and one or more times during one vertical scanning period. and a vertical frequency divider, and is characterized in that a logical product signal of the output of the horizontal frequency divider and the output of the vertical frequency divider is supplied to a cathode ray tube of a television receiver to project a pattern. Therefore, it is possible to adjust the television receiver extremely easily and accurately.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の一実施例におけるテレビジヨ
ン受像機用のパターン発生装置のブロツク線図、
第2図および第3図は同装置の要部の具体的な回
路図、第4図は同装置におけるパターン表示態様
の正面図である。 2…テレビジヨン受像回路、3…パターン発生
回路、4…陰極線管、8…映像増幅回路、10…
垂直偏向回路、11…水平偏向回路、16…ゲー
テツドオシレータ、17…水平分周器、18…垂
直分周器、19…ANDゲート、20…バツフア
増幅回路。
FIG. 1 is a block diagram of a pattern generator for a television receiver according to an embodiment of the present invention;
2 and 3 are specific circuit diagrams of the main parts of the device, and FIG. 4 is a front view of a pattern display mode in the device. 2...Television receiver circuit, 3...Pattern generation circuit, 4...Cathode ray tube, 8...Video amplification circuit, 10...
Vertical deflection circuit, 11...Horizontal deflection circuit, 16...Gated oscillator, 17...Horizontal frequency divider, 18...Vertical frequency divider, 19...AND gate, 20...Buffer amplifier circuit.

Claims (1)

【特許請求の範囲】[Claims] 1 テレビジヨン受像回路中の水平偏向回路と垂
直偏向回路からピツクアツプ用のコイルを用いて
水平パルスと垂直パルスとを取り出し、前記水平
パルスによつて制御されてこの水平パルスの周波
数より高い周波数で発振するゲーテツドオシレー
タと、このゲーテツドオシレータの発振出力を分
周して一定間隔で、かつ1水平走査期間中に1回
以上出力を発生する水平分周器と、上記テレビジ
ヨン受像回路から取り出された水平パルスを分周
して一定間隔で、かつ1垂直走査期間中に、1回
以上出力を発生する垂直分周器とを備え、上記水
平分周器の出力と上記垂直分周器の出力との論理
積信号を上記テレビジヨン受像機の陰極線管に供
給してパターンを映出する事を特徴とするテレビ
ジヨン受像機用パターン発生装置。
1 A horizontal pulse and a vertical pulse are extracted from a horizontal deflection circuit and a vertical deflection circuit in a television receiver circuit using a pickup coil, and oscillation is performed at a frequency higher than that of the horizontal pulse under the control of the horizontal pulse. a horizontal frequency divider that divides the oscillation output of the gated oscillator and generates an output at regular intervals and at least once during one horizontal scanning period; a vertical frequency divider that divides the frequency of the horizontal pulse and generates an output at regular intervals and at least once during one vertical scanning period, the output of the horizontal frequency divider and the output of the vertical frequency divider. 1. A pattern generating device for a television receiver, characterized in that a pattern is projected by supplying an AND signal of the above-mentioned signal to a cathode ray tube of the television receiver.
JP11025276A 1976-09-13 1976-09-13 Pattern generator unit for television picture receiver Granted JPS5335323A (en)

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