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JPS6139729B2 - - Google Patents
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JPS6139729B2 - - Google Patents

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Publication number
JPS6139729B2
JPS6139729B2 JP51071115A JP7111576A JPS6139729B2 JP S6139729 B2 JPS6139729 B2 JP S6139729B2 JP 51071115 A JP51071115 A JP 51071115A JP 7111576 A JP7111576 A JP 7111576A JP S6139729 B2 JPS6139729 B2 JP S6139729B2
Authority
JP
Japan
Prior art keywords
section
wafer
semiconductor wafer
jig
semiconductor
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP51071115A
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English (en)
Other versions
JPS52154370A (en
Inventor
Hiroto Nagatomo
Hiroshi Maejima
Shuichi Hanajima
Susumu Nanko
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
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Publication date
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Publication of JPS52154370A publication Critical patent/JPS52154370A/ja
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Granted legal-status Critical Current

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  • Photosensitive Polymer And Photoresist Processing (AREA)
  • Warehouses Or Storage Devices (AREA)
  • Pile Receivers (AREA)
  • Sheets, Magazines, And Separation Thereof (AREA)
  • Collation Of Sheets And Webs (AREA)
  • Conveyance By Endless Belt Conveyors (AREA)
  • Drying Of Semiconductors (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)

Description

【発明の詳細な説明】 本発明は半導体ウエーハ上にホトレジスト膜を
塗布し、ベークするような処理装置に関し、異種
ロツトの半導体ウエーハでも自動的に処理するこ
とのできる装置を提供するものである。
半導体装置の製造工程においてホトレジスト膜
を形成する工程がある。従来この処理は手作業に
てスピンナーの上に半導体ウエーハを吸着固定
し、その中央にホトレジストを滴下した後にスピ
ンナーを回転してホトレジスト膜を半導体ウエー
ハ上に薄く形成する方法が行なわれている。
しかし、前記処理方法においては、個々の半導
体ウエーハをピンセツトで一々スピンナー上に載
置したり、取り除いたりする作業者による作業が
必要であり、作業者の個人差やミスあるいは汚染
を生ずる欠点があつた。また、個々の半導体ウエ
ーハを処理する関係上多くの時間を必要とする等
の問題があつた。
一方、ホトレジスト膜の塗布、ベーク処理の工
程を連続化させ、自動的に処理する装置が開発さ
れている模様であるが、この装置においては異種
ロツトの半導体ウエーハを連続的に処理すること
ができないという問題があり、大巾な工程改善の
期待をすることができない。
本発明は、前記従来技術の欠点を解消するため
に得られたものである。本発明に従うと複数個の
半導体ウエーハ収納用の治具を支持し、順次半導
体ウエーハを送り込むローダー部と、このローダ
ー部に続くベーク炉のような処理部と、この処理
部の終端に設けた複数個の半導体ウエーハ収納用
の治具を有するアンローダー部とが設けられ、ロ
ーダー部よりの半導体ウエーハの供給とアンロー
ダー部の治具への半導体ウエーハの収納は計算機
によつて自動的に管理される。
以下図面を参照して本発明の実施例を説明す
る。第1図は本発明に係る装置の概略構造を示す
外観斜視図である。
図において1はローダー部で、メイン操作パネ
ル2上に設けたウエーハ押し出し部3上に複数個
の治具4が支持され、それぞれには半導体ウエー
ハ5が支持されている。
6はスピンナー部で、これの上方には開閉エア
ーベアリングシユート7、塗布ヘツド8(スピン
ナー)ウエーハ振分けシユート9が設けられてい
る。
10はベーク部で、これの内部には赤外線ヒー
ターおよび反射板11が複数個配設されている。
12はアンローダー部で、その上部中央には回
転板13が設けられ、これに治具4′が収納でき
るようになつている。
第2図は第1図に示した装置全体の平面図で、
ウエーハ押し出し部3の中央にはプツシヤ14が
設けられ、治具4内に収容されているウエーハ5
を1枚ずつ送り出すように構成されている。
第3図はローダー部の機構の概略図で、回転板
15は1個の治具のウエーハが総て送り出された
のちに、モーター16で一定角度だけ回転して、
新しい治具をエアーベアリング17の方に向け
る。回転板15の上方のケース18の内部にはプ
ツシヤー機構19が設けられ、これでプツシヤー
14を間歇駆動する。
エアーベアリング17の前面下部には治具ピツ
チ送り機構20が設けられ、モーター21によつ
て駆動して治具4aを一定位置に上昇させ支持し
たのち、ウエーハをエアーベアリング17の表面
に合せた状態で、前記プツシヤー機構19を作動
させて1枚のウエーハをプツシヤ14で押し出
す。なお、22はウエーハの有無検出装置、23
はカートリツジ有無検出装置、24,25は1回
転検出装置である。
再び第2図において、プツシヤー14を作動し
てエアーベアリング17上に半導体ウエーハが載
ると真空ストツパー26の作用で一旦半導体ウエ
ーハをこれの上に停止させ、塗布ヘツド8上に半
導体ウエーハがない場合には前記真空ストツパー
26を切つて半導体ウエーハを送り込む。送り込
まれた半導体ウエーハはストツパー27で動きを
阻止されて塗布ヘツド8の位置で停止されるが、
この状態で真空を作用させて塗布ヘツド8上に半
導体ウエーハを支持する。
その後開閉エアーベアリングシユート7を2点
鎖線のように回動させたのち、レジストカツプ3
4を上昇させた状態でノズルよりホトレジスト液
を吐出し、その後塗布ヘツド8を回転してホトレ
ジスト膜の塗布処理を行う。塗布処理が終るとレ
ジストカツプ34を元の位置に下降させ、開閉エ
アーベアリングシユート7を実線の位置に復帰さ
せたのち、真空を切つてエアーベアリング7′上
に移送させ、真空ストツパー28で半導体ウエー
ハを一旦停止しておく。
9はウエーハ振分けシユートでその1部にシヤ
ツター29が設けられ、X,Yの間を首振り運動
をする。真空ストツパー28を切ると半導体ウエ
ーハはウエーハ振分けシユート9に上に移送され
シヤツター29上に載せる。これとともにX,Y
のいずれかの位置にウエーハ振分けシユート9の
首振りをさせたのち、シヤツター29を開いて半
導体ウエーハをベーク部10に設けたベルトコン
ベアー30上に2列に配列する。
ベーク部10において半導体ウエーハは赤外線
ヒーターによつてベーク処理されながらアンロー
ダー側に順次送り出されるわけであるが、送り出
された半導体ウエーハはエアーベアリング31で
運ばれ、真空ストツパー32で一時的に停止さ
れ、続いてプツシヤー33によつて押されて回転
板13上に設けた治具4′の溝内に収納されるな
お、この治具4′は第3図に示した装置のように
電気的信号に従つて上下するように構成されてい
る。
本発明の実施例は1個の治具をアンローダー部
に装填するのではなく、複数個のものを装填する
点に特徴があり、そのために異品種のロツトのも
のでも連続的に供給できる点に特徴がある。
ローダ部より送り出される半導体ウエーハの配
列順序をアンローダー部において再現する必要が
あるが、これには個々の半導体ウエーハについて
マイクロコンピユーターを利用した番地制御によ
つて行なわれる。
すなわち、図示しないマイクロコンピユーター
のRAM(ランダムアクセスメモリ)内に、第4
図のようにローダー番地とアンローダー番地と名
付けた2本の番地参照用のレジスタを持ち、さら
に治具内のウエーハの有無を記憶する個所をも
つ、これをウエーハ表と名付ける。
コンピユーターは、ローダー側で治具を動かす
度にローダー番地をインクリメントし、ウエーハ
があると“1”を、またウエーハがないと“0”
をローダ番地の指定するウエーハ表の番地に書き
込む。
また、コンピユーターは、アンローダー側に収
納すべきウエーハが来るとアンローダー番地によ
つて指定されるウエーハ表の内容を読み出し、そ
の内容が“1”の場合はウエーハを治具の溝を収
納する。また“0”の場合は“1”を読みだせる
までアンローダー番地をインクリメントし、かつ
同時に治具を1ピツチずつ動かし、“1”を読み
出せたカートリツジの位置でウエーハを収納する
のである。
結局前記ローダー側とアンローダー側の操作に
よつてローダー側に装填されたウエーハの配列が
アンローダー側においても再現されるのである。
本発明は、前記のように実施されるので次の効
果を奏する。
(イ) ローダー側とアンローダー側に多数の治具を
装填し、両者間にスピンナー部とベーク部とを
設けて連続処理するようにしたので、工程は連
続化され、作業間搬送時の作業時の作業者のミ
スおよび汚染を防止でき、半導体装置の品質が
向上する。
(ロ) 本発明者の製作した装置においては、8個の
治具を装填でき、200枚の半導体ウエーハを連
続的に処理することができる。
例えば、1枚の半導体ウエーハの処理時間を
40秒とし、1個の治具に25枚収納されるとする
と、8個の治具においては2時間無人で稼動す
ることができる。
(ハ) 異ロツトの半導体ウエーハの連続処理をする
ことができる。
番地制御を行なつているため、処理后のウエー
ハは自動的にロツト別(治具単位)にアンローダ
側の収納治具に収納される。従つてロツト間の混
入がなく、異ロツトの連続処理が可能である。
本発明はホトレジスト膜の塗布、現像工程ある
いはマスク塗布、現像工程に有効に利用すること
ができる。
【図面の簡単な説明】
第1図は本発明の実施例に係る半導体ウエーハ
のホトレジスト膜処理装置の概略構造を示す外観
図、第2図は主要部の構造を示す平面図、第3図
はローダー部の機構の概略図、第4図はウエーハ
表である。 1……ローダー部、2……メイン操作パネル、
3……押し出し部、4……治具、5……半導体ウ
エーハ、6……スピンナー部、7……開閉エアー
ベアリングシユート、8……塗布ヘツド、9……
ウエーハ振分けシユート、10……ベーク部、1
1……赤外線ヒーターおよび反射板、12……ア
ンローダー部、13……回転板、14……プツシ
ヤ、15……回転板、16……モーター、17…
…エアーベアリング、18……ケース、19……
プツシヤ機構、20……治具ピツチ送り機構、2
1……モーター、22……ウエーハ有無検出装
置、23……カートリツジ有無検出装置、24,
25……1回転検出装置、26……真空ストツパ
ー、27……ストツパー、28……真空ストツパ
ー、29……シヤツター、30……ベルトコンベ
アー、31……エアーベアリング、32……真空
ストツパー、33……プツシヤ、34……レジス
トカツプ。

Claims (1)

    【特許請求の範囲】
  1. 1 処理すべき半導体ウエーハをロツト毎に収納
    するための複数の収納用治具を有するローダ部
    と、半導体ウエーハの処理部と、処理された半導
    体ウエーハを上記ロツト毎に収納するための複数
    の収納用治具を有するアンローダ部とを連続的に
    配列した装置であつて、上記ローダ部における各
    収納用治具内の半導体ウエーハ収納用位置に対応
    して半導体ウエーハの有無に関する情報を記憶す
    るコンピユータを有し、上記ローダ部における処
    理すべき半導体ウエーハの送り出し動作と、上記
    アンローダ部における処理された半導体ウエーハ
    の収納動作とが、上記情報を利用する上記コンピ
    ユータによつて制御されることにより、上記ロー
    ダ部の各収納用治具内における半導体ウエーハの
    配列状態が上記アンローダ部における各収納用治
    具内において再現されるようにされてなることを
    特徴とする半導体ウエーハ処理装置。
JP7111576A 1976-06-18 1976-06-18 Photo resist film treatment apparatus of semiconductor wafers Granted JPS52154370A (en)

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JP7111576A JPS52154370A (en) 1976-06-18 1976-06-18 Photo resist film treatment apparatus of semiconductor wafers

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Publications (2)

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JPS52154370A JPS52154370A (en) 1977-12-22
JPS6139729B2 true JPS6139729B2 (ja) 1986-09-05

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ID=13451230

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