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JPS6159019B2 - - Google Patents
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JPS6159019B2 - - Google Patents

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Publication number
JPS6159019B2
JPS6159019B2 JP53154850A JP15485078A JPS6159019B2 JP S6159019 B2 JPS6159019 B2 JP S6159019B2 JP 53154850 A JP53154850 A JP 53154850A JP 15485078 A JP15485078 A JP 15485078A JP S6159019 B2 JPS6159019 B2 JP S6159019B2
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JP
Japan
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symbol
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tone
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JP53154850A
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JPS5494220A (en
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Bii Kyanon Toomasu
Efu Oniiru Jon
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RIPABURITSUKU TERUKOMU SHISUTEMUZU CORP
Original Assignee
RIPABURITSUKU TERUKOMU SHISUTEMUZU CORP
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Publication date
Application filed by RIPABURITSUKU TERUKOMU SHISUTEMUZU CORP filed Critical RIPABURITSUKU TERUKOMU SHISUTEMUZU CORP
Publication of JPS5494220A publication Critical patent/JPS5494220A/ja
Publication of JPS6159019B2 publication Critical patent/JPS6159019B2/ja
Granted legal-status Critical Current

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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04JMULTIPLEX COMMUNICATION
    • H04J3/00Time-division multiplex systems
    • H04J3/24Time-division multiplex systems in which the allocation is indicated by an address the different channels being transmitted sequentially
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04JMULTIPLEX COMMUNICATION
    • H04J3/00Time-division multiplex systems
    • H04J3/17Time-division multiplex systems in which the transmission channel allotted to a first user may be taken away and re-allotted to a second user if the first user becomes inactive, e.g. TASI
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04QSELECTING
    • H04Q11/00Selecting arrangements for multiplex systems
    • H04Q11/04Selecting arrangements for multiplex systems for time-division multiplexing

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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Computer Hardware Design (AREA)
  • Time-Division Multiplex Systems (AREA)
  • Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
  • Small-Scale Networks (AREA)
  • Sub-Exchange Stations And Push- Button Telephones (AREA)
  • Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)

Description

【発明の詳細な説明】 本発明は時間割当通話切換挿入(TASI)シス
テムに関する。
通信伝送装置、例えばサテライト・チヤネルお
よび海底送信回線等が非常にコスト高となるた
め、従来技術では既存の送信設備の効率を最大限
に発揮させるため種々の手段を追求して来た。こ
のようなシステムの1つは、時間割当通話切換挿
入(TASI)システムとして公知である。典型的
なTASIシステムにおいてはn人の発呼者からの
呼出は、遠隔局に対して例えばn/2個の送信装置
を介して送信される。n/2個の送信装置はこの遠
隔局において、n個の出力通話チヤネルに接続さ
れている。このTASIシステムは、統計的事実と
して立証された前提、即ちいかなる時点において
も全ての発呼者が同時に話すことを欲するものと
は限らないと云う前提に基いて作用を行うのであ
る。実際に、一般原則として、発呼者は話す側と
聴く側が接続される時間の半分以下の時間で話し
をするものである。従つて、TASIシステムは、
ある時点において使用可能な通信設備があること
を前提として、話し手が実際に話をしている間だ
け話し手と聴き手を連絡する切換えシステムであ
ると定義することもできます。
ベル・システム・テクニカル・ジヤーナルの
1962年7月号1439乃至1473頁におけるJ・M・フ
レーザ(Fraser)、D・B・ブルロツク
(Bullock)、N・G・ロング(Long)の「TASI
システムの全特性」なる文献においてTASIシス
テムが説明されている。このようなシステムは、
比較的大きな数の通信設備が使用可能であり、例
えば海底ケーブルにおいて成功裡に使用されて来
た。一般に、74の通話チヤネルからの信号を送信
するため36個の送信設備があればよい。呼び線又
は制御チヤネルと呼ばれる別の送信設備を用いて
遠隔局に対して切断信号を送る。前記文献の第3
図はこのようなシステムを示す。
新らしい出力通話チヤネルに対し遠隔局の送信
設備を接続する前にこの送信設備から使用してい
ない出力通話チヤネルを切断するために従来技術
における呼び線と呼ばれる別の送信設備を使用す
ることが必要である。従来技術のシステムは通話
バーストに先行するトーン信号を送信する。この
トーンは、通話バーストが接続されるべき出力通
話チヤネルを識別する。もし送信設備がこのトー
ンの着信の前に以前に接続されている出力通話チ
ヤネルから切断れなければ、以前の接続されてい
る通話チヤネルには不快なノイズが現われる。
ところで、比較的少い数の通信設備を使用する
システムに対して時間割当通話切換挿入方式の原
理を用いることが熱望されている。例えば、僅か
4つの通信設備しかない私設回線通信システムに
このTASI方式の原理を使用することが熱望され
ている。このようなシステムの使用を最も効率的
にするためには、呼び線を除去することが望まし
い。
本発明の目的は、時間割当通話切換挿入システ
ムにおいて呼び線を排除することにある。
本発明の別の目的は、通話バーストに先行する
トーンを聴取ると云う不便さを生じることなく呼
び線を除去することにある。本発明によれば、新
らしい出力通話チヤネルを識別するトーンの着信
が聞える前に送信設備から通話チヤネルを切断す
る。
本発明によれば、入力通話チヤネルと送信設備
間の固定遅延作用は、送信設備が割当てられる通
話チヤネルを識別するトーン記号が形成される時
間間隔を生じる。このトーン記号は、情報信号の
前に送信設備に送られる。遠隔局においては、送
信設備と出力通話チヤネル間の固定遅延作用は、
このトーン記号を検出してこの記号の聴き手の聴
取部なしに必要な切換え作用を行う時間間隔を生
じる。
本発明の別の特質によれば、このトーン記号は
通話チヤネルおよびスイツチング・ビツトを識別
する複数のビツトを有する。このスイツチング・
ビツトは、その発生と対応する一定時間における
スイツチング作用を実施するため遠隔局において
検出される。
本発明の実施に当たり、その一形態においては
遠隔局における信号はデイジタルである。このデ
イジタル信号はデイジタル・メモリーに記憶され
る。これは、送信設備と出力通話チヤネル間の固
定遅延を生じる。
本発明の別の特質によれば、前記スイツチン
グ・ビツトはデイジタル・メモリーにおけるビツ
ト記憶場所に記憶されてスイツチング・ビツトに
対する固定時間遅延を提供する。このため、スイ
ツチング・ビツトを遅延させるための安価な手段
を提供する。
本発明の前記およびその他の目的、特徴、およ
び長所については、以下の詳細な説明および頭書
の特許請求の範囲を照合すれば更に良く理解され
よう。
第1図は本発明が実施されたシステム全体のブ
ロツク図である。PBX又はキー装置の如き加入者
装置11は、4線式送信装置12を含む私設回線
通信システムによつてサービスされる。加入者装
置は入力チヤネル13上で本発明の一部である本
システムに接続される。N個の入力チヤネルは通
常N/2の送信装置によつてサービスされる。一
般に、32個の入力チヤネルが16個迄の送信設備に
よつてサービスされる。
チヤネル・インターフエース回路14は、アナ
ログ/デイジタル・コンバータと、各入力チヤネ
ルを周期的にポールしてこれ等チヤネルを順次サ
ービスするスイツチング回路網を含む。固定およ
び可変送信バツフア15が設けられる。可変バツ
フアは、もしある装置が使用不可能ならばサンプ
ルされた信号に対して一時的記憶を与える。記号
ゼネレータ16は、通話バーストを発生したチヤ
ネルを表示するためある装置に送られた通話バー
ストのあるものの前に挿入されるトーン記号を生
じる。本発明によれば、固定バツフア15は、入
力信号をクリツプすることなくこの記号が送られ
る時間間隔を生じる。
通話バーストはインターフエース回路17を介
して送信装置12に接続される。インターフエー
ス回路17はスイツチング回路網とデイジタル/
アナログ・コンバータを含んでいる。
送信装置は、このアナログ信号を時に「遠端」
と呼ばれる遠隔局に送る。
遠隔局からメツセージが受取られると、固定長
さ受取りバツフア18は、記号デテクタ19がト
ーン記号を復号してどのチヤネルにこのメツセー
ジが割当てられるべきかを決定する時間間隔を生
じる。チヤネルの装置に対する割当てと種々の音
声バツフアにメツセージが記憶される時間は主と
してマイクロプロセツサである制御装置20の制
御下におかれる。
第2図においてはn個の入力通話チヤネルがあ
り、その内チヤネル1とチヤネルnのみを示す。
このようなシステムにおいて公知である如く、入
力通話チヤネルからの信号は、入力通話チヤネル
を使用可能な送信装置1…mに選択的に接続する
スイツチング回路網30に与えられる。送信装置
1およびmのみを示す。一般に、入力通話チヤネ
ルの数の半分の送信装置がある。通話デテクタ3
1,32は他のものと共に入力チヤネル上の信号
の存在を検出する。入力チヤネル上の信号の検出
に応答して、コントローラ35はスイツチング回
路網30を作用させて入力通話チヤネルを使用可
能な送信装置に接続する。第2図は送信装置mに
接続された入力通話チヤネルを示す。
本発明によれば、固定遅延回路33,34およ
びその他は各入力通話チヤネルとスイツチング回
路網30の間に接続される。遅延回路33と34
は、信号ゼネレータ(記号ゼネレータ)36から
のトーン記号が送信装置に与えられる時間間隔を
生じる。信号ゼネレータ36からのこのトーン記
号は、送信装置が割当てられた通話チヤネルを識
別する。例えば、第2図に示す如く送信装置mが
入力通話チヤネルnに割当てられたとする。信号
ゼネレータ36は入力チヤネルnを表わすトーン
記号を発生する。これは、屡々通話バーストと呼
ばれる通話信号の前に送信装置に与えられる。
32m秒遅延回路34は、この記号を通話信号の前
に挿入するため必要な時間間隔を生じる。
本発明の別の重要な特質は、固定遅延回路と並
列の回路に含まれるスイツチング37,38の提
供である。これ等は、送信装置が前記チヤネルに
接続されている限り、第1の通話バーストの後で
システの送信側から固定遅延回路を切断する能力
を与える。この遅延作用の減殺は、もし2つ以上
のシステムが継続的に接続されるならば特に重要
である。この場合、遅延内容は相互に加重し、あ
る種の通話においては不快になる。しかし、ある
入力チヤネルが新らしい送信装置に接続される第
1の通話バーストにおいてのみ遅延回路33,3
4の挿入は不快でないことが判つた。発呼者から
の通話バーストのために一つの送信装置が利用さ
れる状態では、他の発呼者からの通話バーストは
この送信装置に挿入されない。この場合には、遅
延回路による遅延期間に最初のトーン記号が通話
バーストの前に挿入されこの最初のトーン記号が
検出されスイツチング網49がこの通話バースト
を割当てられた送信装置を介して所望の出力チヤ
ネルに接続する。この後は、同一発呼者からの通
話バーストが中断(約50mmsec以上の中断)する
ことがないか、あるいはこの送信装置に別の通話
チヤネルが割当てられない限りこの接続は持続さ
れる。したがつて、最初の通話バーストに続く次
の通話バーストのためのトーン記号の挿入は必要
がなく、このため例えばスイツチ37は遅延回路
34をパスさせる。
第2図に示した本発明の一部を構成しない諸特
徴の内にはアナログ/デイジタル・コンバータ3
9,40により入力チヤネルからの信号をデイジ
タル(P.C.M.)形態に変換する能力が含まれ
る。これ等のデイジタル信号は変更可能な回数だ
けデイジタル・バツフア(図示せず)に記憶で
き、次いである装置が使用可能になる時これに送
信することができる。このデイジタル信号は、こ
れ等が送信装置に与えられる前にデイジタル/ア
ナログ・コンバータ40a,40bにより再びア
ナログ形態に変換される。
第2図に示される送信側システムの作用は次の
如くである。通話デテクタ31と32は、入力通
話チヤネルを監視して信号をコントローラ35に
与え、通話バーストが特定の入力チヤネルに現わ
れる時にこれを表示する。コントローラ35は使
用可能な送信装置に対する活動状態の通話チヤネ
ルの接続を制御する。入力通話チヤネルnに通話
バーストが生じ、このチヤネルはこの時送信装置
に接続されていないものとする。コントローラ3
5は送信装置mが使用可能であることを決定す
る。このため後で固定遅延回路34の出力を送信
装置mに接続する信号を生じる。次いでこのコン
トローラは信号ゼネレータ36の出力を送信装置
mに接続する。通話バースト間の最初の中断
〔Pause〕の後、コントローラは回路網30を切
換えてスイツチ37の出力を装置mに接続するよ
う作用する。
コントローラ35は従来のTASI方法で行われ
ている(例えば、本明細書第6頁第3行目乃至第
10行目のベル・システム・ジヤーナルにも記載さ
れている)方法で送信装置の使用可能度を決定
し、又どの装置を切断し又再び新らしい通話チヤ
ネルに接続されるべきかを決定する。コントロー
ラ35は、例えばINTEL社の8085A型の如き8ビ
ツトのマイクロプロセサで構成される。この作用
の簡単なフロー・チヤートを第5図に示す。マイ
クロプロセサの接続についてはこのフロー・ダイ
ヤグラムから明らかであろう。
信号ゼネレータ36はチヤンネルnを識別する
トーン信号を生じる。この信号は送信装置mに送
られる。このトーン信号の発生の後、通話バース
トが固定遅延回路34の出力側に生じる。これは
送信装置mに与えられ、遠隔局に送られる。この
最初の通話バーストの後、又入力通話チヤネルn
が送信装置mに接続される限り、スイツチ37は
閉路状態である。このため32m秒遅延回路34は
不要となる。
第2図のシステムの作用は第2A図乃至第2C
図に要約されるが、これ等の図は第2図の部位
A,B,Cにおける波形を示す。チヤネルnに生
じる通話バーストは第2A図に示す。このバース
トは、応答に約8m秒を要する通話デテクタ32
により検出される。通話デテクタ32の応答は第
2B図に示される。この応答は合計4個の周波数
を含む多重トーン記号41(第2図Cに示す)を
発生させるために信号ゼネレータ36を活性化す
るコントローラ35に与えられる。3個の周波数
は送信装置が割当てられた通話チヤネルとしてチ
ヤネルNを識別する。第4の周波数はスイツチン
グタイミング制御用のスイツチングトーン(スイ
ツチング信号)である。これは本例においては常
に同じ周波数、即ち1032Hzであつて、正確な時点
に遠隔局におけるスイツチを制御するために使用
される。上記3個の周波数は第6図に示された周
波数のグループから選択される。第6図は周波数
の3つのグループを示している。第6図に示すグ
ループ1は896Hz、813Hz、733Hzの周波数を含
み、グループ2は165Hz、1272Hz、1406Hz、1555
Hzの周波数を含み、グループ3は1984Hz、2104
Hz、2224Hz、2344Hzの周波数を含む。これらの周
波数は第6図の各マトリクスa,b,cの行およ
び列の付近に図式的に示されている。各マトリク
スa〜cの内の0〜40の数字は本願発明が使用さ
れているTASIシステムの各入力通話チヤネルを
示す。各マトリクスa,b,cの特定位置の行お
よび列付近の周波数は特定の入力チヤネルを表示
するために利用されるトーン記号を供給する合計
3個の周波数を示す。例えば、入力通話チヤネル
3を表示するトーン記号の場合はグループ1の
896Hz、グループ2の1165Hzおよびグループ3の
2344Hzが含まれる。これらの周波数に固定周波数
(1032Hz)のスイツチングトーンが重畳されて入
力通話チヤネル3を示す多重トーン記号41が信
号ゼネレータ(記号ゼネレータ)36から発生さ
れる(必要があればサンプリングされデイジタル
化される。)。以上のことは米国特許第4218587号
に記載されている。このトーン記号は送信装置に
生じる。32m秒の遅延の終りにトーン記号が終了
する。この時、通話バーストの始めが32m秒遅延
回路34の出力側に生じる。この通話バーストは
前のトーン記号と共に遠隔局に送られる。
第3図は、本システムの受信側のブロツク図で
ある。送信装置1およびmは本システムの受信側
に示されている。第3A図に示される送信された
トーン記号と通話バーストは送信装置mで受取ら
れている。
アナログ/デイジタル・コンバータ45,46
はある送信装置から受取るアナログ信号をデイジ
タル信号に変換する。固定遅延回路47,48
は、各送信装置とスイツチング回路網49との間
に接続される。記号デテクタ50はコントローラ
51に接続され、このコントローラは送信装置を
検出された記号により示される出力通話チヤネル
に接続する。マルチプレクサ52は、各送信装置
を4m秒の間隔でポールしてトーン記号の存在を
決定する。
本例における作用の事例においては、記号デテ
クタ50は送信装置mにおける通話チヤネルnに
対するトーン記号を検出する。コントローラ51
は送信装置mを出力通話チヤネルnに接続する。
固定遅延回路47は、この記号の検出とスイツチ
ングとが行われる時間間隔を供給する。この接続
の実際の切断作用は、トーン信号41におけるス
イツチング・ビツトの発生により決定される時点
において生じる。このスイツチング・ビツトは、
トーンデテクタ53により検出される1032Hzトー
ンである。検出されたスイツチング・ビツトは固
定遅延回路54において遅延させられる。この遅
延の終りにおいて全てのスイツチング作用がスイ
ツチング回路網49において実施される。この
時、別のスイツチ55がスイツチング装置によつ
て閉路される。このような正確なスイツチングタ
イミングにより、出力通話チヤネルnはトーン記
号のいかなる部分又はスイツチング・ノイズも聞
えない。
送信装置1は、同様の1032Hzのトーンデテクタ
56とスイツチング・ビツトに対する固定遅延回
路57を有する。出力通話チヤネル1は、同様に
前記チヤネルが割当てられた送信装置に接続され
る時スイツチング・ビツトにより閉路されるスイ
ツチ58を有する。
第3A図においては、時点59においてトーン
記号が受取られデテクタ50によつて検出され
る。コントローラ51は、スイツチング回路網4
9の点線により示される如く、この記号に応答し
て送信装置mに前以つて割当てられた出力通話チ
ヤネルを切断し、出力通話チヤネルnを前記送信
装置に接続する。時点59(第3A図)において
トーンデテクタ53は1032Hzのスイツチング・ビ
ツトにおける転換を検出する。24m秒後にスイツ
チ55は閉路される。これは第3B図における時
点60において生じる。この時、通話バーストの
最初の部分は遅延回路47から生じる。これはス
イツチ55を経て出力通話チヤネルに至るが、こ
のチヤネルにおいてはトーン記号もノイズも全く
聞えない。
第4図は本システムの受信側のデイジタル構成
を示している。デイジタル・メモリー61は第3
図の固定遅延回路47,48,54および57を
構成する装置を提供する。
最初に、送信装置mに割当てられたデイジタ
ル・メモリー61の部分について述べよう。アナ
ログ/デイジタル・コンバータ45の出力は8ビ
ツト・ワードで、その最初は記憶場所62に挿入
される。連続する8ビツト・ワードは記憶場所6
3,64,65…67に記憶される。本例におい
ては、ワードが記憶される192の連続する記憶場
所がある。1つのサンプルが最後の記憶場所に記
憶されると、最初の記憶場所が読出され、新らし
いサンプルがこゝに記憶される。後に続く記憶場
所が読出され、新らしいサンプルがこれに記憶さ
れる。24m秒の遅延がある記憶場所の記憶と次に
読出された記憶との間に生じる。
本発明によれば、各記憶場所はスイツチング・
ビツトに対する遅延を生じるために使用される9
番目のビツト場所を含む。即ち、記憶場所62は
9番目のビツト場所68を含み、記憶場所63は
9番目のビツト場所69を含む……如くである。
トーンデテクタ53からのスイツチング・ビツト
はビツト場所68に与えられ、連続する時点のス
イツチング・ビツト又はその欠番は連続する記憶
場所に記憶される。このためスイツチング・ビツ
トに対して固定された24m秒の遅延を与える。こ
の遅延を与えるためメモリー61におけるビツト
場所の使用は遅延手段として非常に安価な方法で
ある。
同様に、デイジタル・メモリー61の他の部分
は他の送信装置に対して割当てられて通話バース
トおよびスイツチング・ビツトに対する固定遅延
を提供する。
メモリーにおける9番目のビツト場所からの出
力はフリツプフロツプ71に与えられる。この出
力の立下りはフリツプフロツプ71をセツトし、
これがスイツチ55を閉路する。スイツチ55
は、スイツチング時に導通状態となるソリツド・
ステート装置72を含んでいる。スイツチ55
は、送信装置に接続されない時出力チヤネルに対
し低レベルのノイズ・ソースを接続する。このた
め、聴き手は自分の送信装置が切換られているこ
とに気が付かない。
第4図は、メモリー61がトーン記号を検出す
るため順次マルチプレクサ52によつてポールさ
れる方法を示している。250マイクロ秒毎に、デ
イジタル・メモリー61の異なる部分が記号デテ
クタ50に読出される。記号の検出のため192ワ
ードが提供される。第4図は、マルチプレクサ5
2を経て記号デテクタ50に並列に読出されるこ
れ等の192のワードを示す。実施においては、こ
れ等の192ワードは、これ等がアナログ/デイジ
タル・コンバータ45およびデイジタル/アナロ
グ・コンバータ73の間でシフトされるより遥か
に早い速度で循環される。これは並列読出しと同
じ効果を有する。各装置はこのようにして本実施
例の16の送信システムにおいて4秒毎に検査が行
われた。
前述の如く連続する記憶場所における連続する
サンプルの記憶の代りに、各サンプルを最初の記
憶場所に記憶させて、シフトレジスタの方法で連
続する記憶場所にシフトさせることもできること
は理解されよう。他の変更例も本発明の主旨およ
び範囲内に含まれる。頭書の特許請求の範囲はか
かる全ての変更例を網羅するためのものである。
【図面の簡単な説明】
第1図は本発明が実施されたシステム全体を示
すブロツク図、第2図は該システムの送信側のブ
ロツク図、第2A図乃至第2C図は第2図におけ
る部位A,B,Cにおける波形を示すグラフ、第
3図は該システムの受信側のブロツク図、第3A
図乃至第3D図は第3図および第4図の部位A,
B,C,Dにおける信号を示す波形グラフ、第4
図はデイジタル・メモリーを有する遅延回路を示
すブロツク図、および第5図は該システムの送信
側のコントローラの作用を示すフロー・チヤート
第6図は記号ゼネレータの説明図である。 11…加入者装置、12…送信装置、13…入
力チヤネル、14…チヤネル・インターフエース
回路、15…送信バツフア、16…記号ゼネレー
タ、18…固定長さ受取りバツフア、19…記号
デテクタ、20…制御装置、30…スイツチング
回路網、31,32…通話デテクタ、33,34
…遅延回路、35…コントローラ、36…信号ゼ
ネレータ、37,38…スイツチ、39,40,
45,46…アナログ/デイジタルコンバータ、
40a,40b…デイジタル/アナログ・コンバ
ータ、41…音色記号、47,48,54,57
…固定遅延回路、49…スイツチング回路網、5
0…記号デテクタ、51…コントローラ、52…
マルチプレクサ、53,56…音色デテクタ、6
1…デイジタル・メモリー、62〜67…記憶場
所、68,69…ビツト場所。

Claims (1)

  1. 【特許請求の範囲】 1 複数の入力通話チヤネルからの信号を前記チ
    ヤネル数よりも少ない数の送信装置に与えるため
    の第1のスイツチング装置と、 各入力通話チヤネル上の信号の存在を検出する
    ため各々の該チヤネルに結合された通話デテクタ
    と、 前記送信装置からの信号を複数の出力通話チヤ
    ネルに与えるための遠隔局における第2のスイツ
    チング装置と、 前記通話デテクタに応答して入力通話チヤネル
    上に信号が検出される時該チヤネルを使用可能な
    送信装置に割当てるように前記第1のスイツチン
    グ装置を制御するための制御装置とを有する型式
    の通信システムにおいて、 送信装置が割当てられた通話チヤネルを識別す
    る記号を生成するため前記制御装置により作動さ
    せられる記号ゼネレータと、 各入力通話チヤネルと前記第1のスイツチング
    装置間に第1の固定遅延回路を設け、前記記号は
    前記第1のスイツチング装置が動作する毎に前記
    信号に先立ちかつ前記第1の固定遅延回路の時間
    間隔の間において割当てられた送信装置に与えら
    れることと、 前記遠隔局において前記第2のスイツチング装
    置に接続されて前記第1のスイツチング装置が動
    作する毎に検出された記号により表示される出力
    通話チヤネルに前記割当てられた送信装置を接続
    する制御を可能にする記号デテクタと、 各送信装置と前記第2のスイツチング装置間に
    第2の固定遅延回路を設け、該第2の固定遅延回
    路は記号の検出と前記第2のスイツチング装置の
    スイツチング動作が生じる時間間隔を発生するこ
    とを特徴とする通信システム。 2 各記号が通話チヤネルを識別する複数のビツ
    トと別個のスイツチングトーンを含み、更に、 トーンを2進数のスイツチング信号に変換する
    ための前記遠隔局におけるトーンデテクタと、 検出されたスイツチング信号を遅延させる装置
    とを設け、この遅延させられ検出されたスイツチ
    ング信号は前記第2のスイツチング装置に接続さ
    れ、割当てられた送信装置を前記の検出された信
    号によつて表示された出力通話チヤネルに接続す
    ることを特徴とする特許請求の範囲1項記載のシ
    ステム。 3 前記信号はデイジタル信号であり、各送信装
    置と前記第2のスイツチング装置間の前記第2の
    固定遅延回路は、 前記信号のデイジタル・サンプルがその記憶場
    所のシーケンスで記憶されるデイジタル・メモリ
    ーを含むことを特徴とする特許請求の範囲2項記
    載のシステム。 4 各サンプルが固定された時間ある記憶場所に
    記憶され、後でそれが記憶されたと同じシーケン
    スで読出されることを特徴とする特許請求の範囲
    3項記載のシステム。 5 前記記憶場所の各々が、前記デイジタル・サ
    ンプルのワードに対する複数のビツト場所と前記
    スイツチング信号に対する少くとも1つのビツト
    場所を含み、前記トーンデテクタの出力は前記の
    最後に指定された信号場所に与えられて前記スイ
    ツチング信号に対する固定された遅延を生じるこ
    とを特徴とする特許請求の範囲3項記載のシステ
    ム。 6 各入力通話チヤネルと前記第1のスイツチン
    グ装置間の前記第1の固定遅延回路と並列に接続
    された回路と、 ある送信装置がある通話チヤネルに割当てら
    れ、かつ最初の通話中断が生じた後では前記信号
    が遅延されることのないように前記並列回路を閉
    路する装置とを更に設けることを特徴とする特許
    請求の範囲1項記載のシステム。 7 前記記号ゼネレータが、前記通話チヤネルを
    識別する異なる周波数の複数のトーンと、前記ス
    イツチング信号として固定された周波数の1つの
    トーンを生じることを特徴とする特許請求の範囲
    1項記載のシステム。
JP15485078A 1977-12-23 1978-12-15 Communication system Granted JPS5494220A (en)

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US05/863,890 US4147896A (en) 1977-12-23 1977-12-23 Fixed speech buffer memories for signalling without an order wire

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JPS5494220A JPS5494220A (en) 1979-07-25
JPS6159019B2 true JPS6159019B2 (ja) 1986-12-15

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ID=25342033

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JP15485078A Granted JPS5494220A (en) 1977-12-23 1978-12-15 Communication system

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JP (1) JPS5494220A (ja)
AU (1) AU521536B2 (ja)
BR (1) BR7808354A (ja)
CA (1) CA1109972A (ja)
DE (1) DE2854842C2 (ja)
FR (1) FR2412991A1 (ja)
GB (1) GB2011224B (ja)
IL (1) IL55907A (ja)
IT (1) IT1101085B (ja)
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NL (1) NL7812530A (ja)
SE (1) SE7813075L (ja)

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AU4273978A (en) 1979-06-28
DE2854842A1 (de) 1979-07-05
AU521536B2 (en) 1982-04-08
NL7812530A (nl) 1979-06-26
BR7808354A (pt) 1979-08-21
MX145300A (es) 1982-01-22
IL55907A (en) 1981-03-31
DE2854842C2 (de) 1985-11-07
GB2011224A (en) 1979-07-04
IL55907A0 (en) 1979-01-31
FR2412991A1 (fr) 1979-07-20
CA1109972A (en) 1981-09-29
IT7831278A0 (it) 1978-12-22
GB2011224B (en) 1982-04-28
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US4147896A (en) 1979-04-03
JPS5494220A (en) 1979-07-25
IT1101085B (it) 1985-09-28

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