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JPS6214457B2 - - Google Patents
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JPS6214457B2 - - Google Patents

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Publication number
JPS6214457B2
JPS6214457B2 JP53077274A JP7727478A JPS6214457B2 JP S6214457 B2 JPS6214457 B2 JP S6214457B2 JP 53077274 A JP53077274 A JP 53077274A JP 7727478 A JP7727478 A JP 7727478A JP S6214457 B2 JPS6214457 B2 JP S6214457B2
Authority
JP
Japan
Prior art keywords
pocket
circuit
letters
signal
accumulated
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP53077274A
Other languages
Japanese (ja)
Other versions
JPS557120A (en
Inventor
Kenji Hirose
Yoshimi Sasaki
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Toshiba Corp
Original Assignee
Tokyo Shibaura Electric Co Ltd
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Publication date
Application filed by Tokyo Shibaura Electric Co Ltd filed Critical Tokyo Shibaura Electric Co Ltd
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Description

【発明の詳細な説明】 本発明はたとえば郵便番号自動読取区分機にお
いて、搬送区分された郵便物を集積する集積部の
集積満杯検出装置に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a stack fullness detection device for a stacking section that stacks conveyed and sorted mail in, for example, an automatic postal code reading and sorting machine.

従来、この種の集積満杯検出装置として、たと
えば第1図に示すようなものが知られている。こ
れは、集積部たとえば集積ポケツト1に集積され
た書状Pの重量を利用することにより、各ポケツ
ト1にそれぞれ設けた2個の検知器たとえばマイ
クロスイツチ2および3を用いて、集積満杯を検
出するものである。すなわち、まず集積量が所定
枚数に達したことをスイツチ2で検知し、その検
知信号により表示器4で所定枚数に達したポケツ
トを表示する。しかる後、集積量が満杯になつた
ことをスイツチ3で検知し、その検知信号で供給
停止回路5を作動させて書状の供給を停止させる
ものである。なお、図中6は搬送ベルト、7は区
分ゲート、8はゲート制御用の書状検知器、9は
ゲート制御回路である。
Conventionally, as this type of integrated fullness detection device, one shown in FIG. 1, for example, is known. This uses the weight of the letters P accumulated in the accumulation section, for example the accumulation pocket 1, to detect when the accumulation is full by using two detectors, for example micro switches 2 and 3, provided in each pocket 1. It is something. That is, first, the switch 2 detects that the accumulated amount has reached a predetermined number of sheets, and based on the detection signal, the display 4 displays the pockets in which the predetermined number of sheets has been reached. Thereafter, the switch 3 detects that the storage capacity is full, and the detection signal activates the supply stop circuit 5 to stop the supply of letters. In the figure, 6 is a conveyor belt, 7 is a sorting gate, 8 is a letter detector for gate control, and 9 is a gate control circuit.

しかしながら、このような従来の集積満杯検出
装置では、各ポケツト(集積部)ごとにそれぞれ
マイクロスイツチ(検知器)が2個必要であり、
このためポケツトの数が多ければ多いほど、それ
に伴いマイクロスイツチの数も著しく多くなり、
非常に複雑かつコスト高となる。また、マイクロ
スイツチをポケツトに固定しているので、その位
置変更も容易にできず、よつて満杯検出の設定値
を容易に変更できないという欠点もあつた。
However, such conventional integrated fullness detection devices require two microswitches (detectors) for each pocket (accumulating section).
For this reason, the more pockets there are, the more microswitches there will be.
Very complex and costly. Furthermore, since the microswitch is fixed in the pocket, its position cannot be easily changed, and therefore the set value for fullness detection cannot be easily changed.

本発明は上記事情に鑑みてなされたもので、そ
の目的とするところは、重量による制御ではな
く、数量による満杯検出制御を電気的に行うこと
により、検知器の数を著しく減少でき、簡単な構
成にしてコストの低下が計れ、しかも満杯検出の
設定値も確実かつ容易に変更し得る集積満杯検出
装置を提供しようとするものである。
The present invention has been made in view of the above circumstances, and its purpose is to electrically perform fullness detection control based on quantity rather than control based on weight, thereby significantly reducing the number of detectors and making it simple. It is an object of the present invention to provide an integrated fullness detection device that can be configured to reduce costs and also allow the set value for fullness detection to be changed reliably and easily.

以下、本発明の一実施例について図面を参照し
て説明する。
An embodiment of the present invention will be described below with reference to the drawings.

第2図において、11は搬送路であり、図示し
ない郵便番号読取部を通過した書状Pを図示矢印
方向に搬送してくる。上記搬送路11の下方部位
には、複数の集積部たとえば集積ポケツト12
〜12oが所定間隔おいて配設されている。上記
各ポケツト12〜12oは、後述する区分され
た書状Pをバツクアツプ板13〜13o上に順
次重合集積するものである。上記バツクアツプ板
13〜13oは、集積された書状Pの重量に応
じて下降するようになつている。上記各ポケツト
12〜12o内の下部所定位置には、それぞれ
検知器たとえばマイクロスイツチ14〜14o
が設けられている。このスイツチ14〜14o
は、下降してくるバツクアツプ板13〜13o
によつて作動されることにより、ポケツト12
〜12o内に集積された書状Pが所定枚数(略満
杯)に達したことを検知するものである。しかし
て、上記搬送路11の各ポケツト12〜12o
とそれぞれ対応する部位には、搬送されてくる書
状Pを対応するポケツトに区分する区分ゲート1
〜15oが設けられている。また、上記搬送
路11の各区分ゲート15〜15oの手前に
は、搬送されてくる書状Pを光学的に検知する検
知器16〜16oが設けられている。これら各
検知器16〜16oの出力信号はゲート制御回
路17にそれぞれ供給され、このゲート制御回路
17には前記読取部(図示しない)から区分指定
コードも供給される。このゲート制御回路17
は、供給される区分指定コードと検知器16
16oの出力信号とにより、対応するポケツト1
〜12oの区分ゲート15〜15oをそれぞ
れ駆動制御するものである。ここに、上記区分指
定コードは、書状Pを区分すべきポケツトを指定
するコード信号であつて、前記読取部から読取つ
た郵便番号に応じて出力されるものである。
In FIG. 2, reference numeral 11 denotes a conveyance path, which conveys the letter P that has passed through a postal code reading section (not shown) in the direction of the arrow shown in the figure. At the lower part of the conveyance path 11, there are a plurality of accumulation parts, for example, accumulation pockets 12 1
~12 o are arranged at predetermined intervals. Each of the pockets 12 1 to 12 o is used to sequentially stack and accumulate separated letters P, which will be described later, on backup plates 13 1 to 13 o . The backup plates 13 1 to 13 o are adapted to descend in accordance with the weight of the accumulated letters P. Detectors such as micro switches 14 1 to 14 o are installed at predetermined lower positions in each of the pockets 12 1 to 12 o.
is provided. This switch 14 1 ~ 14 o
are the descending backup plates 13 1 to 13 o
pocket 12 1 by being activated by
This is to detect that the number of letters P accumulated within ~12 o has reached a predetermined number (substantially full). Therefore, each pocket 12 1 to 12 o of the conveyance path 11
In the corresponding parts, there is a sorting gate 1 for sorting the conveyed letter P into corresponding pockets.
5 1 to 15 o are provided. Furthermore, in front of each of the division gates 15 1 to 15 o on the conveyance path 11, detectors 16 1 to 16 o are provided to optically detect letters P being conveyed. The output signals of these detectors 16 1 to 16 o are respectively supplied to a gate control circuit 17, and the gate control circuit 17 is also supplied with a classification designation code from the reading section (not shown). This gate control circuit 17
The supplied classification designation code and detector 16 1 ~
16 o output signal, the corresponding pocket 1
2 1 to 12 o segment gates 15 1 to 15 o are driven and controlled, respectively. Here, the sorting designation code is a code signal that specifies the pocket in which the letter P is to be sorted, and is output in accordance with the postal code read from the reading section.

また、前記各スイツチ14〜14oの出力信
号は、表示部18およびアドレス指定回路19に
それぞれ供給される。上記表示部18は、スイツ
チ14〜14oの出力信号が供給されることに
より、対応するポケツト内の集積書状Pが所定枚
数(略満杯)に達したことを表示するものであ
る。また、上記アドレス指定回路19には前記区
分指定コードも供給される。上記アドレス指定回
路19は、RAM(ランダム・アクセス・メモ
リ)20のアドレスを指定する回路である。すな
わち、上記RAM20は、各ポケツト12〜1
oにそれぞれ対応するアドレスA1〜Aoを有して
おり、これら各アドレスA1〜Aoをスイツチ14
〜14oの出力信号と供給される区分指定コー
ドとにより指定し、その指定アドレスの内容を加
算器21に供給するようになつている。上記加算
器21はRAM20から供給された指定アドレス
の内容に「1」を加算し、その加算結果を比較器
22に供給するとともに、再びRAM20の対応
する指定アドレス内にメモリ(更新)するもので
ある。上記比較器22は、加算器21の出力と設
定回路23の出力とを比較し、両者が一致したと
き信号を出力する回路である。また、上記設定回
路23は、スイツチ14〜14oがポケツト1
〜12o内に集積された書状Pが所定枚数に
達したことを検知した後、何枚集積されたとき満
杯とするかの標準枚数を設定する回路である。し
かして、上記比較器22の出力信号は、集積満杯
検出信号として供給停止回路24に供給される。
この供給停止回路24は、比較器22から信号が
出力されると、図示しない書状供給部の動作を停
止させるとともに、報知器25を作動させる回路
である。
Further, the output signals of the switches 14 1 to 14 o are supplied to the display section 18 and the address designation circuit 19, respectively. The display unit 18 is provided with output signals from the switches 14 1 to 14 o to display that the number of accumulated letters P in the corresponding pocket has reached a predetermined number (substantially full). Further, the classification designation code is also supplied to the address designation circuit 19. The addressing circuit 19 is a circuit that specifies an address of a RAM (random access memory) 20. In other words, the RAM 20 is configured in each pocket 12 1 to 1.
2 o respectively, and these addresses A 1 to A o are connected to the switch 14 .
The address is designated by an output signal of 1 to 14 o and a supplied classification designation code, and the contents of the designated address are supplied to the adder 21. The adder 21 adds "1" to the contents of the specified address supplied from the RAM 20, supplies the addition result to the comparator 22, and stores (updates) the corresponding specified address in the RAM 20 again. be. The comparator 22 is a circuit that compares the output of the adder 21 and the output of the setting circuit 23, and outputs a signal when the two match. Further, the setting circuit 23 has switches 14 1 to 14 o connected to the pocket 1.
After detecting that the number of letters P accumulated within 2 1 to 12 o has reached a predetermined number, this circuit sets the standard number of letters P that must be accumulated to be considered full. The output signal of the comparator 22 is then supplied to the supply stop circuit 24 as an integrated full detection signal.
The supply stop circuit 24 is a circuit that, when a signal is output from the comparator 22, stops the operation of a letter supply unit (not shown) and also activates the alarm 25.

次に、このような構成において動作を説明す
る。たとえば今、区分機が動作すると、図示しな
い供給部から書状が1枚ずつ順次供給され、図示
しない読取部を通過する。この読取部を通過した
書状Pは、搬送路11でポケツト12〜12o
に向つて搬送されてくる。一方、読取部からは通
過する書状Pに対応する区分指定コードが出力さ
れ、ゲート制御回路17に供給される。これによ
り、ゲート制御回路17は、区分指定コードと検
知器16〜16oの出力信号とにより、対応す
るポケツト12〜12oの区分ゲート15
15oを駆動制御し、搬送されてくる書状Pを所
定のポケツトに区分せしめる。すなわち、たとえ
ば区分指定コードがポケツト12を指定するコ
ードであつて、それと対応する書状Pが検知器1
で検知されると、区分ゲート15が駆動さ
れ、よつて上記書状Pはポケツト12に区分集
積されるものである。このようにして、各ポケツ
ト12〜12oにそれぞれ書状Pが区分集積さ
れるものである。そして、各ポケツト12〜1
oのバツクアツプ板13〜13oは、その上に
集積される書状Pの重量に応じて下降する。
Next, the operation in such a configuration will be explained. For example, when the sorting machine operates now, letters are sequentially supplied one by one from a supply section (not shown) and pass through a reading section (not shown). The letter P that has passed through this reading section is sent to the pockets 12 1 to 12 o on the conveyance path 11.
It is being transported towards. On the other hand, a classification designation code corresponding to the passing letter P is output from the reading section and supplied to the gate control circuit 17. Thereby, the gate control circuit 17 selects the classification gates 15 1 to 15 of the corresponding pockets 12 1 to 12 o based on the classification designation code and the output signals of the detectors 16 1 to 16 o .
15 o is driven and controlled, and the letters P being conveyed are sorted into predetermined pockets. That is, for example, if the classification designation code is a code that designates pocket 121 , and the corresponding letter P is a code that designates pocket 121,
When detected at 61 , the sorting gate 151 is driven, so that the letter P is sorted and accumulated in the pocket 121 . In this way, the letters P are sorted and accumulated in each of the pockets 12 1 to 12 o . And each pocket 12 1 ~ 1
The backup plates 13 1 to 13 o of 2 o are lowered according to the weight of the letters P accumulated thereon.

しかして今、たとえばポケツト12に集積さ
れた書状Pが所定枚数に達し、それがスイツチ1
で検知されると、その検知信号は表示器18
に供給される。これにより表示器は、ポケツト1
内の集積書状Pが所定枚数(略満杯)に達し
たことを表示し、それをオペレータに報知する。
また、上記スイツチ14からの検知信号はアド
レス指定回路19にも供給される。したがつて、
この状態において、読取部からポケツト12
指定する区分指定コードが出力され、その区分指
定コードがアドレス指定回路19に供給される
と、アドレス指定回路19はRAM20の上記区
分指定コードに対応するアドレスたとえばA1
指定し、その指定アドレスA1の内容を加算器2
1に供給する。加算器21は、上記指定アドレス
A1の内容に「1」を加算し、その加算結果を比
較器22に供給するとともに、再びRAM20の
上記指定アドレスA1内にメモリする。すなわ
ち、初期状態においてはRAM20の各アドレス
A1〜Ao内はすべて「0」となつており、よつて
この場合は加算器21の加算結果は「1」とな
り、それがRAM20の指定アドレスA1にメモリ
される。以上の動作を同じ区分指定コードが出力
されるごとに繰り返すことにより、上記アドレス
A1の内容は「1」→「2」→「3」→……と順
次更新されて行く。
However, now, for example, the number of letters P accumulated in pocket 121 has reached a predetermined number, and the number of letters P accumulated in pocket 121 has reached a predetermined number.
4 When detected by 1 , the detection signal is displayed on the display 18.
is supplied to This will cause the display to indicate pocket 1.
2 Displays that the number of accumulated letters P in 1 has reached a predetermined number (substantially full) and notifies the operator of this fact.
Further, the detection signal from the switch 141 is also supplied to the addressing circuit 19. Therefore,
In this state, when a classification designation code specifying pocket 121 is output from the reading section and the classification designation code is supplied to the address designation circuit 19, the address designation circuit 19 reads the address corresponding to the classification designation code in the RAM 20. For example, if A 1 is specified, the contents of the specified address A 1 are sent to the adder 2.
Supply to 1. The adder 21 receives the specified address above.
`` 1 '' is added to the contents of A 1 and the addition result is supplied to the comparator 22 and is again stored in the specified address A 1 of the RAM 20 . That is, in the initial state, each address of RAM20
All of A 1 to A o are "0", so in this case, the addition result of the adder 21 is "1", which is stored in the designated address A 1 of the RAM 20. By repeating the above operation every time the same classification designation code is output, the above address
The contents of A1 are updated sequentially as "1" → "2" → "3" →...

しかして、比較器22は、加算器21の出力と
設定回路23の出力とを比較し、両者が一致した
とき信号を出力し、この出力信号は集積満杯検出
信号として供給停止回路24に供給される。こう
なると、供給停止回路24は、図示しない書状供
給部の動作を停止させ、報知器25でその旨をオ
ペレータに報知する。ここで、オペレータがポケ
ツト12内の書状Pを取出して満杯状態を解除
することにより、スイツチ14から検知信号が
出力されなくなる。これにより、表示器18は表
示内容がクリアされるとともに、アドレス指定回
路19はRAM20の対応するアドレスA1の内容
をクリアして「0」にする。
The comparator 22 compares the output of the adder 21 and the output of the setting circuit 23, and outputs a signal when the two match, and this output signal is supplied to the supply stop circuit 24 as an integrated full detection signal. Ru. When this happens, the supply stop circuit 24 stops the operation of the letter supply section (not shown) and notifies the operator of this with the alarm 25. Here, when the operator removes the letter P from the pocket 121 to release the full state, the switch 141 no longer outputs the detection signal. As a result, the display contents of the display 18 are cleared, and the address designating circuit 19 clears the contents of the corresponding address A1 of the RAM 20 to "0".

なお、前記実施例では、設定回路23におい
て、ポケツトに集積された書状Pが所定枚数に達
したのち何枚集積されたとき満杯とするかの設定
値として各ポケツト12〜12oの標準枚数を
設定したが、これに限らず、たとえば各ポケツト
12〜12oごとにそれぞれ枚数を設定するよ
うにしてもよい。この場合、たとえばROMを用
いてそれぞれの値をメモリさせればよい。また、
アドレス指定回路19、RAM20および加算器
21によつて書状の数を計数するようにしたが、
これに限らず、たとえば通常のカウンタ回路を用
いて計数してもよい。さらに、郵便番号自動読取
区分機において郵便物を集積する集積部に実施し
た場合について説明したが、これに限らず、他の
搬送されてくる物品を集積する集積部にも同様に
実施し得ることは勿論である。
In the above embodiment, the setting circuit 23 sets the standard number of letters P in each pocket 12 1 to 12 o as a set value for determining how many letters P must be accumulated to make the pocket full after the number of letters P accumulated in the pocket reaches a predetermined number. is set, but the number is not limited to this, and for example, the number of sheets may be set for each of the pockets 12 1 to 12 o . In this case, each value may be stored in memory using, for example, a ROM. Also,
Although the number of letters is counted by the addressing circuit 19, RAM 20 and adder 21,
The count is not limited to this, and a normal counter circuit may be used for counting, for example. Furthermore, although the case has been described in which the application is applied to the stacking section that collects mail items in an automatic postal code reading and sorting machine, the present invention is not limited to this, and can be similarly implemented to the stacking section that collects other transported items. Of course.

以上詳述したように本発明によれば、集積部に
集積された物品が所定量に達したことを検知し、
この検知信号によりそれ以後集積部に集積される
物品の数を計数し、その計数内容が設定値と一致
したとき集積満杯検出信号を出力するようにした
ので、電気的な制御により集積満杯を検出でき、
これにより検知器の数を著しく減少でき、簡単な
構成にしてコストの低下が計れ、しかも満杯検出
の設定値も確実かつ容易に変更し得、特に集積部
の数が多いほど顕著な効果を発揮する集積満杯検
出装置を提供できる。
As detailed above, according to the present invention, it is detected that the number of articles accumulated in the accumulation section has reached a predetermined amount,
This detection signal is used to count the number of articles that will be stacked in the stacking section after that, and when the count matches the set value, a stacking full detection signal is output, so electrical control can detect when the stacking is full. I can,
This makes it possible to significantly reduce the number of detectors, reduce costs with a simple configuration, and also allow the setting value for full detection to be changed reliably and easily, and the effect is particularly noticeable as the number of accumulation parts increases. An integrated fullness detection device can be provided.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来の集積満杯検出装置を示す構成
図、第2図は本発明の一実施例を示す構成図であ
る。 P……書状(物品)、11……搬送路、12
〜12o……集積部(ポケツト)、14〜14o
……検知器、15〜15o……区分ゲート、1
7……ゲート制御回路、18……表示器、19…
…アドレス指定回路、20……RAM、21……
加算器、22……比較器、23……設定回路。
FIG. 1 is a block diagram showing a conventional integrated fullness detection device, and FIG. 2 is a block diagram showing an embodiment of the present invention. P...Letter (article), 11...Conveyance path, 12 1
~12 o ...Accumulation part (pocket), 14 1 ~14 o
...Detector, 15 1 to 15 o ...Division gate, 1
7...Gate control circuit, 18...Display device, 19...
...Addressing circuit, 20...RAM, 21...
Adder, 22... Comparator, 23... Setting circuit.

Claims (1)

【特許請求の範囲】[Claims] 1 搬送されてくる物品を順次集積する集積部
と、この集積部に設けられその中に集積された物
品が所定数に達するとそれを検出して信号を出力
する検知器と、この検知器から信号が出力される
とそれ以後前記集積部に集積される物品の数を計
数する計数手段と、前記検知器より信号が出力さ
れた後に前記集積部に集積可能な枚数を設定する
設定手段と、前記計数手段による計数内容を前記
設定手段の設定値と比較しこの比較結果に基づき
集積満杯検出信号を出力する比較器とを具備した
ことを特徴とする集積満杯検出装置。
1. A stacking section that sequentially stacks the transported articles, a detector installed in this stacking section that detects and outputs a signal when the number of articles accumulated therein reaches a predetermined number, and a detector that outputs a signal from the detector. a counting means for counting the number of articles to be stacked in the stacking section after a signal is output; and a setting means for setting the number of articles that can be stacked in the stacking section after the signal is output from the detector; An accumulation full detection device comprising: a comparator that compares the count by the counting means with a set value of the setting means and outputs an accumulation full detection signal based on the comparison result.
JP7727478A 1978-06-26 1978-06-26 Full up detector Granted JPS557120A (en)

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JP7727478A JPS557120A (en) 1978-06-26 1978-06-26 Full up detector

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Publication Number Publication Date
JPS557120A JPS557120A (en) 1980-01-18
JPS6214457B2 true JPS6214457B2 (en) 1987-04-02

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ID=13629270

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JP7727478A Granted JPS557120A (en) 1978-06-26 1978-06-26 Full up detector

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