JPS6233766B2 - - Google Patents
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- Publication number
- JPS6233766B2 JPS6233766B2 JP52126621A JP12662177A JPS6233766B2 JP S6233766 B2 JPS6233766 B2 JP S6233766B2 JP 52126621 A JP52126621 A JP 52126621A JP 12662177 A JP12662177 A JP 12662177A JP S6233766 B2 JPS6233766 B2 JP S6233766B2
- Authority
- JP
- Japan
- Prior art keywords
- amplifier
- terminal
- circuit
- capacitor
- input terminal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
- H03F3/45—Differential amplifiers
- H03F3/45071—Differential amplifiers with semiconductor devices only
- H03F3/45479—Differential amplifiers with semiconductor devices only characterised by the way of common mode signal rejection
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03C—MODULATION
- H03C7/00—Modulating electromagnetic waves
- H03C7/02—Modulating electromagnetic waves in transmission lines, waveguides, cavity resonators or radiation fields of antennas
- H03C7/025—Modulating electromagnetic waves in transmission lines, waveguides, cavity resonators or radiation fields of antennas using semiconductor devices
- H03C7/027—Modulating electromagnetic waves in transmission lines, waveguides, cavity resonators or radiation fields of antennas using semiconductor devices using diodes
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Amplifiers (AREA)
Description
【発明の詳細な説明】
本発明は差動入力音響増幅器において電源リツ
プルにより出力端にモータボーデイング等の雑音
が生じることを防止するための回路構成に関する
ものである。
プルにより出力端にモータボーデイング等の雑音
が生じることを防止するための回路構成に関する
ものである。
第１図は従来よく知られている差動入力音響増
幅器の基本構成図で、差動増幅器１４の非反転入
力端１０１のバイアスは電源端子１０５と接地端
子１０６との間に接続された抵抗１０７，１０８
のブリーダ回路によつて決定され、コンデンサー
１１３は電源変動（電源リツプル）が入力に対し
て与える影響を少なくするために設けてあるリツ
プルフイルター用コンデンサーであり、よく用い
られている回路である。反転入力端１０３は出力
端１０４から抵抗１１０，１１１とコンデンサー
１１２によつて負帰還回路を形成している。
幅器の基本構成図で、差動増幅器１４の非反転入
力端１０１のバイアスは電源端子１０５と接地端
子１０６との間に接続された抵抗１０７，１０８
のブリーダ回路によつて決定され、コンデンサー
１１３は電源変動（電源リツプル）が入力に対し
て与える影響を少なくするために設けてあるリツ
プルフイルター用コンデンサーであり、よく用い
られている回路である。反転入力端１０３は出力
端１０４から抵抗１１０，１１１とコンデンサー
１１２によつて負帰還回路を形成している。
上記の回路構成の差動入力音響増幅器に印加さ
れる電源の電源リツプル（Vripple）はブリーダ
回路の抵抗１０７の抵抗値R107と抵抗１０８の抵
抗値R108とのコンデンサー１１３のインピーダン
スZ113により分割され、 （Ｒ１０８Ｚ１１３）／Ｒ１０７＋（Ｒ１０８Ｚ１
１３）・Vripple となり、かかるリツプル信号が上記差動入力増幅
器の非反転入力端１０１に信号として加わり、差
動入力増幅器の電圧利得倍され出力端１０４に現
われる。この出力電圧の変動は大変耳ざわりな音
であり、場合によつてはモーターボーデイングを
生ずる恐れがある。
れる電源の電源リツプル（Vripple）はブリーダ
回路の抵抗１０７の抵抗値R107と抵抗１０８の抵
抗値R108とのコンデンサー１１３のインピーダン
スZ113により分割され、 （Ｒ１０８Ｚ１１３）／Ｒ１０７＋（Ｒ１０８Ｚ１
１３）・Vripple となり、かかるリツプル信号が上記差動入力増幅
器の非反転入力端１０１に信号として加わり、差
動入力増幅器の電圧利得倍され出力端１０４に現
われる。この出力電圧の変動は大変耳ざわりな音
であり、場合によつてはモーターボーデイングを
生ずる恐れがある。
本発明は、差動入力音響増幅器の非反転入力端
に加わる電源リツプル信号と同相でほぼ同レベル
の信号を差動入力音響増幅器の反転入力端にも加
えることにより電源リツプルによる影響を大幅に
減少させることを目的とするものである。
に加わる電源リツプル信号と同相でほぼ同レベル
の信号を差動入力音響増幅器の反転入力端にも加
えることにより電源リツプルによる影響を大幅に
減少させることを目的とするものである。
上記目的を達成するために構成された電源リツ
プル除去回路の基本構成図を第２図を用いて説明
する。同図において、非反転入力端１と反転入力
端３と出力端４とを有する差動増幅器１４と抵抗
７，８のブリーダ回路と抵抗９とコンデンサー１
３と、負帰還回路を形成する抵抗１０，１１、コ
ンデンサ１２とは第１図と同様の構成をして電源
端子５と接地端子６との間に形成されている。コ
ンデンサー１２の一端は従来のように接地される
ことはなく同相増幅器１４′の出力端１５に接続
されている。同相増幅器１４′の非反転入力端は
コンデンサー１３の一端２に接続されている。尚
同図において同相増幅器１４′は交流利得Ａ。を
１倍に設定しその入力端２に生じるリツプル信号
に等しい信号を出力端１５に発生する。
プル除去回路の基本構成図を第２図を用いて説明
する。同図において、非反転入力端１と反転入力
端３と出力端４とを有する差動増幅器１４と抵抗
７，８のブリーダ回路と抵抗９とコンデンサー１
３と、負帰還回路を形成する抵抗１０，１１、コ
ンデンサ１２とは第１図と同様の構成をして電源
端子５と接地端子６との間に形成されている。コ
ンデンサー１２の一端は従来のように接地される
ことはなく同相増幅器１４′の出力端１５に接続
されている。同相増幅器１４′の非反転入力端は
コンデンサー１３の一端２に接続されている。尚
同図において同相増幅器１４′は交流利得Ａ。を
１倍に設定しその入力端２に生じるリツプル信号
に等しい信号を出力端１５に発生する。
差動増幅器１４の出力抵抗をＲD、同相増幅器
１４′の出力抵抗をR0、コンデンサー１２のイン
ピーダンスをZ12、抵抗１０，１１の抵抗値をそ
れぞれR10，R11と置くと、電源リツプル電圧
（Vripple）は、抵抗７，８のブリーダ回路で分割
され（Ｒ８Ｚ１３）／Ｒ７＋（Ｒ８Ｚ１３）・Vrip
pleとなり、かかるリツ プル信号が非反転入力１に加わりまた、反転入力
端３には、交流利得１倍の同相増幅器１４′を介
して、 Ｒ１１＋ＲＤ／Ｒ０＋Ｚ１２＋Ｒ１０＋Ｒ１１＋ＲＤ・
（Ｒ８Ｚ１３）／Ｒ７＋（Ｒ８Ｚ１３）・ Vrippleの信号が加わるため、実質的に差動入力
音響増幅器の入力換算リツプル信号は （Ｒ８Ｚ１３）／Ｒ７＋（Ｒ８Ｚ１３）・（１−Ｒ
１１＋ＲＤ／Ｒ０＋Ｚ２＋Ｒ１０＋Ｒ１１＋ＲＤ）・ Vrippleとなる。そのため （１−Ｒ１１＋ＲＤ／Ｒ０＋Ｚ１２＋Ｒ１０＋Ｒ１１＋
ＲＤ）倍に入力換算リ ツプル信号を減少させることができる。ここで、
R0、ＲD、の値はほぼゼロと見なせるため入力換
算リツプル信号はほぼ （１−Ｒ１１／Ｚ１２＋Ｒ１０＋Ｒ１１）倍と見なすこ
とができる。
１４′の出力抵抗をR0、コンデンサー１２のイン
ピーダンスをZ12、抵抗１０，１１の抵抗値をそ
れぞれR10，R11と置くと、電源リツプル電圧
（Vripple）は、抵抗７，８のブリーダ回路で分割
され（Ｒ８Ｚ１３）／Ｒ７＋（Ｒ８Ｚ１３）・Vrip
pleとなり、かかるリツ プル信号が非反転入力１に加わりまた、反転入力
端３には、交流利得１倍の同相増幅器１４′を介
して、 Ｒ１１＋ＲＤ／Ｒ０＋Ｚ１２＋Ｒ１０＋Ｒ１１＋ＲＤ・
（Ｒ８Ｚ１３）／Ｒ７＋（Ｒ８Ｚ１３）・ Vrippleの信号が加わるため、実質的に差動入力
音響増幅器の入力換算リツプル信号は （Ｒ８Ｚ１３）／Ｒ７＋（Ｒ８Ｚ１３）・（１−Ｒ
１１＋ＲＤ／Ｒ０＋Ｚ２＋Ｒ１０＋Ｒ１１＋ＲＤ）・ Vrippleとなる。そのため （１−Ｒ１１＋ＲＤ／Ｒ０＋Ｚ１２＋Ｒ１０＋Ｒ１１＋
ＲＤ）倍に入力換算リ ツプル信号を減少させることができる。ここで、
R0、ＲD、の値はほぼゼロと見なせるため入力換
算リツプル信号はほぼ （１−Ｒ１１／Ｚ１２＋Ｒ１０＋Ｒ１１）倍と見なすこ
とができる。
また、同相増幅器１４′の交流利得A0をA0＝
Ｚ１２＋Ｒ１０＋Ｒ１１／Ｒ１１倍に設定すると、入力
換算リツプ ル信号をさらに減少させることも可能である。
Ｚ１２＋Ｒ１０＋Ｒ１１／Ｒ１１倍に設定すると、入力
換算リツプ ル信号をさらに減少させることも可能である。
その上、電源リツプル防止コンデンサー１３
や、負帰還回路のコンデンサー１２は従来より小
さく自由に選択できる特徴がある。
や、負帰還回路のコンデンサー１２は従来より小
さく自由に選択できる特徴がある。
第３図は交流利得１倍の同相増幅器を用いた本
発明の具体的回路例である。同図で第２図と同一
部分は同一の参照数字が用いられている。抵抗
７，８のブリーダ回路から抵抗９を介して、入力
バイアス決定を行ない、コンデンサー１３にて電
源リツプルを除去し、入力に差動回路３７を用い
てその負荷抵抗１６より極性反転のドライブPNP
トランジスタ２５のベースとコレクタの間に接続
し、終段NPN複合トランジスタ２６，２７のベ
ースにドライブ・トランジスタ２５のコレクタを
接続し、ドライブトランジスタ２５、コレクタか
らダイオードチエーン３４，３５，３６を介し
て、終段PNP複合トランジスタ２８，２９のベー
スに接続されて、終段はNPNとPNPトランジス
タから成るシングルエンデツト・プツシユル回路
となつている。トランジスタ２４と抵抗１７は、
差動回路３７の定電流源で、定電圧源（抵抗１８
とダイオード３２，３３）より決定され、トラン
ジスタ３０と抵抗１９でアイドリング電流を決定
し、ダイオードチエーン３４，３５，３６はバイ
アス回路である。
発明の具体的回路例である。同図で第２図と同一
部分は同一の参照数字が用いられている。抵抗
７，８のブリーダ回路から抵抗９を介して、入力
バイアス決定を行ない、コンデンサー１３にて電
源リツプルを除去し、入力に差動回路３７を用い
てその負荷抵抗１６より極性反転のドライブPNP
トランジスタ２５のベースとコレクタの間に接続
し、終段NPN複合トランジスタ２６，２７のベ
ースにドライブ・トランジスタ２５のコレクタを
接続し、ドライブトランジスタ２５、コレクタか
らダイオードチエーン３４，３５，３６を介し
て、終段PNP複合トランジスタ２８，２９のベー
スに接続されて、終段はNPNとPNPトランジス
タから成るシングルエンデツト・プツシユル回路
となつている。トランジスタ２４と抵抗１７は、
差動回路３７の定電流源で、定電圧源（抵抗１８
とダイオード３２，３３）より決定され、トラン
ジスタ３０と抵抗１９でアイドリング電流を決定
し、ダイオードチエーン３４，３５，３６はバイ
アス回路である。
抵抗１０，１１とコンデンサ１２は負帰還回路
である。接続点２から差動回路３８の非反転入力
端に入り、負荷抵抗２１からトランジスタ３１に
入り負帰還回路のコデンサー１２に接続点１５に
て接続され、接続点１５より反転入力端に全帰還
を行い電圧利得１倍としている。抵抗２０は差動
回路３８の定電流源である。
である。接続点２から差動回路３８の非反転入力
端に入り、負荷抵抗２１からトランジスタ３１に
入り負帰還回路のコデンサー１２に接続点１５に
て接続され、接続点１５より反転入力端に全帰還
を行い電圧利得１倍としている。抵抗２０は差動
回路３８の定電流源である。
上記の実施例のほか種々の変形が可能であり、
例えば同相増幅器１４′は差動形式に限らず、要
するに電圧利得が“１”で入―出力関係が同相の
ものであればよい。
例えば同相増幅器１４′は差動形式に限らず、要
するに電圧利得が“１”で入―出力関係が同相の
ものであればよい。
第１図は従来の差動入力音響増幅器の基本構成
図である。第２図は本発明に係る差動入力音響増
幅器の一実施例の基本構成図である。第３図は本
発明を用いた一実施例の具体的回路例である。 １……非反転入力端、２……入力バイアス端、
３……反転入力端、４……出力端、５……電源端
子、６……共通端子、７，８，９，１０，１１，
１６，１７，１８，１９，２０，２１，２２，２
３……抵抗、１２，１３，３９……コンデンサ
ー、１４′……同相増幅器、１５……出力端、２
４，２５，２６，２７，２８，２９，３０，３１
……トランジスター、３２，３３，３４，３５，
３６……ダイオード、３７，３８……差動回路。
図である。第２図は本発明に係る差動入力音響増
幅器の一実施例の基本構成図である。第３図は本
発明を用いた一実施例の具体的回路例である。 １……非反転入力端、２……入力バイアス端、
３……反転入力端、４……出力端、５……電源端
子、６……共通端子、７，８，９，１０，１１，
１６，１７，１８，１９，２０，２１，２２，２
３……抵抗、１２，１３，３９……コンデンサ
ー、１４′……同相増幅器、１５……出力端、２
４，２５，２６，２７，２８，２９，３０，３１
……トランジスター、３２，３３，３４，３５，
３６……ダイオード、３７，３８……差動回路。
Claims (1)
- １ 信号入力端子、帰還端子および出力端子を有
する音響増幅器と、電源間に接続され前記音響増
幅器の前記信号入力端子へのバイアス電圧を発生
するバイアス回路であつて直列結合された第１お
よび第２の抵抗を有するバイアス回路と、前記音
響増幅器の前記出力端子および前記帰還端子間に
設けられ帰還用コンデンサを有する帰還回路とを
備える音響増幅回路において、前記第１および第
２の抵抗の直列結合点に入力端が接続された同相
増幅器をさらに備え、この同相増幅器の出力端と
前記音響増幅器の前記帰還端子との間に前記帰還
用コンデンサが設けられていることを特徴とする
音響増幅回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12662177A JPS5459861A (en) | 1977-10-20 | 1977-10-20 | Acoustic amplifier ciruit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12662177A JPS5459861A (en) | 1977-10-20 | 1977-10-20 | Acoustic amplifier ciruit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5459861A JPS5459861A (en) | 1979-05-14 |
| JPS6233766B2 true JPS6233766B2 (ja) | 1987-07-22 |
Family
ID=14939720
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12662177A Granted JPS5459861A (en) | 1977-10-20 | 1977-10-20 | Acoustic amplifier ciruit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5459861A (ja) |
-
1977
- 1977-10-20 JP JP12662177A patent/JPS5459861A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5459861A (en) | 1979-05-14 |
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