JPS6237844B2 - - Google Patents
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- Publication number
- JPS6237844B2 JPS6237844B2 JP56080877A JP8087781A JPS6237844B2 JP S6237844 B2 JPS6237844 B2 JP S6237844B2 JP 56080877 A JP56080877 A JP 56080877A JP 8087781 A JP8087781 A JP 8087781A JP S6237844 B2 JPS6237844 B2 JP S6237844B2
- Authority
- JP
- Japan
- Prior art keywords
- amplifier
- input
- fet
- terminal
- output
- Prior art date
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- Expired
Links
- 239000003990 capacitor Substances 0.000 claims description 4
- 230000003321 amplification Effects 0.000 description 9
- 238000003199 nucleic acid amplification method Methods 0.000 description 9
- 238000010586 diagram Methods 0.000 description 2
- 238000000034 method Methods 0.000 description 1
Landscapes
- Amplifiers (AREA)
Description
【発明の詳細な説明】
本発明はオシロスコープ等に使用される直流増
幅器の改良に関するものである。
幅器の改良に関するものである。
第１図は従来例を示す直流増幅器で、オシロス
コープの垂直軸増幅器に要求される高入力インピ
ーダンス、低ドリフト、広帯域の特性を実現する
ために、特性のそろつたTWIN FET２を広帯域
直流増幅回路３の入力バツフアに使用した例であ
る。この回路のTWINFET２は低ドリフト、かつ
広帯域（高Gmと等価である）を要求されるので
価格的に非常に高価である。第２図は第１図の欠
点を解消するため考案された回路で、高周波信号
増幅と直流から低周波信号増幅とをそれぞれ別々
の増幅器で行い加算するものである。入力端子１
からの一方の信号はコンデンサ５により直流分が
阻止され、交流分がFET６により増幅され、広
帯域差動増幅器７を経て出力端子４に出力され
る。また入力端子１からの他方の信号はFET入
力差動増幅器８で増幅された後、FET６の出力
信号と加算増幅されて出力端子４に出力される。
なお広帯域差動増幅器７の出力から抵抗９，１
１，１２及び可変抵抗１０で構成する回路により
帰還をかけて所定の増幅度を得ている。ここで入
力端子１から出力端子４までの増幅度について
は、FET６を経由する信号の増幅度と、FET入
力差動増幅器８を経由する信号の増幅度を等しく
することが要求される。しかしながら帰還抵抗等
の偏差があるため、可変抵抗１０を調節して両者
の増幅度を等しくしている。この回路ではFET
は安価になるが調整箇所を生ずる欠点がある。
コープの垂直軸増幅器に要求される高入力インピ
ーダンス、低ドリフト、広帯域の特性を実現する
ために、特性のそろつたTWIN FET２を広帯域
直流増幅回路３の入力バツフアに使用した例であ
る。この回路のTWINFET２は低ドリフト、かつ
広帯域（高Gmと等価である）を要求されるので
価格的に非常に高価である。第２図は第１図の欠
点を解消するため考案された回路で、高周波信号
増幅と直流から低周波信号増幅とをそれぞれ別々
の増幅器で行い加算するものである。入力端子１
からの一方の信号はコンデンサ５により直流分が
阻止され、交流分がFET６により増幅され、広
帯域差動増幅器７を経て出力端子４に出力され
る。また入力端子１からの他方の信号はFET入
力差動増幅器８で増幅された後、FET６の出力
信号と加算増幅されて出力端子４に出力される。
なお広帯域差動増幅器７の出力から抵抗９，１
１，１２及び可変抵抗１０で構成する回路により
帰還をかけて所定の増幅度を得ている。ここで入
力端子１から出力端子４までの増幅度について
は、FET６を経由する信号の増幅度と、FET入
力差動増幅器８を経由する信号の増幅度を等しく
することが要求される。しかしながら帰還抵抗等
の偏差があるため、可変抵抗１０を調節して両者
の増幅度を等しくしている。この回路ではFET
は安価になるが調整箇所を生ずる欠点がある。
本発明の目的は上記欠点を除去し、安価で無調
整な直流増幅器を提供することにある。
整な直流増幅器を提供することにある。
第３図は本発明の実施例を示す直流増幅器であ
る。入力端子１からの入力信号の一方はFET入
力差動増幅器８で増幅された後差動形広帯域増幅
器７に印加される。また入力信号の他方はコンデ
ンサ５で直流分を除いた交流成分がFET１３，
１４で構成する差動増幅器で増幅された後、差動
形広帯域増幅器７に印加されFET入力差動増幅
器８の出力と加算増幅される。また差動形広帯域
増幅器７の出力から抵抗１１，１２によりFET
入力差動増幅器８の負極性入力端子とFET１４
のゲート端子に帰還をかけ、入力端子１と出力端
子４の間に所定の増幅度を持たせている。以上の
回路接続により直流域の特性はFET入力差動増
幅器８の特性で、交流域はFET１３，１４の増
幅特性と差動形広帯域増幅器７の特性により直流
増幅器を実現できる。FET入力差動増幅器８と
して直流特性の優れたものを安価に入手すること
は容易であり、FET差動増幅器及び差動形広帯
域増幅器７は直流特性を何ら要求されず、従つて
広帯域特性を容易に実現することは周知の技術で
よく、また帰還回路は固定抵抗１１，１２の１ル
ープのみであるため調整を必要としない。
る。入力端子１からの入力信号の一方はFET入
力差動増幅器８で増幅された後差動形広帯域増幅
器７に印加される。また入力信号の他方はコンデ
ンサ５で直流分を除いた交流成分がFET１３，
１４で構成する差動増幅器で増幅された後、差動
形広帯域増幅器７に印加されFET入力差動増幅
器８の出力と加算増幅される。また差動形広帯域
増幅器７の出力から抵抗１１，１２によりFET
入力差動増幅器８の負極性入力端子とFET１４
のゲート端子に帰還をかけ、入力端子１と出力端
子４の間に所定の増幅度を持たせている。以上の
回路接続により直流域の特性はFET入力差動増
幅器８の特性で、交流域はFET１３，１４の増
幅特性と差動形広帯域増幅器７の特性により直流
増幅器を実現できる。FET入力差動増幅器８と
して直流特性の優れたものを安価に入手すること
は容易であり、FET差動増幅器及び差動形広帯
域増幅器７は直流特性を何ら要求されず、従つて
広帯域特性を容易に実現することは周知の技術で
よく、また帰還回路は固定抵抗１１，１２の１ル
ープのみであるため調整を必要としない。
以上説明したごとく、本発明によれば、安価な
部品を組合せるのみで、また何らの調整を要せず
にドリフトが小さく、かつ利得が直流から高周波
まで一定の直流増幅器を容易に実現しうる。
部品を組合せるのみで、また何らの調整を要せず
にドリフトが小さく、かつ利得が直流から高周波
まで一定の直流増幅器を容易に実現しうる。
第１図と第２図は、従来例を示す直流増幅器の
回路図、第３図は本発明の一実施例を示す直流増
幅器の回路図である。 １：入力端子、２：TWIN FET、３：広帯域
直流増幅回路、４：出力端子、５：コンデンサ、
６，１３，１４：FET、７：差動形広帯域増幅
器、８：FET入力差動増幅器、９，１１，１
２：抵抗、１０：可変抵抗。
回路図、第３図は本発明の一実施例を示す直流増
幅器の回路図である。 １：入力端子、２：TWIN FET、３：広帯域
直流増幅回路、４：出力端子、５：コンデンサ、
６，１３，１４：FET、７：差動形広帯域増幅
器、８：FET入力差動増幅器、９，１１，１
２：抵抗、１０：可変抵抗。
Claims (1)
- １ 直流から高周波までの成分を含む入力信号を
増幅する直流増幅器において、前記入力信号を２
分して一方をコンデンサに通して交流成分とし、
この交流成分を第１、第２のFETで構成する差
動増幅器の前記第１のFETのゲート端子に印加
し、前記差動増幅器の二つの出力の何れか又は双
方を差動形広帯域増幅器の入力端子に接続し、か
つ前記直流増幅器の入出力が同極性になるように
形成し、前記入力信号を２分した他方をFET入
力差動増幅器の正極性入力端子に印加し、この
FET入力差動増幅器の負極性入力端子を前記第
２のFETのゲート端子に接続し、前記FET入力
差動増幅器の出力端子を前記差動形広帯域増幅器
の入力端子に、前記直流増幅器の入出力が同極性
になるように接続し、前記差動増幅器の出力と前
記FET入力差動増幅器の出力とを加算して前記
直流増幅器の出力信号とすると共に、この出力信
号端子と前記第２のFETのゲート端子との間に
帰還回路を接続したことを特徴とする直流増幅回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56080877A JPS57206106A (en) | 1981-05-29 | 1981-05-29 | Dc amplifier |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56080877A JPS57206106A (en) | 1981-05-29 | 1981-05-29 | Dc amplifier |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57206106A JPS57206106A (en) | 1982-12-17 |
| JPS6237844B2 true JPS6237844B2 (ja) | 1987-08-14 |
Family
ID=13730571
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56080877A Granted JPS57206106A (en) | 1981-05-29 | 1981-05-29 | Dc amplifier |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57206106A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2771314B2 (ja) * | 1990-07-11 | 1998-07-02 | 株式会社日立製作所 | 広帯域増幅器 |
-
1981
- 1981-05-29 JP JP56080877A patent/JPS57206106A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57206106A (en) | 1982-12-17 |
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