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JPS6341005B2 - - Google Patents
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JPS6341005B2 - - Google Patents

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Publication number
JPS6341005B2
JPS6341005B2 JP17623081A JP17623081A JPS6341005B2 JP S6341005 B2 JPS6341005 B2 JP S6341005B2 JP 17623081 A JP17623081 A JP 17623081A JP 17623081 A JP17623081 A JP 17623081A JP S6341005 B2 JPS6341005 B2 JP S6341005B2
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JP
Japan
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output
load cell
load
adder
capacitor
Prior art date
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Expired
Application number
JP17623081A
Other languages
Japanese (ja)
Other versions
JPS5877625A (en
Inventor
Akira Nishikawa
Yoshihisa Nishama
Koichiro Sakamoto
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Tec Corp
Original Assignee
Tokyo Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Tokyo Electric Co Ltd filed Critical Tokyo Electric Co Ltd
Priority to JP17623081A priority Critical patent/JPS5877625A/en
Publication of JPS5877625A publication Critical patent/JPS5877625A/en
Publication of JPS6341005B2 publication Critical patent/JPS6341005B2/ja
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    • G01MEASURING; TESTING
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    • G01G23/18Indicating devices, e.g. for remote indication; Recording devices; Scales, e.g. graduated
    • G01G23/36Indicating the weight by electrical means, e.g. using photoelectric cells
    • G01G23/37Indicating the weight by electrical means, e.g. using photoelectric cells involving digital counting
    • G01G23/3707Indicating the weight by electrical means, e.g. using photoelectric cells involving digital counting using a microprocessor

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Description

【発明の詳細な説明】 (1) 発明の技術分野 この発明は複数個のロードセルを使用したロー
ドセル式秤に関する。
Detailed Description of the Invention (1) Technical Field of the Invention The present invention relates to a load cell scale using a plurality of load cells.

(2) 従来技術及びその問題点 従来、この種のロードセル式秤は、複数のロー
ドセルの出力端子を並列に接続してロードセル出
力を取り出すものであつたが、このものでは各ロ
ードセル出力が設けたロードセルの個数分の1に
略抑えられてしまうため各ロードセルを効率よく
利用できない問題があつた。
(2) Conventional technology and its problems Conventionally, this type of load cell type scales connected the output terminals of multiple load cells in parallel to take out the load cell output. There was a problem that each load cell could not be used efficiently because the number of load cells was reduced to approximately one-fold of the number of load cells.

このため各ロードセル出力をそれぞれ緩衝増幅
器を介して取り出し、それをさらに加算器で加算
することによつて各ロードセル出力を減少させる
ことなく取り出し、各ロードセルを効率よく利用
できることが本発明者等によつて解明された。
Therefore, the inventors have found that by taking out each load cell output through a buffer amplifier and then adding them together in an adder, it is possible to take out each load cell output without decreasing it and to utilize each load cell efficiently. It was clarified.

しかしこのようにした場合緩衝増幅器及び加算
器のオフセツト電圧の計量値に与える影響を無視
できなくなる問題がある。
However, in this case, there is a problem that the influence of the offset voltage of the buffer amplifier and the adder on the measured value cannot be ignored.

(3) 発明の目的 この発明は複数のロードセル出力を減少させる
ことなく取り出すことができて各ロードセルを効
率よく利用でき、しかも増幅器及び加算器のオフ
セツト電圧による影響を防止できて正確な計量が
できるロードセル式秤を提供することを目的とす
る。
(3) Purpose of the Invention This invention enables the output of multiple load cells to be taken out without reduction, allowing each load cell to be used efficiently, and moreover, preventing the effects of offset voltages of amplifiers and adders, thereby enabling accurate measurement. The purpose is to provide a load cell type scale.

(4) 発明の構成 この発明は複数のロードセルをスイツチ素子を
介して直流電源に接続し、その各ロードセル出力
を複数の緩衝増幅器のそれぞれで増幅して加算器
で加算するようにし、その加算器の出力端子間に
コンデンサを介してアナログスイツチを接続し、
上記スイツチ素子及びアナログスイツチをスイツ
チ制御回路で一定時間ずつ交互にON・OFF制御
し、アナログスイツチのOFF時に加算器出力を
コンデンサを介してA/Dコンバータに入力して
そのA/Dコンバータでカウントデータに変換
し、それを演算回路で重量単位にデータに換算す
るようにしたものである。
(4) Structure of the Invention The present invention connects a plurality of load cells to a DC power supply via a switch element, and amplifies the output of each load cell with a plurality of buffer amplifiers and adds them together with an adder. Connect an analog switch via a capacitor between the output terminals of
The above switch element and analog switch are controlled ON and OFF alternately for a certain period of time by the switch control circuit, and when the analog switch is OFF, the adder output is input to the A/D converter via the capacitor and counted by the A/D converter. This is converted into data, and then converted into data in weight units using an arithmetic circuit.

(5) 発明の実施例 第1図において1,2,3,4はそれぞれロバ
ーバル機構からなるロードセルで、この各ロード
セル1,2,3,4は4ケ所に装着されたストレ
ンゲージを各辺とする四辺抵抗ブリツジを構成し
ている。前記各ロードセル1,2,3,4は例え
ば装置本体ベースの四隅に取り付けられ、その上
に載せ皿が載置されている。前記各ロードセル
1,2,3,4はブリツジにおける一方の対向接
点の一方を直流電源としてのバツテリー5の正極
端子に接続するとともに他方をスイツチ素子とし
てのホトカプラ6のホトトランジスタ6Trを介
して上記バツテリー5の負極端子に接続してい
る。また前記ロードセル1,2,3,4はブリツ
ジにおける他方の対向接点の一方をそれぞれ緩衝
増幅器7,8,9,10の入力端子に接続すると
ともに他方を接地している。前記各緩増幅器7,
8,9,10はその出力端子を加算器11の各入
力端子にそれぞれ接続している。前記加算器11
は4個の可変抵抗器12,13,14,15と1
個の演算増幅器16を設け、上記各可変抵抗器1
2,13,14,15の一端を入力端子として前
記各緩衝増幅器7,8,9,10の出力端子にそ
れぞれ接続し、他端を上記演算増幅器16の反転
入力端子に接続している。前記演算増幅器16は
その非反転入力端子(+)を接地するとともにそ
の出力端子を抵抗17を介して自己の反転入力端
子(−)に接続している。前記加算器11は演算
増幅器16の出力端子を出力端子とし、その出力
端子と接地との間に抵抗18及びコンデンサ19
を直列に介してアナログスイツチ20を接続して
いる。前記コンデンサ19とアナログスイツチ2
0との接続点を演算増幅器21の非反転入力端子
(+)に接続している。
(5) Embodiments of the invention In Fig. 1, 1, 2, 3, and 4 are load cells each having a Roberval mechanism, and each load cell 1, 2, 3, and 4 has a strain gauge attached to each side at four locations. It constitutes a four-sided resistance bridge. Each of the load cells 1, 2, 3, and 4 is attached to, for example, the four corners of the base of the device body, and a tray is placed on top of the load cells. Each of the load cells 1, 2, 3, and 4 has one opposing contact in the bridge connected to the positive terminal of a battery 5 as a DC power source, and the other connected to the battery via a phototransistor 6Tr of a photocoupler 6 as a switch element. It is connected to the negative terminal of No.5. The load cells 1, 2, 3, and 4 have one of the other opposing contacts in the bridge connected to the input terminals of the buffer amplifiers 7, 8, 9, and 10, respectively, and the other is grounded. each of the slow amplifiers 7;
8, 9, and 10 have their output terminals connected to each input terminal of the adder 11, respectively. The adder 11
is four variable resistors 12, 13, 14, 15 and 1
operational amplifiers 16 are provided, and each of the variable resistors 1
One ends of the buffer amplifiers 2, 13, 14, and 15 are connected as input terminals to the output terminals of the buffer amplifiers 7, 8, 9, and 10, respectively, and the other ends are connected to the inverting input terminal of the operational amplifier 16. The operational amplifier 16 has its non-inverting input terminal (+) grounded and its output terminal connected via a resistor 17 to its own inverting input terminal (-). The adder 11 uses the output terminal of the operational amplifier 16 as an output terminal, and a resistor 18 and a capacitor 19 are connected between the output terminal and the ground.
The analog switch 20 is connected in series with the analog switch 20. The capacitor 19 and analog switch 2
0 is connected to the non-inverting input terminal (+) of the operational amplifier 21.

また前記バツテリー5に基準電圧発生器22を
接続している。前記基準電圧発生器22は2個の
緩衝増幅器23,24と1個の差動増幅器25と
抵抗26、ポテンシオメータ27及び抵抗28の
直列回路とからなり、上記緩衝増幅器23の非反
転入力端子(+)を前記バツテリー5の正極端子
に接続するとともに上記緩衝増幅器24の非反転
入力端子(+)を上記バツテリー5の負極端子に
接続している。前記緩衝増幅器23の出力端子を
抵抗29を介して前記差動増幅器25の非反転入
力端子(+)に接続するとともにさらに抵抗30
を介して接地している。前記緩衝増幅器24の出
力端子を抵抗31を介して前記差動増幅器25の
反転入力端子(−)に接続している。前記差動増
幅器25の出力端子を抵抗32を介して自己の反
転入力端子(−)に接続するとともに前記抵抗2
6、ポテンシオメータ27及び抵抗28の直列回
路を介して接地している。前記基準電圧発生器2
2は、ポテンシオメータ27の可動端子を出力端
子とし、その出力端子から発生する基準電圧を
A/Dコンバータ33に印加するとともにゼロ点
設定回路34に印加している。前記ゼロ点設定回
路34は2個の緩衝増幅器35,36と抵抗3
7、ポテンシオメータ38、抵抗39の直列回路
とからなり、基準電圧を緩衝増幅器35の入力端
子に入力している。前記緩衝増幅器35はその出
力端子を抵抗37、ポテンシオメータ38及び抵
抗39の直列回路を介して接地している。前記緩
衝増幅器36はその非反転入力端子(+)を前記
ポテンシオメータ38の可動端子に接続するとと
もにその出力端子を抵抗40を介して前記演算増
幅器21の反転入力端子(−)に接続している。
前記演算増幅器21はその出力端子と反転入力端
子(−)との間に抵抗41を接続している。
Further, a reference voltage generator 22 is connected to the battery 5. The reference voltage generator 22 consists of two buffer amplifiers 23 and 24, one differential amplifier 25, and a series circuit of a resistor 26, a potentiometer 27, and a resistor 28, and the non-inverting input terminal ( +) is connected to the positive terminal of the battery 5, and the non-inverting input terminal (+) of the buffer amplifier 24 is connected to the negative terminal of the battery 5. The output terminal of the buffer amplifier 23 is connected to the non-inverting input terminal (+) of the differential amplifier 25 via a resistor 29, and further connected to a resistor 30.
It is grounded through. The output terminal of the buffer amplifier 24 is connected to the inverting input terminal (-) of the differential amplifier 25 via a resistor 31. The output terminal of the differential amplifier 25 is connected to its own inverting input terminal (-) via a resistor 32, and the resistor 2
6. Grounded via a series circuit of a potentiometer 27 and a resistor 28. The reference voltage generator 2
2 uses the movable terminal of the potentiometer 27 as an output terminal, and applies a reference voltage generated from the output terminal to the A/D converter 33 and to the zero point setting circuit 34. The zero point setting circuit 34 includes two buffer amplifiers 35 and 36 and a resistor 3.
7, a potentiometer 38, and a resistor 39 in series, and inputs a reference voltage to the input terminal of a buffer amplifier 35. The buffer amplifier 35 has its output terminal grounded through a series circuit of a resistor 37, a potentiometer 38, and a resistor 39. The buffer amplifier 36 has its non-inverting input terminal (+) connected to the movable terminal of the potentiometer 38, and its output terminal connected to the inverting input terminal (-) of the operational amplifier 21 via a resistor 40. .
The operational amplifier 21 has a resistor 41 connected between its output terminal and its inverting input terminal (-).

前記演算増幅器21はその出力をローパスフイ
ルタ42を介して前記A/Dコンバータ33の入
力端子に入力している。前記A/Dコンバータ3
3は例えば2重積分形のもので前記基準電圧発生
器22からの基準電圧を利用することにより前記
演算増幅器21からローパスフイルタ42を介し
て入力され電圧信号をそのレベルに応じてカウン
トデータに変換するようにしている。前記A/D
コンバータ33から出力されるカウントデータを
演算回路43を内蔵した制御装置44に取り込む
ようにしている。前記制御装置44はA/Dコン
バータ33からカウントデータを取り込んで演算
回路43を動作し、予め決められた最小目盛値
Xg=Yカウントの関係からカウントデータZを
Z/Y・Xの演算を行つてグラム単位の重量デー
タに変換し、その重量データを表示器45に表示
させるようにしている。前記ホトカプラ6の発光
ダイオード6D及びアナログスイツチ20をスイ
ツチ制御回路46で所定のタイミングで動作させ
るようにしている。すなわち前記スイツチ制御回
路46は発光ダイオード6Dを第2図のイに示す
タイミングで一定時間ON動作し、アナログスイ
ツチ20を第2図のロに示すタイミングで一定時
間ON動作するようにしている。なお47はキー
ボードで、このキーボード47にはゼロ点を決め
るキーや風袋引きを行うキー等が設けられてい
る。
The operational amplifier 21 inputs its output to the input terminal of the A/D converter 33 via a low-pass filter 42. The A/D converter 3
3 is of a double integral type, for example, and by using the reference voltage from the reference voltage generator 22, the voltage signal inputted from the operational amplifier 21 via the low-pass filter 42 is converted into count data according to its level. I try to do that. Said A/D
The count data output from the converter 33 is taken into a control device 44 incorporating an arithmetic circuit 43. The control device 44 receives count data from the A/D converter 33, operates the arithmetic circuit 43, and calculates a predetermined minimum scale value.
Based on the relationship of Xg=Y count, the count data Z is converted to weight data in grams by calculating Z/Y.X, and the weight data is displayed on the display 45. The light emitting diode 6D of the photocoupler 6 and the analog switch 20 are operated at predetermined timing by a switch control circuit 46. That is, the switch control circuit 46 turns on the light emitting diode 6D for a certain period of time at the timing shown in FIG. 2A, and turns on the analog switch 20 for a certain period of time at the timing shown in FIG. 2B. Note that 47 is a keyboard, and this keyboard 47 is provided with keys for determining the zero point, keys for taring, and the like.

このように構成された本発明実施例においては
各ロードセル1,2,3,4は載せ皿上の荷重を
それぞれ分割して検出するようになる。そしてス
イツチ制御回路46はホトカプラ6の発光ダイオ
ード6Dを第2図のイに示すタイミングT2,T4
……で一定時間ON動作し、かつアナログスイツ
チ20を第2図のロに示すタイミングT1,T3
T5,……で一定時間ON動作する。しかしてタイ
ミングT1,T3,T5,……においては各ロードセ
ル1,2,3,4がバツテリー5に接続されない
ので、各ロードセル1,2,3,4から出力が発
生することはない。一方、このタイミングにおい
てはアナログスイツチ20がON動作されるの
で、コンデンサ19の一端が接地される。しかし
て各緩衝増幅器7,8,9,10の出力端子にオ
フセツト電圧が発生するとそのオフセツト電圧が
加算器11で加算されるとともに加算器11の演
算増幅器21のオフセツト電圧も加わつて加算器
11出力となりコンデンサ19に蓄わえられる。
またタイミングT2,T4,……においてはホトカ
プラ6がON動作して各ロードセル1,2,3,
4がバツテリー5に接続される。一方アナログス
イツチ20がOFF動作してコンデンサ19の一
端が接地から開放される。この状態では各ロード
セル1,2,3,4からそれぞれの荷重に対応し
た電圧が出力され、それぞれ緩衝増幅器7,8,
9,10で増幅されて加算器11で加算されコン
デンサ19を介して演算増幅器21に入力され
る。このときコンデンサ19に蓄わえられたオフ
セツト電圧によつて加算器11出力に加わつてい
るオフセツト電圧がキヤンセルされ演算増幅器2
1には正しく各ロードセル1,2,3,4の出力
電圧に対応した電圧信号のみが入力されることに
なる。そして演算増幅器21において加算器11
からの入力電圧からゼロ点設定回路34からの入
力電圧が減算され荷重出力電圧としてローパスフ
イルター42を介してA/Dコンバータ33に入
力されA/Dコンバータ33が第2図のハで示す
タイミングで動作し入力電圧をカウントデータに
変換される。そしてこのカウントデータが制御装
置44に取込まれ演算回路43でグラム単位の重
量データに変換されて評示器45に表示される。
こうして荷重に対応したグラム単位の重量表示が
行われることになる。
In the embodiment of the present invention configured in this way, each load cell 1, 2, 3, 4 detects the load on the tray by dividing the load. The switch control circuit 46 controls the light emitting diode 6D of the photocoupler 6 at timings T 2 , T 4 ,
. . . is turned on for a certain period of time, and the analog switch 20 is turned on at timings T 1 , T 3 , and T 3 shown in FIG.
T 5 , ... turns on for a certain period of time. However, at timings T 1 , T 3 , T 5 , ..., each load cell 1, 2, 3, 4 is not connected to the battery 5, so no output is generated from each load cell 1, 2, 3, 4. . On the other hand, since the analog switch 20 is turned on at this timing, one end of the capacitor 19 is grounded. Therefore, when an offset voltage is generated at the output terminal of each of the buffer amplifiers 7, 8, 9, and 10, the offset voltage is added in the adder 11, and the offset voltage of the operational amplifier 21 of the adder 11 is also added to the output terminal of the adder 11. and is stored in the capacitor 19.
Also, at timings T 2 , T 4 , ..., the photocoupler 6 is turned on and each load cell 1, 2, 3,
4 is connected to battery 5. On the other hand, the analog switch 20 is turned OFF, and one end of the capacitor 19 is disconnected from the ground. In this state, each load cell 1, 2, 3, 4 outputs a voltage corresponding to the respective load, and the buffer amplifier 7, 8,
The signals are amplified by 9 and 10, added by an adder 11, and input to an operational amplifier 21 via a capacitor 19. At this time, the offset voltage applied to the output of the adder 11 is canceled by the offset voltage stored in the capacitor 19, and the offset voltage is applied to the output of the operational amplifier 2.
Only voltage signals corresponding to the output voltages of the load cells 1, 2, 3, and 4 are inputted to the load cells 1. Then, in the operational amplifier 21, the adder 11
The input voltage from the zero point setting circuit 34 is subtracted from the input voltage from the zero point setting circuit 34, and is input as a load output voltage to the A/D converter 33 via the low-pass filter 42. It operates and converts the input voltage into count data. This count data is then taken into the control device 44, converted into weight data in grams by the arithmetic circuit 43, and displayed on the evaluator 45.
In this way, the weight in grams corresponding to the load is displayed.

この動作における各緩衝増幅器7,8,9,1
0及び加算器11におけるオフセツト電圧のキヤ
ンセルについて詳述する。各緩衝増幅器7,8,
9,10のオフセツト電圧をそれぞれνps1,νps2
νps3,νps4とし、加算器11の演算増幅器16の
オフセツト電圧をνps5とし、各可変抵抗器12,
13,14,15の抵抗値をR12,R13,R14
R15とし、かつ抵抗17の抵抗値をR17とすると
タイミングT1,T3,T5,……における加算器1
1の出力E5(1)は E5(1)=R17/R12・νps1+R17/R13・ vps2+R17/R14・νps3+R17/R15・νps4+νps
… となる。ここでνps5は νps5=R17/R12・ν′ps5+R17/R13・ ν′ps5+R17/R14・νps5+R17/R15・ν′ps5
… として表わされるから上記式は結局 E5(1)=R17/R12(νps1+ν′ps5) +R17/R13(νps2+ν′ps5)+R17/R14(νps3
+ν′ps5)+ R17/R15(νps4+ν′ps5) …… となる。そしてこのE5(1)がコンデンサ19に蓄わ
えられる。
Each buffer amplifier 7, 8, 9, 1 in this operation
The canceling of the offset voltage in the adder 11 and the offset voltage in the adder 11 will be explained in detail. Each buffer amplifier 7, 8,
The offset voltages of 9 and 10 are respectively ν ps1 , ν ps2 ,
ν ps3 and ν ps4 , the offset voltage of the operational amplifier 16 of the adder 11 is ν ps5 , and each variable resistor 12,
The resistance values of 13, 14, and 15 are R 12 , R 13 , R 14 ,
If R 15 and the resistance value of the resistor 17 are R 17 , the adder 1 at timings T 1 , T 3 , T 5 , ...
The output E 5(1) of 1 is E 5(1) = R 17 /R 12・ν ps1 +R 17 /R 13・v ps2 +R 17 /R 14・ν ps3 +R 17 /R 15・ν ps4ps ...
... becomes. Here, ν ps5 is ν ps5 = R 17 /R 12・ν′ ps5 +R 17 /R 13・ν′ ps5 +R 17 /R 14・ν ps5 +R 17 /R 15・ν′ ps5
..., so the above equation ends up being E 5(1) = R 17 /R 12ps1 + ν′ ps5 ) +R 17 /R 13ps2 +ν′ ps5 ) + R 17 /R 14ps3
+ν′ ps5 )+ R 17 /R 15ps4 +ν′ ps5 )... This E 5(1) is then stored in the capacitor 19.

また、各ロードセル1,2,3,4の出力を
E1,E2,E3,E4とするとタイミングT2,T4,…
…における加算器11の出力E5(2)は E5(2)=R17/R12(νps1+ν′ps5+E1) +R17/R13(νps2+ν′ps5+E2) +R17/R14(νps3+ν′ps5+E3) +R17/R15(νps4+ν′ps5+E4) …… となる。しかして演算増幅器21に入力される電
圧Vioは Vio=E5(2)−E5(1)=R17/R12・E1+R17/R13・E2 +R17/R14・E3+R17/R15・E4 …… となり、オフセツト電圧がキヤンセルされること
になる。
Also, the output of each load cell 1, 2, 3, 4
Assuming E 1 , E 2 , E 3 , E 4 , timing T 2 , T 4 ,...
The output E 5(2) of the adder 11 at ... is E 5(2) = R 17 /R 12ps1 + ν′ ps5 +E 1 ) +R 17 /R 13ps2 +ν′ ps5 +E 2 ) +R 17 / R 14ps3 + ν′ ps5 + E 3 ) + R 17 /R 15ps4 + ν′ ps5 + E 4 )... Therefore, the voltage V io input to the operational amplifier 21 is V io =E 5(2) −E 5(1) =R 17 /R 12・E 1 +R 17 /R 13・E 2 +R 17 /R 14・E 3 +R 17 /R 15・E 4 ..., and the offset voltage is canceled.

しかして、抵抗40,41の抵抗値をR40
R41とし、ゼロ点設定回路34の出力をE6とする
と演算増幅器21の出力Vputは Vput=(1+R41/R40)(R17/R12・E1+R17/R13
E2 +R17/R14・E3+R17/R15・E4)−R41/R40・E6
… となる。そしてこのVputがA/Dコンバータ33
によつてカウントデータに変換されることにな
る。
Therefore, the resistance values of resistors 40 and 41 are R 40 ,
When R 41 and the output of the zero point setting circuit 34 are E 6 , the output V put of the operational amplifier 21 is V put = (1 + R 41 /R 40 ) (R 17 /R 12・E 1 +R 17 /R 13
E 2 +R 17 /R 14・E 3 +R 17 /R 15・E 4 )−R 41 /R 40・E 6
... becomes. And this V put is A/D converter 33
It will be converted into count data by .

このように各ロードセル1,2,3,4の出力
E1,E2,E3,E4が減少されずに生かされ、各ロ
ードセルを効率よく利用できる。また各緩衝増幅
器7,8,9,10のオフセツト電圧及び加算器
11のオフセツト電圧をキヤンセルでき荷重に対
応した正確な計量ができる。
In this way, the output of each load cell 1, 2, 3, 4
E 1 , E 2 , E 3 , and E 4 are utilized without being reduced, and each load cell can be used efficiently. Further, the offset voltages of each buffer amplifier 7, 8, 9, 10 and the offset voltage of adder 11 can be canceled, allowing accurate measurement corresponding to the load.

なお、前記実施例ではロードセルを4個使用し
たものについて述べたがかならずしもこれに限定
されるものではなく、要は複数個使用したもので
あればよい。
In the above embodiment, four load cells were used, but the present invention is not limited to this, and it is sufficient to use a plurality of load cells.

また前記実施例ではスイツチ素子としてホトカ
プラを使用したものについて述べたがかならずし
もこれに限定されるものではないのは勿論であ
る。
Further, in the above embodiment, a photocoupler was used as the switch element, but it is needless to say that the present invention is not limited to this.

(6) 発明の効果 この発明によれば複数のロードセルを使用した
ものにおいて各ロードセル出力を減少させること
なく取り出すことができるので各ロードセルを効
率よく利用でき、またコンデンサを使用して緩衝
増幅器及び加算器のオフセツト電圧をキヤンセル
できるので正確な計量ができるロードセル式秤を
提供できるものである。
(6) Effects of the Invention According to the present invention, in a device using a plurality of load cells, the output of each load cell can be taken out without decreasing, so each load cell can be used efficiently. It is possible to provide a load cell type scale that can perform accurate weighing because the offset voltage of the weighing device can be canceled.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの発明の実施例を示す回路図、第2
図は同実施例における各部の動作タイミングを示
す波形図である。 1,2,3,4……ロードセル、5……バツテ
リー、6……ホトカプラ、7,8,9,10……
緩衝増幅器、11……加算器、19……コンデン
サ、20……アナログスイツチ、33……A/D
コンバータ、43……演算回路、44……制御装
置、46……スイツチ制御回路。
Fig. 1 is a circuit diagram showing an embodiment of this invention, Fig. 2 is a circuit diagram showing an embodiment of the present invention;
The figure is a waveform diagram showing the operation timing of each part in the same embodiment. 1, 2, 3, 4...Load cell, 5...Battery, 6...Photocoupler, 7, 8, 9, 10...
Buffer amplifier, 11...Adder, 19...Capacitor, 20...Analog switch, 33...A/D
Converter, 43... Arithmetic circuit, 44... Control device, 46... Switch control circuit.

Claims (1)

【特許請求の範囲】[Claims] 1 直流電源と、この電源にスイツチ素子を介し
てそれぞれ接続され、荷重に応じた電圧を出力す
る複数のロードセルと、この各ロードセル出力を
それぞれ増幅する複数の緩衝増幅器と、この各増
幅器出力を加算する加算器と、この加算器の出力
端子間にコンデンサを介して接続されたアナログ
スイツチと、上記スイツチ素子及びアナログスイ
ツチを一定時間ずつ交互にON・OFF制御するス
イツチ制御回路と、上記アナログスイツチの
OFF時に上記加算器出力を上記コンデンサを介
して入力され、その入力レベルに対応したカウン
トデータを出力するA/Dコンバータと、この
A/Dコンバータ出力を入力し、重量単位のデー
タを得る演算回路とを具備したことを特徴とする
ロードセル式秤。
1. A DC power supply, multiple load cells each connected to this power supply via a switch element and outputting a voltage according to the load, multiple buffer amplifiers that amplify each of these load cell outputs, and the summation of each amplifier output. an analog switch connected between the output terminals of the adder via a capacitor, a switch control circuit that alternately controls ON/OFF of the switch element and the analog switch for a fixed period of time;
An A/D converter that receives the output of the adder via the capacitor when OFF and outputs count data corresponding to the input level; and an arithmetic circuit that receives the output of the A/D converter and obtains data in weight units. A load cell scale characterized by comprising:
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02142787U (en) * 1989-04-28 1990-12-04

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