JPS6362946B2 - - Google Patents
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- JPS6362946B2 JPS6362946B2 JP59277763A JP27776384A JPS6362946B2 JP S6362946 B2 JPS6362946 B2 JP S6362946B2 JP 59277763 A JP59277763 A JP 59277763A JP 27776384 A JP27776384 A JP 27776384A JP S6362946 B2 JPS6362946 B2 JP S6362946B2
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Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、鮮明な文字表示を可能にした映像
及び文字表示装置。[Detailed Description of the Invention] [Industrial Application Field] The present invention is an image and character display device that enables clear character display.
テレビジヨン受像機の受像管の画面に文字を表
示する場合、通常は、文字を映し出そうとする部
分の映像信号にはブランキングをかけるととも
に、ブランキング期間中に文字信号を挿入する方
法が用いられる。第3図に示す従来の映像及び文
字表示装置1は、受像管2のカソードに、赤、
緑、青の原色駆動信号をコレクタから供給する3
個の映像出力トランジスタQr,Qg,Qbが接続し
てあり、これらの映像出力トランジスタQr,Qg,
Qbと文字出力トランジスタQcが、映像出力回路
3を構成している。各映像出力トランジスタQr,
Qg,Qbは、ベースに色差信号R−Y,G−Y,
B−Yが印加され、エミツタに共通接続したブラ
ンキング回路4を介して輝度信号Yが印加され
る。
When displaying characters on the picture tube screen of a television receiver, the usual method is to blank the video signal in the area where the characters are to be displayed and insert the character signal during the blanking period. used. The conventional video and character display device 1 shown in FIG.
Supply green and blue primary color drive signals from the collector 3
Video output transistors Q r , Q g , Q b are connected, and these video output transistors Q r , Q g ,
Q b and character output transistor Q c constitute a video output circuit 3. Each video output transistor Q r ,
Q g and Q b are color difference signals R-Y, G-Y,
B-Y is applied, and a luminance signal Y is applied via a blanking circuit 4 commonly connected to the emitters.
この例では、受像管2の絶縁信号用カソードに
対し、前記映像出力トランジスタQgと並列に、
文字出力トランジスタQcが接続してあり、この
文字出力トランジスタQcのベースに、ブランキ
ング回路4を介して文字信号を印加する構成とし
てある。 In this example, the insulated signal cathode of the picture tube 2 is connected in parallel with the video output transistor Q g .
A character output transistor Q c is connected, and a character signal is applied to the base of this character output transistor Q c via a blanking circuit 4 .
ブランキング回路4は、輝度信号入力端子5と
文字信号発生回路6に接続してあり、入力である
輝度信号と文字信号は一方が選択的に取り出され
る。7は、スイツチ回路で、輝度信号入力用のト
ランジスタQyと文字信号入力用のトランジスタ
Qdが、エミツタどうし共通のエミツタ抵抗Reに
接続されて差動対を構成しており、そのエミツタ
出力がバツフアトランジスタQeを介して、各映
像出力トランジスタQr,Qg,Qbのエミツタに供
給される。 The blanking circuit 4 is connected to a luminance signal input terminal 5 and a character signal generation circuit 6, and one of the input luminance signal and character signal is selectively taken out. 7 is a switch circuit, which includes a transistor Qy for luminance signal input and a transistor for character signal input.
Q d is connected to a common emitter resistor R e to form a differential pair, and its emitter output is connected to each video output transistor Q r , Q g , Q b via a buffer transistor Q e . It is supplied to the emitsuta of.
文字信号入力用のトランジスタQdは、文字信
号発生回路6からの文字信号出力がベースに印加
されるトランジスタQ1のコレクタ出力をレベル
シフトするトランジスタQ2のコレクタから文字
信号を供給される。また、トランジスタQ2のコ
レクタは、前記文字出力トランジスタQcのベー
スに接続してある。 The character signal input transistor Q d is supplied with a character signal from the collector of a transistor Q 2 which level-shifts the collector output of the transistor Q 1 to which the character signal output from the character signal generation circuit 6 is applied. Further, the collector of the transistor Q2 is connected to the base of the character output transistor Qc .
従つて、いま文字信号発生回路6から文字信号
が出力されると、スイツチ回路7の文字信号入力
用のトランジスタQdが飽和し、輝度信号入力用
のトランジスタQyは遮断状態となる。その結果、
バツフアトランジスタQeも遮断状態となり、ブ
ランキング回路4の輝度信号出力は最大となるた
め、映像出力トランジスタQr,Qg,Qbは、すべ
て遮断状態となり、ブランキングがかかる。 Therefore, when a character signal is now output from the character signal generating circuit 6, the transistor Qd for inputting the character signal of the switch circuit 7 is saturated, and the transistor Qy for inputting the luminance signal is cut off. the result,
Since the buffer transistor Q e is also cut off and the brightness signal output of the blanking circuit 4 is at its maximum, the video output transistors Q r , Q g , and Q b are all cut off and blanking is applied.
一方、ブランキング回路4を介して文字出力ト
ランジスタQcのベースには、ハイレベルの文字
信号が印加されるため、文字出力トランジスタ
Qcの導通により緑色文字が受像管2の画面に映
し出される。 On the other hand, since a high-level character signal is applied to the base of the character output transistor Q c via the blanking circuit 4, the character output transistor
Green characters are displayed on the screen of the picture tube 2 due to the conduction of Q c .
上記従来の映像及び文字表示装置1は、ブラン
キング回路4内で形成されるブランキング信号が
文字信号に対して位相遅れを生じ、映像出力回路
3内において、ブランキング信号と文字信号のタ
イミングが正確に一致せず、鮮明な文字表示がで
きない等の問題点があつた。
In the conventional video and character display device 1 described above, the blanking signal formed in the blanking circuit 4 has a phase delay with respect to the character signal, and the timing of the blanking signal and the character signal in the video output circuit 3 is There were problems such as not being able to match accurately and not being able to display clear characters.
この発明は、上記問題点を解決したものであ
り、出力すべき映像信号を消去するブランキング
信号が、前記映像信号に代つて別途入力される文
字信号に対して、位相遅れをもつて入力される映
像出力回路と、前記文字信号を時間微分して得ら
れるエツジ検出信号を、前記ブランキング信号に
加算し、このブランキング信号自体の波形のなま
りと位相遅れを補正する補正手段を設けて構成し
たことを要旨とするものである。
This invention solves the above problem, and the blanking signal for erasing the video signal to be output is input with a phase delay with respect to the character signal input separately in place of the video signal. and a correction means for adding an edge detection signal obtained by time-differentiating the character signal to the blanking signal and correcting the waveform roundness and phase lag of the blanking signal itself. This is a summary of what was done.
この発明は、映像信号のブランキング期間に文
字信号を挿入する際、文字信号を時間微分して得
られるエツジ検出信号を、ブランキング信号に加
算し、ブランキング信号自体の波形のなまりと位
相遅れを補正し、にじみのない鮮明な文字表示を
可能とする。
In this invention, when inserting a character signal into the blanking period of a video signal, an edge detection signal obtained by time-differentiating the character signal is added to the blanking signal, and the waveform of the blanking signal itself is rounded and the phase lag is detected. This enables clear character display without blurring.
以下、この発明の実施例について、第1,2図
を参照して説明する。第1,2図は、それぞれこ
の発明の映像及び文字表示装置の一実施例を示す
要部回路図及び回路各部の信号波形図である。な
お、第1図中、第3図と同一構成部分には、同一
符号が付してある。
Embodiments of the present invention will be described below with reference to FIGS. 1 and 2. 1 and 2 are a main circuit diagram and a signal waveform diagram of each part of the circuit, respectively, showing an embodiment of the video and character display device of the present invention. In FIG. 1, the same components as in FIG. 3 are given the same reference numerals.
第1図中、映像及び文字表示装置11は、文字
出力トランジスタ量Qcのエミツタと映像出力ト
ランジスタQgのベースを、補正用の微分コンデ
ンサCを介して接続した構成である。このため、
文字出力トランジスタQcのエミツタ出力の微分
信号が、エツジ検出信号としてブランキング時の
映像出力トランジスタQgのベースに印加される
ことになる。 In FIG. 1, a video and character display device 11 has a configuration in which the emitter of a character output transistor quantity Q c and the base of a video output transistor Q g are connected via a differential capacitor C for correction. For this reason,
The differential signal of the emitter output of the character output transistor Q c is applied as an edge detection signal to the base of the video output transistor Q g during blanking.
文字出力トランジスタQcは、文字信号により
導通し、そのエミツタ出力の微分信号は、同図D
に示す如く、文字信号の立上りと立下りで極性が
異なる単峰状のパルスとなる。従つて、映像出力
トランジスタQr,Qg,Qbのエミツタに、文字信
号に対し△τなる位相遅れをもつ、第2図Cに示
すブランキング信号が印加されたとき、その始縁
部での導通が加速的に行われ、終縁部では強制的
に遮断状態に移行する。 The character output transistor Q c is made conductive by the character signal, and the differential signal of its emitter output is shown in Figure D.
As shown in the figure, the character signal becomes a single-peak pulse with different polarities at the rising and falling edges. Therefore, when the blanking signal shown in FIG . conduction occurs at an accelerated rate, and at the terminal edge, the state is forcibly switched to the cut-off state.
すなわち、第2図B,C,Dには、それぞれ文
字信号出力、ブランキング信号出力及びエツジ検
出信号が、単独で存在した場合の映像出力トラン
ジスタQg及び文字出力トランジスタQcのコレク
タ出力(カソード入力)波形を仮想し、一点鎖線
で図示してある。これらの仮想波形は、実際には
単独で存在しないのであるが、第2図B,C,D
にそれぞれ実線で示した信号の同時入力による映
像出力トランジスタQg及び文字出力トランジス
タQcのコレクタ出力は、上記仮想波形を合成し
た波形となり、同図Eに実線で示した信号波形が
それである。 That is, FIGS. 2B, C, and D show the collector outputs ( cathode Input) waveforms are hypothetical and shown with dashed lines. These virtual waveforms do not actually exist independently, but they are shown in Figure 2 B, C, and D.
The collector outputs of the video output transistor Q g and the character output transistor Q c due to the simultaneous input of the signals shown by solid lines in FIG.
このため、ブランキング信号の始縁部での波形
のなまりが補正されるとともに、終縁部での文字
信号に対する位相遅れも除去される。すなわち、
映像出力トランジスタQg及び文字出力トランジ
スタQcのコレクタでみた文字信号出力は、第2
図Eに示した如く、急俊な始縁部と後縁部を有し
ており、同図E中点線で示した従来の文字信号出
力にみられる立上りの波形なまりや文字の影の原
因となる後縁部のこぶ状波形はなく、これにより
にじみのない鮮明な文字表示が可能となる。 Therefore, the rounding of the waveform at the starting edge of the blanking signal is corrected, and the phase lag with respect to the character signal at the ending edge is also removed. That is,
The character signal output seen from the collectors of the video output transistor Q g and the character output transistor Q c is the second
As shown in Figure E, it has a sharp leading edge and trailing edge, which is the cause of the waveform rounding of the rising edge and shadows of characters seen in the conventional character signal output shown by the dotted line in the middle of Figure E. There is no hump-like waveform at the trailing edge, which makes it possible to display clear characters without blur.
このように、上記映像及び文字表示装置1は、
映像信号のブランキング期間に文字信号を挿入す
る際、文字信号を微分コンデンサCにより時間微
分して得られるエツジ検出信号を、ブランキング
信号に加算し、ブランキング信号自体の波形のな
まりと位相遅れを補正する構成としたから、受像
管2の画面上に映し出される文字の輪郭線の右側
縁側に生ずる淡い影の発生を抑制し、文字のにじ
みを防止して、鮮明な文字表示が可能であり、受
像管2の画面に映し出されるチヤンネル文字や、
パーソナルコンピユータ等からの文字情報等の見
やすさを、倍加することができる。 In this way, the video and character display device 1 has the following features:
When inserting a character signal into the blanking period of a video signal, the edge detection signal obtained by time-differentiating the character signal using a differentiating capacitor C is added to the blanking signal, and the waveform roundness and phase delay of the blanking signal itself are detected. Since the structure is configured to correct for this, it is possible to suppress the occurrence of faint shadows that occur on the right edge of the outline of the characters projected on the screen of the picture tube 2, prevent blurring of the characters, and enable clear character display. , the channel characters displayed on the screen of the picture tube 2,
The ease of viewing text information etc. from a personal computer etc. can be doubled.
以上説明したように、この発明によれば、映像
信号のブランキング期間に文字信号を挿入する
際、文字信号を時間微分して得られるエツジ検出
信号を、ブランキング信号に加算し、ブランキン
グ信号自体の波形のなまりと位相遅れを補正する
構成としたから、受像管の画面上に映し出される
文字の輪郭線の右側縁側に生ずる淡い影の発生を
抑制し、文字のにじみを防止して、鮮明な文字表
示が可能であり、受像管の画面に映し出されるチ
ヤンネル文字や、パーソナルコンピユータ等から
の文字情報等の見やすさを、倍加することができ
る等の優れた効果を奏する。
As explained above, according to the present invention, when inserting a character signal into the blanking period of a video signal, an edge detection signal obtained by time-differentiating the character signal is added to the blanking signal, and the blanking signal is The structure corrects the roundness and phase lag of the waveform of the image tube, which suppresses the appearance of faint shadows on the right edge of the outline of the characters projected on the picture tube screen, prevents blurring of the characters, and makes them clearer. It has excellent effects such as doubling the visibility of channel characters displayed on the picture tube screen and character information from a personal computer or the like.
第1,2図は、それぞれこの発明の映像及び文
字表示装置の一実施例を示す要部回路図及び回路
各部の信号波形図、第3図は、従来の映像及び文
字表示装置の一例を示す要部回路図である。
11……映像及び文字表示装置、2……受像
管、3……映像出力回路、4……ブランキング回
路、6……文字信号発生回路、C……微分コンデ
ンサ。
1 and 2 are main circuit diagrams and signal waveform diagrams of various parts of the circuit, respectively, showing an embodiment of the video and character display device of the present invention, and FIG. 3 is an example of a conventional video and character display device. It is a main part circuit diagram. DESCRIPTION OF SYMBOLS 11... Video and character display device, 2... Picture tube, 3... Video output circuit, 4... Blanking circuit, 6... Character signal generation circuit, C... Differential capacitor.
Claims (1)
信号が、前記映像信号に代つて別途入力される文
字信号に対して、位相遅れをもつて入力される映
像出力回路と、前記文字信号を時間微分して得ら
れるエツジ検出信号を、前記ブランキング信号に
加算し、このブランキング信号自体の波形のなま
りと位相遅れを補正する補正手段を設けてなる映
像及び文字表示装置。1. A video output circuit in which a blanking signal for erasing a video signal to be output is inputted with a phase delay with respect to a character signal input separately in place of the video signal, and a video output circuit that time-differentiates the character signal. A video and character display device comprising a correction means for adding an edge detection signal obtained by the blanking signal to the blanking signal and correcting the waveform roundness and phase delay of the blanking signal itself.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59277763A JPS61159871A (en) | 1984-12-31 | 1984-12-31 | Video and character display device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59277763A JPS61159871A (en) | 1984-12-31 | 1984-12-31 | Video and character display device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61159871A JPS61159871A (en) | 1986-07-19 |
| JPS6362946B2 true JPS6362946B2 (en) | 1988-12-05 |
Family
ID=17587992
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59277763A Granted JPS61159871A (en) | 1984-12-31 | 1984-12-31 | Video and character display device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61159871A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03228244A (en) * | 1990-02-01 | 1991-10-09 | Mitsubishi Electric Corp | Tape tension adjuster |
-
1984
- 1984-12-31 JP JP59277763A patent/JPS61159871A/en active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03228244A (en) * | 1990-02-01 | 1991-10-09 | Mitsubishi Electric Corp | Tape tension adjuster |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61159871A (en) | 1986-07-19 |
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