JPS645313B2 - - Google Patents
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- Publication number
- JPS645313B2 JPS645313B2 JP58207685A JP20768583A JPS645313B2 JP S645313 B2 JPS645313 B2 JP S645313B2 JP 58207685 A JP58207685 A JP 58207685A JP 20768583 A JP20768583 A JP 20768583A JP S645313 B2 JPS645313 B2 JP S645313B2
- Authority
- JP
- Japan
- Prior art keywords
- data
- pattern
- display
- image
- unit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Controls And Circuits For Display Device (AREA)
Description
【発明の詳細な説明】
(a) 発明の技術分野
本発明は、画像表示を制御する表示方式に関す
る。
る。
(b) 従来技術と問題点
画像をドツトパタン構成で表示するビツトマツ
プデイスプレイでは、表示メモリの容量（ビツト
数）は、画面を構成するドツト数と同一の容量を
必要とする。小型の電子装置（例えばフアクシミ
リ装置）において、操作案内用の液晶表示部に、
ドツト構成の画像パタンの蓄積用として、画面容
量（ドツト数）と同量の表示メモリを設ければ、
装置が高価となる欠点があつた。
プデイスプレイでは、表示メモリの容量（ビツト
数）は、画面を構成するドツト数と同一の容量を
必要とする。小型の電子装置（例えばフアクシミ
リ装置）において、操作案内用の液晶表示部に、
ドツト構成の画像パタンの蓄積用として、画面容
量（ドツト数）と同量の表示メモリを設ければ、
装置が高価となる欠点があつた。
(c) 発明の目的
本発明は上記の欠点を解決するためになされた
もので、表示メモリ容量を減少しうる表示制御方
式の提供を目的とする。
もので、表示メモリ容量を減少しうる表示制御方
式の提供を目的とする。
(d) 発明の構成
本発明は、表示部と制御装置とを有し、画素数
が縦Ｍドツト横Ｎドツトなる方形画像を、単位画
像として表示部に表示する装置において、前記単
位画像を構成する縦又は横方向のドツトパタンが
16進データで構成され且つ同一ドツトパタンの個
数が倍数記号及び倍数データで構成される画像パ
タンと、該画像パタンのデータを前記単位画像に
変換する手段と、検索手段とを備え、前記制御装
置から指定された前記画像パターンを索出し、該
画像パタンのデータを取出す際、前記倍数記号が
検出されたときは、該倍数記号に対応するパタン
データを前記倍数データが示す数だけ前記表示部
へ送出することを特徴とする表示制御方式であ
る。以上のように本発明は、ビツトマツプデイス
プレイにおいて、ドツトパタンをコード化した画
像パタンを備えることにより、表示メモリ容量の
縮小化を図つたものである。
が縦Ｍドツト横Ｎドツトなる方形画像を、単位画
像として表示部に表示する装置において、前記単
位画像を構成する縦又は横方向のドツトパタンが
16進データで構成され且つ同一ドツトパタンの個
数が倍数記号及び倍数データで構成される画像パ
タンと、該画像パタンのデータを前記単位画像に
変換する手段と、検索手段とを備え、前記制御装
置から指定された前記画像パターンを索出し、該
画像パタンのデータを取出す際、前記倍数記号が
検出されたときは、該倍数記号に対応するパタン
データを前記倍数データが示す数だけ前記表示部
へ送出することを特徴とする表示制御方式であ
る。以上のように本発明は、ビツトマツプデイス
プレイにおいて、ドツトパタンをコード化した画
像パタンを備えることにより、表示メモリ容量の
縮小化を図つたものである。
(e) 発明の実施例
以下、本発明を図面によつて説明する。第１図
は本発明を説明するブロツク図である。第１図ａ
に示す如く、表示メモリ１から表示部２へ、画像
データＧ（ドツトデータ）が送られることにより、
画面にドツト構成の画像が表示される。画面は、
ｎ個の単位画像G1〜Goが表示されるが、この単
位画像は、縦８ドツト、横10ドツトの計80ドツト
で構成されるものとする。第１図ｂは単位画像
G1のデータブロツク図である。第１図ｂにおい
て斜線が施された位置が表示される部分を示す。
従来方式では、このような表示を行う場合でも画
像（ドツト）パタンメモリとして、８×10ビツト
を必要とした。本発明は、第１図ｂに示す単位画
像G1の画像データを第１図ｃに示す如く、コー
ド化した画像パタンP1で構成せしめることによ
り、表示メモリ１の容量の節減を図つたものであ
る。パタンのコード化は次の要領で行われる。第
１図ｂにおいて、領域B1（b0〜b3）と領域B2（b4
〜b7）とに分けてコード化する。列D1の領域B1
において、斜線が施されている部分は行b1，b2及
びb3であるので、これを16進コード「Ｅ」とし
て、第１図ｃの画像パタンP1のアドレスAnの項
Ｌに格納する。尚、斜線部を“１”、空白部を
“０”とし、ビツトb0側を下位桁、ビツトb7側を
上位桁とする。また列D1の領域B2のうち斜線が
施されているのは行b4のみであるので、これを16
進コード「１」として第１図ｃの画像パタンP1
のアドレスAnの項Ｕに格納する。また列D2にお
いては、行b3及びb4のみに斜線が施されているの
で、第１図ｃの画像パタンP1のアドレスAo+1の
項Ｌ及びＵに16進コード「８」と「１」を格納す
る。第１図ｂの列D3〜D6においては、列D2と同
じく行b3及びb4のみに斜線が施されているので、
この場合には、第１図ｃの画像パタンP1のアド
レスAo+1の項Ｕに乗算記号（×）をまた項Ｌに
は数値データ「４」を格納する。ただし前記乗算
記号はデータとして表われないコードに定める。
このようなコード化作業により、第１図ｂに示す
単位画像G1（10バイト構成）は、第１図ｃに示す
画像パタンP1（６バイト）の如く、コード化され
て表示メモリ１に格納される。従つて表示メモリ
１の容量を節減することができる。
は本発明を説明するブロツク図である。第１図ａ
に示す如く、表示メモリ１から表示部２へ、画像
データＧ（ドツトデータ）が送られることにより、
画面にドツト構成の画像が表示される。画面は、
ｎ個の単位画像G1〜Goが表示されるが、この単
位画像は、縦８ドツト、横10ドツトの計80ドツト
で構成されるものとする。第１図ｂは単位画像
G1のデータブロツク図である。第１図ｂにおい
て斜線が施された位置が表示される部分を示す。
従来方式では、このような表示を行う場合でも画
像（ドツト）パタンメモリとして、８×10ビツト
を必要とした。本発明は、第１図ｂに示す単位画
像G1の画像データを第１図ｃに示す如く、コー
ド化した画像パタンP1で構成せしめることによ
り、表示メモリ１の容量の節減を図つたものであ
る。パタンのコード化は次の要領で行われる。第
１図ｂにおいて、領域B1（b0〜b3）と領域B2（b4
〜b7）とに分けてコード化する。列D1の領域B1
において、斜線が施されている部分は行b1，b2及
びb3であるので、これを16進コード「Ｅ」とし
て、第１図ｃの画像パタンP1のアドレスAnの項
Ｌに格納する。尚、斜線部を“１”、空白部を
“０”とし、ビツトb0側を下位桁、ビツトb7側を
上位桁とする。また列D1の領域B2のうち斜線が
施されているのは行b4のみであるので、これを16
進コード「１」として第１図ｃの画像パタンP1
のアドレスAnの項Ｕに格納する。また列D2にお
いては、行b3及びb4のみに斜線が施されているの
で、第１図ｃの画像パタンP1のアドレスAo+1の
項Ｌ及びＵに16進コード「８」と「１」を格納す
る。第１図ｂの列D3〜D6においては、列D2と同
じく行b3及びb4のみに斜線が施されているので、
この場合には、第１図ｃの画像パタンP1のアド
レスAo+1の項Ｕに乗算記号（×）をまた項Ｌに
は数値データ「４」を格納する。ただし前記乗算
記号はデータとして表われないコードに定める。
このようなコード化作業により、第１図ｂに示す
単位画像G1（10バイト構成）は、第１図ｃに示す
画像パタンP1（６バイト）の如く、コード化され
て表示メモリ１に格納される。従つて表示メモリ
１の容量を節減することができる。
第２図は本発明の表示制御の一実施例を説明す
るブロツク図である。第２図において、第１図ｂ
に示した単位画像G1の出力表示を指示する指令
コードg1が制御装置３から発せられる。制御部４
は、指令コードg1に対応する画像パタンP1を、表
示メモリ１から索出する。然るのち、まず画像パ
タンP1のアドレスAoの項Ｌ及びＵのデータ
（「Ｅ」及び「１」）を取出し、これをレジスタ５
にセツトする。レジスタ５は、上位部RUと下位
部RLとに分たれており、上位部RUにデータ「１」
が、また下位部RLにデータ「Ｅ」がセツトされ
る。判別部６はレジスタ５の上位部RU内のデー
タが乗算記号（×）であるか否かを調べる。乗算
記号（×）でなければレジスタ５（上位部RU及
び下位部RL）のデータを、レジスタ７へ転送せ
しめる。これに対し乗算記号（×）のとき、判別
部６は制御信号C2を発して、レジスタ５の下位
部RLのデータをカウンタ（down counter）８に
セツトすると共に、転送部９を起動する。転送部
９は、転送信号Ｓを発してレジスタ７内のデータ
を変換部１０へ送出する。このときのレジスタ７
には、レジスタ５内のデータ（例えばアドレス
Ao）よりも１つ前のアドレスAo-1のデータが格
納されている。また転送部９は転送信号Ｓを発す
る毎に、パルスＦを発して、カウンタ８の値を１
つ減ずる。カウンタ８の値が「０」になつたとき
終了信号Ｈが発せられ、転送部９が停止される。
従つてレジスタ７内のデータは、カウンタ８にセ
ツトされた値の回数だけ、変換部１０へ送出され
ることになる。変換部１０は、レジスタ７から送
られてくるデータを第１図ｂに示した単位画像
G1へ変換するので、表示部２に、指定された画
像がドツト構成で表示される。なお第３図は以上
の動作の概要を示すフローチヤートである。
るブロツク図である。第２図において、第１図ｂ
に示した単位画像G1の出力表示を指示する指令
コードg1が制御装置３から発せられる。制御部４
は、指令コードg1に対応する画像パタンP1を、表
示メモリ１から索出する。然るのち、まず画像パ
タンP1のアドレスAoの項Ｌ及びＵのデータ
（「Ｅ」及び「１」）を取出し、これをレジスタ５
にセツトする。レジスタ５は、上位部RUと下位
部RLとに分たれており、上位部RUにデータ「１」
が、また下位部RLにデータ「Ｅ」がセツトされ
る。判別部６はレジスタ５の上位部RU内のデー
タが乗算記号（×）であるか否かを調べる。乗算
記号（×）でなければレジスタ５（上位部RU及
び下位部RL）のデータを、レジスタ７へ転送せ
しめる。これに対し乗算記号（×）のとき、判別
部６は制御信号C2を発して、レジスタ５の下位
部RLのデータをカウンタ（down counter）８に
セツトすると共に、転送部９を起動する。転送部
９は、転送信号Ｓを発してレジスタ７内のデータ
を変換部１０へ送出する。このときのレジスタ７
には、レジスタ５内のデータ（例えばアドレス
Ao）よりも１つ前のアドレスAo-1のデータが格
納されている。また転送部９は転送信号Ｓを発す
る毎に、パルスＦを発して、カウンタ８の値を１
つ減ずる。カウンタ８の値が「０」になつたとき
終了信号Ｈが発せられ、転送部９が停止される。
従つてレジスタ７内のデータは、カウンタ８にセ
ツトされた値の回数だけ、変換部１０へ送出され
ることになる。変換部１０は、レジスタ７から送
られてくるデータを第１図ｂに示した単位画像
G1へ変換するので、表示部２に、指定された画
像がドツト構成で表示される。なお第３図は以上
の動作の概要を示すフローチヤートである。
(f) 発明の効果
以上のように本発明は、表示メモリの容量を著
しく減少しうる利点を有する。
しく減少しうる利点を有する。
第１図は本発明を説明するブロツク図、第２図
は本発明の一実施例を説明するブロツク図、第３
図は本発明の一実施例を説明するフローチヤート
であり、図中に用いた符号は次の通りである。 １は表示メモリ、２は表示部、３は制御装置、
４は制御部、５，７はレジスタ、８はカウンタ、
９は転送部、１０は変換部、Ao，Ao+1，Ao+2，
Ao+3，Ao+4，Ao+5はアドレス、B1，B2は領域、
bJ，b1，b2，b3，b4，b5，b6，b7は行、C1，C2は
制御信号、D1，D2，D3，D4，D5，D6，D7，D8，
D9，D10は列、Ｅは16進コード、Ｆはパルス、Ｇ
は画像データ、G1，Goは単位画像、g1は指令コ
ード、Ｈは終了信号、Ｌ，Ｕは項、P1，Poは画
像パタン、RLはレジスタの下位部、RUはレジス
タの上位部を示す。
は本発明の一実施例を説明するブロツク図、第３
図は本発明の一実施例を説明するフローチヤート
であり、図中に用いた符号は次の通りである。 １は表示メモリ、２は表示部、３は制御装置、
４は制御部、５，７はレジスタ、８はカウンタ、
９は転送部、１０は変換部、Ao，Ao+1，Ao+2，
Ao+3，Ao+4，Ao+5はアドレス、B1，B2は領域、
bJ，b1，b2，b3，b4，b5，b6，b7は行、C1，C2は
制御信号、D1，D2，D3，D4，D5，D6，D7，D8，
D9，D10は列、Ｅは16進コード、Ｆはパルス、Ｇ
は画像データ、G1，Goは単位画像、g1は指令コ
ード、Ｈは終了信号、Ｌ，Ｕは項、P1，Poは画
像パタン、RLはレジスタの下位部、RUはレジス
タの上位部を示す。
Claims (1)
- 【特許請求の範囲】 １ 表示部と、該表示部に表示すべき画像データ
を記憶する表示メモリと、制御装置とを有し、画
素数が縦Ｍドツト横Ｎドツトなる方形画像を単位
画像として表示部に表示する装置において、 前記表示メモリの前記単位画像データの記憶方
式として、縦方向の列のＭビツトのパタンが前の
列のＭビツトのパタンと異なる時は、Ｌ桁の16進
データ（但しLx4＝ＭでＬは２以上の整数）とし
て一列に記憶し、上記縦方向のＭドツトのパタン
が前の列のＭビツトのパタンと同じ時は、その同
じパタンが連続する回数を、同じ列パタンが連続
する回数であることを示す特定記号を付して一列
のデータとして記憶し、 前記表示メモリの前記単位画像データの読み出
し方式として、一列のデータを順次読み出し、そ
のデータが上記特定記号を含まない時は、そのま
ま表示部へ送出し、そのデータが上記特定記号を
含む時は、この特定記号を付した回数だけ、その
直前に読み出されたＬ桁の16進データを連続して
表示部へ送出することを特徴とする表示制御方
式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58207685A JPS60100177A (ja) | 1983-11-05 | 1983-11-05 | 表示制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58207685A JPS60100177A (ja) | 1983-11-05 | 1983-11-05 | 表示制御方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60100177A JPS60100177A (ja) | 1985-06-04 |
| JPS645313B2 true JPS645313B2 (ja) | 1989-01-30 |
Family
ID=16543877
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58207685A Granted JPS60100177A (ja) | 1983-11-05 | 1983-11-05 | 表示制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60100177A (ja) |
-
1983
- 1983-11-05 JP JP58207685A patent/JPS60100177A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60100177A (ja) | 1985-06-04 |
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