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JPS646483B2 - - Google Patents
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JPS646483B2 - - Google Patents

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Publication number
JPS646483B2
JPS646483B2 JP56120099A JP12009981A JPS646483B2 JP S646483 B2 JPS646483 B2 JP S646483B2 JP 56120099 A JP56120099 A JP 56120099A JP 12009981 A JP12009981 A JP 12009981A JP S646483 B2 JPS646483 B2 JP S646483B2
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JP
Japan
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data
printer
counter
lines
address
Prior art date
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Expired
Application number
JP56120099A
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Japanese (ja)
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JPS5822440A (en
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Fumisuke Tsukasa
Sadaoki Sakai
Masaaki Hirayama
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Anritsu Corp
Original Assignee
Anritsu Corp
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Publication date
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    • G06COMPUTING OR CALCULATING; COUNTING
    • G06KGRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
    • G06K15/00Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers

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  • Engineering & Computer Science (AREA)
  • General Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Record Information Processing For Printing (AREA)

Description

【発明の詳細な説明】 本発明は高速入力データをそれよりも遅い印字
速度で印字する場合に有効なバツフア機能を持つ
た高速入力データ用プリンタに関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a printer for high-speed input data that has a buffer function that is effective when printing high-speed input data at a slower printing speed.

従来のこの種のプリンタは、第1図に示すよう
に送信装置側(図示せず)においてプリンタ機構
部1から送出されている“0”レベルを示す印字
中(ビジー)の信号PIを確認した後、書込み側
に設定されているアドレスカウンタ2へ第2図に
示す書込みパルスWPを用いて1行分(10文字で
1行が構成されるとする)のメモリ容量を持つデ
ータメモリ3へ入力データID(第2図参照)を順
次書込んでいく。このようにして1行分の入力デ
ータIDを書込んだ後、送信装置側では第2図に
示す印字指令パルスPCをプリンタ側に与えてア
ドレスカウンタ2を読出し側に設定するととも
に、モータ制御ラツチ4をセツトしてモータドラ
イバ5によりプリンタ機構部1のモータを駆動せ
しめる。そうすると、プリンタ機構部は印字中
(ビジー)である“1”レベルの信号PIを出力す
るとともに、1ドツト印字ごとにドツト完了信号
Dを出してくる。このドツト完了信号Dによりド
ツトカウンタ6の内容を変えながらデータメモリ
3のデータを順次読出してキヤラクタジエネレー
タ7に入力し、ここで、ドツトデータに変換後ワ
イヤードツトドライバ8でプリンタ機構部1のワ
イヤーヘツドをドライブし印字を行なう構成であ
る。9,10はオア回路である。
In the conventional printer of this kind, as shown in Fig. 1, the printing (busy) signal PI indicating the "0" level sent from the printer mechanism section 1 was confirmed on the transmitting device side (not shown). Then, using the write pulse WP shown in Figure 2 to the address counter 2 set on the write side, input to the data memory 3 which has a memory capacity of one line (assuming one line is composed of 10 characters). Write the data IDs (see Figure 2) in sequence. After writing one line of input data ID in this way, the transmitter side gives the print command pulse PC shown in Figure 2 to the printer side, sets the address counter 2 to the read side, and also turns the motor control latch on. 4, and the motor of the printer mechanism section 1 is driven by the motor driver 5. Then, the printer mechanism section outputs a "1" level signal PI indicating that printing is in progress (busy), and also outputs a dot completion signal D every time one dot is printed. The data in the data memory 3 is sequentially read out while changing the contents of the dot counter 6 according to the dot completion signal D and inputted to the character generator 7. Here, after converting to dot data, the wire dot driver 8 is used to control the printer mechanism section 1. The configuration is such that printing is performed by driving a wire head. 9 and 10 are OR circuits.

しかしながら以上のようなプリンタでは、1行
分の入力データIDをデータメモリ3に書込んだ
後、そのまま1行分のデータを1文字づつ読出し
て印字するものであるため、送信装置側から送出
する入力データIDの速度はプリンタメカの印字
速度によつて実質的に決まつてしまう不具合があ
る。また、送信装置は印字中であるか否かを確認
しながら入力データIDを書込んだり、プリンタ
側にデータの読出しを譲つたりしているので、一
方のデータの処理中には他方のデータの処理が難
しく、このためこの種のプリンタでは高速入力デ
ータに対するバツフア機能を充分発揮しえなかつ
た。
However, in the above-mentioned printers, after writing one line of input data ID to the data memory 3, one line of data is read out one character at a time and printed, so the data is sent from the transmitting device. There is a problem that the speed of input data ID is substantially determined by the printing speed of the printer mechanism. In addition, the transmitting device writes the input data ID while checking whether printing is in progress or yields data reading to the printer, so while one data is being processed, the other data is being processed. Therefore, this type of printer was unable to fully utilize its buffer function for high-speed input data.

本発明は上記実情にかんがみてなされたもの
で、その目的とするところは、送信装置側で印字
中(ビジー)の確認を必要とせずにデータの書込
みおよび読出しを独自に行なつて高速入力データ
を通常の印字速度で何ら支障なく印字しうるよう
にする高速入力データ用プリンタを提供するもの
とする。
The present invention has been made in view of the above-mentioned circumstances, and an object of the present invention is to independently write and read data without the need to check whether the transmitting device is busy or not, thereby providing high-speed input data. To provide a high-speed input data printer capable of printing at normal printing speed without any trouble.

以下、本発明の一実施例について第3図を参照
して説明する。同図において11は送信装置側か
らの複数行分のデータIDを格納できる例えば
RAM(Random Access Memory)等で構成さ
れたデータメモリである。このメモリ11は書込
みアドレスカウンタ12および読出しアドレスカ
ウンタ13のアドレス指定に基づいてデータの書
込みおよび読出しが同時に行なえる構成となつて
いる。この書込みアドレスカウンタ12は送信装
置側から送られてくる書込みパルスWPの入力ご
とにカウントアツプしてデータメモリ11へ書込
みアドレスを指定するとともに、そのアドレス指
定値をアドレス比較器14に供給する。他方の読
出しアドレスカウンタ13はプリンタ機構部15
から出力される1文字分の数のドツト印字完了信
号Dでカウント値を変更するドツトカウンタ16
の出力でカウントアツプしてデータメモリ11へ
読出しアドレスを指定するとともに、そのアドレ
ス指定値をアドレス比較器17に供給する。これ
らのアドレス比較器14,17にはメモリ最終ア
ドレス設定回路18からデータメモリ11の複数
行分のアドレスもしくはそれよりも少ない最終ア
ドレスが常時入力され、それぞれの書込みアドレ
スカウンタ12および読出しアドレスカウンタ1
3から入力するアドレス指定値と比較し一致した
とき同カウンタ12,13をクリアする機能を持
つている。19はデータメモリ11から1文字分
づつデータを取込んでドツトカウンタ16からの
1文字相当のドツトアドレス指定に基づいてドツ
ト信号に変換し後続のワイヤードツトドライバ2
0に供給するキヤラクタジエネレータである。こ
のワイヤードツトドライバ20はプリンタ機構部
15のワイヤーヘツドをドライブする機能を持つ
ている。21は送信装置側からの印字指令信号
PCでカウントアツプしかつプリンタ機構部15
からの印字中信号の終了タイミングでカウントダ
ウンする未印字行数カウンタであり、同カウンタ
21は印字指令信号PCの入力に基づいてモータ
ドライバ22を駆動させ、プリンタ機構部15の
モータをオンせしめる機能を持つている。
Hereinafter, one embodiment of the present invention will be described with reference to FIG. In the same figure, 11 is an example that can store data IDs for multiple lines from the transmitter side.
This is data memory composed of RAM (Random Access Memory) and the like. The memory 11 is configured such that data can be written and read simultaneously based on address designations of a write address counter 12 and a read address counter 13. This write address counter 12 counts up each time a write pulse WP is input from the transmitter side, specifies a write address to the data memory 11, and supplies the address designation value to the address comparator 14. The other read address counter 13 is connected to the printer mechanism section 15.
A dot counter 16 whose count value is changed by a dot printing completion signal D corresponding to one character output from the dot counter 16.
It counts up at the output of , specifies a read address to the data memory 11 , and supplies the address designation value to the address comparator 17 . These address comparators 14 and 17 are constantly inputted with addresses for multiple lines of the data memory 11 or smaller final addresses from the memory final address setting circuit 18, and the respective write address counters 12 and read address counters 1
It has a function of comparing with the address designation value input from 3 and clearing the counters 12 and 13 when they match. 19 reads data one character at a time from the data memory 11, converts it into a dot signal based on the dot address designation corresponding to one character from the dot counter 16, and sends it to the subsequent wire dot driver 2.
This is a character generator that supplies 0. This wire dot driver 20 has a function of driving the wire head of the printer mechanism section 15. 21 is a print command signal from the transmitter side
Count up on PC and printer mechanism section 15
This is a counter for the number of unprinted lines that counts down at the end timing of the printing signal from the PC. I have it.

次に、以上のように構成せるプリンタの作用を
説明する。先ず、印字すべき入力データIDとし
て第4図のように、、の3行分とし、かつ
1行分の入力データIDは例えば10文字で構成さ
れているものとする。この場合データメモリ11
は少なくとも3行分以上のメモリ容量を備えてい
ることが望ましい。しかして、送信装置は、第3
図に示すようなプリンタへデータを印字する場合
そのプリンタ機構部15の印字有無を確認するこ
となく書込みアドレスカウンタ12へ1行分10文
字に相当する書込みパルスWPを順次供給する。
ここで、書込みアドレスカウンタ12は書込みパ
ルスWPが入力されるごとに0番地から順次上位
の番地へとアドレス指定を行ないながら送信装置
側から送られてくる入力データIDをデータメモ
リ11へ書込んでいく。更に、書込アドレスカウ
ンタ12は上記アドレス指定値をアドレス比較器
14に供給する。そして、データメモリ11へ1
行分の入力データIDを書込むと、送信装置は
印字指令信号PCをプリンタ側へ送出する。この
信号PCを受けたプリンタ側の未印字行数カウン
タ21は第4図Aに示すように「1」となり、こ
こで未印字行数有りと判断してモータドライバ2
2を介してプリンタ機構部15のモータMを駆動
せしめる。すなわち、モータMはプリンタ機構部
15を構成する紙送り機構、印字ヘツドを印字用
紙に沿つて移動させる機構等の各種機械的機構を
駆動する。そして、プリンタ機構部15は、読出
しアドレスカウンタ13の指定に基づいてキヤラ
クタジエネレータ19およびワイヤードツトドラ
イバ20を介して入力されている0番地の1文字
分ドツトデータを印字し始める。このとき、プリ
ンタ機構部15は第4図に示すように印字中の信
号PIを出力するとともに、1ドツト印字ごとに
ドツト完了信号Dをドツトカウンタ16に供給す
る。このドツトカウンタ16は1文字のドツト完
了信号Dをカウントすると読出しアドレスカウン
タ13へ1文字分印字完了信号23を送ると同時
に引き続きキヤラクタジエネレータ19へドツト
アドレスを送出する。こようにして読出しアドレ
スカウンタ13は0番地から順次上位番地となる
ようにデータメモリ11へのアドレス指定を行な
つて1文字分ごとのデータを読出して印字すると
ともに、そのアドレス指定値をアドレス比較器1
7へ供給する。
Next, the operation of the printer configured as described above will be explained. First, let us assume that the input data ID to be printed consists of three lines of , as shown in FIG. 4, and that one line of the input data ID consists of, for example, 10 characters. In this case data memory 11
It is desirable to have a memory capacity for at least three lines. Therefore, the transmitting device
When printing data to a printer as shown in the figure, write pulses WP corresponding to 10 characters for one line are sequentially supplied to the write address counter 12 without checking whether the printer mechanism 15 is printing or not.
Here, the write address counter 12 writes the input data ID sent from the transmitter side to the data memory 11 while sequentially specifying addresses from address 0 to higher addresses every time the write pulse WP is input. go. Additionally, write address counter 12 supplies the addressing value to address comparator 14 . Then, 1 to the data memory 11
After writing the input data ID for a line, the transmitting device sends a print command signal PC to the printer side. Upon receiving this signal PC, the unprinted lines counter 21 on the printer side becomes "1" as shown in FIG.
2, the motor M of the printer mechanism section 15 is driven. That is, the motor M drives various mechanical mechanisms constituting the printer mechanism section 15, such as a paper feeding mechanism and a mechanism for moving the printing head along the printing paper. Then, the printer mechanism section 15 starts printing the dot data for one character at address 0, which is input via the character generator 19 and the wire dot driver 20, based on the designation of the read address counter 13. At this time, the printer mechanism section 15 outputs a printing in progress signal PI as shown in FIG. 4, and also supplies a dot completion signal D to the dot counter 16 every time one dot is printed. When the dot counter 16 counts the dot completion signal D for one character, it sends a print completion signal 23 for one character to the read address counter 13, and at the same time, it continues to send a dot address to the character generator 19. In this way, the read address counter 13 specifies addresses in the data memory 11 sequentially from address 0 to higher addresses, reads out and prints data for each character, and compares the addressed values with the addresses. Vessel 1
Supply to 7.

一方、送信装置はプリンタ機構部15の印字動
作とは無関係に書込みパルスWPを出力して2行
分の入力データIDをデータメモリ11に書込
み、かつ2行分入力データIDを書き終ると印字
指令信号PCを出力して未印字行数カウンタ21
の未印字行数をカウントアツプさせる。プリンタ
機構部15は未印字行数カウンタ21に未印字行
数が存ずる限りモータMがオン状態となつている
ので、ドツトデータを印字し続け、1行分文字の
ドツトデータを印字し終ると印字中信号を“0”
レベルとして未印字行数カウンタ21をカウント
ダウンせしめる。以上のようにしてデータの読出
しおよび書込みを独立的に行ないながら書込みア
ドレスカウンタ12および読出しアドレスカウン
タ13のアドレス指定値が最終アドレス設定回路
18の最終アドレスに達すると、それぞれのアド
レス比較器14,17から一致信号がでて書込み
アドレスカウンタ12および読出しドレスカウン
タ13をクリアする。なお、プリンタ機構部15
は未印字行数ウンタ21が“0”となるまで印字
動作を続ける。
On the other hand, the transmitting device outputs a write pulse WP regardless of the printing operation of the printer mechanism section 15 to write two lines of input data ID to the data memory 11, and when it finishes writing the two lines of input data ID, it issues a print command. Output the signal PC to counter the number of unprinted lines 21
Count up the number of unprinted lines. Since the motor M is in the ON state as long as the number of unprinted lines remains in the unprinted line counter 21, the printer mechanism section 15 continues to print dot data, and when it finishes printing one line of character dot data, it starts printing. Set the medium signal to “0”
As a level, the unprinted line number counter 21 is caused to count down. When the address designation values of the write address counter 12 and the read address counter 13 reach the final address of the final address setting circuit 18 while reading and writing data independently as described above, the respective address comparators 14 and 17 A match signal is output from , and the write address counter 12 and read address counter 13 are cleared. Note that the printer mechanism section 15
continues the printing operation until the unprinted line counter 21 becomes "0".

従つて、以上のようなプリンタによれば、プリ
ンタ機構部15の印字速度が遅くても送信装置側
の高速入力データを確実に保持できバツフとして
の機能を充分発揮できる。また、プリンタ機構部
15は未印字行数が存ずる限り、送信装置側と無
関係にデータを読出して印字できるため、それだ
けデータ処理の高能率化を図れる。また、送信装
置はプリンタ機構部15からの印字有無を確認す
る必要がなく、このため装置の簡素化は勿論のこ
と、両装置の信号線の減少ひいてはコストの低減
化を図れる。
Therefore, according to the above-described printer, even if the printing speed of the printer mechanism section 15 is slow, the high-speed input data from the transmitter side can be reliably held and the function as a buffer can be fully exhibited. Further, as long as there is a number of unprinted lines, the printer mechanism section 15 can read and print data independently of the transmitter side, so that data processing can be made more efficient. Further, the transmitting device does not need to check whether or not there is printing from the printer mechanism section 15, which not only simplifies the device, but also reduces the number of signal lines for both devices, thereby reducing costs.

また、未印字行数が零になるとモータドライバ
22がプリンタ機構部15の各機械的機構を駆動
するモータを強制的に停止するので、データメモ
リ11内に印字すべきデータが存在しないのにプ
リンタ機構部15が駆動している状態を防止で
き、消費電力を抑制できるとともに異常時におけ
るプリンタ機構部15の暴走を確実に停止でき
る。
Furthermore, when the number of unprinted lines becomes zero, the motor driver 22 forcibly stops the motors that drive each mechanical mechanism of the printer mechanism section 15, so even if there is no data to be printed in the data memory 11, the printer It is possible to prevent the mechanism section 15 from being driven, suppress power consumption, and reliably stop the printer mechanism section 15 from running out of control in the event of an abnormality.

なお、本発明は上記実施例に限定されるもので
はない。例えば書込みアドレスカウンタ12およ
び読出しアドレスカウンタ13自体に最終アドレ
ス設定機能を持たせるようにすれば、アドレス比
較器14,17および最終アドレス設定回路21
を除去することが可能である。その他、本発明は
その要旨を逸脱しない範囲で種々変形して実施で
きる。
Note that the present invention is not limited to the above embodiments. For example, if the write address counter 12 and the read address counter 13 themselves are provided with a final address setting function, the address comparators 14 and 17 and the final address setting circuit 21
It is possible to remove. In addition, the present invention can be implemented with various modifications without departing from the gist thereof.

以上詳記したように本発明によれば、データメ
モリに複数行分のメモリを備えかつ書込みと読出
しとを独自に行なうようにしたので、印字速度よ
りも高速の入力データでも確実に保持して印字で
きるとともに、送信装置およびプリンタはそれぞ
れ拘束されずに本来の機能を実行しえデータ処理
の能率化を図ることができる高速入力データ用プ
リンタを提供できる。
As described in detail above, according to the present invention, the data memory is provided with memory for multiple lines, and writing and reading are performed independently, so even input data faster than the printing speed can be reliably retained. It is possible to provide a printer for high-speed input data that can print, and allows the transmitting device and printer to perform their original functions without being restricted, thereby improving the efficiency of data processing.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は従来のプリンタの構成図、第2図は第
1図のプリンタの動作を説明するフロチヤート、
第3図は本発明に係る高速入力データ用プリンタ
の一実施例を示す構成図、第4図は第3図に示す
プリンタの動作を説明するフロチヤートである。 11…データメモリ、12…書込みアドレスカ
ウンタ、13…読出しアドレスカウンタ、14,
17…アドレス比較器、15…プリンタ機構部、
16…ドツトカウンタ、18…最終アドレス設定
回路、19…キヤラクタジエネレータ、20…ワ
イヤードツトカウンタ、21…未印字行数カウン
タ、22…モータドライバ、23…1文字分印字
完了信号。
FIG. 1 is a block diagram of a conventional printer, and FIG. 2 is a flowchart explaining the operation of the printer shown in FIG.
FIG. 3 is a block diagram showing an embodiment of the printer for high-speed input data according to the present invention, and FIG. 4 is a flowchart explaining the operation of the printer shown in FIG. 3. 11...Data memory, 12...Write address counter, 13...Read address counter, 14,
17...address comparator, 15...printer mechanism section,
16... Dot counter, 18... Final address setting circuit, 19... Character generator, 20... Wire dot counter, 21... Unprinted line number counter, 22... Motor driver, 23... One character printing completion signal.

Claims (1)

【特許請求の範囲】[Claims] 1 送信装置から順次入力される各データを一時
格納した後この各データを読出してプリンタ機構
部15で複数行に亘つて印字出力する高速入力デ
ータ用プリンタにおいて、複数行分のデータを記
憶できるメモリ容量を有したデータメモリ11
と、前記送信装置からの書込みパルス入力に応動
して前記入力される各データの前記データメモリ
内での書込みアドレスを順次指定する書込みアド
レスカウンタ12と、前記プリンタ機構部からの
1データ分の各印字完了信号出力に応動して前記
データメモリ内の読出しアドレスを順次指定する
読出しアドレスカウンタ13と、前記送信装置か
ら送出される1行分のデータに対する印字指令信
号にてカウントアツプされ、前記プリンタ機構部
から送出される1行分のデータに対する印字中信
号の終了にてカウントダウンされる未印字行数カ
ウンタ21と、この未印字行数カウンタにてカウ
ントされる未印字行数が零行になつたとき前記プ
リンタ機構部を動作させるモータを停止させるモ
ータドライバ22とを備えたことを特徴とする高
速入力データ用プリンタ。
1. A memory capable of storing data for multiple lines in a high-speed input data printer that temporarily stores each data sequentially input from a transmitting device, reads out each data, and prints out multiple lines at the printer mechanism section 15. Data memory 11 with capacity
a write address counter 12 that sequentially specifies a write address in the data memory for each input data in response to a write pulse input from the transmitting device; A read address counter 13 that sequentially specifies read addresses in the data memory in response to the output of a print completion signal, and a read address counter 13 that is incremented by a print command signal for one line of data sent from the transmitting device, and is counted up by the printer mechanism. The unprinted lines counter 21 counts down at the end of the printing signal for one line of data sent from the unit, and the unprinted lines counted by this unprinted lines counter reaches zero lines. A printer for high-speed input data, comprising: a motor driver 22 for stopping a motor for operating the printer mechanism section.
JP56120099A 1981-07-31 1981-07-31 Printer for high-speed input data Granted JPS5822440A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
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Publications (2)

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JPS5822440A JPS5822440A (en) 1983-02-09
JPS646483B2 true JPS646483B2 (en) 1989-02-03

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ID=14777882

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Cited By (1)

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JPS5822440A (en) 1983-02-09

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