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JPS648353B2 - - Google Patents
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JPS648353B2 - - Google Patents

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Publication number
JPS648353B2
JPS648353B2 JP10783882A JP10783882A JPS648353B2 JP S648353 B2 JPS648353 B2 JP S648353B2 JP 10783882 A JP10783882 A JP 10783882A JP 10783882 A JP10783882 A JP 10783882A JP S648353 B2 JPS648353 B2 JP S648353B2
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JP
Japan
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key
note
block
time
slot
Prior art date
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Application number
JP10783882A
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Japanese (ja)
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JPS58224386A (en
Inventor
Kazuo Tanaka
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Yamaha Corp
Original Assignee
Yamaha Corp
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Publication date
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  • Auxiliary Devices For Music (AREA)

Description

【発明の詳細な説明】 この発明は鍵盤楽器による演奏の過程を自動的
に楽譜として表示する楽譜表示方法に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a musical score display method for automatically displaying the process of playing a keyboard instrument as a musical score.

この種の楽譜表示方法においては、例えば第1
図に示すように、時刻t1においてキーC3(第3
オクターブC音のキー)が押下され、時刻t2にお
いてキーC4が押下され、時刻t3においてキーC
3,C4が共に離鍵されると同時にキーE4,D
5が共に押下された場合、同図に示すようにまず
C3音の音符を表示し、次に4分音符の時間に対
応する距離だけ隔ててC4音の音符を表示し、次
いで4分音符の時間に対応する距離だけ隔てて
E4音、D5音の音符を表示するのが一般的である。
しかしながら、このような表示方法にあつては、
表示された楽譜において、C4音の遅れ時間(先
行音C3からの遅れ時間)が明確に表示されない
という問題がある。
In this type of score display method, for example, the first
As shown in the figure, at time t1 , key C3 (third
Octave C note key) is pressed, key C4 is pressed at time t 2 , and key C is pressed at time t 3 .
3 and C4 are both released, and at the same time keys E4 and D are released.
If 5 are pressed together, first, as shown in the same figure,
Display the notes for the C3 note, then the notes for the C4 note separated by a distance corresponding to the quarter note time, then the notes for the C4 note separated by a distance corresponding to the quarter note time.
It is common to display the notes E4 and D5.
However, in this display method,
In the displayed musical score, there is a problem in that the delay time of the C4 note (delay time from the preceding note C3) is not clearly displayed.

そこでこの発明は、先行音に遅れて他の音符が
表示される場合、その音符の前に先行音からの遅
れ時間に対応する休符(第1図における破線参
照)を表示するようにし、これにより、先行音か
らの遅れ時間が明確に表示されるようにしたもの
である。
Therefore, in this invention, when another note is displayed after the preceding note, a rest corresponding to the delay time from the preceding note (see the broken line in FIG. 1) is displayed before that note. This allows the delay time from the preceding sound to be clearly displayed.

以下、図面を参照しこの発明の一実施例につい
て説明する。
An embodiment of the present invention will be described below with reference to the drawings.

第2図はこの発明による方法を適用した楽譜表
示装置の構成を示すブロツク図であり、この図に
示す楽譜表示装置はピアノ1による演奏の過程を
自動的に楽譜として表示するものである。
FIG. 2 is a block diagram showing the configuration of a musical score display device to which the method according to the present invention is applied, and the musical score display device shown in this figure automatically displays the process of performance on the piano 1 as a musical score.

すなわち、ピアノ1には、各キー(鍵)に対応
してキー操作検出用のキースイツチが設けられて
おり、各キースイツチの出力(楽音情報)が各々
楽器インターフエイス2へ供給されている。
That is, the piano 1 is provided with a key switch for detecting a key operation corresponding to each key, and the output (musical tone information) of each key switch is supplied to the musical instrument interface 2, respectively.

楽器インターフエイス2はピアノ1の各キース
イツチの出力を一定周期で走査することにより各
キーのオン/オフ状態を検出する。そして、各キ
ーのオン/オフ状態に変化(以下、イベントと称
す)が生じた場合に、第3図イに示すイベントブ
ロツクIBを作成し、音符選出処理回路3へ供給
する。ここで、イベントブロツクIBは最小4バ
イトから構成され、その第1、第2バイトには前
回のイベント発生時点から今回のイベント発生時
点までの時間を示すタイマデータが書込まれ、そ
の第3バイトには第3図ロに示すインデイケータ
が書込まれ、また、その第4バイトには変化が生
じたキーのキーコードが書込まれる。この場合、
演奏開始時点においてピアノ1のキーが最初に押
下された時作成されるイベントブロツクIBのタ
イマデータは「0」となる。また、インデイケー
タには、その第7ビツト(MSB)にキーのオ
ン/オフの別を示す情報が“1”(キーオン)ま
たは“0”(キーオフ)で書込まれ、その第1ビ
ツトおよび第0ビツト(LSB)には通常“0”、
“0”が書込まれる。なお、イベント間隔がタイ
マデータのビツト数によつて表わされる時間以上
になつた場合は、その時点で同様のイベントブロ
ツクIBが再び作成されるが、この場合インデイ
ケータの第1、第0ビツトが各々“0”、“1”と
なる。また、インデイケータの第2〜第6ビツト
は以後の処理に全く使用されない。また、2以上
のキーについて同時にイベントが発生した場合、
例えばあるキーがオフとされ、同時に他のキーが
オンとされた場合は、第3図に示すインデイケー
タおよびキーコードからなるブロツクIBBがイベ
ントが発生したキーの数だけ設けられる。
The musical instrument interface 2 detects the on/off state of each key by scanning the output of each key switch of the piano 1 at regular intervals. When a change (hereinafter referred to as an event) occurs in the on/off state of each key, an event block IB shown in FIG. 3A is created and supplied to the note selection processing circuit 3. Here, the event block IB consists of a minimum of 4 bytes, and the first and second bytes are written with timer data indicating the time from the previous event occurrence to the current event occurrence, and the third byte is The indicator shown in FIG. 3B is written in , and the key code of the changed key is written in the fourth byte. in this case,
The timer data of the event block IB, which is created when the key of the piano 1 is pressed for the first time at the start of the performance, becomes "0". In addition, information indicating whether the key is on or off is written in the 7th bit (MSB) of the indicator as "1" (key on) or "0" (key off), and the 1st bit and 0th bit are written in the indicator. The bit (LSB) is usually “0”,
“0” is written. Note that if the event interval exceeds the time represented by the number of bits in the timer data, a similar event block IB is created again at that point, but in this case, the 1st and 0th bits of the indicator are They become “0” and “1”. Furthermore, the second to sixth bits of the indicator are not used at all in subsequent processing. Also, if events occur simultaneously for two or more keys,
For example, if a certain key is turned off and another key is turned on at the same time, blocks IBB consisting of indicators and key codes shown in FIG. 3 are provided as many as the keys in which the event occurred.

第4図は第1図に示す楽譜を再び示したもの
で、この図に示す時刻t1〜t3において第1図の場
合と同様に各キーが操作された場合、時刻t1〜t3
において作成されるイベントブロツクIBは各々、
第5図に示すIB−1〜IB−3となる。なお、第
5図におけるタイマデータT1,T2は各々、時刻
t1,t2間の時間および時刻t2,t3間の時間である。
FIG. 4 shows the musical score shown in FIG. 1 again. If each key is operated in the same way as in FIG .
Each event block IB created in
They are IB-1 to IB-3 shown in FIG. Note that timer data T 1 and T 2 in FIG. 5 each indicate time.
These are the time between t 1 and t 2 and the time between t 2 and t 3 .

次に、第2図に示すパラメータ設定装置4は調
名(ハ長調、イ短調等)、テンポ(例えば、4分
音符の長さ)、拍子(4/4拍子等)を各々設定
するためのもので、設定された調名、テンポ、拍
子に対応する調名データ、テンポデータ、拍子デ
ータが各々音符選出処理回路3へ供給される。
Next, the parameter setting device 4 shown in FIG. Key name data, tempo data, and time signature data corresponding to the set key name, tempo, and time signature are each supplied to the note selection processing circuit 3.

音符選出処理回路3は楽器インターフエイス2
から供給されるイベントブロツクIBに基づいて、
ピアノ1の各キーのオン/オフ状態を検知し、こ
の検知結果に基づいて第6図に示すスロツトブロ
ツクSBを作成し、記号組立処理回路5へ出力す
る。
Note selection processing circuit 3 is instrument interface 2
Based on the event block IB supplied by
The on/off state of each key on the piano 1 is detected, and based on the detection result, a slot block SB shown in FIG. 6 is created and output to the symbol assembly processing circuit 5.

以下、この音符選出処理回路3について詳述す
る。例えば第4図に示す楽譜がピアノ1によつて
演奏された場合、第2図に示す楽譜表示装置は、
第4図に示す楽譜をそのまま表示することができ
る。音符選出処理回路3は、この楽譜を表示する
ために必要なデータを、第4図に示すスロツト
S1,S2…毎にスロツトブロツクSBの形で作成す
る。第6図はこのスロツトブロツクSBの基本構
成を示すもので、その第1バイトにはスロツト
S1,S2…のスロツト幅(第4図に示すSL1,SL2
…)が後述する符長コードに変換されて書込ま
れ、また、第2〜第4バイトには各々TYPEデー
タ、長さデータ、キーコードが書込まれる。この
場合、第2〜第4バイトからなるブロツクSBB
は各スロツトS1,S2…内の音符あるいは休符に対
応して設けられ、例えば第4図に示すスロツトS3
の場合は2個の音符に対応してブロツクSBBが
2個設けられ、また、スロツトS2の場合はブロツ
クSBBが1個設けられる。また、TYPEデータ
としては「1」〜「3」のいずれかのデータが書
込まれる。すなわち、ブロツクSBBによつて表
わされるものが音符の場合は「1」が書込まれ、
先行音からの遅れを示す休符(例えば、第4図に
おけるスロツトS1内の休符)の場合は「2」が書
込まれ、また無音状態の休符の場合は「3」が書
込まれる。また、長さデータとしては、音符ある
いは休符の長さに対応する符長コードが書込まれ
る。なお、この実施例においては、全音符(全体
符)、2分音符(2分休符)、4分音符(4分休
符)…の各長さに各々対応して、符長コードLN
1,LN2,LN4…が割当てられている。また、
キーコードとしては、そのブロツクSBBが音符
を表わす場合はその音符のキーコードが書込ま
れ、そのブロツクSBBが休符を表わす場合は、
次の音符のキーコード(TYPEデータが「2」の
場合)あるいは「0」(TYPEデータが「3」の
場合)が書込まれる。
This note selection processing circuit 3 will be described in detail below. For example, when the score shown in FIG. 4 is played on the piano 1, the score display device shown in FIG.
The musical score shown in FIG. 4 can be displayed as is. The note selection processing circuit 3 sends the data necessary for displaying this musical score to the slot shown in FIG.
Create a slot block SB for each S 1 , S 2 . Figure 6 shows the basic configuration of this slot block SB, with a slot in the first byte.
Slot width of S 1 , S 2 ... (SL 1 , SL 2 shown in Fig. 4)
) is converted into a note length code to be described later and written, and TYPE data, length data, and key code are written in the second to fourth bytes, respectively. In this case, the block SBB consisting of the 2nd to 4th bytes
are provided corresponding to the notes or rests in each slot S 1 , S 2 . . . For example, slot S 3 shown in FIG.
In the case of slot S2, two blocks SBB are provided corresponding to two notes, and in the case of slot S2 , one block SBB is provided. Further, as the TYPE data, any one of "1" to "3" is written. That is, if what is represented by block SBB is a musical note, "1" is written,
A ``2'' is written for a rest that is delayed from the preceding note (for example, the rest in slot S 1 in Figure 4), and a ``3'' is written for a rest that is silent. It will be done. Further, as length data, a note length code corresponding to the length of a note or rest is written. In addition, in this embodiment, note length codes LN are set corresponding to each length of a whole note (whole note), a half note (half note), a quarter note (quarter rest), etc.
1, LN2, LN4... are assigned. Also,
As for the key code, if the block SBB represents a note, the key code of that note is written, and if the block SBB represents a rest, the key code of that note is written.
The key code of the next note (if the TYPE data is "2") or "0" (if the TYPE data is "3") is written.

次に上述したスロツトブロツクSBの作成課程
を第7図に示すフローチヤートを参照して説明す
る。
Next, the process of creating the slot block SB mentioned above will be explained with reference to the flowchart shown in FIG.

例えば、第4図に示す時刻t1において第5図に
示すイベントブロツクIB−1が作成され、音符
選出処理回路3へ供給されると、このイベントブ
ロツクIB−1が第7図に示すステツプSP1で検出
され、ステツプSP2の処理へ進む。ステツプSP2
では、音符選出処理回路3の内部に設けられたメ
モリM(第8図参照)のエリアE1a〜E5a内のデー
タにイベントブロツクIB−1のタイマデータが
加算される。なお、メモリMは初期状態において
クリアされている。また、上述した加算はエリア
E1b〜E5bの内のいずれかにデータ(キーコード)
が記憶されている場合にのみ行われる。したがつ
て、この時点では実際の加算は行われない。次
に、ステツプSP3に進み、キーオンがあるか否
か、すなわち、イベントブロツクIB−1内にイ
ンデイケータの第7ビツトが“1”のブロツク
IBBがあるか否かが判断される。この場合、判断
結果は「YES」であり、したがつてステツプSP4
へ進む。ステツプSP4では、先行音がありか否か
が判断される。ここで、後述するように、現在押
下中のキーのキーコードは全てメモリMのエリア
E1b〜E5bのいずれかに登録されるようになつてい
る。したがつて、このステツプSP4ではエリア
E1b〜E5bが走査される。この場合、E1b〜E5b
は、いずれもキーコードが書込まれておらず、し
たがつて先行音なしと判断され、ステツプSP5
進む。ステツプSP5では、イベントブロツクIB−
1に基づいてスロツトS1(第4図)に対応するス
ロツトブロツクSB−1(第8図)の作成が行わ
れる。すなわち、エリアE2にTYPEデータとし
て「1」が書込まれ、エリアE4にキーC3のキ
ーコードが書込まれる。そして、ステツプSP6
進む。ステツプSP6ではキーオンのブロツクIBB
内のキーコードがエリアE1b〜E5bに登録される。
この場合、キーC3のキーコードがエリアE1b
登録される。なお、キーオンのブロツクIBBがな
い場合は何の処理も行われない。次にステツプ
SP7へ進むと、オフとされたキーのキーコードが
エリアE1b〜E5bから消去される。この場合、イベ
ントブロツクIB−1にはキーオフのブロツク
IBBがなく、したがつて、ステツプSP7を通過
し、ステツプSP8へ進む。ステツプSP8では、メ
モリM内のスロツトブロツクSBが完成したか否
かが判断される。この場合、スロツトブロツク
SB−1は完成しておらず、したがつて、再びス
テツプSP1へ戻る。
For example, when the event block IB- 1 shown in FIG. 5 is created at time t1 shown in FIG. 1 is detected and the process proceeds to step SP2 . Step SP 2
Then, the timer data of the event block IB-1 is added to the data in the areas E1a to E5a of the memory M (see FIG. 8) provided inside the note selection processing circuit 3. Note that the memory M is cleared in the initial state. In addition, the addition mentioned above is
Data (key code) in one of E 1b to E 5b
This is done only if the is stored. Therefore, no actual addition is performed at this point. Next, proceed to step SP3 , and check whether there is a key-on or not, that is, if there is a block whose 7th bit of the indicator is "1" in event block IB-1.
It is determined whether or not IBB is present. In this case, the decision result is ``YES'', so step SP 4
Proceed to. In step SP4 , it is determined whether or not there is a preceding sound. Here, as described later, all the key codes of the keys currently being pressed are stored in the memory M area.
It is now registered as one of E 1b to E 5b . Therefore, in this step SP 4 , the area
E 1b to E 5b are scanned. In this case, no key code is written in any of E 1b to E 5b , so it is determined that there is no preceding tone, and the process advances to step SP5 . In step SP 5 , the event block IB-
1, a slot block SB-1 (FIG. 8) corresponding to slot S 1 (FIG. 4) is created. That is, "1" is written as the TYPE data in area E2 , and the key code of key C3 is written in area E4 . Then proceed to step SP 6 . Key-on block IBB in step SP 6
The key codes within are registered in areas E 1b to E 5b .
In this case, the key code of key C3 is registered in area E 1b . Note that if there is no key-on block IBB, no processing is performed. Next step
When proceeding to SP 7 , the key codes of the keys that have been turned off are erased from areas E 1b to E 5b . In this case, event block IB-1 has a key-off block.
There is no IBB, so step SP 7 is passed and step SP 8 is proceeded to. At step SP8 , it is determined whether the slot block SB in the memory M is completed. In this case, the slot block
SB-1 is not completed, so the process returns to step SP1 again.

次に、時刻t2においてイベントブロツクIB−2
が供給されると、まず、ステツプSP2において、
キーコードが書込まれているエリアE1bに対応す
るエリアE1a内のデータにイベントブロツクIB−
2のタイマデータ「T1」が加算され、この結果、
エリアE1a内のデータが「T1」となる。次に、ス
テツプSP3を介してステツプSP4へ進み、このス
テツプSP4において先行音の有無が判断される。
この場合、エリアE1bに先行音C3のキーコード
が記憶されており、したがつてステツプSP9へ進
む。ステツプSP9では、先行音からの遅れ時間
Tdと予め設定されている設定時間Tcとが比較さ
れる。ここで、先行音からの遅れ時間Tdは、先
行音のキーコードが記憶されているエリアE1b
対応するエリアE1aに記憶されている。すなわち、
この場合Td=T1である。また、設定時間Tcとし
ては、この実施例においては32分休符に対応する
時間より大きく、16分休符に対応する時間より小
さい時間が設定されている。そして、この場合デ
ータT1が4分音符の時間に対応していることか
ら、Td>Tcであり、ステツプSP10へ進む。ステ
ツプSP10では、先行音からの遅れ時間Td(=T1
に対応する休符(第4図に示すスロツトS1内の休
符)を表示するためのブロツクSBB−2が、先
行音C2のスロツトブロツクSB−1内に作成さ
れる。すなわち、エリアE5にTYPEデータ「2」
が書込まれ、エリアE6に時間T1に対応する符長
コードLN4が書込まれ、また、エリアE7にキー
C4(後続音)のキーコードが書込まれる。な
お、エリアE7のキーコードはブロツクSBB−2
によつて表わされる休符の表示位置を決めるため
のものである。そして、ステツプSP5へ進む。ス
テツプSP5ではイベントブロツクIB−2に基づい
てスロツトブロツクSBの作成が行われる。すな
わち、まず、タイマデータT1に対応する符長コ
ードLN4がスロツト幅としてスロツトブロツク
SB−1のエリアE1に書込まれる。次に、スロツ
トS2(第4図)に対応するスロツトブロツクSB−
2のエリアE9にTYPEデータ「1」が、また、
エリアE11にキーC4のキーコードが書込まれる。
次いで、ステツプSP6において新たにオンとなつ
たキーC4のキーコードがエリアE2bに書込まれ、
ステツプSP7,SP8を介してステツプSP1へ戻る。
Next, at time t2 , event block IB-2
is supplied, first, in step SP 2 ,
Event block IB-
2 timer data “T 1 ” is added, and as a result,
The data in area E 1a becomes "T 1 ". Next, the process advances to step SP4 via step SP3 , and in this step SP4 it is determined whether there is a preceding sound.
In this case, the key code of the preceding tone C3 is stored in area E1b , and the process therefore advances to step SP9 . In step SP 9 , the delay time from the preceding tone is
Td and a preset time Tc are compared. Here, the delay time Td from the preceding sound is stored in area E 1a corresponding to area E 1b where the key code of the preceding sound is stored. That is,
In this case Td= T1 . Furthermore, in this embodiment, the set time Tc is set to be larger than the time corresponding to a 32nd minute rest and smaller than the time corresponding to a 16th minute rest. In this case, since the data T1 corresponds to the time of a quarter note, Td>Tc, and the process advances to step SP10 . At step SP 10 , the delay time Td (=T 1 ) from the preceding sound
A block SBB-2 for displaying the rest corresponding to (the rest in slot S1 shown in FIG. 4) is created in slot block SB-1 of the preceding tone C2. In other words, TYPE data "2" in area E 5
is written, the note length code LN4 corresponding to time T1 is written in area E6 , and the key code of key C4 (subsequent note) is written in area E7 . The key code for area E 7 is block SBB-2.
This is to determine the display position of the rest represented by . Then proceed to step SP 5 . In step SP5 , a slot block SB is created based on event block IB-2. That is, first, note length code LN4 corresponding to timer data T1 is used as the slot width.
Written to area E1 of SB-1. Next, slot block SB- corresponding to slot S2 (Fig. 4)
TYPE data “1” is in area E 9 of 2, and
The key code of key C4 is written in area E11 .
Next, in step SP 6 , the key code of key C4, which is newly turned on, is written in area E 2b .
Return to step SP 1 via steps SP 7 and SP 8 .

次に、時刻t3においてイベントブロツクIB−3
が供給されると、まず、タイマデータT2がエリ
アE1a,E2a内のデータに各々加算され(ステツプ
SP2)、この結果、エリアE1a,E2a内のデータが
各々(T1+T2)、T2となる。次に、ステツプSP3
を介してステツプSP4へ進むと、先行音の有無が
判断される。この場合、エリアE1b,E2bに各々先
行音C3,C4が登録されているが、イベントブ
ロツクIB−3にはこれらの先行音C3,C4の
オフを示すブロツクIBB−1,IBB−2が含まれ
ており、したがつて、先行音なしと判断され、ス
テツプSP5へ進む。ステツプSP5では、まずタイ
マデータT2に対応する符長コードLN4がスロツ
トブロツクSB−2のエリアE8にスロツト幅とし
て書込まれる。次いで、キーC3オフを示すブロ
ツクIBB−1に基づいて、エリアE1a内のデータ
(T1+T2)(このデータはキーC3のオン時間を
示す)に対応する符長コードLN2がエリアE3
書込まれる。次いで、キーC4オフを示すブロツ
クIBB−2に基づいて、エリアE2a内のデータT2
に対応する符長コードLN4がエリアE10に書込ま
れる。次に、キーD5,E4オンを示すブロツク
IBB−3,IBB−4に基づいてスロツトS3に対応
するスロツトブロツクSB−3(第8図)が作成
される。そして、ステツプSP6へ進む。
Next, at time t3 , event block IB-3
is supplied, first, timer data T 2 is added to the data in areas E 1a and E 2a (step
SP 2 ), and as a result, the data in areas E 1a and E 2a become (T 1 +T 2 ) and T 2 , respectively. Next, step SP 3
When the process proceeds to step SP4 via , it is determined whether there is a preceding sound. In this case, the preceding sounds C3 and C4 are registered in areas E 1b and E 2b, respectively, but the event block IB-3 contains blocks IBB-1 and IBB-2 indicating that these preceding sounds C3 and C4 are off. Therefore, it is determined that there is no preceding sound, and the process proceeds to step SP5 . At step SP5 , the code length code LN4 corresponding to the timer data T2 is first written into the area E8 of the slot block SB-2 as the slot width. Next, based on the block IBB-1 indicating that the key C3 is off, the note length code LN2 corresponding to the data (T 1 + T 2 ) in the area E 1a (this data indicates the on time of the key C3) is assigned to the area E 3 . written to. Then, based on block IBB-2 indicating key C4 OFF, data T 2 in area E 2a is
The note length code LN4 corresponding to is written in area E10 . Next, a block indicating keys D5 and E4 are turned on.
Slot block SB-3 (FIG. 8) corresponding to slot S3 is created based on IBB- 3 and IBB-4. Then proceed to step SP 6 .

ステツプSP6では、新たに押下されたキーD
5,E4のキーコードが各々、エリアE3b,E4b
登録される。次いで、ステツプSP7へ進むと、オ
フとされたキーC3,C4のキーコードが登録さ
れているエリアE1b,E2bが共にクリアされ、ま
た、同時にエリアE1a,E2aもクリアされる。次
に、ステツプSP8へ進むと、この時点でスロツト
ブロツクSB−1,SB−2が共に完成しているこ
とから、ステツプSP8での判断結果は「YES」で
あり、ステツプSP11へ進む。ステツプSP11では
完成したスロツトブロツクSB−1,SB−2が順
次記号組立処理回路5(第1図)へ送出される。
そして、ステツプSP1へ戻る。以下、同様の過程
により、ピアノ1の演奏に従つて順次スロツトブ
ロツクSBが作成され、記号組立処理回路5へ送
出される。
In step SP 6 , the newly pressed key D
Key codes 5 and E4 are registered in areas E 3b and E 4b , respectively. Next, when the process advances to step SP7 , areas E 1b and E 2b in which the key codes of keys C3 and C4 that have been turned off are registered are both cleared, and at the same time, areas E 1a and E 2a are also cleared. Next, when the process advances to step SP8 , since both slot blocks SB-1 and SB-2 have been completed at this point, the judgment result at step SP8 is "YES", and the process advances to step SP11 . At step SP11 , the completed slot blocks SB-1 and SB-2 are sequentially sent to the symbol assembly processing circuit 5 (FIG. 1).
Then, return to step SP 1 . Thereafter, slot blocks SB are sequentially created in accordance with the performance of the piano 1 through the same process, and sent to the symbol assembly processing circuit 5.

なお、前述した時間Tcとして、32分休符の時
間より大きく、16分休符の時間より小さい時間が
設定されている意味は、遅れ時間Tdが16分休符
の時間以上の場合にのみ、休符表示をするという
ことである。したがつて、遅れ時間Tdが32分休
符の時間以下の場合は休符表示が行われない。
Note that the above-mentioned time Tc is set to a time greater than the time of a 32nd rest but less than the time of a 16th minute rest.The meaning of the time Tc set above is that only when the delay time Td is greater than or equal to the time of a 16th minute rest. This means that a rest is displayed. Therefore, if the delay time Td is less than the time of a 32nd minute rest, no rest is displayed.

次に、記号組立処理回路5は、音符選出処理回
路3から供給される各スロツトブロツクSBに対
応して、音符、休符等を表示するための表示ブロ
ツクHB(第9図参照)を作成し、音符表示処理
回路6へ出力する。ここで、この表示ブロツク
HBは、第9図に示すように最低4バイトから構
成され、その第1バイトには供給されたスロツト
ブロツクSBのスロツト幅が書込まれ、第2バイ
ト〜第4バイトには各々X座標、Y座標、UDS
コードが書込まれる。また、第2〜第4バイトか
らなるブロツクHBBはスロツトブロツクSBのブ
ロツクSBBに対応して設けられる。この表示ブ
ロツクHBにおいて、X座標としては第4図に示
すスロツトS1,S2…内における音符あるいは休符
のX方向(横方向)の位置を示すデータが書込ま
れる。このX方向の位置は、通常、スロツトS1
S2…の左端から一定距離の位置である。また、Y
座標としては、スロツトS1,S2…内におけるY方
向(たて方向)の位置を示すデータが書込まれ
る。このY方向の位置は、音符の場合はスロツト
ブロツクSBのブロツクSBB内のキーコードによ
つて決定され、先行音からの遅れを示す休符(例
えば、スロツトS1における休符)の場合は、次の
音符C4のキーコードによつて決定され、また、
無音状態の休符の場合は、予め定められた一定位
置となる。
Next, the symbol assembly processing circuit 5 creates display blocks HB (see FIG. 9) for displaying notes, rests, etc., corresponding to each slot block SB supplied from the note selection processing circuit 3. It is output to the note display processing circuit 6. Now this display block
HB consists of at least 4 bytes as shown in FIG. 9, the slot width of the supplied slot block SB is written in the first byte, and the X coordinate and Y coordinate are written in the second to fourth bytes, respectively. Coordinates, UDS
Code is written. Furthermore, block HBB consisting of the second to fourth bytes is provided corresponding to block SBB of slot block SB. In this display block HB, data indicating the position of a note or rest in the X direction (horizontal direction) within the slots S 1 , S 2 . . . shown in FIG. 4 is written as the X coordinate. This position in the X direction is usually the slot S 1 ,
It is a position a certain distance from the left end of S 2 .... Also, Y
As the coordinates, data indicating the position in the Y direction (vertical direction) within the slots S 1 , S 2 . . . is written. In the case of a note, this position in the Y direction is determined by the key code in block SBB of slot block SB, and in the case of a rest that is delayed from the preceding note (for example, the rest in slot S 1 ), it is determined by the key code in block SBB of slot block SB. is determined by the key code of note C4, and
In the case of a silent rest, it is at a predetermined fixed position.

また、UDSコードとは音符、休符、臨時記号
等(これらを総称して音楽記号という)の種類を
を示すコードである。すなわち、第2図に示すメ
モリ7内には予め全ての音楽記号がベクトルによ
つて記憶されている。例えば、4分音符は第10
図に示すベクトルV1,V2…の各始点および終点
の座標によつて記憶され、また、2分音符は同図
に示すベクトルV11,V12…の各始点および終点
の座標によつて記憶されている。
Furthermore, the UDS code is a code that indicates the type of musical note, rest, accidental symbol, etc. (these are collectively referred to as musical symbols). That is, all musical symbols are stored in advance in the form of vectors in the memory 7 shown in FIG. For example, a quarter note is the 10th note.
The coordinates of the starting and ending points of the vectors V 1 , V 2 . remembered.

そして、記号組立処理回路5は、供給されたス
ロツトブロツクSBのブロツクSBBが音符を表わ
している場合は、その長さデータに基づいて音符
の種類を検知し、この検知結果に対応するUDS
コードを表示ブロツクHBに書込む。また、スロ
ツトブロツクSBのブロツクSBBが休符を表わし
ている場合は、ブロツクSBBの長さデータに基
づいて休符の種類を検知し、この検知結果に対応
するUDSコードを表示ブロツクHBに書込む。
Then, if the block SBB of the supplied slot block SB represents a musical note, the symbol assembly processing circuit 5 detects the type of note based on the length data, and creates a UDS corresponding to this detection result.
Write the code to display block HB. If block SBB of slot block SB represents a rest, the type of rest is detected based on the length data of block SBB, and a UDS code corresponding to this detection result is written in display block HB.

なお、臨時記号(例えば、#)が音符に付加さ
れる場合は、この臨時記号を表示するためのブロ
ツクHBBを表示ブロツクHBに付加する。この
場合、付加されるブロツクHBBのX、Y座標に
は各々臨時記号の表示位置に関するデータが書込
まれ、また、臨時記号のUDSコードがUDSコー
ドのエリアに書込まれる。
Note that when an accidental symbol (for example, #) is added to a note, a block HBB for displaying this accidental symbol is added to the display block HB. In this case, data regarding the display position of the accidental is written in each of the X and Y coordinates of the added block HBB, and the UDS code of the accidental is written in the UDS code area.

以上の様に、表示ブロツクHBはスロツトブロ
ツクSBが供給される毎に作成され、また表示ブ
ロツクHBの各ブロツクHBBはスロツトブロツ
クSBの各ブロツクSBBに対応して作成され、さ
らに、臨時記号がある場合は同臨時記号を表示す
るためのブロツクHBBが付加される。そして、
作成された表示ブロツクHBは音符表示処理回路
6へ供給される。
As described above, display block HB is created every time slot block SB is supplied, and each block HBB of display block HB is created corresponding to each block SBB of slot block SB. A block HBB is added to display the accidental. and,
The created display block HB is supplied to the note display processing circuit 6.

音符表示処理回路6は記号組立処理回路5から
供給される表示ブロツクHBのブロツクHBB内
のX、Y座標を表示装置8の画面上のX、Y座標
(以後、X′、Y′座標と称す)に変換し、UDSコー
ドと共に表示装置8へ出力する。すなわち、例え
ば第4図に示す楽譜を表示する場合は、まず、ス
ロツトS1の左端のX′座標(X′−1とする)を設
定し、この座標(X′−1)およびスロツトS1
対応する表示ブロツクHB内のX座標から音符C
3および休符のX′座標を算出する。次いで、上
記表示ブロツクHB内のスロツト幅および座標
(X′−1)からスロツトS1の右端(スロツトS2
左端)のX′座標を求め(X′−2とする)、求めら
れた座標(X′−2)およびスロツトS2に対応す
る表示ブロツクHB内のX座標から音符C4の
X′座標を算出する。以下、同様にして各音符、
休符等のX′座標が求められる。また、各音符等
のY′座標は、五線のY′座標および各表示ブロツ
クHB内のY座標から求められる。そして音符表
示処理回路6は求められた各音符等のX′、Y′座
標をUDSコードと共に表示装置8へ出力する。
The musical note display processing circuit 6 converts the X, Y coordinates in the block HBB of the display block HB supplied from the symbol assembly processing circuit 5 to the X, Y coordinates (hereinafter referred to as X', Y' coordinates) on the screen of the display device 8. ) and output to the display device 8 along with the UDS code. That is, for example, when displaying the musical score shown in Fig. 4, first set the X' coordinate (X'-1) of the left end of slot S1 , and then Note C from the X coordinate in the display block HB corresponding to
3 and the X' coordinate of the rest. Next, the X' coordinate of the right end of slot S1 (left end of slot S2) is determined from the slot width and the coordinate (X'- 1 ) in the display block HB (referred to as X'-2), and the determined coordinate is (X'-2) and the X coordinate in display block HB corresponding to slot S2 to note C4.
Calculate the X′ coordinate. Similarly, each note,
The X' coordinates of rests, etc. can be found. Further, the Y' coordinate of each note, etc. is determined from the Y' coordinate of the staff and the Y coordinate within each display block HB. Then, the note display processing circuit 6 outputs the determined X' and Y' coordinates of each note etc. to the display device 8 together with the UDS code.

表示装置8はCRT(ブラウン管)表示装置(あ
るいはプリンタ)と制御回路を有して構成される
もので、CRT画面上に五線を表示すると共に、
供給されるUDSコードに基づいてメモリ7から
音楽記号を読出し、この音楽記号の各ベクトルを
示す座標を上述したX′、Y′座標に基づいて座標
変換して、CRT画面上等に音楽記号を順次表示
する。
The display device 8 is composed of a CRT (cathode ray tube) display device (or printer) and a control circuit, and displays the musical staff on the CRT screen.
A musical symbol is read from the memory 7 based on the supplied UDS code, coordinates representing each vector of this musical symbol are transformed based on the above-mentioned X', Y' coordinates, and the musical symbol is displayed on a CRT screen, etc. Display sequentially.

なお、第2図に示す回路は通常マイクロコンピ
ユータを用いて構成される。
Note that the circuit shown in FIG. 2 is usually constructed using a microcomputer.

以上説明したように、この発明によれば先行音
に遅れて他の音符が表示される場合に、その音符
の前に先行音からの遅れ時間に対応する休符を表
示するようにしたので、先行音からの遅れ時間を
楽譜上に明確に表示することが可能になる。
As explained above, according to the present invention, when another note is displayed after the preceding note, a rest corresponding to the delay time from the preceding note is displayed before that note. It becomes possible to clearly display the delay time from the preceding note on the musical score.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は楽譜表示の一例を示す図、第2図はこ
の発明の一実施例である楽譜表示装置の構成を示
すブロツク図、第3図イおよびロはイベントブロ
ツクIBの構成を示す図、第4図は第2図に示す
楽譜表示装置による表示例を示す図、第5図はイ
ベントブロツクIBの具体例を示す図、第6図は
スロツトブロツクSBの構成例を示す図、第7図
は第2図における音符選出処理回路3の動作を説
明するためのフローチヤート、第8図は音符選出
処理回路3内に設けられているメモリMの記憶エ
リアを示す図、第9図は表示ブロツクHBの構成
を示す図、第10図は音楽記号を構成する各ベク
トルを示す図である。 2……楽器インターフエイス、3……音符選出
処理回路、5……記号組立処理回路、6……音符
表示処理回路、7……メモリ、8……表示装置、
M……メモリ。
FIG. 1 is a diagram showing an example of a musical score display, FIG. 2 is a block diagram showing the configuration of a musical score display device which is an embodiment of the present invention, FIG. 3 A and B are diagrams showing the configuration of an event block IB, 4 is a diagram showing an example of display by the score display device shown in FIG. 2, FIG. 5 is a diagram showing a specific example of the event block IB, FIG. 6 is a diagram showing an example of the configuration of the slot block SB, and FIG. FIG. 2 is a flowchart for explaining the operation of the note selection processing circuit 3, FIG. 8 is a diagram showing the storage area of the memory M provided in the note selection processing circuit 3, and FIG. 9 is a display block HB. FIG. 10 is a diagram showing the vectors forming the musical symbol. 2... Musical instrument interface, 3... Note selection processing circuit, 5... Symbol assembly processing circuit, 6... Note display processing circuit, 7... Memory, 8... Display device,
M...Memory.

Claims (1)

【特許請求の範囲】[Claims] 1 鍵盤楽器における各キーのオン/オフ時間を
検出し、前記キーのオン時間に基づいて音符を表
示し、前記キーのオフ時間に基づいて休符を表示
する楽譜表示方法において、1のキーのキーオン
が検出された時点で先行音があるか否かを検出
し、前記先行音が検出された場合に、前記先行音
に対応するキーのキーオン時刻と前記1のキーの
キーオン時刻との時間差を検出し、この時間差が
予め設定されている設定値より大の場合に、前記
1のキーに対応して表示される音符の前に前記時
間差に対応する休符を表示することを特徴とする
楽譜表示方法。
1. In a musical score display method that detects the on/off time of each key on a keyboard instrument, displays notes based on the on time of the key, and displays rests based on the off time of the key, At the time when a key-on is detected, it is detected whether or not there is a preceding sound, and when the preceding sound is detected, the time difference between the key-on time of the key corresponding to the preceding sound and the key-on time of the first key is calculated. A musical score characterized in that when the time difference is detected and the time difference is larger than a preset value, a rest corresponding to the time difference is displayed before the note displayed corresponding to the first key. Display method.
JP10783882A 1982-06-18 1982-06-23 Display of musical score Granted JPS58224386A (en)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP10783882A JPS58224386A (en) 1982-06-23 1982-06-23 Display of musical score
US06/504,395 US4506587A (en) 1982-06-18 1983-06-15 Method of processing data for musical score display system

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03193021A (en) * 1989-12-25 1991-08-22 Matsushita Electric Ind Co Ltd vacuum cleaner floor nozzle

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* Cited by examiner, † Cited by third party
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JPH03193021A (en) * 1989-12-25 1991-08-22 Matsushita Electric Ind Co Ltd vacuum cleaner floor nozzle

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