JPH0113569B2 - - Google Patents
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- JPH0113569B2 JPH0113569B2 JP57039074A JP3907482A JPH0113569B2 JP H0113569 B2 JPH0113569 B2 JP H0113569B2 JP 57039074 A JP57039074 A JP 57039074A JP 3907482 A JP3907482 A JP 3907482A JP H0113569 B2 JPH0113569 B2 JP H0113569B2
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- Controls And Circuits For Display Device (AREA)
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Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は、デイスプレイ装置におけるインデイ
ケータ表示を制御するデイスプレイ・インデイケ
ータの制御方式に関する。DETAILED DESCRIPTION OF THE INVENTION [Technical Field of the Invention] The present invention relates to a display indicator control method for controlling indicator display on a display device.
第1図は全体のシステム・ブロツク図である。
1はメイン・ストレージ、2はコントロール・ス
トレージ、3はマイクロプロセツサ、4はデイス
ク制御部、5はデイスク装置、6はフロツピイ・
デイスク制御部、7はフロツピイ・デイスク装
置、8はデイスプレイ制御部、9はデイスプレイ
装置、10はキー・ボード制御部、11はキー・
ボード、12はプリンタ制御部、13はプリンタ
を示す。メイン・ストレージ1には処理プログラ
ムとオペレーテイング・システムが格納され、コ
ントロール・ストレージ2にはマイクロプログラ
ムが格納される。マイクロプロセツサ3にはデー
タ・バスが接続される。データ・バスにはデイス
ク制御部4、フロツピイ・デイスタ制御部6、デ
イスプレイ制御部8、キー・ボード制御部10そ
してプリンタ制御部12等が接続される。デイス
ク制御部4の出力はデイスク装置5に接続され、
フロツピイ・デイスク制御部6の出力はフロツピ
イ・デイスク装置7に接続され、デイスプレイ制
御部8の出力はデイスプレイ装置9に接続され、
キー・ボード制御部10の出力キー・ボード11
に接続され、プリンタ制御部12の出力はプリン
タ13に接続される。データ・バスに接続された
これらの各制御部は、処理プログラム、オペレー
テング・システム、マイクロプログラムにしたが
つてマイクロプロセツサ3から制御される。デイ
スプレイ制御部8は文字コードを格納するデイス
プレイ・メモリと文字パターンを格納するキヤラ
クタ・ゼネレータを有し、マイクロプロセツサ3
からの制御に基いてデイスプレイ装置9への表示
を行う。
FIG. 1 is an overall system block diagram.
1 is the main storage, 2 is the control storage, 3 is the microprocessor, 4 is the disk control unit, 5 is the disk device, and 6 is the floppy disk drive.
7 is a floppy disk device; 8 is a display control portion; 9 is a display device; 10 is a keyboard control portion; 11 is a key board control portion;
12 is a printer control unit, and 13 is a printer. Main storage 1 stores processing programs and an operating system, and control storage 2 stores microprograms. A data bus is connected to the microprocessor 3. A disk control section 4, a floppy disk drive control section 6, a display control section 8, a keyboard control section 10, a printer control section 12, etc. are connected to the data bus. The output of the disk control unit 4 is connected to the disk device 5,
The output of the floppy disk control section 6 is connected to the floppy disk device 7, the output of the display control section 8 is connected to the display device 9,
Output keyboard 11 of keyboard control section 10
The output of the printer control section 12 is connected to the printer 13. Each of these control units connected to the data bus is controlled by the microprocessor 3 according to the processing program, operating system, and microprogram. The display control unit 8 has a display memory for storing character codes and a character generator for storing character patterns, and the microprocessor 3
Display on the display device 9 is performed based on the control from.
従来のデイスプレイ装置におけるインデイケー
タ表示方式は、キヤラクタ・ゼネレータとは別に
インデイケータ・パターンをROM(リード・オ
ンリ・メモリ)等に格納し、表示位置の制御とし
ては行カウンタ及び列カウンタを特別にデコード
する方式、或はデイスプレイ・メモリに特殊フラ
グを設け、デイスプレイ・メモリにインデイケー
タ・コードを格納する方式がある。しかしながら
これらの方法はいずれもハードウエアが特別に必
要になるという欠点がある。 The indicator display method in conventional display devices is a method in which the indicator pattern is stored in a ROM (read-only memory), etc. separately from the character generator, and the display position is controlled by specially decoding the row counter and column counter. Alternatively, there is a method in which a special flag is provided in the display memory and an indicator code is stored in the display memory. However, both of these methods have the disadvantage of requiring special hardware.
本発明は上記の欠点を排除するものであつて、
インデイケータ・パターンを特別のハードウエア
として持たず、従来の文字キヤラクタ・ゼネレー
タの中にインデイケータ・パターンを書込み、文
字キヤラクタ・ゼネレータを利用してインデイケ
ータを表示することができるようにすることを目
的とする。
The present invention eliminates the above-mentioned drawbacks and includes:
The purpose is to write the indicator pattern into a conventional character character generator and to display the indicator using the character character generator without having the indicator pattern as special hardware. .
上記目的を達成するため、本発明のデイスプレ
イ・インデイケータ制御方式は、上位装置から送
られてきたデイスプレイ装置の1画面の文字コー
ドを格納するデイスプレイ・メモリと、文字コー
ドに対応する文字パターンを格納するキヤラク
タ・ゼネレータと、デイスプレイ制御回路とを有
し、上記デイスプレイ制御回路により上記デイス
プレイ・メモリの文字コードを読出し、文字コー
ドに対応する上記キヤラクタ・ゼネレータ内の文
字パターンをデイスプレイ装置の画面に表示する
ようにしたデイスプレイ・システムにおけるデイ
スプレイ・インデイケータ制御方式において、上
記デイスプレイ装置の画面に文字コード表示領域
とハードウエア表示領域とを設けると共に、上記
キヤラクタ・ゼネレータに通常文字とインデイケ
ータ・パターンとを予め格納し、上記キヤラク
タ・ゼネレータにおける通常文字とコードとの関
系をJISコード系又はEBCDICコード系と同一と
し、インデイケータに割当てられるコードを上記
JISコード系又はEBCDICコード系のフアンクシ
ヨン・コード又はインバリツト・コード領域に含
まれるコードを割当てるようにし、上位装置によ
つて上記インデイケータ・パターンを上記ハード
ウエア専用領域に表示するように制御することを
特徴とする。
In order to achieve the above object, the display indicator control method of the present invention includes a display memory that stores the character code of one screen of the display device sent from the host device, and a character pattern corresponding to the character code. It has a character generator and a display control circuit, and the display control circuit reads the character code of the display memory and displays the character pattern in the character generator corresponding to the character code on the screen of the display device. In the display indicator control method in the display system, a character code display area and a hardware display area are provided on the screen of the display device, and normal characters and an indicator pattern are stored in advance in the character generator, The relationship between normal characters and codes in the above character generator is the same as the JIS code system or EBCDIC code system, and the code assigned to the indicator is the above.
A function code of a JIS code system or an EBCDIC code system or a code included in an invariant code area is assigned, and a host device controls the indicator pattern to be displayed in the hardware-dedicated area. shall be.
以下、本発明を図面を参照しつつ説明する。 Hereinafter, the present invention will be explained with reference to the drawings.
第2図は本発明に用いられるデイスプレイ制御
部の具体的な構成の1例を示すブロツク図、第3
図は本発明によるキヤラクタ・ゼネレータにおけ
るコードと文字パターンの関係を示す図、第4図
は本発明による制御の流れを示す図、第5図は処
理プログラムによるデイスプレイ・ライト時にお
けるマイクロプロセツサ側の処理を示すフロー・
チヤート、第6図はインデイケータ制御時におけ
るマイクロプロセツサ側の処理を示すフロー・チ
ヤートである。図において、15はデイスプレイ
制御回路、16はメモリ・アドレス・レジスタ、
17はセレクタ、18はデイスプレイ・メモリ、
20はデイスプレイ・レジスタ、21はキヤラク
タ・ゼネレータ、22はアトリビユート制御回
路、23はシフト・レジスタ、24はビデオ制御
回路、25はバス・イン・レジスタ、14と19
はレシーバ、26はドライバ、27は表示領域、
28はハードウエア専用領域行、29はインデイ
ケータ表示領域を示す。 FIG. 2 is a block diagram showing one example of a specific configuration of a display control section used in the present invention, and FIG.
The figure shows the relationship between codes and character patterns in the character generator according to the present invention, Figure 4 shows the flow of control according to the present invention, and Figure 5 shows the relationship between the code and the character pattern in the character generator according to the present invention. Flow chart showing processing
FIG. 6 is a flow chart showing processing on the microprocessor side during indicator control. In the figure, 15 is a display control circuit, 16 is a memory address register,
17 is a selector, 18 is a display memory,
20 is a display register, 21 is a character generator, 22 is an attribute control circuit, 23 is a shift register, 24 is a video control circuit, 25 is a bus-in register, 14 and 19
is a receiver, 26 is a driver, 27 is a display area,
Reference numeral 28 indicates a hardware-only area row, and 29 indicates an indicator display area.
デイスプレイ制御部8は、第1図の全体のシス
テム・ブロツク図でみたように、データ・バスに
よりマイクロプロセツサ3と接続されるが、内部
の具体的な構成を示したのが第2図である。レシ
ーバ14の入力端子はデータ・バスに接続され、
その出力端子はメモリ・アドレス・レジスタ16
の入力端子とレシーバ19の入力端子とデイスプ
レイ制御回路15の入力端子に接続される。デイ
スプレイ制御回路15のメモリ・アドレス読出端
子はセレクタ17の一方の入力端子に接続され、
ラスター・アドレス読出端子はキヤラクタ・ゼネ
レータ21のラスター・アドレス入力端子に接続
され、同期信号等の出力端子はビデオ制御回路2
4の同期信号等の入力端子に接続される。メモ
リ・アドレス・レジスタ16の出力端子はセレク
タ17の他方の入力端子に接続される。セレクタ
17の出力端子はデイスプレイ・メモリ18のア
ドレス端子に接続される。デイスプレイ・メモリ
18のデータ端子はデイスプレイ・レジスタ20
の入力端子とバス・イン・レジスタ25の入力端
子とレシーバ19の出力端子に接続される。デイ
スプレイ・レジスタ20の出力端子はキヤラク
タ・ゼネレータ21の入力端子とアトリビユート
制御回路22の入力端子に接続される。キヤラク
タ・ゼネレータ21の出力端子はシフト・レジス
タ23の入力端子に接続される。シフト・レジス
タ23の出力端子はビデオ制御回路24の表示ド
ツト・データ入力端子に接続される。アトリビユ
ート制御回路22の出力端子はビデオ制御回路2
4のアトリビユート信号等の入力端子に接続され
る。バス・イン・レジスタ25の出力端子はドラ
イバ26の入力端子に接続される。ドライバ26
の出力端子はデータ・バスに接続される。キヤラ
クタ・ゼネレータ21には第3図に示すコード表
にしたがつて文字パターンが格納されている。 The display control section 8 is connected to the microprocessor 3 via a data bus, as shown in the overall system block diagram of FIG. 1, but FIG. 2 shows the specific internal configuration. be. An input terminal of receiver 14 is connected to a data bus;
Its output terminal is memory address register 16
, an input terminal of the receiver 19 , and an input terminal of the display control circuit 15 . A memory address read terminal of the display control circuit 15 is connected to one input terminal of the selector 17,
The raster address read terminal is connected to the raster address input terminal of the character generator 21, and the output terminal for synchronization signals etc. is connected to the video control circuit 2.
It is connected to the input terminal for the synchronization signal, etc. of No. 4. The output terminal of memory address register 16 is connected to the other input terminal of selector 17. The output terminal of selector 17 is connected to the address terminal of display memory 18. The data terminal of display memory 18 is connected to display register 20.
, the input terminal of the bus-in register 25 , and the output terminal of the receiver 19 . The output terminal of display register 20 is connected to the input terminal of character generator 21 and the input terminal of attribute control circuit 22. The output terminal of character generator 21 is connected to the input terminal of shift register 23. The output terminal of shift register 23 is connected to the display dot data input terminal of video control circuit 24. The output terminal of the attribute control circuit 22 is connected to the video control circuit 2.
It is connected to the input terminal for the attribute signal, etc. of No. 4. The output terminal of bus-in register 25 is connected to the input terminal of driver 26. driver 26
The output terminal of is connected to the data bus. The character generator 21 stores character patterns according to the code table shown in FIG.
第2図のデイスプレイ制御部におけるデイスプ
レイ制御の概要を説明する。まずメモリ・アドレ
ス・レジスタ16にデイスプレイ・メモリ・アド
レスがセツトされる。デイスプレイ・メモリ・デ
ータがレシーバ19を介してデイスプレイ・メモ
リ18に格納される。データの格納されるデイス
プレイ・メモリ18のアドレスはメモリ・アドレ
ス・レジスタ16により指定される。デイスプレ
イ・メモリ18にデータを格納し終わりデイスプ
レイ制御回路15に起動指令がかかると、デイス
プレイ制御回路15からのメモリ・アドレス信号
MAOないしMANによりデイスプレイ・メモリ
18の内容が順次読出されデイスプレイ・レジス
タ20にセツトされる。デイスプレイ・レジスタ
20の内容とデイスプレイ制御回路15からのラ
スター・アドレスRA0ないしRA4にしたがつて
文字パターン・データ(行エレメント)がキヤラ
クタ・ゼネレータ21からシフト・レジスタ23
へ供給される。キヤラクタ・ゼネレータ21から
の文字パターン・データはシフト・レジスタ23
でシリアルな表示ドツト・データに変換され、ビ
デオ制御回路24に供給される。シフト・レジス
タ23からのシリアルな表示ドツト・データとデ
イスプレイ制御回路15からの同期信号がビデオ
制御回路24に入力され、ビデオ制御回路24の
出力によりデイスプレイ表示が行われる。バス・
イン・レジスタ25は、例えばデイスプレイ・メ
モリ18の内容を読出すときに使用される。アト
リビユート制御回路22はデイスプレイ・レジス
タ20に読出されたアトリビユト・コードによつ
て例えばリバースやブリンク等をビデオ制御回路
に指示する。 An overview of display control in the display control section of FIG. 2 will be explained. First, a display memory address is set in the memory address register 16. Display memory data is stored in display memory 18 via receiver 19. The address of display memory 18 where data is stored is specified by memory address register 16. When data is stored in the display memory 18 and a start command is applied to the display control circuit 15, a memory address signal from the display control circuit 15 is sent.
The contents of display memory 18 are sequentially read out and set in display register 20 by MAO or MAN. Character pattern data (row elements) are transferred from character generator 21 to shift register 23 according to the contents of display register 20 and raster addresses RA0 to RA4 from display control circuit 15.
supplied to The character pattern data from the character generator 21 is transferred to the shift register 23.
The data is converted into serial display dot data and supplied to the video control circuit 24. Serial display dot data from the shift register 23 and a synchronization signal from the display control circuit 15 are input to the video control circuit 24, and the output of the video control circuit 24 performs display display. bus·
The in register 25 is used, for example, when reading the contents of the display memory 18. The attribute control circuit 22 instructs the video control circuit to reverse, blink, etc., using the attribute code read into the display register 20.
第3図は本発明によるキヤラクタ・ゼネレータ
におけるコードと文字パターンの関係を示す図で
ある。第3図から判るように、この表はEBCDIC
コード表において従来フアンクシヨン・コード又
はインバリツト・コード領域として割振られてい
る領域をインデイケータ・パターンに割当てるも
のである。即ち第3図の表は16進の上位の桁が横
方向、下位の桁が縦方向を表わしているが横方向
が0ないし3、縦方向が0ないしFの領域はイン
デイケータ・パターンに割当てられ、横方向が4
ないしF、縦方向が0ないしFの領域はEBCDIC
コード体系と同様に通常文字に割当てられる。 FIG. 3 is a diagram showing the relationship between codes and character patterns in the character generator according to the present invention. As you can see from Figure 3, this table is based on EBCDIC
In this method, an area conventionally allocated as a function code or invariant code area in a code table is allocated to an indicator pattern. In other words, in the table of Figure 3, the upper hexadecimal digits represent the horizontal direction and the lower digits represent the vertical direction, and the areas 0 to 3 in the horizontal direction and 0 to F in the vertical direction are assigned to the indicator pattern. , the horizontal direction is 4
to F, areas with vertical direction from 0 to F are EBCDIC
Like the coding system, it is usually assigned to characters.
デイスプレイ装置9は、第4図に示すように、
24行80桁1920字の表示領域27とハードウエア専
用領域行28が設けられる。このハードウエア専
用領域行28は25行目とされる。記号29で示す
ようにこのハードウエア専用領域行28にインデ
イケータ・パターンが表示される。表示領域27
とハードウエア専用領域行28を含めた25行80桁
2000字のデイスプレイ・メモリが用意される。イ
ンデイケータ・コードX▼10▼とX▼20▼が与え
られると、第3図に示すように、システム・アベ
イラブルのインデイケータ表示が行われる。デイ
スプレイ装置にシステム或は他のワーク・ステー
シヨンからメツセージが届いているときのメツセ
ージ受信中のインデイケータ表示はX▼11▼とX
▼21▼のインデイケータ・コードを与えることに
よつて行われる。オペレータのミスやキー・ボー
ドのインプツト・エラー或はキー・ボードの操作
禁示を示す打鍵エラー発生のインデイケータ表示
はX▼13▼とX▼23▼のインデイケータ・コード
を与えることによつて行われる。これらは処理プ
ログラムには関係なく、マイクロプログラムを含
すハードウエア・レベルで行われる。 The display device 9, as shown in FIG.
A display area 27 of 24 lines, 80 columns, and 1920 characters and a hardware-only area line 28 are provided. This hardware-only area row 28 is the 25th row. An indicator pattern is displayed in this hardware-only area row 28, as shown by symbol 29. Display area 27
25 rows and 80 columns including hardware dedicated area row 28
A display memory of 2000 characters is provided. When indicator codes X▼10▼ and X▼20▼ are given, the system availability indicator is displayed as shown in FIG. When the display device receives a message from the system or another work station, the message receiving indicator will display X▼11▼ and X.
This is done by giving the indicator code ▼21▼. The indicator of the occurrence of a keystroke error indicating operator error, keyboard input error, or prohibition of keyboard operation is displayed by giving the indicator codes X▼13▼ and X▼23▼. . These operations are performed at the hardware level, including microprograms, regardless of the processing program.
以下、制御の流れを第4図によつて説明する。
キー・ボード11において、印刷キー押下時はマ
イクロプログラムによりX▼19▼とX▼29▼のイ
ンデイケータ・コードがデイスプレイ・メモリ1
8のハードウエア専用領域行にライトされる。挿
入キー押下時、或は打鍵エラー発生時も同様にし
てX▼12▼とX▼22▼、或はX▼13▼とX▼23▼
のインデイケータ・コードがデイスプレイ・メモ
リ18のハードウエア専用領域行にライトされ
る。ιMPL/ιPL時のデバイス指定のときはマイ
クロプログラムによりX▼16▼とX▼26▼のイン
デイケータ・コードがデスプレイ・メモリ18の
ハードウエア専用領域行にライトされる。フロツ
ピイ・デイスク装置7のメモリ・ダンプ指定のと
きは同様にマイクロプログラムによりX▼15▼と
X▼25▼、X▼17▼とX▼27▼及びX▼18▼とX
▼28▼のインデイケータ・コードがデイスプレ
イ・メモリ18のハードウエア専用領域行にライ
トされる。システム・アベイラブルの状態のとき
はオペレーシヨン・システムよりインデイケー
タ・セツト・コマンドが発行され、マイクロプロ
グラムによりX▼10▼とX▼20▼のインデイケー
タ・コードがデイスプレイ・メモリ18のハード
ウエア専用領域行にライトされる。他のワーク・
ステーシヨン等からメツセージが届いているとき
(メツセージ受信中)もオペレーテング・システ
ムよりインデイケータ・セツト・コマンドが発行
され、マイクロプログラムによりX▼11▼とX▼
21▼のインデイケータ・コードがデイスプレイ・
メモリ18のハードウエア専用領域行にライトさ
れる。このように、オペレーテング・システム、
マイクロプログラム、或はハードウエアの内容に
よりインデイケータ・コードがデイスプレイ・メ
モリ18のハードウエア専用領域行にライトされ
る。 The flow of control will be explained below with reference to FIG.
On the keyboard 11, when the print key is pressed, the indicator codes of X▼19▼ and X▼29▼ are transferred to display memory 1 by the microprogram.
It is written to the hardware-only area row number 8. Similarly, when pressing the insert key or when a keystroke error occurs, press X▼12▼ and X▼22▼, or X▼13▼ and X▼23▼
The indicator code is written to the hardware-only area row of display memory 18. When specifying a device at ιMPL/ιPL, the indicator codes of X▼16▼ and X▼26▼ are written to the hardware-only area row of the display memory 18 by the microprogram. Similarly, when specifying the memory dump of the floppy disk device 7, the microprogram selects X▼15▼ and X▼25▼, X▼17▼ and X▼27▼, and
The indicator code ▼28▼ is written to the hardware-only area row of the display memory 18. When the system is available, the operating system issues an indicator set command, and the microprogram writes the indicator codes X▼10▼ and written. Other work/
Even when a message is received from a station, etc. (while receiving a message), the operating system issues an indicator set command, and the microprogram executes X▼11▼ and X▼
21▼ indicator code is displayed.
It is written to the hardware-dedicated area row of the memory 18. In this way, the operating system,
An indicator code is written to the hardware-dedicated area row of the display memory 18 depending on the contents of the microprogram or hardware.
次に、処理プログラムによつてデイスプレイ・
ライト・マクロが発行されたときにおけるマイク
ロプロセツサの処理の流れを第5図を参照して説
明する。 The processing program then displays the
The flow of processing performed by the microprocessor when a write macro is issued will be explained with reference to FIG.
処理プログラムからコードを受信する。 Receive code from processing program.
受信したコードが横方向が0ないし3、縦方
向が1ないしFの領域の中にあるものかを判定
する。 It is determined whether the received code is within the range of 0 to 3 in the horizontal direction and 1 to F in the vertical direction.
Yesの場合はの処理を行い、Noの場合は
の処理を行う。 If Yes, perform the process; if No, perform the process.
受信したコードが横方向が0ないし3、縦方
向が1ないしFにあるときはそれが制御コード
かどうかを判定する。 If the received code is in the range 0 to 3 in the horizontal direction and 1 to F in the vertical direction, it is determined whether it is a control code.
Yesであればの処理を行い、Noであれば
の処理を行う。 If Yes, perform the process; if No, perform the process.
制御コードにしたがつた制御を実行する。 Execute control according to the control code.
全コードをNull(X▼00▼)に変換してデイ
スプレイ・メモリ18にライトする。 Convert all codes to Null (X▼00▼) and write to display memory 18.
受信したコードをデイスプレイ・メモリにラ
イトする。 Write the received code to display memory.
オペレーテング・システムにおけるイニシヤル
時のJOBメニユー等のときは画面ライト・コマ
ンドが発行され、デイスプレイ制御部のデイスプ
レイ・メモリ18における表示領域にメニユー画
面用の文字コードがライトされる。 In the case of an initial JOB menu or the like in the operating system, a screen write command is issued, and a character code for the menu screen is written into the display area in the display memory 18 of the display control section.
以上の説明から明らかなように、本発明によれ
ば、インデイケータを表示するハードウエア専用
領域を含めたデイスプレイ・メモリを持ち、従来
のキヤラクタ・ゼネレータのフアンクシヨン・コ
ード又はインバリツト・コード領域にインデイケ
ータ・パターンを格納し、ユーザー・プログラム
に対しては、そのコードをデイスプレイ・メモリ
にライトできないようにすると共にインデイケー
タをハードウエア・レベル(マイクロプログラム
を含む。)でのみコントロールし、ライトする。
したがつて、特別なインデイケータ専用のハード
ウエアを持つことなく、ユーザーによりインデイ
ケータ・パターンを表示されることもなく、ハー
ドウエア・レベルで任意なインデイケータを表
示/制御することができる。
As is clear from the above description, the present invention has a display memory including a hardware-dedicated area for displaying an indicator, and displays an indicator pattern in the function code or invariant code area of a conventional character generator. The user program is prevented from writing the code to the display memory, and the indicator is controlled and written only at the hardware level (including microprograms).
Therefore, any indicator can be displayed/controlled at the hardware level without having special hardware dedicated to the indicator and without displaying the indicator pattern by the user.
第1図は全体のシステム・ブロツク図、第2図
は本発明に用いられるデイスプレイ制御部の具体
的な構成の1例を示すブロツク図、第3図は本発
明によるキヤラクタ・ゼネレータにおけるコード
と文字パターンの関係を示す図、第4図は本発明
による制御の流れを示す図、第5図は処理プログ
ラムによるデイスプレイ・ライト時におけるマイ
クロプロセツサ側の処理を示すフロー・チヤー
ト、第6図はインデイケータ制御時におけるマイ
クロプロセツサ側の処理を示すフロー・チヤート
である。
1……メイン・ストレージ、2……コントロー
ル・ストレージ、3……マイクロプロセツサ、4
……デイスク制御部、5……デイスク装置、6…
…フロツピイ・デイスク制御部、7……フロツピ
イ・デイスク装置、8……デイスプレイ制御部、
9……デイスプレイ装置、10……キー・ボード
制御部、11……キー・ボード、12……プリン
タ制御回路、13……プリンタ、15……デイス
プレイ制御回路、16……メモリ・アドレス・レ
ジスタ、17……セレクタ、18……デイスプレ
イ・メモリ、20……デイスプレイ・レジスタ、
21……キヤラクタ・ゼネレータ、22……アト
リビユート制御回路、23……シフト・レジス
タ、24……ビデオ制御回路、25……バス・イ
ン・レジスタ、14と19……レシーバ、26…
…ドライバ、27……表示領域、28……ハード
ウエア専用領域行、29……インデイケータ表示
領域。
Fig. 1 is an overall system block diagram, Fig. 2 is a block diagram showing one example of a specific configuration of a display control section used in the present invention, and Fig. 3 is a code and character in the character generator according to the present invention. Figure 4 is a diagram showing the relationship between patterns, Figure 4 is a diagram showing the flow of control according to the present invention, Figure 5 is a flow chart showing the processing on the microprocessor side when writing the display by the processing program, and Figure 6 is the indicator. This is a flow chart showing processing on the microprocessor side during control. 1... Main storage, 2... Control storage, 3... Microprocessor, 4
...Disk control unit, 5...Disk device, 6...
... Floppy disk control unit, 7... Floppy disk device, 8... Display control unit,
9... Display device, 10... Keyboard control unit, 11... Keyboard, 12... Printer control circuit, 13... Printer, 15... Display control circuit, 16... Memory address register, 17...Selector, 18...Display memory, 20...Display register,
21... Character generator, 22... Attribute control circuit, 23... Shift register, 24... Video control circuit, 25... Bus in register, 14 and 19... Receiver, 26...
... Driver, 27 ... Display area, 28 ... Hardware dedicated area row, 29 ... Indicator display area.
Claims (1)
の1画面の文字コードを格納するデイスプレイ・
メモリと、文字コードに対応する文字パターンを
格納するキヤラクタ・ゼネレータと、デイスプレ
イ制御回路とを有し、上記デイスプレイ制御回路
により上記デイスプレイ・メモリの文字コードを
読出し、文字コードに対応する上記キヤラクタ・
ゼネレータ内の文字パターンをデイスプレイ装置
の画面に表示するようにしたデイスプレイ・シス
テムにおけるデイスプレイ・インデイケータ制御
方式において、上記デイスプレイ装置の画面に文
字コード表示領域とハードウエア表示領域とを設
けると共に、上記キヤラクタ・ゼネレータに通常
文字とインデイケータ・パターンとを予め格納
し、上記キヤラクタ・ゼネレータにおける通常文
字とコードとの関係をJISコード系又はEBCDIC
コード系と同一とし、インデイケータに割当てら
れるコードを上記JISコード系又はEBCDICコー
ド系のフアンクシヨン・コード又はインバリツ
ト・コード領域に含まれるコードを割当てるよう
にし、上位装置によつて上記インデイケータ・パ
ターンを上位ハードウエア専用領域に表示するよ
うに制御することを特徴とするデイスプレイ・イ
ンデイケータ制御方式。1 A display unit that stores the character code for one screen of the display device sent from the host device.
It has a memory, a character generator that stores a character pattern corresponding to the character code, and a display control circuit, and the display control circuit reads out the character code from the display memory and generates the character
In a display indicator control method for a display system in which a character pattern in a generator is displayed on a screen of a display device, a character code display area and a hardware display area are provided on the screen of the display device, and a character code display area and a hardware display area are provided on the screen of the display device. Normal characters and indicator patterns are stored in the generator in advance, and the relationship between the normal characters and codes in the character generator is determined by the JIS code system or EBCDIC.
The code system is the same as the code system, and the code assigned to the indicator is a function code of the above JIS code system or EBCDIC code system, or a code included in the invariant code area, and the above indicator pattern is assigned by the host device. A display indicator control method characterized by controlling the display to be displayed in a wear-only area.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57039074A JPS58158735A (en) | 1982-03-12 | 1982-03-12 | Controlling system of display indicator |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57039074A JPS58158735A (en) | 1982-03-12 | 1982-03-12 | Controlling system of display indicator |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58158735A JPS58158735A (en) | 1983-09-21 |
| JPH0113569B2 true JPH0113569B2 (en) | 1989-03-07 |
Family
ID=12542966
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57039074A Granted JPS58158735A (en) | 1982-03-12 | 1982-03-12 | Controlling system of display indicator |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58158735A (en) |
-
1982
- 1982-03-12 JP JP57039074A patent/JPS58158735A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58158735A (en) | 1983-09-21 |
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