JPH0121698B2 - - Google Patents
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- JPH0121698B2 JPH0121698B2 JP57159308A JP15930882A JPH0121698B2 JP H0121698 B2 JPH0121698 B2 JP H0121698B2 JP 57159308 A JP57159308 A JP 57159308A JP 15930882 A JP15930882 A JP 15930882A JP H0121698 B2 JPH0121698 B2 JP H0121698B2
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
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- H02M3/22—Conversion of DC power input into DC power output with intermediate conversion into AC
- H02M3/24—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters
- H02M3/28—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC
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Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は変動負荷出力チヤネルを含む複数の出
力チヤネルを有する多出力スイツチング電源装置
に関する。TECHNICAL FIELD OF THE INVENTION The present invention relates to a multi-output switching power supply having a plurality of output channels including variable load output channels.
一般にこの種のスイツチング電源装置、例えば
フオワードコンバータ方式のスイツチング電源装
置では、第1図に示されるようにコンバータトラ
ンスTの1次巻線N1にスイツチング用パワート
ランジスタQ1が接続されている。そして、トラ
ンジスタQ1が周期的にオン/オフすることによ
つてコンバータトランスTの2次巻線N2,N3に
発生する交流波形電圧がそれぞれ直流電圧に変換
され、平滑化されることにより、例えば5V、
12V出力が得られるものである。すなわち上記2
次巻線N2に発生する交流波形電圧については、
ダイオードD1,D2を通して直流電圧に変換され、
チヨークコイルL1、コンデンサCF1から成るフイ
ルタによつて平滑化される。同じく2次巻線N3
に発生する交流波形電圧については、ダイオード
D3,D4を通して直流電圧に変換され、チヨータ
コイルL2、コンデンサCF2から成るフイルタによ
つて平滑化される。
Generally, in this type of switching power supply device, for example, a forward converter type switching power supply device, a switching power transistor Q1 is connected to a primary winding N1 of a converter transformer T, as shown in FIG. The alternating current waveform voltages generated in the secondary windings N2 and N3 of the converter transformer T by periodically turning on and off the transistor Q1 are converted into direct current voltage and smoothed. , for example 5V,
It can provide 12V output. In other words, above 2
Regarding the AC waveform voltage generated in the next winding N2 ,
It is converted to DC voltage through diodes D 1 and D 2 ,
It is smoothed by a filter consisting of a choke coil L 1 and a capacitor C F1 . Similarly, secondary winding N 3
For the AC waveform voltage generated in the diode
It is converted into a DC voltage through D 3 and D 4 and smoothed by a filter consisting of a chiyoter coil L 2 and a capacitor C F2 .
また、第1図の例では、特に2次巻線N2側の
5V出力電圧を一定にするための工夫がなされて
いる。これは、上記5V出力電圧をフイードバツ
クし、当該出力電圧と基準電圧との差分を増幅す
る誤差増幅器AV、パルス幅変調器PWM、およ
びドライブ回路Dを介してトランジスタQ1のベ
ースに制御パルスを加えることにより可能とな
る。更に第1図の例では、過負荷時に、トランジ
スタQ1やダイオードD1〜D4等が破壊されること
を防止するための工夫もなされている。これは、
トランジスタQ1のコレクタ電流を電流変成器
(カレントトランス)CTで検出し、所定値以上の
過電流が検出された場合に、過電流保護回路AI
からの要求によりパルス幅変調器PWMを介して
上記制御パルスのパルス幅を狭くするか、或いは
過電流保護回路AIによりトランジスタQ1のスイ
ツチング動作を停止させることにより可能とな
る。 In addition, in the example of Fig. 1, especially the secondary winding N2 side
Efforts have been made to keep the 5V output voltage constant. This feeds back the above 5V output voltage and applies a control pulse to the base of transistor Q1 via an error amplifier AV that amplifies the difference between the output voltage and the reference voltage, a pulse width modulator PWM, and a drive circuit D. This makes it possible. Furthermore, in the example shown in FIG. 1, measures have been taken to prevent the transistor Q1 , diodes D1 to D4 , etc. from being destroyed in the event of overload. this is,
The collector current of transistor Q1 is detected by the current transformer (current transformer) CT, and if an overcurrent exceeding a predetermined value is detected, the overcurrent protection circuit AI
This can be achieved by narrowing the pulse width of the control pulse via the pulse width modulator PWM or by stopping the switching operation of the transistor Q1 by using the overcurrent protection circuit AI.
ここで一般的な過負荷の設定について説明す
る。例えば第1図の例で、5V出力電圧側の負荷
が固定負荷でその負荷電流が5Aであり、これに
対し12V出力電圧側の負荷が変動負荷(パルス負
荷)でその変動負荷電流(パルス負荷電流)I12
が第2図に示されるようにピーク値で2A、平均
値で0.333Aであるものとする。この場合、(5V出
力電圧側の出力電力)+(12V出力電圧側の出力電
力のピーク値)=5(V)×5(A)+12(V)×2(A)=49W
を上まわる値に過負荷(過負荷条件)を設定する
必要がある。このため、第1図のスイツチング電
源装置では、12V出力電圧側が無負荷で5V出力
電圧側が過負荷であるときには、5V出力電圧側
の負荷電流が49(W)/5(V)=9.8A以上に増加しな
いと過電流保護回路AIによる過電流検出/保護
機能が働かない。したがつて、第1図のスイツチ
ング電源装置では、5V出力電圧側の2次巻線N2
やダイオードD1,D2等の定格電流容量を定格出
力電流の約2倍のものとしなければならず、これ
らの部品定格が大きくなる欠点があつた。これ
は、上述の場合と逆に、5V出力電圧側が無負荷
で12V出力電圧側が過負荷のときも同様であり、
このときには12V出力電圧側の2次巻線N3やダ
イオードD3,D4等の定格を大きくする必要があ
る。 Here, general overload settings will be explained. For example, in the example shown in Figure 1, the load on the 5V output voltage side is a fixed load and its load current is 5A, whereas the load on the 12V output voltage side is a variable load (pulse load) and its variable load current (pulse load). Current) I 12
As shown in Figure 2, the peak value is 2A and the average value is 0.333A. In this case, (output power on the 5V output voltage side) + (peak value of output power on the 12V output voltage side) = 5 (V) x 5 (A) + 12 (V) x 2 (A) = 49W
It is necessary to set the overload (overload condition) to a value greater than . Therefore, in the switching power supply shown in Figure 1, when there is no load on the 12V output voltage side and overload on the 5V output voltage side, the load current on the 5V output voltage side will be 49 (W) / 5 (V) = 9.8 A or more. The overcurrent detection/protection function by the overcurrent protection circuit AI will not work unless the voltage increases. Therefore, in the switching power supply shown in Fig. 1, the secondary winding N 2 on the 5V output voltage side
The rated current capacity of the diodes D 1 , D 2 , etc. must be approximately twice the rated output current, which has the disadvantage that the ratings of these components become large. This is the same when the 5V output voltage side is unloaded and the 12V output voltage side is overloaded, contrary to the above case.
In this case, it is necessary to increase the ratings of the secondary winding N3 , diodes D3 , D4, etc. on the 12V output voltage side.
このような問題を解消する方法として、電流変
成器CTの出力信号を積分回路を通して遅延させ
ることにより、第2図に示したパルス負荷電流
I12のピーク値(1msのパルス)に応じないよ
うにすることが考えられる。しかし、この方法で
は、コンバータトランスTの飽和等によるトラン
ジスタQ1のコレクタ電流の急上昇を検出するこ
とが困難となり、トランジスタQ1のターンオフ
時のスイツチング損失が増大してトランジスタ
Q1の熱破壊を招く恐れがある。 As a way to solve this problem, by delaying the output signal of the current transformer CT through an integrating circuit, the pulse load current shown in Figure 2 can be adjusted.
It is possible to avoid responding to the peak value of I 12 (1 ms pulse). However, with this method, it is difficult to detect a sudden increase in the collector current of transistor Q1 due to saturation of converter transformer T, etc., and the switching loss when turning off transistor Q1 increases, causing the transistor to turn off.
There is a risk of thermal destruction of Q1 .
本発明は上記事情に鑑みてなされたもので、そ
の目的は、過負荷検出条件を変動負荷出力チヤネ
ルを含む各出力チヤネルの平均電力の総和に極力
近付けることができる多出力スイツチング電源装
置を提供することにある。
The present invention has been made in view of the above circumstances, and its purpose is to provide a multi-output switching power supply device that can bring the overload detection condition as close as possible to the sum of the average power of each output channel including variable load output channels. There is a particular thing.
本発明は変動負荷出力チヤネル側に設けられた
直流電圧平滑用の第1のフイルタ回路に電流制限
抵抗とエネルギ蓄積用のコンデンサからなる第2
のフイルタ回路を接続し、負荷変動によつて第1
のフイルタ回路のチヨークコイルを流れる電流が
大きく変動するのを上記電流制限抵抗によつて抑
え、すなわち電流制限抵抗によつて変動のピーク
値を下げるようにしたものである。これによりコ
ンバータトランスの2次側電流、すなわちコンバ
ータトランスの1次側電流が負荷変動に影響され
ず平坦になり、過電流設定に当つて従来のように
変動負荷電流のピーク値を考慮する必要がなく過
電流設定値をほぼ平均電流に近付けることができ
る。そして、本発明では、電流制限抵抗によつて
変動負荷電流の平均値に近い平坦な小電流を流し
ていても、上記コンデンサに蓄積されたエネルギ
が一部放出されることによつて変動負荷にパルス
状の電流が流れるので変動負荷を駆動するのに何
ら支障がないようになつている。
The present invention provides a first filter circuit for DC voltage smoothing provided on the fluctuating load output channel side, and a second filter circuit consisting of a current limiting resistor and an energy storage capacitor.
A filter circuit is connected, and the first
The current limiting resistor suppresses large fluctuations in the current flowing through the choke coil of the filter circuit, that is, the current limiting resistor lowers the peak value of the fluctuation. As a result, the secondary current of the converter transformer, that is, the primary current of the converter transformer, becomes flat without being affected by load fluctuations, and it is no longer necessary to consider the peak value of fluctuating load current when setting overcurrent, as in the past. The overcurrent setting value can be brought close to the average current without any problem. In the present invention, even if a small flat current close to the average value of the fluctuating load current is flowing through the current limiting resistor, a part of the energy stored in the capacitor is released, so that the fluctuating load Since a pulsed current flows, there is no problem in driving a variable load.
以下、本発明の一実施例を図面を参照して説明
する。なお、第1図と同一部分には同一符号を付
して詳細な説明を省略する。第3図の多出力スイ
ツチング電源装置において、RSは12V出力回路に
直列に接続された電流制限抵抗、REGは出力電
圧安定化用3端子レギユレータである。3端子レ
ギユレータREGは例えば東京芝浦電気株式会社
製のTA78012Pである。CSは3端子レギユレータ
REGの発振を防止するために当該レギユレータ
REGの入力端子、共通端子間に介挿されるコン
デンサ、COは変動負荷にパルス電流を供給する
ためのエネルギー蓄積用コンデンサである。この
コンデンサCOはレギユレータREGの出力端子、
共通端子間に、すなわち負荷(図示せず)と並列
に設けられている。
Hereinafter, one embodiment of the present invention will be described with reference to the drawings. Note that the same parts as in FIG. 1 are given the same reference numerals and detailed explanations are omitted. In the multi-output switching power supply shown in FIG. 3, R S is a current limiting resistor connected in series to the 12V output circuit, and REG is a three-terminal regulator for stabilizing the output voltage. The three-terminal regulator REG is, for example, TA78012P manufactured by Tokyo Shibaura Electric Co., Ltd. C S is a 3-terminal regulator
the regulator to prevent REG oscillation.
The capacitor C O inserted between the REG input terminal and the common terminal is an energy storage capacitor that supplies pulsed current to a fluctuating load. This capacitor C O is the output terminal of the regulator REG,
It is provided between common terminals, that is, in parallel with a load (not shown).
次に第3図の構成の動作を第4図a,bの信号
波形図を参照して説明する。従来例で述べたよう
にコンバータトランスTの2次巻線N2,N3には
トランジスタQ1のオン/オフにより交流波形電
圧が誘起される。しかして、例えば固定負荷チヤ
ネルである5V出力電圧側では、上記交流波形電
圧はダイオードD1,D2によつて直流電圧に変換
され、更にリツプル成分を有する当該直流電圧は
チヨークコイルL1、コンデンサCF1からなるフイ
ルタ回路によつて平滑化される。これにより比較
的平坦な電流がチヨークコイルL1を流れる。こ
の電流は、固定負荷電流の平均値にほぼ一致する
もので、従来例で述べたように5Aである。 Next, the operation of the configuration shown in FIG. 3 will be explained with reference to the signal waveform diagrams shown in FIGS. 4a and 4b. As described in the conventional example, an AC waveform voltage is induced in the secondary windings N 2 and N 3 of the converter transformer T by turning on/off the transistor Q 1 . For example, on the 5V output voltage side, which is a fixed load channel, the AC waveform voltage is converted to a DC voltage by diodes D 1 and D 2 , and the DC voltage having a ripple component is converted to a DC voltage by a chain coil L 1 and a capacitor C. It is smoothed by a filter circuit consisting of F1 . This causes a relatively flat current to flow through the choke coil L1 . This current almost matches the average value of the fixed load current, which is 5A as described in the conventional example.
一方、変動負荷出力チヤネル例えばパルス負荷
チヤネルである12V出力電圧側では、上記交流波
形電圧はダイオードD3,D4によつて直流電圧に
変換され、更に(トランジスタQ1のオン/オフ
周期に対応した高周波の)リツプル成分を有する
当該直流電圧はチヨークコイルL2、コンデンサ
CF2からなるフイルタ回路によつて平滑化される。
ところで、パルス負荷チヤネルの場合、従来例で
述べたように有負荷時と無負荷時とで負荷電流
(パルス負荷電流)が異なる。すなわち有負荷時
の間(1ms)パルス負荷には2Aの電流が流れ、
無負荷時の間(5ms)パルス負荷には電流は流
れない。一般にこの負荷変動の周期(6ms)は
トランジスタQ1のオン/オフ周期(例えば20μs)
に比べて著しく長い。このように負荷電流の変動
の周期が長い場合、チヨークコイルL2で当該負
荷電流を平滑化することはできない。したがつ
て、第1図の従来例では、有負荷時にパルス負荷
電流のピーク値に対応した電流がチヨークコイル
L2を流れてしまう。 On the other hand, on the 12V output voltage side of a variable load output channel, for example a pulse load channel, the above AC waveform voltage is converted to a DC voltage by diodes D 3 and D 4 , and further (corresponding to the on/off period of transistor Q 1 The DC voltage with the ripple component (of high frequency)
It is smoothed by a filter circuit consisting of C F2 .
By the way, in the case of a pulse load channel, as described in the conventional example, the load current (pulse load current) differs between the loaded state and the unloaded state. In other words, a current of 2A flows through the pulse load during the load period (1ms),
No current flows through the pulse load during the no-load period (5 ms). Generally, the cycle of this load fluctuation (6ms) is the on/off cycle of transistor Q1 (for example, 20μs)
significantly longer than . When the period of variation in the load current is long as described above, the load current cannot be smoothed by the chiyoke coil L2 . Therefore, in the conventional example shown in FIG.
It flows through L 2 .
しかし、本実施例では、チヨークコイルL2、
コンデンサCF2からなるフイルタ回路に、電流制
限抵抗RS、エネルギ蓄積用コンデンサCOからな
る2次巻線回路を接続しているので、当該電流制
限抵抗RSによつてチヨークコイルL2を流れる電
流が減少される。すなわち、コンバータトランス
Tの2次巻線N3を流れる電流が従来例に比して
減少される。この電流制限抵抗RSの抵抗値は例
えば次のようにして決定される。本実施例では抵
抗RSを流れる電流、すなわちレギユレータREG
の入力電流I12(IN)が12V出力電圧側のパルス負
荷電流の平均値にほぼ一致するようにしている。
この平均値(平均電流)は第2図、更には上述の
説明から明らかなように(1(ms)/6(ms))
×2(A)=0.333Aである。そこでこの平均電流が
抵抗RSを流れたとき、レギユレータREGの入力
端子、出力端子間電圧差が当該レギユレータ
REGの動作可能な電圧範囲の最小値(通常2V程
度)になるように抵抗RSの抵抗値を設定してい
る。そして、本実施例ではこのように抵抗値が設
定された抵抗RS、コンデンサCOからなるフイル
タによつて、第4図aに示されるようにパルス負
荷電流のピーク電流に応じてチヨークコイルL2
を流れる電流のレベルを下げると共に、その電流
平滑機能によつて当該電流を平坦にすることがで
きる。なお、同図における破線の電流波形は従来
例(第2図参照)を示すものである。 However, in this embodiment, the chiyoke coil L 2 ,
Since a secondary winding circuit consisting of a current limiting resistor R S and an energy storage capacitor C O is connected to the filter circuit consisting of the capacitor C F2 , the current flowing through the choke coil L 2 due to the current limiting resistor R S is is reduced. That is, the current flowing through the secondary winding N3 of the converter transformer T is reduced compared to the conventional example. The resistance value of this current limiting resistor R S is determined, for example, as follows. In this example, the current flowing through the resistor R S , that is, the regulator REG
The input current I 12 (IN) is made to approximately match the average value of the pulse load current on the 12V output voltage side.
As is clear from Fig. 2 and the above explanation, this average value (average current) is (1 (ms)/6 (ms))
×2(A)=0.333A. Therefore, when this average current flows through the resistor R S , the voltage difference between the input terminal and output terminal of the regulator REG is
The resistance value of the resistor R S is set to the minimum value (usually around 2V) of the voltage range in which REG can operate. In this embodiment, a filter consisting of a resistor R S and a capacitor C O whose resistance values are set in this manner is used to control the current of the choke coil L 2 according to the peak current of the pulse load current, as shown in FIG. 4a.
In addition to lowering the level of the current flowing through the device, its current smoothing function can flatten the current. Note that the current waveform indicated by a broken line in the same figure shows the conventional example (see FIG. 2).
エネルギ蓄積用コンデンサCOは前記入力電流
I12(IN)、すなわちチヨークコイルL2を流れる電
流によつて充電される。本実施例では、有負荷時
に、このコンデンサCOの充電電荷を一部放電さ
せてパルス負荷に2Aのパルス負荷電流を供給す
るものである。そのためには、無負荷期間(第2
図のTOFF期間)にコンデンサCOの電荷を回復さ
せる必要がある。そこでCORSTOFFとなるよう
にコンデンサCOの容量が選ばれている。このコ
ンデンサCO両端電圧すなわち変動負荷(パルス
負荷)チヤネルの12V出力電圧波形は第4図bに
示される通りである。また同図における破線の電
圧波形は第1図の従来例における12V出力電圧波
形である。図から明らかなように、本実施例で
は、コンンデンサCOの充放電による出力電圧変
動が生じるため、レギユレータREGによつてそ
の変動を極力抑えている。 The energy storage capacitor C O is connected to the input current
I 12 (IN), which is charged by the current flowing through the choke coil L 2 . In this embodiment, when a load is applied, part of the charge in the capacitor C O is discharged to supply a pulse load current of 2A to the pulse load. To do this, the no-load period (second
It is necessary to restore the charge on the capacitor C O during the T OFF period in the figure). Therefore, the capacitance of the capacitor C O is selected so that C O R S T OFF . The voltage across this capacitor CO , that is, the 12V output voltage waveform of the variable load (pulse load) channel is as shown in FIG. 4b. Further, the voltage waveform indicated by a broken line in the figure is the 12V output voltage waveform in the conventional example shown in FIG. As is clear from the figure, in this embodiment, the output voltage fluctuates due to charging and discharging of the capacitor C O , so the regulator REG suppresses this fluctuation as much as possible.
このように本実施例によれば、チヨークコイル
L2を流れる電流すなわち入力電流I12(IN)の電流
値を有負荷時、無負荷時に無関係に常にパルス負
荷電流の平均値にほぼ一致させることができるの
で、過負荷検出条件を設定する際に従来のように
12V出力電圧側のピーク出力電力(24W)を考慮
する必要がない。このため過負荷の基準を5V出
力電圧側の出力電力25W+12V出力電圧側の平均
出力電力4W=29W(従来例では49W)を少し上回
る程度とすることができる。 In this way, according to this embodiment, the chiyoke coil
The current value of the current flowing through L 2 , that is, the input current I 12 (IN), can always be made to almost match the average value of the pulse load current regardless of whether there is a load or no load, so when setting overload detection conditions, as before
There is no need to consider the peak output power (24W) on the 12V output voltage side. Therefore, the overload standard can be set to slightly exceed 25W of output power on the 5V output voltage side + 4W of average output power on the 12V output voltage side = 29W (49W in the conventional example).
なお、前記実施例ではコンデンサCOの充放電
による出力電圧変動、すなわち有負荷時と無負荷
時の出力電圧変動を抑えるため3端子レギユレー
タREGを用いた場合について説明したが、デイ
スクリート部品を組み合せてなるレギユレータを
用いてもよい。第5図はこのようなレギユレータ
の一例を示すものである。図中、Q2はNPNパワ
ートランジスタ、D5はトランジスタQ2のベース
とOV間に介挿された(ツエナー電圧が12.6Vの)
ツエナーダイオードである。また、RBはトラン
ジスタQ2のコレクタ、ベース間に介挿された抵
抗である。抵抗RBはツエナーダイオードD5のバ
イアス電流を供給するためのものである。なお、
本発明の要旨によればレギユレータは必ずしも必
要でない。 In the above embodiment, a case was explained in which a 3-terminal regulator REG was used to suppress output voltage fluctuations due to charging and discharging of the capacitor CO , that is, output voltage fluctuations under load and no load.However, it is also possible to use a combination of discrete components. A regulator may also be used. FIG. 5 shows an example of such a regulator. In the figure, Q 2 is an NPN power transistor, and D 5 is inserted between the base of transistor Q 2 and OV (Zener voltage is 12.6V).
It is a Zener diode. Further, R B is a resistor inserted between the collector and base of the transistor Q2 . The resistor R B is for supplying the bias current of the Zener diode D5 . In addition,
According to the subject matter of the invention, a regulator is not necessarily required.
また、前記実施例において、レギユレータ
REGの出力側に過電流垂下回路を設けることに
より、一層の効果が得られるものである。 Further, in the above embodiment, the regulator
Further effects can be obtained by providing an overcurrent drooping circuit on the output side of the REG.
また、前記実施例では、2出力のスイツチング
電源装置の場合について説明したが、3出力以上
のスイツチング電源装置にも同様に実施できる。
また、前記実施例では、フオワードコンバータ方
式のスイツチング電源装置の場合について説明し
たが、フライバツクコンバータ方式、ハーフブリ
ツジコンバータ方式、フルブリツジコンバータ方
式等にも同様に実施できる。更に前記実施例のよ
うにスイツチング周波数一定の制御方式(デユー
テイサイクル制御方式)に限らず、周波数変化
形、オン時間一定形、オフ時間一定形等の各種制
御方式、自励式スイツチング電源装置にも実施で
きる。 Further, in the above embodiment, the case of a switching power supply device with two outputs has been described, but the present invention can be similarly implemented in a switching power supply device with three or more outputs.
Further, in the above embodiment, the case of a forward converter type switching power supply device has been described, but the present invention can be similarly implemented in a flyback converter type, a half bridge converter type, a full bridge converter type, etc. Furthermore, it is not limited to the control method with a constant switching frequency (duty cycle control method) as in the above embodiment, but can also be applied to various control methods such as a variable frequency type, a constant on time type, a constant off time type, and a self-excited switching power supply. can also be implemented.
〔発明の効果〕
以上詳述したように本発明によれば、次に列挙
する作用効果を奏することができる。[Effects of the Invention] As detailed above, according to the present invention, the following effects can be achieved.
(1) パルス負荷であるときでも、コンバータトラ
ンスの1次側に流れる電流を平坦にすることが
できるので、過電流設定値を平均電流に近付け
ることができる。(1) Even when the load is pulsed, the current flowing to the primary side of the converter transformer can be flattened, so the overcurrent setting value can be brought closer to the average current.
(2) このため1次側回路のスイツチング用パワー
トランジスタを小電流定格のもので済せること
ができる。(2) Therefore, it is possible to use a switching power transistor in the primary circuit with a low current rating.
(3) スイツチング用パワートランジスタには従来
のようにピーク電流が流れなくなるため、ドラ
イブベース電流を少なくでき、ドライブ回路の
小型化が図れ、その消費電力を少なくできる。(3) Since the peak current no longer flows through the switching power transistor as in the conventional case, the drive base current can be reduced, the drive circuit can be made smaller, and its power consumption can be reduced.
(4) 2次側が過負荷時の検出レベルを低くできる
ので、2次側回路の構成部品のそれぞれの電流
定格を小さくできる。(4) Since the detection level when the secondary side is overloaded can be lowered, the current rating of each component of the secondary side circuit can be lowered.
(5) このため、安価な部品によつて構成でき、か
つ電源の小型化が図れる。(5) Therefore, it can be constructed using inexpensive parts and the power supply can be downsized.
第1図は従来のスイツチング電源装置の回路構
成図、第2図は上記従来例におけるパルス負荷電
流波形を示す図、第3図は本発明のスイツチング
電源装置の一実施例を示す回路構成図、第4図
a,bは上記実施例における各部の信号波形を示
すもので、それぞれ入力電流波形、出力電圧波形
を示す図、第5図はレギユレータの他の実施例を
示す回路構成図である。
Q1……スイツチング用パワートランジスタ、
T……コンバータトランス、L1,L2……チヨー
クコイル、CT……電流変成器、AI……過電流保
護回路、RS……電流制限抵抗、CO……エネルギ
蓄積用コンデンサ。
FIG. 1 is a circuit configuration diagram of a conventional switching power supply device, FIG. 2 is a diagram showing a pulse load current waveform in the above conventional example, and FIG. 3 is a circuit diagram showing an embodiment of the switching power supply device of the present invention. FIGS. 4a and 4b show signal waveforms of each part in the above embodiment, and are diagrams showing input current waveforms and output voltage waveforms, respectively. FIG. 5 is a circuit configuration diagram showing another embodiment of the regulator. Q 1 ...Switching power transistor,
T...Converter transformer, L1 , L2 ...Chiyoke coil, CT...Current transformer, AI...Overcurrent protection circuit, R S ...Current limiting resistor, CO ...Energy storage capacitor.
Claims (1)
荷を繰返すパルス負荷チヤネルを含む複数の出力
チヤネルを有し、過負荷検出機能を備えた多出力
スイツチング電源装置において、前記パルス負荷
チヤネル側に設けられたチヨークコイルを含む直
流電圧平滑用の第1のフイルタ回路に、電流制限
抵抗とエネルギー蓄積用のコンデンサとからなる
第2のフイルタ回路と出力電圧安定化用レギユレ
ータとを接続して、前記パルス負荷チヤネル側の
パルス負荷の有負荷時に前記エネルギー蓄積用の
コンデンサの充電電荷を一部放電させて前記パル
ス負荷に負荷電流を供給し、前記パルス負荷の無
負荷期間に前記エネルギー蓄積用のコンデンサを
充電し、このコンデンサの充放電による出力電圧
の変動を前記出力電圧安定化用レギユレータによ
り抑止すると共に、前記電流制限抵抗を流れる電
流が前記パルス負荷に流れる負荷電流の平均値と
ほぼ一致するようにこの電流制限抵抗の値を定
め、前記エネルギー蓄積用のコンデンサの値と前
記電流制限抵抗の値との積が前記パルス負荷の無
負荷期間とほぼ等しくなるように、このエネルギ
ー蓄積用のコンデンサの値を定めたことを特徴と
する多出力スイツチング電源装置。1. In a multi-output switching power supply device that has a plurality of output channels including a pulse load channel that repeats loaded and unloaded states on the secondary side of a converter transformer and is equipped with an overload detection function, A second filter circuit including a current limiting resistor and an energy storage capacitor and a regulator for stabilizing the output voltage are connected to the first filter circuit for DC voltage smoothing including a choke coil. When the side pulse load is loaded, part of the charge in the energy storage capacitor is discharged to supply a load current to the pulse load, and the energy storage capacitor is charged during the no-load period of the pulse load. The output voltage stabilizing regulator suppresses fluctuations in the output voltage due to charging and discharging of this capacitor, and the current is adjusted such that the current flowing through the current limiting resistor approximately matches the average value of the load current flowing through the pulse load. The value of the limiting resistor is determined, and the value of the energy storage capacitor is determined such that the product of the value of the energy storage capacitor and the value of the current limiting resistor is approximately equal to the no-load period of the pulse load. A multi-output switching power supply device characterized by:
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15930882A JPS5947973A (en) | 1982-09-13 | 1982-09-13 | Multioutput switching power source |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15930882A JPS5947973A (en) | 1982-09-13 | 1982-09-13 | Multioutput switching power source |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5947973A JPS5947973A (en) | 1984-03-17 |
| JPH0121698B2 true JPH0121698B2 (en) | 1989-04-21 |
Family
ID=15690960
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15930882A Granted JPS5947973A (en) | 1982-09-13 | 1982-09-13 | Multioutput switching power source |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5947973A (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2731565B1 (en) * | 1995-03-10 | 1997-04-18 | Gec Alsthom Transport Sa | ELECTRONIC DEVICE FOR CONVERTING ELECTRICAL ENERGY |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51121122A (en) * | 1975-04-16 | 1976-10-22 | Nippon Telegr & Teleph Corp <Ntt> | Multi-output dc-dc converter |
-
1982
- 1982-09-13 JP JP15930882A patent/JPS5947973A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5947973A (en) | 1984-03-17 |
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