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JPH0128429B2 - - Google Patents
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JPH0128429B2 - - Google Patents

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Publication number
JPH0128429B2
JPH0128429B2 JP56124553A JP12455381A JPH0128429B2 JP H0128429 B2 JPH0128429 B2 JP H0128429B2 JP 56124553 A JP56124553 A JP 56124553A JP 12455381 A JP12455381 A JP 12455381A JP H0128429 B2 JPH0128429 B2 JP H0128429B2
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JP
Japan
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gate
signal
barcode
output
flop
Prior art date
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Application number
JP56124553A
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Koji Yamana
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Casio Computer Co Ltd
Original Assignee
Casio Computer Co Ltd
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Publication date
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    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06KGRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
    • G06K7/00Methods or arrangements for sensing record carriers, e.g. for reading patterns

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  • Engineering & Computer Science (AREA)
  • Artificial Intelligence (AREA)
  • Computer Vision & Pattern Recognition (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)

Description

【発明の詳細な説明】 この発明はバーコード読取り制御装置に関す
る。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a barcode reading control device.

近年、デイジタル情報をバーコードによりカー
ド等に印刷等により書込み、またこのデイジタル
情報をバーコードリーダにより読取つて、例えば
電子楽器に音高情報を入力したりするバーコード
入力装置が考えられている。
2. Description of the Related Art In recent years, barcode input devices have been developed that write digital information using a barcode on a card or the like by printing or the like, and read this digital information with a barcode reader to input pitch information into, for example, an electronic musical instrument.

ところで従来のバーコード入力装置では、上記
カードを机の上などに置き、バーコードリーダで
バーコードをなぞつて走査しているが、一連のバ
ーコードの終端付近にごみなどによる汚点がある
場合、誤つてこの汚点を読取つてしまうことがあ
り、エラー発生の原因となつていた。
By the way, with conventional barcode input devices, the card is placed on a desk or the like and the barcode is traced and scanned with a barcode reader, but if there is a dirt stain near the end of a series of barcodes, This blemish could be read by mistake, causing an error.

また情報量が多い場合、カード上には複数行に
亘つてバーコードが印刷等されるが、このような
場合、各行の情報の内容が異なるため行の長さが
不揃いになつて見栄え悪い欠点があつた。更にま
た、行の終端には必ず余白(以下マージンスペー
スと称する。)を設ける必要があり、したがつて
1枚のカードに収容できる情報量がその分、減少
する欠点もあつた。
In addition, when there is a large amount of information, the barcode is printed over multiple lines on the card, but in such cases, the information content on each line is different, resulting in uneven line lengths, which creates an unattractive appearance. It was hot. Furthermore, it is necessary to provide a margin (hereinafter referred to as margin space) at the end of each line, which has the disadvantage that the amount of information that can be stored on one card is reduced accordingly.

この発明は上述した各種事情を背景にしてなさ
れたもので、その目的とするところは、必要な情
報の読取り終了後から所定時間が経過するまでの
間は、バーコードリーダから出力される読取り信
号の入力を禁止し、これにより上述した従来の各
種欠点を除去できるようにしたバーコード読取り
制御装置を提供することである。
This invention was made against the background of the above-mentioned circumstances, and its purpose is to provide a read signal that is output from a barcode reader until a predetermined period of time has elapsed after reading the necessary information. An object of the present invention is to provide a barcode reading control device which prohibits the input of barcodes and thereby eliminates the various drawbacks of the above-mentioned conventional methods.

以下、図面を参照して各種実施例を説明する。
第1図は第1実施例の回路図である。カード(例
えば第3図参照)上には印刷等の方法により、所
定の内容のデイジタル情報が一連のバーコードに
て書込まれているが、バーコードリーダ(図示
略)から出力される読取信号はアンドゲート1を
介し入力処理を行なうためのCPU(中央処理装
置)2に与えられると共に、アンドゲート3へ与
えられる。そしてCPU2へ入力された読取り信
号は夫々のバーコードに対応するデイジタル情報
に変換されたのち必要なものは、RAM(ランダ
ムアクセスメモリ、図示略)へ更に送出され、記
憶される。
Various embodiments will be described below with reference to the drawings.
FIG. 1 is a circuit diagram of the first embodiment. On the card (for example, see Figure 3), digital information with predetermined contents is written as a series of barcodes by printing or other methods, and the read signal output from a barcode reader (not shown) is applied to a CPU (central processing unit) 2 for performing input processing via an AND gate 1, and is also applied to an AND gate 3. The read signal input to the CPU 2 is converted into digital information corresponding to each barcode, and then necessary information is further sent to a RAM (random access memory, not shown) and stored therein.

茲で、第3図によりカード上のバーコードにつ
き説明すると、1組のバーコードは、複数本のバ
ーで構成される一連のデータコードと、その最後
のデータコード(第3図aに1により示す)の次
に設けられた、4ビツトオール“1”データ(こ
こにおいて黒白に関係なくバーの幅の広い、狭い
によりそれぞれ“1”,“0”を表現する。)によ
り規定されているエンドコード(第3図aに2に
より示す)、継続ビツト、チエツクサムの各デー
タ(第3図a中、夫々3,4にて示す)から成つ
ている。本実施例の場合、この1組のバーコード
が1行分であつて、上記継続ビツトは次の行の有
無を示すデータであり、またチエツクサムはチエ
ツク用データである。
To explain the barcodes on the card with reference to Figure 3, one set of barcodes consists of a series of data codes consisting of multiple bars, and the last data code (1 in Figure 3a). The end code specified by the 4-bit all “1” data (here, the widest and narrowest bars represent “1” and “0”, respectively, regardless of whether they are black or white) provided next to the bar (shown). (indicated by 2 in FIG. 3a), continuation bit, and checksum data (indicated by 3 and 4, respectively in FIG. 3a). In the case of this embodiment, this set of barcodes corresponds to one line, the continuation bit is data indicating the presence or absence of the next line, and the checksum is data for checking.

上記CPU2は、バーコードリーダから与えら
れる読取り信号中のエンドコードに対応する信号
を検出すると“1”の信号BEを出力し、アンド
ゲート3に与えて該アンドゲート3を開成する。
したがつてアンドゲート3からは、第3図bに示
す継続ビツトおよびチエツクサムによる3発の
“1”レベルの信号が出力し、CR微分回路4を介
し3進カウンタ5へ入力され、計数される構成と
なつている。なお、この継続ビツトは1ビツトの
データであり、チエツクサムは4ビツトのデータ
である為、必ず3発の“1”信号が得られるもの
である。3進カウンタ5のキヤリー出力はCPU
2およびCR微分回路6へ供給される。そしてこ
れに応じてCPU2は信号BEの出力を停止し、ま
たCR微分回路6の出力パルスはカウンタ7およ
びSR型フリツプフロツプ8の各リセツト入力端
子Rへ印加され、それぞれをリセツト状態とす
る。カウンタ7はクロツクCPを計数し、所定時
間、例えば1秒間を計時するために設けられたカ
ウンタである。そしてそのキヤリー出力は上記フ
リツプフロツプ8のセツト入力端子Sに印加さ
れ、またフリツプフロツプ8のセツト出力はアン
ドゲート1にゲート制御信号として与えられてい
る。
When the CPU 2 detects a signal corresponding to the end code in the read signal given from the barcode reader, it outputs a signal BE of "1" and supplies it to the AND gate 3 to open the AND gate 3.
Therefore, the AND gate 3 outputs three "1" level signals based on the continuation bit and checksum shown in FIG. It is structured as follows. Note that since this continuation bit is 1-bit data and the checksum is 4-bit data, three "1" signals are always obtained. The carry output of ternary counter 5 is the CPU
2 and the CR differentiation circuit 6. In response to this, the CPU 2 stops outputting the signal BE, and the output pulse of the CR differentiating circuit 6 is applied to each reset input terminal R of the counter 7 and SR type flip-flop 8, thereby setting each of them in a reset state. The counter 7 is a counter provided to count the clock CP and time a predetermined period of time, for example, one second. The carry output is applied to the set input terminal S of the flip-flop 8, and the set output of the flip-flop 8 is applied to the AND gate 1 as a gate control signal.

次に上記実施例の動作を説明する。カードから
のバーコード読取り開始時においては、フリツプ
フロツプ8はセツト状態にあり、したがつてアン
ドゲート1が開成している。このため読取り信号
はCPU2およびアンドゲート3に与えられる。
読取り信号を入力処理して得られた必要なデイジ
タル情報はCPU2を介し更にRAMへ転送され
る。また1組のバーコードのうち一連のデータコ
ードを読取つている間は信号BEは“0”であり、
アンドゲート3は開成している。
Next, the operation of the above embodiment will be explained. When reading a bar code from a card, the flip-flop 8 is in the set state, and therefore the AND gate 1 is open. Therefore, the read signal is given to the CPU 2 and the AND gate 3.
Necessary digital information obtained by input processing the read signal is further transferred to the RAM via the CPU 2. Also, while reading a series of data codes out of a set of barcodes, the signal BE is "0".
ANDGATE 3 is open.

次いでエンドコードが読取られるとCPU2は
信号BEを“1”として出力し、アンドゲート3
を以後開成する。そして次いで継続ビツト,チエ
ツクサムによる3発の“1”レベルの信号が読取
られるとその“1”信号がアンドゲート3から出
力し、CR微分回路4を介し3進カウンタ5へ供
給され計数される。そしてその計数値が「1」,
「2」,「0」と変化し、値が「0」となつたタイ
ミングでキヤリー信号が出力するとそのキヤリー
信号がCR微分回路6を介しカウンタ7、フリツ
プフロツプ8に夫々与えられ、夫々をリセツト状
態とする。そしてカウンタ7は以後、例えば1秒
間の計時動作を開始し、またこの間、アンドゲー
ト1が閉成し、このためバーコードリーダが何の
情報を読取つてもCPU2へは入力されず、無視
される。また1秒間が経過するとカウンタ7から
キヤリー信号が出力し、フリツプフロツプ8がセ
ツト状態とされる。したがつてそのセツト出力
(“1”)によつてアンドゲート1が以後開成し、
次の行や別のカードのバーコードの読取りが可能
となる。ここで、上記1秒という値は、バーコー
ドリーダを走査した際、バーコードの終端から次
行の始端に向うまでの時間を考慮して得たもので
ある。
Next, when the end code is read, the CPU 2 outputs the signal BE as "1", and the AND gate 3
will be developed from now on. Then, when three "1" level signals from the continuation bit and checksum are read, the "1" signal is outputted from the AND gate 3, supplied to the ternary counter 5 via the CR differentiation circuit 4, and counted. And the count value is “1”,
When the carry signal is output at the timing when the value changes to "2" and "0" and the value becomes "0", the carry signal is given to the counter 7 and flip-flop 8 through the CR differentiation circuit 6, respectively, and resets each of them. shall be. Thereafter, the counter 7 starts counting time, for example, for one second, and during this time, the AND gate 1 is closed, so that even if the barcode reader reads any information, it is not input to the CPU 2 and is ignored. . When one second has elapsed, a carry signal is output from the counter 7, and the flip-flop 8 is set. Therefore, the set output (“1”) opens AND gate 1 from now on,
It becomes possible to read the next line or the barcode of another card. Here, the value of 1 second was obtained by taking into consideration the time from the end of the barcode to the start of the next line when scanning with the barcode reader.

次に第2図を参照して第2実施例を説明する。
なお、第1図と同一機能の回路には同一符号を付
し、その説明を省略する。
Next, a second embodiment will be described with reference to FIG.
Note that circuits having the same functions as those in FIG. 1 are given the same reference numerals, and their explanations will be omitted.

即ち、上記アンドゲート1出力は更にインバー
タ11,CR微分回路12を介しSR型フリツプフ
ロツプ13のリセツト入力端子Rに印加されてい
る。上記フリツプフロツプ13のセツト入力端子
SにはCR微分回路14を介し上記信号BEが印加
されている。そしてそのセツト出力はアンドゲー
ト15にゲート制御信号として与えられている。
このアンドゲート15にはクロツクCPが印加さ
れ、該アンドゲート15から出力する上記クロツ
クCPはカウンタ16に入力して計数される。
That is, the output of the AND gate 1 is further applied to the reset input terminal R of the SR type flip-flop 13 via an inverter 11 and a CR differentiation circuit 12. The signal BE is applied to the set input terminal S of the flip-flop 13 via the CR differentiation circuit 14. The set output is given to the AND gate 15 as a gate control signal.
A clock CP is applied to this AND gate 15, and the clock CP output from the AND gate 15 is input to a counter 16 and counted.

上記クロツクCPはまた1/N分周器17を介
しアンドゲート18に印加されている。また上記
3進カウンタ5のキヤリー出力がフリツプフロツ
プ19のセツト入力端子Sに印加されており、ま
たそのセツト出力は上記アンドゲート18にゲー
ト制御信号として与えられている。そしてアンド
ゲート18から出力する1/Nに分周された信号
はカウンタ20へ印加され、計数される。更にカ
ウンタ16,20の各計数出力は共に一致回路2
1に与えられて一致を検出され、またその一致出
力はSR型フリツプフロツプ22のセツト入力端
子に印加されると共に上記フリツプフロツプ19
のリセツト入力端子Rに印加されている。そして
フリツプフロツプ22のセツト出力は上記アンド
ゲート1のゲート制御信号とされている。なお、
カウンタ16は信号BEを微分回路14を介した
信号によりリセツトされ、またカウンタ20およ
びフリツプフロツプ22は共に、微分回路6出力
によつてリセツトされる構成となつている。
The clock CP is also applied to an AND gate 18 via a 1/N frequency divider 17. Further, the carry output of the ternary counter 5 is applied to the set input terminal S of the flip-flop 19, and its set output is applied to the AND gate 18 as a gate control signal. The 1/N frequency-divided signal output from the AND gate 18 is applied to the counter 20 and counted. Further, each count output of the counters 16 and 20 is both sent to the matching circuit 2.
1 to detect a match, and the match output is applied to the set input terminal of the SR flip-flop 22 and the flip-flop 19.
is applied to the reset input terminal R of. The set output of the flip-flop 22 is used as a gate control signal for the AND gate 1. In addition,
The counter 16 is reset by the signal BE passed through the differentiating circuit 14, and the counter 20 and flip-flop 22 are both reset by the output of the differentiating circuit 6.

次に上記第2実施例の動作を説明する。カード
からバーコード読取り開始時においては、フリツ
プフロツプ22がセツト状態にあり、したがつて
アンドゲート1が開成している。このため読取り
信号はCPU2、アンドゲート3、インバータ1
1に夫々与えられている。そして、読取り信号を
入力処理して得られた必要なデイジタル情報は
CPU2から更にRAMへ送出される。またこの
間、信号BEは“0”であり、アンドゲート3は
閉成している。
Next, the operation of the second embodiment will be explained. When reading a barcode from a card, the flip-flop 22 is in a set state and therefore the AND gate 1 is open. Therefore, the read signal is sent to CPU2, AND gate 3, and inverter 1.
1 are given respectively. The necessary digital information obtained by inputting and processing the read signal is
It is further sent from CPU2 to RAM. Also, during this time, the signal BE is "0" and the AND gate 3 is closed.

次いでエンドコードが読取られるとCPU2は
“1”の信号BEを出力し、アンドゲート3を以後
開成する。またCR微分回路14の出力によつて
フリツプフロツプ13がセツト状態とされ、同時
にカウンタ16がリセツト状態とされ、これに応
じてアンドゲート15を介しクロツクCPがカウ
ンタ16により計数開始される。そして、継続ビ
ツト(第3図aの3)信号の立ち下がりに同期し
てインバータ11から出力が生じる。そしてCR
微分回路12を介しフリツプフロツプ13をリセ
ツトする。この結果アンドゲート15が閉成しカ
ウンタ16の計数動作が停止する。つまり継続ビ
ツトを走査した時間に対応した計数値がカウンタ
16に計数される。ゆえに、バーコードリーダの
走査速度が速いと計数値は小となり、逆にバーコ
ードリーダの走査速度が遅いと計数値は大とな
る。
Next, when the end code is read, the CPU 2 outputs a signal BE of "1" and opens the AND gate 3 thereafter. Further, the flip-flop 13 is set to a set state by the output of the CR differentiation circuit 14, and at the same time, the counter 16 is set to a reset state. Then, an output is generated from the inverter 11 in synchronization with the fall of the continuation bit (3 in FIG. 3a) signal. and C.R.
The flip-flop 13 is reset via the differentiating circuit 12. As a result, the AND gate 15 is closed and the counting operation of the counter 16 is stopped. That is, the counter 16 counts a count value corresponding to the time when the continuation bit is scanned. Therefore, if the scanning speed of the barcode reader is fast, the counted value will be small, and conversely, if the scanning speed of the barcode reader is slow, the counted value will be large.

一方、開成したアンドゲート3、CR微分回路
4を介し、継続ビツト、チエツクサムによる3発
の“1”レベルの信号が3進カウンタ5に入力し
計数される。そしてその計数値が「0」となると
キヤリー信号が出力し、フリツプフロツプ19が
セツトされ、またCR微分回路6出力によつてカ
ウンタ20とフリツプフロツプ22が同時にリセ
ツトされる。したがつて以後はアンゲート1を介
しバーコードリーダからの読取り信号の入力が禁
止される。
On the other hand, three "1" level signals from the continuation bit and checksum are input to the ternary counter 5 and counted through the AND gate 3 and the CR differentiation circuit 4. When the count value becomes "0", a carry signal is output, flip-flop 19 is set, and counter 20 and flip-flop 22 are simultaneously reset by the output of CR differentiation circuit 6. Therefore, from now on, input of a read signal from the barcode reader via the ungate 1 is prohibited.

一方、フリツプフロツプ19のセツト後、1/
Nに分周されたクロツクCPがアンドゲート18
を介しカウンタ20に印加され、計数される。そ
してその計数出力は一致回路21にてカウンタ1
6の計数出力と比較され、両者が一致すると一致
信号が出力し、フリツプフロツプ22がセツトさ
れ、これに応じてアンドゲート1が再び開成し、
次の行や他のカードのバーコードの読取りに備え
られる。
On the other hand, after flip-flop 19 is set, 1/
The clock CP whose frequency is divided by N is the AND gate 18.
The signal is applied to the counter 20 through the circuit and counted. Then, the counting output is sent to the counter 1 in the coincidence circuit 21.
6 is compared, and when the two match, a match signal is output, flip-flop 22 is set, and in response, AND gate 1 is opened again.
Ready to read barcodes on the next line or other cards.

以上説明したように、この第2実施例の場合、
バーコードリーダの走査スピードに対応した時間
だけ、必要な情報の読取り終了後バーコードリー
ダからの読取り信号の入力が禁止される。つま
り、バーコードリーダの走査速度が速ければ入力
禁止時間が短かく、逆に走査速度が遅ければ入力
禁止時間が長くなる。
As explained above, in the case of this second embodiment,
After reading the necessary information, the input of a read signal from the barcode reader is prohibited for a time corresponding to the scanning speed of the barcode reader. That is, the faster the scanning speed of the barcode reader is, the shorter the input prohibition time is, and conversely, the slower the scanning speed is, the longer the input prohibition time is.

なお、バーコードリーダからの読取り信号の入
力の禁止時間の長さは、上記各種実施例のものに
限定されず、任意である。
Note that the length of time during which input of the read signal from the barcode reader is prohibited is not limited to those of the various embodiments described above, and is arbitrary.

又、バーコードの形態は上記実施例に限定され
るものでなく、情報のフオーマツトも適宜変更し
得る。
Further, the form of the barcode is not limited to the above embodiment, and the format of the information may be changed as appropriate.

この発明は以上説明したように、バーコード群
のうち1組のバーコード中の一連のデータコード
を読取つた後は、エンドコードを検出することに
よつて所定時間が経過するまでの間バーコードリ
ーダからの読取り信号の入力を禁止し、次の1組
のバーコードの読取りに備えるようにしたバーコ
ード読取り制御装置を提供したから、バーコード
中の必要なデータコードの読取り終了後に、バー
コードリーダが誤つてカードからはみ出して机上
のごみなどによる汚点を読取つたり、又カード上
の汚点を読取つたりしてもこのエラーデータは入
力されず、したがつてエラー発生が確実に防止で
きる利点がある。またバーコード表示体が1枚の
カード上に複数行に亘つて設けられている場合、
各行の最後にダミーコードを設けて各行の長さを
等しくさせてもこのダミーコードはデータとして
入力されず、したがつてカードの見栄えがよくな
る利点もある。更にマージンスペースを小さくし
ても上述した理由でエラーは発生しないから、1
枚のカードに書込める情報量がその分増加し、経
済的になる利点もある。
As explained above, in this invention, after reading a series of data codes in one set of barcodes out of a group of barcodes, the barcode is read until a predetermined time elapses by detecting an end code. Since we have provided a barcode reading control device that prohibits the input of reading signals from the reader and prepares for reading the next set of barcodes, the barcode can be read after reading the necessary data codes in the barcode. Even if the reader accidentally protrudes from the card and reads a smudge caused by dust on the desk, or a smudge on the card, this error data is not inputted, so the advantage is that errors can be reliably prevented from occurring. There is. Also, if the barcode display is provided on multiple lines on one card,
Even if a dummy code is provided at the end of each line to make each line the same length, this dummy code will not be input as data, which has the advantage of improving the appearance of the card. Even if the margin space is made smaller, the error will not occur for the reason mentioned above, so 1
The amount of information that can be written on a single card increases accordingly, which also has the advantage of being economical.

【図面の簡単な説明】[Brief explanation of drawings]

第1図はこの発明の第1実施例の要部の回路
図、第2図は第2実施例の要部の回路図、第3図
は上記各実施例におけるバーコード表示体の終了
付近におけるエンドコード等の内容を示す図であ
る。 1,3,15,18……アンドゲート、2……
CPU、4,6,12,14……CR微分回路、
5,7,16,20……カウンタ、8,13,1
9,22……フリツプフロツプ、17……1/N
分周器、21……一致回路。
Fig. 1 is a circuit diagram of the main part of the first embodiment of the present invention, Fig. 2 is a circuit diagram of the main part of the second embodiment, and Fig. 3 is a circuit diagram of the main part of the bar code display in each of the above embodiments. FIG. 3 is a diagram showing the contents of an end code and the like. 1, 3, 15, 18...and gate, 2...
CPU, 4, 6, 12, 14...CR differential circuit,
5, 7, 16, 20...Counter, 8, 13, 1
9, 22...flip flop, 17...1/N
Frequency divider, 21... matching circuit.

Claims (1)

【特許請求の範囲】 1 1組のバーコードが少なくとも一連のデータ
コードとその最後のデータコードの次に設けられ
たエンドコードとからなるバーコード群を順次バ
ーコードリーダによつて読取り、その読取り信号
を入力処理手段に与える際の制御を行なうバーコ
ード読取り制御装置に於いて、 上記読取り信号を上記入力処理手段に与えるた
めのゲート手段と、 上記読取り信号中の上記エンドコードに対応す
る信号を検出する検出手段と、 この検出手段によつて上記エンドコードに対応
する信号が検出されてから所定時間が経過するま
での間、上記ゲート手段に対して上記読取り信号
を上記入力処理手段に与えることを禁止する制御
を行なう制御手段と、 を具備したことを特徴とするバーコード読取り制
御装置。
[Claims] 1. A barcode group in which one set of barcodes consists of at least a series of data codes and an end code provided after the last data code is sequentially read by a barcode reader; A barcode reading control device that controls when a signal is given to an input processing means, comprising gate means for giving the read signal to the input processing means, and a signal corresponding to the end code in the read signal. a detection means for detecting the end code; and supplying the read signal to the gate means to the input processing means until a predetermined time period elapses after the detection means detects the signal corresponding to the end code. 1. A barcode reading control device comprising: a control means for performing control for prohibiting; and a barcode reading control device.
JP12455381A 1981-08-08 1981-08-08 Barcode reading control device Granted JPS5827272A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP12455381A JPS5827272A (en) 1981-08-08 1981-08-08 Barcode reading control device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP12455381A JPS5827272A (en) 1981-08-08 1981-08-08 Barcode reading control device

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Publication Number Publication Date
JPS5827272A JPS5827272A (en) 1983-02-17
JPH0128429B2 true JPH0128429B2 (en) 1989-06-02

Family

ID=14888323

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Application Number Title Priority Date Filing Date
JP12455381A Granted JPS5827272A (en) 1981-08-08 1981-08-08 Barcode reading control device

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JP (1) JPS5827272A (en)

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JPS52129236A (en) * 1976-04-21 1977-10-29 Nippon Denso Co Ltd Reading control method

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JPS5827272A (en) 1983-02-17

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