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JPH0144017B2 - - Google Patents
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JPH0144017B2 - - Google Patents

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JPH0144017B2
JPH0144017B2 JP58068518A JP6851883A JPH0144017B2 JP H0144017 B2 JPH0144017 B2 JP H0144017B2 JP 58068518 A JP58068518 A JP 58068518A JP 6851883 A JP6851883 A JP 6851883A JP H0144017 B2 JPH0144017 B2 JP H0144017B2
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housing
substrate
heated
temperature
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Uensukasu Haabaato
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  • Electric Connection Of Electric Components To Printed Circuits (AREA)
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Description

【発明の詳細な説明】 〔技術分野〕 本発明は、基板の端子パツドにはんだ接続され
ている素子を除去するための方法及び装置に係
る。
〔従来技術〕
今日の超小型電子技術に於けるLSI化の傾向
は、複数の半導体素子を相互接続し且つ支持する
半導体パツケージの使用を必要としている。その
様なパツケージは、例えば、多数の半導体素子が
基板に於ける相互接続導体にはんだ接続されてい
る多層セラミツク基板より成り得る。その様なパ
ツケージは、米国特許第4302625号の明細書に記
載されている。
多数の半導体素子を有するこの種のモジユール
が、特に高性能のコンピユータのための大量生産
に於て用いられるとき、欠陥を有することが解つ
た1つ又はそれ以上の素子を交換する必要が生じ
得る。その必要性の確率は、モジユールに含まれ
ている素子の数が増加するに従つて、増加する。
換言すれば、或る所与の位置から欠陥素子を除去
し、新しい素子のための位置を整えてから、その
新しい素子を接続するための方法を得ることが必
要とされる。素子の熱的方法による除去に関する
背景技術の例が、IBM Technical Disclosure
Bulletin、第20巻、第9号、1978年2月、第3725
頁に於ける“Use of a Heated Jet to
Remove a Silicon Chip Soldered to a
Substrate”と題する論文、及びその第21巻、第
9号、1979年2月、第3592頁に於ける“Inverted
Hot Gas Selected Chip Removal”と題する論
文に記載されている。しかしながら、最も困難な
問題は、素子が除去された後に基板上のはんだパ
ツドを元の状態に戻すことである。通常、これ
は、パツドに於けるはんだを、全部でなく部分的
に、除去することによる。その様な方法は、迅
速、簡単、且つ低コストであることが望ましい。
その方法は、隣接する素子に影響を与えたり、基
板表面に存在する導体網に損傷を与えたり、又は
導体条片又はパツド間に望ましくない短絡回路を
生じ得るはんだの流れを生じたりしてはならな
い。
従来の素子除去技術を用いて行われる、はんだ
接続されている素子の除去は、基板のパツド上に
多量のはんだを残す。その量は、その除去技術に
よつて異なるが、通常ははんだ接続体に用いられ
たはんだの全量の30乃至80%の範囲である。その
はんだの量は、多すぎるので、交換される新しい
素子が接続される前に除かれねばならない。その
新しい素子の接続操作の準備に於ては、概しては
んだ全量の10乃至15%だけがパツド上に残される
べきである。
はんだを除去する操作は、時間を長々と要し、
高くつく。更に、その操作は、隣接する素子及び
素子接続体に、そして基板の導体自体にも損傷を
生じ得る。
余分なはんだが素子とともに簡便に除去され
て、清浄化操作を必要とせずにもう1つの素子を
受取る様に準備されている端子パツドが残され
る、素子除去技術が必要とされている。
〔本発明の概要〕
本発明は、次の素子接続操作に必要とされる不
可欠な量のはんだだけを残し得る、基板からはん
だ接続されている素子を除去する装置を提供す
る。この装置は、素子の平坦な裏面に係合する様
に適合された座部を有するハウジングの開放端部
と、上記ハウジングの内部に加熱された不活性ガ
スを導入するための導入口と、その加熱されたガ
スのための排出口とを有している、中空のハウジ
ングより成る。上記ハウジングの内部には、そら
せ板が、上記ハウジングの座部から引込んだ端部
を有する様に設けられている。そのそらせ板は、
加熱されたガスを上記ハウジングの座部と係合し
ている上記素子の裏面に向つて下方に方向づけて
から上記排出口の外へ方向づける様に適合されて
いる。又、上記素子が上記ハウジングの座部上に
保持され得る様に、締付手段が、上記ハウジング
の開放端部に近接して上記ハウジング上に設けら
れている。上記素子を保持し又は解放する様に、
上記締付手段を選択的に付勢させる手段も設けら
れている。
本発明は又、更にパツドに処理を施すことを必
要とせずにもう1つの半導体素子をはんだ接続す
るに充分なはんだの被膜だけがパツド上に残され
る様に、セラミツク基板からはんだ接続されてい
る半導体素子を除去する方法を提供する。その方
法は、上記のはんだ接続されている素子を有する
上記基板を、はんだ接続体のはんだの融点よりも
100℃以上低い温度に予熱し;上記はんだ接続体
の温度を上記はんだの融点よりも高く迅速に上昇
させるために、加熱された不活性ガスの限定され
た流れを上記素子の裏面に選択的に方向づけ;上
記の加熱されたガスを上記基板に接触させずに除
去し;上記の加熱されたガスにより加えられた熱
によつて上記基板の上部が上記予熱温度よりもか
なり高く加熱される前に、上記基板から上記素子
を持上げることを含む。この様に上記素子の迅速
な加熱と、上記素子を持上げるタイミングとを組
合わせることにより、上記はんだと上記パツドと
の間の界面に大きな温度差を生ぜしめて、上記は
んだ接続体のはんだの80乃至90%を上記素子に選
択的に付着させる。
〔実施例の説明〕
第1図に於て、はんだ接続されている素子12
を基板14から除去するための装置10が示され
ている。はんだ接続体16が素子12を基板に接
続させており、それらの接続体については米国特
許第3495133号の明細書に詳細に記載されている。
装置10は、環状の上部20と、傾斜した中間部
22と、すぼんだ下部24とを有するハウジング
18を有している。下部24は、素子12の裏面
と係合する様に適合された座部26を有する開放
端部を有している。ハウジング18は、加熱され
たガスを該ハウジングの内部に導入させる導入口
28と、その加熱されたガスを排出する排出口3
0とを有している。該ハウジング18の内部に
は、使用されたとき、上記の加熱されたガスを素
子12の裏面に向つて下方に方向づけてから排出
口30の外へ方向づけるそらせ板32が装着され
ている。そらせ板32は、ハウジング18の内側
表面即ち上部20に係合する傾斜した上部34、
及びハウジングの座部26から引込んだ端部を有
する管状の下部36を有している。この配置は、
加熱されたガスが、矢印38により示されている
如く、導入口28から導入されて、素子12の裏
面を横切つて方向づけられる様にする。素子12
は、ボルト41でハウジングに保持されている上
端、及び座部26を超えて延びている下端を有す
る、2つの対向する板ばね素子即ち締付手段40
によつて、ハウジング18の座部26に保持され
ている。ばね素子40は、内方にバイアスされて
おり、素子12の端部に接触している。素子12
は、該素子12とばね素子40の端部との間の摩
擦によつて然るべき位置に保持されている。締付
手段40を離れた位置から付勢する手段が設けら
れている。締付手段の制御は、ばね素子40とハ
ウジング18との間に回転可能に配置された、橢
円形の断面を有する、2つのカム素子42によつ
て達成される。第2図に示されている如く、ケー
ブル44によるカム素子の回転は、ばね素子40
を素子12の端部から外側へ離隔させる。素子1
2の温度を測定するために、熱電対46が、座部
26に近接してハウジング18の下部に装着され
ている。素子12の温度を視覚的に表示するため
に、上記熱電対46からのリード線が適当な表示
器48に接続されている。更に、熱電対46から
の出力は、ハウジング18内に導入されるガスを
加熱する抵抗加熱装置50を制御するために用い
られ得る。その加熱されたガスは、導入口28を
経て、素子12の裏面上を循環された後に、排出
口30の外へ排出される。
上記装置を用いて、セラミツク基板からはんだ
接続されている半導体素子を除去する方法を用い
ることにより、上記素子を上記基板に接続してい
るはんだ接続体を形成しているはんだの80乃至90
%が上記素子とともに除去され得る。残されたは
んだの量は、パツドを酸化から保護しそしてパツ
ドの湿潤性を維持するために適切な量である。こ
の方法によつて、IBM TDB、第18巻、第5号、
1975年10月、第1384頁に記載されている如き余分
のはんだを除去するための従来の操作が不要とな
る。本発明による方法に於ては、除去されるべき
上記素子を支持している基板が、概して、はんだ
接続体のはんだの融点から100℃以上低い温度に
予熱される。この予熱温度は、はんだ接続体に用
いられているはんだの種類及び上記素子を除去す
るための他の条件によつて異なり得る。概して、
その予熱温度は、100乃至220℃の範囲、より好ま
しくは180乃至200℃の範囲である。それから、は
んだ接続体の温度を極めて迅速にはんだの融点よ
りも高く上昇させるために、加熱された不活性ガ
スの流れが除去されるべき上記素子の裏面に方向
付けられる。この操作は、前述の装置を用いて達
成されることが好ましい。この加熱工程に於ける
はんだ接続体の温度の増加の平均は、好ましくは
毎秒14乃至20℃の範囲内である。加熱された不活
性ガスの流れは、その必要な温度の上昇を達成す
るために、典型的には450乃至500℃の任意の適当
な温度に加熱され得る。上記素子の温度を極めて
迅速に上昇させるために、加熱されたガスの流れ
を限定するために用いられている装置が、上記素
子の裏面に係合する様に配置される前に予熱され
る。その予熱が達成された後、上記の加熱された
ガスにより加えられた熱によつて上記基板の上部
が上記予熱温度よりもかなり高く加熱される前
に、上記基板から上記素子が迅速に持上げられ
る。はんだ接続体のはんだと上記支持基板との間
の大きな温度差が、上記はんだの略80乃至90%を
上記基板上のパツドにではなく上記素子上のはん
だパツドに選択的に付着させる条件を生じること
が理論的に云える。概して、はんだ接続体のはん
だの温度は、その融点よりも40乃至60℃だけ高く
加熱される。基板及び該基板上のはんだパツド
は、初めの予熱温度からかなり高い温度には加熱
されない。本発明の方法を実施するための条件
は、上記素子が基板から持上げられるときにはん
だ接続部のはんだの80乃至90%が該素子とともに
持上げられる様に、上記はんだと基板上のはんだ
パツドとの間に大きな温度差を生ぜしめるため
に、注意深く測定及び制御されねばならない。
次に示す実施例は単に本発明の1好実施例を示
したものであつて、本発明の範囲を何ら限定する
ものではない。
実施例 米国特許第4302625号の明細書に記載の如く形
成され、表面に100個の半導体素子が接続されて
いる、90×90mmの寸法を有する、アルミナの多層
セラミツク基板が選択された。各々の半導体素子
は、315℃の融点を有する、90%の鉛と10%の錫
とより成る、121個のはんだ接続体を用いて、基
板に接続された。各半導体素子は、約4.6×4.6mm
の寸法を有するシリコンから形成された。本発明
の方法に従つて除去されるために、接続に欠陥の
ある又は欠陥を有する1つの基板が選択された。
その基板が、190℃の温度に保たれている赤外線
による炉中に10分間配置された。前述の装置が、
移動可能な支持体上に支持され、500℃に加熱さ
れた窒素ガスを通されることにより予熱された。
ノズルの温度が350℃に達したときに、上記ガス
の流れが停止され、上記装置のハウジングが除去
されるために選択された素子上に移動されて、上
記素子が締付手段により保持された。加熱された
不活性ガスの循環が再び開示され、ノズルの温度
が観察された。10秒後に、ノズルの温度が375℃
に達し、上記素子が基板から持上げられた。基板
が室温迄冷えてから、パツド上に残されたはんだ
の量が測定され、それは初めに上記素子を基板に
接続するために用いられたはんだの量の略15%を
成すことが解つた。
【図面の簡単な説明】
第1図は基板にはんだ接続されている半導体素
子上の然るべき位置に配置されている本発明によ
る装置の構造を示す縦断面図、第2図は第1図に
示されている装置の下方端部を側面から見て詳細
に示している図である。 10……素子除去装置、12……はんだ接続さ
れている素子、14……基板、16……はんだ接
続体、18……ハウジング、20……ハウジング
の上部、22……ハウジングの中間部、24……
ハウジングの下部、26……ハウジングの座部、
28……導入口、30……排出口、32……そら
せ板、34……そらせ板の上部、36……そらせ
板の下部、40……板ばね素子(締付手段)、4
1……ボルト、42……カム素子、44……ケー
ブル、46……熱電対、48……表示器、50…
…抵抗加熱装置。

Claims (1)

  1. 【特許請求の範囲】 1 更にパツドに処理を施すことを必要とせずに
    もう1つの半導体素子をはんだ接続するに充分な
    はんだの被膜だけがパツド上に残される様に、セ
    ラミツク基板からはんだ接続されている半導体素
    子を除去する方法であつて、 上記のはんだ接続されている素子を有する上記
    基板を、はんだ接続体のはんだの融点よりも100
    ℃以上低い温度に予熱し、 上記はんだ接続体の温度を上記はんだの融点よ
    りも高く迅速に上昇させるために、除去されるべ
    き上記素子の裏面に加熱された不活性ガスの限定
    された流れを選択的に方向づけ、 上記の加熱されたガスを上記基板に接触させず
    に除去し、 上記の加熱されたガスにより加えられた熱によ
    つて上記基板の上部が上記予熱温度よりもかなり
    高く加熱される前に、上記基板から上記素子を持
    上げ、 上記素子の迅速な加熱と上記素子を持上げるタ
    イミングとの組合せにより、上記はんだと上記パ
    ツドとの間の界面に大きな温度差を生ぜしめて、
    上記はんだ接続体のはんだの90パーセント迄を上
    記素子に選択的に付着させることを含む、 はんだ接続されている半導体素子を除去する方
    法。 2 基板からはんだ接続されている素子を除去す
    る装置であつて、 上記のはんだ接続されている素子の平坦な裏面
    に係合する様に適合された座部を有するハウジン
    グの開放端部、上記ハウジングの内部に加熱され
    たガスを導入するための導入口、及び上記の加熱
    されたガスのための排出口を有している、中空の
    ハウジングと、 上記ハウジングの座部から引込んだ端部を有す
    る様に上記ハウジングの内部に設けられており、
    使用されたとき、上記の加熱されたガスを上記ハ
    ウジングの座部と係合している上記素子の裏面に
    向つて下方に方向づけてから上記排出口の外へ方
    向づける様に適合されているそらせ板と、 上記素子が上記ハウジングの座部上に保持され
    得る様に、上記ハウジングの開放端部に近接して
    上記ハウジング上に設けられている締付手段と、 上記素子を保持し又は解放する様に、上記締付
    手段を選択的に付勢させる手段とを有している、 はんだ接続されている素子を除去する装置。
JP58068518A 1982-06-28 1983-04-20 はんだ接続されている半導体素子を除去する方法及び装置 Granted JPS598342A (ja)

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US06/392,905 US4444559A (en) 1982-06-28 1982-06-28 Process and apparatus for unsoldering solder bonded semiconductor devices

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JPS598342A JPS598342A (ja) 1984-01-17
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EP (1) EP0097796B1 (ja)
JP (1) JPS598342A (ja)
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