Deprecated: The each() function is deprecated. This message will be suppressed on further calls in /home/zhenxiangba/zhenxiangba.com/public_html/phproxy-improved-master/index.php on line 456
JPH0222966B2 - - Google Patents
[go: Go Back, main page]

JPH0222966B2 - - Google Patents

Info

Publication number
JPH0222966B2
JPH0222966B2 JP1921282A JP1921282A JPH0222966B2 JP H0222966 B2 JPH0222966 B2 JP H0222966B2 JP 1921282 A JP1921282 A JP 1921282A JP 1921282 A JP1921282 A JP 1921282A JP H0222966 B2 JPH0222966 B2 JP H0222966B2
Authority
JP
Japan
Prior art keywords
film
photosensitive resin
resin film
alumite
forming
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP1921282A
Other languages
English (en)
Other versions
JPS58137915A (ja
Inventor
Kenichi Mimori
Kazuo Aikawa
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Alps Alpine Co Ltd
Original Assignee
Alps Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Alps Electric Co Ltd filed Critical Alps Electric Co Ltd
Priority to JP1921282A priority Critical patent/JPS58137915A/ja
Priority to US06/430,601 priority patent/US4463084A/en
Publication of JPS58137915A publication Critical patent/JPS58137915A/ja
Publication of JPH0222966B2 publication Critical patent/JPH0222966B2/ja
Granted legal-status Critical Current

Links

Landscapes

  • Manufacture Of Switches (AREA)
  • Insulated Metal Substrates For Printed Circuits (AREA)

Description

【発明の詳細な説明】 本発明は回路板の形成方法に関し、とくにアル
ミニウム基板にアルマイト皮膜を形成し、この皮
膜を構成する結晶体群のセルに、選択的に導電物
質と非導電物質とを充填して、接触面が平滑かつ
微細なパターンの電気回路を形成する回路板の形
成方法に関する。
従来接触式エンコーダ用コードスイツチ基板な
どを形成する場合、印刷や真空蒸着などの厚膜、
薄膜形成技術と転写法とを併用して、接触子が摺
動する面が平滑でかつ微細な回路パターンを絶縁
基板上に形成する方法が知られている。
しかし、上記従来例にあつて、回路の最小パタ
ーン巾が100μm以下の微細な回路を有し、かつ
100万サイクル以上の摺動寿命を有する回路板の
形成は蒸着等の工程が面倒で高価になり、また薄
膜のため摺動寿命が短かくなる欠点があつた。
本発明は上記欠点を除去するものであり、アル
ミニウム基板上に形成したセルを有するアルマイ
ト皮膜を利用して、長寿命かつ微細な回路パター
ンを容易に形成しうる回路板の形成方法を提供す
ることを目的とする。
以下本発明を第1図〜第3図と共に説明する。
第1図イ〜カは工程説明図、1はアルミニウムの
金属板、2は前記アルミニウム基板上に陽極酸化
法(アルミニウム基板を陽極としてシヨウ酸等の
電解液中で電解酸化を行なう)によつて形成され
たアルマイト皮膜である。この陽極酸化法で形成
されたアルマイト皮膜2は公知の如く多孔質酸化
皮膜よりなり第2図に示した部分拡大図のよう
に、多くの微細な多角形状の結晶体2aが密接・
配置され、それぞれの結晶体2aには最大寸法が
300Å程度の微細なセル2bがアルミニウム基板
面にまで接続して形成される。
次に第1図ハにおいて、前記アルマイト皮膜2
上にアクリル系の感光性樹脂(例えばデユポン社
製の商品名リストン)皮膜3がコーテングされ、
次のニ,ホの工程ではこの感光性樹脂皮膜3に不
要フオトレジスト除去処理が施こされて該皮膜3
の一部が除去される。この不要フオトレジスト除
去処理により残余の皮膜3a,3a間に所望の回
路のアルマイト皮膜のネガパターン2cが形成さ
れる。次のヘの工程ではこのネガパターン2cの
アルマイト皮膜2の上記結晶体2aのセル2bに
二硫化モリブデン(MOS2)6などの非導電物質
が充填されるが、この方法はアルマイト処理した
アルミニウム基板1をテトラチオモリブデン酸ア
ンモニウムの水溶液で二次電解し、アルマイト皮
膜2のセル2b内に二硫化モリブテンの絶縁層4
を形成することによつて行われる。次いで、トの
工程では上記残余の感光性樹脂皮膜3aが塩化メ
チレンなどの溶剤やバフなどの併用により、化学
的または機械的に除去される。次のチの工程では
残余のアルマイト皮膜2の結晶体2aのセル2b
にメツキにより、金7などの導電物質がセル2b
の出口上面2b1より少し盛り上がる程度に充填さ
れる。これにより第3図に示すように、回路の各
接点電極5a,5b,5c,5d,5eを構成す
る導電層5がアルマイト皮膜中に形成される。次
のリの工程では、アルマイト皮膜2に上記のよう
に形成された絶縁層4及び導電層5を有するアル
ミニウム基板1の裏面側に上記ハの工程と同じよ
うにして感光性樹脂皮膜8が形成され、次のヌ,
ル,オの工程において、これらの樹脂皮膜8、ア
ルミニウム基板1に不要フオトレジスト除去処理
及びエツチング処理が施こされ、先に形成した絶
縁層4(ネガパターン2c)に対向するパターン
9が形成される。更にワの工程で残余の感光性樹
脂皮膜8aが上記ヘの工程と同じようにして除去
され、カの最終工程で、上記オの工程で形成され
たパタータ9内に合成樹脂10の絶縁物質を充填
して絶縁層11を形成する。絶縁層11の形成に
より導電層5がアルミニウム基板1によつて相互
に導通するのを防止された回路板形成が完了し、
例えば第3図に示すようなコードスイツチ基板が
得られることになる。
このように形成された回路板は、絶縁層4と導
電層5とが形成されているアルマイト皮膜2の各
結晶体2aとセル2bとは、前記のようにきわめ
て微細でかつ相互に密接しているので各接点5a
〜5e上を摺接する各接触子(図示せず)は各接
点5a〜5eにおいて同時に多数のセル2b上を
摺接し、セル2bに充填されてかつこのセル2b
の出口上面2b1に少し盛り上がり被着形成された
金7に相互に接触するので接点5a〜5eと接触
子との電気的接触不良の恐れは全くなく、更にセ
ル2bに充填された金7などの導電物質はこのセ
ル2bによつて保護されるので耐摩耗性にすぐれ
た長寿命の回路板が得られる。また更に回路のネ
ガパターン形成もフオト処理によるので微細かつ
精度の高いものが容易に得られるなどの利点があ
り、こうして形成された回路板を用いることによ
り、従来に比して格段に小形のコードスイツチが
供給できる。また、上記回路板では接点を構成す
る各導電層5がアルミニウム基板1上に形成され
てはいるが、これらは絶縁層11によつて相互の
導通が阻止されているのでコード信号の拾い出し
には1枚の金属板から分岐した接触子を用いれば
よい。
なお、アルマイト皮膜2のセル2bに充填され
る非導電物質や導電物質は実施例のものに限定さ
れるものではなく、回路のパターン形成も任意に
設定できることは言うまでもない。
【図面の簡単な説明】
図面はいずれも本発明に係り、第1図イ〜カは
工程説明図、第2図はアルマイト皮膜の部分拡大
図、第3図はコードスイツチ用基板の上面図であ
る。 1……アルミニウム基板、2……アルマイト皮
膜、2a……結晶体、2b……セル、2c……ネ
ガパターン、3,8……感光性樹脂皮膜、4,1
1……絶縁層、5……導電層、5a,5b,5
c,5d,5e……接点。

Claims (1)

  1. 【特許請求の範囲】 1 a アルミニウム基板上にセルを有する結晶
    体より成るアルマイト皮膜を形成する第1の工
    程と、 b 上記アルマイト皮膜上に感光性樹脂皮膜を形
    成する第2の工程と、 c 上記感光性樹脂皮膜の一部を除去して所望の
    回路のネガパターンを形成する第3の工程と、 d 上記ネガパターンの上記アルマイト皮膜のセ
    ルに非導電物質を充填する第4の工程と、 e 上記残余のアルマイト皮膜上の感光性樹脂皮
    膜を除去する第5の工程と、 f 上記感光性樹脂皮膜が除去されたアルマイト
    皮膜のセルに導電物質を充填する第6の工程
    と、 g 上記アルミニウム基板のアルマイト皮膜が形
    成された面の裏面側に感光性樹脂皮膜を形成す
    る第7の工程と、 h 上記第7の工程によつて形成された感光性樹
    脂皮膜とアルミニウム基板の裏面とをフオトエ
    ツチング処理によつて前記ネガパターンに対向
    するパターンに除去する第8の工程と、 i 上記第8の工程によつて残余された感光性樹
    脂皮膜を除去する第9の工程と、 j 上記第8の工程によつて上記アルミニウム基
    板に形成された前記パターンに非導電物質を充
    填する第10の工程とより成ることを特徴とする
    回路板の形成方法。
JP1921282A 1982-02-09 1982-02-09 回路板の形成方法 Granted JPS58137915A (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP1921282A JPS58137915A (ja) 1982-02-09 1982-02-09 回路板の形成方法
US06/430,601 US4463084A (en) 1982-02-09 1982-09-30 Method of fabricating a circuit board and circuit board provided thereby

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP1921282A JPS58137915A (ja) 1982-02-09 1982-02-09 回路板の形成方法

Publications (2)

Publication Number Publication Date
JPS58137915A JPS58137915A (ja) 1983-08-16
JPH0222966B2 true JPH0222966B2 (ja) 1990-05-22

Family

ID=11993058

Family Applications (1)

Application Number Title Priority Date Filing Date
JP1921282A Granted JPS58137915A (ja) 1982-02-09 1982-02-09 回路板の形成方法

Country Status (1)

Country Link
JP (1) JPS58137915A (ja)

Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP5385682B2 (ja) 2009-05-19 2014-01-08 新光電気工業株式会社 電子部品の実装構造
JP5249132B2 (ja) 2009-06-03 2013-07-31 新光電気工業株式会社 配線基板
JP5460155B2 (ja) 2009-07-14 2014-04-02 新光電気工業株式会社 キャパシタ及び配線基板
JP5280309B2 (ja) 2009-07-17 2013-09-04 新光電気工業株式会社 半導体装置及びその製造方法
JP5436963B2 (ja) 2009-07-21 2014-03-05 新光電気工業株式会社 配線基板及び半導体装置
JP2011151185A (ja) 2010-01-21 2011-08-04 Shinko Electric Ind Co Ltd 配線基板及び半導体装置
JP5363384B2 (ja) 2010-03-11 2013-12-11 新光電気工業株式会社 配線基板及びその製造方法

Also Published As

Publication number Publication date
JPS58137915A (ja) 1983-08-16

Similar Documents

Publication Publication Date Title
US5262226A (en) Anisotropic conductive film
HU208715B (en) Method for forming printed circuits with selectively etchable metal layers, as well as method for final forming pattern of high definition
EP0053490B1 (en) Method for manufacturing a fine-patterned thick film conductor structure
US4125441A (en) Isolated bump circuitry on tape utilizing electroforming
JP2001521620A (ja) 多数の接触端子を備える、半導体チップの試験用カードの製造方法
US2834723A (en) Method of electroplating printed circuits
US3935635A (en) Method of producing a semiconductor arrangement
US4463084A (en) Method of fabricating a circuit board and circuit board provided thereby
JPH0222966B2 (ja)
US3890177A (en) Technique for the fabrication of air-isolated crossovers
US3314869A (en) Method of manufacturing multilayer microcircuitry including electropolishing to smooth film conductors
US6077727A (en) Method for manufacturing lead frame
US4098637A (en) Process for the production of a planar conductor path system for integrated semiconductor circuits
JP2003347149A (ja) 金属転写シート、金属転写シートの製造方法およびセラミックコンデンサの製造方法
JPS58141595A (ja) 回路板の形成方法
US3787961A (en) Chip-shaped, non-polarized solid state electrolytic capacitor and method of making same
US3836446A (en) Semiconductor devices manufacture
JPH02301118A (ja) 固体電解コンデンサの製造方法
US3634202A (en) Process for the production of thick film conductors and circuits incorporating such conductors
KR100275372B1 (ko) 회로기판 제조방법
US3554876A (en) Process for etching and electro plating a printed circuit
JPH02277242A (ja) 半導体装置の製造方法
JPS61193315A (ja) 平滑スイツチ基板の製造方法
KR100202498B1 (ko) 평탄화 방법
JPS6032357B2 (ja) 容量素子の製造方法