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JPH0247898B2 - KINSETSUSUITSUCHI - Google Patents
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JPH0247898B2 - KINSETSUSUITSUCHI - Google Patents

KINSETSUSUITSUCHI

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JPH0247898B2
JPH0247898B2 JP15371883A JP15371883A JPH0247898B2 JP H0247898 B2 JPH0247898 B2 JP H0247898B2 JP 15371883 A JP15371883 A JP 15371883A JP 15371883 A JP15371883 A JP 15371883A JP H0247898 B2 JPH0247898 B2 JP H0247898B2
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transistor
circuit
capacitor
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output
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Shinichi Kuno
Shigeru Aoshima
Giichi Kawashima
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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K17/00Electronic switching or gating, i.e. not by contact-making and –breaking
    • H03K17/94Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the way in which the control signals are generated
    • H03K17/945Proximity switches
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
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    • H03K17/082Modifications for protecting switching circuit against overcurrent or overvoltage by feedback from the output to the control circuit
    • H03K17/0826Modifications for protecting switching circuit against overcurrent or overvoltage by feedback from the output to the control circuit in bipolar transistor switches

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Description

【発明の詳細な説明】 この発明は近接スイツチに係り、とくに電流投
入時の誤動作防止用タイマー回路の改良に関する
ものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a proximity switch, and particularly to an improvement in a timer circuit for preventing malfunction when current is turned on.

一般にこの種の近接スイツチ10は第1図に示
すように近接センサ用IC回路1と、このIC回路
の出力電流容量を補うための出力トランジスタ2
0とで構成される。そしてそのIC回路1は内部
に発振回路2、コンパレータ3、積分回路4、コ
ンパレータ5、出力回路6、定電圧回路7および
電源リセツト回路8を有しており、検出コイル1
1、共振コンデンサ16、感度調整用可変抵抗1
2、側路コンデンサ13、積分コンデンサ14、
電源リセツト用コンデンサ15などが外付けされ
る。
Generally, this type of proximity switch 10, as shown in FIG. 1, includes a proximity sensor IC circuit 1 and an output transistor 2 for supplementing the output current capacity of this IC circuit.
0. The IC circuit 1 includes an oscillation circuit 2, a comparator 3, an integration circuit 4, a comparator 5, an output circuit 6, a constant voltage circuit 7, and a power supply reset circuit 8.
1, resonance capacitor 16, variable resistor for sensitivity adjustment 1
2, bypass capacitor 13, integrating capacitor 14,
A power supply reset capacitor 15 and the like are externally connected.

したがつて検出コイル11に対して金属体が接
近または離間することにより発振回路2が発振を
開始または停止し、出力回路6よりLまたはHの
出力が得られる。
Therefore, when the metal body approaches or separates from the detection coil 11, the oscillation circuit 2 starts or stops oscillating, and the output circuit 6 produces an L or H output.

そして従来は電源リセツト回路として第2図に
示すものがある。これは定電流源30,58、ト
ランジスタ40,51〜54、抵抗55〜57お
よびコンデンサ41から構成されている。
A conventional power supply reset circuit is shown in FIG. This is composed of constant current sources 30, 58, transistors 40, 51-54, resistors 55-57, and capacitor 41.

今、電源を投入したときコンデンサ41の電圧
VCTは VCT=Q/C=IC×t/C となる。ここでQ:コンデンサの負荷、C:コン
デンサの容量、IC:充電電流である。
Now, when the power is turned on, the voltage of capacitor 41 is
V CT becomes V CT =Q/C=I C ×t/C. Here, Q: load of the capacitor, C: capacitance of the capacitor, and I C : charging current.

よつてトランジスタ40がオフとなり、リセツ
トが解除されると、コンデンサ41の電圧VCT
第3図に示すように零から直線的に上昇を始め
る。そしてトランジスタ51のベース電位VTH
りコンデンサ電圧VCTが大きくなるとトランジス
タ50がオンとなり、同時にトランジスタ51,
54がオフとなり、トランジスタ51のベース電
位が下り、VTLとなる。このため、コンデンサ電
圧VCTがVTLより小さくならないかぎりトランジ
スタ51はオフとなり、トランジスタ50に電流
I2が流れる。このときコンデンサ41に流れる電
流は電流源I1からトランジスタ50のベースに流
入する電流を減じた値となり、電圧VCTの上昇速
度は以前より遅くなりながら上昇し、内部供給電
圧VSに近いところで安定する。
Therefore, when the transistor 40 is turned off and the reset is released, the voltage V CT of the capacitor 41 starts to rise linearly from zero as shown in FIG. When the capacitor voltage V CT becomes larger than the base potential V TH of the transistor 51, the transistor 50 turns on, and at the same time, the transistors 51,
54 is turned off, and the base potential of the transistor 51 drops to VTL . Therefore, unless the capacitor voltage V CT becomes smaller than V TL , transistor 51 is turned off and current flows through transistor 50.
I 2 flows. At this time, the current flowing into the capacitor 41 is equal to the value obtained by subtracting the current flowing into the base of the transistor 50 from the current source I1 , and the rising speed of the voltage V CT increases at a slower rate than before, until it reaches a point close to the internal supply voltage V S. Stabilize.

このような状態で過電流検出回路60が出力ト
ランジスタ20の過電流を検出すると過電流検出
回路60の出力はトランジスタ40をオンにし
て、このタイマー回路のコンデンサを放電し、リ
セツトを計る。そして電圧VCTの値がVTLを下回
るとトランジスタ50,52,53がオフし、逆
にトランジスタ51,54がオンし、トランジス
タ51のベース電位は上りVTHとなる。よつて出
力禁止状態となるので、出力トランジスタ20は
オフし、過電流検出回路60は反転し、トランジ
スタ40はオフとなる。このためコンデンサ41
は充電を開始し、その充電電圧VCTが電圧VTH
越えるまで続く。そして電圧VCTが電圧VTHを越
えると出力禁止が解除され、出力トランジスタ2
0にふたたび過電流が流れるのでトランジスタ4
0がオンとなり電圧VCTが電圧VTLを下回るまで
放電される。この繰返しによつて出力トランジス
タ20の状態は第4図に示すようになる。この図
から分るようにオンパルスの最初の幅はそれ以後
のパルスの幅よりも大きい。なぜならば出力オン
パルスの幅はコンデンサ41の放電時間に依存す
るが、最初は内部供給電圧VSから電圧VTLまでの
放電時間t1であり、それ以後は電圧VTHから電圧
VTLまでの放電時間t2でよく、(VS−VTL)>(VTH
−VTL)、よつてt1>t2となるからである。
When the overcurrent detection circuit 60 detects an overcurrent in the output transistor 20 in this state, the output of the overcurrent detection circuit 60 turns on the transistor 40, discharges the capacitor of this timer circuit, and performs a reset. When the value of voltage V CT falls below V TL , transistors 50, 52, and 53 are turned off, and conversely, transistors 51 and 54 are turned on, and the base potential of transistor 51 rises to V TH . As a result, the output is prohibited, so the output transistor 20 is turned off, the overcurrent detection circuit 60 is inverted, and the transistor 40 is turned off. Therefore, capacitor 41
begins charging until its charging voltage V CT exceeds the voltage V TH . Then, when the voltage V CT exceeds the voltage V TH , the output inhibition is canceled and the output transistor 2
Since overcurrent flows again to 0, transistor 4
0 is turned on and the voltage VCT is discharged until it becomes lower than the voltage VTL . By repeating this process, the state of the output transistor 20 becomes as shown in FIG. As can be seen from this figure, the initial width of the on-pulse is larger than the width of subsequent pulses. This is because the width of the output on-pulse depends on the discharging time of the capacitor 41, but initially it is the discharging time t 1 from the internal supply voltage V S to the voltage V TL , and then from the voltage V TH to the voltage V TL .
The discharge time to V TL may be t 2 , and (V S − V TL ) > (V TH
−V TL ), so t 1 > t 2 .

このように出力トランジスタ20が過電流に対
して時間t2より長い時間であるt1の間耐えなけれ
ばならない。
In this way, the output transistor 20 must withstand the overcurrent for a time t1 , which is longer than the time t2 .

一般にトランジスタの破壊特性は平均消費電力
と瞬間の消費電力に依存することが知られている
が、瞬間消費電力の面から、発振から非発振へ移
つたときの第1番目のオンパルスが以後のものよ
り長いのは不利で、その分出力トランジスタ20
の破壊特性の良いものを必要とする。
It is generally known that the breakdown characteristics of a transistor depend on average power consumption and instantaneous power consumption, but in terms of instantaneous power consumption, the first on-pulse when transitioning from oscillation to non-oscillation is It is disadvantageous that the output transistor 20 is longer.
A material with good breaking properties is required.

この発明はこのような従来の欠点を解消しよう
とするもので、以下図によつてこの発明の一実施
例について説明する。
The present invention aims to eliminate such conventional drawbacks, and one embodiment of the present invention will be described below with reference to the drawings.

すなわち第5図はこの発明における電源リセツ
ト回路で、30は第1の定電流源、31は第2の
定電流源、32,33,34,35,36,3
7,38,39,40はトランジスタ、41はコ
ンデンサ、49はダイオードである。なお61は
出力禁止回路、60は過電流検出回路、20は出
力トランジスタである。そしてトランジスタ36
と37によりシユミツト回路が形成されている。
That is, FIG. 5 shows a power supply reset circuit according to the present invention, in which 30 is a first constant current source, 31 is a second constant current source, 32, 33, 34, 35, 36, 3.
7, 38, 39, and 40 are transistors, 41 is a capacitor, and 49 is a diode. Note that 61 is an output prohibition circuit, 60 is an overcurrent detection circuit, and 20 is an output transistor. and transistor 36
and 37 form a Schmitt circuit.

この図において電源が投入され、トランジスタ
40がオフとなりコンデンサ41の短絡状態を開
放すると、コンデンサ41に充電が開始され、
VCTはゼロから上昇を開始する。コンデンサ41
の電圧VCTがゼロに近いとき、トランジスタ36
はオフ、トランジスタ37はオンであり、トラン
ジスタ37の電流はトランジスタ35で決まる電
流値I2が流れ、トランジスタ36,37のエミツ
タ電圧VEは、トランジスタ34の飽和電圧
(VSAT0.1V)、ダイオード49の電圧降下分
(=nVD)、トランジスタ37のベース−エミツタ
間電圧(≒VD)をVSから減じた電圧 VE≒VS−VSAT−nVD−VD となつている。
In this figure, when the power is turned on and the transistor 40 is turned off to release the short-circuited state of the capacitor 41, charging of the capacitor 41 starts.
V CT starts rising from zero. capacitor 41
When the voltage V CT is close to zero, the transistor 36
is off, the transistor 37 is on, the current value I 2 determined by the transistor 35 flows through the transistor 37, and the emitter voltage V E of the transistors 36 and 37 is equal to the saturation voltage (V SAT 0.1V) of the transistor 34, the diode The voltage V E ≈V S −V SAT −nV D −V D is obtained by subtracting the base-emitter voltage ( ≈V D ) of the transistor 37 from V S by the voltage drop of 49 (=nV D ).

よつてトランジスタ36はベース電圧である
VCTがVEよりVDだけ高い値となるまでオフをつづ
ける。トランジスタ36がオフからオンへ反転す
るためのVCTの臨界電圧VTHは VTH=VE+VD =VS−VSAT(0.1V)−nVD となり、VCTはVTHに達するまで上昇をつづける。
そして、VCTがVTHに達すると、トランジスタ3
6がオンするが、トランジスタ37のベースへ流
れ込んでいた電流はトランジスタ36へ流れ込む
ので、トランジスタ37はオフする。トランジス
タ36には、トランジスタ34,35との電流容
量の関係で電流が流れるが、トランジスタ35の
エミツタに流れる電流はトランジスタ34から供
給される電流I2/Nとトランジスタ36のベース
から流れ込む電流を加えたものが流れる。
Therefore, transistor 36 has a base voltage
It continues to turn off until V CT becomes a value higher than V E by V D. The critical voltage V TH of V CT for transistor 36 to flip from off to on is V TH = V E + V D = V S − V SAT (0.1V) − nV D , and V CT increases until it reaches V TH Continue.
Then, when V CT reaches V TH , transistor 3
6 is turned on, but the current flowing into the base of transistor 37 flows into transistor 36, so transistor 37 is turned off. A current flows through the transistor 36 due to its current capacity with the transistors 34 and 35, but the current flowing to the emitter of the transistor 35 is the sum of the current I 2 /N supplied from the transistor 34 and the current flowing from the base of the transistor 36. things flow.

ここでもしI1+I2/N<I2であれば、IX=I2
(I1+I2/N)というコンデンサ放電電流が生じ、
トランジスタ36のベースおよびエミツタ電圧は
低下していく。やがてトランジスタ35のエミツ
タ−コレクタ間の飽和電圧VSATすなわち零に近い
値たとえば0.1Vになると、トランジスタ35の
通電能力がI2より低下していき、I1+I2/Nとな
つたところで安定する。
Here, if I 1 + I 2 /N<I 2 , then I X = I 2
A capacitor discharge current of (I 1 + I 2 /N) occurs,
The base and emitter voltages of transistor 36 decrease. Eventually, when the saturation voltage V SAT between the emitter and collector of the transistor 35 reaches a value close to zero, for example 0.1V, the current carrying capacity of the transistor 35 becomes lower than I 2 and stabilizes when it reaches I 1 + I 2 /N. .

以上の状態のVCTを表したものが第7図であ
る。トランジスタ36がオフするVCTの値、VTL
は VTL=VD+VSAT となる。
FIG. 7 shows V CT in the above state. The value of V CT at which transistor 36 is turned off, V TL
becomes V TL = V D + V SAT .

出力トランジスタ20がオン状態で過電流が流
れると、過電流検出回路60によりタイマー回路
をリセツトするようにトランジスタ40のベース
電位が上る。そしてこのトランジスタがオンし、
コンデンサ41を放電するがコンデンサ41の電
圧VCTは電圧VTLに近い電圧にあるため電圧VCT
電圧VTLを下回る電圧に達する時間はひじように
小さい。電圧VCTがVTLを下回るとトランジスタ
36がオフし、トランジスタ34からトランジス
タ37にベース電流が流れるのでトランジスタ3
7がオンする。トランジスタ37のベース電位お
よびエミツタ電位は電源投入時と同様となり、ト
ランジスタ36のベース電位が電圧VTH以上にな
るまで反転しない。この状態は出力禁止状態で、
出力トランジスタ20の電流がなくなるので、ト
ランジスタ40がオフとなり、コンデンサ41の
充電が開始され、この充電はその充電電圧VCT
電圧VTHを越えるまで続く。そして電圧VCTが電
圧VTHを越えると出力禁止が解除され、出力トラ
ンジスタ20にふたたび過電流が流れるので、ト
ランジスタ40がオンとなり電圧VCTが電圧VTL
を下回るまで放電される。この繰返しによつて出
力トランジスタ20の状態は第8図に示すように
なる。この図からオンパルスの最初の幅はそれ以
後のパルスの幅よりも小さいことが分る。
When the output transistor 20 is on and an overcurrent flows, the overcurrent detection circuit 60 raises the base potential of the transistor 40 so as to reset the timer circuit. Then this transistor turns on,
Although the capacitor 41 is discharged, since the voltage V CT of the capacitor 41 is close to the voltage V TL , the time for the voltage V CT to reach a voltage lower than the voltage V TL is as short as an elbow. When the voltage V CT falls below V TL , the transistor 36 is turned off, and the base current flows from the transistor 34 to the transistor 37, so that the transistor 3
7 turns on. The base potential and emitter potential of the transistor 37 are the same as when the power is turned on, and are not inverted until the base potential of the transistor 36 becomes equal to or higher than the voltage VTH . This state is a state in which output is prohibited.
Since the current in output transistor 20 is gone, transistor 40 is turned off and charging of capacitor 41 begins, which continues until its charging voltage V CT exceeds voltage V TH . When the voltage V CT exceeds the voltage V TH , the output inhibition is canceled and overcurrent flows through the output transistor 20 again, so the transistor 40 is turned on and the voltage V CT becomes the voltage V TL.
is discharged until it drops below . By repeating this process, the state of the output transistor 20 becomes as shown in FIG. It can be seen from this figure that the initial width of the on-pulse is smaller than the width of subsequent pulses.

なお第9図は第2図に示す従来例とこの発明に
おける実施例すなわち第5図との構成を参考まで
に比較するもので、aが従来例を、またbがこの
発明の実施例を示している。
In addition, FIG. 9 compares the configurations of the conventional example shown in FIG. 2 and the embodiment of the present invention, that is, FIG. 5, for reference; a indicates the conventional example, and b indicates the embodiment of the present invention. ing.

この発明は上述のように検出コイルを有する発
振回路の発振振幅に応じて出力信号を生じ、コン
デンサを有するタイマー回路と、タイマー回路が
タイムアツプ以前において出力信号を強制的に所
定の状態に保持する出力回路と、出力回路の過負
荷状態である過電流状態を検出し、検出信号によ
り上記タイマー回路をリセツトする過電流検出回
路を有する近接スイツチにおいて、上記タイマー
回路はコンデンサとコンデンサを充電する第1の
定電流源と、コンデンサを放電する第1のトラン
ジスタと、第2の定電流源をコレクタ負荷とし、
コンデンサ充電電圧をベースに接続した第2のト
ランジスタと、第2のトランジスタのコレクタ、
エミツタをベース、エミツタに接続した第3のト
ランジスタと、第2、第3のトランジスタのエミ
ツタからの電流が流れ込む第3の定電流源を有す
るシユミツト回路において、前記第1の定電流源
の電流と第2の定電流源の和より、第3の定電流
源の電流が大きく設定されているため、過負荷状
態において出力トランジスタがオンし、その出力
が禁止されるまでの第1出力パルスの幅がそれ以
後の出力パルス幅よりはるかに狭くなる。したが
つて出力トランジスタは定常状態のパルス幅に相
当する瞬間電力に耐えればよいので、それに応じ
て耐破壊特性の小さい出力トランジスタを使用し
うる利点がある。
As described above, this invention generates an output signal according to the oscillation amplitude of an oscillation circuit having a detection coil, and includes a timer circuit having a capacitor, and an output signal for forcibly holding the output signal in a predetermined state before the timer circuit times up. and a proximity switch having an overcurrent detection circuit that detects an overcurrent condition, which is an overload condition of the output circuit, and resets the timer circuit with a detection signal, the timer circuit includes a capacitor and a first circuit that charges the capacitor. A constant current source, a first transistor discharging the capacitor, and a second constant current source are used as collector loads,
a second transistor having the capacitor charging voltage connected to its base; and a collector of the second transistor;
In a Schmitt circuit having an emitter as a base, a third transistor connected to the emitter, and a third constant current source into which current from the emitters of the second and third transistors flows, the current of the first constant current source and Since the current of the third constant current source is set larger than the sum of the second constant current sources, the width of the first output pulse until the output transistor turns on and its output is inhibited in an overload state. is much narrower than the subsequent output pulse width. Therefore, since the output transistor only has to withstand the instantaneous power corresponding to the steady-state pulse width, there is an advantage that an output transistor having a correspondingly low breakdown resistance can be used.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は一般の近接スイツチを示すブロツク回
路図、第2図は従来の電源リセツト回路の回路
図、第3図はタイマー回路の特性図、第4図はコ
ンデンサの放電特性と出力パルスとの関係を示す
特性図、第5図はこの発明の近接スイツチにおけ
る電源リセツト回路の一実施例を示す回路図、第
6図は第5図の等価回路図、第7図はタイマー回
路の特性図、第8図は出力トランジスタの出力波
形図、第9図は第2図と第5図との比較を示す等
価回路図である。 30……第1の定電流源、31……第2の定電
流源、32,33,34,35,36,37,3
8,39,40……トランジスタ、49……ダイ
オード、41……コンデンサ、61……出力禁止
回路、20……出力トランジスタ、60……過電
流検出回路。
Fig. 1 is a block circuit diagram of a general proximity switch, Fig. 2 is a circuit diagram of a conventional power supply reset circuit, Fig. 3 is a characteristic diagram of a timer circuit, and Fig. 4 shows the relationship between capacitor discharge characteristics and output pulses. A characteristic diagram showing the relationship, FIG. 5 is a circuit diagram showing an embodiment of the power supply reset circuit in the proximity switch of the present invention, FIG. 6 is an equivalent circuit diagram of FIG. 5, and FIG. 7 is a characteristic diagram of the timer circuit. FIG. 8 is an output waveform diagram of the output transistor, and FIG. 9 is an equivalent circuit diagram showing a comparison between FIG. 2 and FIG. 5. 30...First constant current source, 31...Second constant current source, 32, 33, 34, 35, 36, 37, 3
8, 39, 40...transistor, 49...diode, 41...capacitor, 61...output prohibition circuit, 20...output transistor, 60...overcurrent detection circuit.

Claims (1)

【特許請求の範囲】[Claims] 1 検出コイルを有する発振回路の発振振幅に応
じて出力信号を生ずる近接スイツチにおいて、タ
イマー回路と、このタイマー回路によつて制御さ
れ、上記タイマー回路がタイムアツプする以前に
おいて出力信号を強制的に所定の状態に保持する
出力禁止回路と、出力回路の出力電流が過電流で
あることを検出し、この過電流検出信号を出力
し、上記タイマー回路をリセツトする過電流検出
回路とを備え、上記タイマー回路は、タイマー用
コンデンサとコンデンサ充電用の第1の電流源
と、タイマー用コンデンサを放電する放電回路
と、コンデンサ充電電圧を入力とするシユミツト
回路を有し、上記シユミツト回路は、第2の電流
源をコレクタ側の負荷とし、エミツタ側に第3の
電流源を有し、ベースに上記タイマー用コンデン
サの一端が接続された第1のトランジスタと、こ
の第1のトランジスタのコレクタにベースが接続
され、第1のトランジスタのエミツタにエミツタ
が接続された第2のトランジスタとを少なくとも
有し、上記第1の電流源の電流容量と上記第2の
電流源の電流容量の和が上記第3の電流源の電流
容量より小さく、上記第2の電流源の電流容量を
上記第1のトランジスタの電流増幅率で割つた値
より上記第1の電流源の電流容量が大きいことを
特徴とするシユミツト回路を上記タイマー回路に
有する近接スイツチ。
1. A proximity switch that generates an output signal according to the oscillation amplitude of an oscillation circuit having a detection coil includes a timer circuit, and is controlled by the timer circuit, and forcibly outputs the output signal to a predetermined value before the timer circuit times up. and an overcurrent detection circuit that detects that the output current of the output circuit is an overcurrent, outputs the overcurrent detection signal, and resets the timer circuit. has a timer capacitor, a first current source for charging the capacitor, a discharge circuit that discharges the timer capacitor, and a Schmitt circuit that receives the capacitor charging voltage as input, and the Schmitt circuit has a second current source. is a load on the collector side, has a third current source on the emitter side, and has a base connected to one end of the timer capacitor, and a base connected to the collector of the first transistor, and a second transistor whose emitter is connected to the emitter of the first transistor, and the sum of the current capacity of the first current source and the current capacity of the second current source is the third current source. The Schmitt circuit described above is characterized in that the current capacity of the first current source is smaller than the current capacity of the second current source divided by the current amplification factor of the first transistor. Proximity switch in the timer circuit.
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JP15371883A Expired - Lifetime JPH0247898B2 (en) 1983-08-23 1983-08-23 KINSETSUSUITSUCHI

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JPS63187813A (en) * 1987-01-30 1988-08-03 Yamatake Honeywell Co Ltd Overcurrent preventing circuit for contactless switch
JPS63187812A (en) * 1987-01-30 1988-08-03 Yamatake Honeywell Co Ltd Overcurrent preventing circuit for proximity switch

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