JPH0412050B2 - - Google Patents
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- JPH0412050B2 JPH0412050B2 JP56211151A JP21115181A JPH0412050B2 JP H0412050 B2 JPH0412050 B2 JP H0412050B2 JP 56211151 A JP56211151 A JP 56211151A JP 21115181 A JP21115181 A JP 21115181A JP H0412050 B2 JPH0412050 B2 JP H0412050B2
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- H04J3/10—Arrangements for reducing cross-talk between channels
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
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- Electronic Switches (AREA)
Description
【発明の詳細な説明】
本発明は、搬送波または変調波等の入力信号を
スイツチングするためのスイツチ回路に関す。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a switch circuit for switching input signals such as carrier waves or modulated waves.
時分割通信方式やSCPC(Single channel per
Carrier)方式においては、IF(中間周波)帯、ま
たはRF(無線周波)帯において、搬送波または変
調波をスイツチングしてバースト化された出力信
号を発生する。しかして従来、このようなスイツ
チングは通常、PINダイオードを用いて、そのオ
ン、オフによる抵抗変化を利用してスイツチング
を行うスイツチ回路によつて行われている。 Time division communication method and SCPC (Single channel per
In the carrier type, a burst output signal is generated by switching a carrier wave or a modulated wave in an IF (intermediate frequency) band or an RF (radio frequency) band. Conventionally, however, such switching has normally been performed by a switch circuit that uses a PIN diode and performs switching by utilizing resistance changes caused by turning on and off the PIN diode.
第1図は従来の代表的なスイツチ回路の構成を
示している。 FIG. 1 shows the configuration of a typical conventional switch circuit.
同図において、入力信号IFまたはRF信号をバ
ースト化するためのオン/オフ信号は、ゲート1
を経て抵抗2、コンデンサ3からなる時定数回路
(積分回路)に加えられる。時定数回路の出力は
チヨークコイル4を経てPINダイオード5に加え
られ、これによつてダイオード電流が流れる。
PINダイオード5の抵抗はオフの状態では無限大
に近く非常に大きいが、オン状態では極めて小さ
く殆んどゼロに近くなる。従つて、PINダイオー
ド5がオフの状態では入力信号はコンデンサ6,
7を経て出力されるが、PINダイオード5がオン
状態では出力信号を生じない。このようにして第
1図の回路によつてバースト信号出力を得ること
が出来る。第1図において、チヨークコイル4、
PINダイオード5、コンデンサ6,7はスイツチ
部8を構成している。また第1図は信号に対して
並列に接続されているが、信号に対して直列に挿
入するようにしても同様の効果が得られる。 In the same figure, the on/off signal for bursting the input signal IF or RF signal is gate 1.
The signal is then added to a time constant circuit (integrator circuit) consisting of a resistor 2 and a capacitor 3. The output of the time constant circuit is applied to the PIN diode 5 via the choke coil 4, thereby causing a diode current to flow.
The resistance of the PIN diode 5 is very large, close to infinity in the off state, but extremely small and almost zero in the on state. Therefore, when the PIN diode 5 is off, the input signal is transferred to the capacitor 6,
However, when the PIN diode 5 is on, no output signal is generated. In this way, a burst signal output can be obtained by the circuit of FIG. In FIG. 1, the chiyoke coil 4,
The PIN diode 5 and capacitors 6 and 7 constitute a switch section 8. Further, although in FIG. 1 the connectors are connected in parallel to the signal, the same effect can be obtained even if the connectors are inserted in series with the signal.
第1図の回路において、抵抗2、コンデンサ3
からなる時定数回路がない場合は、入力信号のス
イツチングは第2図aに示す矩形波からなるオ
ン/オフ信号波形に従つて行われる。このような
状態ではバースト信号出力の前縁および後縁で瞬
時応答に基づくパルスが生じ、これによつて不要
波が発生する。このため抵抗2、コンデンサ3か
らなる時定数回路を用いることによつて、ダイオ
ード電流の立上り、立下りにおける変化を緩かに
して不要波の発生を防止している。 In the circuit shown in Figure 1, resistor 2 and capacitor 3
If there is no time constant circuit, the switching of the input signal is performed according to the on/off signal waveform consisting of a rectangular wave as shown in FIG. 2a. In such a state, pulses based on the instantaneous response occur at the leading and trailing edges of the burst signal output, thereby generating unnecessary waves. For this reason, by using a time constant circuit consisting of a resistor 2 and a capacitor 3, the rise and fall of the diode current are made gentler and the generation of unnecessary waves is prevented.
しかしながら、PINダイオードがオンになると
きは、その正特性によつて高速度に応答するので
抵抗2、コンデンサ3からなる時定数回路の時定
数とほぼ等しい時定数の電流応答波形が得られる
が、オフになるときはPINダイオードの容量に蓄
積されていた電荷が放電するために応答波形は一
般に時定数τによつて決まる応答より長くなる。 However, when the PIN diode turns on, it responds at high speed due to its positive characteristics, so a current response waveform with a time constant approximately equal to the time constant of the time constant circuit consisting of resistor 2 and capacitor 3 is obtained. When turned off, the charge accumulated in the capacitance of the PIN diode is discharged, so the response waveform generally becomes longer than the response determined by the time constant τ.
しかし、スイツチ回路におけるオン/オフ信号
の立上り、立下り波形により整形される時定数は
等しいことが望ましい。 However, it is desirable that the time constants shaped by the rising and falling waveforms of the on/off signal in the switch circuit be equal.
第2図は第1図のスイツチ回路における各部の
信号の波形を示す。同図において、aはスイツチ
ングのために加えられるオン/オフ信号の波形
を示す。bは抵抗2、コンデンサ3からなる時定
数回路の出力波形を示し、立上りおよび立下り
において時定数τの過渡応答を生じている。cは
PINダイオード5の電流応答波形を示し、オン
になるときの時定数τAは前記時定数回路の時定数
τにほぼ等しいが、オフになるときの時定数τBは
時定数τよりも長い。すなわち、ττA<τBの関
係になる。dはバースト信号出力の波形を示
し、その立上りは立下りに比べておそい。 FIG. 2 shows waveforms of signals at various parts in the switch circuit of FIG. 1. In the figure, a indicates the waveform of an on/off signal applied for switching. b shows an output waveform of a time constant circuit consisting of a resistor 2 and a capacitor 3, and a transient response with a time constant τ occurs at rise and fall. c is
The current response waveform of the PIN diode 5 is shown, and the time constant τ A when turned on is almost equal to the time constant τ of the time constant circuit, but the time constant τ B when turned off is longer than the time constant τ. In other words, the relationship is ττ A < τ B. d shows the waveform of the burst signal output, the rise of which is slower than the fall.
このようにスイツチング用ダイオードの応答に
基づいてバースト信号の振幅変化特性に影響をう
けることは、信号品質保持の上から好ましくな
い。そのため従来はダイオードがオフになると
き、これに逆電圧を加えることによつて放電時間
を短かくする方法が用いられていた。 In this way, it is undesirable from the viewpoint of maintaining signal quality that the amplitude change characteristics of the burst signal are affected based on the response of the switching diode. Conventionally, therefore, a method has been used to shorten the discharge time by applying a reverse voltage to the diode when it is turned off.
第3図はダイオードの蓄積電荷の影響を防止し
たドライバ回路の構成を示している。同図におい
て、PINダイオードに電流を流すためのオン/オ
フ信号に応じて、ダイオードオンするときは正電
圧+Vaを出力し、オフにするときは負電圧−Va
を切り替えて出力する。スイツチ9の出力は抵抗
2、コンデンサ3(第1図)からなる時定数回路
を経て、第1図に示されたスイツチ部8へ供給さ
れる。従つてPINダイオード5はオフになると
き、その電荷によつて逆電流が流れて放電時間が
短縮される。 FIG. 3 shows the configuration of a driver circuit that prevents the influence of accumulated charge in the diode. In the same figure, in response to the on/off signal that causes current to flow through the PIN diode, when the diode is turned on, a positive voltage +Va is output, and when it is turned off, a negative voltage -Va is output.
Switch and output. The output of the switch 9 is supplied to the switch section 8 shown in FIG. 1 through a time constant circuit consisting of a resistor 2 and a capacitor 3 (see FIG. 1). Therefore, when the PIN diode 5 is turned off, its charge causes a reverse current to flow, shortening the discharge time.
第4図は第3図に示されたドライバ回路を用い
た場合の電流応答波形を示している。第3図のド
ライバ回路では、逆電圧を加えてダイオード電荷
の放電時間を短縮するようにしたので、オフにな
るときの電流応答波形の時定数はτcであつて、第
2図の場合に比べて短縮されている。 FIG. 4 shows a current response waveform when the driver circuit shown in FIG. 3 is used. In the driver circuit shown in Figure 3, a reverse voltage is applied to shorten the discharge time of the diode charge, so the time constant of the current response waveform when turning off is τ c , and in the case of Figure 2, It has been shortened in comparison.
しかしながら、第3図に示されたドライバ回路
を用いる場合も、時定数回路の時定数が大きいと
きは、その効果が十分でない。すなわち時定数回
路の抵抗とPINダイオードの容量とで定まる時定
数に従つて放電が行われるため、抵抗値が大きい
ときは放電時間は長くなる欠点を有する。 However, even when using the driver circuit shown in FIG. 3, the effect is not sufficient when the time constant of the time constant circuit is large. That is, since discharge is performed according to a time constant determined by the resistance of the time constant circuit and the capacitance of the PIN diode, there is a drawback that the discharge time becomes longer when the resistance value is large.
上記の改善策として、第5図に示す如く放電時
にはダイオードD′10によつて時定数回路の抵
抗R12を短絡してダイオードD′10の抵抗R′1
1が時定数となる方式が考えられ良い結果が得ら
れている。(R1R′)
第5図において、演算増幅器以下バツフアアン
プと記す12より出力される第6図eに示す正電
圧+V、負電圧−Vを有するスイツチング波形
で、PINダイオード5を制御すると第6図fに示
す波形が得られる。波形f−1(立上り)、f−
2(立下り)は抵抗2、コンデンサ3によつて整
形された波形(時定数R1・C1)で立下り波形f
−2の時定数τf−2が立上り時定数τf−1より大
きいのはダイオード5の容量が時定数に附加され
ているからである。 As an improvement measure for the above problem, as shown in FIG.
A method in which 1 is the time constant has been considered and good results have been obtained. (R 1 R') In FIG. 5, when the PIN diode 5 is controlled with a switching waveform having a positive voltage +V and a negative voltage -V as shown in FIG. The waveform shown in Figure f is obtained. Waveform f-1 (rising), f-
2 (falling) is a waveform shaped by resistor 2 and capacitor 3 (time constant R 1 · C 1 ), and is a falling waveform f
The reason why the time constant τf-2 of -2 is larger than the rising time constant τf-1 is because the capacitance of the diode 5 is added to the time constant.
ダイオード5が接続された状態でコンデンサ
(C1)3、ダイオード5の放電電圧が0ボルト
(0V)13を過ぎ負電圧になるとダイオードD′1
0が動作し、立下り特性が急峻になり波形f−3
が整形され、時定数は△tとなる。従つて立下り
の時定数はτf−3になる。この場合、ダイオード
D′10が逆電導通になつている時間だけ早くな
り、それ以前ではPINダイオード5による放電時
間が支配的となり目的の時定数を附加した抵抗
(R1)2、コンデンサ(C1)3より得ることが困
難である。 With diode 5 connected, when the discharge voltage of capacitor (C 1 ) 3 and diode 5 exceeds 0 volts (0V) 13 and becomes a negative voltage, diode D'1
0 operates, the falling characteristic becomes steep and the waveform f-3
is shaped, and the time constant becomes Δt. Therefore, the falling time constant is τf-3. In this case, the diode
It becomes faster by the time when D'10 becomes reverse conductive, and before that, the discharge time by the PIN diode 5 becomes dominant, and the resistance (R 1 ) 2 and capacitor (C 1 ) 3 with the desired time constant becomes faster. difficult to obtain.
本発明は上記従来例の欠点に鑑み、スイツチン
グのためのオン/オフ信号の立下り波形を微分回
路で整形してバースト信号の立上り及び立下りの
時定数を等しくした新規のスイツチ回路を提供す
ることを目的とする。 In view of the above-mentioned drawbacks of the conventional example, the present invention provides a new switch circuit in which the falling waveform of the on/off signal for switching is shaped by a differentiating circuit to equalize the time constants of the rise and fall of the burst signal. The purpose is to
上記目的は、バースト信号をオン/オフするス
イツチング用のPINダイオードと、スイツチング
のための矩形波のオン/オフ信号を出力するゲー
トと、前記PINダイオードに電流を供給するバツ
フアアンプと、前記ゲートの出力端と前記バツフ
アアンプの入力端との間に接続された第一の抵抗
と前記バツフアアンプの入力端とアースの間に接
続された第一のコンデンサとからなる積分回路
と、第二のコンデンサと第二の抵抗とを直列接続
し、該第二のコンデンサを前記ゲートの出力端
に、該第二の抵抗をアースにそれぞれ接続してな
る微分回路と、前記直列接続の中点に陰極が、前
記バツフアアンプの入力端に陽極がそれぞれ接続
された制御用のダイオードとを有することを特徴
とするスイツチ回路により達成される。 The above purpose is to provide a PIN diode for switching to turn on/off a burst signal, a gate to output a square wave on/off signal for switching, a buffer amplifier to supply current to the PIN diode, and an output of the gate. an integrating circuit comprising a first resistor connected between the input terminal of the buffer amplifier and the input terminal of the buffer amplifier, and a first capacitor connected between the input terminal of the buffer amplifier and the ground; A differential circuit is connected in series with a resistor, the second capacitor is connected to the output terminal of the gate, and the second resistor is connected to the ground, and the buffer amplifier has a cathode at the midpoint of the series connection. This is achieved by a switch circuit characterized in that it has control diodes each having an anode connected to its input terminal.
以下本発明を第7図の実施例、および第8図の
オン/オフ信号波形およびスイツチング波形その
他に基づいて述べる。 The present invention will be described below based on the embodiment shown in FIG. 7, and the on/off signal waveforms, switching waveforms, etc. shown in FIG.
第7図において、ゲート1より出力されるPIN
ダイオード5をスイツチングするためのオン/オ
フ信号(第8図g)は抵抗(R1)2、コンデン
サ(C1)3によつて構成される時定数回路(積
分回路)で第8図hの如く整形される。波形hの
立上り及び立下り波形、h−1及びh−2の時定
数は等しい。該オン/オフ信号gの立下り波形g
−1はダイオードD′10を介して、抵抗(R2)
14、コンデンサ(C2)15より構成される微
分回路にて第8図iに示す波形に整形され、波形
h,iはその出力点16にて合成され波形jが整
形される。 In Figure 7, the PIN output from gate 1
The on/off signal (Fig. 8g) for switching the diode 5 is a time constant circuit (integrator circuit) composed of a resistor (R 1 ) 2 and a capacitor (C 1 ) 3, as shown in Fig. 8h. It is formatted like this. The rising and falling waveforms of waveform h and the time constants of h-1 and h-2 are equal. Falling waveform g of the on/off signal g
-1 is connected to the resistor (R 2 ) through the diode D'10.
14 and a capacitor (C 2 ) 15, the waveforms h and i are combined at the output point 16 to form a waveform j.
該波形jはバツフアアンプ17を経てスイツチ
ング部8に入力され、チヨークコイル4を介して
PINダイオード5をスイツチングし、該波形jは
該ダイオード5の容量により第8図kに示す如く
立上り波形k−1、立下り波形k−2の時定数が
ほぼ等しいバースト信号波形kに整形される。 The waveform j is inputted to the switching unit 8 via the buffer amplifier 17, and is inputted via the switch coil 4.
By switching the PIN diode 5, the waveform j is shaped by the capacitance of the diode 5 into a burst signal waveform k in which the time constants of the rising waveform k-1 and the falling waveform k-2 are almost equal, as shown in FIG. 8k. .
第9図は本発明の応用例で、同図は本発明実施
例を第1回路18とし、前記従来例の第5図を第
2回路19をバツフアアンプ12を介して接続し
たものである。但し、抵抗コンデンサの時定数は
適宜に設定する。 FIG. 9 shows an application example of the present invention, in which the embodiment of the present invention is connected to a first circuit 18, and the conventional example shown in FIG. 5 is connected to a second circuit 19 via a buffer amplifier 12. However, the time constant of the resistance capacitor should be set appropriately.
同図において、第8図gに示すオン/オフ波形
は第1回路18の積分回路の時定数抵抗(R1-1)
20、コンデンサ(C1-1)21と微分回路の時定
数抵抗(R2)14、コンデンサ(C2)15とに
よつて整形され、該整形波形はほぼ第8図jの如
くなり、波形jは正、負の電圧が用いられている
バツフアアンプ12を介して第2回路19に入力
され、第2回路19にて該波形は第5図で示した
回路動作により第8図kに示す如き立上り波形と
立下り波形の夫々の時定数が等しいバースト信号
に整形される。 In the figure, the on/off waveform shown in FIG. 8g is the time constant resistance (R 1-1 ) of the integrating circuit of the first circuit 18
20, the shaped waveform is shaped by the capacitor (C 1-1 ) 21, the time constant resistor (R 2 ) 14 of the differentiator circuit, and the capacitor (C 2 ) 15, and the shaped waveform is approximately as shown in FIG. j is input to the second circuit 19 via the buffer amplifier 12 which uses positive and negative voltages, and in the second circuit 19, the waveform is changed to the one shown in FIG. 8k by the circuit operation shown in FIG. The rising waveform and the falling waveform are shaped into a burst signal with equal time constants.
以上本発明によれば、スイツチ回路に簡単な回
路構成の微分回路を付加することによりバースト
信号の立上り、立下り波形を等しく出来る利点を
有する。 As described above, the present invention has the advantage that the rise and fall waveforms of the burst signal can be made equal by adding a differentiating circuit with a simple circuit configuration to the switch circuit.
第1図、第5図は従来例のスイツチ回路、第2
図は第1図の各点の波形、第3図は負電圧の時定
数に及ぼす影響を示す図、第4図は第3図によつ
て作られた波形、第6図は第5図によつて作られ
た波形、第7図は本発明の実施例、第8図は第7
図の各点の波形、第9図は本発明の応用例を示
す。
図中、1はゲート、2,14,20,22は抵
抗、3,6,7,15,21,23はコンデン
サ、4はチヨークコイル、5はPINダイオード、
8はスイツチ部、9は正電圧−Vaを出力するス
イツチ、10,10−1,10−2はダイオー
ド、11,11−1,11−2はダイオードの動
作抵抗、12,17はバツフアアンプ、13は0
ボルトレベル、16は出力点、18は第1回路、
19は第2回路を示す。
Figures 1 and 5 show conventional switch circuits,
The figure shows the waveform at each point in Figure 1, Figure 3 shows the influence of negative voltage on the time constant, Figure 4 shows the waveform created by Figure 3, and Figure 6 shows the waveform in Figure 5. The waveforms thus created, FIG. 7 is an embodiment of the present invention, and FIG.
The waveforms at each point in the figure, FIG. 9, show an application example of the present invention. In the figure, 1 is a gate, 2, 14, 20, 22 are resistors, 3, 6, 7, 15, 21, 23 are capacitors, 4 is a chiyoke coil, 5 is a PIN diode,
8 is a switch section, 9 is a switch that outputs a positive voltage -Va, 10, 10-1, 10-2 are diodes, 11, 11-1, 11-2 are operating resistances of the diodes, 12, 17 are buffer amplifiers, 13 is 0
Volt level, 16 is the output point, 18 is the first circuit,
19 indicates a second circuit.
Claims (1)
用のPINダイオードと、スイツチングのための矩
形波のオン/オフ信号を出力するゲートと、前記
PINダイオードに電流を供給するバツフアアンプ
と、前記ゲートの出力端と前記バツフアアンプの
入力端との間に接続された第一の抵抗と前記バツ
フアアンプの入力端とアースの間に接続された第
一のコンデンサとからなる積分回路と、第二のコ
ンデンサと第二の抵抗とを直列接続し、該第二の
コンデンサを前記ゲートの出力端に、該第二の抵
抗をアースにそれぞれ接続してなる微分回路と、
前記直列接続の中点に陰極が、前記バツフアアン
プの入力端に陽極がそれぞれ接続された制御用の
ダイオードとを有することを特徴とするスイツチ
回路。1. A PIN diode for switching to turn on/off the burst signal, a gate to output a square wave on/off signal for switching, and
a buffer amplifier that supplies current to the PIN diode; a first resistor connected between the output end of the gate and the input end of the buffer amplifier; and a first capacitor connected between the input end of the buffer amplifier and ground. and a differential circuit comprising an integrating circuit consisting of a second capacitor and a second resistor connected in series, the second capacitor being connected to the output terminal of the gate, and the second resistor being connected to the ground. and,
A switch circuit comprising a control diode having a cathode connected to the middle point of the series connection and a control diode having an anode connected to the input terminal of the buffer amplifier.
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21115181A JPS58114625A (en) | 1981-12-28 | 1981-12-28 | Switching circuit |
| US06/448,906 US4644531A (en) | 1981-04-07 | 1982-04-01 | Time division communication system |
| PCT/JP1982/000094 WO1982003515A1 (en) | 1981-04-07 | 1982-04-01 | Time-sharing communicating system |
| EP82901002A EP0075601B1 (en) | 1981-04-07 | 1982-04-01 | Time-sharing communicating system |
| DE8282901002T DE3278307D1 (en) | 1981-04-07 | 1982-04-01 | Time-sharing communicating system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21115181A JPS58114625A (en) | 1981-12-28 | 1981-12-28 | Switching circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58114625A JPS58114625A (en) | 1983-07-08 |
| JPH0412050B2 true JPH0412050B2 (en) | 1992-03-03 |
Family
ID=16601221
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21115181A Granted JPS58114625A (en) | 1981-04-07 | 1981-12-28 | Switching circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58114625A (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01115328U (en) * | 1988-01-27 | 1989-08-03 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4328598Y1 (en) * | 1964-09-03 | 1968-11-25 |
-
1981
- 1981-12-28 JP JP21115181A patent/JPS58114625A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58114625A (en) | 1983-07-08 |
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